JPS592151A - Check point recovering system - Google Patents

Check point recovering system

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Publication number
JPS592151A
JPS592151A JP57112151A JP11215182A JPS592151A JP S592151 A JPS592151 A JP S592151A JP 57112151 A JP57112151 A JP 57112151A JP 11215182 A JP11215182 A JP 11215182A JP S592151 A JPS592151 A JP S592151A
Authority
JP
Japan
Prior art keywords
memory
core memory
bulk core
management table
read
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP57112151A
Other languages
Japanese (ja)
Inventor
Yoshinori Nakai
中居 良則
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP57112151A priority Critical patent/JPS592151A/en
Publication of JPS592151A publication Critical patent/JPS592151A/en
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00Error detection; Error correction; Monitoring
    • G06F11/07Responding to the occurrence of a fault, e.g. fault tolerance
    • G06F11/14Error detection or correction of the data by redundancy in operation

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Quality & Reliability (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Retry When Errors Occur (AREA)

Abstract

PURPOSE:To shorten the time required for obtain-processing of a check point and its recovery processing, by providing a check word before and after a control table. CONSTITUTION:In case of executing the recovery processing, first of all, one of tables on a bulk core memory 3 is read, and a check word 1 is compared with a check word 2. As a result of comparison, unless both of them are equal to each other, contents of a shunting area on the memory 3 are read, and contents which are read in a corresponding table area on the memory 3 are written. Subsequently, an address of the following table existing on the memory 3 is derived, the same processing is repeated, and the processing concerned is executed as to all the control tables.

Description

【発明の詳細な説明】 〔発明の技術分野〕 本発明は、バルク・コア・メモリを用いたチェックポイ
ント・リカバリ方式に関するものである。
DETAILED DESCRIPTION OF THE INVENTION [Technical Field of the Invention] The present invention relates to a checkpoint recovery method using bulk core memory.

〔従来技術と問題点〕[Prior art and problems]

従来のオンライン・システムでは、システム9ダウンが
発生しても、それまで処理していた電文を保障するため
、リカバリを必要とする情報を更新する前にチェックポ
イントをDEAD上のファイルに取得しておき、ダウン
後のリカバリ処理でこのチェックポイント・ファイルか
ら主記憶のテーブルを復元している。この種の従来方式
では、トランザクシ叢ン発生時のチェックポイント取得
のためのファイル・アクセス時間がかなり大きい。また
、リカバリのときにもアクセス時間が太きいため、リカ
バリ全体の時間が長くなる。
In conventional online systems, even if the system 9 goes down, a checkpoint is acquired in the DEAD file before updating information that requires recovery, in order to guarantee the messages that were being processed up to that point. The main memory table is restored from this checkpoint file during the recovery process after the system goes down. In this type of conventional method, it takes a considerable amount of time to access a file to obtain a checkpoint when a transaction occurs. Furthermore, since the access time is long during recovery, the entire recovery time becomes long.

〔発明の目的〕[Purpose of the invention]

本発明は、従来の欠点を除去するものであってチェック
ポイントおよびリカバリに要していた時間を短縮すると
共に、チェックポイント・ブiグラムおよびリカバリ・
プログラムの開発を容易にできるようにしたチェックポ
イント・リカバリ方式を提供することを目的としている
The present invention eliminates the drawbacks of the prior art, reduces the time required for checkpoint and recovery, and provides
Its purpose is to provide a checkpoint recovery method that facilitates program development.

〔発明の構成〕[Structure of the invention]

そしてそのため、本発明のチェックポイント・リカバリ
方式は、中央処理装置と、主記憶と、バルク・コア・メ
モリと、入出力装置とを具備する情報処理システムにお
いて、管理テーブルの前後にチェック・ワードを設ける
と共に尚該管理テーブルを上記バルク・コア・メモリに
格納し、管理テーブルの更新を行5場合、バルク・コア
・メモリ上の管理テーブルを主記憶に読込み、読込んだ
内容をバルク・コア・メ′モリ上の退避域に書込み更新
すべき箇所を更新し、前後のチェックワードのそれぞれ
に1を加算し、しかる後に更新後の情報なバルク・コア
・メモリ上の該当する管理テーブルに書込み、リカバリ
処理を行う場合、バルク・コア・メモリ上の管理テーブ
ルを主記憶に読込み、前後のチェックワードの値が等し
いか否かを込んだ内容をバルク・コア・メモリ上の該当
する管理テーブル領域に書込み、バルク・コア・メモリ
上の次の管理テーブルのアドレスを求め、しかる後にバ
ルク・コア・メモリ上の全ての管理テーブルについての
更新処理が行われたかを調べ、行なわれていないときに
は上記の処理を繰返すことを特徴とするものである。
Therefore, the checkpoint recovery method of the present invention provides a checkpoint recovery method that stores check words before and after a management table in an information processing system that includes a central processing unit, a main memory, a bulk core memory, and an input/output device. In addition, the management table is stored in the bulk core memory, and when the management table is updated in line 5, the management table on the bulk core memory is read into the main memory, and the read contents are stored in the bulk core memory. Update the part to be updated by writing to the save area in the memory, add 1 to each of the previous and following check words, and then write the updated information to the corresponding management table in the bulk core memory. When performing recovery processing, the management table in the bulk core memory is read into main memory, and the contents including whether the values of the previous and subsequent checkwords are equal or not are written to the corresponding management table area in the bulk core memory. Write, find the address of the next management table on the bulk core memory, then check whether all management tables on the bulk core memory have been updated, and if not, perform the above process. It is characterized by repeating.

〔発明の実施例〕[Embodiments of the invention]

以下、本発明を図面を参照しつつ説明する。 Hereinafter, the present invention will be explained with reference to the drawings.

第1図は本発明が適用される情報処理システムの1例を
示す図、第2図は制御テーブルの1例を示す図、第3図
はROM (バルク・コア・メモリの略)テーブルの更
新処理を説明する図、第4図はリカバリ処理を説明する
図である。
FIG. 1 is a diagram showing an example of an information processing system to which the present invention is applied, FIG. 2 is a diagram showing an example of a control table, and FIG. 3 is a diagram showing an example of a ROM (abbreviation for bulk core memory) table. FIG. 4 is a diagram explaining the recovery process.

第1図において、1は中央処理装置、2は主記憶、3は
バルク・コア・メモリ、4は補助記憶装置、5は通信制
御装置、6はタイプライタ、7は共通バスをそれぞれ示
している。
In FIG. 1, 1 is a central processing unit, 2 is a main memory, 3 is a bulk core memory, 4 is an auxiliary storage device, 5 is a communication control device, 6 is a typewriter, and 7 is a common bus. .

バスVり・コア・メモリ3は、記憶素子として18M工
りを使用し、128にバイトのメモリ・スタックを2枚
まで実装することができるものである。
The bus V core memory 3 uses 18M metal as a storage element, and can mount up to two 128-byte memory stacks.

バルク・コア・メ千すは、 ・転送速度が早い・ ・オーバ2ンが発生しない。Bulk core mesenshu, - Fast transfer speed - ・Over-two-over does not occur.

・磁気ドラム装置をアクセスする場合と同じソフトウェ
アが使用できる。
- The same software can be used to access magnetic drum devices.

・1119(16ビツト)又は1バイト単位のプログラ
ム・アクセスができる。
- Program access is possible in 1119 (16 bits) or 1 byte units.

・バルク・コア・メモリと入出力装置間(磁気ディスク
装置など)のデータ転送ができる。
・Data transfer between bulk core memory and input/output devices (magnetic disk devices, etc.) is possible.

・機構部品がなく信頼性が高い。・High reliability as there are no mechanical parts.

、停電時又は瞬断時に記憶内容が保農される。, the memory contents are preserved in the event of a power outage or instantaneous interruption.

などの特徴ヲ有している。バルク・コア・メモリ3は、
補助記憶装置4の受信ファイル管理情報をも格納してい
る。補助記憶装置4は、回線毎の受信ファイルを格納し
ており、通信制御装置5は複数回線を収容している。
It has characteristics such as. Bulk core memory 3 is
It also stores received file management information of the auxiliary storage device 4. The auxiliary storage device 4 stores received files for each line, and the communication control device 5 accommodates a plurality of lines.

第2図はバルク・コア・メモリ3に格納されているテー
ブルの1例を示すものである。ROMテーブルの先頭の
エントリにはチェックワードlが記入され、最後のエン
トリにはチェック7=ド2が記入されている。先頭のチ
ェックワード1と最後のチェックワード20間の複数の
エントリには、ステータスや空レコード数、未送信電文
数、送信中レコード数、書込みポインタ、読込みポイン
タ、受信ファイル先頭アドレス、受信ファイルレコード
数などが記入されている。
FIG. 2 shows an example of a table stored in the bulk core memory 3. Check word 1 is written in the first entry of the ROM table, and check 7=do 2 is written in the last entry. The multiple entries between the first check word 1 and the last check word 20 include the status, number of empty records, number of unsent messages, number of records being sent, write pointer, read pointer, received file start address, and number of received file records. etc. are entered.

第3図はBOMテーブルの更新処理を説明するものであ
る。
FIG. 3 explains the BOM table update process.

■ バルク・コア・メモリ3上の該轟テーブルを主記憶
に読込む。
■ Read the Todoroki table on the bulk core memory 3 into the main memory.

■ 読込んだ内容をバルク・コア・メモリ3上の退避域
に書込む。
■ Write the read contents to the save area on bulk core memory 3.

■ 更新すべき箇所(例えば第2図の書込みポインタ)
を更新する。
■ Locations to be updated (e.g. write pointer in Figure 2)
Update.

■ チェックワード1およびチェックワード2のそれぞ
れに1を加算する。なお、初期設定時においては、チェ
ックワード1およびチェックワード2は共に零である。
■ Add 1 to each of checkword 1 and checkword 2. Note that, at the time of initial setting, check word 1 and check word 2 are both zero.

■ 更新後の情報をバルク・コア・メモリ3上のテーブ
ルに書込む。
■ Write the updated information to the table on bulk core memory 3.

更新後の情報を主記憶2からバルク・コア・メモリ3に
転送する途中でダウンが生ずると、バルク・コア・メモ
リ3のテーブルのチェックワード1とチェックワード2
が違った値となる。
If a failure occurs during the transfer of updated information from main memory 2 to bulk core memory 3, checkword 1 and checkword 2 of the table in bulk core memory 3
will have different values.

第4図は本発明におけるリカバリ処理を説明する図であ
る。
FIG. 4 is a diagram illustrating recovery processing in the present invention.

Cバルク・コア・メモリ3上のテーブルを1つ読込む。Read one table on C bulk core memory 3.

■′ チェックワード1とチェックワード2とを比較す
る。
■' Compare check word 1 and check word 2.

■′ 両者が等しいが否かを調べる。YO2の場合には
■′の処理を行い、Nτの場合にはCの処理を行う。
■′ Check whether they are equal or not. In the case of YO2, the process ``■'' is performed, and in the case of Nτ, the process C is performed.

■′ バルク・コア・メモリ3上の退避域の内容を読込
む。
■' Read the contents of the save area in bulk core memory 3.

σ バルク・コア・メモリ3上の該当テーブル領域にダ
で読込んだ内容を1込む。
σ The contents read by da are loaded into the corresponding table area on the bulk core memory 3 by 1.

じ バルク・コア・メモリ上に存在する次のテーブルの
アドレスを求める。
Find the address of the next table in bulk core memory.

■′ テーブルが終ワか否かを脚ぺる。N万 の場合に
は、■の処理に戻る。
■′ Check whether the table is finished or not. In the case of N million, return to the process of ■.

〔発明の効果〕〔Effect of the invention〕

以上の説明から明らかなように、本発明によれば、チェ
ックポイント取得処理およびリカバリ処理の時間を短縮
できること、並びにりカバリ・プログラムが単純なため
デパックの時間が少な(て済むこと等の顕著な作用効果
を奏することが出来る。
As is clear from the above description, according to the present invention, the time required for checkpoint acquisition processing and recovery processing can be shortened, and since the recovery program is simple, depacking time can be reduced. It can produce effects.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明が適用される情報処理システムの1例を
示す図、第2図は制御テーブルの1例を示す図、第3図
はBOM(バルク・コア・メモリの略)テーブルの更新
処理を説明する図、第4図はリカバリ処理を説明する図
である。 1・・・中央処理装置、2・・・主記憶、3・・・バル
ク・コア・メモリ、4・・・補助記憶装置、5・・・通
信制御装置、6・・・タイプライタ、7・・・共通バス
。 特許出願人 富士通株式会社 代理人弁理士 京 谷 四 部 才1図
FIG. 1 is a diagram showing an example of an information processing system to which the present invention is applied, FIG. 2 is a diagram showing an example of a control table, and FIG. 3 is a diagram showing an example of a BOM (abbreviation for bulk core memory) table. FIG. 4 is a diagram explaining the recovery process. DESCRIPTION OF SYMBOLS 1... Central processing unit, 2... Main memory, 3... Bulk core memory, 4... Auxiliary storage device, 5... Communication control device, 6... Typewriter, 7...・Common bus. Patent Applicant: Fujitsu Ltd. Representative Patent Attorney: Kyotani Yotsube Saizu1

Claims (1)

【特許請求の範囲】 中央処理装置と、主記憶と、バルク・コア・メモリと、
入出力装置とを具備する情報処理システムにおいて、管
理テーブルの前後にチェック・ワ。 −ドを設けると共に当該管理テーブルを上記バルク・コ
ア・メモリに格納し、管理テーブルの更新を行5場合、
バルク・コア・メモリ上の管理テーブルを主記憶に読込
んだ内容をバルク・コア・メモリ上の退避域に書込み、
更新すべき箇所を更新し、前後のチェックワードのそれ
ぞれに1を加算し、しかる後に更新後の情報をバルク・
コア・メモリ上の該浩する管理テーブルに書込み、リカ
バリ処理を行う場合、バルク・コア・メモリ上の管理テ
ーブルを主記憶に読込み、前−のチェックワードの値が
等しいか否かを調べ、両者が等しくないときには、バル
ク・コア・メモリ上の該当する退避域の内容を主記憶に
読込み、読込んだ内容をバルク・コア・メモリ上の該当
する管理テーブル−領域に書゛込み、バルク・コア・メ
モリ上の次の管理テーブルのアドレスを求め、しかる後
にバルク・コア・メモリ上の全ての管理テーブルについ
ての更新処理が行われたかを調べ、行われていないとき
には上記の処理を繰返すことを特徴とするチェックポイ
ント・リカバリ方式。
[Claims] A central processing unit, a main memory, a bulk core memory,
In an information processing system equipped with an input/output device, checks are performed before and after the management table. - When the management table is stored in the bulk core memory and the management table is updated in line 5,
The contents of the management table in the bulk core memory are read into the main memory and written to the save area in the bulk core memory.
Update the parts that should be updated, add 1 to each of the previous and following check words, and then bulk update the updated information.
When performing recovery processing by writing to the large management table in the core memory, the management table in the bulk core memory is read into the main memory, it is checked whether the values of the previous checkword are equal, and both If they are not equal, the contents of the corresponding save area in the bulk core memory are read into the main memory, the read contents are written to the corresponding management table area in the bulk core memory, and the contents are stored in the bulk core memory.・It is characterized by finding the address of the next management table in memory, and then checking whether update processing has been performed for all management tables in bulk core memory, and repeating the above processing if not. checkpoint recovery method.
JP57112151A 1982-06-29 1982-06-29 Check point recovering system Pending JPS592151A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP57112151A JPS592151A (en) 1982-06-29 1982-06-29 Check point recovering system

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JP57112151A JPS592151A (en) 1982-06-29 1982-06-29 Check point recovering system

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Publication Number Publication Date
JPS592151A true JPS592151A (en) 1984-01-07

Family

ID=14579505

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JP57112151A Pending JPS592151A (en) 1982-06-29 1982-06-29 Check point recovering system

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JP (1) JPS592151A (en)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS60235246A (en) * 1984-04-26 1985-11-21 ベー・ベー・ツエー・アクチエンゲゼルシヤフト・ブラウン・ボヴエリ・ウント・コンパニイ Method and apparatus for saving computer state against disturbance and interruption

Cited By (1)

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Publication number Priority date Publication date Assignee Title
JPS60235246A (en) * 1984-04-26 1985-11-21 ベー・ベー・ツエー・アクチエンゲゼルシヤフト・ブラウン・ボヴエリ・ウント・コンパニイ Method and apparatus for saving computer state against disturbance and interruption

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