JPS59178709U - 監視装置 - Google Patents
監視装置Info
- Publication number
- JPS59178709U JPS59178709U JP7130283U JP7130283U JPS59178709U JP S59178709 U JPS59178709 U JP S59178709U JP 7130283 U JP7130283 U JP 7130283U JP 7130283 U JP7130283 U JP 7130283U JP S59178709 U JPS59178709 U JP S59178709U
- Authority
- JP
- Japan
- Prior art keywords
- cpu
- monitoring device
- status
- memory
- display output
- Prior art date
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- Pending
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- Emergency Alarm Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は従来の監視装置の構成を示すブロック図、第２
図はこの考案の一実施例による監視装置 −め構
成を示すブロック図である。 １−０．入力回路、２２−ＣＰＵ、３２”−１−Ｆ：：
Ｉ）、４・・・表示出力、５２・・・監視装置、６・・
・メモリ、７・・・表示出力。
図はこの考案の一実施例による監視装置 −め構
成を示すブロック図である。 １−０．入力回路、２２−ＣＰＵ、３２”−１−Ｆ：：
Ｉ）、４・・・表示出力、５２・・・監視装置、６・・
・メモリ、７・・・表示出力。
Claims (1)
- プロセスや設備機器等の状態および異常を示す入力信号
が入力される入力回路と、この入力回路からの信号にも
とづいて、第１のメモリに格納されているプログラムに
したがって、ランプ等からなる第１の表示出力に状態を
表示させるＣＰＵと、異常とその原因の相関情報、およ
びトラブルシューティングフローの情報を格納する第２
のメモリと、この第２のメモリに格納されている情報に
したがって、上記入力信号の内容に対応する異常ガイダ
ンスを上記ＣＰＵからの信号にもとづいて表示するＣＲ
Ｔ等からなる第２の表示出力とを備えていることを特徴
とする監視装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7130283U JPS59178709U (ja) | 1983-05-11 | 1983-05-11 | 監視装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7130283U JPS59178709U (ja) | 1983-05-11 | 1983-05-11 | 監視装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59178709U true JPS59178709U (ja) | 1984-11-29 |
Family
ID=30201451
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7130283U Pending JPS59178709U (ja) | 1983-05-11 | 1983-05-11 | 監視装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59178709U (ja) |
-
1983
- 1983-05-11 JP JP7130283U patent/JPS59178709U/ja active Pending
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