JPS59146346A - Communication system between processes - Google Patents
Communication system between processesInfo
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- JPS59146346A JPS59146346A JP2132883A JP2132883A JPS59146346A JP S59146346 A JPS59146346 A JP S59146346A JP 2132883 A JP2132883 A JP 2132883A JP 2132883 A JP2132883 A JP 2132883A JP S59146346 A JPS59146346 A JP S59146346A
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- JP
- Japan
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- packet
- storage area
- data
- control block
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- Pending
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Abstract
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は、１つの計算機上におけるプロセス間通信又は
異なる計算機上のプロセス間通、倍力式において、成る
プロセスがメツセージ送信マクロを発行した時に、当該
プロセスから他のプロセスに対してパケットの送信が行
われると共に、当該プロセスを宛先とする他のプロセス
から送らして来ているパケットを描線プロセスに渡すよ
うにしたプロセス間通信方式に関するものである。DETAILED DESCRIPTION OF THE INVENTION [Technical Field of the Invention] The present invention provides for communication between processes on one computer or communication between processes on different computers, when a process issuing a message sending macro, This relates to an interprocess communication method in which packets are sent from the process to other processes, and packets sent from other processes whose destination is the process are passed to the line drawing process. .
計算機上のプロセスＡとプロセスＢとの通信全行うため
に、メツセージ送信マクロとメツセージ受信マクロとが
システムに用意さｔている。例えば、プロセスＡからプ
ロセスＢヘデータを送信する場合、プロセスＡは宛先プ
ロセス、データ・アドレスおよびデータ長を指定してメ
ツセージ送信マクロを発行する。メツセージ送信マクロ
は機械語に翻訳されると所定のパラメータ（ＳＶＣ番号
と同義）を持つＳＶＣ命令となるが、このＳＶＣ命令が
発行されると、ＳＶＣ割込みが生じ、ＳＶＣ割込ハンド
ラによって上記のパラメータが解析され、メツセージ送
信用処理ルーチンの実行が開始される。メツセージ送信
用処理ルーチンは、データ・アドレス、データ長および
宛先となるプロセスを調べ、メモリから上記データ・ア
ドレスおよびデータ長で指定されるデータ（バケッ）ト
Ｉｍ義）を宛先となるプロセスＢに送るための処理を行
う。In order to perform all communication between process A and process B on the computer, a message sending macro and a message receiving macro are provided in the system. For example, when sending data from process A to process B, process A issues a message sending macro specifying the destination process, data address, and data length. When the message sending macro is translated into machine language, it becomes an SVC instruction with predetermined parameters (synonymous with the SVC number), but when this SVC instruction is issued, an SVC interrupt occurs, and the SVC interrupt handler uses the above parameters. is analyzed and execution of the message sending processing routine is started. The message sending processing routine checks the data address, data length, and destination process, and sends the data (bucket) specified by the above data address and data length from memory to the destination process B. Perform processing for
プロセスＢを宛先とするパケットはメモリ上のパケット
格納域に格納され、当該パケット格納域はプロセスＢと
１対１の対応をなすプロセス制御ブロックにリンクされ
る。同様に、プロセスＡを宛先とするパケットもパケッ
ト格納域に格納され、当該パケット格納域はプロセスＡ
と１対１の対応をなすプロセス制御ブロックにリンクさ
れる。例エバ、フロセスＡが他のプロセスからのデータ
を受信する場合、プロセスＡはデータ・アドレスを指定
してメツセージ受信マクロを発行する。このメツセージ
受信マクロも機械語命令に翻訳されると他の所定パラメ
ータを持つＳｖＣ命令となる。A packet destined for process B is stored in a packet storage area in memory, and the packet storage area is linked to a process control block that has a one-to-one correspondence with process B. Similarly, packets destined for process A are also stored in the packet storage area, and the packet storage area is
The process control block has a one-to-one correspondence with the process control block. For example, when process A receives data from another process, process A issues a message receive macro specifying the data address. When this message receiving macro is also translated into a machine language instruction, it becomes an SvC instruction with other predetermined parameters.
このＳＶＣ命令が発行されると、ＳＶＣ割込みが生じ、
ＳＶＣ割込ハンドラによって上記パラメータが解析され
、メツセージ受信用処理ルーチンに制御が渡される。メ
ツセージ受信用処理ルーチンは、プロセスＡのプロセス
制御ブロックにパケット格納域がリンクされておれば、
そのパケット格納域のパケットをプロセスＡに割当てら
れているデータ領域に書込み、そのデータ長を所定のレ
ジスタにセットする。プロセスＡのプロセス制御ブロッ
クにパケット格納域がリンクされていない場合には、メ
ツセージ受信用処理ルーチンはプロセスＡを宛先とする
パケットが送られて来るのを所定時間だけ待ち、送られ
て来ると、パケットをプロセスＡのデータ領域に書込む
。所定時間たってもプロセスＡを宛先とするパケットが
送られて来なかった場合には、メツセージ受信処理ルー
チンは、所定のレジスタにデータ長Ｏを書込む。When this SVC instruction is issued, an SVC interrupt occurs,
The SVC interrupt handler analyzes the above parameters and passes control to the message reception processing routine. If the packet storage area is linked to the process control block of process A, the message reception processing routine
The packet in the packet storage area is written to the data area allocated to process A, and the data length is set in a predetermined register. If the packet storage area is not linked to the process control block of process A, the message reception processing routine waits for a predetermined period of time for a packet destined for process A to be sent, and when it is sent, Write the packet to process A's data area. If a packet destined for process A is not sent after a predetermined period of time, the message reception processing routine writes a data length O to a predetermined register.
例えば、プロセスＡからプロセスＢに大量のデータ（フ
ァイル転送など）を送シたい場合がある。For example, there are cases where process A wants to send a large amount of data (file transfer, etc.) to process B.
このような場合、一般的にはプロセスＡは連続的にメソ
セージ送信マクロを発行し、プロセスＢは連続的にメツ
セージ受信マクロを発行する。しかしながら、プロセス
ＡからプロセスＢへのデータ送信中に、プロセスＢが再
送要求や打切９要求をプロセスＡに送る場合がある。プ
ロセスＡからプロセスＢへ大量のデータを送信している
最中にプロセスＢからの再送要求や打切り要求を受信し
ようとすると、従来技術ではプロセス人はメツセージ送
信マクロとメツセージ受信マクロとを交互に発行する必
要がある。しかしながら、メツセージ受信マクロは割込
みを伴うと共に時間監視を行っているので、メツセージ
送信マクロとメツセージ受信マクロとを交互に発行する
と、オーバヘッドが増加し、計算機の処理効率が著しく
低下する。In such a case, generally process A continuously issues message sending macros, and process B continuously issues message receiving macros. However, during data transmission from process A to process B, process B may send a retransmission request or an abort 9 request to process A. If process A tries to receive a retransmission request or abort request from process B while a large amount of data is being sent to process B, in the conventional technology, the process person alternately issues message sending macros and message receiving macros. There is a need to. However, since the message reception macro involves an interrupt and monitors time, issuing the message transmission macro and the message reception macro alternately increases overhead and significantly reduces the processing efficiency of the computer.
本発明は、上記の考察に基づくものであって、成るプロ
セスＡが他のプロセスへデータを送信するとき計算機の
処理効率を低下させることなくプロセスＡを宛先とする
他プロセスからのパケットをプロセスＡが受信できるよ
うにしたプロセス間通信方式を提供することを目的とし
ている。The present invention is based on the above considerations, and the present invention is based on the above-mentioned consideration. The purpose of this project is to provide an interprocess communication method that allows data to be received.
そしてそのため、本発明のプロセス間通信方式は、計算
機上に生成された成るプロセスＡを宛先とする受信パケ
ットを上記計算機のメモリのパケット格納域に書込み、
上記プロセスＡと１対１に対応するメモリ上のプロセス
制御ブロックに上記受信パケットを収容したパケット格
納域をリンクするように構成されたプロセス間通信方式
において、プロセスＡが宛先プロセスおよびパケットを
指定してパケットを送信するための所定の命令を発行し
た時プロセスＡによって指定された送信パケットをプロ
セスＡによって指定された他のプロセスに送信するため
の処理を行うと共にプロセスＡのプロセス制御ブロック
にリンクされているパケット格納域のパケットをプロセ
スＡに渡す処理を行うメツセージ送信命令処理手段を設
けたことを特徴とするものである。Therefore, the inter-process communication method of the present invention writes a received packet destined for process A generated on a computer to a packet storage area of the memory of the computer,
In an inter-process communication method configured to link a packet storage area containing the received packet to a process control block in memory that has a one-to-one correspondence with the process A, the process A specifies the destination process and the packet. When process A issues a predetermined command to transmit a packet, it performs processing to transmit the transmission packet specified by process A to another process specified by process A, and is linked to the process control block of process A. The present invention is characterized in that a message sending command processing means is provided for passing the packets in the packet storage area to the process A.
以下、本発明を図面を参照しつつ説明する。 Hereinafter, the present invention will be explained with reference to the drawings.
第１図はメモリの構成を示す図、第２図はパケットの構
成を示す図、第３図は本発明の送信プロセスの処理の概
要を示す図、第４図は本発明のメツセージ送信処理ルー
チンの概要を示す図、第５図はパケットの受信および取
外しを説明する図である。FIG. 1 is a diagram showing the memory configuration, FIG. 2 is a diagram showing the packet configuration, FIG. 3 is a diagram showing an overview of the transmission process of the present invention, and FIG. 4 is the message transmission processing routine of the present invention. FIG. 5 is a diagram illustrating the reception and removal of packets.
第１図において、１−１ないし１−７Ｌはプロセス制御
ブロック、２−１ないし２− ｎはデータ域、３−１な
いし３− ｍはパケット格納域をそれぞれ示している。In FIG. 1, 1-1 to 1-7L indicate process control blocks, 2-1 to 2-n data areas, and 3-1 to 3-m packet storage areas, respectively.
プロセス制御ブロックは、計算機上に生成されているプ
ロセスと１対１の対応をなして設けられているものであ
如、この中には対応するプロセスに関する種々の情報が
格納されている。A process control block is provided in one-to-one correspondence with a process generated on a computer, and various information regarding the corresponding process is stored therein.
プロセスに対しては１個のデータ域が設けられている。One data area is provided for a process.
バケット格納域３−１ないし３− ｍは、プロセス間の
通信のために用いられるものである。Bucket storage areas 3-1 to 3-m are used for communication between processes.
第２図はパケットの構成を示すものである。パケットは
、送シ元プロセス識別子、宛先プロセス識別子、データ
種別、データ長およびデータなどから構成されている。FIG. 2 shows the structure of a packet. A packet is composed of a source process identifier, a destination process identifier, data type, data length, data, and the like.
データ種別とは、例えば送信データか、或はレスポンス
かを示すものである。The data type indicates, for example, transmission data or response.
第３図は送信プロセスの処理の概要を示すものである。FIG. 3 shows an overview of the transmission process.
送信プロセスは、処理を行い、メソセージ送信マクロを
発行する。メソセージ送信マクロを機械語に翻訳すると
、レジスタＸにデータ・アドレスをセットする命令、レ
ジスタＹにデータ長をセットする命令、レジスタＺに宛
先プロセス識別子をセントする命令および所定のＳｖＣ
番号を持つＳＶＣ命令に展開される。このＳＶＣ命令が
発行されると、８７０割込みが生じ、ＳＶＣ割込ハンド
ラが動作してＳＶＣ番号が解析され、メツセージ送信処
理ルーチンの実行が開始される。第４図は本発明による
メソセージ送信処理ルーチンの概要を示す図である。い
ま、プロセスＡからプロセスＢへ大量のデータを送信す
る場合を仮定する。メソセージ送信処理ルーチンは、プ
ロセスＢの制御ブロックを調べ、プロセスＢのプロセス
制御ブロックにパケットが既にキューイングされている
か否かを調べる。次に、プロセスＡのデータ域からデー
タ・アドレスおよびデータ長で指定されたデータ（パケ
ット）を取出し、このパケットをパケット格納域に書込
み、プロセスＢのプロセス制御ブロックにパケットがキ
ューイングされていない場合には当該パケット格納域を
プロセスＢのプロセス制御ブロックにリンクし、プロセ
スＢのプロセス制御ブロックに既に・ζケノトがキュー
イングされている場合には当該パケット格納域を既にキ
ューイングされている最後のパケット格納域にリンクす
る。メンセージ送信処理ルーチンは、送信パケットをプ
ロセスＢのプロセス制御ブロックにキューイングした後
、プロセスＡのプロセス制御ブロックに受信パケットが
キューイングされているか否かを調べ、キューイングさ
れている場合には、先頭のパケットをキューから取外し
、プロセスＡのデータ域に格納する。格納場所としては
、パケットを送信して空きとなった格納場所を用いるこ
とが出来る。勿論、メツセージ送信マクロを送信する際
に、プロセスＡが受信パケット格納場所を指定するよう
にしても良い。メンセージ送信処理ルーチンは、プロセ
スＡを宛先とするパケットをプロセスＡのデータ域に１
込んだ後、そのデータ長をレジスタＤにセットする。メ
ツセージ送信処理ルーチンが終了すると、プロセスＡに
制御が戻され、上記レジスタＤの内容が調べられる。レ
ジスタＤの内容が０よシ大のときは受信パケット有シと
され、そのパケットを参照する処理が行われ、レジスタ
Ｄの内容が０のときには受信パケットなしとされ、次の
パケットをプロセスＢに送るだめの処理が行われる。The send process performs processing and issues message send macros. Translating the message sending macro into machine language, it includes an instruction to set the data address in register X, an instruction to set the data length in register Y, an instruction to place the destination process identifier in register Z, and a specified SvC
It is expanded into an SVC instruction with a number. When this SVC command is issued, an 870 interrupt occurs, the SVC interrupt handler operates, the SVC number is analyzed, and execution of the message transmission processing routine is started. FIG. 4 is a diagram showing an outline of a message transmission processing routine according to the present invention. Now, assume that a large amount of data is to be sent from process A to process B. The message send processing routine examines process B's control block to see if a packet is already queued in process B's process control block. Next, extract the data (packet) specified by the data address and data length from the data area of process A, write this packet to the packet storage area, and if no packet is queued in the process control block of process B. , the packet storage area is linked to the process control block of process B, and if the process control block of process B has already been queued, the packet storage area is linked to the last queued Link to packet storage. After queuing a transmission packet in the process control block of process B, the mensage transmission processing routine checks whether a reception packet is queued in the process control block of process A, and if it is queued, Remove the first packet from the queue and store it in process A's data area. As the storage location, a storage location that becomes vacant after transmitting the packet can be used. Of course, process A may specify the storage location of the received packet when transmitting the message transmission macro. The message transmission processing routine stores a packet destined for process A in the data area of process A.
After that, set the data length in register D. When the message transmission processing routine ends, control is returned to process A, and the contents of register D are examined. When the contents of register D are greater than 0, it is assumed that there is a received packet, and processing is performed to refer to that packet.When the contents of register D is 0, it is assumed that there is no received packet, and the next packet is sent to process B. Processing for sending is performed.
第５図はパケットの受信および取外しを説明する図であ
る。第５図において、４はプロセス番号欄、５はデータ
・バケット拳エントリ欄をそれぞれ示している。FIG. 5 is a diagram illustrating reception and removal of packets. In FIG. 5, 4 indicates a process number column, and 5 indicates a data bucket entry column.
プロセス制御、ブロック１− ｎは、プロセス番号欄４
およびデータ・パケット・エントリ欄５を有している。Process control, block 1-n is process number column 4
and a data packet entry column 5.
プロセス番号欄４にはプロセス識別子が書込まれ、デー
タ・パヶソ）・・エントリ欄５にはキューイングされて
いるパケット列の先頭パヶノドを格納するパケット格納
域のアドレスが書込まれている。第５図（イ）のように
、プロセス制御ブロック１−ｎにパケットがキューイン
グされていない場合は、０がデータ・バケントψエント
リ欄５に邦込捷れる。第５図（ロ）では、プロセス制御
ブロック１−ルがパケット格納域３−Ｊをポイントし、
パケット格納域３−Ｊはパケット格納域３−Ｋをポイン
トしている。この例ではパケット格納域３−Ｋにリンク
されているパケット格納域が存在しないので、パケット
格納域３−にのポインタ欄にはＯが書込まれる。第５図
（ロ）の状態からパケット格納域３−１工のパケットを
宛先プロセスのデータ域に書込１れた後は、プロセス制
御ブロック１− ｎはパケット格納域３−Ｋをポイント
する。A process identifier is written in the process number column 4, and an address of a packet storage area for storing the first packet of the queued packet string is written in the data entry column 5. As shown in FIG. 5(a), when no packet is queued in the process control block 1-n, 0 is written to the data packet ψ entry field 5. In FIG. 5(b), the process control block 1-le points to the packet storage area 3-J,
The packet storage area 3-J points to the packet storage area 3-K. In this example, since there is no packet storage area linked to the packet storage area 3-K, O is written in the pointer column for the packet storage area 3-K. After the packet in the packet storage area 3-1 is written to the data area of the destination process from the state shown in FIG. 5(b), the process control block 1-n points to the packet storage area 3-K.
この状態は第５図（ハ）に示される。This state is shown in FIG. 5(c).
以上の説明から明らかなように、本発明によれば、成る
プロセスＡが他のプロセスにパケットを送信するだめの
命令を発行したとき、そのパケットを他のプロセスに送
信すると共に、プロセスＡを宛先とするパケットが到着
しているかを調べ、到着している場合にはそのパケット
をプロセスＡに渡しているので、プロセスＡを宛先とす
るノくケノトの受信を計算機の処理効率を低下させるこ
となく行うことが出来る。As is clear from the above description, according to the present invention, when a process A issues an instruction not to send a packet to another process, the packet is sent to the other process, and the process A is sent to the destination. It is checked whether a packet has arrived, and if it has arrived, the packet is passed to process A, so it is possible to receive messages destined for process A without reducing the processing efficiency of the computer. It can be done.
【図面の簡単な説明】
第１図はメモリの構成を示す図、第２図はパケットの構
成を示す図、第３図は本発明の送信プロセスの処理の概
要を示す図、第４図は本発明のメソセージ送信処理ルー
チンの概要を示す図、第５図はパケットの受信および取
外しを説明する図である。
１−１ないしｌ−ｎ・・・プロセス制御ブロック、２−
１ないし２− ｎ・・・データ域、３−１ないし３−ｍ
・・・パケット格納域、４・・・プロセス番号欄、５・
・・データ・パケットｅエントリ欄。
特許出願人 富士通株式会社
代理人弁理士 京 谷 四 部
第１ 口
偉ｚ１力
萼１１；蒼品＝τ″データ狸や１ テ゛−タ長 テ゛
−タブ３閏 健４圀[BRIEF DESCRIPTION OF THE DRAWINGS] FIG. 1 is a diagram showing the memory configuration, FIG. 2 is a diagram showing the packet configuration, FIG. 3 is a diagram showing an overview of the transmission process of the present invention, and FIG. FIG. 5 is a diagram showing an outline of the message transmission processing routine of the present invention, and is a diagram illustrating reception and removal of a packet. 1-1 to l-n...process control block, 2-
1 to 2-n...data area, 3-1 to 3-m
...Packet storage area, 4...Process number column, 5.
...Data packet e entry field. Patent Applicant: Fujitsu Ltd. Representative Patent Attorney Kyotani 4th Department 1 口 Wei z 1 power calyx 11; Aoshin = τ'' Data Tanukiya 1 Data head 3 tabs Ken 4
Claims (1)
パケットを上記計算機のメモリのパケット格納域に書込
み、上記プロセスＡと１対１に対応するメモリ上のプロ
セス制御ブロックに上記受信パケットを収容したパケッ
ト格納域をリンクするように構成されたプロセス間通信
方式において、プロセスＡが宛先プロセスおよびパケッ
トを指定してパケットを送信するだめの所定の命令を発
行した時プロセスＡによって指定された送信パケットを
プロセスＡによって指定された他のプロセスに送信する
だめの処理を行うと共にプロセスＡのプロセス制御ブロ
ックにリンクされているパケット格納域のパケットをプ
ロセスＡに渡す処理を行うメソセージ送信命令処理手段
を設けたことを特徴とするプロセス間通信方式。A received packet destined for process A generated on the computer was written to a packet storage area of the memory of the computer, and the received packet was stored in a process control block on the memory that corresponded one-to-one with process A. In an interprocess communication scheme configured to link packet stores, when process A issues a predetermined command to send a packet specifying a destination process and a packet, the sending packet specified by process A is sent. A message transmission command processing means is provided which performs processing to transmit a message to another process specified by process A and also performs processing to pass a packet in a packet storage area linked to a process control block of process A to process A. An inter-process communication method characterized by:
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2132883A JPS59146346A (en) | 1983-02-10 | 1983-02-10 | Communication system between processes |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2132883A JPS59146346A (en) | 1983-02-10 | 1983-02-10 | Communication system between processes |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59146346A true JPS59146346A (en) | 1984-08-22 |
Family
ID=12052068
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2132883A Pending JPS59146346A (en) | 1983-02-10 | 1983-02-10 | Communication system between processes |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59146346A (en) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61500385A (en) * | 1983-11-04 | 1986-03-06 | インモス リミテツド | microcomputer |
| JPS6215638A (en) * | 1985-07-12 | 1987-01-24 | Nec Corp | Process control method in svc routine |
| JPS62134728A (en) * | 1985-12-06 | 1987-06-17 | Nec Corp | Inter-program data transferring system |
-
1983
- 1983-02-10 JP JP2132883A patent/JPS59146346A/en active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61500385A (en) * | 1983-11-04 | 1986-03-06 | インモス リミテツド | microcomputer |
| JPS6215638A (en) * | 1985-07-12 | 1987-01-24 | Nec Corp | Process control method in svc routine |
| JPS62134728A (en) * | 1985-12-06 | 1987-06-17 | Nec Corp | Inter-program data transferring system |
| JPH0444291B2 (en) * | 1985-12-06 | 1992-07-21 | Nippon Electric Co |
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