JPS5834412U - 出力バツフア回路 - Google Patents
出力バツフア回路Info
- Publication number
- JPS5834412U JPS5834412U JP12886281U JP12886281U JPS5834412U JP S5834412 U JPS5834412 U JP S5834412U JP 12886281 U JP12886281 U JP 12886281U JP 12886281 U JP12886281 U JP 12886281U JP S5834412 U JPS5834412 U JP S5834412U
- Authority
- JP
- Japan
- Prior art keywords
- output buffer
- buffer circuit
- sets
- npn
- circuits
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
、 第1図はこの考案の一実施例に係る出力バッフ 、
子回路を示す図、第一2図はこの考案の他の実施例を示
す図である。 ■・・・インバータ、T1〜T4.T7・・・MO3型
トランジスタ、T5.T6・・・バイポーラ型NPNト
ランジスタ。
子回路を示す図、第一2図はこの考案の他の実施例を示
す図である。 ■・・・インバータ、T1〜T4.T7・・・MO3型
トランジスタ、T5.T6・・・バイポーラ型NPNト
ランジスタ。
Claims (1)
- バイポーラ型NPN )ランジスタとMO3型トランジ
スタとを組み合わせた2組の回路をダーリントン接続し
て集積回路で構成し、上記2組の回路のそれぞれNPN
トランジスタでそれぞれ電流増幅が行なわれるように
した出力バッファ回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12886281U JPS5834412U (ja) | 1981-08-31 | 1981-08-31 | 出力バツフア回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12886281U JPS5834412U (ja) | 1981-08-31 | 1981-08-31 | 出力バツフア回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5834412U true JPS5834412U (ja) | 1983-03-05 |
Family
ID=29922541
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP12886281U Pending JPS5834412U (ja) | 1981-08-31 | 1981-08-31 | 出力バツフア回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5834412U (ja) |
-
1981
- 1981-08-31 JP JP12886281U patent/JPS5834412U/ja active Pending
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