JPS583405A - Dual complementary symmetrical class b amplifier - Google Patents

Dual complementary symmetrical class b amplifier

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JPS583405A
JPS583405A JP10750282A JP10750282A JPS583405A JP S583405 A JPS583405 A JP S583405A JP 10750282 A JP10750282 A JP 10750282A JP 10750282 A JP10750282 A JP 10750282A JP S583405 A JPS583405 A JP S583405A
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JP
Japan
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transistor
amplifier
electrode
base
emitter
Prior art date
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Application number
JP10750282A
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Japanese (ja)
Inventor
デヴイツド・エイ・ホツトヴエツト
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
TERETSUKUSU KOMIYUNIKEESHIYONZ
TERETSUKUSU KOMIYUNIKEESHIYONZU Inc
Original Assignee
TERETSUKUSU KOMIYUNIKEESHIYONZ
TERETSUKUSU KOMIYUNIKEESHIYONZU Inc
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Publication date
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Pending legal-status Critical Current

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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03FAMPLIFIERS
    • H03F1/00Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
    • H03F1/32Modifications of amplifiers to reduce non-linear distortion
    • H03F1/3217Modifications of amplifiers to reduce non-linear distortion in single ended push-pull amplifiers
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03FAMPLIFIERS
    • H03F1/00Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
    • H03F1/34Negative-feedback-circuit arrangements with or without positive feedback
    • HELECTRICITY
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    • H03F3/00Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
    • H03F3/30Single-ended push-pull [SEPP] amplifiers; Phase-splitters therefor
    • H03F3/3066Single-ended push-pull [SEPP] amplifiers; Phase-splitters therefor the collectors of complementary power transistors being connected to the output
    • H03F3/3067Single-ended push-pull [SEPP] amplifiers; Phase-splitters therefor the collectors of complementary power transistors being connected to the output with asymmetrical driving of the end stage

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【発明の詳細な説明】 本発明はデュアル相補性対称B級電力増幅器の改良に係
り、一層詳輻には、かかる増幅器に1I4p!l的に存
在するクロスオーバひずみの減少に係る。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an improvement in a dual-complementary symmetrical class B power amplifier, and more particularly to an improvement in such an amplifier. This relates to the reduction of crossover distortion that exists in

従来のデュアル相補性対称B、級電カー幅器は効率の点
でも入力信号、再生の質の点でも望、ましくない−作詩
性を有する。
Conventional dual-complementary symmetric B, class power amplifiers have undesirable and undesirable performance, both in terms of efficiency and in terms of input signal and reproduction quality.

デュアル相補、!!対対称8電電力増器に関しては、そ
の多くの文献を列挙!る必要はないほどに当業者によく
知られているが、その例をあげれば米国。
Dual complementary,! ! Regarding the symmetrical 8-volt power booster, we list many documents on it! An example is the United States, which is so well known to those skilled in the art that there is no need to do so.

特許第33744414及び第39 ’00790号明
細−がある。
There are patent Nos. 33744414 and 39'00790.

本発明は、デュアル相補性対称B級電力増幅器の特性を
改曽する目的で、その出力段と信@源(典型的にはオー
ディオ周波数信号源)に接続される増幅器との闇に、低
インピーダンスの電圧増幅器を挿入皐ることを提案する
ものである・この新規な組合せにより、8級。増幅に伴
う“デッド−・バンド”が顕著に減ぜられる。B電増幅
器の出力段に於ける追加的内部フィードバックにより非
直線性が一■減ぜられ、またオーバーオニルな電圧フィ
ードバックに声すゲイン、が安定−化される。直流フィ
ードバックにより出力電圧が所望のレベルに保たれる。
The present invention aims to mimic the characteristics of a dual-complementary symmetrical class B power amplifier by adding a low-impedance amplifier between its output stage and the amplifier connected to a signal source (typically an audio frequency signal source). It is proposed to insert a voltage amplifier into the class 8. "Dead bands" associated with amplification are significantly reduced. Additional internal feedback in the output stage of the B-voltage amplifier reduces non-linearity and stabilizes the gain associated with over-the-line voltage feedback. DC feedback maintains the output voltage at the desired level.

電圧増幅器の挿入により、デュアル相補性対称ell増
幅器の入hインピーダンスが非常に低い交流インピーダ
ンスとなり、“デッド・バンド”が顕著に減ぜられると
共に、デュアル相補性対称接続の第1段トランジスタの
双方の同時導通を阻止するのに必要なマージンが確保さ
れる。
By inserting the voltage amplifier, the input impedance of the dual complementary symmetric ELL amplifier becomes a very low AC impedance, the "dead band" is significantly reduced, and the The margin necessary to prevent simultaneous conduction is ensured.

以下、図面により本発明の詳細な説明する。Hereinafter, the present invention will be explained in detail with reference to the drawings.

第1図を参照すると、駆動段を含み、適当な信号源例え
ばオーディオ信号源に接続可能な入力端子11を有し、
且レシーバ41辷接続された出力端子を有するデュアル
相補性対称B級電力増幅器10が示されている。
Referring to FIG. 1, it includes a drive stage and has an input terminal 11 connectable to a suitable signal source, for example an audio signal source;
A dual complementary symmetrical class B power amplifier 10 is shown having an output terminal connected across a receiver 41.

第1図の左半部には、ベース、エミッタ及びコレクタ電
極15.16及び17を有する信号増幅トランジスタ1
4と、エミッタ、ベース及びコレクタ電極37.38及
び39を有する電圧増幅トランジスタ36とが示されて
いる。また右半部には、デュアル相補性対称に接続され
た第1のトランジスタ対28及び32と第2のトランジ
スタ対20及び24とが示されている。
In the left half of FIG.
4 and a voltage amplification transistor 36 having emitter, base and collector electrodes 37, 38 and 39. Also shown in the right half are a first pair of transistors 28 and 32 and a second pair of transistors 20 and 24, which are connected in a dual complementary manner.

トランジスタ20はエミッタ、ベース及びコレクタ電極
21.22及び23を含み、トランジスタ24はコレク
タ、ベース及びエミッタ電極25.26及び27を含み
、トランジスタ28はエミッタ、ベース及びコレクタ電
極28.29及び3゜を含み、またトランジスタ32は
エミッタ、ベース及びコレクタ電極33.34及び35
を含んでいる。トランジスタ20及び28の伝導形式と
トランジスタ24及び32の伝導形式とは互いに反対で
ある。
Transistor 20 includes emitter, base and collector electrodes 21, 22 and 23, transistor 24 includes collector, base and emitter electrodes 25, 26 and 27, and transistor 28 includes emitter, base and collector electrodes 28, 29 and 3°. The transistor 32 also includes emitter, base and collector electrodes 33, 34 and 35.
Contains. The conduction types of transistors 20 and 28 and the conduction types of transistors 24 and 32 are opposite to each other.

トランジスタ14はコンデンサ12及び抵抗13を通じ
て入力端子11にベース電極15を接続されている。ベ
ース電極15は抵抗18とコンデンサ19との並列回路
を通じて接地点にも接続されている。トランジスタ14
のエミッタ電極16は接地点に接続されており、またト
ランジスタ14のコレクタ電極17は抵抗43.44及
び45を通じて正電源端子40に接続されている。
The base electrode 15 of the transistor 14 is connected to the input terminal 11 through the capacitor 12 and the resistor 13. The base electrode 15 is also connected to a ground point through a parallel circuit of a resistor 18 and a capacitor 19. transistor 14
The emitter electrode 16 of the transistor 14 is connected to a ground point, and the collector electrode 17 of the transistor 14 is connected to the positive power supply terminal 40 through resistors 43, 44 and 45.

トランジスタ36のコレクタ電極39はトランジスタ2
8のベース電極30と、抵抗43と、44との閤め接続
点に接続されている。トランジスタ36のベース電極3
8は抵抗45と44との閣の接続点に接続されており、
またそのエミッタ電極37はトランジスタ32のベース
電−34とトランジスタ14のコレクタ電極17とに接
続されている。
The collector electrode 39 of the transistor 36 is connected to the transistor 2
It is connected to the connection point between the base electrode 30 of No. 8, the resistors 43, and 44. Base electrode 3 of transistor 36
8 is connected to the connection point between resistors 45 and 44,
Further, the emitter electrode 37 is connected to the base electrode 34 of the transistor 32 and the collector electrode 17 of the transistor 14.

トランジスタ28のコレクタ電極31は抵抗47を通じ
て正電源端子41に、また直接にトランジスタ20のベ
ース電・極22に接続されている。
The collector electrode 31 of the transistor 28 is connected to the positive power supply terminal 41 through a resistor 47 and directly to the base electrode 22 of the transistor 20 .

トランジスタ28のエミッタ電極29は直接にトランジ
スタ32のエミッタ電極33に、抵抗49及びコンデン
サ51を通じて接地点に、また抵抗48を通じてトラン
ジスタ20及び24のコレクタ電極23及び25に接続
されている。
Emitter electrode 29 of transistor 28 is connected directly to emitter electrode 33 of transistor 32, through a resistor 49 and capacitor 51 to ground, and through resistor 48 to collector electrodes 23 and 25 of transistors 20 and 24.

トランジスタ32のコレクタ電極3′5は直接にトラン
ジスタ24のベース電極26に、また抵抗46を通じて
接地点に接続されている。トランジスタ32のエミッタ
電極33は抵抗48を通じてトランジスタ20及び24
のコレクタ電極23及び25に接続されている。
The collector electrode 3'5 of the transistor 32 is connected directly to the base electrode 26 of the transistor 24 and through a resistor 46 to ground. Emitter electrode 33 of transistor 32 is connected to transistors 20 and 24 through resistor 48.
are connected to collector electrodes 23 and 25 of.

トランジスタ20のエミッタ電極′21は゛正電置端子
40に、またそのコレクタ電極23はコンデンサ52を
通じてレシーバ41に接続されている。
The emitter electrode 21 of the transistor 20 is connected to the positive terminal 40, and the collector electrode 23 is connected to the receiver 41 through a capacitor 52.

トランジスタ24のコレクタ電極25はトランジスタ2
0のコレクタ電極2−3と接続されており、この接続点
は上記のようにコンデンサ52を通じてレシーバ41に
接続され、且抵抗50を通じてトランジスタ14のベー
ス電極15に接続されている。トランジスタ24のエミ
ッタ電極27は接地点に接続されている。
The collector electrode 25 of the transistor 24 is connected to the transistor 2
This connection point is connected to the receiver 41 through the capacitor 52 and to the base electrode 15 of the transistor 14 through the resistor 50 as described above. Emitter electrode 27 of transistor 24 is connected to ground.

1    の   の− 13     抵抗   12 kΩ 18     抵抗  100 kΩ 43     抵抗   12 kΩ 44     抵抗   2.2に0 45     抵抗   4.7にΩ 46     抵抗  330 kΩ 47     抵抗  330 k0 48     抵抗   33 kΩ 49     抵抗   12 kΩ 50     抵抗  51JOkΩ 19   コンデンサ  22p l”14トランジス
タ BC2390 2G   )ランジスタ 2N 600324   ト
5>ラスタ2N6012 28トランジスタ 2N 6012 32トランジスタ 2N 6003 36トランジスタ 2N8012 第2図には、第1図中の電圧増幅トランジスタ36が抵
抗63.64及び65からなる分圧回路内の抵抗64と
して等価的に表わされており、この抵抗64の両端が第
1図中のトランジスタ28及び32に相当するトランジ
スタ55及び59のベース電極57及び61にそれぞれ
接続されている。トランジスタ55はエミッタ、ベース
及びコレクタ電極56.57及び58を有するものとし
て、またトランジス、り59はエミッタ、ベース及びコ
レクタ電極60.61及び62を有するものとして図示
されているが、第1図の説明との藺係は明らかであろう
- 13 Resistance 12 kΩ 18 Resistance 100 kΩ 43 Resistance 12 kΩ 44 Resistance 2.2 to 0 45 Resistance 4.7 to Ω 46 Resistance 330 kΩ 47 Resistance 330 k0 48 Resistance 33 kΩ 49 Resistance 12 kΩ 50 Resistance 51JOkΩ 19 Capacitor 22p l"14 Transistor BC2390 2G) Transistor 2N 600324 5>Raster 2N6012 28 Transistor 2N 6012 32 Transistor 2N 6003 36 Transistor 2N8012 In FIG. 2, the voltage amplifying transistor 36 in FIG. The resistor 64 is equivalently represented as a resistor 64 in a voltage divider circuit, and both ends of the resistor 64 are connected to base electrodes 57 and 61 of transistors 55 and 59, which correspond to transistors 28 and 32 in FIG. Although transistor 55 is shown as having emitter, base and collector electrodes 56, 57 and 58, and transistor 59 is shown as having emitter, base and collector electrodes 60, 61 and 62. The relationship with the explanation of FIG. 1 will be obvious.

第3図には、デュアル相補性対称B級電力増幅器用の駆
動回路の典型的な公知の形式が示されており、この回路
では、エミッタ、ベース及びコレクタ電極71.72及
び73を有するトランジスタ70と、エミッタ、ベース
及びコレクタ電極75.76及び77を有するトランジ
スタ74と、一対の抵抗7B及び79とが図示のように
接続されている。
FIG. 3 shows a typical known form of a drive circuit for a dual complementary symmetrical class B power amplifier, in which a transistor 70 with emitter, base and collector electrodes 71, 72 and 73 is shown. , a transistor 74 having emitter, base and collector electrodes 75, 76 and 77, and a pair of resistors 7B and 79 are connected as shown.

第2図中の抵抗64により表わされる等価回路のインピ
ーダンスは公式 %式% により計算されるa 4a中4oo、LL、中5.00
0、Rs  (参照符@44)−2,2kΩ、R1(参
照符号45)−4,7kΩのオーディオ増幅器に対して
は、B−二」−一 、Rs −−2’032.2にΩ にΩであるから、等価インピーダンスはと計算される。
The impedance of the equivalent circuit represented by the resistor 64 in FIG. 2 is calculated by the formula % a 4oo in 4a, LL in 5.00
For an audio amplifier of 0, Rs (reference mark @44) - 2,2 kΩ, R1 (reference mark 45) - 4,7 kΩ, B-2'-1, Rs -2'032.2 to Ω. Since it is Ω, the equivalent impedance is calculated as.

上記の低い等価インピーダンスは交ll知絡回路の近似
である。その結果、電力増幅器の“デッド・バンド”は
1/4に減少し、−例では1.2vから0.3vへの減
少が達成された。
The above low equivalent impedance is an approximation of a cross-circuit circuit. As a result, the "dead band" of the power amplifier was reduced by a factor of 4 - in the example a reduction from 1.2v to 0.3v was achieved.

第1図の実施例では、更に、内部直流フィードバック即
ちトランジスタ20のコレクタ23及びトランジスタ2
4のコレクタ25から抵抗48及び49ならびにコンデ
ンサ51を通じて接地点に至る回路による交流接合接地
が行なわれている。
The embodiment of FIG. 1 further includes internal DC feedback, i.e., collector 23 of transistor 20
AC junction grounding is performed by a circuit extending from collector 25 of No. 4 through resistors 48 and 49 and capacitor 51 to a grounding point.

これは抵抗48及び49の値により定めら詐る約3.7
5の電圧ゲインを安定化する効果を有し、入力段から与
えられる信号の所要電圧を減少し、且B級増幅に伴う非
直論性を−、■減少する効果を有する。この作用は抵抗
、50及び18を通じてのオーバーオールなフィードバ
ックが作動する以前に生ずる。
This is determined by the values of resistors 48 and 49, which is approximately 3.7
This has the effect of stabilizing the voltage gain of 5, reduces the required voltage of the signal applied from the input stage, and reduces the non-direct logic associated with class B amplification. This action occurs before the overall feedback through resistors 50 and 18 is activated.

前掲の一覧表に示した部品を用いて―或された増幅器の
ゲインは46倍(34dB>であり、また直流出力電圧
は4vであり、典型的な8.5v電源と実質的に等しい
ピーク・ピーク出力電圧を生ずることが確認された。
Using the components listed in the table above - the resulting amplifier gain is 46x (>34dB) and the DC output voltage is 4V, which is essentially the same peak power as a typical 8.5V power supply. It was confirmed that the peak output voltage was generated.

本発明の範囲内で図示の実施例に種々の変形を行ない得
ることは当業者により理解されよう。
It will be understood by those skilled in the art that various modifications may be made to the illustrated embodiments without departing from the scope of the invention.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の実施例であるオーディオ周波数電力増
幅器の回路図である。 第2図は第1図中の駆動−路を等価的に示す図である。 第3rj!Jは公知の増幅器に於ける駆動回路を示す図
である。 11・・・入力端子、14・・・信号増幅トランジスタ
。 20.24.28.32・・・デュアル相補性対称接続
のトランジスタ、36・・・電圧増幅トランジスタ。 41・・・レシーバ(負荷) 特許出願人 テレックス・コミュニケーションズ・イン
コーホレイテッド
FIG. 1 is a circuit diagram of an audio frequency power amplifier according to an embodiment of the present invention. FIG. 2 is a diagram equivalently showing the driving path in FIG. 1. 3rd rj! J is a diagram showing a drive circuit in a known amplifier. 11... Input terminal, 14... Signal amplification transistor. 20.24.28.32...Dual complementary symmetrical connection transistor, 36...Voltage amplification transistor. 41...Receiver (load) Patent applicant Telex Communications, Inc.

Claims (1)

【特許請求の範囲】 互いに反対の伝導形式の第1及び第2電流制御手段を含
んでお?、入力端子と共通負荷に接続された出力端子と
を有する出力段と、 電流制御手段を含んでおり、出力端子及び入力−子を有
する入力段と、 前記入力段の出力端子を前記出力段の前記第1及び第2
電流制御手段の入力端子に接続する回路手段と、 低インピーダンス電圧増幅手段を含んでおり、信@源を
前記入力段の入力端子に接続する回路手段と を含んであることを特徴とするデュアル相補性対称8級
増幅器。
[Claims] The present invention includes first and second current control means of mutually opposite conduction type. , an output stage having an input terminal and an output terminal connected to a common load; an input stage including current control means and having an output terminal and an input terminal; Said first and second
dual complementary circuit means for connecting to the input terminal of the current control means; circuit means for connecting the signal source to the input terminal of the input stage; Symmetrical class 8 amplifier.
JP10750282A 1981-06-22 1982-06-21 Dual complementary symmetrical class b amplifier Pending JPS583405A (en)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US27585981A 1981-06-22 1981-06-22
US275859 1981-06-22

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JPS583405A true JPS583405A (en) 1983-01-10

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DE (1) DE3222931A1 (en)
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GB (1) GB2100948A (en)

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