JPS5821872U - 入出力特性試験装置 - Google Patents

入出力特性試験装置

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JPS5821872U
JPS5821872U JP11724481U JP11724481U JPS5821872U JP S5821872 U JPS5821872 U JP S5821872U JP 11724481 U JP11724481 U JP 11724481U JP 11724481 U JP11724481 U JP 11724481U JP S5821872 U JPS5821872 U JP S5821872U
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JP
Japan
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terminal
input
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input terminal
digital
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Application number
JP11724481U
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English (en)
Inventor
平川　敬久
Original Assignee
日本電気株式会社
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
図は本考案の一実施例を示す構成図である。 図において、１はトリガ部、２はバイナリカウンタ部、
３．　４．　５はＲＯＭ、（３は信号源、７はディジタ
ルレベルメータ、８は遅延回路、９゜１０はディジタル
コンパレータ、１１は判定表示部、１２は試験の対象と
なる増幅器をそれぞれ示している。

Claims (1)

    【実用新案登録請求の範囲】
  1. 電子機器の入出力特性の良否を調べる装置において、ト
    リが部とバイナリカウンタ部と、ＲＯＭ（ＲＥＡＤ　　
    ０ＮＬＹ　　ＭＥＭＯＲＹ）群と、信号源と、ディジタ
    ルレベルメータと、遅延回路と、ディジタルコンパレー
    タ群と、判定表示部とを備えて構成され、トリガ部の出
    力端子をバイナリカウンタ部の入力端子および遅延回路
    の入力端子にそれぞれ接続し、遅延回路の出力端子をデ
    ィジタルレベルメータの測定開始信号入力端子に接続し
    、前記バイナリカウンタ部の出力端子をＲＯＭ群のアド
    レス端子にそれぞれ接続し、一部ＲＯＭのデータ端子を
    信号源の入力端子に接続し、前記ディジタルレベルメー
    タのディジタルデータ出力端子をディジタルコンパレー
    タ群の一方の入力端子にそれぞれ接続し、前記以外のＲ
    ＯＭのデータ端子をディジタルコンパレータ群の他方の
    入力端子にそれぞれ接続し、ディジタルコンパレータ群
    のそレソれの出力端子および前記ディジタルレベルメー
    タの測定終了信号出力端子を判定表示部の各入力端子に
    それぞれ接続することを特徴とする入出力特性試験装置
    。　　　　−
JP11724481U 1981-08-06 1981-08-06 入出力特性試験装置 Pending JPS5821872U (ja)

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JPS5821872U true JPS5821872U (ja) 1983-02-10

Family

ID=29911432

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Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5313964A (en) * 1976-07-23 1978-02-08 Sony Corp Measurement device
JPS5455482A (en) * 1977-10-13 1979-05-02 Japan Radio Co Ltd Direct viewing device of transmission function

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5313964A (en) * 1976-07-23 1978-02-08 Sony Corp Measurement device
JPS5455482A (en) * 1977-10-13 1979-05-02 Japan Radio Co Ltd Direct viewing device of transmission function

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