JPS58127224A - Power bus coupling construction - Google Patents
Power bus coupling constructionInfo
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- JPS58127224A JPS58127224A JP57009266A JP926682A JPS58127224A JP S58127224 A JPS58127224 A JP S58127224A JP 57009266 A JP57009266 A JP 57009266A JP 926682 A JP926682 A JP 926682A JP S58127224 A JPS58127224 A JP S58127224A
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Abstract
Description
【発明の詳細な説明】
との発明は例えばプロセス制御用に、用いられるa14
頗酎のような電子ml!に適用して好適な)くワーバス
帖合114造に関し、特に一つのユニットの故障が他に
波及しない、従って信頼性の高いバワーノくスを提供で
もるパワーパス結合構造を提案しようとするものでるる
。DETAILED DESCRIPTION OF THE INVENTION The invention is directed to a14 used for example for process control.
Electronic ml like yurichu! This paper aims to propose a power path coupling structure in which a failure of one unit does not spread to other units, and therefore provides a highly reliable bower node. Ruru.
〈う6明の背景〉
一般に電子装置の構成方法として第1図に示すように機
能別或は制御系別KIgl路を一枚のプリントに収納し
、そのプリント板化されたユニット101をバックボー
ドと称する配線基板102にコネクタ103を介して装
着し、バックボード102を介してエニツ)101の相
互間が結合されて籐2蜘に示すように筐体201に収納
されるのが普通である。このような構成方法をマルチカ
ード式と呼ばれ広く一般に用いられている。従って以下
ではユニット101をカードと称することとする。<6 Background> In general, as shown in FIG. 1, as a configuration method for electronic devices, the KIgl paths for each function or control system are stored on a single printed sheet, and the printed board unit 101 is mounted on a backboard. Normally, the devices 101 are attached to a wiring board 102 (called a rattan) via a connector 103, connected to each other via a backboard 102, and housed in a housing 201 as shown in the figure. This configuration method is called a multi-card system and is widely used. Therefore, below, the unit 101 will be referred to as a card.
とζろでマルチカード式電子装置を大別すると例えば電
子計算機のように一つのカードが故障すると装置全体の
機能が停止してしまうものと、プロセス制御装置のよう
に各カードの独立性が高く一つのカードの故障はそのカ
ードが受持つ制御系だけ機能が停止するものとがある。Broadly speaking, multi-card electronic equipment can be divided into those such as computers, where if one card fails, the entire equipment will stop functioning, and those such as process control equipment, where each card is highly independent. When a single card malfunctions, only the control system that is in charge of that card may stop functioning.
この発明は後者の形式の電子装置を対称とするものであ
り、一つのカードの故障が他に波及しないパワーパス結
合構造を提案するものである。This invention is aimed at the latter type of electronic device, and proposes a power path coupling structure in which a failure of one card does not affect other cards.
くパワーバスの説明〉
マルチカード式を採るとき第3図に示すように各カード
101a〜101nには給電系ブロック301かりパワ
ーパス302を介して電力が送給される。Description of Power Bus> When a multi-card system is adopted, power is supplied to each card 101a to 101n via a power supply block 301 and a power path 302, as shown in FIG.
こ\で例えにカード1011の故障が他のカード101
b〜101nの動作に影響を与えないときカード101
aを抜き*り、正常晶と交換する等の操作を村なえはプ
ロセスの操業を維持できる。この場合帖亀糸ブロック3
01の故障に際しても同様にプロセスの操業を維持する
ためには第4図に示すように帽電糸ブロックを301m
、301bの如く並列attMすれによい。第4図に示
す401は受電端子忙示す。この受電端子401は例え
ば第2図にボした1体201の背面に設けられる。For example, if card 1011 malfunctions, other card 101
Card 101 when it does not affect the operation of b to 101n.
Muranae can maintain the operation of the process by removing * a and replacing it with a normal crystal. In this case, Chokameito block 3
In order to maintain the operation of the process even in the event of a breakdown of
, 301b, parallel attM is sufficient. 401 shown in FIG. 4 indicates a power receiving terminal. This power receiving terminal 401 is provided, for example, on the back side of the unit 201 shown in FIG. 2.
帖電糸ブロック301畠、301bは例えば第5図にン
バすように二系統の給電線501&と501bを通じて
同一の電圧、va、vbを受電し、出力線502.50
3.504に互KJ!なる電圧vm、vm、Vsを出力
する。尚出力lll1!505a警報信号Pの出力軸、
b06は共通電位線である。これら出力#502〜50
6が第3図に示したパワーパス302を構成する。この
パワーパス302にW子St器tm成するカード101
m、101b、***5lQlnが第4図に示すようE
l!合される。The electric wire blocks 301 and 301b receive the same voltage, va, and vb through two power supply lines 501& and 501b, as shown in FIG. 5, for example, and the output lines 502.50
Mutual KJ at 3.504! It outputs voltages vm, vm, and Vs. Furthermore, the output shaft of the output lll1!505a alarm signal P,
b06 is a common potential line. These outputs #502-50
6 constitutes the power path 302 shown in FIG. A card 101 that is connected to this power path 302
m, 101b, ***5lQln as shown in Figure 4.
l! will be combined.
く従来の欠点〉
カード101a〜101nの中で例えば共通電位に対し
短絡事故が起きると仮に給電系プルツクを第4図に示し
九ように二重化し九としてもパワーパス302は機能を
消失し、装置全体に影響を及はす。またパワーパス30
2によシ異なる電圧がカード101&−101nK供給
されている状況において嶌い電圧の給電線が低い電圧の
給電巌に混触し九とすると全てのカード101m−10
1n内に設は九低い電圧で動作する回路が破損するおそ
れがある。If a short-circuit accident with respect to the common potential occurs in the cards 101a to 101n, the power path 302 will lose its function even if the power supply system pulls are duplicated as shown in FIG. It affects the whole. Also power pass 30
2. In a situation where different voltages are supplied to the cards 101 & -101nK, if a lower voltage power supply line comes into contact with a lower voltage power supply line, and 9, all cards 101m-10
If the voltage is set within 1n, there is a risk of damage to circuits that operate at low voltages.
〈発明の目的〉
この発明はカード内において電源線が共通電位に接触す
る短絡事故が起きた場合にも及び高電圧−が低電圧11
に混触し九場合にもパワーパス302を保護し、他に影
響を与える仁とのないパワーパ □ス結合構造を提
供するKある。<Object of the Invention> This invention is applicable even when a short circuit accident occurs in a card where a power line comes into contact with a common potential.
□Provides a power path coupling structure that protects the power path 302 even if it comes into contact with other components and does not affect other components.
〈発明の41を費〉
ζO発明ではパワーパス30!と各カードと0間にヒユ
ーズ或はノーヒユーズブレーカのような過電流保躾手段
を接続すると共に少なくとも低い電圧で動作する回路と
並列に過電圧保験手威を接続し、カード内で如何なる故
障が起きても、重要カード外で混触事故が起きてもパワ
ーパス302及び低電圧で動作する回路を保護すること
ができるように構成したものである。<41 spent on invention> Power pass 30 for ζO invention! An overcurrent protection means such as a fuse or a no-fuse breaker is connected between each card and each card, and an overvoltage protection means is connected at least in parallel with a circuit that operates at a low voltage to prevent any failure within the card. Even if a cross-contact accident occurs outside the important card, the power path 302 and the circuits that operate at low voltage can be protected.
〈発明の構成〉
第6図にこの発明の一実施例を示す。5oiat301
bは給電系ブロックを示す、給電系ブーツタ301a、
301bの出力III!02.SO8及び共通電位95
06が互に共通接続されてパワーパス302として導出
される。この例では給電II!501&と501bから
24ボルトの直流電圧を受けて出力@502と共通[5
06rtlJK24dtkト0直流電圧を出力し、出力
*SOSと共通電位@SO・関に5ボルトの直流電圧を
出力するようにした場合を示す。601は24ボルトの
電圧を5ボルトの電圧に降圧するための電圧レギエレー
ノを示す。<Configuration of the Invention> FIG. 6 shows an embodiment of the invention. 5oiat301
b indicates a power supply system block, a power supply system booter 301a;
Output III of 301b! 02. SO8 and common potential 95
06 are commonly connected to each other and derived as a power path 302. In this example, power supply II! Receives 24 volt DC voltage from 501& and 501b and outputs @502 and common [5
06rtlJK24dtk 0 DC voltage is output, and a 5 volt DC voltage is output between the output *SOS and the common potential @SO. Reference numeral 601 indicates a voltage regieleno for stepping down a voltage of 24 volts to a voltage of 5 volts.
この発明においてはパワーノくス302と各カード10
1a〜101nの間に電流制限手段602を接続すると
共に、各カード101a〜101nに設けられた低圧回
路603と並列に電圧制限子R604を接続するもので
ある。電流制限子R602は例、ttfヒユーズ或はノ
ーヒユーズブレーカ等を用いることができる。ま九電圧
制限手検604はツェナーダイオード又轢過電圧を構出
してオフに動作するリレー接点を用いることができる。In this invention, the power node 302 and each card 10
A current limiting means 602 is connected between the cards 1a to 101n, and a voltage limiter R604 is connected in parallel with the low voltage circuit 603 provided in each card 101a to 101n. For example, a TTF fuse or a no-fuse breaker can be used as the current limiter R602. The voltage limit check 604 can use a Zener diode or a relay contact that creates an overvoltage and turns off.
第7図にその具体例を示す。wiJ7図の例で祉電流制
限手段602としてヒユーズを用い、電圧制限手渡60
4としてツエナータ′イオードを用いた場合を示す。A specific example is shown in FIG. In the example shown in Figure wiJ7, a fuse is used as the current limiting means 602, and the voltage limiting device 60
4 shows the case where a zenata' diode is used.
〈発明の作用効果〉 −
このように各カード101a〜101mと)くワーノ(
ス302の間に電流制限手段602を接続したことによ
pカード101a〜101n内において共通電位に対す
る短絡事故が起きたとしてもその短絡事故により過電流
が流れると電流制限手段602が応動し、過電流を連断
すると共に)くワーノくス302から故障部所を切離し
、パワーバス3o8を保護する。よって各カード101
a〜101m内において電源線の短絡事故が起き九とし
ても故障し九カードがパワーバスjO2から1動的に切
離され、他への影畳が阻止される。<Operation and Effect of the Invention> - In this way, each card 101a to 101m)
Even if a short circuit to the common potential occurs in the p cards 101a to 101n by connecting the current limiting means 602 between the terminals 302, if an overcurrent flows due to the short circuit, the current limiting means 602 will respond. At the same time as disconnecting the current, the faulty part is disconnected from the bus 302 to protect the power bus 3o8. Therefore, each card 101
A short-circuit accident in the power supply line occurs within 101 m of a to 101m, and the 9th card malfunctions, and the 9th card is dynamically disconnected from the power bus jO2, preventing the impact on others.
一方、高圧側の9502と低圧側40@!503が混触
し九場合KFi電圧制限手段・04が応動し、低電圧で
動作する回路603の制限電!E以上0電圧が回路60
3に与えられることを阻止す為。よってこのような混触
事故が起きても低電圧で動作する回路603を保躾する
ことかで11J1゜よってパワーパス302の信頼性を
向上できる。On the other hand, 9502 on the high pressure side and 40 on the low pressure side! If 503 is in contact, KFi voltage limiting means 04 responds and limits the voltage of circuit 603, which operates at low voltage! 0 voltage above E is circuit 60
To prevent it from being given to 3. Therefore, even if such a cross-contact accident occurs, the reliability of the power path 302 can be improved by maintaining the circuit 603 that operates at low voltage.
尚、給電プpツク301m、30ib内にも電流制限手
段602と電圧制限手9604が駿けられる。Note that current limiting means 602 and voltage limiting means 9604 are also provided in the power supply ports 301m and 30ib.
給電系ブロック301m、30ib内0電流制限手段6
02はカードとバス3(l関に設は九電流制繊手段60
2と同様に短絡電流のよ5fk過電流を検出してオフと
なるヒユーズ又鉱ノーヒエーズブレーカを用いることが
できる。具体的には第7図に示すようにヒユーズを用い
る仁とがで、自、過電流に応動してオフに動作し、給電
−501m、501bに接続された電源を保−する。ま
九給電系ブロック301畠、301bK設けた電圧制限
手段604は例えは電圧レギュレータ601の故障によ
シ出力巌503の電圧が規定値よシ上昇すること及びバ
ス302@から侵入した過電圧を制限して電圧レギュレ
ータ601及びカード内の低圧で動作する回路603を
保賎する。0 current limiting means 6 in power supply system block 301m, 30ib
02 is the card and the bus 3
Similarly to 2, a fuse or no fuse breaker that turns off when it detects a 5fk overcurrent such as a short circuit current can be used. Specifically, as shown in FIG. 7, a fuse is used, which turns off in response to an overcurrent and maintains the power supply connected to the power supplies 501m and 501b. The voltage limiting means 604 provided in the power supply system blocks 301 and 301bK limits the voltage of the output pin 503 from rising above the specified value due to a failure of the voltage regulator 601, and limits the overvoltage that enters from the bus 302@. This protects the voltage regulator 601 and the circuit 603 that operates at low voltage within the card.
また給電系ブロック301m、301b内には給電縁5
01 m 、 50 l b及び出力@503と直列に
直列保護手段605を接続する。仁の直列保腫手*60
5Fi、例えば第7図に示すようにダイオードを用いる
ことができ、給電9501 a又Fi501bの何れか
一方の障害が他方の給電系に波及することを阻止するた
めに設けられる。また出力縁503と直列接続した直列
保護手段605は例えば電圧レギュレータ601の故障
によシレギヱレータ601の出力電圧が異常に低下した
とき、その電圧降下をバス302に出力しないように動
作する。In addition, there is a power supply edge 5 in the power supply system blocks 301m and 301b.
A series protection means 605 is connected in series with 01 m, 50 lb and the output @503. Jin's serial hold hands *60
5Fi, for example, a diode can be used as shown in FIG. 7, and is provided to prevent a failure in either the power supply 9501a or the Fi 501b from spreading to the other power supply system. Further, a series protection means 605 connected in series with the output edge 503 operates to prevent the voltage drop from being output to the bus 302 when the output voltage of the oscillator 601 drops abnormally due to a failure of the voltage regulator 601, for example.
以上説明したようにこの発明によれば、被数Oカードに
分割されて動作する電子機器において、カード内におい
て短絡事故が起きてもパワーパス302を保−できる。As described above, according to the present invention, in an electronic device that operates by being divided into O cards, the power path 302 can be maintained even if a short circuit occurs within the card.
を九高圧と低圧の電!1502.503が混触しても低
電圧で動作する囲路603を抹暎することができ信頼性
の高い電子機器を提供できる。The nine high voltage and low voltage electricity! Even if 1502.503 comes into contact, the enclosure 603, which operates at low voltage, can be destroyed, and a highly reliable electronic device can be provided.
4、 )−11jil CO*+ 4Lな説明第1図は
マルチカード式の電子機器の構造を説明するための斜視
図、第2図はその電子機器の外観を示す斜視図、@3図
及びJlJ図はマルチカード式電子憎器のパワーバスを
説明するためのブロック図、第5図は給電系ブロックの
機能を説明するlこめのブロック図、第6図はこの発明
の一実施例を示すブロック図、第7図はこの発明の具体
的な実施レリをホす接続図である。4, )-11jil CO*+ 4L Explanation Figure 1 is a perspective view to explain the structure of a multi-card electronic device, Figure 2 is a perspective view showing the external appearance of the electronic device, Figure @3 and JlJ The figure is a block diagram for explaining the power bus of a multi-card type electronic power supply device, FIG. 7 are connection diagrams showing a concrete implementation of the present invention.
101 a〜101 n :カード、102:バンクプ
レート、103:コネクタ、201:筐体、302:パ
ワーバス、301m、301b :給電系ブレツク、6
01:%圧しギュレータ、602:電流11III限′
=F−鯨、603:低電圧で動作する回路、604:電
圧制限手段、605:直列保農手島%奸出願人 株式
会社北辰電機製作所代理人 単針 卓101 a to 101 n: Card, 102: Bank plate, 103: Connector, 201: Housing, 302: Power bus, 301m, 301b: Power supply system block, 6
01: % pressure regulator, 602: Current 11III limit'
=F-whale, 603: Circuit that operates at low voltage, 604: Voltage limiting means, 605: Series bonding agent Taku Single Needle, Applicant Hokushin Electric Works Co., Ltd.
Claims (1)
のユニットと、これら複数のユニットにこれら竹ユニッ
トで必要とする互に異なる電圧を供給するパワーパスと
、上記各ユニットとパワーI(スとの間に11列に挿入
し九電流制限手段と、上記各ユニットの少なくとも低圧
動作回路に並列接続し九′−圧制限手段とを具備して成
る)くワーノ(ス結合栖遺。(1) A co-contributor unit with multiple circuits that operate at different voltages, a power path that supplies these multiple units with the different voltages required by the bamboo units, and a power I (9 current limiting means inserted in 11 rows between the above-mentioned units and 9' voltage limiting means connected in parallel to at least the low voltage operating circuit of each unit).
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57009266A JPS58127224A (en) | 1982-01-22 | 1982-01-22 | Power bus coupling construction |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57009266A JPS58127224A (en) | 1982-01-22 | 1982-01-22 | Power bus coupling construction |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS58127224A true JPS58127224A (en) | 1983-07-29 |
Family
ID=11715632
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57009266A Pending JPS58127224A (en) | 1982-01-22 | 1982-01-22 | Power bus coupling construction |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58127224A (en) |
-
1982
- 1982-01-22 JP JP57009266A patent/JPS58127224A/en active Pending
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