JPS58116684U - パワ−オンクリア回路 - Google Patents

パワ−オンクリア回路

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Publication number
JPS58116684U
JPS58116684U JP1332482U JP1332482U JPS58116684U JP S58116684 U JPS58116684 U JP S58116684U JP 1332482 U JP1332482 U JP 1332482U JP 1332482 U JP1332482 U JP 1332482U JP S58116684 U JPS58116684 U JP S58116684U
Authority
JP
Japan
Prior art keywords
power
clear circuit
circuit
output
clear
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP1332482U
Other languages
English (en)
Inventor
中林　靖
Original Assignee
セイコーインスツルメンツ株式会社
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Filing date
Publication date
Application filed by セイコーインスツルメンツ株式会社 filed Critical セイコーインスツルメンツ株式会社
Priority to JP1332482U priority Critical patent/JPS58116684U/ja
Publication of JPS58116684U publication Critical patent/JPS58116684U/ja
Pending legal-status Critical Current

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  • Electronic Switches (AREA)
  • Electromechanical Clocks (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は、従来のパワーオンクリア回路図、第２図は第
１図を説明するタイムチャート、第３図はこの考案を示
すブロック図、第４図は第３図を説明するタイムチャー
トである。 １・・・発振回路、２・・・分周回路、３・・・昇圧回
路、４・・田シック、５」・・コンデンサ、６・・・Ｐ
チャンネルトランジスタ、７・・・インバータ、８・・
・ＮＡＮＤゲート。

Claims (1)

    【実用新案登録請求の範囲】
  1. 、　　　電源間にコンデンサと抵抗を直列に蒙続した微
    分回路の出力と昇圧回路の出力を２人カゲートで受ける
    ように構成したパワーオンクリア回路。
JP1332482U 1982-02-02 1982-02-02 パワ−オンクリア回路 Pending JPS58116684U (ja)

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JP1332482U JPS58116684U (ja) 1982-02-02 1982-02-02 パワ−オンクリア回路

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP1332482U JPS58116684U (ja) 1982-02-02 1982-02-02 パワ−オンクリア回路

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JPS58116684U true JPS58116684U (ja) 1983-08-09

Family

ID=30025845

Family Applications (1)

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JP1332482U Pending JPS58116684U (ja) 1982-02-02 1982-02-02 パワ−オンクリア回路

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