JPS58101339U - テ−プレコ−ダの表示装置 - Google Patents
テ−プレコ−ダの表示装置Info
- Publication number
- JPS58101339U JPS58101339U JP19625881U JP19625881U JPS58101339U JP S58101339 U JPS58101339 U JP S58101339U JP 19625881 U JP19625881 U JP 19625881U JP 19625881 U JP19625881 U JP 19625881U JP S58101339 U JPS58101339 U JP S58101339U
- Authority
- JP
- Japan
- Prior art keywords
- playback
- rewind
- fast
- tape recorder
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図はこの考案に係るテープレコーダの表示装置の第
1の実施例を示すブロック回路構成図、第2図6↓同第
1の★流側の表示素子をパネル上に配設しf状態を示す
正面図、第3図及び第4図は第2図 それぞれ同第1の実施例の変形例を示すブロック回路構
成図、第5図はこの考案の第2の実施例を−示すブロッ
ク回路構成図、第6図及び第7母はそれぞれ同第2の実
施例の変形例を示すブロック回−路構成図である。
− 11−LSI、 12乃至17−・・スイッチ、18・
・・電源端子、19・・・アンド回路、′2−O・・・
電源端子、−21・・・ナンド回路、22・・・アンド
回路、23・・・電源端子、24・・・ナンド回路、2
5−/ット回路、26・・−パルス発振回路、27−A
SOパルス信号発生回路、28.29・・・ナンド回路
、30乃至32−・・接続端子、33; 34−・・
アンド回路、35.−36−=・電源端子、−37・・
・再生ヘッド、3B−・・信号処理回路、39−・・分
周回路、40−・・安定回路、41−・・オア回路、4
2・・・アンド回路、43・・・′ASOパルス信号発
生回路、44−・・ナンド回路、−−45・・・アンド
回路、46−・・接続端子、47−・・オア回路、48
.49−・・接続端子、50−・・電源端子、51・・
−再生ヘッド、5鼾・・信号処理回路、53・・・分局
回路、54・・・安定回路。
1の実施例を示すブロック回路構成図、第2図6↓同第
1の★流側の表示素子をパネル上に配設しf状態を示す
正面図、第3図及び第4図は第2図 それぞれ同第1の実施例の変形例を示すブロック回路構
成図、第5図はこの考案の第2の実施例を−示すブロッ
ク回路構成図、第6図及び第7母はそれぞれ同第2の実
施例の変形例を示すブロック回−路構成図である。
− 11−LSI、 12乃至17−・・スイッチ、18・
・・電源端子、19・・・アンド回路、′2−O・・・
電源端子、−21・・・ナンド回路、22・・・アンド
回路、23・・・電源端子、24・・・ナンド回路、2
5−/ット回路、26・・−パルス発振回路、27−A
SOパルス信号発生回路、28.29・・・ナンド回路
、30乃至32−・・接続端子、33; 34−・・
アンド回路、35.−36−=・電源端子、−37・・
・再生ヘッド、3B−・・信号処理回路、39−・・分
周回路、40−・・安定回路、41−・・オア回路、4
2・・・アンド回路、43・・・′ASOパルス信号発
生回路、44−・・ナンド回路、−−45・・・アンド
回路、46−・・接続端子、47−・・オア回路、48
.49−・・接続端子、50−・・電源端子、51・・
−再生ヘッド、5鼾・・信号処理回路、53・・・分局
回路、54・・・安定回路。
Claims (1)
- 再生操作子と早送りまたは巻戻し操作子とを複合的に操
作することによって早送り再生及び巻戻し再生動作を行
な゛い得るテープレ−コーグにおいて、前記再生、早送
り及び巻戻し操作子毎にそれぞれ設けられ該再生、早送
り及び巻戻し操作子の各操作に連動して駆動今れる再生
、早送り及び巻戻し状態表示用の第1乃至第3の表示素
子どJ前記再生操作子ど前記早送りまたは巻戻し操作子
とが複合的に操作された状態で前記第1の表示素子と前
記第2または第iの表示素子とのうち一方の表示素子を
点滅駆動させる信号を出力する発振回路とを具備し、前
記早送り再生及び巻戻し再生状態で前記第1の表示素子
と前記第2及び第3の表示素子とのうち一方を点滅させ
他方を点灯させてなる− ことを特徴とするテープ
レコーダの表示装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19625881U JPS58101339U (ja) | 1981-12-26 | 1981-12-26 | テ−プレコ−ダの表示装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19625881U JPS58101339U (ja) | 1981-12-26 | 1981-12-26 | テ−プレコ−ダの表示装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS58101339U true JPS58101339U (ja) | 1983-07-09 |
Family
ID=30109505
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP19625881U Pending JPS58101339U (ja) | 1981-12-26 | 1981-12-26 | テ−プレコ−ダの表示装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58101339U (ja) |
-
1981
- 1981-12-26 JP JP19625881U patent/JPS58101339U/ja active Pending
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