JPH0981211A - 表示回路およびプログラマブルコントローラ - Google Patents
表示回路およびプログラマブルコントローラInfo
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- JPH0981211A JPH0981211A JP23707895A JP23707895A JPH0981211A JP H0981211 A JPH0981211 A JP H0981211A JP 23707895 A JP23707895 A JP 23707895A JP 23707895 A JP23707895 A JP 23707895A JP H0981211 A JPH0981211 A JP H0981211A
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Abstract
(57)【要約】
【目的】消費電流を低減する。
【構成】ラッチ２０にデータが書き込まれると、値が１
のビット出力に接続するトランジスタスイッチ７２はオ
ン状態となり、定電流源７３よりの電流はオン状態とな
ったトランジスタスイッチを流れ、対応するLED７１に
は流れない。よって、このLED７１は点灯しない。一
方、値が0のビット出力に接続するトランジスタスイッ
チ７２はオフ状態となり、定電流源７３よりの電流はオ
フ状態となったトランジスタスイッチは流れずに、対応
するLED７１を流れる。よって、このLED７１は点灯する
ことになる。 【構成】直列にLEDを駆動することにより並列に駆動す
る場合に比べ消費電流が低減される。
のビット出力に接続するトランジスタスイッチ７２はオ
ン状態となり、定電流源７３よりの電流はオン状態とな
ったトランジスタスイッチを流れ、対応するLED７１に
は流れない。よって、このLED７１は点灯しない。一
方、値が0のビット出力に接続するトランジスタスイッ
チ７２はオフ状態となり、定電流源７３よりの電流はオ
フ状態となったトランジスタスイッチは流れずに、対応
するLED７１を流れる。よって、このLED７１は点灯する
ことになる。 【構成】直列にLEDを駆動することにより並列に駆動す
る場合に比べ消費電流が低減される。
Description
【０００１】
【産業上の利用分野】本発明はプログラマブルコントロ
ーラの入出力部などに用いられる表示回路の省電力化の
技術に関するものである。
ーラの入出力部などに用いられる表示回路の省電力化の
技術に関するものである。
【０００２】
【従来の技術】図１に従来のプログラマブルコントロー
ラの内部構成を図６に示す。
ラの内部構成を図６に示す。
【０００３】図中、１はＣＰＵ、２は表示部、３は入力
部、４は出力部、５はメモリ、６は入出力ポートであ
る。
部、４は出力部、５はメモリ、６は入出力ポートであ
る。
【０００４】このような構成にプログラマブルコントロ
ーラにおいて、CPU１は、ポート６から取り込んだユー
ザプログラムをメモリ５に取り込む。そして、以降は入
力部から取り込んだ制御対象の状態を表すデータや、ポ
ートから取り込んだスイッチ設定等の入力に応じた処理
を、メモリ５に取り込んだユーザプログラムに従って実
行し、結果を出力部から制御対象に出力し、制御対象を
制御する。
ーラにおいて、CPU１は、ポート６から取り込んだユー
ザプログラムをメモリ５に取り込む。そして、以降は入
力部から取り込んだ制御対象の状態を表すデータや、ポ
ートから取り込んだスイッチ設定等の入力に応じた処理
を、メモリ５に取り込んだユーザプログラムに従って実
行し、結果を出力部から制御対象に出力し、制御対象を
制御する。
【０００５】このような処理に際して、CPU１は、出力
部４から出力したデータの値等を表示部２を用いて表示
する。
部４から出力したデータの値等を表示部２を用いて表示
する。
【０００６】表示部の構成を図７に示す。
【０００７】図示するように、表示部２は、ラッチ２
０、LED２１、抵抗２２より構成される。ラッチ２０の
各ビット出力は、それぞれ異なるLED21のカソード側に
接続し、ラッチ２０の各ビット入力はCPU１にバスを介
して接続している。また、各LED21のアノード側は対応
する抵抗２２を介して５Ｖの電源２３に接続している。
このような構成において、CPU１よりラッチ２０にデー
タが書き込まれると、値が０のビットに対応するビット
出力に接続するLED21には抵抗を介して電源２３より順
電流が流れ点灯する。一方、値が１のビットに対応する
ビット出力に接続するLED21は順電流が流れず点灯しな
い。
０、LED２１、抵抗２２より構成される。ラッチ２０の
各ビット出力は、それぞれ異なるLED21のカソード側に
接続し、ラッチ２０の各ビット入力はCPU１にバスを介
して接続している。また、各LED21のアノード側は対応
する抵抗２２を介して５Ｖの電源２３に接続している。
このような構成において、CPU１よりラッチ２０にデー
タが書き込まれると、値が０のビットに対応するビット
出力に接続するLED21には抵抗を介して電源２３より順
電流が流れ点灯する。一方、値が１のビットに対応する
ビット出力に接続するLED21は順電流が流れず点灯しな
い。
【０００８】次に、入力部３の構成を図８に示す。
【０００９】図示するように、入力部３は、ラッチ３
０、フォトカプラ３１、抵抗３２、LED３３、抵抗３４
より構成される。ラッチ２０の各ビット出力は、CPU１
とバスによって接続している。また、ラッチ３０の各ビ
ット入力毎にフォトカプラ３１、抵抗３２、LED３３、
抵抗３４の組が設けられている。いま、ラッチ３０の一
つのビットに着目して説明すると、外部のスイッチ３５
がオンのときには、電源３７、フォトカプラ３１中のLE
D、外部スイッチ３５の順に電流が流れ、フォトカプラ
３１中のフォトトランジスタがオンする。そうすると、
電源３６、抵抗３４、LED３３、抵抗３４、フォトカプ
ラ３１中のフォトトランジスタ、接地電位３８の順に電
流が流れLED３３が点灯する。また、LED31のカソード側
はローレベルの電位となり、ラッチ３０の対応するビッ
トには値０が取り込まれる。一方、外部のスイッチ３５
がオフのときには、フォトカプラ３１中のフォトトラン
ジスタがオフのままであり、LED31には電流は流れず点
灯しない。また、LED３１のカソード側は、電源３６に
よってプルアップされた状態となり、その電位はハイレ
ベルの電位となる。したがい、この場合にはラッチ３０
の対応するビットに値１が取り込まれる。
０、フォトカプラ３１、抵抗３２、LED３３、抵抗３４
より構成される。ラッチ２０の各ビット出力は、CPU１
とバスによって接続している。また、ラッチ３０の各ビ
ット入力毎にフォトカプラ３１、抵抗３２、LED３３、
抵抗３４の組が設けられている。いま、ラッチ３０の一
つのビットに着目して説明すると、外部のスイッチ３５
がオンのときには、電源３７、フォトカプラ３１中のLE
D、外部スイッチ３５の順に電流が流れ、フォトカプラ
３１中のフォトトランジスタがオンする。そうすると、
電源３６、抵抗３４、LED３３、抵抗３４、フォトカプ
ラ３１中のフォトトランジスタ、接地電位３８の順に電
流が流れLED３３が点灯する。また、LED31のカソード側
はローレベルの電位となり、ラッチ３０の対応するビッ
トには値０が取り込まれる。一方、外部のスイッチ３５
がオフのときには、フォトカプラ３１中のフォトトラン
ジスタがオフのままであり、LED31には電流は流れず点
灯しない。また、LED３１のカソード側は、電源３６に
よってプルアップされた状態となり、その電位はハイレ
ベルの電位となる。したがい、この場合にはラッチ３０
の対応するビットに値１が取り込まれる。
【００１０】すなわち、ラッチ３０に取り込まれるデー
タの、オン状態のスイッチに対応するビットは１に、オ
フ状態にあるスイッチに対応するビットは０になる。ま
た、オン状態のスイッチに対応するLED31は点灯し、オ
フ状態にあるスイッチに対応するLED31は点灯しない。
タの、オン状態のスイッチに対応するビットは１に、オ
フ状態にあるスイッチに対応するビットは０になる。ま
た、オン状態のスイッチに対応するLED31は点灯し、オ
フ状態にあるスイッチに対応するLED31は点灯しない。
【００１１】次に、出力部４の構成を図９に示す。図示
するように、出力部４は、ラッチ４０、フォトカプラ４
１より構成される。
するように、出力部４は、ラッチ４０、フォトカプラ４
１より構成される。
【００１２】ラッチ４０のの各ビット出力は、それぞれ
異なるフォトカプラ４１中のLEDに接続し、ラッチ２０
の各ビット入力はCPU１にバスを介して接続している。
異なるフォトカプラ４１中のLEDに接続し、ラッチ２０
の各ビット入力はCPU１にバスを介して接続している。
【００１３】このような構成において、CPU１よりラッ
チ２０にデータが書き込まれると、値が０のビットに対
応するビット出力に接続するフォトカプラ４１中のLED
には電源４２より順電流が流れ、フォトカプラ４１中の
フォトダイオードがオンする。一方、値が１のビットに
対応するビット出力に接続するフォトカプラ４１中のLE
Dには電源４２より順電流が流れず、フォトカプラ４１
中のフォトダイオードはオフ状態となる。
チ２０にデータが書き込まれると、値が０のビットに対
応するビット出力に接続するフォトカプラ４１中のLED
には電源４２より順電流が流れ、フォトカプラ４１中の
フォトダイオードがオンする。一方、値が１のビットに
対応するビット出力に接続するフォトカプラ４１中のLE
Dには電源４２より順電流が流れず、フォトカプラ４１
中のフォトダイオードはオフ状態となる。
【００１４】
【発明が解決しようとする課第】さて、先に説明した表
示部２や、出力部４や、入力部３の消費電流は、できる
だけ小さくすることが好ましい。
示部２や、出力部４や、入力部３の消費電流は、できる
だけ小さくすることが好ましい。
【００１５】すなわち、消費電流が大きい場合には、用
意しなければならない電源を大容量化することが必要と
なるだけでなく、電源板の大形化や、消費発熱量の増大
を招き、プログラマブルコントローラを小型化すること
が困難となる。
意しなければならない電源を大容量化することが必要と
なるだけでなく、電源板の大形化や、消費発熱量の増大
を招き、プログラマブルコントローラを小型化すること
が困難となる。
【００１６】そこで、より消費電流の小さな表示回路
や、出力回路や、入力回路を提供することを目的とす
る。
や、出力回路や、入力回路を提供することを目的とす
る。
【００１７】
【課第を解決するための手段】前記目的達成のために本
発明は、たとえば、定電流源と、前記定電流源と直列に
接続された複数の、直列に接続された発光素子と、各発
光素子に対応して設けられた、対応する発光素子に並列
に接続されたバイパス回路とを有し、前記バイパス回路
は、供給される制御信号に応じて、対応する発光素子の
両端を、対応する発光素子の抵抗値に比べ充分に小さな
抵抗値をもって短絡することを特徴とする表示回路を提
供する。
発明は、たとえば、定電流源と、前記定電流源と直列に
接続された複数の、直列に接続された発光素子と、各発
光素子に対応して設けられた、対応する発光素子に並列
に接続されたバイパス回路とを有し、前記バイパス回路
は、供給される制御信号に応じて、対応する発光素子の
両端を、対応する発光素子の抵抗値に比べ充分に小さな
抵抗値をもって短絡することを特徴とする表示回路を提
供する。
【００１８】
【作用】本発明に係る表示回路によれば、あるバイパス
回路が供給される制御信号に応じて、対応する発光素子
の両端を短絡すると、定電流源からの電流は、この短絡
された電流路を流れ、対応する発光素子には流れない。
したがい、この発光素子は点灯しない。一方、バイパス
回路が対応する発光素子の両端を短絡していないときに
は、定電流源からの電流は、発光素子を流れるので、発
光素子は点灯する。
回路が供給される制御信号に応じて、対応する発光素子
の両端を短絡すると、定電流源からの電流は、この短絡
された電流路を流れ、対応する発光素子には流れない。
したがい、この発光素子は点灯しない。一方、バイパス
回路が対応する発光素子の両端を短絡していないときに
は、定電流源からの電流は、発光素子を流れるので、発
光素子は点灯する。
【００１９】すなわち、本発明では、各発光素子を直列
に接続して、定電流源からの定電流によって駆動し、発
光素子の点灯、非点灯の制御を、各発光素子に対応して
設けたバイパス回路を制御することにより行うことがで
きる。ここで、定電流源よりの定電流によって、直列に
各発光素子を駆動するコトに要する消費電流は、、先に
図７に示したように並列に発光素子を駆動する場合に比
べ少なくてすむ。
に接続して、定電流源からの定電流によって駆動し、発
光素子の点灯、非点灯の制御を、各発光素子に対応して
設けたバイパス回路を制御することにより行うことがで
きる。ここで、定電流源よりの定電流によって、直列に
各発光素子を駆動するコトに要する消費電流は、、先に
図７に示したように並列に発光素子を駆動する場合に比
べ少なくてすむ。
【００２０】
【実施例】以下、本発明の一実施例について説明する。
【００２１】まず、第１の実施例について説明する。
【００２２】図１に、本第１実施例に係るプログラマブ
ルコントローラの構成を示す。
ルコントローラの構成を示す。
【００２３】図中、１はＣＰＵ、７は表示部、３は入力
部、４は出力部、５はメモリ、６は入出力ポートであ
る。すなわち、本第１実施例に係るプログラマブルコン
トローラの構成は、図６に示した従来のプログラマブル
コントローラの構成と、ほぼ同様であり、表示部2の内
部構成のみが異なる。
部、４は出力部、５はメモリ、６は入出力ポートであ
る。すなわち、本第１実施例に係るプログラマブルコン
トローラの構成は、図６に示した従来のプログラマブル
コントローラの構成と、ほぼ同様であり、表示部2の内
部構成のみが異なる。
【００２４】図２に、本第１実施例に係る表示部７の内
部構成を示す。
部構成を示す。
【００２５】図示するように、本第１実施例に係る表示
部７は、ラッチ７０、LED７１、トランジスタスイッチ
７２、定電流源73より構成される。ラッチ２０の各ビッ
ト出力は、それぞれ異なるトランジスタスイッチ７２の
ベースに接続し、ラッチ２０の各ビット入力はCPU１に
バスを介して接続している。
部７は、ラッチ７０、LED７１、トランジスタスイッチ
７２、定電流源73より構成される。ラッチ２０の各ビッ
ト出力は、それぞれ異なるトランジスタスイッチ７２の
ベースに接続し、ラッチ２０の各ビット入力はCPU１に
バスを介して接続している。
【００２６】また、複数のLED７１と定電流源７３が直
列に接続されており、各LED７１の両端には、それぞれ
異なるトランジスタスイッチ７２のコレクタ、エミッタ
に接続している。
列に接続されており、各LED７１の両端には、それぞれ
異なるトランジスタスイッチ７２のコレクタ、エミッタ
に接続している。
【００２７】このような構成において、CPU１よりラッ
チ２０にデータが書き込まれると、値が１のビットに対
応するビット出力に接続するトランジスタスイッチ７２
はオン状態となり、定電流源７３よりの電流は、オン状
態となったトランジスタスイッチのコレクタ、エミッタ
間を流れ、このコレクタ、エミッタの間に接続されたLE
D７１には流れない。したがい、このLED７１は点灯しな
い。一方、値が0のビットに対応するビット出力に接続
するトランジスタスイッチ７２はオフ状態となり、定電
流源７３よりの電流は、オフ状態となったトランジスタ
スイッチのコレクタ、エミッタ間には流れずに、このコ
レクタ、エミッタの間に接続されたLED７１を流れる。
したがい、このLED７１は点灯することになる。
チ２０にデータが書き込まれると、値が１のビットに対
応するビット出力に接続するトランジスタスイッチ７２
はオン状態となり、定電流源７３よりの電流は、オン状
態となったトランジスタスイッチのコレクタ、エミッタ
間を流れ、このコレクタ、エミッタの間に接続されたLE
D７１には流れない。したがい、このLED７１は点灯しな
い。一方、値が0のビットに対応するビット出力に接続
するトランジスタスイッチ７２はオフ状態となり、定電
流源７３よりの電流は、オフ状態となったトランジスタ
スイッチのコレクタ、エミッタ間には流れずに、このコ
レクタ、エミッタの間に接続されたLED７１を流れる。
したがい、このLED７１は点灯することになる。
【００２８】このように、本第１実施例では、各LED71
を、定電流源７３よりの定電流によって、直列に駆動し
ている。したがい、先に図７に示したように並列に各LE
Dを駆動する場合に比べ消費電流は少なくてすむ。たと
えば、一つのLEDに４mAの電流を供給する必要がある場
合を考えると、従来は、４mA×LEDの個数分の消費電流
が必要であったのに対し、本実施例では消費電流は4 m
Aですむ。ただし、実際には、LEDの電圧降下が存在する
ので、LEDの個数が多い場合には、図２に示した表示部
を複数設ける必要があるが、この場合でも従来に比べ消
費電流は少なくて済む。
を、定電流源７３よりの定電流によって、直列に駆動し
ている。したがい、先に図７に示したように並列に各LE
Dを駆動する場合に比べ消費電流は少なくてすむ。たと
えば、一つのLEDに４mAの電流を供給する必要がある場
合を考えると、従来は、４mA×LEDの個数分の消費電流
が必要であったのに対し、本実施例では消費電流は4 m
Aですむ。ただし、実際には、LEDの電圧降下が存在する
ので、LEDの個数が多い場合には、図２に示した表示部
を複数設ける必要があるが、この場合でも従来に比べ消
費電流は少なくて済む。
【００２９】以上、本発明の第１実施例について説明し
た。
た。
【００３０】次に、本発明の第２実施例について説明す
る。
る。
【００３１】図３に、本第２実施例に係るプログラマブ
ルコントローラの構成を示す。
ルコントローラの構成を示す。
【００３２】図中、１はＣＰＵ、８は入力部、９は出力
部、５はメモリ、６は入出力ポートである。すなわち、
本第１実施例に係るプログラマブルコントローラの構成
は、図６に示した従来のプログラマブルコントローラの
構成より表示部２を省略した構成となっている。また、
入力部と出力部の内部構成が図６に示したものとは異な
る。また、本第２実施例では、CPU１は、入力部８より
外部スイッチの状態をバスを介してではなく、シリアル
入出力線を介して直接取り込むようにしている。ただ
し、これはバスを介して取り込むようにしてもよい。
部、５はメモリ、６は入出力ポートである。すなわち、
本第１実施例に係るプログラマブルコントローラの構成
は、図６に示した従来のプログラマブルコントローラの
構成より表示部２を省略した構成となっている。また、
入力部と出力部の内部構成が図６に示したものとは異な
る。また、本第２実施例では、CPU１は、入力部８より
外部スイッチの状態をバスを介してではなく、シリアル
入出力線を介して直接取り込むようにしている。ただ
し、これはバスを介して取り込むようにしてもよい。
【００３３】図４に、本第２実施例に係る入力部８の構
成を示す。
成を示す。
【００３４】図示するように、入力部８は、ラッチ８
０、トランジスタスイッチ８２、LED81,、フォトカプラ
８３、定電流源８４から構成される。ラッチ８０の各ビ
ット入力は、CPU１とバスによって接続している。ま
た、ラッチ80の各ビット出力には、トランジスタスイッ
チ８２のベースが接続している。また、定電流源８４、
LED81 、外部スイッチ３５、LED81 、....外部スイッチ
３５、フォトカプラ８３、定電流源８３の順に直列に接
続されており、各トランジスタスイッチ８２のエミッタ
とコレクタは、直列に接続されたLED81のアノードと、
外部スイッチ３５のLED81のカソードに接続していない
端にそれぞれ接続されている。
０、トランジスタスイッチ８２、LED81,、フォトカプラ
８３、定電流源８４から構成される。ラッチ８０の各ビ
ット入力は、CPU１とバスによって接続している。ま
た、ラッチ80の各ビット出力には、トランジスタスイッ
チ８２のベースが接続している。また、定電流源８４、
LED81 、外部スイッチ３５、LED81 、....外部スイッチ
３５、フォトカプラ８３、定電流源８３の順に直列に接
続されており、各トランジスタスイッチ８２のエミッタ
とコレクタは、直列に接続されたLED81のアノードと、
外部スイッチ３５のLED81のカソードに接続していない
端にそれぞれ接続されている。
【００３５】このような構成において、CPU1は、ラッチ
８０に１ビットのみが値０で、他のビットの値が１のデ
ータを書き込む。このようにすると、値が１のビット出
力に接続したトランジスタスイッチ８２はオン状態とな
り、値が０のビット出力に接続したトランジスタスイッ
チ８２のみがオフ状態となる。このようにすると、定電
流源８３からオン状態であるトランジスタスイッチ８２
のコレクタに供給された電流はオトランジスタスイッチ
８２を流れ、外部スイッチ３５の状態にかかわらずにオ
ン状態であるトランジスタスイッチ８２のコレクタ、エ
ミッタ間に接続されたLED81、外部スイッチ３５は流れ
ない。一方、定電流源８３からオフ状態であるトランジ
スタスイッチ８２のコレクタに供給された電流はオフ状
態であるトランジスタスイッチ８２を流れずに、外部ス
イッチ３５の状態がオンであれば、オフ状態のトランジ
スタスイッチ８２のコレクタ、エミッタ間に接続された
LED81、外部スイッチ３５に流れる。また、外部スイッ
チ３５の状態がオフであれば、オフ状態のトランジスタ
スイッチ８２のコレクタ、エミッタ間に接続されたLED8
1、外部スイッチ３５に電流は流れない。
８０に１ビットのみが値０で、他のビットの値が１のデ
ータを書き込む。このようにすると、値が１のビット出
力に接続したトランジスタスイッチ８２はオン状態とな
り、値が０のビット出力に接続したトランジスタスイッ
チ８２のみがオフ状態となる。このようにすると、定電
流源８３からオン状態であるトランジスタスイッチ８２
のコレクタに供給された電流はオトランジスタスイッチ
８２を流れ、外部スイッチ３５の状態にかかわらずにオ
ン状態であるトランジスタスイッチ８２のコレクタ、エ
ミッタ間に接続されたLED81、外部スイッチ３５は流れ
ない。一方、定電流源８３からオフ状態であるトランジ
スタスイッチ８２のコレクタに供給された電流はオフ状
態であるトランジスタスイッチ８２を流れずに、外部ス
イッチ３５の状態がオンであれば、オフ状態のトランジ
スタスイッチ８２のコレクタ、エミッタ間に接続された
LED81、外部スイッチ３５に流れる。また、外部スイッ
チ３５の状態がオフであれば、オフ状態のトランジスタ
スイッチ８２のコレクタ、エミッタ間に接続されたLED8
1、外部スイッチ３５に電流は流れない。
【００３６】したがって、フォトカプラ８３には、オフ
状態のトランジスタスイッチ８２のコレクタ、エミッタ
間に接続された外部スイッチ３５がオン状態の場合のみ
電流が流れる。したがい、フォトカプラ８３によってこ
の電流を検出することができ、CPU1は、この検出値を取
り込むことにより、ラッチ８０の値０のビットに対応す
る外部スイッチ３５の状態を知ることができる。
状態のトランジスタスイッチ８２のコレクタ、エミッタ
間に接続された外部スイッチ３５がオン状態の場合のみ
電流が流れる。したがい、フォトカプラ８３によってこ
の電流を検出することができ、CPU1は、この検出値を取
り込むことにより、ラッチ８０の値０のビットに対応す
る外部スイッチ３５の状態を知ることができる。
【００３７】また、オフ状態のトランジスタスイッチ８
２のコレクタ、エミッタ間に接続されたLED３１にの
み、オフ状態のトランジスタスイッチ８２のコレクタ、
エミッタ間に接続された外部スイッチ３５がオン状態の
場合に電流が流れる、点灯する。オフ状態のトランジス
タスイッチ８２のコレクタ、エミッタ間に接続された外
部スイッチ３５がオフ状態の場合には、いずれのLED８
１にも電流は流れない。
２のコレクタ、エミッタ間に接続されたLED３１にの
み、オフ状態のトランジスタスイッチ８２のコレクタ、
エミッタ間に接続された外部スイッチ３５がオン状態の
場合に電流が流れる、点灯する。オフ状態のトランジス
タスイッチ８２のコレクタ、エミッタ間に接続された外
部スイッチ３５がオフ状態の場合には、いずれのLED８
１にも電流は流れない。
【００３８】このような動作において、CPU1は、値０の
ラッチ８０のビットがひとつづつサイクリックにずれて
いくようにデータを順次書き込み、書き込み毎にフォト
カプラ８３の検出値を取り込む。これにより、スキャン
方式により外部スイッチの状態をひとつずつ順次取り込
むことができる。また、このような動作において、オン
状態の外部スイッチに対応するLED８１のみに断続的に
電流が流れ点灯することになる。なお、このCPU1の動作
がある程度以上高速であれば、オン状態の外部スイッチ
に対応するLED81は、実質的に連続点灯することにな
る。
ラッチ８０のビットがひとつづつサイクリックにずれて
いくようにデータを順次書き込み、書き込み毎にフォト
カプラ８３の検出値を取り込む。これにより、スキャン
方式により外部スイッチの状態をひとつずつ順次取り込
むことができる。また、このような動作において、オン
状態の外部スイッチに対応するLED８１のみに断続的に
電流が流れ点灯することになる。なお、このCPU1の動作
がある程度以上高速であれば、オン状態の外部スイッチ
に対応するLED81は、実質的に連続点灯することにな
る。
【００３９】次に、本第２実施例に係る出力部９の構成
を図５に示す。
を図５に示す。
【００４０】図示するように、本第２実施例に係る外部
スイッチ９は、ラッチ９０、トランジスタスイッチ９
２、LED９１、フォトカプラ９３、定電流源９４から構
成される。ラッチ９０の各ビット入力は、CPU１とバス
によって接続している。また、ラッチ９０の各ビット出
力には、トランジスタスイッチ９２のベースが接続して
いる。また、定電流源９４、LED９１ 、フォトカプラ９
３、LE９１ 、....フォトカプラ９３、定電流源９４の
順に直列に接続されており、各トランジスタスイッチ９
２のエミッタとコレクタは、直列に接続されたLED９１
のアノードと、フォトカプラ９３のLED９１のカソード
に接続していない端にそれぞれ接続されている。
スイッチ９は、ラッチ９０、トランジスタスイッチ９
２、LED９１、フォトカプラ９３、定電流源９４から構
成される。ラッチ９０の各ビット入力は、CPU１とバス
によって接続している。また、ラッチ９０の各ビット出
力には、トランジスタスイッチ９２のベースが接続して
いる。また、定電流源９４、LED９１ 、フォトカプラ９
３、LE９１ 、....フォトカプラ９３、定電流源９４の
順に直列に接続されており、各トランジスタスイッチ９
２のエミッタとコレクタは、直列に接続されたLED９１
のアノードと、フォトカプラ９３のLED９１のカソード
に接続していない端にそれぞれ接続されている。
【００４１】このような構成において、ラッチ９０にCP
U１からデータが書き込まれると、値が１のビット出力
に接続されたトランジスタスイッチ９２はオン状態とな
り、定電流源９３から供給された電流が流れ、コレクタ
とエミッタ間に接続されたLED91とフォトカプラ９３に
は流れない。したがって、このLED91は点灯せず、フォ
トカプラ９３よりの出力もなされない。
U１からデータが書き込まれると、値が１のビット出力
に接続されたトランジスタスイッチ９２はオン状態とな
り、定電流源９３から供給された電流が流れ、コレクタ
とエミッタ間に接続されたLED91とフォトカプラ９３に
は流れない。したがって、このLED91は点灯せず、フォ
トカプラ９３よりの出力もなされない。
【００４２】一方、値が０のビット出力に接続されたト
ランジスタスイッチ９２はオフ状態となり、定電流源９
３から供給された電流はトランジスタスイッチ９２を流
れず、コレクタとエミッタ間に接続されたLED91とフォ
トカプラ９３に流れることになる。したがって、このLE
D91は点灯し、フォトカプラ９３より出力がなされるこ
とになる。
ランジスタスイッチ９２はオフ状態となり、定電流源９
３から供給された電流はトランジスタスイッチ９２を流
れず、コレクタとエミッタ間に接続されたLED91とフォ
トカプラ９３に流れることになる。したがって、このLE
D91は点灯し、フォトカプラ９３より出力がなされるこ
とになる。
【００４３】以上のように、本第２実施例の出力部で
は、出力を行う複数のフォトカプラと出力状態を表示す
る複数のLEDとを直列に接続し、駆動する。したがい、
図９に示したように出力を行うフォトカプラを並列に駆
動し、かつ、図９に示すように、別途表示部でLEDを並
列に駆動し出力状態を表示していた従来にくらべ、消費
電流は少なくて済む。たとえば、各フォトカプラに１0m
Aの電流を、各LE Dに４mAの電流を供給する場合を考え
ると、従来は（１０+４）×出力数分の電流を消費する
が、本第２実施例によれば１０mAの電流を消費するだけ
で足りる。ただし、出力数が多い場合には、図５に示し
た出力部を複数設ける必要があるが、この場合でも従来
より消費電流は少なくて済む。
は、出力を行う複数のフォトカプラと出力状態を表示す
る複数のLEDとを直列に接続し、駆動する。したがい、
図９に示したように出力を行うフォトカプラを並列に駆
動し、かつ、図９に示すように、別途表示部でLEDを並
列に駆動し出力状態を表示していた従来にくらべ、消費
電流は少なくて済む。たとえば、各フォトカプラに１0m
Aの電流を、各LE Dに４mAの電流を供給する場合を考え
ると、従来は（１０+４）×出力数分の電流を消費する
が、本第２実施例によれば１０mAの電流を消費するだけ
で足りる。ただし、出力数が多い場合には、図５に示し
た出力部を複数設ける必要があるが、この場合でも従来
より消費電流は少なくて済む。
【００４４】また、同様に、本第２実施例の入力部で
は、外部スイッチの状態を取り込むフォトカプラと外部
スイッチによる入力状態を表示する複数のLEDとを直列
に接続し駆動する。したがい、図８に示したようにフォ
トカプラを外部スイッチの状態に応じて並列に駆動し、
かつ、LEDを並列に駆動して入力状態を表示していた従
来にくらべ、消費電流は少なくて済む。たとえば、フォ
トカプラに１0mAの電流を、各LE Dに４mAの電流を供給
する場合を考えると、従来は（１０+４）×入力数分の
電流を消費するが、本第２実施例によれば１０mAの電流
を消費するのみで足りる。ただし、入力数が多い場合に
は、図４に示した入力部を複数設ける必要が、この場合
でも従来より消費電流は少なくて済む。
は、外部スイッチの状態を取り込むフォトカプラと外部
スイッチによる入力状態を表示する複数のLEDとを直列
に接続し駆動する。したがい、図８に示したようにフォ
トカプラを外部スイッチの状態に応じて並列に駆動し、
かつ、LEDを並列に駆動して入力状態を表示していた従
来にくらべ、消費電流は少なくて済む。たとえば、フォ
トカプラに１0mAの電流を、各LE Dに４mAの電流を供給
する場合を考えると、従来は（１０+４）×入力数分の
電流を消費するが、本第２実施例によれば１０mAの電流
を消費するのみで足りる。ただし、入力数が多い場合に
は、図４に示した入力部を複数設ける必要が、この場合
でも従来より消費電流は少なくて済む。
【００４５】以上本発明の実施例について説明した。以
上説明してきたように、本発明の実施例によれば消費電
流を低減することができ、また、これに応じて消費電力
や発熱量を低減することができる。
上説明してきたように、本発明の実施例によれば消費電
流を低減することができ、また、これに応じて消費電力
や発熱量を低減することができる。
【００４６】
【発明の効果】以上のように、本発明によれば、より消
費電流の小さな表示回路や、出力回路や、入力回路を提
供することができる。
費電流の小さな表示回路や、出力回路や、入力回路を提
供することができる。
【図１】本発明の第１実施例に係るプログラマブルコン
トローラの構成を示すブロック図である。
トローラの構成を示すブロック図である。
【図２】本発明の第１実施例に係る表示部の内部構成を
示す図である。
示す図である。
【図３】本発明の第２実施例に係るプログラマブルコン
トローラの構成を示すブロック図である。
トローラの構成を示すブロック図である。
【図４】本発明の第２実施例に係る入力部の内部構成を
示す図である。
示す図である。
【図５】本発明の第１実施例に係る出力部の内部構成を
示す図である。
示す図である。
【図６】従来のプログラマブルコントローラの構成を示
すブロック図である。
すブロック図である。
【図７】従来の表示部の構成を示す図である。
【図８】従来の入力部の構成を示す図である。
【図９】従来の出力部の構成を示す図である。
１ ＣＰＵ ７…表示部 ３、8…入力部 ４、9…出力部 ５…メモリ ６…入出力ポート
Claims (4)
- 【請求項１】定電流源と、前記定電流源と直列に接続さ
れた複数の、直列に接続された発光素子と、各発光素子
に対応して設けられた、対応する発光素子に並列に接続
されたバイパス回路とを有し、 前記バイパス回路は、供給される制御信号に応じて、対
応する発光素子の両端を、対応する発光素子の抵抗値に
比べ充分に小さな抵抗値をもって短絡することを特徴と
する表示回路。 - 【請求項２】直列に接続された発光素子と出力素子より
なる、複数の直列に接続した出力表示回路と、前記複数
の出力表示回路と直列に接続した定電流源と、前記各出
力表示回路に対応して設けられた、対応する出力表示回
路に並列に接続されたバイパス回路とを供え、 前記バイパス回路は、供給される制御信号に応じて、対
応する発出力表示回路の両端を、対応する出力表示回路
の抵抗値に比べ充分に小さな抵抗値をもって短絡するこ
とを特徴とする出力回路。 - 【請求項３】直列に接続された発光素子と出力素子より
なる、複数の直列に接続した入力表示回路と、前記複数
の入力表示回路に直列に接続した検知素子と、前記複数
の入力表示回路に直列に接続した定電流源と、前記各出
力表示回路に対応して設けられた、対応する出力表示回
路に並列に接続されたバイパス回路とを供え、 前記バイパス回路は、供給される制御信号に応じて、対
応する発出力表示回路の両端を、対応する出力表示回路
の抵抗値に比べ充分に小さな抵抗値をもって短絡するこ
とを特徴とする出力回路。 - 【請求項４】請求項１記載の表示回路と、前記表示回路
に前記制御信号を供給するプロセッサとを有することを
特徴とするプログラマブルコントローラ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23707895A JPH0981211A (ja) | 1995-09-14 | 1995-09-14 | 表示回路およびプログラマブルコントローラ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23707895A JPH0981211A (ja) | 1995-09-14 | 1995-09-14 | 表示回路およびプログラマブルコントローラ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0981211A true JPH0981211A (ja) | 1997-03-28 |
Family
ID=17010094
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23707895A Pending JPH0981211A (ja) | 1995-09-14 | 1995-09-14 | 表示回路およびプログラマブルコントローラ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0981211A (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2003054844A1 (en) * | 2001-12-20 | 2003-07-03 | Koninklijke Philips Electronics N.V. | Active matrix electroluminescent display device |
| JP2005195761A (ja) * | 2004-01-05 | 2005-07-21 | Fuji Electric Ind Co Ltd | 点滅回路内蔵型表示灯 |
| US7425801B2 (en) | 2003-04-01 | 2008-09-16 | Hunet Display Technology Inc. | LED driving device for multiple color LED displays |
| US8044898B2 (en) | 2007-04-16 | 2011-10-25 | Nagano Keiki Co., Ltd. | LED display apparatus having a column and row controller |
| US8207691B2 (en) | 2005-04-08 | 2012-06-26 | Eldolab Holding B.V. | Methods and apparatus for operating groups of high-power LEDS |
| US8284133B2 (en) | 2006-02-22 | 2012-10-09 | Samsung Electronics Co., Ltd. | Light emitting apparatus and control method thereof |
-
1995
- 1995-09-14 JP JP23707895A patent/JPH0981211A/ja active Pending
Cited By (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2003054844A1 (en) * | 2001-12-20 | 2003-07-03 | Koninklijke Philips Electronics N.V. | Active matrix electroluminescent display device |
| US7129914B2 (en) * | 2001-12-20 | 2006-10-31 | Koninklijke Philips Electronics N. V. | Active matrix electroluminescent display device |
| US7425801B2 (en) | 2003-04-01 | 2008-09-16 | Hunet Display Technology Inc. | LED driving device for multiple color LED displays |
| JP2005195761A (ja) * | 2004-01-05 | 2005-07-21 | Fuji Electric Ind Co Ltd | 点滅回路内蔵型表示灯 |
| US8207691B2 (en) | 2005-04-08 | 2012-06-26 | Eldolab Holding B.V. | Methods and apparatus for operating groups of high-power LEDS |
| US8853972B2 (en) | 2005-04-08 | 2014-10-07 | Eldolab Holding B.V. | Methods and apparatuses for operating groups of high-power LEDs |
| US9560707B2 (en) | 2005-04-08 | 2017-01-31 | Eldolab Holding B.V. | Methods and apparatuses for operating groups of high-power LEDs |
| US9936546B2 (en) | 2005-04-08 | 2018-04-03 | Eldolab Holding B.V. | Methods and apparatuses for operating groups of high-power LEDs |
| US8284133B2 (en) | 2006-02-22 | 2012-10-09 | Samsung Electronics Co., Ltd. | Light emitting apparatus and control method thereof |
| US8044898B2 (en) | 2007-04-16 | 2011-10-25 | Nagano Keiki Co., Ltd. | LED display apparatus having a column and row controller |
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