JPH09232871A - 逓倍回路 - Google Patents
逓倍回路Info
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- JPH09232871A JPH09232871A JP3163696A JP3163696A JPH09232871A JP H09232871 A JPH09232871 A JP H09232871A JP 3163696 A JP3163696 A JP 3163696A JP 3163696 A JP3163696 A JP 3163696A JP H09232871 A JPH09232871 A JP H09232871A
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- JP
- Japan
- Prior art keywords
- signal
- output
- circuit
- waveform
- frequency
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Abstract
(57)【要約】
【課題】 数拾ＭＨｚの矩形波を入力して逓倍信号を取
り出す回路の設計が容易であり、かつ入力信号に対して
遅延量変化の少ない同期信号を出力信号として出力でき
る逓倍回路を提供することである。 【解決手段】 抵抗器Ｒ１、コイルＬ、コンデンサＣ１
・Ｃ２という受動素子により集中定数回路を構成し矩形
波による入力信号の基本周波数を逓倍した２倍の周波数
の逓倍信号を出力するフィルタ部１と、フィルタ部１の
出力を入力し半導体素子特性の非線形領域を利用して波
形を整形し矩形波により出力する抵抗器Ｒ２とバッファ
２１とを並列接続した波形整形部とを備えている。
り出す回路の設計が容易であり、かつ入力信号に対して
遅延量変化の少ない同期信号を出力信号として出力でき
る逓倍回路を提供することである。 【解決手段】 抵抗器Ｒ１、コイルＬ、コンデンサＣ１
・Ｃ２という受動素子により集中定数回路を構成し矩形
波による入力信号の基本周波数を逓倍した２倍の周波数
の逓倍信号を出力するフィルタ部１と、フィルタ部１の
出力を入力し半導体素子特性の非線形領域を利用して波
形を整形し矩形波により出力する抵抗器Ｒ２とバッファ
２１とを並列接続した波形整形部とを備えている。
Description
【０００１】
【発明の属する技術分野】本発明は、入力信号の周波数
を逓倍し出力する逓倍回路に関し、特に、矩形波を入力
して逓倍信号を取り出す回路の設計が容易であり、かつ
入力信号に対して遅延量変化の少ない同期信号を出力信
号として出力できる逓倍回路に関する。
を逓倍し出力する逓倍回路に関し、特に、矩形波を入力
して逓倍信号を取り出す回路の設計が容易であり、かつ
入力信号に対して遅延量変化の少ない同期信号を出力信
号として出力できる逓倍回路に関する。
【０００２】
【従来の技術】従来、この種の逓倍回路では、受動素子
による発振回路とトランジスタ等の能動素子とを組み合
わせたタンク回路が多く使用されている。
による発振回路とトランジスタ等の能動素子とを組み合
わせたタンク回路が多く使用されている。
【０００３】一方、別に出力側にサイドカップル形等の
フィルタを使用したＭＩＣ（MicroＩＣ）による逓倍回
路についての技術が、例えば、特開昭６３−２８６０１
２号公報に記載されている。
フィルタを使用したＭＩＣ（MicroＩＣ）による逓倍回
路についての技術が、例えば、特開昭６３−２８６０１
２号公報に記載されている。
【０００４】この方式では、帯域フィルタが経験則によ
りその通過する基本周波数の奇数倍の周波数の信号を通
過させることができることから、出力側のサイドカップ
ル形等のフィルタを基本周波数の３倍の周波数を通過さ
せる構成にして、良好なフィルタ特性が得られるという
目的が達成されている。
りその通過する基本周波数の奇数倍の周波数の信号を通
過させることができることから、出力側のサイドカップ
ル形等のフィルタを基本周波数の３倍の周波数を通過さ
せる構成にして、良好なフィルタ特性が得られるという
目的が達成されている。
【０００５】
【発明が解決しようとする課題】上述した従来の逓倍回
路のうち、能動素子のトランジスタ等を使用したフィル
タ回路は、能動素子の特性に変化を生じるため、例えば
温度等によりトランジスタの“Ｑ”がずれたため、元の
基本信号に対して逓倍された信号の遅延量が変化すると
いう問題点がある。
路のうち、能動素子のトランジスタ等を使用したフィル
タ回路は、能動素子の特性に変化を生じるため、例えば
温度等によりトランジスタの“Ｑ”がずれたため、元の
基本信号に対して逓倍された信号の遅延量が変化すると
いう問題点がある。
【０００６】また、上記公開公報に記載された構成のサ
イドカップル形等のフィルタでは、数拾ＭＨｚの矩形波
による信号を通過させることが困難であるという実用上
の面で問題点がある。
イドカップル形等のフィルタでは、数拾ＭＨｚの矩形波
による信号を通過させることが困難であるという実用上
の面で問題点がある。
【０００７】本発明の課題は、数拾ＭＨｚの矩形波を入
力して出力信号を取り出す回路の設計が容易であり、か
つ入力信号に対して遅延量変化の少ない同期信号を出力
信号として出力できる逓倍回路を提供することである。
力して出力信号を取り出す回路の設計が容易であり、か
つ入力信号に対して遅延量変化の少ない同期信号を出力
信号として出力できる逓倍回路を提供することである。
【０００８】
【課題を解決するための手段】本発明による逓倍回路
は、入力信号の周波数を逓倍し出力する逓倍回路におい
て、受動素子により集中定数回路を構成し、入力信号の
基本周波数を逓倍して２倍の周波数の逓倍信号を出力す
るフィルタ部と、このフィルタ部の出力を入力し半導体
素子特性の非線形領域を利用して波形を整形し出力する
波形整形部とを備えている。
は、入力信号の周波数を逓倍し出力する逓倍回路におい
て、受動素子により集中定数回路を構成し、入力信号の
基本周波数を逓倍して２倍の周波数の逓倍信号を出力す
るフィルタ部と、このフィルタ部の出力を入力し半導体
素子特性の非線形領域を利用して波形を整形し出力する
波形整形部とを備えている。
【０００９】前記フィルタ部の１つの具体例は、入力信
号を一方に接続する第１の抵抗器と、この抵抗器の他方
に直列に一方を接続して他方を接地するコイルと、前記
第１の抵抗器およびコイルを直結する接続端に一方を接
続し他方を接地する直列に接続された２つのコンデンサ
とを有し、この２つのコンデンサを直結する中央接続端
から信号を出力しており、前記波形整形部の１つの具体
例は一方に前記フィルタ部の出力を接続し他方から信号
を出力する並列接続された第２の抵抗器およびバッファ
を有し、入力波形を整形し出力している。このバッファ
の１つの具体例は、Ｃ−ＭＯＳ（Comprementory Metal
Oxide Semiconductor ）構造を有し、特性の非線形領域
を利用して波形整形している。
号を一方に接続する第１の抵抗器と、この抵抗器の他方
に直列に一方を接続して他方を接地するコイルと、前記
第１の抵抗器およびコイルを直結する接続端に一方を接
続し他方を接地する直列に接続された２つのコンデンサ
とを有し、この２つのコンデンサを直結する中央接続端
から信号を出力しており、前記波形整形部の１つの具体
例は一方に前記フィルタ部の出力を接続し他方から信号
を出力する並列接続された第２の抵抗器およびバッファ
を有し、入力波形を整形し出力している。このバッファ
の１つの具体例は、Ｃ−ＭＯＳ（Comprementory Metal
Oxide Semiconductor ）構造を有し、特性の非線形領域
を利用して波形整形している。
【００１０】この単純な構成により、矩形波による無線
周波数の入力信号に対して遅延量変化の少ないかつ入力
信号の基本周波数に対して２倍の周波数の同期信号が出
力信号として出力される。
周波数の入力信号に対して遅延量変化の少ないかつ入力
信号の基本周波数に対して２倍の周波数の同期信号が出
力信号として出力される。
【００１１】
【発明の実施の形態】次に、本発明の実施の形態につい
て図面を参照して説明する。
て図面を参照して説明する。
【００１２】図１は本発明の実施の一形態を示す回路図
である。図１に示された逓倍回路では、フィルタ部１お
よび波形整形部２が直列に接続構成されている。
である。図１に示された逓倍回路では、フィルタ部１お
よび波形整形部２が直列に接続構成されている。
【００１３】従来との相違は、フィルタ部１が受動素子
を使用した集中定数回路であり、波形整形部２が半導体
素子の特性の非線形領域を用いた回路である点にある。
を使用した集中定数回路であり、波形整形部２が半導体
素子の特性の非線形領域を用いた回路である点にある。
【００１４】次に、図１を参照して、回路の機能につい
て説明する。
て説明する。
【００１５】フィルタ部１は、数拾ＭＨｚの無線周波数
による矩形波の入力信号から基本周波数の２倍の周波数
をもつ逓倍信号を出力するフィルタ回路である。
による矩形波の入力信号から基本周波数の２倍の周波数
をもつ逓倍信号を出力するフィルタ回路である。
【００１６】図示されるように、フィルタ部１は、抵抗
器Ｒ１、コイルＬ、コンデンサＣ１・Ｃ２により構成さ
れている。入力信号は抵抗器Ｒ１およびコイルＬの直列
回路の抵抗器Ｒ１に接続され、直列回路の他端はコイル
Ｌを介して接地されている。抵抗器Ｒ１およびコイルＬ
の直列回路の中央接続点はコンデンサＣ１の一端に接続
され、コンデンサＣ１の他端はコンデンサＣ２を介して
接地されている。すなわち、２つのコンデンサＣ１・Ｃ
２は直列接続されており、コンデンサＣ１・Ｃ２の直列
回路の中心接続点から信号が取り出される。
器Ｒ１、コイルＬ、コンデンサＣ１・Ｃ２により構成さ
れている。入力信号は抵抗器Ｒ１およびコイルＬの直列
回路の抵抗器Ｒ１に接続され、直列回路の他端はコイル
Ｌを介して接地されている。抵抗器Ｒ１およびコイルＬ
の直列回路の中央接続点はコンデンサＣ１の一端に接続
され、コンデンサＣ１の他端はコンデンサＣ２を介して
接地されている。すなわち、２つのコンデンサＣ１・Ｃ
２は直列接続されており、コンデンサＣ１・Ｃ２の直列
回路の中心接続点から信号が取り出される。
【００１７】この構成のフィルタ部には、入力信号の基
本周波数の２倍の周波数を通過させる定数値が与えられ
基本周波数を十分に減衰させることができる。この結
果、上記回路構成では、矩形波信号が有する高次の周波
数成分の内、基本周波数の２倍の周波数を取り出すこと
ができる。また、受動素子を使用しているので、能動素
子を使用して生じる動作点の変動がなく、したがって、
遅延量の変化が少ない出力信号を容易に取り出すことが
できる。
本周波数の２倍の周波数を通過させる定数値が与えられ
基本周波数を十分に減衰させることができる。この結
果、上記回路構成では、矩形波信号が有する高次の周波
数成分の内、基本周波数の２倍の周波数を取り出すこと
ができる。また、受動素子を使用しているので、能動素
子を使用して生じる動作点の変動がなく、したがって、
遅延量の変化が少ない出力信号を容易に取り出すことが
できる。
【００１８】また、波形整形部２は、半導体素子特性の
非線形領域を利用し入力する波形を整形して出力するも
のとする。また、図示されるように波形整形部２は、バ
ッファ２１と抵抗器Ｒ２との並列回路である。
非線形領域を利用し入力する波形を整形して出力するも
のとする。また、図示されるように波形整形部２は、バ
ッファ２１と抵抗器Ｒ２との並列回路である。
【００１９】波形整形部２は、トランジスタ等の特性の
線形領域を利用せず、Ｃ−ＭＯＳ構造の半導体素子の特
性の内、非線形領域を利用しているものとする。すなわ
ち、基本周波数の２倍の周波数の逓倍信号をフィルタ部
１から入力し、Ｃ−ＭＯＳ特性の非線形領域を利用して
矩形波にレベル整形しディジタル信号として出力してい
る。
線形領域を利用せず、Ｃ−ＭＯＳ構造の半導体素子の特
性の内、非線形領域を利用しているものとする。すなわ
ち、基本周波数の２倍の周波数の逓倍信号をフィルタ部
１から入力し、Ｃ−ＭＯＳ特性の非線形領域を利用して
矩形波にレベル整形しディジタル信号として出力してい
る。
【００２０】この構成の波形整形部２のレベル整形は簡
単であり、かつ基本周波数に同期した信号を出力するこ
とができる。
単であり、かつ基本周波数に同期した信号を出力するこ
とができる。
【００２１】上述の逓倍回路の回路定数は、取り扱う入
力信号の周波数が数拾ＭＨｚと低いので、シミュレーシ
ョンにより簡単に決定できる。この１つの結果を図２に
示す。この例では、図示されるように、通過帯域２６Ｍ
Ｈｚ付近の周波数と１／２の基本周波数とのレベル差は
１５ｄＢ以上と十分に大きく、良好な特性が得られてい
る。
力信号の周波数が数拾ＭＨｚと低いので、シミュレーシ
ョンにより簡単に決定できる。この１つの結果を図２に
示す。この例では、図示されるように、通過帯域２６Ｍ
Ｈｚ付近の周波数と１／２の基本周波数とのレベル差は
１５ｄＢ以上と十分に大きく、良好な特性が得られてい
る。
【００２２】上記説明では、回路構成を具体的に図示し
て説明したが、上記機能を満たすものであれば他の回路
構成でもよい。更に、波形整形部にＣ−ＭＯＳ構造を使
用すると説明したが上記機能を満たすものであれば他の
素子構造でもよい。
て説明したが、上記機能を満たすものであれば他の回路
構成でもよい。更に、波形整形部にＣ−ＭＯＳ構造を使
用すると説明したが上記機能を満たすものであれば他の
素子構造でもよい。
【００２３】
【発明の効果】以上説明したように本発明によれば、受
動素子により集中定数回路を構成し入力信号の基本周波
数を逓倍して２倍の周波数の逓倍信号を出力するフィル
タ部と、このフィルタ部の出力を入力し半導体素子特性
の非線形領域を利用して波形を整形し出力する波形整形
部とを備える逓倍回路が得られる。
動素子により集中定数回路を構成し入力信号の基本周波
数を逓倍して２倍の周波数の逓倍信号を出力するフィル
タ部と、このフィルタ部の出力を入力し半導体素子特性
の非線形領域を利用して波形を整形し出力する波形整形
部とを備える逓倍回路が得られる。
【００２４】フィルタ部を集中定数回路で構成したこと
により、回路設計が容易でかつ良好なフィルタ特性を得
ることができる。また、受動素子を使用することにより
遅延量の変化が少ない逓倍信号の出力を得ることができ
る。
により、回路設計が容易でかつ良好なフィルタ特性を得
ることができる。また、受動素子を使用することにより
遅延量の変化が少ない逓倍信号の出力を得ることができ
る。
【００２５】また、波形整形部は半導体素子特性の非線
形領域を利用することにより波形を簡単に整形して矩形
波を出力することができる。
形領域を利用することにより波形を簡単に整形して矩形
波を出力することができる。
【００２６】したがって、数拾ＭＨｚの矩形波を入力し
て周波数の逓倍信号を取り出す回路の設計が容易であ
り、かつ入力信号に対して遅延量変化の少ない同期信号
を出力信号として出力できる逓倍回路を得ることができ
る。
て周波数の逓倍信号を取り出す回路の設計が容易であ
り、かつ入力信号に対して遅延量変化の少ない同期信号
を出力信号として出力できる逓倍回路を得ることができ
る。
【図１】本発明の実施の一形態を示す回路図である。
【図２】図１に回路定数を設定してシミュレーションし
た際の結果の一形態を示すグラフである。
た際の結果の一形態を示すグラフである。
１ フィルタ部 ２ 波形整形部 ２１ バッファ
Claims (3)
- 【請求項１】 入力信号の周波数を逓倍し出力する逓倍
回路において、受動素子により集中定数回路を構成し、
入力信号の基本周波数を逓倍して２倍の周波数の逓倍信
号を出力するフィルタ部と、このフィルタ部の出力を入
力し半導体素子特性の非線形領域を利用して波形を整形
し出力する波形整形部とを備えることを特徴とする逓倍
回路。 - 【請求項２】 請求項１において、前記フィルタ部は、
入力信号を一方に接続する第１の抵抗器と、この抵抗器
の他方に直列に一方を接続して他方を接地するコイル
と、前記第１の抵抗器およびコイルを直結する接続端に
一方を接続し他方を接地する直列に接続された２つのコ
ンデンサとを有し、この２つのコンデンサを直結する中
央接続端から信号を出力し、前記波形整形部は一方に前
記フィルタ部の出力を接続し他方から信号を出力する並
列接続された第２の抵抗器およびバッファを有し、入力
波形を整形し出力することを特徴とする逓倍回路。 - 【請求項３】 請求項２において、前記バッファは、Ｃ
−ＭＯＳ（Comprementory Metal Oxide Semiconductor
）構造を有し、特性の非線形領域を利用して波形整形
することを特徴とする逓倍回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3163696A JPH09232871A (ja) | 1996-02-20 | 1996-02-20 | 逓倍回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3163696A JPH09232871A (ja) | 1996-02-20 | 1996-02-20 | 逓倍回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09232871A true JPH09232871A (ja) | 1997-09-05 |
Family
ID=12336708
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3163696A Withdrawn JPH09232871A (ja) | 1996-02-20 | 1996-02-20 | 逓倍回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09232871A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| USRE43311E1 (en) | 1997-08-29 | 2012-04-10 | Stryker Corporation | Fast-detaching electrically insulated implant |
| US9571072B2 (en) | 2014-07-23 | 2017-02-14 | Seiko Epson Corporation | Frequency multiplication circuit, electronic device and moving object |
-
1996
- 1996-02-20 JP JP3163696A patent/JPH09232871A/ja not_active Withdrawn
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| USRE43311E1 (en) | 1997-08-29 | 2012-04-10 | Stryker Corporation | Fast-detaching electrically insulated implant |
| US9571072B2 (en) | 2014-07-23 | 2017-02-14 | Seiko Epson Corporation | Frequency multiplication circuit, electronic device and moving object |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20030506 |