JPH09204372A - Serial interface - Google Patents
Serial interfaceInfo
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- JPH09204372A JPH09204372A JP8012618A JP1261896A JPH09204372A JP H09204372 A JPH09204372 A JP H09204372A JP 8012618 A JP8012618 A JP 8012618A JP 1261896 A JP1261896 A JP 1261896A JP H09204372 A JPH09204372 A JP H09204372A
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- inspection
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- Pending
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Abstract
Description
【0001】[0001]
【発明の属する技術分野】本発明は、例えば、ファクシ
ミリ装置等の機器にパーソナルコンピュータ等の外部機
器を接続するためのシリアルインタフェースに関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a serial interface for connecting an external device such as a personal computer to a device such as a facsimile machine.
【0002】[0002]
【従来の技術】従来、ファクシミリ装置は独立機として
利用されていたが、最近では、そのプリンタ機能に着目
し、例えば、パーソナルコンピュータを接続することに
よりパーソナルコンピュータのプリンタとして使用する
ような利用形態も出現している(例えば、特開平6−2
25072号公報参照)。この場合、ファクシミリ装置
においては、例えばRS232Cのようなシリアルイン
タフェースを備えることにより、パーソナルコンピュー
タの接続を可能としている。2. Description of the Related Art Conventionally, a facsimile machine has been used as a stand-alone machine, but recently, attention has been paid to its printer function, and for example, a form of use in which a personal computer is connected to be used as a printer for the personal computer is also available. Has appeared (for example, Japanese Patent Laid-Open No. 6-2
25072). In this case, the facsimile apparatus is equipped with a serial interface such as RS232C to enable connection of a personal computer.
【0003】図3に、ファクシミリ装置のインタフェー
ス制御部等に設けられた従来のシリアルインタフェース
21の一部の構成例を示す。このシリアルインタフェー
ス21は10ピン構造のものであるが、入力制御信号S
D,RTS,DTR用の入力ピンが3本、出力制御信号
RD,CTS,DSR,DCD,CI用の出力ピンが5
本に設定されている。入力ピンのライン上には入力バッ
ファ(レシーバ)22が設けられて入力ポートが形成さ
れ、出力ピンのライン上には出力バッファ(ドライバ)
23が設けられて出力ポートが形成されている。FIG. 3 shows an example of a part of the configuration of a conventional serial interface 21 provided in an interface control unit of a facsimile machine. Although this serial interface 21 has a 10-pin structure, the input control signal S
3 input pins for D, RTS, DTR, 5 output pins for output control signals RD, CTS, DSR, DCD, CI
It is set in the book. An input buffer (receiver) 22 is provided on the input pin line to form an input port, and an output buffer (driver) is provided on the output pin line.
23 is provided to form an output port.
【0004】このようなシリアルインタフェース21の
工程検査での動作確認を考える。この動作確認を行う検
査法として、従来、2通りある。第1の方法は、シリア
ルインタフェース21にパーソナルコンピュータを実際
に接続して行う実働検査法である。第2の方法は、ルー
プバック治具を用いて行う検査法である。Consider the operation confirmation in the process inspection of the serial interface 21. There are two conventional inspection methods for confirming this operation. The first method is an operation inspection method performed by actually connecting a personal computer to the serial interface 21. The second method is an inspection method using a loopback jig.
【0005】[0005]
【発明が解決しようとする課題】ところが、実働法によ
る場合、実際にパーソナルコンピュータを接続するとと
もにパーソナルコンピュータを稼働させて行わなくては
ならず、面倒な上に時間がかかる。However, in the case of the working method, it is necessary to actually connect the personal computer and operate the personal computer, which is troublesome and time consuming.
【0006】一方、ループバック治具を用いる検査法に
よれば、パーソナルコンピュータがなくても検査できる
点で簡便な方法であるが、現実には、2種類のループバ
ック治具を用いて検査を2回行わなくてならず、2度手
間で検査時間もかかってしまう。即ち、図3に示したシ
リアルインタフェース21の場合、入力制御信号SD用
の入力ピンと出力制御信号RD用の出力ピンとを結線、
入力制御信号RTS用の入力ピンと出力制御信号CTS
用の出力ピンとを結線、入力制御信号DTR用の入力ピ
ンと出力制御信号DSR用の出力ピンとを結線するよう
に構成された第1のループバック治具と、例えば、入力
制御信号SR用の入力ピンと出力制御信号DCD用の出
力ピンとを結線、入力制御信号RTS用の入力ピンと出
力制御信号CI用の出力ピンとを結線するように構成さ
れた第2のループバック治具との2種類の治具を用意し
て、2度に分けて行う必要がある。On the other hand, the inspection method using the loopback jig is a simple method in that it can be inspected without a personal computer, but in reality, the inspection is performed using two types of loopback jigs. I have to do it twice, and it takes a lot of time and labor for inspection. That is, in the case of the serial interface 21 shown in FIG. 3, the input pin for the input control signal SD and the output pin for the output control signal RD are connected,
Input pin for input control signal RTS and output control signal CTS
A first loopback jig configured to connect an output pin for input control signal DTR and an input pin for input control signal DTR and an output pin for output control signal DSR; and, for example, an input pin for input control signal SR Two types of jigs, a second loopback jig configured to connect the output control signal DCD output pin and the input control signal RTS input pin and the output control signal CI output pin, are provided. It is necessary to prepare and carry out in two steps.
【0007】そこで、本発明は、1種類のループバック
治具を用いた1回の検査で動作確認を行うことができる
シリアルインタフェースを提供することを目的とする。Therefore, an object of the present invention is to provide a serial interface capable of confirming the operation by a single inspection using one type of loopback jig.
【0008】[0008]
【課題を解決するための手段】本発明では、機器間を接
続するためのシリアルインタフェースにおいて、入力ポ
ート数を出力ポート数と同数にする分の検査用入力ポー
トを備えている。従って、入力ポートと出力ポートとに
関して全てのループ対を確保でき、1種類のループバッ
ク治具を用いた1回の検査で全てのポートの動作確認が
可能となる。According to the present invention, a serial interface for connecting devices is provided with as many test input ports as the number of input ports is equal to the number of output ports. Therefore, it is possible to secure all the loop pairs for the input port and the output port, and it is possible to confirm the operation of all the ports with one inspection using one type of loopback jig.
【0009】[0009]
【発明の実施の形態】本発明の実施の一形態を図1及び
図2に基づいて説明する。まず、本実施の形態のシリア
ルインタフェースは、実施の形態の一つとしてファクシ
ミリ装置に適用されている。このファクシミリ装置1の
ハードウェア構成を図2を参照して説明する。各部を制
御するCPU2が設けられている。このCPU2には、
基本プログラム、検査プログラム等を含む固定的データ
を格納したROM3、各種データを随時格納するRAM
4、画像データを格納するデータ蓄積用メモリ(SA
F)5が、バスライン6を介して接続されている。ま
た、ファクシミリ装置1として基本的な原稿読取り動作
を行うスキャナ7と、受信画像データ等を印字出力する
プリンタ8とが設けられ、各々制御部9,10及び前記
バスライン6を介して前記CPU2に接続されている。
さらに、画像データに関して所定の符号化或いは複号処
理を行う符号化複号部(DCR)11や、送信信号を変
調し、受信信号を復調する変復調回路(モデム)12
も、前記バスライン6を介して前記CPU2に接続され
ている。前記モデム12は網制御部(NCU)13を介
して公衆電話回線に接続されている。BEST MODE FOR CARRYING OUT THE INVENTION An embodiment of the present invention will be described with reference to FIGS. First, the serial interface of this embodiment is applied to a facsimile apparatus as one of the embodiments. The hardware configuration of the facsimile apparatus 1 will be described with reference to FIG. A CPU 2 that controls each unit is provided. This CPU2 has
ROM 3 that stores fixed data including basic programs and inspection programs, RAM that stores various data as needed
4. Data storage memory for storing image data (SA
F) 5 is connected via a bus line 6. Further, a scanner 7 that performs a basic document reading operation as the facsimile device 1 and a printer 8 that prints out received image data and the like are provided, and are provided to the CPU 2 via the control units 9 and 10 and the bus line 6, respectively. It is connected.
Further, a coding / decoding unit (DCR) 11 that performs a predetermined coding or decoding process on image data, and a modulation / demodulation circuit (modem) 12 that modulates a transmission signal and demodulates a reception signal.
Is also connected to the CPU 2 via the bus line 6. The modem 12 is connected to a public telephone line via a network control unit (NCU) 13.
【0010】さらに、前記プリンタ8をプリンタに利用
する外部機器として、例えば、パーソナルコンピュータ
(PC)14を接続するためのインタフェース(I/
F)制御部15が設けられている。このI/F制御部1
5には、PC14側から引き出されたケーブル&コネク
タを実際に接続するためのシリアルインタフェース(シ
リアルI/F)16が設けられている。Further, as an external device using the printer 8 as a printer, for example, an interface (I / I) for connecting a personal computer (PC) 14
F) A control unit 15 is provided. This I / F control unit 1
5 is provided with a serial interface (serial I / F) 16 for actually connecting the cable & connector pulled out from the PC 14 side.
【0011】このシリアルI/F16としては、例え
ば、RS232Cが用いられている。ここに、本実施の
形態によるシリアルI/F16の一部の構成例を図1に
示す。このシリアルI/F16は10ピン構造のもので
あるが、入力制御信号SD,RTS,DTR用の入力ピ
ンが3本、出力制御信号RD,CTS,DSR,DC
D,CI用の出力ピンが5本に設定されている。さら
に、検査入力信号TEST1,TEST2用の入力ピン
が2本設定されている。入力ピンのライン上には入力バ
ッファ(レシーバ)17が設けられて入力ポートが形成
され、出力ピンのライン上には出力バッファ(ドライ
バ)18が設けられて出力ポートが形成されている。即
ち、本実施の形態においては、図3との対比において、
検査入力信号TEST1,TEST2用の入力ピンによ
る入力ポートが2本増設されることにより、入力ポート
数が5本となり、出力ポート数と同数になるようにポー
トが構成されている。As this serial I / F 16, for example, RS232C is used. FIG. 1 shows an example of a part of the configuration of the serial I / F 16 according to the present embodiment. Although this serial I / F 16 has a 10-pin structure, it has three input pins for input control signals SD, RTS, and DTR, and output control signals RD, CTS, DSR, and DC.
Five output pins for D and CI are set. Further, two input pins for the test input signals TEST1 and TEST2 are set. An input buffer (receiver) 17 is provided on the input pin line to form an input port, and an output buffer (driver) 18 is provided on the output pin line to form an output port. That is, in the present embodiment, in comparison with FIG.
By adding two input ports by the input pins for the test input signals TEST1 and TEST2, the number of input ports becomes 5, and the ports are configured so as to be the same as the number of output ports.
【0012】このような構成によれば、シリアルI/F
16における入力ポート数と出力ポート数とが同数であ
るので、このシリアルI/F16の動作確認を行うため
の検査を1種類のループバック治具を用いた1回の検査
で行うことができる。即ち、図1中に示すように、入力
制御信号SD用の入力ピンと出力制御信号RD用の出力
ピンとを結線、入力制御信号RTS用の入力ピンと出力
制御信号CTS用の出力ピンとを結線、入力制御信号D
TR用の入力ピンと出力制御信号DSR用の出力ピンと
を結線、検査入力信号TEST1用の入力ピンと出力制
御信号DCD用の出力ピンとを結線、検査入力信号TE
ST2用の入力ピンと出力制御信号CI用の出力ピンと
を結線するように構成された1種類のループバック治具
19を用いるだけで、入出力の全てのループ対を形成す
ることができ、各信号の送受信確認の検査を行うことが
できる。よって、検査工程を簡単にして確実かつ短時間
で済ませることができる。According to this structure, the serial I / F
Since the number of input ports and the number of output ports in 16 are the same, the inspection for confirming the operation of the serial I / F 16 can be performed by one inspection using one type of loopback jig. That is, as shown in FIG. 1, the input pin for the input control signal SD and the output pin for the output control signal RD are connected, the input pin for the input control signal RTS and the output pin for the output control signal CTS are connected, and the input control is performed. Signal D
The input pin for TR and the output pin for the output control signal DSR are connected, the input pin for the test input signal TEST1 and the output pin for the output control signal DCD are connected, and the test input signal TE is connected.
All of the input / output loop pairs can be formed by using only one type of loopback jig 19 configured to connect the input pin for ST2 and the output pin for output control signal CI. It is possible to check the transmission and reception confirmation of. Therefore, the inspection process can be simplified and can be completed reliably and in a short time.
【0013】なお、本実施の形態では、ファクシミリ装
置に備えられてパーソナルコンピュータを接続するため
のシリアルインタフェースに適用したが、このような例
に限らず、入力ポート数が出力ポート数よりも少ないシ
リアルインタフェースの場合であれば同様に適用でき
る。In the present embodiment, the present invention is applied to a serial interface provided in a facsimile machine for connecting a personal computer, but the present invention is not limited to such an example, and a serial interface in which the number of input ports is smaller than the number of output ports is used. The same applies to the case of an interface.
【0014】[0014]
【発明の効果】本発明によれば、機器間を接続するため
のシリアルインタフェースにおいて、入力ポート数を出
力ポート数と同数にする分の検査用入力ポートを備えた
ので、入力ポートと出力ポートとに関して全てのループ
対を確保でき、よって、1種類のループバック治具によ
る1回の検査で全ての入出力ポートの動作確認を行うこ
とができ、検査工程を簡単にして確実かつ短時間で済ま
せることができる。According to the present invention, in the serial interface for connecting the devices, the test input ports are provided so as to make the number of input ports the same as the number of output ports. All loop pairs can be secured, so that the operation of all I / O ports can be confirmed by one-time inspection using one type of loopback jig, and the inspection process can be simplified and completed in a reliable and short time. be able to.
【図1】本発明の実施の一形態としてループバック治具
の結線を含めてシリアルI/Fの一部を抽出して示す模
式的な回路図である。FIG. 1 is a schematic circuit diagram showing a part of a serial I / F extracted including a connection of a loopback jig as an embodiment of the present invention.
【図2】ファクシミリ装置のハードウェア構成を示すブ
ロック図である。FIG. 2 is a block diagram showing a hardware configuration of a facsimile device.
【図3】従来例のシリアルI/Fの一部を抽出して示す
模式的な回路図である。FIG. 3 is a schematic circuit diagram showing a part of a serial I / F of a conventional example extracted.
1,14 機器 16 シリアルインタフェース 1,14 Equipment 16 Serial interface
Claims (1)
フェースにおいて、入力ポート数を出力ポート数と同数
にする分の検査用入力ポートを備えることを特徴とする
シリアルインタフェース。1. A serial interface for connecting devices, wherein the serial interface is provided with as many test input ports as the number of input ports is equal to the number of output ports.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8012618A JPH09204372A (en) | 1996-01-29 | 1996-01-29 | Serial interface |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8012618A JPH09204372A (en) | 1996-01-29 | 1996-01-29 | Serial interface |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH09204372A true JPH09204372A (en) | 1997-08-05 |
Family
ID=11810372
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP8012618A Pending JPH09204372A (en) | 1996-01-29 | 1996-01-29 | Serial interface |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH09204372A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007095276A (en) * | 2005-09-29 | 2007-04-12 | Hynix Semiconductor Inc | Multiport memory device having serial/output interface |
-
1996
- 1996-01-29 JP JP8012618A patent/JPH09204372A/en active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007095276A (en) * | 2005-09-29 | 2007-04-12 | Hynix Semiconductor Inc | Multiport memory device having serial/output interface |
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