JPH09161285A - Tracking error detecting device - Google Patents

Tracking error detecting device

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JPH09161285A
JPH09161285A JP31644695A JP31644695A JPH09161285A JP H09161285 A JPH09161285 A JP H09161285A JP 31644695 A JP31644695 A JP 31644695A JP 31644695 A JP31644695 A JP 31644695A JP H09161285 A JPH09161285 A JP H09161285A
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JP
Japan
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signal
tracking error
light
current
voltage
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Withdrawn
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JP31644695A
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Japanese (ja)
Inventor
Motoi Kimura
基 木村
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Sony Corp
Original Assignee
Sony Corp
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Publication date
Application filed by Sony Corp filed Critical Sony Corp
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Abstract

PROBLEM TO BE SOLVED: To provide a tracking error detecting device with high detection precision. SOLUTION: A light receiving means 1 light receives reflected light of a light spot formed on an information track of a recording medium by irradiating irradiation light by photodetectors A-D, and outputs currents according to the light receiving amount of the photodetector A-D. Current/voltage conversion means 2A-2D convert the current outputs of the light receiving means 1 to voltage signals. Signal detection means 3a, 3b generate two detection signals varying according to information recorded on the recording medium and varying their phases each other according to the tracking error of the light spot from the voltage signals from the current/voltage conversion means 2A-2D. High band emphasis means 4a, 4b increase respective high frequency components of the two detection signals to supply them to waveform shaping means 5a, 5b. The waveform shaping means 5a, 5b waveform shape respectively two detection signals from the high band emphasis means 4a, 4b to generate two digital detection signals. Phase comparison means 6, 7 generate the tracking error signal based on the phase difference component of the two digital detection signals to output it.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【発明の属する技術分野】本発明は、例えば、光ディス
ク等の記録媒体に位相ピットにより記録された情報を再
生する光学的情報再生装置において、再生処理時に行う
トラッキング制御のためのトラッキング誤差信号を検出
するトラッキング誤差検出装置に関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an optical information reproducing apparatus for reproducing information recorded by phase pits on a recording medium such as an optical disk, for example, and detects a tracking error signal for tracking control performed during reproduction processing. And a tracking error detecting device.

【0002】[0002]

【従来の技術】近年、コンパクトディスクやビデオディ
スク等の光ディスクから光学的に情報を読み取る光学的
情報再生装置が多く用いられている。上記光ディスクに
は、微細なトラックに情報が位相ピットにより記録され
ており、このトラックから正確に情報を再生するために
は、精密なトラッキング制御が必要である。また、精密
なトラッキング制御を行うためには、トラッキング誤差
の検出が必要であり、このトラッキング誤差の検出は、
通常、光学的手段を利用して行われる。
2. Description of the Related Art In recent years, an optical information reproducing apparatus for optically reading information from an optical disk such as a compact disk or a video disk has been widely used. In the above optical disk, information is recorded on a fine track by phase pits, and precise tracking control is necessary to accurately reproduce the information from this track. Also, in order to perform precise tracking control, it is necessary to detect a tracking error.
Usually, it is performed using optical means.

【0003】そこで、上記光学的情報再生装置は、図1
3に示すようなトラッキング誤差検出回路200を備え
ている。このトラッキング誤差検出回路200は、例え
ば、位相差検出方式を用いたものである。
Therefore, the optical information reproducing apparatus shown in FIG.
The tracking error detection circuit 200 as shown in FIG. The tracking error detection circuit 200 uses, for example, a phase difference detection method.

【0004】以下、トラッキング誤差検出回路200に
ついて説明する。
The tracking error detection circuit 200 will be described below.

【0005】先ず、図示していない光ディスクから反射
してきた光ビームを4分割フォトディテクタ201の中
心付近に入射させる。これにより、4分割フォトディテ
クタ201の4つの受光素子A,B,C,Dからは、受
光素子の受光量に応じた電流が電流電圧変換器202
A,202B,202C,202Dに対して各々出力さ
れる。そして、電流電圧変換器202A,202B,2
02C,202Dにより、受光素子A,B,C,Dから
の各出力電流が電圧信号に各々変換される。
First, a light beam reflected from an optical disk (not shown) is made incident near the center of the four-division photodetector 201. Thus, from the four light receiving elements A, B, C, D of the four-division photo detector 201, a current according to the amount of light received by the light receiving elements is converted into a current-voltage converter 202.
It is output to each of A, 202B, 202C and 202D. Then, the current-voltage converters 202A, 202B, 2
The output currents from the light receiving elements A, B, C, and D are converted into voltage signals by the 02C and 202D, respectively.

【0006】次に、加算器203aは、電流電圧変換器
202Aで得られた電圧信号と、電流電圧変換器202
Cで得られた電圧信号とを加算する。また、加算器20
3bは、電流電圧変換器202Bで得られた電圧信号
と、電流電圧変換器202Dで得られた電圧信号とを加
算する。
Next, the adder 203a receives the voltage signal obtained by the current-voltage converter 202A and the current-voltage converter 202.
The voltage signal obtained at C is added. Also, the adder 20
3b adds the voltage signal obtained by the current-voltage converter 202B and the voltage signal obtained by the current-voltage converter 202D.

【0007】加算器203aで得られた加算信号(以
下、A+C信号と言う。)は、2値化器204aにより
2値化され、2値化されたA+C信号は、ディジタル検
出信号(A+C)として位相比較器205に供給され
る。また、加算器203bで得られた加算信号(以下、
B+D信号と言う。)も、2値化器204bにより2値
化され、2値化されたB+D信号は、ディジタル検出信
号(B+D)として位相比較器205に供給される。
The addition signal (hereinafter referred to as A + C signal) obtained by the adder 203a is binarized by the binarizer 204a, and the binarized A + C signal is converted into a digital detection signal (A + C). It is supplied to the phase comparator 205. In addition, the addition signal obtained by the adder 203b (hereinafter,
This is called the B + D signal. ) Is also binarized by the binarizer 204b, and the binarized B + D signal is supplied to the phase comparator 205 as a digital detection signal (B + D).

【0008】次に、位相比較器205は、2値化器20
4aからのディジタル検出信号(A+C)と、2値化器
204bからのディジタル検出信号(B+D)とから、
進み位相差及び遅れ位相差を検出し、進み位相差のパル
ス、及び遅れ位相差のパルスを各々生成する。そして、
位相比較器205は、生成した2つのパルスを別々に出
力処理回路206に供給する。
Next, the phase comparator 205 includes a binarizer 20.
From the digital detection signal (A + C) from 4a and the digital detection signal (B + D) from the binarizer 204b,
The lead phase difference and the lag phase difference are detected, and the lead phase difference pulse and the lag phase difference pulse are respectively generated. And
The phase comparator 205 separately supplies the generated two pulses to the output processing circuit 206.

【0009】出力処理回路206は、位相比較器205
から別々に供給された2つのパルスからトラッキング誤
差信号を生成して出力する。
The output processing circuit 206 includes a phase comparator 205.
A tracking error signal is generated and output from the two pulses supplied separately from.

【0010】[0010]

【発明が解決しようとする課題】ところで、光ディスク
用光学系の空間周波数特性は、図14に示すような特性
であり、上記図14に示すように、短いピットになるほ
ど再生信号のレベルは低くなる。
By the way, the spatial frequency characteristic of the optical system for an optical disk is such as shown in FIG. 14, and as shown in FIG. 14, the shorter the pit, the lower the level of the reproduction signal. .

【0011】尚、以下の説明において、光学系の遮断空
間周波数を[νcutoff]、光学系の遮断空間周波
数相当のピット長を[Lcutoff]、チャンネルク
ロック周期を[T]、及びn倍のチャンネルクロック周
期の長さを有するピット長を[LnT]で示す。
In the following description, the cut-off spatial frequency of the optical system is [νcutoff], the pit length corresponding to the cut-off spatial frequency of the optical system is [Lcutoff], the channel clock period is [T], and the channel clock is n times as large. A pit length having a period length is indicated by [L nT ].

【0012】そこで、ピット長が[Lcutoff]に
近いことにより再生信号の振幅(以下、再生振幅と言
う。)が小さい短ピットを有する光ディスクに対して、
上述したようなトラッキング誤差検出回路200を備え
る光学的情報再生装置を用いて再生処理を行った場合、
上記図14に示した空間周波数特性により、ピット非対
称性、すなわちピットアシンメトリによる中心レベルの
変動、フォーカスずれ、光ディスクの光ピックアップ光
軸からの傾き等に起因する再生信号のレベル低下、及び
トラッキング誤差検出回路200の2値化器204a,
204bのオフセット電圧変動によるしきい値の変動等
が生じてしまっていた。このため、トラッキング誤差検
出回路200では、短ピットの2値化処理を正確に行う
ことができない場合が生じ、それに伴い、トラッキング
誤差検出回路200で得られるトラッキング誤差信号の
振幅低下、雑音増加、及び波形歪を招くことがあった。
Therefore, for an optical disc having a short pit in which the pit length is close to [Lcutoff], the amplitude of the reproduction signal (hereinafter, referred to as reproduction amplitude) is small.
When the reproduction process is performed using the optical information reproducing device including the tracking error detection circuit 200 as described above,
According to the spatial frequency characteristics shown in FIG. 14, the pit asymmetry, that is, the fluctuation of the center level due to the pit asymmetry, the focus shift, the level reduction of the reproduction signal due to the inclination of the optical disc from the optical pickup optical axis, and the tracking error detection. The binarizer 204a of the circuit 200,
The change in the threshold value due to the change in the offset voltage of 204b has occurred. For this reason, the tracking error detection circuit 200 may not be able to accurately perform the binarization processing of the short pits. As a result, the tracking error signal obtained by the tracking error detection circuit 200 may have a reduced amplitude, increased noise, and It sometimes caused waveform distortion.

【0013】具体的に説明すると、例えば、コンパクト
ディスク(以下、CD:compact diskと言う。)用光学
系の空間周波数特性は、[νcutoff]〜約115
0本/mmであり、この値は、ピット長[Lcutof
f]〜0.43μmに相当する。
More specifically, for example, the spatial frequency characteristic of an optical system for a compact disk (hereinafter referred to as a CD: compact disk) is [νcutoff] to about 115.
0 / mm, which is the pit length [Lcutof
f] to 0.43 μm.

【0014】一方、CDには、EFM(Eight to Forte
en Modulation)変調方式によりディジタル化された信
号が[3T]〜[11T]の長さのピットで記録されて
いる。したがって、CDに記録されているピットのうち
[3T]の長さのピットが最短ピットとなるが、CDの
規格では、[L3T]=0.83μmであり、空間周波数
特性は、[L3T]〜2×[Lcutoff]となる。
On the other hand, the CD has an EFM (Eight to Forte)
A signal digitized by the en modulation method is recorded in pits having a length of [3T] to [11T]. Therefore, of the pits recorded on the CD, the pit having a length of [3T] is the shortest pit, but according to the CD standard, [L 3T ] = 0.83 μm, and the spatial frequency characteristic is [L 3T ] −2 × [Lcutoff].

【0015】ここで、上述のようなCDから得られる再
生信号において、図15は、上記CDがピット非対称性
を持たない場合のアイパターンを示したものであり、図
16は、上記CDがピット非対称性を有する場合のアイ
パターンを示したものである。
Here, in the reproduction signal obtained from the above CD, FIG. 15 shows an eye pattern in the case where the CD does not have pit asymmetry, and FIG. 16 shows the pit in the CD. It shows an eye pattern in the case of having asymmetry.

【0016】上記図15及び上記図16に示すように、
最短ピットの再生振幅I3Tは、比較的大きく、[11
T]の長さのピットの再生振幅I11Tの70%程度とな
っている。したがって、このような場合には、ピット非
対称性を有するCDであっても2値化処理を行うことが
できる。
As shown in FIGS. 15 and 16 above,
The reproduction amplitude I 3T of the shortest pit is relatively large, [11
The reproduction amplitude of a pit having a length of [T] is about 70% of I 11T . Therefore, in such a case, the binarization process can be performed even for a CD having pit asymmetry.

【0017】しかし、最短ピットのピット長が[Lcu
toff]に最も近い場合、例えば、空間周波数特性が
[L3T]〜1.5×[Lcutoff]であった場合、
図17に示すように、最短ピットの再生振幅I3Tは、
[11T]の長さのピットの振幅I11Tの20%程度に
減少する。したがって、光学系の遮断空間周波数相当の
ピット長に近い長さのピットに対しては、上述したよう
なピット非対称性等の要因により、2値化処理を行うこ
とができない場合が生じてしまっていた。
However, the pit length of the shortest pit is [Lcu
toff], for example, when the spatial frequency characteristic is [L 3T ] to 1.5 × [Lcutoff],
As shown in FIG. 17, the reproduction amplitude I 3T of the shortest pit is
The amplitude I 11T of a pit having a length of [11T] is reduced to about 20%. Therefore, for a pit having a length close to the pit length corresponding to the cut-off spatial frequency of the optical system, there are cases in which the binarization processing cannot be performed due to the factors such as the pit asymmetry described above. It was

【0018】一方、上述したような問題点を解決するた
めに、例えば、2値化器への入力信号の振幅を全体的に
増大する装置が考えられるが、このような装置では、長
ピットの再生振幅までも増大されてしまい、長ピットの
再生振幅が非常に大きくなってしまう。このため、高い
電源電圧が必要となり、これは、装置の消費電力の増大
につながってしまう。
On the other hand, in order to solve the above-mentioned problems, for example, a device for increasing the amplitude of the input signal to the binarizer may be considered. The reproduction amplitude is also increased, and the reproduction amplitude of the long pit becomes very large. Therefore, a high power supply voltage is required, which leads to an increase in power consumption of the device.

【0019】そこで、本発明は、上述の如き従来の実情
に鑑みてなされたものであり、次のような目的を有する
ものである。
Therefore, the present invention has been made in view of the conventional circumstances as described above, and has the following objects.

【0020】即ち、本発明の目的は、検出精度が高いト
ラッキング誤差検出装置を提供することにある。
That is, an object of the present invention is to provide a tracking error detecting device having high detection accuracy.

【0021】また、本発明の目的は、トラッキング制御
の安定性及び制御精度を向上させることができるトラッ
キング誤差検出装置を提供することにある。
Another object of the present invention is to provide a tracking error detecting device capable of improving the stability and control accuracy of tracking control.

【0022】[0022]

【課題を解決するための手段】上述の課題を解決するた
めに、本発明に係るトラッキング誤差検出装置は、記録
媒体の情報トラック上に照射光を投射して形成された光
スポットの反射光を受光素子により受光し、上記受光素
子の受光量に応じた電流を出力する受光手段と、上記受
光手段の電流出力を電圧信号に変換する電流電圧変換手
段と、上記電流電圧変換手段で得られた電圧信号から上
記記録媒体に記録されている情報に応じて変化すると共
に上記光スポットのトラッキング誤差に応じて互いに位
相が変化する2つの検出信号を生成する信号検出手段
と、上記信号検出手段により生成された2つの検出信号
を各々波形整形して2つのディジタル検出信号を生成す
る波形整形手段と、上記波形整形手段により生成された
2つのディジタル検出信号の位相差成分に基いたトラッ
キング誤差信号を生成して出力する位相比較手段とを備
える。そして、上記波形整形手段の前に各高周波成分が
増大された2つの検出信号を生成する高域強調手段を備
えることを特徴とする。
In order to solve the above problems, a tracking error detecting apparatus according to the present invention detects reflected light of a light spot formed by projecting irradiation light onto an information track of a recording medium. The light-receiving device receives light and outputs a current according to the amount of light received by the light-receiving device, the current-voltage converting device converts the current output of the light-receiving device into a voltage signal, and the current-voltage converting device. A signal detection unit that generates two detection signals that change from the voltage signal according to the information recorded on the recording medium and that change their phases according to the tracking error of the light spot, and the signal detection unit. A waveform shaping means for shaping each of the two generated detection signals to generate two digital detection signals; and two digital detection means generated by the waveform shaping means. And a phase comparing means for generating and outputting a tracking error signal based on the phase difference component of the signal. Further, it is characterized in that a high-frequency emphasizing means for generating two detection signals in which each high-frequency component is increased is provided before the waveform shaping means.

【0023】また、本発明に係るトラッキング誤差検出
装置は、上記高域強調手段は、高域強調特性を有する上
記電流電圧変換手段により構成されることを特徴とす
る。
Further, the tracking error detecting device according to the present invention is characterized in that the high-frequency emphasis means is constituted by the current-voltage conversion means having high-frequency emphasis characteristics.

【0024】また、本発明に係るトラッキング誤差検出
装置は、上記高域強調手段は、高域強調特性を有する上
記信号検出手段により構成されることを特徴とする。
Further, the tracking error detecting apparatus according to the present invention is characterized in that the high frequency enhancing means is constituted by the signal detecting means having a high frequency enhancing characteristic.

【0025】[0025]

【発明の実施の形態】以下、発明の実施の形態につい
て、図面を参照して詳細に説明する。
Embodiments of the present invention will be described below in detail with reference to the drawings.

【0026】本発明に係るトラッキング誤差検出装置
は、例えば、光ディスクに記録された情報を再生する光
学的情報再生装置に設けられた図1に示すようなトラッ
キング誤差検出回路100に適用される。
The tracking error detecting device according to the present invention is applied to, for example, a tracking error detecting circuit 100 shown in FIG. 1 provided in an optical information reproducing device for reproducing information recorded on an optical disc.

【0027】このトラッキング誤差検出回路100は、
後述する位相差検出方式を用いたものであり、4つの受
光素子A,B,C,Dからなる4分割フォトディテクタ
1と、4つの受光素子A,B,C,Dの各出力が各々供
給される4つの電流電圧変換器2A,2B,2C,2D
と、電流電圧変換器2Aの出力と電流電圧変換器2Cの
出力が供給される加算器3aと、電流電圧変換器2Bの
出力と電流電圧変換器2Dの出力が供給される加算器3
bと、加算器3aの出力が供給される高域強調回路4a
と、加算器3bの出力が供給される高域強調回路4b
と、高域強調回路4aの出力が供給される2値化器5a
と、高域強調回路4bの出力が供給される2値化器5b
と、2値化器5aの出力と2値化器5bの出力が供給さ
れる位相比較器6と、位相比較器6の出力が供給されト
ラッキング誤差信号を出力する出力処理回路7とを備え
ている。
The tracking error detection circuit 100 is
A phase-difference detecting method described later is used, and the four-division photodetector 1 including four light receiving elements A, B, C, and D and the respective outputs of the four light receiving elements A, B, C, and D are supplied. Four current-voltage converters 2A, 2B, 2C, 2D
And an adder 3a to which the output of the current-voltage converter 2A and the output of the current-voltage converter 2C are supplied, and an adder 3 to which the output of the current-voltage converter 2B and the output of the current-voltage converter 2D are supplied.
b and the high frequency emphasizing circuit 4a to which the output of the adder 3a is supplied.
And a high frequency emphasizing circuit 4b to which the output of the adder 3b is supplied.
And a binarizer 5a to which the output of the high-frequency emphasis circuit 4a is supplied.
And the binarizer 5b to which the output of the high-frequency emphasis circuit 4b is supplied.
And a phase comparator 6 to which the output of the binarizer 5a and the output of the binarizer 5b are supplied, and an output processing circuit 7 to which the output of the phase comparator 6 is supplied and which outputs a tracking error signal. There is.

【0028】まず、4分割フォトディテクタ1には、例
えば、図2に示すような光ヘッド8からの光ビームが入
射するようになされている。
First, for example, a light beam from an optical head 8 as shown in FIG. 2 enters the four-division photodetector 1.

【0029】すなわち、上記図2に示した光ヘッド8に
おいて、先ず、半導体レーザ81から出射した発散光
は、ハーフミラー82により反射し、コリメーターレン
ズ83に入射する。
That is, in the optical head 8 shown in FIG. 2, first, the divergent light emitted from the semiconductor laser 81 is reflected by the half mirror 82 and enters the collimator lens 83.

【0030】コリメータレンズ83は、発散光である入
射光を平行光に変換して出射する。コリメータレンズ8
3から出射される平行光は、対物レンズ84により光デ
ィスク9上に集光する。この時、図示していないフォー
カシング制御回路は、光ディスク9上に集光するスポッ
ト径が常に最小となるようにフォーカスサーボを行う。
The collimator lens 83 converts incident light which is divergent light into parallel light and emits it. Collimator lens 8
The parallel light emitted from 3 is condensed on the optical disc 9 by the objective lens 84. At this time, a focusing control circuit (not shown) performs focus servo so that the diameter of the spot focused on the optical disc 9 is always minimized.

【0031】そして、光ディスク9から反射した光は、
再度、対物レンズ84とコリメータレンズ83を介して
収束光となり、非点収差法によるフォーカス誤差検出用
の平行平面板85を介した後、集差補正用レンズ86を
介して光ビームとして4分割フォトディテクタ1に入射
する。
The light reflected from the optical disk 9 is
Again, it becomes convergent light through the objective lens 84 and the collimator lens 83, passes through the plane-parallel plate 85 for focus error detection by the astigmatism method, and then passes through the lens 86 for correction of difference as a light beam into four-part photodetector. Incident on 1.

【0032】上述のようにして光ヘッド8から出射され
る光ビームは、上記図1に示すように、4分割フォトデ
ィテクタ1の中心付近Cに入射されるようになされてい
る。
The light beam emitted from the optical head 8 as described above is made incident on the vicinity C of the center of the four-divided photodetector 1 as shown in FIG.

【0033】つぎに、上述した位相差検出方式とは、上
記図2に示した光ディスク9からの反射光のような検出
光を受光し、受光面の2つの部分の受光量に基いた2つ
の電気信号の位相差を用いて、トラッキング誤差を検出
する方式である。このような位相差検出方式を用いたト
ラッキング誤差検出回路100では、4分割フォトディ
テクタ1の受光素子A,B,C,Dの各受光量に対応す
る電気信号の位相をPA,PB,PC,PDとした場合、上
述した2つの電気信号の位相差TEを TE=(PA+PC)−(PB+PD) なる式に基いて求めるようになされている。
Next, the above-mentioned phase difference detection method means that the detection light such as the reflected light from the optical disk 9 shown in FIG. This is a method of detecting a tracking error by using the phase difference between electric signals. In the tracking error detection circuit 100 using such a phase difference detection method, the phases of the electric signals corresponding to the respective light receiving amounts of the light receiving elements A, B, C, D of the four-division photodetector 1 are P A , P B , P. C, when the P D, the phase difference TE of the two electrical signals described above TE = (P a + P C ) - are adapted to determine on the basis of (P B + P D) becomes equation.

【0034】すなわち、先ず、受光素子Aは、光ヘッド
8からの入射光を受光し、その受光量に対応した電流を
電流電圧変換器2Aに供給する。また、他の3つの受光
素子B,C,Dも受光素子Aと同様にして、各々、光ヘ
ッド8からの入射光を受光し、その受光量に対応した電
流を電流電圧変換器2B,2C,2Dに各々供給する。
That is, first, the light receiving element A receives the incident light from the optical head 8 and supplies the current corresponding to the received light amount to the current-voltage converter 2A. Similarly to the light-receiving element A, the other three light-receiving elements B, C and D respectively receive the incident light from the optical head 8 and output currents corresponding to the received light amounts to the current-voltage converters 2B and 2C. , 2D respectively.

【0035】次に、電流電圧変換器2Aは、受光素子A
からの電流を電圧信号に変換し、その電圧信号を加算器
3aに供給する。また、電流電圧変換器2B,2C,2
Dも電流電圧変換器2Aと同様にして、各々、受光素子
B,C,Dからの電流を電圧信号に変換し、その電圧信
号を加算器3b,3c,3dに各々供給する。
Next, the current-voltage converter 2A includes the light receiving element A.
The current from is converted into a voltage signal, and the voltage signal is supplied to the adder 3a. In addition, the current-voltage converters 2B, 2C, 2
Similarly to the current-voltage converter 2A, D also converts the currents from the light receiving elements B, C, D into voltage signals and supplies the voltage signals to the adders 3b, 3c, 3d, respectively.

【0036】したがって、加算器3aには、電流電圧変
換器2Aと電流電圧変換器2Cからの各電圧信号が供給
され、加算器3bには、電流電圧変換器2Bと電流電圧
変換器2Dからの各電圧信号が供給されることとなる。
Therefore, the adder 3a is supplied with the respective voltage signals from the current-voltage converter 2A and the current-voltage converter 2C, and the adder 3b is supplied with the current-voltage converter 2B and the current-voltage converter 2D. Each voltage signal will be supplied.

【0037】そして、加算器3aは、電流電圧変換器2
Aからの電圧信号と、電流電圧変換器2Cからの電圧信
号とを加算し、その加算信号Sa1を高域強調回路4aに
供給する。また、加算器3bは、電流電圧変換器2Bか
らの電圧信号と、電流電圧変換器2Dからの電圧信号と
を加算し、その加算信号Sa2を高域強調回路4bに供給
する。
Then, the adder 3a is connected to the current-voltage converter 2
The voltage signal from A and the voltage signal from the current-voltage converter 2C are added, and the added signal S a1 is supplied to the high frequency emphasis circuit 4a. Further, the adder 3b adds the voltage signal from the current-voltage converter 2B and the voltage signal from the current-voltage converter 2D, and supplies the addition signal S a2 to the high frequency emphasizing circuit 4b.

【0038】ここで、加算器3aから出力される加算信
号Sa1、すなわち受光素子Aにおける受光量に対応した
電圧信号と、受光素子Cにおける受光量に対応した電圧
信号とを加算して得られた信号(以下、A+C信号Sa1
と言う。)は、例えば、図3の(1)に示すような波形
となる。また、加算器3bから出力される加算信号
a2、すなわち受光素子Bにおける受光量に対応した電
圧信号と、受光素子Dにおける受光量に対応した電圧信
号とを加算して得られた信号(以下、B+D信号Sa2
言う。)は、例えば、上記図3の(2)に示すような波
形となる。上記図3の(1)及び(2)に示すように、
A+C信号Sa1及びB+D信号Sa2は、各々、ピットの
有無に応じた波形となり、このようなA+C信号Sa1
びB+D信号Sa2が高域強調回路5a及び高域強調回路
5bに各々供給される。
Here, the addition signal S a1 output from the adder 3a, that is, the voltage signal corresponding to the amount of light received by the light receiving element A and the voltage signal corresponding to the amount of light received by the light receiving element C are obtained. Signal (hereinafter A + C signal S a1
Say ) Has a waveform as shown in (1) of FIG. 3, for example. Further, a signal obtained by adding the addition signal S a2 output from the adder 3b, that is, the voltage signal corresponding to the amount of light received by the light receiving element B and the voltage signal corresponding to the amount of light received by the light receiving element D (hereinafter , B + D signal S a2 ) has a waveform as shown in (2) of FIG. 3, for example. As shown in (1) and (2) of FIG.
The A + C signal S a1 and the B + D signal S a2 each have a waveform corresponding to the presence or absence of a pit, and the A + C signal S a1 and the B + D signal S a2 are supplied to the high frequency emphasis circuit 5a and the high frequency emphasis circuit 5b, respectively. It

【0039】高域強調回路4aは、例えば、図4に示す
ような構成をしており、図5に示すような特性を有して
いる。
The high frequency emphasizing circuit 4a has, for example, a configuration as shown in FIG. 4 and has characteristics as shown in FIG.

【0040】すなわち、高域強調回路4aでは、電荷容
量C1を有するコンデンサ41、抵抗値R2を有する抵
抗42、及び差動増幅回路43が入力端子Iinと出力端
子Iout間に順に設けられている。また、入力端子Iin
と出力端子Iout間には、コンデンサ41、抵抗42、
及び差動増幅回路43に対して並列に抵抗値R1を各々
有する抵抗45と抵抗46とが順に設けられている。さ
らに、抵抗45と抵抗46間と、抵抗42と差動増幅器
43間とが接続されている。
That is, in the high frequency emphasizing circuit 4a, the capacitor 41 having the charge capacity C1, the resistor 42 having the resistance value R2, and the differential amplifier circuit 43 are provided in order between the input terminal I in and the output terminal I out. There is. Also, the input terminal I in
Between the output terminal I out and the capacitor 41, the resistor 42,
And a resistor 45 and a resistor 46 each having a resistance value R1 in parallel with the differential amplifier circuit 43. Further, the resistor 45 and the resistor 46 are connected, and the resistor 42 and the differential amplifier 43 are connected.

【0041】上述のような構成により、上記図5に示す
ように、入力端子Iinから入力される入力信号の周波数
が1/(2π(R1+R2)C1)から高周波になる
程、20db/decの利得が与えられ、周波数1/
(2πR2C1)では、出力端子Ioutから出力される
信号は、R1/(R1//R2)で表される利得が与え
られることとなる。
With the above configuration, as shown in FIG. 5, as the frequency of the input signal input from the input terminal I in becomes higher from 1 / (2π (R1 + R2) C1) to 20 dB / dec. Gain is given, frequency 1 /
At (2πR2C1), the signal output from the output terminal I out is given a gain represented by R1 / (R1 // R2).

【0042】尚、高域強調回路4bは、上記図4に示し
た高域強調回路4aの構成と同様の構成をしており、ま
た、上記図5に示した特性を有したものであるため、そ
の詳細な説明は省略する。また、高域強調回路4a,4
bによる具体的な効果についての詳細な説明は後述す
る。
The high frequency emphasizing circuit 4b has the same configuration as the high frequency emphasizing circuit 4a shown in FIG. 4 and has the characteristics shown in FIG. , Its detailed description is omitted. Further, the high frequency emphasizing circuits 4a, 4
A detailed description of the specific effect of b will be given later.

【0043】したがって、加算器3aで得られたA+C
信号Sa1は、高域強調回路4aにより高周波成分が増大
されてA+C信号Sd a1として2値化器5aに供給され
る。また、加算器3bで得られたB+D信号Sa2は、高
域強調回路4bにより高周波成分が増大されてB+D信
号Sd a2として2値化器5bに供給される。
Therefore, A + C obtained by the adder 3a
The high frequency component of the signal S a1 is increased by the high frequency emphasizing circuit 4 a and is supplied to the binarizer 5 a as an A + C signal S d a1 . Further, B + D signal S a2 obtained by the adder 3b, the high-frequency component is supplied as is increased B + D signal S d a2 the binarizing unit 5b by the high-frequency emphasis circuit 4b.

【0044】2値化器5aには、例えば、図示していな
いコンデンサにより、直流成分が遮断された高域強調回
路4aからのA+C信号Sd a1が供給される。そして、
2値化器5aは、直流成分が遮断されたA+C信号Sd
a1に対して、GNDレベルを中心とした2値化処理、す
なわち上記図3の(1)に示すような平均直流レベルL
1を中心とした2値化処理を施す。これにより、2値化
器5aでは、上記図3の(3)に示すような波形のディ
ジタル検出信号Sb1が得られる。
The binarizer 5a is supplied with the A + C signal S d a1 from the high frequency emphasizing circuit 4a, the direct current component of which is blocked by, for example, a capacitor (not shown). And
The binarizer 5a uses the A + C signal S d with the DC component cut off.
For a1 , the binarization process centered on the GND level, that is, the average DC level L as shown in (1) of FIG.
A binarization process centered on 1 is performed. As a result, the binarizer 5a obtains the digital detection signal S b1 having the waveform as shown in (3) of FIG.

【0045】また、2値化器5bには、2値化器5aと
同様にして、図示していないコンデンサにより、直流成
分が遮断された高域強調回路4bからのB+D信号Sd
a2が供給される。そして、2値化器5bは、2値化器5
aと同様にして、直流成分が遮断されたB+D信号Sd
a2に対して、GNDレベルを中心とした2値化処理、す
なわち上記図3の(2)に示すような平均直流レベルL
2を中心とした2値化処理を施す。これにより、2値化
器5bでは、上記図3の(4)に示すような波形のディ
ジタル検出信号Sb2が得られる。
Further, in the binarizer 5b, similarly to the binarizer 5a, the B + D signal S d from the high frequency emphasizing circuit 4b in which the DC component is cut off by a capacitor (not shown ).
a2 is supplied. Then, the binarizer 5b is the binarizer 5
In the same manner as a, the B + D signal S d with the DC component blocked
For a2 , the binarization process centered on the GND level, that is, the average DC level L as shown in (2) of FIG. 3 above.
2 binary processing with a focus on performing. As a result, the binarizer 5b obtains the digital detection signal S b2 having the waveform as shown in (4) of FIG.

【0046】上述のようにして2値化器5aで得られた
ディジタル検出信号Sd b1、及び2値化器5bで得られ
たディジタル検出信号Sd b2は、各々、位相比較器6に
供給される。
The digital detection signal S d b1 obtained by the binarizer 5a and the digital detection signal S d b2 obtained by the binarizer 5b as described above are supplied to the phase comparator 6, respectively. To be done.

【0047】位相比較器6は、例えば、図6に示すよう
な構成をしており、2値化器5aからのディジタル検出
信号Sd b1と、2値化器204bからのディジタル信号
d b2とから、進み位相差のパルス、及び遅れ位相差の
パルスを生成して、生成した2つのパルスを別々に出力
する。
The phase comparator 6 has a structure as shown in FIG. 6, for example, and has a digital detection signal S d b1 from the binarizer 5a and a digital signal S d b2 from the binarizer 204b. From this, a pulse with a lead phase difference and a pulse with a lag phase difference are generated, and the two generated pulses are output separately.

【0048】以下、上記図3の(3)〜(6)及び上記
図6を用いて、位相比較器6により生成される各パルス
について具体的に説明する。
Each pulse generated by the phase comparator 6 will be specifically described below with reference to (3) to (6) in FIG. 3 and FIG.

【0049】尚、上記図3の(5)及び(6)は、位相
比較器6により生成されるパルスの波形を示したもので
あり、上記図3の(3)〜(6)において、各信号の状
態部分及び状態反転部分を各々b1−X、b2−X、C
1−X、C2−Xで示すものとする。
Incidentally, (5) and (6) of FIG. 3 show waveforms of the pulse generated by the phase comparator 6, and in (3) to (6) of FIG. The state part and the state inversion part of the signal are denoted by b1-X, b2-X, and C, respectively.
1-X and C2-X.

【0050】まず、位相比較器6において、NANDゲ
ート600の出力信号Aは、状態部分b1−1及びb2
−1に示すように、2値化器5aからのディジタル検出
信号Sd b1と、2値化器5bからのディジタル検出信号
d b2とが共に「1」の場合のみ「0」となる。また、
ORゲート601の出力信号Bは、状態部分b1−2及
びb2−2に示すように、ディジタル検出信号Sd b1
ディジタル検出信号Sd b2が共に「0」の場合のみ
「0」となる。さらに、NANDゲート612の出力信
号は、後述するが、ディジタル検出信号Sd b1とディジ
タル検出信号Sd b2が共に等しい場合のみ通常「0」と
なる。このため、NANDゲート600の出力信号A、
又はORゲート601の出力信号Bが「0」の場合に、
フリップフロップ604は、セット、又はリセットさ
れ、信号Cを出力する。
First, in the phase comparator 6, the output signal A of the NAND gate 600 has the state parts b1-1 and b2.
As shown in -1, a digital detection signal S d b1 from the binarizing unit 5a, when the digital detection signal from the binarizing unit 5b S d b2 are both "1" only becomes "0". Also,
The output signal B of the OR gate 601, as shown in state portion b1-2 and b2-2, if the digital detection signal S d b1 and digital detection signal S d b2 are both "0" only "0". Further, as will be described later, the output signal of the NAND gate 612 normally becomes “0” only when both the digital detection signal S d b1 and the digital detection signal S d b2 are equal. Therefore, the output signal A of the NAND gate 600,
Alternatively, when the output signal B of the OR gate 601 is “0”,
The flip-flop 604 is set or reset and outputs the signal C.

【0051】すなわち、ディジタル検出信号Sd b1とデ
ィジタル検出信号Sd b2が共に「1」の場合に、フリッ
プフロップ604は、セットされて、「1」の信号Cを
出力し、ディジタル検出信号Sb1とディジタル検出信号
b2が共に「0」の場合に、フリップフロップ604
は、リセットされて、「0」の信号Cを出力する。
That is, when both the digital detection signal S d b1 and the digital detection signal S d b2 are "1", the flip-flop 604 is set and outputs the signal C of "1", and the digital detection signal S When both b1 and the digital detection signal S b2 are “0”, the flip-flop 604
Is reset and outputs a signal C of "0".

【0052】そこで、例えば、ディジタル検出信号Sd
b1とディジタル検出信号Sd b2が共に「1」の場合、フ
リップフロップ604は、セットされて、「1」の信号
Cを出力するため、NANDゲート606の出力信号
D、及びNANDゲート608の出力信号Fは、共に
「0」となる。また、この場合、ORゲート607の出
力信号E、及びORゲート609の出力信号Gは、共に
「1」となる。
Therefore, for example, the digital detection signal S d
When both b1 and the digital detection signal S d b2 are “1”, the flip-flop 604 is set and outputs the signal C of “1”. Therefore, the output signal D of the NAND gate 606 and the output of the NAND gate 608 are output. The signals F are both "0". Further, in this case, the output signal E of the OR gate 607 and the output signal G of the OR gate 609 are both “1”.

【0053】したがって、状態部分C1−1に示すよう
に、ディジタル検出信号Sd b1とディジタル検出信号Sd
b2が共に「1」の場合には、信号H、すなわち出力端子
1から出力されるパルスSC1が「0」で出力される。
また、状態部分C2−1に示すように、信号I、すなわ
ち出力端子I2から出力されるパルスSC2も「0」で出
力される。
Therefore, as shown in the state portion C1-1, the digital detection signal S d b1 and the digital detection signal S d
When both b2 are "1", the signal H, that is, the pulse S C1 output from the output terminal I 1 is output as "0".
Further, as shown in the state portion C2-1, the signal I, that is, the pulse S C2 output from the output terminal I 2 is also output as “0”.

【0054】次に、ディジタル検出信号Sd b1又はディ
ジタル検出信号Sd b2が「0」になると、例えば、状態
反転部分b1−3に示すように、ディジタル検出信号S
d b1が「0」になると、状態反転部分C1−2に示すよ
うに、パルスSC1が「1」となる。この時、パルスSC2
は、「0」である。
Next, when the digital detection signal S d b1 or the digital detection signal S d b2 becomes "0", for example, as shown in the state inversion part b1-3, the digital detection signal S d b1
When d b1 becomes “0”, the pulse S C1 becomes “1” as shown in the state inversion portion C1-2. At this time, the pulse S C2
Is “0”.

【0055】また、状態反転部分b2−3に示すよう
に、ディジタル検出信号Sd b2が「0」になり、ディジ
タル検出信号Sd b1とディジタル検出信号Sd b2が共に
「0」になると、状態反転部分C1−3に示すように、
パルスSC1が「0」となる。この時、パルスSC2は、
「0」である。
As shown in the state inversion part b2-3, when the digital detection signal S d b2 becomes "0" and both the digital detection signal S d b1 and the digital detection signal S d b2 become "0". As shown in the state inversion portion C1-3,
The pulse S C1 becomes “0”. At this time, the pulse S C2 is
It is "0".

【0056】そして、ディジタル検出信号Sd b1とディ
ジタル検出信号Sd b2が共に「0」になると、すなわち
ディジタル検出信号Sd b1とディジタル検出信号Sd b2
共に同じ状態となると、上述したが、NANDゲート6
12の出力は、「0」となり、ORゲート601の出力
信号Bも「0」となる。このため、フリップフロップ6
04は、リセットされる。これにより、NANDゲート
606の出力信号D、及びNANDゲート608の出力
信号Fは、共に「1」となる。また、ORゲート607
の出力信号E、及びORゲート609の出力信号Gは、
共に「0」となる。
When the digital detection signal S d b1 and the digital detection signal S d b2 both become "0", that is, when the digital detection signal S d b1 and the digital detection signal S d b2 both become the same state, , NAND gate 6
The output of 12 becomes "0", and the output signal B of the OR gate 601 also becomes "0". Therefore, the flip-flop 6
04 is reset. As a result, both the output signal D of the NAND gate 606 and the output signal F of the NAND gate 608 become "1". Also, the OR gate 607
And the output signal G of the OR gate 609 is
Both are “0”.

【0057】以後、ディジタル検出信号Sd b1又はディ
ジタル検出信号Sd b2が「1」になると、パルスSC1
はパルスSC2が「1」となり、ディジタル検出信号Sd
b1とディジタル検出信号Sd b2が共に「1」になると、
パルスSC1又はパルスSC2が共に「0」となって、最初
の状態に戻る。
After that, when the digital detection signal S d b1 or the digital detection signal S d b2 becomes “1”, the pulse S C1 or the pulse S C2 becomes “1”, and the digital detection signal S d
When both b1 and the digital detection signal S d b2 become “1”,
Both the pulse S C1 and the pulse S C2 become “0”, and the state returns to the initial state.

【0058】上述のように、位相比較器6に供給される
ディジタル検出信号Sb1の状態のみが反転した場合に
は、位相比較器6からパルスSC1が「1」で出力され、
ディジタル検出信号Sd b1とディジタル検出信号Sd b2
共に同じ状態になると、パルスSC1が「0」となる。ま
た、位相比較器6に供給されるディジタル検出信号Sd b
2の状態のみが反転した場合には、位相比較器6からパ
ルスSC2が「1」で出力され、ディジタル検出信号Sd
b1とディジタル検出信号Sd b2が共に同じ状態になる
と、パルスSC2が「0」となる。
As described above, when only the state of the digital detection signal S b1 supplied to the phase comparator 6 is inverted, the phase comparator 6 outputs the pulse S C1 at "1",
When both the digital detection signal S d b1 and the digital detection signal S d b2 are in the same state, the pulse S C1 becomes “0”. In addition, the digital detection signal S d b supplied to the phase comparator 6
When only the state of 2 is inverted, the pulse S C2 is output as “1” from the phase comparator 6, and the digital detection signal S d is output.
When both b1 and the digital detection signal S d b2 are in the same state, the pulse S C2 becomes “0”.

【0059】そして、パルスSC1とパルスSC2の「1」
の時間の長さの差が位相差を示すこととなる。
Then, "1" of the pulse S C1 and the pulse S C2
The difference in the length of time indicates the phase difference.

【0060】上述のようにして位相比較器6で得られた
パルスSC1とパルスSC2は、別々に、出力処理回路7に
供給される。
The pulse S C1 and the pulse S C2 obtained by the phase comparator 6 as described above are separately supplied to the output processing circuit 7.

【0061】出力処理回路7は、図示していないが、低
域通過フィルタ及び差動増幅回路からなる。この出力処
理回路7において、位相比較器6からのパルスSC1とパ
ルスSC2は、上記低域通過フィルタを介して上記差動増
幅回路に供給される。そして、上記差動増幅回路は、上
記低域通過フィルタを介したパルスSC1とパルスSC2
差分をとり、その差分に基いたトラッキング誤差信号を
生成する。したがって、出力処理回路7からは、上記図
3の(7)に示すようなトラッキング誤差信号Sd出力
される。
Although not shown, the output processing circuit 7 comprises a low pass filter and a differential amplifier circuit. In the output processing circuit 7, the pulse S C1 and the pulse S C2 from the phase comparator 6 are supplied to the differential amplifier circuit via the low pass filter. Then, the differential amplifier circuit takes the difference between the pulse S C1 and the pulse S C2 that have passed through the low-pass filter, and generates a tracking error signal based on the difference. Therefore, the output processing circuit 7 outputs the tracking error signal S d as shown in (7) of FIG.

【0062】上述のように、トラッキング誤差検出回路
100では、2値化器5a,5bの前段に高域強調回路
4a,4bを備え、2値化器5a,5bには、高域強調
回路4a,4bを介した信号が供給されるようになされ
ている。
As described above, in the tracking error detection circuit 100, the high-frequency emphasizing circuits 4a and 4b are provided in front of the binarizers 5a and 5b, and the high-frequency emphasizing circuit 4a is included in the binarizers 5a and 5b. , 4b are supplied.

【0063】以下、高域強調回路4a,4bを備えるこ
とによる効果について具体的に説明する。
The effect of providing the high frequency emphasizing circuits 4a and 4b will be specifically described below.

【0064】例えば、上記図2に示した光ディスク9に
は、EFM変調方式により[3T]〜[11T]の長さ
のピットの情報が記録されているものとする。また、空
間周波数特性は[L3T]〜1.5×[Lcutof
f]、[3T]の長さのピット(以下、3Tピットと言
う。)の繰り返し時の再生信号周波数は約4.5MH
z、[11T]の長さのピット(以下、11Tピットと
言う。)の繰り返し時の再生信号周波数は約1.2MH
zとする。さらに、高域強調回路4a,4bは、1MH
zで約+3dbの利得を与え、4MHzで約+12db
の利得を与えるものとする。
For example, it is assumed that the optical disc 9 shown in FIG. 2 has pit information of [3T] to [11T] length recorded by the EFM modulation method. The spatial frequency characteristic is [L 3T ] to 1.5 × [Lcutof
f] and [3T] length pits (hereinafter referred to as 3T pits) have a reproduction signal frequency of about 4.5 MH.
The reproduction signal frequency at the time of repeating z and [11T] pits (hereinafter referred to as 11T pits) is about 1.2 MH.
z. Further, the high frequency emphasizing circuits 4a and 4b are set to 1 MHz.
It gives a gain of about + 3db at z and about + 12db at 4MHz.
Shall be given.

【0065】まず、上述のような条件において、光ディ
スク9からは、上記図17に示したようなアイパターン
を有する再生信号が得られる。また、上記図17に示し
たアイパターンを有する光ディスク9からは、トラッキ
ング誤差検出回路100により、図7に示すようなトラ
ッキング誤差信号が得られる。このトラッキング誤差信
号は、フォーカスサーボをかけて光ディスク9のトラッ
クを横切っていく場合に得られたものである。
First, under the conditions as described above, a reproduction signal having the eye pattern as shown in FIG. 17 is obtained from the optical disc 9. Further, the tracking error signal as shown in FIG. 7 is obtained from the optical disc 9 having the eye pattern shown in FIG. 17 by the tracking error detection circuit 100. This tracking error signal is obtained when the focus servo is applied to cross the track of the optical disc 9.

【0066】つぎに、例えば、光ディスク9をピット非
対称性を有するディスクとした場合、この光ディスク9
からは、図8に示すように、3Tピットの振幅の中心レ
ベルL3Tが11Tピットの振幅の中心レベルL11Tから
大きくずれたアイパターンを有する再生信号が得られ
る。
Next, for example, when the optical disk 9 is a disk having pit asymmetry, this optical disk 9
As shown in FIG. 8, a reproduction signal having an eye pattern in which the center level L 3T of the amplitude of the 3T pit greatly deviates from the center level L 11T of the amplitude of the 11T pit is obtained.

【0067】そこで、上述のようなピット非対称性を有
する光ディスク9からトラッキング誤差信号を検出する
場合において、高域強調回路4a,4bの有無によるト
ラッキング誤差信号の違いは以下のようになる。
Therefore, when the tracking error signal is detected from the optical disk 9 having the pit asymmetry as described above, the difference between the tracking error signals depending on the presence or absence of the high frequency emphasizing circuits 4a and 4b is as follows.

【0068】図9は、トラッキング誤差検出回路100
から高域強調回路4a,4bを省いた場合に得られるト
ラッキング誤差信号、すなわち上記図13に示したよう
な従来のトラッキング誤差検出回路200を用いた場合
に得られるトラッキング誤差信号を示した図である。ま
た、図10の(a)及び(b)は、この場合において、
2値化器に入力される信号の波形、及び2値化器から出
力される信号の波形を示した図である。
FIG. 9 shows a tracking error detection circuit 100.
13 is a diagram showing a tracking error signal obtained when the high frequency emphasizing circuits 4a and 4b are omitted, that is, a tracking error signal obtained when the conventional tracking error detecting circuit 200 shown in FIG. 13 is used. is there. In addition, in this case, (a) and (b) of FIG.
It is the figure which showed the waveform of the signal input into a binarizer, and the waveform of the signal output from a binarizer.

【0069】上記図9に示したトラッキング誤差信号
は、上記図7に示したトラッキング誤差信号に比べ、振
幅低下、雑音増加、及び波形歪が生じている。また、上
記図10の(a)に示すように、2値化器へ入力される
信号は、短ピットの再生振幅が中心からずれているた
め、しきい値Tを横切ることができない部分Er1〜Er4
が生じている。このため、上記図10の(b)に示すよ
うに、しきい値Tを横切ることができない部分Er1〜E
r4は、2値化されずに出力されている。
The tracking error signal shown in FIG. 9 has lower amplitude, increased noise, and waveform distortion than the tracking error signal shown in FIG. Further, as shown in (a) of FIG. 10, the signal inputted to the binarizer has a portion E r1 that cannot cross the threshold T because the reproduction amplitude of the short pit is deviated from the center. ~ E r4
Has occurred. Therefore, as shown in FIG. 10B, the portions E r1 to E that cannot cross the threshold T.
r4 is output without being binarized.

【0070】一方、図11は、高域強調回路4a,4b
を備えたトラッキング誤差検出回路100を用いた場合
に得られるトラッキング誤差信号を示した図である。ま
た、図12の(a)及び(b)は、この場合の2値化器
5a,5bに入力される信号の波形、及び2値化器5
a,5bから出力される信号の波形を示した図である。
On the other hand, FIG. 11 shows high frequency emphasizing circuits 4a and 4b.
FIG. 7 is a diagram showing a tracking error signal obtained when the tracking error detection circuit 100 including the above is used. 12A and 12B are waveforms of signals input to the binarizers 5a and 5b and the binarizer 5 in this case.
It is the figure which showed the waveform of the signal output from a and 5b.

【0071】上記図11に示したトラッキング誤差信号
は、上記図7に示したトラッキング誤差信号に比べ、振
幅低下、雑音増加、及び波形歪が生じているが、上記図
9に示したトラッキング誤差信号より、振幅低下、雑音
増加、及び波形歪が大幅に改善されている。また、上記
図12の(a)に示すように、高域強調回路4a,4b
により、短ピットの再生振幅が増大されている。このた
め、上記図12の(b)に示すように、短ピットの再生
振幅が中心からずれていてもしきい値Tを横切ることが
でき、確実に2値化することができる。
The tracking error signal shown in FIG. 11 has lower amplitude, increased noise, and waveform distortion than the tracking error signal shown in FIG. 7, but the tracking error signal shown in FIG. Therefore, the amplitude reduction, the noise increase, and the waveform distortion are significantly improved. In addition, as shown in FIG. 12A, the high frequency emphasizing circuits 4a and 4b.
As a result, the reproduction amplitude of the short pit is increased. Therefore, as shown in (b) of FIG. 12, even if the reproduction amplitude of the short pit is deviated from the center, the threshold T can be crossed and the binarization can be surely performed.

【0072】上述のように、2値化器5a,5bの前段
に高域強調回路4a,4bを備えることにより、短ピッ
トの再生振幅が増大されるため、2値化処理及び位相比
較処理を正確に行うことができる。したがって、ピット
非対称性を有する光ディスクから得られるトラッキング
誤差信号の振幅低下、雑音増加、及び波形歪を低減する
ことができる。
As described above, by providing the high frequency emphasizing circuits 4a and 4b in front of the binarizers 5a and 5b, the reproduction amplitude of the short pit is increased, so that the binarization process and the phase comparison process are performed. Can be done accurately. Therefore, it is possible to reduce the amplitude reduction, noise increase, and waveform distortion of the tracking error signal obtained from the optical disc having the pit asymmetry.

【0073】また、2値化器5a,5bのオフセット電
圧のばらつき、フォーカスずれ、及び光ディスクの光ピ
ックアップ光軸からの傾き等に起因する再生信号のレベ
ル低下により生じるトラッキング誤差信号の振幅低下、
雑音増加、及び波形歪を低減することができる。
Further, the amplitude of the tracking error signal is reduced due to the variation in the offset voltage of the binarizers 5a and 5b, the focus shift, and the reduction in the level of the reproduction signal caused by the inclination of the optical disc from the optical pickup optical axis.
Noise increase and waveform distortion can be reduced.

【0074】したがって、トラッキング誤差検出回路1
00は、良質なトラッキング誤差信号を得ることができ
る。そして、トラッキング誤差検出回路100で得られ
たトラッキング誤差信号を用いることにより、安定した
高精度のトラッキング制御を行うことができる。
Therefore, the tracking error detection circuit 1
00 can obtain a good tracking error signal. Then, by using the tracking error signal obtained by the tracking error detection circuit 100, stable and highly accurate tracking control can be performed.

【0075】尚、上述したトラッキング誤差検出回路1
00では、2値化器5a,5bの前段に高域強調回路4
a,4bを設けた構成としたが、高域強調回路4a,4
bを設けずに、電流電圧変換器2A〜2Dに高域強調特
性を各々持たせるようにしてもよい。或いは、電流電圧
変換器2A〜2Dではなく加算器3a,3bに高域強調
特性を各々持たせるようにしてもよい。
The tracking error detection circuit 1 described above is used.
In 00, the high frequency emphasizing circuit 4 is provided before the binarizers 5a and 5b.
The high-frequency emphasizing circuits 4a, 4b
The current-voltage converters 2 </ b> A to 2 </ b> D may each be provided with high-frequency emphasis characteristics without providing b. Alternatively, instead of the current-voltage converters 2A to 2D, the adders 3a and 3b may have high-frequency emphasis characteristics.

【0076】[0076]

【発明の効果】本発明に係るトラッキング誤差検出装置
では、受光手段は、記録媒体の情報トラック上に照射光
を投射して形成された光スポットの反射光を受光素子に
より受光し、上記受光素子の受光量に応じた電流を出力
する。電流電圧変換手段は、上記受光手段の電流出力を
電圧信号に変換する。信号検出手段は、上記電流電圧変
換手段で得られた電圧信号から上記記録媒体に記録され
ている情報に応じて変化すると共に上記光スポットのト
ラッキング誤差に応じて互いに位相が変化する2つの検
出信号を生成する。波形整形手段は、上記信号検出手段
により生成された2つの検出信号を各々波形整形して2
つのディジタル検出信号を生成する。この時、上記波形
整形手段の前に備えられた高域強調手段は、各高周波成
分が増大された2つの検出信号を生成して上記波形整形
手段に供給する。位相比較手段は、上記波形整形手段に
より生成された2つのディジタル検出信号の位相差成分
に基いたトラッキング誤差信号を生成して出力する。こ
れにより、上記波形整形手段に供給される2つの検出信
号は、各高周波成分が増大されたものであるため、上記
上記波形整形手段は、2値化処理を正確に行うことがで
きる。また、上記位相比較手段には、正確な2値化処理
により得られた2つのディジタル検出信号が供給される
ため、上記位相比較手段は、位相比較処理を正確に行う
ことができ、良質のトラッキング誤差信号を生成するこ
とができる。したがって、上記トラッキング誤差検出装
置の検出精度を向上させることができる。また、このト
ラッキング誤差検出回路で得られた良質のトラッキング
誤差信号を用いることにより、安定した高精度のトラッ
キング制御を行うことができる。
In the tracking error detecting device according to the present invention, the light receiving means receives the reflected light of the light spot formed by projecting the irradiation light on the information track of the recording medium by the light receiving element, and the light receiving element The current is output according to the amount of received light. The current-voltage converting means converts the current output of the light receiving means into a voltage signal. The signal detection means changes from the voltage signal obtained by the current-voltage conversion means according to the information recorded on the recording medium, and the two detection signals whose phases change according to the tracking error of the light spot. To generate. The waveform shaping means shapes the waveforms of the two detection signals generated by the signal detecting means, and outputs 2
Generate two digital detection signals. At this time, the high frequency emphasizing means provided in front of the waveform shaping means generates two detection signals in which each high frequency component is increased and supplies the two detection signals to the waveform shaping means. The phase comparison means generates and outputs a tracking error signal based on the phase difference component of the two digital detection signals generated by the waveform shaping means. As a result, the two detection signals supplied to the waveform shaping means have high frequency components increased, and therefore the waveform shaping means can accurately perform the binarization process. Further, since the two digital detection signals obtained by the accurate binarization processing are supplied to the phase comparison means, the phase comparison means can accurately perform the phase comparison processing, and the tracking with good quality can be performed. An error signal can be generated. Therefore, it is possible to improve the detection accuracy of the tracking error detection device. Further, by using a high quality tracking error signal obtained by this tracking error detection circuit, stable and highly accurate tracking control can be performed.

【0077】また、本発明に係るトラッキング誤差検出
装置では、上記高域強調手段は、高域強調特性を有する
上記電流電圧変換手段により構成される。これにより、
信号検出手段には、各高周波成分が増大された電圧信号
が供給されることとなり、信号検出手段は、各高周波成
分が増大された2つの検出信号を生成することができ
る。また、上記波形整形手段は、2値化処理を正確に行
うことができる。また、上記位相比較手段は、位相比較
処理を正確に行うことができ、良質のトラッキング誤差
信号を生成することができる。したがって、上記トラッ
キング誤差検出装置の検出精度を向上させることができ
る。
Further, in the tracking error detecting device according to the present invention, the high frequency emphasizing means is composed of the current-voltage converting means having the high frequency emphasizing characteristic. This allows
The voltage signal in which each high frequency component is increased is supplied to the signal detection unit, and the signal detection unit can generate two detection signals in which each high frequency component is increased. Further, the waveform shaping means can accurately perform the binarization process. Further, the phase comparison means can accurately perform the phase comparison process and can generate a good quality tracking error signal. Therefore, it is possible to improve the detection accuracy of the tracking error detection device.

【0078】また、本発明に係るトラッキング誤差検出
装置では、上記高域強調手段は、高域強調特性を有する
上記信号検出手段により構成される。これにより、上記
波形整形手段に供給される2つの検出信号は、各高周波
成分が増大されたものであるため、上記上記波形整形手
段は、2値化処理を正確に行うことができる。また、上
記位相比較手段は、位相比較処理を正確に行うことがで
き、良質のトラッキング誤差信号を生成することができ
る。したがって、上記トラッキング誤差検出装置の検出
精度を向上させることができる。
Further, in the tracking error detecting apparatus according to the present invention, the high frequency emphasizing means is composed of the signal detecting means having the high frequency emphasizing characteristic. As a result, the two detection signals supplied to the waveform shaping means have high frequency components increased, and therefore the waveform shaping means can accurately perform the binarization process. Further, the phase comparison means can accurately perform the phase comparison process and can generate a good quality tracking error signal. Therefore, it is possible to improve the detection accuracy of the tracking error detection device.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明に係るトラッキング誤差検出装置を適用
したトラッキング誤差検出回路の構成を示すブロック図
である。
FIG. 1 is a block diagram showing a configuration of a tracking error detection circuit to which a tracking error detection device according to the present invention is applied.

【図2】光ヘッドの構成を示すブロック図である。FIG. 2 is a block diagram showing a configuration of an optical head.

【図3】上記トラッキング誤差検出回路の各構成要素の
各出力信号を説明するための波形図である。
FIG. 3 is a waveform diagram for explaining each output signal of each component of the tracking error detection circuit.

【図4】上記トラッキング誤差検出回路の高域強調回路
の構成を示す回路図である。
FIG. 4 is a circuit diagram showing a configuration of a high frequency emphasis circuit of the tracking error detection circuit.

【図5】上記高域強調回路の特性を説明するための図で
ある。
FIG. 5 is a diagram for explaining the characteristics of the high-frequency emphasis circuit.

【図6】上記トラッキング誤差検出回路の位相比較器の
構成を示す回路図である。
FIG. 6 is a circuit diagram showing a configuration of a phase comparator of the tracking error detection circuit.

【図7】下記図17のアイパターンを有する光ディスク
から得られるトラッキング誤差信号を説明するための図
である。
7 is a diagram for explaining a tracking error signal obtained from an optical disc having the eye pattern of FIG. 17 below.

【図8】ピット非対称性を有する光ディスクから得られ
る再生信号のアイパターンを説明するための図である。
FIG. 8 is a diagram for explaining an eye pattern of a reproduction signal obtained from an optical disc having pit asymmetry.

【図9】上記高域強調回路を備えない場合に得られるト
ラッキング誤差信号を説明するための図である。
FIG. 9 is a diagram for explaining a tracking error signal obtained when the high-frequency emphasis circuit is not provided.

【図10】上記高域強調回路を備えない場合の2値化器
における入出力信号を説明するための波形図である。
FIG. 10 is a waveform diagram for explaining input / output signals in the binarizer in the case where the high-frequency emphasis circuit is not provided.

【図11】上記高域強調回路を備えた場合に得られるト
ラッキング誤差信号を説明するための図である。
FIG. 11 is a diagram for explaining a tracking error signal obtained when the high-frequency emphasis circuit is provided.

【図12】上記高域強調回路を備えた場合の2値化器に
おける入出力信号を説明するための波形図である。
FIG. 12 is a waveform diagram for explaining input / output signals in the binarizer in the case where the high frequency emphasizing circuit is provided.

【図13】従来のトラッキング誤差検出回路の構成を示
すブロック図である。
FIG. 13 is a block diagram showing a configuration of a conventional tracking error detection circuit.

【図14】光ディスク用光学系の空間周波数特性を説明
するための図である。
FIG. 14 is a diagram for explaining a spatial frequency characteristic of an optical system for an optical disc.

【図15】ピット非対称性を持たない光ディスクから得
られる再生信号のアイパターンを説明するための図であ
る。
FIG. 15 is a diagram for explaining an eye pattern of a reproduction signal obtained from an optical disc having no pit asymmetry.

【図16】ピット非対称性を有する光ディスクから得ら
れる再生信号のアイパターンを説明するための図であ
る。
FIG. 16 is a diagram for explaining an eye pattern of a reproduction signal obtained from an optical disc having pit asymmetry.

【図17】最短ピットのピット長が光学系の遮断空間周
波数相当のピット長に最も近い場合の最短ピットの再生
振幅を説明するための図である。
FIG. 17 is a diagram for explaining the reproduction amplitude of the shortest pit when the pit length of the shortest pit is closest to the pit length corresponding to the cutoff spatial frequency of the optical system.

【符号の説明】[Explanation of symbols]

1 4分割フォトディテクタ 2A〜2D 電流電圧変換器 3a,3b 加算器 4a,4b 高域強調回路 5a,5b 2値化器 6 位相比較器 7 出力処理回路 100 トラッキング誤差検出回路 1 4-division photodetector 2A-2D Current-voltage converter 3a, 3b Adder 4a, 4b High-frequency emphasis circuit 5a, 5b Binarizer 6 Phase comparator 7 Output processing circuit 100 Tracking error detection circuit

Claims (3)

【特許請求の範囲】[Claims] 【請求項1】 記録媒体の情報トラック上に照射光を投
射して形成された光スポットの反射光を受光素子により
受光し、上記受光素子の受光量に応じた電流を出力する
受光手段と、 上記受光手段の電流出力を電圧信号に変換する電流電圧
変換手段と、 上記電流電圧変換手段で得られた電圧信号から上記記録
媒体に記録されている情報に応じて変化すると共に上記
光スポットのトラッキング誤差に応じて互いに位相が変
化する2つの検出信号を生成する信号検出手段と、 上記信号検出手段により生成された2つの検出信号を各
々波形整形して2つのディジタル検出信号を生成する波
形整形手段と、 上記波形整形手段により生成された2つのディジタル検
出信号の位相差成分に基いたトラッキング誤差信号を生
成して出力する位相比較手段とを備え、 上記波形整形手段の前に各高周波成分が増大された2つ
の検出信号を生成する高域強調手段を備えることを特徴
とするトラッキング誤差検出装置。
1. A light receiving means for receiving reflected light of a light spot formed by projecting irradiation light onto an information track of a recording medium by a light receiving element and outputting a current according to the amount of light received by the light receiving element. A current-voltage converting means for converting the current output of the light-receiving means into a voltage signal, and the tracking of the light spot, which changes according to the information recorded on the recording medium from the voltage signal obtained by the current-voltage converting means. A signal detection means for generating two detection signals whose phases change depending on an error, and a waveform shaping means for shaping the two detection signals generated by the signal detection means to generate two digital detection signals. And a phase comparison means for generating and outputting a tracking error signal based on the phase difference component of the two digital detection signals generated by the waveform shaping means. For example, a tracking error detecting apparatus characterized by comprising a high band emphasis means for generating two detection signals which each high-frequency component is increased prior to said waveform shaping means.
【請求項2】 上記高域強調手段は、高域強調特性を有
する上記電流電圧変換手段により構成されることを特徴
とする請求項1記載のトラッキング誤差検出装置。
2. The tracking error detecting device according to claim 1, wherein the high-frequency emphasis unit is constituted by the current-voltage conversion unit having a high-frequency emphasis characteristic.
【請求項3】 上記高域強調手段は、高域強調特性を有
する上記信号検出手段により構成されることを特徴とす
る請求項1記載のトラッキング誤差検出装置。
3. The tracking error detection device according to claim 1, wherein the high-frequency emphasis unit is constituted by the signal detection unit having a high-frequency emphasis characteristic.
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