JPH079691A - Apparatus for detection of abnormality of thermal head - Google Patents

Apparatus for detection of abnormality of thermal head

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JPH079691A
JPH079691A JP5145072A JP14507293A JPH079691A JP H079691 A JPH079691 A JP H079691A JP 5145072 A JP5145072 A JP 5145072A JP 14507293 A JP14507293 A JP 14507293A JP H079691 A JPH079691 A JP H079691A
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JP
Japan
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abnormality
voltage
data
dot
thermal head
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Application number
JP5145072A
Other languages
Japanese (ja)
Inventor
Yoshinao Yanagisawa
義直 柳沢
Kaihei Takamizawa
海平 高見沢
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Takamisawa Cybernetics Co Ltd
Original Assignee
Takamisawa Cybernetics Co Ltd
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Publication date
Application filed by Takamisawa Cybernetics Co Ltd filed Critical Takamisawa Cybernetics Co Ltd
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Abstract

PURPOSE:To prevent preliminarily abnormality from being generated by detecting whether the abnormality of a thermal head is generated or not by providing a comparison means wherein a drop in voltage of a heating element to which electric power is supplied is compared with a threshold voltage and when both values being in a specific voltage relation is detected, an abnormality-generated signal is emitted. CONSTITUTION:When electric power is supplied, and if a heating element (r1) is damaged, in the case of a wire-broken state, a drop in voltage of the element (r1) is not generated. Then, a voltage VEC to a contact EC comes to be almost equal to that of a power source VDD. Further, since a comparator OP of an abnormality detection circuit compares the voltage VEC with a threshold voltage VTH, and emits an output at a high voltage level, a detection data DEC of a theoretical value H indicating occurrence of the abnormality is transferred to a central control circuit MPU. Besides, when the element (r1) is normal, a drop in voltage of the element (r1) is generated. Therefore, the voltage VEC at the contact EC comes to be lower than the threshold voltage VTH, an output of the comparator OP comes to be at a low voltage level, and the detection value DEC of a theoretical value L indicating the normal state is transferred to the central control circuit MPU.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は、サーマルヘッドの異常
発生の有無を検出するための異常検出装置に関し、特
に、ドット印字に対応して設けられている発熱抵抗体の
異常発生を個々独立に検出する異常検出装置に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an abnormality detecting device for detecting the presence / absence of an abnormality in a thermal head, and more particularly to independently detecting the occurrence of an abnormality in a heating resistor provided for dot printing. The present invention relates to an abnormality detection device for detecting.

【0002】[0002]

【従来の技術】サーマルヘッドは、数十μmないし百数
十μm口の多数の発熱抵抗体が絶縁基板上に設置され、
これらの発熱抵抗体に選択的に通電することによって発
生するジュール熱を、感熱紙や転写用フィルムなどに伝
達させることにより、ドットのモザイクとして文字や絵
などを印字するものであり、ファクシミリをはじめとし
て、計測機器、各種端末用プリンタ、駅の自動券売機な
どの広い範囲の記録装置に適用されている。
2. Description of the Related Art A thermal head has a large number of heating resistors of several tens μm to hundreds of tens μm installed on an insulating substrate.
The Joule heat generated by selectively energizing these heating resistors is transferred to thermal paper or transfer film to print characters and pictures as a mosaic of dots. Is applied to a wide range of recording devices such as measuring instruments, printers for various terminals, and automatic ticket vending machines at stations.

【0003】ところで、かかるサーマルヘッドは、各発
熱抵抗体が高温の熱パルスを発生するので、優れた耐温
度特性を有し、また摺動などによる摩耗が少なく機械的
強度が高いなどの高信頼性が要求されている。更に、短
い熱的時定数が設定でき、感熱紙などに短時間で印字す
ることができる熱パルスを発生することができるなどの
高速印字可能性が要求されている。更に、印字品質の良
いことが要求されている。
By the way, in such a thermal head, since each heating resistor generates a high-temperature heat pulse, it has excellent temperature resistance and has high reliability such as low abrasion due to sliding and high mechanical strength. Sex is required. Furthermore, high-speed printability is required such that a short thermal time constant can be set and a heat pulse that can be printed on a thermal paper in a short time can be generated. Further, good print quality is required.

【0004】そして、このような要求を満足するため
に、従来、サーマルヘッドを供給する側のメーカーによ
って、発熱抵抗体の材質の向上や絶縁基板を含めた構造
的改良、発熱抵抗体の配置方法や駆動方法などの改良が
行われてきた。
In order to satisfy such requirements, conventionally, the manufacturer of the thermal head supplier has improved the material of the heating resistor, structural improvement including the insulating substrate, and method of arranging the heating resistor. And driving methods have been improved.

【0005】[0005]

【発明が解決しようとする課題】しかしながら、このよ
うに改良が重ねられてきたサーマルヘッドであっても、
厳しい使用条件下で連続駆動されるような場合には、特
性劣化や故障等の異常発生を避けることができないのが
実情である。
However, even in the thermal head which has been improved in this way,
Under continuous circumstances, it is inevitable that abnormalities such as characteristic deterioration and failures cannot be avoided under continuous driving conditions.

【0006】そこで、このようなサーマルヘッドを組込
んで各種の記録装置を実現する側のメーカー等は、組込
まれたサーマルヘッドの異常の発生を未然に防止し得る
自動監視システムや、ひとたび異常が発生した場合には
迅速に対処することができる装置構成を要求されてい
る。特に、顧客を対象とする各種業務に適用される機器
にあっては、業務の迅速処理や信頼性のある業務の遂行
を行うために極めて重要となっている。
Therefore, manufacturers, etc., who implement various recording devices by incorporating such a thermal head, have an automatic monitoring system that can prevent the occurrence of abnormality of the incorporated thermal head, and once In the event of an occurrence, there is a demand for a device configuration that can promptly deal with it. In particular, in a device applied to various kinds of work for a customer, it is extremely important for quick processing of work and execution of reliable work.

【0007】一例として、駅の構内などに設置される自
動券売機に内蔵されるサーマールヘッドは、券売業務の
性質上、極めて多数の利用客に対して迅速な券売処理を
行う必要があるので、最大稼動能力の状態を長時間維持
しつつ高速且つ高品質の印字を行うこととなり、異常発
生の頻度が高くなる。このことは、従来、乗車券を購入
したときに印字の潰れや掠れによる不鮮明を経験した利
用者が少なからず存在していたことからも明らかであ
る。そして、このような不鮮明印字の原因は、サーマル
ヘッドの発熱抵抗体が熱的あるいは機械的に破損するこ
とによる場合が多い。したがって、自動券売機のように
多数の利用客を対象とするような時間的制限のある分野
では、このような異常発生の事態を未然に防止するため
の異常検出手段が極めて重要である。特に近年の様に新
幹線に代表される高速鉄道網の整備が為され高額の特急
券等についても無人管理の元で発券する趨勢にある中
で、高額の金銭を投入したにもかかわらず殆んど白紙で
ある券が放出されたり、日付が不明である等の券が発行
されると利用客・交通機関共多大な混乱に巻き込まれる
こととなる本発明はこのような課題に鑑みて成されたも
のであり、サーマルヘッドの異常発生の有無を確実に検
出して、異常発生を未然に防止することができる異常検
出装置を提供することを目的とする。
[0007] As an example, a thermal head installed in an automatic ticket vending machine installed on the premises of a station or the like needs to perform prompt ticket sales processing to an extremely large number of users due to the nature of ticket sales. High-speed and high-quality printing is performed while maintaining the state of maximum operating capacity for a long time, and the frequency of occurrence of abnormality increases. This is clear from the fact that there have been many users who have experienced blurring due to print crushing or blurring when purchasing a ticket. In many cases, the cause of such unclear printing is thermal or mechanical damage to the heating resistor of the thermal head. Therefore, in a field such as an automatic ticket vending machine, which has a time limit such as targeting a large number of customers, abnormality detecting means for preventing such a situation of occurrence of abnormality is extremely important. Particularly in recent years, the high-speed rail network represented by the Shinkansen has been developed and high-priced express tickets are being issued under unmanned management. If a blank ticket is released or a ticket with an unknown date is issued, the passengers and the transportation will be in a great deal of confusion. It is an object of the present invention to provide an abnormality detection device capable of reliably detecting whether or not an abnormality has occurred in a thermal head and preventing the abnormality from occurring.

【0008】[0008]

【課題を解決するための手段】このような目的を達成す
るために本発明は、ドット記録すべきドット情報に応じ
て複数の発熱抵抗体に電力源から電力を供給して夫々の
発熱抵抗体に発生したジュール熱によりドット記録する
サーマルヘッドに適用されるサーマルヘッド異常検出装
置を対象とし、上記複数の発熱抵抗体の内、異常検出す
べき1又は2以上の発熱抵抗体を指定するドット情報を
発生する選択手段と、上記ドット情報に従って前記電力
源から異常検出すべき上記発熱抵抗体にのみ電力を供給
する駆動手段と、上記電力供給された発熱抵抗体の電圧
降下をしきい値電圧と比較して、該電圧降下がしきい値
電圧に対して所定の電圧関係にあることを検出すると、
異常発生を示す検出信号を発生する比較手段とを具備す
る構成とした。
In order to achieve such an object, the present invention provides a plurality of heat generating resistors by supplying power from a power source according to dot information to be dot-recorded. Targeting a thermal head abnormality detection device applied to a thermal head for dot recording by Joule heat generated in the above, dot information specifying one or more heating resistors to detect an abnormality among the plurality of heating resistors Generating means, driving means for supplying power only to the heating resistor to be abnormally detected from the power source according to the dot information, and a voltage drop of the powered heating resistor as a threshold voltage. In comparison, when it is detected that the voltage drop has a predetermined voltage relationship with the threshold voltage,
It is configured to include a comparison unit that generates a detection signal indicating that an abnormality has occurred.

【0009】[0009]

【作用】このような構成によれば、各発熱抵抗体に対応
するドット情報に基づいて特定の発熱抵抗体に通電し、
その通電による特定発熱抵抗体の電圧降下が、所定のし
きい値電圧との比較によって、正常動作時での電圧降下
と異なっていると、異常発生の検出信号が出力される。
したがって、発熱抵抗体の特性劣化や破損等を個々独立
に検出することができる。又、印字などのドット解像度
に応じて、複数の発熱抵抗体毎に同時に通電して、その
ときの電圧降下の変化から異常の検出をしたり、使用頻
度の高い1又は2以上の発熱抵抗体の異常検出を行う等
の各種の検出方法にも適用することができる、極めて汎
用性に優れた技術である。
With such a configuration, the specific heating resistor is energized based on the dot information corresponding to each heating resistor,
If the voltage drop of the specific heating resistor due to the energization is different from the voltage drop during normal operation by comparison with a predetermined threshold voltage, a detection signal of abnormality occurrence is output.
Therefore, it is possible to independently detect the characteristic deterioration and damage of the heating resistor. In addition, depending on the dot resolution such as printing, the plurality of heating resistors are simultaneously energized to detect abnormalities from changes in the voltage drop at that time, or one or more heating resistors that are frequently used. It is a technology with extremely excellent versatility that can be applied to various detection methods such as detecting abnormalities.

【0010】[0010]

【実施例】以下、本発明によるサーマルヘッドの異常検
出装置の一実施例を図面と共に説明する。まず、図1に
基づいて構成を説明すると、このサーマルヘッドは、絶
縁基板上にその長手方向に沿って一列に形成された32
0個の微小発熱抵抗体r1〜r320 を有し、更に、これ
らの発熱抵抗体r1 〜r320 に個々独立に通電するため
のドライバ回路DR1 〜DR4 と、これらのドライバ回
路DR1 〜DR4 に通電の指示を行うための320ビッ
トのドットデータD1 〜D320 を選択して転送するマル
チプレクサ回路M1 〜M4 と、これらのマルチプレクサ
回路M1 〜M4 に320ビットのドットデータD1 〜D
320 を並列転送する320ビットのシフトレジスタ(シ
リアル入力パラレル出力シフトレジスタ)SR及び、後
述する制御回路と異常検出回路が、同一絶縁基板上に形
成されることにより、ユニット化されたライン型サーマ
ルヘッドとなっている。そして、このユニット化された
サーマルヘッドに設けられた接続端子群を介して接続さ
れたマイクロプロセッサ等の中央制御ユニットMPUに
より駆動される。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS An embodiment of a thermal head abnormality detecting device according to the present invention will be described below with reference to the drawings. First, the structure will be described with reference to FIG. 1. This thermal head is formed on an insulating substrate in a row along the longitudinal direction thereof.
It has zero minute heating resistors r 1 to r 320 , and further driver circuits DR 1 to DR 4 for independently energizing these heating resistors r 1 to r 320 , and these driver circuits DR. Multiplexer circuits M 1 to M 4 that select and transfer 320-bit dot data D 1 to D 320 for instructing energization to 1 to DR 4 and 320-bit data to these multiplexer circuits M 1 to M 4 . Dot data D 1 to D
A 320-bit shift register (serial input parallel output shift register) SR for transferring 320 in parallel, and a line-type thermal head unitized by forming a control circuit and an abnormality detection circuit described later on the same insulating substrate. Has become. Then, it is driven by a central control unit MPU such as a microprocessor connected through a connection terminal group provided in this unitized thermal head.

【0011】更に構成を詳述する。上記の制御回路は、
単安定マルチバイブレータMBと、2入力ANDゲート
AN1 〜AN4 と、発熱抵抗体r1 〜r320 に近接して
絶縁基板上に設けられたサーミスタTMと、P形MOS
FET Tr0 を備えている。
The configuration will be further described in detail. The above control circuit
A monostable multivibrator MB, two-input AND gates AN 1 to AN 4 , a thermistor TM provided on the insulating substrate in the vicinity of the heating resistors r 1 to r 320 , and a P-type MOS.
The FET Tr 0 is provided.

【0012】ここで、単安定マルチバイブレータMB
は、トリガデータTG が供給されると、容量素子Cτ
と抵抗Rτ 及びサーミスタTMの抵抗値RTMによる時
定数τ、即ちτ=1/Cτ (Rτ +RTM)によって決
まる時間幅で論理“H”となるストローブデータSTB
を発生する。尚、抵抗値RTMは、絶縁基板の温度に応じ
て変化するので、時定数τも変化し、同時に、ストロー
ブデータSTBの時間幅も変化する。ANDゲートAN
1 〜AN4 は、中央制御ユニットMPUから入力される
アクティブデータE1 〜E4 とストローブデータSTB
との論理積データ(以下、セレクトデータという)S1
〜S4 を発生して、夫々対応するマルチプレクサ回路M
1 〜M4 のセレクト端子に供給する。尚、同図から明ら
かなように、ストローブデータSTB及びアクティブデ
ータE1 〜E4 が論理“H”のときに、セレクトデータ
1 〜S4 が論理“H”となる。P形MOSFET T
0 は、ゲート端子に印加される電力制御データPが論
理“L”のときにオン状態になることにより、電源VDD
からドライバ回路DR1 〜DR4 へ駆動電力を供給し、
論理 “H”のときはオフ状態となって駆動電力の供給
を遮断する。
Here, the monostable multivibrator MB
Is supplied with the trigger data T G , the capacitive element C τ
Strobe data STB that becomes a logic "H" in a time width determined by the resistance R τ and the resistance value R TM of the thermistor TM, that is, τ = 1 / C τ (R τ + R TM ).
To occur. Since the resistance value R TM changes according to the temperature of the insulating substrate, the time constant τ also changes, and at the same time, the time width of the strobe data STB also changes. AND gate AN
1 to AN 4 are active data E 1 to E 4 and strobe data STB input from the central control unit MPU.
AND data (hereinafter referred to as select data) S 1
~ S 4 are generated and the corresponding multiplexer circuits M are generated.
Supply to select terminals 1 to M 4 . As it is apparent from the figure, strobe data STB and active data E 1 to E 4 is at the logical "H", the select data S 1 to S 4 is logic "H". P-type MOSFET T
r 0 is turned on when the power control data P applied to the gate terminal is logic “L”, so that the power supply V DD
Drive power is supplied to the driver circuits DR 1 to DR 4 from
When it is a logic "H", it is turned off to cut off the supply of drive power.

【0013】次に、シストレジスタSRは、クロックデ
ータCKに同期して1ビット毎に転送されてくるドット
データDS を順次にシリアル入力してパラレル出力する
と共に、入力されたラッチデータLHに同期してそのパ
ラレル出力を並列にラッチすることにより、320ビッ
トのドットデータD1 〜D320 を発生する。尚、図示し
ないが、シストレジスタSR内に内蔵されている320
ビット分のD形フリップフロップ群が上記のラッチを行
うようになっている。
Next, the shift register SR sequentially serially inputs and parallel outputs dot data D S transferred bit by bit in synchronization with the clock data CK, and at the same time, synchronizes with the input latch data LH. Then, the parallel outputs are latched in parallel to generate 320-bit dot data D 1 to D 320 . Although not shown, 320 built in the shift register SR
A group of D-type flip-flops for bits performs the above-mentioned latch.

【0014】4個のマルチプレクサ回路M1 〜M4
内、第1のマルチプレクサ回路M1 は、第1ないし第8
0ビットまでのドットデータD1 〜D80が並列入力さ
れ、論理“H”のセレクトデータS1 が供給される期
間、これらのドットデータD1 〜D80を第1のドライバ
回路DR1 に並列転送する。第2のマルチプレクサ回路
2 は、第81ないし第160ビットまでのドットデー
タD81〜D160 が並列入力され、論理“H”のセレクト
データS2 が供給される期間、これらのドットデータD
81〜D160 を第2のドライバ回路DR2 に並列転送す
る。第3のマルチプレクサ回路M3 は、第161ないし
第240ビットまでのドットデータD161 〜D240 が並
列入力され、論理“H”のセレクトデータS3 が供給さ
れる期間、これらのドットデータD161 〜D240 を第3
のドライバ回路DR3 に並列転送する。第4のマルチプ
レクサ回路M4 は、第241ないし第320ビットまで
のドットデータD241 〜D320 が並列入力され、論理
“H”のセレクトデータS4 が供給される期間、これら
のドットデータD241 〜D320 を第4のドライバ回路D
4に並列転送する。
Of the four multiplexer circuits M 1 to M 4 , the first multiplexer circuit M 1 is the first to the eighth multiplexer circuits.
During the period in which the dot data D 1 to D 80 of up to 0 bits are input in parallel and the select data S 1 of logic “H” is supplied, these dot data D 1 to D 80 are parallel to the first driver circuit DR 1 . Forward. The second multiplexer circuit M 2 receives the dot data D 81 to D 160 of the 81st to 160th bits in parallel and supplies the dot data D 81 of the logic “H” during the period in which the select data S 2 is supplied.
81 to D 160 are transferred in parallel to the second driver circuit DR 2 . The third multiplexer circuit M 3 receives the dot data D 161 to D 240 of the 161st to 240th bits in parallel and supplies the dot data D 161 of the logic “H” during the period in which the select data S 3 is supplied. ~ D 240 third
In parallel to the driver circuit DR 3 . The fourth multiplexer circuit M 4 receives the dot data D 241 to D 320 of the 241st to 320th bits in parallel and supplies the dot data D 241 of the logic “H” during the period in which the select data S 4 is supplied. ~ D 320 is the fourth driver circuit D
Transfer to R 4 in parallel.

【0015】したがって、4ビットのアクティブデータ
1 〜E4 の各論理値を任意に設定すれば、全てのマル
チプレクサ回路M1 〜M4 を同時に指定することができ
るし、又、個々独立に指定することもできる。即ち、ド
ットデータD1 〜D320 を80ビット分ずつ4分割して
選択して、対応するドライバ回路DR1 〜DR4 へ転送
することができることができるようになっている。
Therefore, if each logical value of the 4-bit active data E 1 to E 4 is arbitrarily set, all the multiplexer circuits M 1 to M 4 can be designated at the same time, or individually designated. You can also do it. That is, it is possible to select the dot data D 1 to D 320 by dividing the dot data into 4 by 80 bits and transfer the selected dot data to the corresponding driver circuits DR 1 to DR 4 .

【0016】4個のドライバ回路DR1 〜DR4 もマル
チプレクサ回路M1 〜M4 に対応した分割構成を有する
と共に、夫々の内部には、ドットデータD1 〜D320
よってオン・オフ制御される例えば320個のN形MO
SFETが内蔵されており、マルチプレクサ回路M1
4 から転送されてくる各ドットデータD1 〜D320
指定されてオンとなったN形MOSFETを介して、対
応する発熱抵抗体のみに駆動電力をを供給する構成とな
っている。
The four driver circuits DR 1 to DR 4 also have a division structure corresponding to the multiplexer circuits M 1 to M 4 , and inside of each of them is controlled to be turned on / off by dot data D 1 to D 320 . For example, 320 N-type MO
SFET is built-in, multiplexer circuit M 1 ~
The drive power is supplied only to the corresponding heating resistor via the N-type MOSFET which is designated and turned on by each dot data D 1 to D 320 transferred from M 4 .

【0017】図2は、マルチプレクサ回路M1 〜M4
びドライバ回路DR1 〜DR4 の更に詳細な構成例を、
第1のマルチプレクサM1 と第1のドライバ回路DR1
の構成を代表して示している。
FIG. 2 shows a more detailed configuration example of the multiplexer circuits M 1 to M 4 and the driver circuits DR 1 to DR 4 .
First multiplexer M 1 and first driver circuit DR 1
The configuration is shown as a representative.

【0018】図2において、マルチプレクサM1 は、一
方の入力端子に第1のセレクトデータS1 が供給される
と共に、他方の入力端子に各ドットデータD1 〜D80
対応して入力される80個の2入力ANDゲートm1
80で構成されている。ドライバ回路DR1 は80個の
N形MOSFET Tr1 〜Tr80から成り、これらの
MOSFET Tr1 〜Tr80は、対応するANDゲー
トm1 〜m80の出力がゲートに供給されると共に、ドレ
インが電力供給用のP形MOSFET Tr0のドレイ
ンに接続され、更に、各ソースが発熱抵抗体r1 〜r80
に対応付けて接続されている。そして、残余のマルチプ
レクサM2 〜M4 とドライバ回路DR〜DRも同
じ回路構成を有している。
In FIG. 2, the multiplexer M 1 is supplied with the first select data S 1 at one input terminal and the dot data D 1 to D 80 are correspondingly input at the other input terminal. 80 2-input AND gates m 1 ~
It is composed of m 80 . The driver circuit DR 1 is composed of 80 N-type MOSFETs Tr 1 to Tr 80. These MOSFETs Tr 1 to Tr 80 are supplied with the outputs of the corresponding AND gates m 1 to m 80 to their gates, and have their drains. It is connected to the drain of a P-type MOSFET Tr 0 for power supply, and each source has heating resistors r 1 to r 80.
Is connected to. The remaining multiplexers M 2 to M 4 and the driver circuits DR 2 to DR 4 also have the same circuit configuration.

【0019】再び図1において、上記の異常検出回路
は、非反転入力端子が電力供給用のP形MOSFET
Tr0 のドレイン(以下、検出接点ECという)に接続
されると共に、反転入力端子が抵抗R1 ,R2 による分
圧電圧(以下、しきい値電圧という)VTHが印加される
コンパレータOPと、コンパレータOPの出力を2値論
理の検出データDECに波形整形するD型フリップフロッ
プDFFを備えている。そして、検出データDECは、検
出接点ECの電圧VECが、VEC≧VTHのときは異常発生
を示す論理値“H”となり、VEC<VTHのときは正常を
示す論理値“L”となる。又、D型フリップフロップD
FFは、中央制御回路MPUからリセットデータRST
が供給されることによって、内部状態をリセットする。
Referring again to FIG. 1, in the above-mentioned abnormality detection circuit, the non-inverting input terminal is a P-type MOSFET for power supply.
A comparator OP which is connected to the drain of Tr 0 (hereinafter, referred to as a detection contact EC) and whose inverting input terminal is applied with a divided voltage (hereinafter, referred to as a threshold voltage) V TH by the resistors R 1 and R 2. , A D-type flip-flop DFF for waveform shaping the output of the comparator OP into binary logic detection data D EC . Then, the detection data D EC, the voltage V EC detection contact EC is a logical value indicating the abnormality when the V EC ≧ V TH "H", and the logical value indicating normal when the V EC <V TH " L ". In addition, D-type flip-flop D
FF is reset data RST from the central control circuit MPU.
Is supplied to reset the internal state.

【0020】次に、かかる構成を有する実施例の動作を
説明する。まず、図3に基づいてドット印字の最も基本
的な動作を説明する。例えば、かかるサーマルヘッドが
駅の券売機に内蔵されるサーマルプリンタに適用され
て、感熱層が塗布された元の感熱紙に乗車金額や利用日
等の情報を記録した後、乗車客に乗車券として発券処理
するような場合には、発熱抵抗体r1 〜r320 の配列方
向が主走査方向、発熱抵抗体r1 〜r320 と直交する方
向(感熱紙を相対的に移動させる方向)が副走査方向と
なる。図3は、その1主走査期間TH における記録動作
を示す。
Next, the operation of the embodiment having such a configuration will be described. First, the most basic operation of dot printing will be described with reference to FIG. For example, such a thermal head is applied to a thermal printer built into a ticket vending machine at a station, and after recording information such as the fare amount and the date of use on the original thermal paper coated with a thermal layer, the passengers get a ticket. In the case of issuing a ticket as described above, the arrangement direction of the heating resistors r 1 to r 320 is the main scanning direction, and the direction orthogonal to the heating resistors r 1 to r 320 (the direction in which the thermal paper is relatively moved) is It is in the sub-scanning direction. FIG. 3 shows the recording operation in the one main scanning period T H.

【0021】最初のデータ入力期間TINにおいて、シフ
トレジスタSRが、中央制御回路MPUから1ビット毎
に転送されてくるドットデータDS をクロックデータC
Kに同期してシリアル入力し、320ビット分のドット
データD1 〜D320 を入力するかで継続する。ここで、
ドット記録すべき部分に対応するドットデータは論理値
“H”、記録しない部分に対応するドットデータは論理
値“L”に設定される。更に、1主走査期間TH では、
電力制御データPが論理値“L”となり、P型MOSF
ET Tr0 をオン状態に設定する。次に、シフトレジ
スタSRが、320ビット分のドットデータD1 〜D
320 を入力すると、論理値“H”のラッチデータLHが
供給されることにより、これらをラッチしてマルチプレ
クサ回路M 1 〜M320 へ並列転送する。
First data input period TINAt Schiff
Register SR from the central control circuit MPU bit by bit
Data D transferred to theSClock data C
Serial input in synchronization with K and dot for 320 bits
Data D1~ D320Enter to continue. here,
Dot data corresponding to the dot recording area is a logical value
"H", the dot data corresponding to the part not recorded is logical
It is set to the value "L". Further, one main scanning period THThen
The power control data P becomes the logical value "L", and the P-type MOSF
ET Tr0Set to ON state. Next, shift register
Star SR is 320 bits of dot data D1~ D
320Is input, the latch data LH of logical value "H"
When supplied, these are latched and
Comb circuit M 1~ M320Transfer in parallel to.

【0022】次の記録期間TWTでは、まず、論理値
“H”の単一パルス状のトリガデータTG と、ほぼ記録
期間TWT内で論理値“H”となるアクティブデータE1
〜E4 が中央制御回路MPUから出力される。そして、
単安定マルチバイブレータMBが、トリガデータTG
同期して上記時定数τに対応する時間幅で論理値“H”
となるストローブデータSTBを出力すると共に、AN
DゲートAN1 〜AN4 が、ストローブデータSTBと
アクティブデータE1 〜E4 との論理積を求めて、セレ
クトデータS1 〜S4 を出力する。
In the next recording period T WT , first, the single pulse-shaped trigger data T G having the logical value “H” and the active data E 1 having the logical value “H” almost in the recording period T WT .
~ E 4 is output from the central control circuit MPU. And
The monostable multivibrator MB synchronizes with the trigger data T G and has a logical value "H" in a time width corresponding to the time constant τ.
And outputs strobe data STB
The D gates AN 1 to AN 4 obtain the logical product of the strobe data STB and the active data E 1 to E 4, and output select data S 1 to S 4 .

【0023】尚、図3のタイミンチャートでは、アクテ
ィブデータE1 〜E4 の全てを論理値“H”にすること
によって、全てのマルチプレクサ回路M1 〜M4 を指定
する場合を示したが、アクティブデータE1 〜E4 の一
部だけを論理値“H”にして、マルチプレクサ回路M1
〜M4 の一部を指定することもできる。
Although the timing chart of FIG. 3 shows the case where all the multiplexer circuits M 1 to M 4 are designated by setting all the active data E 1 to E 4 to the logical value “H”, Only a part of the active data E 1 to E 4 is set to the logical value “H”, and the multiplexer circuit M 1
It is also possible to specify a part of ~ M 4 .

【0024】このように、セレクトデータS1 〜S4
マルチプレクサ回路M1 〜M4 に供給されると、セレク
トデータS1 〜S4 で選択されたマルチプレクサ回路M
1 〜M4 がドットデータD1 〜D320 をドライブ回路D
1 〜DR4 に転送し、ドットデータD1 〜D320 の内
の論理値“H”となるドットデータに対応する発熱抵抗
体(即ち、発熱抵抗体r1 〜r320 の内の対応するも
の)に電力が供給されてジュール熱を発生し、ドットが
記録されることとなる。
In this way, when the select data S 1 to S 4 are supplied to the multiplexer circuits M 1 to M 4 , the multiplexer circuit M selected by the select data S 1 to S 4 is selected.
1 to M 4 drive dot data D 1 to D 320 to drive circuit D
The heating resistors corresponding to the dot data transferred to R 1 to DR 4 and having the logical value “H” in the dot data D 1 to D 320 (that is, corresponding to the heating resistors r 1 to r 320 ). Object) to generate Joule heat and dots are recorded.

【0025】そして、1主走査期間TH でのドット記録
が完了した後、感熱紙を副走査方向へ所定距離だけ移動
して、再び図3と同様の処理を行い、更にかかる副走査
と主走査の処理を繰り返すことによって、二次元のドッ
ト記録が可能となる。
After the dot recording in one main scanning period T H is completed, the thermal paper is moved in the sub scanning direction by a predetermined distance and the same process as in FIG. 3 is performed again. By repeating the scanning process, two-dimensional dot recording becomes possible.

【0026】尚、サーミスタTMの抵抗値RTMがサーマ
ルヘッドの温度変化に応じて変化するのに従って、単安
定マルチバイブレータMBから出力されるストローブデ
ータSTBの時間幅が変化するので、発熱抵抗体r1
320 に供給される駆動電力がサーマルヘッドの温度変
化に応じて自動制御され、過熱による発熱抵抗体r1
320 の破壊が防止されると共に、最適な温度状態での
ドット記録が維持される。因みに、サーマルヘッドの温
度が上昇すると、ストローブデータSTBの時間幅が短
くなって駆動電力が減少し、逆にサーマルヘッドの温度
が降下すると、ストローブデータSTBの時間幅が長く
なって駆動電力が増加する。
[0026] Incidentally, as the resistance value R TM of the thermistor TM is changed according to the temperature change of the thermal head, since the time width of the strobe data STB outputted from the monostable multivibrator MB is changed, the heating resistor r 1 ~
The driving power supplied to r 320 is automatically controlled according to the temperature change of the thermal head, and the heating resistor r 1 to
The destruction of r 320 is prevented and the dot recording in the optimum temperature state is maintained. Incidentally, when the temperature of the thermal head rises, the time width of the strobe data STB becomes shorter and the driving power decreases. On the contrary, when the temperature of the thermal head drops, the time width of the strobe data STB becomes longer and the driving power increases. To do.

【0027】次に、本発明の主要部である異常検出の動
作を図4に基づいて説明する。尚、かかる異常検出の動
作は、上記ドット記録(図3参照)に支障を来さない任
意の空き時間などにおいて行われる。この実施例では、
図4中の異常検査期間TCHKは、図3の1主走査期間T
H と同じ時間に設定されている。
Next, the operation of abnormality detection, which is the main part of the present invention, will be described with reference to FIG. The operation of detecting the abnormality is performed in an arbitrary free time or the like that does not hinder the dot recording (see FIG. 3). In this example,
The abnormality inspection period T CHK in FIG. 4 is equal to one main scanning period T in FIG.
It is set to the same time as H.

【0028】まず、図4のデータ入力期間TINにおい
て、ドット記録のときと同様にして320ビット分のド
ットデータDS をシフトレジスタSRに入力させる。但
し、このときは、異常発生の有無を検出すべき発熱抵抗
体に対応するドットデータのみが論理値“H”となり、
残余のドットデータが論理値“L”となるドットデータ
1 〜D320 をシフトレジスタSRに入力させる。更
に、異常検査期間TCHK 中は、電力制御データPが論理
値“L”となり、P型MOSFET Tr0 がオン状態
に保持される。
First, in the data input period T IN of FIG. 4, 320 bits of dot data D S are input to the shift register SR as in the case of dot recording. However, at this time, only the dot data corresponding to the heating resistor for which the presence or absence of the abnormality occurrence should be detected has the logical value “H”,
The dot data D 1 to D 320 that makes the remaining dot data a logical value “L” are input to the shift register SR. Further, during the abnormality inspection period T CHK , the power control data P becomes the logical value “L”, and the P-type MOSFET Tr 0 is held in the ON state.

【0029】代表例として、発熱抵抗体r1 の異常検出
を行う場合を述べれば、ドットデータDS は、クロック
データCKの最初から319周期目までの期間では、全
て論理値“L”、最後の320周期目で論理値“H”と
なり、これらがラッチデータLHが論理値“H”となる
のに同期してシフトレジスタSRにラッチされる。
As a typical example, the case of detecting the abnormality of the heating resistor r 1 will be described. In the period from the beginning to the 319th cycle of the clock data CK, the dot data D S are all logical values “L” and last. Becomes the logical value "H" in the 320th cycle of, and these are latched in the shift register SR in synchronization with the latch data LH becoming the logical value "H".

【0030】次に、期間TWTにおいて、まず、トリガデ
ータTG が単安定マルチバイブレータMBに供給される
と同時に、異常検出すべき発熱抵抗体に対応するマルチ
プレクサ回路(即ち、M1 〜M4 のいずれか)を選択す
るための論理値のアクティブデータE1 〜E4 がAND
ゲートAN1 〜AN4 に供給される。
Next, in the period T WT , first, the trigger data T G is supplied to the monostable multivibrator MB, and at the same time, a multiplexer circuit (that is, M 1 to M 4) corresponding to the heating resistor to be detected as an abnormality. AND) of active data E 1 to E 4 of logical value for selecting
It is supplied to the gates AN 1 to AN 4 .

【0031】発熱抵抗体r1 の異常検出を行う上記代表
例によれば、アクティブデータE1だけが論理値“H”
となる。そして、図4に示すように、単安定マルチバイ
ブレータMBがストローブデータSTBを発生し、更
に、ANDゲートAN1 〜AN4 が、アクティブデータ
1 〜E4 とストローブデータSTBとの論理積を求め
て、論理値“H”となるセレクトデータS1 と論理値
“L”となるセレクトデータS2 〜S4 を出力する。し
たがって、代表例によれば、発熱抵抗体r1 だけに電力
が供給される。
According to the above-mentioned representative example for detecting the abnormality of the heating resistor r 1 , only the active data E 1 has the logical value "H".
Becomes Then, as shown in FIG. 4, the monostable multivibrator MB generates the strobe data STB, and the AND gates AN 1 to AN 4 obtain the logical product of the active data E 1 to E 4 and the strobe data STB. Then, the select data S 1 having the logical value “H” and the select data S 2 to S 4 having the logical value “L” are output. Therefore, according to the representative example, power is supplied only to the heating resistor r 1 .

【0032】そして、このように電力が供給されると、
仮に、発熱抵抗体r1 が破損して断線状態になっていれ
ば、発熱抵抗体r1 の電圧降下が発生しなくなるので、
図4中のケース(1) に示すように、接点ECの電圧VEC
がほぼ電源VDD(24V)と等しくなり、更に、異常検
出回路のコンパレータOPが電圧VECとしきい値電圧V
THとを比較することによって高電圧レベルの出力を発生
するので、異常発生を示す論理値“H”の検出データD
ECが中央制御回路MPUへ転送される。一方、発熱抵抗
体r1 が正常であれば、発熱抵抗体r1 の電圧降下が発
生するので、図4中のケース(2) に示すように、接点E
Cの電圧VECがしきい値電圧VTHより低くなり、コンパ
レータOPの出力が低電圧レベル(グランドレベル)と
なり、中央制御回路MPUには、正常状態を示す論理値
“L”の検出データDECが転送される。
When power is supplied in this way,
If the heating resistor r 1 is broken and has a broken wire, the voltage drop of the heating resistor r 1 will not occur.
As shown in the case (1) in FIG. 4, the voltage V EC of the contact EC is
Becomes almost equal to the power supply V DD (24V), and further, the comparator OP of the abnormality detection circuit detects the voltage V EC and the threshold voltage V
Since a high voltage level output is generated by comparing with TH , the detection data D of the logical value "H" indicating the occurrence of an abnormality
The EC is transferred to the central control circuit MPU. On the other hand, if the heating resistor r 1 is normal, a voltage drop occurs in the heating resistor r 1 , so as shown in case (2) in FIG.
The voltage V EC of C becomes lower than the threshold voltage V TH , the output of the comparator OP becomes a low voltage level (ground level), and the detection data D of the logical value “L” indicating the normal state is sent to the central control circuit MPU. EC is transferred.

【0033】そして、中央制御回路MPUが、論理値
“H”の検出データDECの受信に応じて、予め設けられ
ている警報装置(例えば、警報ブザーやディスプレイな
ど)を制御することによって、異常の発生を監視要員な
どに指示することにより、発売を中止状態とし、白紙状
態の券や印字内容の不鮮明な券の発行を未然に防止した
上で、早期の修理を行うことができる。
[0033] Then, the central control unit MPU is, by depending on the reception of the detection data D EC logical value "H", for controlling the alarm device provided in advance (e.g., such as an alarm buzzer or a display), abnormal By instructing the monitoring personnel or the like of the occurrence of the above, the sale can be stopped, and the issuance of blank tickets and tickets with unclear printed contents can be prevented and early repair can be performed.

【0034】尚、この実施例では、コンパレータOPに
設定されているしきい値VTHを1種類だけ設けた場合を
示したが、レベルの異なる複数種類のしきい値を設定し
て、これらのしきい値と接点ECの電圧VECを逐次比較
することによって、発熱抵抗体の特性劣化の程度を検出
するようにしてもよい。
In this embodiment, only one kind of threshold value V TH set in the comparator OP is provided, but a plurality of kinds of threshold values having different levels are set and these threshold values are set. The degree of characteristic deterioration of the heating resistor may be detected by sequentially comparing the threshold value and the voltage V EC of the contact EC.

【0035】又、説明上、発熱抵抗体r1 の異常検出を
代表して述べたが、他の発熱抵抗体の異常検出について
も同様の処理で実現することができる。
Further, for the sake of explanation, the abnormality detection of the heating resistor r 1 has been described as a representative, but the abnormality detection of other heating resistors can be realized by the same processing.

【0036】更に、1つずつ順番に発熱抵抗体の異常を
検出だけでなく、複数個ずつまとめて発熱抵抗体の異常
検出を行うことができる。即ち、異常検出の際にシフト
レジスタSRに設定するドットデータD1 〜D320 の各
論理値を任意に変更・設定することによって、様々な異
常検出の態様を設定することができ、異常検出処理の時
間短縮や、きめの細かな異常検出のいずれにも対処でき
る、極めて汎用性に優れた技術である。
Further, it is possible not only to detect the abnormality of the heating resistors one by one, but also to detect the abnormality of the heating resistors collectively. That is, by arbitrarily changing and setting the respective logical values of the dot data D 1 to D 320 to be set in the shift register SR during anomaly detection, it is possible to set the various aspects of the abnormality detection, the abnormality detection processing It is an extremely versatile technology that can deal with both the shortening of the time and the detailed detection of abnormalities.

【0037】更に、この実施例では、いわゆる正論理の
回路構成を適用しているが、負論理の回路構成であって
もよい。又、1ライン当たり320個の発熱抵抗体を設
けたサーマルヘッドについて述べたが、これに限定され
ず、本発明は、任意の数の発熱抵抗体を設けたサーマル
ヘッドに適用できる。
Furthermore, in this embodiment, a so-called positive logic circuit structure is applied, but a negative logic circuit structure may be used. Further, the thermal head provided with 320 heating resistors per line has been described, but the present invention is not limited to this, and the present invention can be applied to a thermal head provided with an arbitrary number of heating resistors.

【0038】[0038]

【発明の効果】以上説明したように、本発明によれば、
複数の発熱抵抗体の内、異常検出すべき1又は2以上の
発熱抵抗体を指定するドット情報を発生する選択手段
と、上記ドット情報に従って電力源から異常検出すべき
上記発熱抵抗体にのみ電力を供給する駆動手段と、上記
電力供給された発熱抵抗体の電圧降下をしきい値電圧と
比較して、該電圧降下がしきい値電圧に対して所定の電
圧関係にあることを検出すると、異常発生を示す検出信
号を発生する比較手段とを具備する構成としたので、発
熱抵抗体の特性劣化や破損等を個々独立に細かく検出す
ることができる。又、印字などのドット解像度に応じ
て、複数の発熱抵抗体毎の異常検出も可能となる。この
ように、選択手段で発生するドット情報の設定の仕方に
よって様々な検査態様を得ることができるので、サーマ
ルヘッドの異常発生の有無を確実に検出して、異常発生
を未然に防止する等の様々な応用に適した、汎用性に優
れた技術を提供することができる。
As described above, according to the present invention,
Selection means for generating dot information designating one or more heating resistors to detect anomaly among the plurality of heating resistors, and power from the power source to the heating resistor to be anomaly detected according to the dot information. Comparing the voltage drop of the heating means supplied with the driving means and the power supply with the threshold voltage, and detecting that the voltage drop has a predetermined voltage relationship with respect to the threshold voltage, Since the constitution is provided with the comparison means for generating the detection signal indicating the occurrence of the abnormality, it is possible to individually and finely detect the characteristic deterioration and damage of the heating resistor. Further, it is also possible to detect an abnormality for each of the plurality of heat generating resistors according to the dot resolution such as printing. As described above, since various inspection modes can be obtained depending on how to set the dot information generated by the selection unit, it is possible to reliably detect the presence or absence of an abnormality in the thermal head and prevent the abnormality from occurring. It is possible to provide a highly versatile technique suitable for various applications.

【図面の簡単な説明】[Brief description of drawings]

【図1】一実施例の構成を示すブロック図である。FIG. 1 is a block diagram showing a configuration of an example.

【図2】図1の要部構成をより詳細に示す回路図であ
る。
FIG. 2 is a circuit diagram showing in more detail the main part configuration of FIG.

【図3】図1に示す回路のドット記録時の動作を説明す
るためのタイミングチャートである。
FIG. 3 is a timing chart for explaining the operation of the circuit shown in FIG. 1 during dot recording.

【図4】図1に示す回路の異常検査時の動作を説明する
ためのタイミングチャートである。
FIG. 4 is a timing chart for explaining an operation of the circuit shown in FIG. 1 at the time of abnormality inspection.

【符号の説明】[Explanation of symbols]

1 〜r320 …発熱抵抗体、DR1 〜DR4 …ドライブ
回路、M1 〜M4 …マルチプレクサ回路、SR…シフト
レジスタ、AN1 〜AN4 …ANDゲート、Tr0 ,T
1 〜Tr80…MOSFET、MB…単安定マルチバイ
ブレータ、TM…サーミスタ、OP…コンパレータ、R
1 ,R2 …分圧抵抗、DFF…D型フリップフロップ、
MPU…中央制御回路。
r 1 to r 320 ... Heating resistor, DR 1 to DR 4 ... Drive circuit, M 1 to M 4 ... Multiplexer circuit, SR ... Shift register, AN 1 to AN 4 ... AND gate, Tr 0 , T
r 1 to Tr 80 ... MOSFET, MB ... Monostable multivibrator, TM ... Thermistor, OP ... Comparator, R
1 , R 2 ... Dividing resistance, DFF ... D-type flip-flop,
MPU ... Central control circuit.

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】 ドット記録すべきドット情報に応じて複
数の発熱抵抗体に電力源から電力を供給して夫々の発熱
抵抗体に発生したジュール熱によりドット記録するサー
マルヘッドのサーマルヘッド異常検出装置において、 前記複数の発熱抵抗体の内、異常検出すべき1又は2以
上の発熱抵抗体を指定するドット情報を発生する選択手
段と、 上記ドット情報に従って前記電力源から異常検出すべき
上記発熱抵抗体にのみ電力を供給する駆動手段と、 上記電力供給された発熱抵抗体の電圧降下をしきい値電
圧と比較して、該電圧降下がしきい値電圧に対して所定
の電圧関係にあることを検出すると、異常発生を示す信
号を発生する比較手段と、を具備することを特徴とする
サーマルヘッド異常検出装置。
1. A thermal head abnormality detection device for a thermal head, which supplies electric power from a power source to a plurality of heating resistors in accordance with dot information to be dot-recorded and performs dot recording by Joule heat generated in each heating resistor. A selection means for generating dot information designating one or more heating resistors to detect an abnormality among the plurality of heating resistors, and the heating resistor to be detected abnormally from the power source according to the dot information. The voltage drop of the driving means for supplying power only to the body and the heating resistor to which the power is supplied is compared with a threshold voltage, and the voltage drop has a predetermined voltage relationship with the threshold voltage. A thermal head abnormality detection device, comprising: a comparison unit that generates a signal indicating that an abnormality has occurred.
JP5145072A 1993-06-16 1993-06-16 Apparatus for detection of abnormality of thermal head Pending JPH079691A (en)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6738085B2 (en) 2000-10-30 2004-05-18 Sharp Kabushiki Kaisha Printing apparatus and communication apparatus and information processing apparatus having the same
KR100437377B1 (en) * 2002-02-15 2004-06-25 삼성전자주식회사 An inkjet printer capable of checking as to whether nozzle is normal or not and method for informing about abnormal nozzle

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