JPH079040U - Transistor switch circuit - Google Patents

Transistor switch circuit

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JPH079040U
JPH079040U JP4137893U JP4137893U JPH079040U JP H079040 U JPH079040 U JP H079040U JP 4137893 U JP4137893 U JP 4137893U JP 4137893 U JP4137893 U JP 4137893U JP H079040 U JPH079040 U JP H079040U
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JP
Japan
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transistor
circuit
power supply
load
terminal
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山 隆 之 片
泉 哲 郎 中
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Mitsumi Electric Co Ltd
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Mitsumi Electric Co Ltd
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Abstract

(57)【要約】 (修正有) 【目的】 負荷に電源を供給するトランジスタスイッチ
回路において、過電流が流れた場合にトランジスタの破
壊を防ぐ簡易な構成の回路を提供する。 【構成】 電源供給端子1と共通端子2との間に、負荷
4への電源供給を制御する第1のトランシスタQ1が設
けられ、端子3より制御信号が入力され、トランジスタ
Q1のオン・オフ動作を制御する第2のトランジスタQ
2を備え、負荷4が短絡状態になつた時に第2のトラン
ジスタQ2を不動作にするため過電流保護回路5を設
け、電源供給端子1とトランジスタQ1との間に、所定
値を越える過電流を検出したとき第2のトランジスタQ
2を不動作にするための過電流検出回路を設ける。
(57) [Summary] (Modified) [Objective] To provide a circuit having a simple structure for preventing a transistor from being destroyed when an overcurrent flows in a transistor switch circuit for supplying power to a load. [Structure] A first transistor Q1 for controlling power supply to a load 4 is provided between a power supply terminal 1 and a common terminal 2, a control signal is input from a terminal 3, and an on / off operation of a transistor Q1 is performed. Second transistor Q for controlling
2, an overcurrent protection circuit 5 is provided to disable the second transistor Q2 when the load 4 is short-circuited, and an overcurrent exceeding a predetermined value is provided between the power supply terminal 1 and the transistor Q1. Second transistor Q when
An overcurrent detection circuit for disabling No. 2 is provided.

Description

【考案の詳細な説明】[Detailed description of the device]

【0001】[0001]

【産業上の利用分野】[Industrial applications]

本考案はトランジスタスイッチ回路に関し、特に、通信機器やOA、AV等の 電気機器において、電源供給をオン・オフ制御するためのトランジスタを用いた トランジスタスイッチ回路に関する。 The present invention relates to a transistor switch circuit, and more particularly to a transistor switch circuit using a transistor for controlling on / off of power supply in a communication device or an electric device such as OA and AV.

【0002】[0002]

【従来の技術】[Prior art]

一般に、通信機器や電気機器においては、電源を負荷に供給したり断としたり するためにトランジスタによるスイッチ回路が用いられている。 しかしながら、通常のトランジスタスイッチ回路においては、負荷に電源を供 給中に負荷側で何らかの理由により短絡状態になった場合や、電源供給側で何ら かの原因で過電流が供給されたりした場合、用いられている半導体素子すなわち スイッチングトランジスタが破壊し、大電流が流れて発火および発煙事故につな がる危険性がある。 このため何らかのトランジスタの破壊防止策が講じられることになる。 Generally, in a communication device or an electric device, a switch circuit including a transistor is used to supply or disconnect a power source to a load. However, in a normal transistor switch circuit, if the load side is short-circuited for some reason while supplying power to the load, or if an overcurrent is supplied to the power supply side for some reason, There is a risk that the semiconductor element used, that is, the switching transistor, will be destroyed and a large current will flow, leading to fire and smoke accidents. Therefore, some measure for preventing the destruction of the transistor is taken.

【0003】 図3はこのような破壊防止策が採用された従来のトランジスタスイッチ回路で あり、1は電源供給端子(Vin)、2は共通端子(GND)、3は制御信号入 力端子(ON/OFF)、4は負荷である。Q1はPNPトランジスタ、Q2は NPNトランジスタ、R1〜R4は抵抗である。FIG. 3 shows a conventional transistor switch circuit in which such a destruction prevention measure is adopted. 1 is a power supply terminal (Vin), 2 is a common terminal (GND), and 3 is a control signal input terminal (ON). / OFF), 4 is a load. Q1 is a PNP transistor, Q2 is an NPN transistor, and R1 to R4 are resistors.

【0004】 図3のトランジスタQ1のエミッタは電源供給端子1に接続され、そのコレク タは負荷4を介して共通端子2に接続され、トランジスタQ1のベース・エミッ タ間には抵抗R1が接続される。 一方、トランジスタQ2のベースは抵抗R3を介して制御信号入力端子3に接 続され、そのエミッタは共通端子2に接続され、そしてトランジスタQ2のベー ス・エミッタ間には抵抗R4が接続される。 また、トランジスタQ1のベースとトランジスタQ2のコレクタ間は、抵抗R 2を介して結合されている。The emitter of the transistor Q1 in FIG. 3 is connected to the power supply terminal 1, its collector is connected to the common terminal 2 via the load 4, and the resistor R1 is connected between the base and emitter of the transistor Q1. It On the other hand, the base of the transistor Q2 is connected to the control signal input terminal 3 via the resistor R3, its emitter is connected to the common terminal 2, and the resistor R4 is connected between the base and emitter of the transistor Q2. Further, the base of the transistor Q1 and the collector of the transistor Q2 are coupled via a resistor R2.

【0005】 このような従来のトランジスタスイッチ回路にあっては、電源供給端子1と共 通端子2間に電源電圧Vaが印加された状態で、制御信号入力端子3に信号源( 図示しない)から正のワンショット信号(セットパルス)が入力されると、スイ ッチング制御素子であるトランジスタQ2がオンし、これに伴ないゲート保護抵 抗R2を介して電源供給制御素子であるトランジスタQ1のベースが低電位とな り、オン状態となって電源供給端子1より電源電流Ifが負荷4に供給されるよ うに構成されている。また、負のワンショット信号(リセットパルス)が入力さ れるとトランジスタQ2がオフするので、トランジスタQ1もオフとなり負荷4 への電源電流Ifの供給も断たれることになる。 このように、信号源からのセット、リセット信号に応じてトランジスタQ1、 Q2をオン、オフ動作させ電源電流を供給したり、断つようにしたりして、目的 に対応する電源供給制御動作を行うわけである。In such a conventional transistor switch circuit, in the state where the power supply voltage Va is applied between the power supply terminal 1 and the common terminal 2, the control signal input terminal 3 is fed from a signal source (not shown). When a positive one-shot signal (set pulse) is input, the transistor Q2, which is a switching control element, turns on, and accordingly, the base of the transistor Q1, which is a power supply control element, passes through the gate protection resistor R2. It is configured to have a low potential and be turned on to supply the power supply current If to the load 4 from the power supply terminal 1. Further, when the negative one-shot signal (reset pulse) is input, the transistor Q2 is turned off, so that the transistor Q1 is also turned off and the supply of the power supply current If to the load 4 is cut off. In this way, the power supply control operation corresponding to the purpose is performed by turning on / off the transistors Q1 and Q2 according to the set / reset signal from the signal source to supply or cut off the power supply current. Is.

【0006】[0006]

【考案が解決しようとする課題】[Problems to be solved by the device]

しかしながら、このような従来のトランジスタスイッチ回路にあつては、次の ような問題点があった。すなわち、同トランジスタスイッチ回路では、PNPト ランジスタQ1をオン・オフ駆動させて電源供給動作を行っているが、負荷4に 電源を供給中に、例えばアブノーマルな状態すなわち負荷4が点線Aで示すよう に短絡状態(ショート)になった場合には、トランジスタQ2はオン状態となっ ているため、トランジスタQ1もオン状態にあるのでそのエミッタ・コレクタに 大電流が流れることとなり、トランジスタQ1の定格電力を超過し、最終的には 発煙、発火という大事故につながるという欠点があった。 また、電源供給側で何らかの原因で過電流が供給されたりした場合も、同様の 事故が起きる可能性がある。 この考案の目的は、前記従来の問題点を除去し、簡易な回路構成で負荷の短絡 や過電流による事故防止が可能なトランジスタスイッチ回路を提供することにあ る。 However, such a conventional transistor switch circuit has the following problems. That is, in the same transistor switch circuit, the PNP transistor Q1 is driven to be turned on and off to perform the power supply operation. However, while the power is being supplied to the load 4, for example, an abnormal state, that is, the load 4 is indicated by a dotted line A. In the case where the transistor Q2 is in the short-circuited state, the transistor Q2 is in the on-state, and the transistor Q1 is also in the on-state. Therefore, a large current flows through the emitter / collector of the transistor Q1. There was a drawback that it exceeded the limit and eventually led to a major accident such as smoke and ignition. Also, if an overcurrent is supplied for some reason on the power supply side, a similar accident may occur. An object of the present invention is to eliminate the above-mentioned conventional problems and to provide a transistor switch circuit capable of preventing an accident due to a load short circuit or an overcurrent with a simple circuit configuration.

【0007】[0007]

【課題を解決するための手段】[Means for Solving the Problems]

この目的を達成するために本考案は、 電源供給端子と共通端子との間に、負荷と該負荷への電源供給を制御する第1の トランジスタ回路とが設けられると共に、制御信号入力端子に制御入力端が接続 され、該第1のトランジスタ回路のオン・オフ動作を制御する第2のトランジス タ回路とを備えてなるトランジスタスイッチ回路であって、 前記負荷と第1のトランジスタ回路の接続点と、前記第2のトランジスタ回路 の制御入力端との間に、前記負荷が短絡状態になった時に該第2のトランジスタ 回路を不動作にするため過電流保護回路を設けたトランジスタスイッチ回路、 並びに、 電源供給端子と前記第1のトランジスタとの間に、予め定められた供給電流を 越える過電流を検出したとき前記第2のトランジスタを不動作にするための過電 流検出回路を設けたトランジスタスイッチ回路 を提案するものである。 To achieve this object, the present invention provides a load and a first transistor circuit for controlling power supply to the load between a power supply terminal and a common terminal, and a control signal input terminal for controlling the load. A transistor switch circuit having an input terminal connected thereto and a second transistor circuit for controlling on / off operation of the first transistor circuit, comprising: a connection point between the load and the first transistor circuit. A transistor switch circuit provided between the control input terminal of the second transistor circuit and an overcurrent protection circuit for disabling the second transistor circuit when the load is short-circuited; To disable the second transistor when an overcurrent exceeding a predetermined supply current is detected between the power supply terminal and the first transistor We propose a transistor switch circuit with an overcurrent detection circuit.

【0008】[0008]

【実施例】【Example】

以下、図1及び図2について本考案の実施例の詳細を説明する。 図1は本考案の第1実施例のトランジスタスイッチ回路の回路構成図であり、 図3と同一符号は同一構成部分を示しており、C1はコンデンサ、D1は放電用 ダイオード、R5は抵抗であり、これらは過電流保護回路5を形成する。 図1におけるトランジスタQ1のエミッタは電源供給端子1に接続され、その コレクタは負荷4を介して共通端子2に接続されて、トランジスタQ1のベース ・エミッタ間には抵抗R1が接続されている。 一方、トランジスタQ2のベースは抵抗R3およびコンデンサC1を介して制 御信号入力端子3に接続され、そのエミッタは共通端子2に接続され、そしてト ランジスタQ2のベース・エミッタ間には抵抗R4が接続されている。 また、トランジスタQ1のベースとトランジスタQ2のコレクタ間は、抵抗R 2を介して結合されている。 更に、カソードを制御信号入力端子3側に配置すると共にアノードを抵抗R3 側に配置したダイオードD1がコンデンサC1と並列に接続され、ダイオードD 1のアノードは抵抗R5を介してトランジスタQ1のコレクタに接続されている 。 Hereinafter, the embodiment of the present invention will be described in detail with reference to FIGS. 1 is a circuit configuration diagram of a transistor switch circuit according to a first embodiment of the present invention. The same reference numerals as those in FIG. 3 denote the same components, C1 is a capacitor, D1 is a discharging diode, and R5 is a resistor. , Which form the overcurrent protection circuit 5. The emitter of the transistor Q1 in FIG. 1 is connected to the power supply terminal 1, its collector is connected to the common terminal 2 via the load 4, and the resistor R1 is connected between the base and emitter of the transistor Q1. On the other hand, the base of the transistor Q2 is connected to the control signal input terminal 3 via the resistor R3 and the capacitor C1, its emitter is connected to the common terminal 2, and the resistor R4 is connected between the base and emitter of the transistor Q2. Has been done. Further, the base of the transistor Q1 and the collector of the transistor Q2 are coupled via a resistor R2. Further, a diode D1 having a cathode on the side of the control signal input terminal 3 and an anode on the side of the resistor R3 is connected in parallel with the capacitor C1, and the anode of the diode D1 is connected to the collector of the transistor Q1 via the resistor R5. Has been.

【0009】 したがって、図1のトランジスタスイッチ回路においては、電源供給端子1と 共通端子2間に電源電圧Vaが印加された状態で、制御信号入力端子3に信号源 (図示しない)からコンデンサC1を介してワンショット信号(セットパルス) が入力されると、スイッチング制御素子であるトランジスタQ2がオンし、これ に伴ないゲート保護抵抗R2を介して電源供給制御素子であるトランジスタQ1 のベースが低電位となり、オン状態となって電源供給端子1より電源電流Ifが 負荷4に供給されることになる。これと同時に、トランジスタQ1のコレクタか ら抵抗R5を介してトランジスタQ2のベースに電源電流が供給されるので、ト ランジスタQ1はオン状態を継続保持する。 また、負のワンショット信号(リセットパルス)が入力されると、トランジス タQ2がオフするので、トランジスタQ1もオフとなり負荷4への電源電流If の供給も断たれる。 このように、信号源からのセット、リセット信号に応じてトランジスタQ1、 Q2をオン、オフ動作させ電源電流を供給したり、断つようにしたりして、目的 、機能に対応する電源供給制御動作が行なわれる。Therefore, in the transistor switch circuit of FIG. 1, with the power supply voltage Va applied between the power supply terminal 1 and the common terminal 2, the capacitor C1 is connected to the control signal input terminal 3 from a signal source (not shown). When a one-shot signal (set pulse) is input via the transistor Q2, which is a switching control element, the transistor Q2, which is a switching control element, is turned on, and accordingly, the base of the transistor Q1 which is a power supply control element is at a low potential via the gate protection resistor R2. Then, the power supply terminal 1 is turned on, and the power supply current If is supplied from the power supply terminal 1 to the load 4. At the same time, since the power supply current is supplied from the collector of the transistor Q1 to the base of the transistor Q2 via the resistor R5, the transistor Q1 continuously maintains the ON state. When a negative one-shot signal (reset pulse) is input, the transistor Q2 turns off, so the transistor Q1 also turns off and the supply of the power supply current If to the load 4 is cut off. In this way, the power supply control operation corresponding to the purpose and function is performed by turning on / off the transistors Q1 and Q2 in accordance with the set / reset signal from the signal source to supply or cut off the power supply current. Done.

【0010】 次に、過電流保護動作について述べると、図1のトランジスタスイッチ回路に あっても、PNPトランジスタQ1をオン・オフ駆動させて電源供給動作を行っ ているが、負荷4に電源を供給中に、例えばアブノーマルな状態すなわち負荷4 が点線Aで示すように短絡状態(ショート)になった場合には、通常状態すなわ ちトランジスタQ2はオン状態、トランジスタQ1もオン状態を継続保持してい る状態が、負荷5のショートにより電源電流が共通端子2に引き込まれると同時 に、抵抗R5とコンデンサC1および放電用ダイオードD1との並列回路とから なる過電流保護回路5のルートを介してトランジスタQ2のベースが低電位とな る。この結果、トランジスタQ2のオンを維持する電流源がなくなるため、トラ ンジスタQ2はオフし、同時にトランジスタQ1もオフとなる。よって、トラン ジスタQ1のエミッタ・コレクタに大電流が流れることはなくなり、トランジス タQ1の定格電力を超過した電源電流による破壊に伴う発煙、発火という大事故 を防止することができる。Next, to describe the overcurrent protection operation, even in the transistor switch circuit of FIG. 1, the PNP transistor Q1 is driven on / off to perform the power supply operation, but the power is supplied to the load 4. If, for example, an abnormal state, that is, the load 4 is short-circuited (short-circuited) as shown by the dotted line A, the normal state, that is, the transistor Q2 is kept on and the transistor Q1 is kept on. At the same time that the power supply current is drawn into the common terminal 2 due to the short-circuiting of the load 5, the transistor is routed through the route of the overcurrent protection circuit 5 including the resistor R5 and the parallel circuit of the capacitor C1 and the discharging diode D1. The base of Q2 becomes low potential. As a result, there is no current source that keeps the transistor Q2 on, so the transistor Q2 turns off and at the same time the transistor Q1 turns off. Therefore, a large current does not flow in the emitter / collector of the transistor Q1, and it is possible to prevent a major accident such as smoking or ignition due to destruction due to the power supply current exceeding the rated power of the transistor Q1.

【0011】 図2は本考案の第2実施例によるトランジスタスイッチ回路であり、図1およ び図3と同一部分については同一符号を付してある。符号6は過電流検出回路で 、PNPトランジスタQ3、NPNトランジスタQ4、コンデンサC2、抵抗R 6、R7、R8から構成される。図1の実施例と異なる点は、過電流検出回路6 が追加されている点にある。 つまり、この実施例では、電源供給端子1とトランジスタQ1のエミッタとの 間に過電流検知抵抗R6とコンデンサC2との並列回路が挿入接続され、その抵 抗R6の電源供給端子1側の一端にトランジスタQ3のエミッタが接続され、そ の他端に抵抗R7を介してベースが接続される。そしてそのトランジスタQ3の コレクタは抵抗R8を介してトランジスタQ4のベースに接続され、そのエミツ タは共通端子2に、そのコレクタはコンデンサC1と抵抗R4との接続点に接続 されている。FIG. 2 shows a transistor switch circuit according to a second embodiment of the present invention, and the same parts as those in FIGS. 1 and 3 are designated by the same reference numerals. Reference numeral 6 is an overcurrent detection circuit, which includes a PNP transistor Q3, an NPN transistor Q4, a capacitor C2, and resistors R6, R7, and R8. The difference from the embodiment of FIG. 1 is that an overcurrent detection circuit 6 is added. That is, in this embodiment, a parallel circuit of the overcurrent detection resistor R6 and the capacitor C2 is inserted and connected between the power supply terminal 1 and the emitter of the transistor Q1, and one end of the resistor R6 on the power supply terminal 1 side is connected. The emitter of the transistor Q3 is connected, and the other end thereof is connected to the base via the resistor R7. The collector of the transistor Q3 is connected to the base of the transistor Q4 via the resistor R8, the emitter is connected to the common terminal 2, and the collector is connected to the connection point between the capacitor C1 and the resistor R4.

【0012】 よって、第2実施例によるトランジスタスイッチ回路においては、予め定めら れた電流を越えた電流が抵抗R6に流れると、トランジスタQ3が検知して検知 出力が送出されることになる。その出力はトランジスタQ4のベースに供給され るので、トランジスタQ4がオンするため、トランジスタQ2のベース電位が低 電位になり、トランジスタQ2がオフに、トランジスタQ1もオフになるから、 トランジスタQ1の破壊が防止される。 加えると、図1の実施例においては、負荷4が短絡状態になった場合に、トラ ンジスタQ2をオフにしてトランジスタQ1の破壊を防止したが、図2の実施例 においては、何らかの原因でトランジスタQ1の入力側すなわち電源供給端子1 側で過電流が供給された場合に、過電流検知回路6で検知してトランジスタQ1 の破壊が防止されるわけである。Therefore, in the transistor switch circuit according to the second embodiment, when a current that exceeds a predetermined current flows through the resistor R6, the transistor Q3 detects and outputs a detection output. Since the output is supplied to the base of the transistor Q4, the transistor Q4 turns on, the base potential of the transistor Q2 becomes low, the transistor Q2 turns off, and the transistor Q1 also turns off. To be prevented. In addition, in the embodiment of FIG. 1, when the load 4 is short-circuited, the transistor Q2 is turned off to prevent the transistor Q1 from being destroyed. However, in the embodiment of FIG. When an overcurrent is supplied to the input side of Q1, that is, the power supply terminal 1 side, the overcurrent detection circuit 6 detects it and prevents the transistor Q1 from being destroyed.

【0013】[0013]

【考案の効果】[Effect of device]

以上の説明から明らかなように、本考案は第1のトランジスタのコレクタと、 第2のトランジスタベースとの間に、過電流保護回路を配置するという簡易な構 成で、負荷が短絡状態になったとしても電源電流供給のためのトランジスタの破 壊を防止することができるので、破壊に伴う発煙、発火という事故を未然に防げ るという実用上の利点を有する。また電源供給側での過電流を検知する過電流検 知回路を設けることにより、トランジスタの破壊を未然に防止することができる ので、実用上の利点は更に大となる。 As is clear from the above description, the present invention has a simple configuration in which the overcurrent protection circuit is arranged between the collector of the first transistor and the base of the second transistor, and the load is short-circuited. Even in this case, the transistor for supplying the power supply current can be prevented from being destroyed, which has a practical advantage of preventing accidents such as smoking and ignition due to the destruction. In addition, by providing an overcurrent detection circuit that detects an overcurrent on the power supply side, it is possible to prevent the breakdown of the transistor in advance, so the practical advantage becomes even greater.

【図面の簡単な説明】[Brief description of drawings]

【図1】本考案の第1実施例によるトランジスタスイッ
チ回路の回路構成図である。
FIG. 1 is a circuit configuration diagram of a transistor switch circuit according to a first embodiment of the present invention.

【図2】本考案の第2実施例によるトランジスタスイッ
チ回路の回路構成図である。
FIG. 2 is a circuit configuration diagram of a transistor switch circuit according to a second embodiment of the present invention.

【図3】従来のトランジスタスイッチ回路の回路構成図
である。
FIG. 3 is a circuit configuration diagram of a conventional transistor switch circuit.

【符号の説明】[Explanation of symbols]

1 電源供給端子(Vin) 2 共通端子(GND) 3 制御信号入力端子(ON/OFF) 4 負荷(Vs) 5 過電流保護回路 6 過電流検知回路 Q1、Q3 PNPトランジスタ Q2、Q4 NPNトランジスタ R1〜R8 抵抗 D1 ダイオード C1、C2 コンデンサ 1 power supply terminal (Vin) 2 common terminal (GND) 3 control signal input terminal (ON / OFF) 4 load (Vs) 5 overcurrent protection circuit 6 overcurrent detection circuit Q1, Q3 PNP transistor Q2, Q4 NPN transistor R1 R8 resistance D1 diode C1, C2 capacitor

Claims (2)

【実用新案登録請求の範囲】[Scope of utility model registration request] 【請求項1】 電源供給端子と共通端子との間に、負荷
と該負荷への電源供給を制御する第1のトランジスタ回
路とが設けられると共に、 制御信号入力端子に制御入力端が接続され、該第1のト
ランジスタ回路のオン・オフ動作を制御する第2のトラ
ンジスタ回路とを備えてなるトランジスタスイッチ回路
であって、 前記負荷と第1のトランジスタ回路の接続点と、前記第
2のトランジスタ回路の制御入力端との間に、前記負荷
が短絡状態になった時に該第2のトランジスタ回路を不
動作にするため過電流保護回路を設けたことを特徴とす
るトランジスタスイッチ回路。
1. A load and a first transistor circuit for controlling power supply to the load are provided between a power supply terminal and a common terminal, and a control input terminal is connected to a control signal input terminal, A transistor switch circuit comprising a second transistor circuit for controlling on / off operation of the first transistor circuit, the connection point between the load and the first transistor circuit, and the second transistor circuit. And a control input terminal of the transistor switch circuit, wherein an overcurrent protection circuit is provided for disabling the second transistor circuit when the load is short-circuited.
【請求項2】 電源供給端子と共通端子との間に、負荷
と、該負荷への電源供給を制御する第1のトランジスタ
回路とが設けられると共に、 制御信号入力端子に制御入力端が接続され、該第1のト
ランジスタ回路のオン・オフ動作を制御する第2のトラ
ンジスタ回路とを備えてなるトランジスタスイッチ回路
であって、 前記負荷と第1のトランジスタ回路の接続点と、前記第
2のトランジスタ回路の制御入力端との間に、前記負荷
が短絡状態になった時に該第2のトランジスタ回路を不
動作にするため過電流保護回路を設け、 更に電源供給端子と前記第1のトランジスタとの間に、
予め定められた供給電流を越える過電流を検出したとき
前記第2のトランジスタを不動作にするための過電流検
出回路を設けたことを特徴とするトランジスタスイッチ
回路。
2. A load and a first transistor circuit for controlling power supply to the load are provided between the power supply terminal and the common terminal, and a control input terminal is connected to the control signal input terminal. And a second transistor circuit for controlling on / off operation of the first transistor circuit, comprising: a connection point between the load and the first transistor circuit; and the second transistor. An overcurrent protection circuit is provided between the control input terminal of the circuit and the control input terminal to disable the second transistor circuit when the load is short-circuited, and a power supply terminal and the first transistor are connected. Between,
A transistor switch circuit comprising an overcurrent detection circuit for disabling the second transistor when an overcurrent exceeding a predetermined supply current is detected.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2017063527A (en) * 2015-09-24 2017-03-30 株式会社豊田自動織機 Power source system

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