JPH0654459B2 - Touch panel input device - Google Patents

Touch panel input device

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JPH0654459B2
JPH0654459B2 JP60186418A JP18641885A JPH0654459B2 JP H0654459 B2 JPH0654459 B2 JP H0654459B2 JP 60186418 A JP60186418 A JP 60186418A JP 18641885 A JP18641885 A JP 18641885A JP H0654459 B2 JPH0654459 B2 JP H0654459B2
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JP
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voltage
touch panel
input device
vcc
panel
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敏也 浜崎
常彦 石谷
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Omron Corp
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Description

【発明の詳細な説明】 (a)技術分野 この発明はCRT画面上等に設置される透明シート状の
タッチパネルスイッチを有する入力装置に関し、特にタ
ッチパネルスイッチに異常が発生したときに故障箇所を
判定できるタッチパネル入力装置に関する。
Description: (a) Technical Field The present invention relates to an input device having a transparent sheet-like touch panel switch installed on a CRT screen or the like, and in particular, can determine a failure location when an abnormality occurs in the touch panel switch. The present invention relates to a touch panel input device.

(b)発明の概要 この発明に係るタッチパネル入力装置は、導電シートに
中間タップを設けるとともに、一方の導電シートに電圧
が印加されたとき、その導電シートの両端及び中間タッ
プの電圧を測定する手段を設け、それぞれの電圧を正常
値と比較することによって、タッチパネルスイッチが正
常に動作するか否か、正常に動作しないとき故障した部
位は何処かを判定することができるようにしたものであ
る。
(b) Summary of the invention, the touch panel input device according to the present invention, a means for measuring the voltage of both ends of the conductive sheet and the intermediate tap when a voltage is applied to one conductive sheet while providing the conductive sheet with the intermediate tap. Is provided, and by comparing each voltage with a normal value, it is possible to determine whether or not the touch panel switch operates normally, and where the failed part is when it does not operate normally.

(c)従来技術とその欠点 タッチパネル入力装置に用いられるタッチパネルスイ
ッチの説明 先ず、第7図にタッチパネルスイッチの構成を示す。こ
のタッチパネルスイッチは上側パネル10と下側パネル
20とで構成されている。上側パネル10について説明
する。タッチパネル面は透明樹脂フィルム基材上に形成
されている。前記基材面の両側辺には抵抗体12a,1
2bが形成され、両抵抗体間には一定幅の導電体ストラ
イプ11(11a〜11g)が一定間隔で梯子状に渡さ
れている。本図中ではこの導電体ストライプを7本示し
ているが、ATM等のCRT画面上に設置されるものに
おいては16本〜64本形成されている。これら抵抗体
12a,12b及び導電体ストライプ11はITO(Ind
ium Tin Oxide)等を前記基材上に蒸着して形成される。
前記抵抗体12a,12bの両端にはリード線13,1
4が接続されている。このリード線13,14は電圧印
加回路(図示せず)に接続されている。
(c) Conventional Technology and Its Deficiencies Description of Touch Panel Switch Used in Touch Panel Input Device First, FIG. 7 shows the configuration of the touch panel switch. The touch panel switch is composed of an upper panel 10 and a lower panel 20. The upper panel 10 will be described. The touch panel surface is formed on a transparent resin film substrate. Resistors 12a, 1 are provided on both sides of the substrate surface.
2b is formed, and conductor stripes 11 (11a to 11g) having a constant width are provided between both resistors in a ladder shape at regular intervals. Although seven conductor stripes are shown in this figure, 16 to 64 conductor stripes are formed on a CRT screen such as an ATM. The resistors 12a and 12b and the conductor stripe 11 are made of ITO (Ind
ium Tin Oxide) or the like is vapor-deposited on the base material.
Lead wires 13, 1 are provided on both ends of the resistors 12a, 12b.
4 is connected. The lead wires 13 and 14 are connected to a voltage applying circuit (not shown).

リード線13,14を介して抵抗体12a,12bに電
圧(Vcc)が印加されると、抵抗体12a,12bには一
端から他端へ向かう電圧傾斜が形成される。この抵抗体
12a,12bに接続されている前記各導電体ストライ
プ11a〜11gには、抵抗体12a,12bのそれぞ
れの導電体ストライプの接続点の電圧と同じ大きさの電
圧が生じる。また、下側パネル20も上側パネル10と
同様に構成されている。21(21a〜21e)は導電
体ストライプ、22(22a,22b)は抵抗体、2
3,24はリード線である。
When a voltage (Vcc) is applied to the resistors 12a and 12b via the lead wires 13 and 14, a voltage gradient from one end to the other end is formed in the resistors 12a and 12b. A voltage having the same magnitude as the voltage at the connection point of the conductor stripes of the resistors 12a and 12b is generated in the conductor stripes 11a to 11g connected to the resistors 12a and 12b. The lower panel 20 is also configured similarly to the upper panel 10. 21 (21a to 21e) is a conductor stripe, 22 (22a, 22b) is a resistor, 2
Reference numerals 3 and 24 are lead wires.

これら上側パネル10,下側パネル20を前記電圧傾斜
方向が直交するように前記導電体ストライプ面を互いに
対向させて微少間隔で設置することによってタッチパネ
ルスイッチが構成される。この図においては上側パネル
10の電圧傾斜が横(X軸)方向,下側パネル20の電
圧傾斜が縦(Y軸)方向になるように設置されている。
前記電圧(Vcc)は上側パネル10,下側パネル20に交
互に印加される。
A touch panel switch is constructed by disposing the upper panel 10 and the lower panel 20 so that the conductor stripe surfaces face each other so that the voltage inclination directions are orthogonal to each other at a minute interval. In this figure, the upper panel 10 is installed so that the voltage gradient is horizontal (X axis) direction and the lower panel 20 is vertical (Y axis) direction.
The voltage (Vcc) is alternately applied to the upper panel 10 and the lower panel 20.

従来のタッチパネル入力装置の説明 第6図は上記タッチパネルスイッチを含む従来のタッチ
パネル入力装置のブロック図である。以下前記リード線
13,14,23,24をそれぞれA,B,C,Dとす
る。CPU2はバスを介してA/D変換器3,I/Oポ
ート4及びメモリ5に接続されている。A/D変換器3
にはゲート8a−緩衝増幅器7a,ゲート8b−緩衝増
幅器7b,ゲート8c−緩衝増幅器7c及びゲート8d
−緩衝増幅器7dを介してA,B,C及びDと接続され
ている。前記リード線13,14,23,24にはそれ
ぞれスイッチングトランジスタ6a,6b,6c,6d
が接続されている。これらスイッチングトランジスタ6
a,6b,6c,6dがスイッチ回路に対応する。
Description of Conventional Touch Panel Input Device FIG. 6 is a block diagram of a conventional touch panel input device including the touch panel switch. Hereinafter, the lead wires 13, 14, 23 and 24 are referred to as A, B, C and D, respectively. The CPU 2 is connected to the A / D converter 3, the I / O port 4 and the memory 5 via the bus. A / D converter 3
Includes gate 8a-buffer amplifier 7a, gate 8b-buffer amplifier 7b, gate 8c-buffer amplifier 7c and gate 8d.
-Connected to A, B, C and D via buffer amplifier 7d. The lead wires 13, 14, 23, 24 are provided with switching transistors 6a, 6b, 6c, 6d, respectively.
Are connected. These switching transistors 6
a, 6b, 6c and 6d correspond to the switch circuit.

これらのスイッチングトランジスタはCPU2−I/O
ポート4からのオン信号a,b及びc,dによって6
a,6b及び6c,6dの組み合わせで交互にオン・オ
フを繰り返す。スイッチングトランジスタ6a,6bが
オンしたときには上側パネル10に電圧(Vcc)が印加さ
れ、スイッチングトランジスタ6c,6dがオンしたと
きには下側パネル20に電圧(Vcc)が印加される。CP
U2は上側パネル10に電圧(Vcc)を印加したとき、同
時にオン信号e,f,gを出力してゲート8a,8b,
8dをオンする。ゲート8a,8bを開くことによって
上側パネル10の両端の電圧、即ち上側パネル10の抵
抗体12a,12bに実際に印加されている電圧を測定
する。また、ゲート8dを開くことによって、このタッ
チパネルスイッチ1が押下されたとき下側パネル20が
検知する前記X軸方向の接点検知電圧(Vx)をA/D変換
器3へ入力する。
These switching transistors are CPU2-I / O
6 by the ON signals a, b and c, d from the port 4
The on / off operation is repeated alternately for combinations of a, 6b and 6c, 6d. When the switching transistors 6a and 6b are turned on, the voltage (Vcc) is applied to the upper panel 10, and when the switching transistors 6c and 6d are turned on, the voltage (Vcc) is applied to the lower panel 20. CP
When the voltage (Vcc) is applied to the upper panel 10, U2 outputs the ON signals e, f, g at the same time to output the gates 8a, 8b,
Turn on 8d. By opening the gates 8a and 8b, the voltage across the upper panel 10, that is, the voltage actually applied to the resistors 12a and 12b of the upper panel 10 is measured. Further, by opening the gate 8d, the contact detection voltage (Vx) in the X-axis direction detected by the lower panel 20 when the touch panel switch 1 is pressed is input to the A / D converter 3.

下側パネルに電圧(Vcc)を印加したときも同様に、CP
U2はオン信号e,f,gを出力してゲート8b,8
c,8dをオンする。ゲート8c,8dを開くことによ
って下側パネル20の両端の電圧、即ち下側パネル20
の抵抗体22a,22bに実際に印加されている電圧を
測定する。また、ゲート8bを開くことによって、この
タッチパネルスイッチ1が押下されたとき上側パネル1
0が検知する前記Y軸方向の接点検知電圧(Vy)をA/D
変換器3へ入力する。
Similarly, when voltage (Vcc) is applied to the lower panel, CP
U2 outputs ON signals e, f, g to output gates 8b, 8
Turn on c and 8d. By opening the gates 8c and 8d, the voltage across the lower panel 20, that is, the lower panel 20.
The voltage actually applied to the resistors 22a and 22b is measured. Further, by opening the gate 8b, when the touch panel switch 1 is pressed, the upper panel 1
The contact detection voltage (Vy) in the Y-axis direction detected by 0 is A / D
Input to the converter 3.

上側パネル10に電圧(Vcc)を印加したときにタッチパ
ネルスイッチ1が押下されて上側パネル10と下側パネ
ル20とが接触した場合、上側パネル10の前記接触し
た点(接点)にある導電体ストライプ11に生じている
電圧が下側パネル20へ接点を介して印加される。緩衝
増幅器7dは非常に入力インピーダンスが高いものであ
るため、下側パネル20の膜面抵抗及び上側パネル10
から下側パネル20へ流れ混む電流は無視することが出
来る。従って、このときA/D変換器3に入力される電
圧は、上側パネル10の接点に生じている電圧(Vx)その
ものであると見做すことができる。この電圧(Vx)と前記
上側パネル10の抵抗体12a,12bに実際に印加さ
れている電圧とに基づいて接点の左右方向(X軸方向)
の位置(X座標値)を検出することができる。
When the touch panel switch 1 is pressed when the voltage (Vcc) is applied to the upper panel 10 and the upper panel 10 and the lower panel 20 are in contact with each other, the conductor stripes at the contact points (contact points) of the upper panel 10 The voltage generated at 11 is applied to the lower panel 20 via the contacts. Since the buffer amplifier 7d has an extremely high input impedance, the film surface resistance of the lower panel 20 and the upper panel 10 are reduced.
The current flowing from the lower panel 20 to the lower panel 20 can be ignored. Therefore, the voltage input to the A / D converter 3 at this time can be regarded as the voltage (Vx) itself generated at the contact point of the upper panel 10. Based on this voltage (Vx) and the voltage actually applied to the resistors 12a and 12b of the upper panel 10, the left and right directions of the contacts (X axis direction)
Position (X coordinate value) can be detected.

前記電圧(Vcc)の印加は上述したように上側パネル1
0,下側パネル20に対して交互に行われる。上側パネ
ル10へ電圧(Vcc)を印加してX座標値を検出した直後
に、下側パネル20へ電圧(Vcc)を印加するとともにゲ
ート8c,8d及びゲート8bがオンされる。下側パネ
ル20へ電圧(Vcc)が印加されたことによって下側パネ
ル20の前記接点に生じた電圧が、上側パネルへ前記接
点を介して印加される。緩衝増幅器7bは緩衝増幅器7
d同様非常に入力インピーダンスが高いものであるた
め、上側パネル10の膜面抵抗及び下側パネル20から
上側パネル10へ流れ込む電流は無視することが出来
る。従って、このときA/D変換器3に入力される電圧
は、下側パネル20の接点に生じている電圧(Vy)そのも
のであると見做すことができる。この電圧(Vy)と前記下
側パネル20の抵抗体22a,22bに実際に印加され
ている電圧とに基づいて接点の上下方向(Y軸方向)の
位置(Y座標値)を検出することができる。このように
して、X,Y座標値を求めることにより、タッチパネル
スイッチ1が押下されたときの接点(押下位置)を検出
することができる。
The voltage (Vcc) is applied to the upper panel 1 as described above.
0, alternately for the lower panel 20. Immediately after the voltage (Vcc) is applied to the upper panel 10 to detect the X coordinate value, the voltage (Vcc) is applied to the lower panel 20 and the gates 8c, 8d and the gate 8b are turned on. The voltage generated at the contact of the lower panel 20 by applying the voltage (Vcc) to the lower panel 20 is applied to the upper panel via the contact. The buffer amplifier 7b is the buffer amplifier 7
Since the input impedance is very high like d, the film surface resistance of the upper panel 10 and the current flowing from the lower panel 20 to the upper panel 10 can be ignored. Therefore, at this time, the voltage input to the A / D converter 3 can be regarded as the voltage (Vy) itself generated at the contact point of the lower panel 20. The vertical position (Y-axis direction) position (Y coordinate value) of the contact can be detected based on this voltage (Vy) and the voltage actually applied to the resistors 22a and 22b of the lower panel 20. it can. In this way, by obtaining the X and Y coordinate values, the contact point (pressed position) when the touch panel switch 1 is pressed can be detected.

なお、前記スイッチングトランジスタ6a,6b,6
c,6dのオン信号(a,b,c,d)及びゲート8
b,8dのオン信号(e,f)はCPU2で生成され、
I/Oポート4を介して供給される。
The switching transistors 6a, 6b, 6
ON signal (a, b, c, d) of c, 6d and gate 8
ON signals (e, f) of b and 8d are generated by the CPU 2,
It is supplied via the I / O port 4.

上記のようなタッチパネル入力装置は通常自動取引処理
装置等のCRT画面上に設置され、画面にキーを表示
し、そのキーの位置の押下をタッチパネル入力装置で判
定するタッチキー装置として使用される。即ち、表示さ
れたキーの画像位置に対応する座標点の押下(接触)を
検知したときそのキーの押下があったと判定して、他の
制御部に通知するものである。
The touch panel input device as described above is usually installed on a CRT screen of an automatic transaction processing device or the like, and is used as a touch key device that displays keys on the screen and determines whether the key position is pressed by the touch panel input device. That is, when the depression (contact) of the coordinate point corresponding to the image position of the displayed key is detected, it is determined that the key is depressed and the other control unit is notified.

上記従来のタッチパネル入力装置の欠点 タッチパネルスイッチ1の上下パネルには、上述のよう
に交互に電圧(Vcc)が印加される。この電圧(Vcc)によっ
てタッチパネル上には電圧傾斜が形成される。この電圧
傾斜が正常に形成されることが接触位置の検出を正確に
行うための必要条件となる。即ち、スイッチングトラン
ジスタ6a〜6dの何れかが壊れた場合、またはリード
線A,B,C,Dの何れかが断線した場合等には前記電
圧傾斜が正常に形成されず接触位置検知を正確に行うこ
とができない。
Disadvantages of the conventional touch panel input device The voltage (Vcc) is alternately applied to the upper and lower panels of the touch panel switch 1 as described above. This voltage (Vcc) forms a voltage gradient on the touch panel. The normal formation of this voltage gradient is a necessary condition for accurately detecting the contact position. That is, when any of the switching transistors 6a to 6d is broken, or when any of the lead wires A, B, C, and D is broken, the voltage gradient is not normally formed, and the contact position detection is accurately performed. I can't do it.

従来のタッチパネル入力装置においては、上記異常を検
知する機能を有していなかったため、装置自身で異常を
発見し、それに対応する等の動作をさせることが出来な
かった。このため、タッチパネルスイッチの異常の発見
に時間が掛かるうえ、異常であることが判ってもどの部
位が故障しているのかを改めて検査して発見しなければ
ならず、異常であることが判ったのち復旧までに時間が
掛かる欠点があった。
Since the conventional touch panel input device does not have a function of detecting the above abnormality, the apparatus itself cannot detect the abnormality and cannot perform an action corresponding to the abnormality. For this reason, it takes time to find an abnormality in the touch panel switch, and even if it is found to be abnormal, it is necessary to re-inspect and find out which part is defective, and it is found to be abnormal. There was a drawback that it would take time to recover later.

(d)発明の目的 この発明は上記欠点に鑑み、常にタッチパネルスイッチ
の状態をチェックし、異常を発見したときには速やかに
故障箇所を特定することの出来るタッチパネル入力装置
を提供することを目的とする。
(d) Object of the Invention In view of the above-mentioned drawbacks, an object of the present invention is to provide a touch panel input device capable of always checking the state of a touch panel switch and promptly identifying a failure location when an abnormality is found.

(e)発明の構成及び効果 この発明は、対向した2枚の導電シートのそれぞれの両
端に電極端子を設け、一方の導電シートの両端の電極端
子間に電圧を印加してその表面に電圧分布を形成する電
圧印加回路と、この電圧印加回路から前記電極端子への
電圧印加を開閉するスイッチ回路とを有するとともに、
前記2枚の導電シートが接触したとき、他方の導電シー
トが得た電圧と前記電圧分布とから接触位置を検知する
タッチパネル入力装置において、 前記2枚の導電シート上にそれぞれ中間タップを設ける
とともに、導電シートに正常に前記電圧が印加されたと
きの前記両電極端子及び中間タップに生じる電圧を記憶
する基準電圧記憶手段を設け、前記スイッチ回路が閉成
したとき前記一方の導電シートの両電極端子及び前記中
間タップの電圧を測定する端子電圧測定手段と、この端
子電圧測定手段で測定した電極端子の電圧に基づいて前
記スイッチ回路の故障の有無を判定するとともに中間タ
ップの電圧に基づいて前記電極端子の断線の有無を判定
する故障判定手段と、を有することを特徴とする。
(e) Structure and Effect of the Invention The present invention provides electrode terminals at both ends of each of two conductive sheets facing each other, and applies a voltage between the electrode terminals at both ends of one conductive sheet to distribute the voltage on the surface. And a switch circuit that opens and closes voltage application from the voltage application circuit to the electrode terminals,
In the touch panel input device that detects a contact position from the voltage obtained by the other conductive sheet and the voltage distribution when the two conductive sheets are in contact, an intermediate tap is provided on each of the two conductive sheets, Reference voltage storage means for storing the voltage generated at the both electrode terminals and the intermediate tap when the voltage is normally applied to the conductive sheet is provided, and both electrode terminals of the one conductive sheet when the switch circuit is closed. And terminal voltage measuring means for measuring the voltage of the intermediate tap, and determining the presence or absence of a failure of the switch circuit based on the voltage of the electrode terminal measured by the terminal voltage measuring means and the electrode based on the voltage of the intermediate tap. And a failure determination unit that determines whether or not the terminal is broken.

以上のように構成することによってこの発明によれば、
導電シートに電圧が印加されたとき端子電圧測定手段に
よって、両電極端子及び中間タップの電圧を測定する。
測定された電圧が全て基準電圧記憶手段の記憶内容と略
一致しているときタッチパネルスイッチが正常に動作し
ていると判定し、測定された電圧のうち何れかが前記基
準電圧記憶手段の記憶内容と不一致のときタッチパネル
スイッチは正常に動作していないと判定することができ
る。タッチパネルスイッチが正常に動作していない場
合、どの電極端子又は中間タップの電圧がどのように基
準電圧記憶手段の記憶内容からずれているかを判定する
ことによって故障箇所を判定することができる。これに
よって、タッチパネルスイッチの異常を逸早く発見する
ことができるとともに、異常が発生した場合には故障箇
所が判定されているため、修理・復旧を速やかに行うこ
とができ、顧客等利用者の不便を最小限に止めることが
できる。
According to the present invention configured as described above,
When a voltage is applied to the conductive sheet, the terminal voltage measuring means measures the voltages of both electrode terminals and the intermediate tap.
When all the measured voltages substantially match the stored contents of the reference voltage storage unit, it is determined that the touch panel switch is operating normally, and one of the measured voltages is stored in the reference voltage storage unit. When it does not match, it can be determined that the touch panel switch is not operating normally. When the touch panel switch is not operating normally, the failure location can be determined by determining which electrode terminal or intermediate tap voltage deviates from the stored content of the reference voltage storage means. This makes it possible to quickly detect an abnormality in the touch panel switch, and when an abnormality occurs, the failure location is determined, so repair / restoration can be performed promptly, and inconvenience to users such as customers. It can be kept to a minimum.

このようなタッチパネル入力装置を銀行の自動取引処理
装置等に使用すれば、異常なままで入力を受け付けて誤
ったデータを処理してしまう不都合がなくなり、取引等
に支障を来すことが無い利点が生じる。
If such a touch panel input device is used for an automatic transaction processing device of a bank, etc., there will be no inconvenience of accepting an input in an abnormal state and processing incorrect data, which will not hinder transactions. Occurs.

(f)実施例 第3図はこの発明の実施例であるタッチパネル入力装置
の回路図、第4図は上記タッチパネルに使用されるタッ
チパネルスイッチの概略図である。本実施例において第
6図及び第7図で説明した従来のタッチパネル入力装置
と構成において異なる点は、上側パネル,下側パネルの
抵抗体の中央に中間タップM,Nを設けるとともに、中
間タップMを緩衝増幅器7m,ゲート8mを介してA/
D変換器3に接続し、中間タップNを緩衝増幅器7n,
ゲート8nを介してA/D変換器3に接続した点であ
る。本図において第6図に示したブロック図と同様の部
分には同一番号を付して説明を省略する。なお、タッチ
パネルスイッチ1の上側パネル10,下側パネル20の
抵抗体はそれぞれ12,22の1本のみ形成されている
が、この抵抗体を、第7図に示したタッチパネルスイッ
チにおける抵抗体12a,12bおよび抵抗体22a,
22bのように2本ずつ形成するようにしてもよい。こ
の場合において、中間タップは2本の抵抗体のいずれに
設けてもよい。すなわち、中間タップは、抵抗体の両端
に電圧が印加されたとき、その中間の電位が検出される
位置であればどこに設けてもよく、その中間の電位を第
2図(A)の正常時のVmとして設定することにより、本
願の作用効果を奏することができる。
(f) Embodiment FIG. 3 is a circuit diagram of a touch panel input device according to an embodiment of the present invention, and FIG. 4 is a schematic diagram of a touch panel switch used in the touch panel. The present embodiment differs from the conventional touch panel input device described with reference to FIGS. 6 and 7 in that the intermediate taps M and N are provided at the centers of the resistors of the upper panel and the lower panel, and the intermediate tap M is provided. Via the buffer amplifier 7m and gate 8m to A /
The intermediate tap N is connected to the D converter 3 and the buffer tap 7n,
This is the point connected to the A / D converter 3 via the gate 8n. In this figure, the same parts as those in the block diagram shown in FIG. It should be noted that the upper panel 10 and the lower panel 20 of the touch panel switch 1 are formed with only one resistor 12, 22 respectively, but this resistor is used as the resistor 12a in the touch panel switch shown in FIG. 12b and resistor 22a,
You may make it form two pieces like 22b. In this case, the intermediate tap may be provided on either of the two resistors. That is, the intermediate tap may be provided at any position where the intermediate potential is detected when a voltage is applied to both ends of the resistor, and the intermediate potential is set at the normal time of FIG. 2 (A). By setting it as Vm, the operation and effect of the present application can be achieved.

CPU2は、電圧(Vcc)が上側パネル10に印加された
とき、即ちスイッチングトランジスタ6a,6bがオン
されたとき、上述したようにゲート8a,8bをオンに
してA点の電圧Va,B点の電圧Vbを測定するとともに、
このとき同時にゲート8mをオンして上側パネル10の
中間タップMの電圧Vmも測定する。下側パネル20に電
圧(Vcc)が印加されたときも同様に、ゲート8c,8d
をオンしてC点の電圧Vc,D点の電圧Vdを測定するとと
もに、ゲート8nをオンして下側パネル20の中間タッ
プNの電圧Vnも測定する。
When the voltage (Vcc) is applied to the upper panel 10, that is, when the switching transistors 6a and 6b are turned on, the CPU 2 turns on the gates 8a and 8b as described above to turn on the voltage Va at the point A and the voltage at the point B. While measuring the voltage Vb,
At this time, the gate 8m is turned on at the same time and the voltage Vm of the intermediate tap M of the upper panel 10 is also measured. Similarly, when a voltage (Vcc) is applied to the lower panel 20, the gates 8c and 8d
Is turned on to measure the voltage Vc at the point C and the voltage Vd at the point D, and the gate 8n is turned on to measure the voltage Vn at the intermediate tap N of the lower panel 20.

ここで、スイッチングトランジスタ6a,6bをオンす
るためのオン信号a,bを出力するとともに、ゲート8
a,8b,8mをオンするためにオン信号g,f,iを
出力してVa,Vb,Vmを測定した時のタッチパネルスイッ
チの状態判定表を第2図(A)に示す。正常に電圧Vccが印
加されているときは、Aの電圧VaはVccであり、Bの電
圧Vbは0であり、MはA,Bの中点であるため電圧Vmは
Vcc/2である。即ち、上側パネル10にはVcc〜0Vの電
圧傾斜が正常に形成されている。スイッチングトランジ
スタ6aが故障してオンしなくなると、上側パネル10
はスイッチングトランジスタ6bのオンによって接地さ
れた状態になるため、Va,Vb,Vmの電圧は全て0にな
る。スイッチングトランジスタ6bが故障してオンしな
くなると、上側パネル10はスイッチングトランジスタ
6aのオンによってVcc側に浮いた状態になるため、V
a,Vb,Vmの電圧は全てVccになる。また、リード線Aが
断線すると、スイッチングトランジスタ6aのオンによ
ってVaはVccになるが、その電圧が上側パネル10まで
印加されないため、Vm,Vbは0のままである。リード線
Bが断線すると、上側パネル10はVcc側に浮いた状態
になるためVa,VmはVccであり、スイッチングトランジ
スタ6bによって接地されているVbは0になっている。
Here, the ON signals a and b for turning on the switching transistors 6a and 6b are output, and the gate 8
FIG. 2 (A) shows a state judgment table of the touch panel switch when ON signals g, f, i are output to turn on a, 8b, 8m and Va, Vb, Vm are measured. When the voltage Vcc is normally applied, the voltage Va of A is Vcc, the voltage Vb of B is 0, and M is the midpoint between A and B, so the voltage Vm is
It is Vcc / 2. That is, the upper panel 10 has a normal voltage gradient of Vcc to 0V. When the switching transistor 6a fails and does not turn on, the upper panel 10
Becomes a grounded state when the switching transistor 6b is turned on, so that the voltages of Va, Vb and Vm are all zero. When the switching transistor 6b fails and does not turn on, the upper panel 10 is floated to the Vcc side due to the switching transistor 6a turning on.
The voltages of a, Vb and Vm are all Vcc. Further, when the lead wire A is disconnected, Va becomes Vcc due to the switching transistor 6a being turned on, but since the voltage is not applied to the upper panel 10, Vm and Vb remain 0. When the lead wire B is broken, the upper panel 10 floats on the Vcc side, so Va and Vm are Vcc, and Vb grounded by the switching transistor 6b is 0.

第5図は上記メモリ5の部分構成図である。メモリのう
ちRAMには3個のフラグFA,FB,FM(M1,M
2,M3)が設定され、ROMには、Val,Vbh,Vmh,V
mlが記憶されるとともに(M4,M5,M6,M7)、
テーブルM8が設定されている。前記フラグFA,F
B,FMはそれぞれVa,Vb,Vmが異常であるとき1又は
2が設定されるフラグであり、タッチパネルスイッチが
正常に動作しているときは全て0にセットされている。
前記ValはVaの許容下限電圧(Vcc−△V,△V:許容偏
差、以下同じ)、VbhはVbの許容上限電圧(△V)、Vmh
はVmの許容上限電圧(Vcc/2+△V)、VmlはVmの許容下
限電圧(Vcc/2−△V)である。これら許容電圧は装置
の調整時に設定されROMに記憶されるものである。そ
れぞれの電圧がこれらの許容範囲内にないとき上記対応
するフラグが1又は2にセットされる。即ち、VmがVmh
を上回ったときFM(M3)が2にセットされ、その他
の電圧異常のときは、その電圧に対応るすフラグが1に
セットされる。
FIG. 5 is a partial configuration diagram of the memory 5. The RAM of the memory has three flags FA, FB, FM (M1, M
2, M3) is set, and ROM stores Val, Vbh, Vmh, V
ml is memorized (M4, M5, M6, M7),
The table M8 is set. The flags FA, F
B and FM are flags that are set to 1 or 2 when Va, Vb, and Vm are abnormal, and are all set to 0 when the touch panel switch is operating normally.
Val is an allowable lower limit voltage of Va (Vcc-ΔV, ΔV: allowable deviation, the same applies hereinafter), Vbh is an allowable upper limit voltage of Vb (ΔV), Vmh
Is an allowable upper limit voltage of Vm (Vcc / 2 + ΔV), and Vml is an allowable lower limit voltage of Vm (Vcc / 2−ΔV). These allowable voltages are set when the device is adjusted and stored in the ROM. The corresponding flag is set to 1 or 2 when the respective voltage is not within these tolerances. That is, Vm is Vmh
FM (M3) is set to 2 when the voltage exceeds the threshold, and the flag corresponding to the voltage is set to 1 when the other voltage is abnormal.

第2図(A)に示すタッチパネルスイッチの状態を上記フ
ラグFA,FB,FMの内容で表現すれば、同図(B)に
示すテーブルのようになる。このテーブルがエリアM8
に記憶されている。
If the state of the touch panel switch shown in FIG. 2 (A) is expressed by the contents of the above-mentioned flags FA, FB, and FM, it becomes a table shown in FIG. 2 (B). This table is area M8
Remembered in.

これらのフラグ,許容電圧及びテーブルは上側パネル1
0を判定する場合について設定されているが、下側パネ
ル20も上側パネル10と同様の構成であるため、その
電圧を判定する時にも併用される。その場合、VaはVc
に、VbはVdに、VmはVnに相当する。
These flags, allowable voltages and tables are on the upper panel 1.
Although the case of determining 0 is set, the lower panel 20 also has the same configuration as the upper panel 10, and therefore is also used when determining the voltage. In that case, Va is Vc
In addition, Vb corresponds to Vd and Vm corresponds to Vn.

第1図は前記CPU2の動作を示すフローチャートであ
る。以下、上側パネル10に電圧Vccを印加するため、
スイッチングトランジスタ6a,6bオン信号a,bを
出力した直後の動作を説明する。
FIG. 1 is a flow chart showing the operation of the CPU 2. Hereinafter, in order to apply the voltage Vcc to the upper panel 10,
The operation immediately after outputting the ON signals a and b of the switching transistors 6a and 6b will be described.

スイッチングトランジスタ6a,6bオン信号a,bを
出力するとまず、ステップn1(以下、ステップniを
単にniと言う。)で前記フラグFA,FB,FMを0
に設定し、n2でVa,Vb,Vmを読み取る。n3ではVaと
Valとを比較し、VaがVal以下であればフラグFAに1を
設定する(n30)。n4ではVbとVbhとを比較し、Vb
がVbh以上であればフラグFBに1を設定する(n4
0)。n5,n6ではVmとVmh,Vmlとを比較し、VmがVm
l以下であればフラグFMに1を設定し(n50)、Vm
がVmh以上であればフラグFMに2を設定する(n6
0)。n7では各フラグのフラグの設定状態を判断し、
全てのフラグが0であればn8の正常時処理を行う。何
れかのフラグが0でなければフラグの設定内容に基づい
て前記テーブル(M8)を検索し、故障箇所を判定する
(n9)。
When the ON signals a and b of the switching transistors 6a and 6b are output, first, the flags FA, FB and FM are set to 0 in step n1 (hereinafter, step ni is simply referred to as ni).
, And read Va, Vb, and Vm with n2. Va at n3
If Val is equal to or lower than Val, 1 is set to the flag FA (n30). In n4, Vb and Vbh are compared, and Vb
Is greater than or equal to Vbh, the flag FB is set to 1 (n4
0). At n5 and n6, Vm is compared with Vmh and Vml, and Vm is Vm
If l or less, set flag FM to 1 (n50), Vm
Is Vmh or more, 2 is set to the flag FM (n6
0). At n7, the setting state of each flag is judged,
If all the flags are 0, the normal processing of n8 is performed. If any of the flags is not 0, the table (M8) is searched based on the setting contents of the flags to determine the failure point (n9).

その故障がリード線の断線によるものであれば、断線エ
ラー処理動作(n11)に進み、そうでなければスイッ
チングトランジスタ異常エラー処理動作へ進む(n1
2)。
If the failure is due to disconnection of the lead wire, the process proceeds to a disconnection error processing operation (n11), and if not, to the switching transistor abnormality error processing operation (n1).
2).

以上の動作説明は上側パネルに電圧が印加されたときの
動作について説明したが、下側パネルに電圧が印加され
たときについてはVa,Vb,Vmに代えてそれぞれVc,Vd,
Vnが設定され、他の動作は同様である。
The above description of the operation has explained the operation when a voltage is applied to the upper panel, but when a voltage is applied to the lower panel, instead of Va, Vb, Vm, Vc, Vd,
Vn is set, and other operations are the same.

なお、上記メモリ5のエリアM4〜M7がこの発明の基
準電圧記憶手段に対応し、ゲート7a,7b,7c,7
d,7m,7n、緩衝増幅器8a,8b,8c,8d,
8m,8n及び上記動作のn2がこの発明の端子電圧測
定手段に対応し、上記動作のn3以下がこの発明の故障
箇所判定手段に対応する。
The areas M4 to M7 of the memory 5 correspond to the reference voltage storage means of the present invention, and the gates 7a, 7b, 7c, 7 are provided.
d, 7m, 7n, buffer amplifiers 8a, 8b, 8c, 8d,
8m, 8n and n2 of the above operation correspond to the terminal voltage measuring means of the present invention, and n3 and below of the above operation correspond to the failure point determining means of the present invention.

【図面の簡単な説明】[Brief description of drawings]

第1図はこの発明の実施例であるタッチパネル入力装置
の制御部の動作を示すフローチャート、第2図(A)は電
圧印加信号が出力されたときの両電極端子及び中間タッ
プの電圧と故障箇所との関係を表す表を示す図、同図
(B)は同図(A)の状態をフラグFA,FB,FMで表した
表を示す図であり、上記タッチパネル入力装置のメモリ
に設定されるテーブルの内容を示す。第3図は上記タッ
チパネル入力装置の回路図、第4図は上記タッチパネル
スイッチの概略図、第5図は上記タッチパネル入力装置
のメモリの部分構成図、第6図は従来のタッチパネル入
力装置の回路図、第7図は従来のタッチパネルスイッチ
の構成を示す図である。 M,N……中間タップ、7m,7n……ゲート、8m,
8n……緩衝増幅器。
FIG. 1 is a flow chart showing the operation of the control unit of the touch panel input device according to the embodiment of the present invention, and FIG. 2 (A) is the voltage of both electrode terminals and the intermediate tap when the voltage application signal is output and the failure point. Figure showing the table showing the relationship with
(B) is a diagram showing a table in which the state of (A) is represented by flags FA, FB, FM, and shows the contents of the table set in the memory of the touch panel input device. FIG. 3 is a circuit diagram of the touch panel input device, FIG. 4 is a schematic diagram of the touch panel switch, FIG. 5 is a partial configuration diagram of a memory of the touch panel input device, and FIG. 6 is a circuit diagram of a conventional touch panel input device. , FIG. 7 is a diagram showing a configuration of a conventional touch panel switch. M, N ... Middle tap, 7m, 7n ... Gate, 8m,
8n ... Buffer amplifier.

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】対向した2枚の導電シートのそれぞれの両
端に電極端子を設け、一方の導電シートの両端の電極端
子間に電圧を印加してその表面に電圧分布を形成する電
圧印加回路と、この電圧印加回路から前記電極端子への
電圧印加を開閉するスイッチ回路とを有するとともに、
前記2枚の導電シートが接触したとき、他方の導電シー
トが得た電圧と前記電圧分布とから接触位置を検知する
タッチパネル入力装置において、 前記2枚の導電シート上にそれぞれ中間タップを設ける
とともに、導電シートに正常に前記電圧が印加されたと
きの前記両電極端子及び中間タップに生じる電圧を記憶
する基準電圧記憶手段を設け、前記スイッチ回路が閉成
したとき前記一方の導電シートの両電極端子及び前記中
間タップの電圧を測定する端子電圧測定手段と、この端
子電圧測定手段で測定した電極端子の電圧に基づいて前
記スイッチ回路の故障の有無を判定するとともに中間タ
ップの電圧に基づいて前記電極端子の断線の有無を判定
する故障判定手段と、を有してなるタッチパネル入力装
置。
1. A voltage application circuit for providing electrode terminals on both ends of each of two facing conductive sheets and applying a voltage between the electrode terminals on both ends of one conductive sheet to form a voltage distribution on the surface. A switch circuit for opening and closing voltage application from the voltage application circuit to the electrode terminals,
In the touch panel input device that detects a contact position from the voltage obtained by the other conductive sheet and the voltage distribution when the two conductive sheets are in contact, an intermediate tap is provided on each of the two conductive sheets, Reference voltage storage means for storing the voltage generated at the both electrode terminals and the intermediate tap when the voltage is normally applied to the conductive sheet is provided, and both electrode terminals of the one conductive sheet when the switch circuit is closed. And terminal voltage measuring means for measuring the voltage of the intermediate tap, and determining the presence or absence of a failure of the switch circuit based on the voltage of the electrode terminal measured by the terminal voltage measuring means and the electrode based on the voltage of the intermediate tap. A touch panel input device comprising: failure determination means for determining whether or not a terminal is broken.
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