JPH0592819U - DC stabilization circuit - Google Patents

DC stabilization circuit

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JPH0592819U
JPH0592819U JP2837992U JP2837992U JPH0592819U JP H0592819 U JPH0592819 U JP H0592819U JP 2837992 U JP2837992 U JP 2837992U JP 2837992 U JP2837992 U JP 2837992U JP H0592819 U JPH0592819 U JP H0592819U
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友広 鈴木
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Abstract

(57)【要約】 【目的】 異常検知回路を備えた直流安定化回路において、瞬時的な異常に対しては応答しない安定した出力電圧の直流安定化回路を実現する。 (57) Abstract: In DC stabilization circuit having a Objective abnormality detection circuit, to achieve a stabilized direct-current circuit of the stabilized output voltage that does not respond to instantaneous abnormalities. 【構成】 異常発生時に出力トランジスタ13を遮断する異常検知回路40は、異常検出部14と、その後段に接続される、異常状態の継続時間を検出する時間検出用カウンタ16と異常状態及び正常状態間の変動回数を検出する変動検出用カウンタ17と、両カウンタ16,1 [Configuration] abnormality detection circuit to shut off the output transistor 13 to the abnormality occurrence 40 is abnormal detection unit 14 is connected to a subsequent stage, the time detection counter 16 for detecting the duration of the abnormal state an abnormal state and a normal state a fluctuation detection counter 17 for detecting the variation time count between, both counters 16,1
7の検出状態に応じて出力トランジスタ13を制御する出力トランジスタ制御部41とを有してなることを特徴とする。 Characterized by comprising an output transistor control unit 41 that controls the output transistor 13 in accordance with the 7 detection state.

Description

【考案の詳細な説明】 Description of the invention]

【0001】 [0001]

【産業上の利用分野】 BACKGROUND OF THE INVENTION

本考案は、過電流破壊から保護する過電流検出回路等の異常検知回路を備えた 直流安定化回路に関する。 This invention relates to a direct-current stabilization circuit having an anomaly detection circuit of such an overcurrent detection circuit for protecting from overcurrent breakdown.

【0002】 [0002]

【従来の技術】 BACKGROUND OF THE INVENTION

従来の技術について図4及び図5を参照して説明する。 It will be described with reference to FIGS. 4 and 5 for the prior art. 図4は従来例による直 流安定化回路の回路図、図5は図4の回路図の各部の信号波形図である。 Figure 4 is a circuit diagram of the dc stabilizing circuit according to the conventional example, FIG. 5 is a signal waveform diagram of each part of the circuit diagram of FIG.

【0003】 図4中、1は直流安定化素子であるチョッパ型直流安定化素子であり、コイル 2、抵抗3,4、ダイオード5、コンデンサ6により降圧型の回路構成となって いる。 [0003] In FIG. 4, 1 is a chopper type DC stabilized device is a direct current stabilizing element, a coil 2, a resistor 3, 4, the diode 5 has a circuit configuration of the step-down by the capacitor 6. 7は負荷である。 7 is a load.

【0004】 以上の構成において、出力電圧V 0を抵抗3,4により分圧した電圧と基準電 圧8とを誤差増幅器9により誤差増幅し、そして三角波発信器10とコンパレー タ11によりパルス幅変調し、その変調された信号により論理素子12を介して 出力トランジスタ13を制御する。 [0004] In the above configuration, the error amplifier the voltage divided by the resistors 3 and 4 the output voltage V 0 and the reference voltage 8 by the error amplifier 9, and a pulse width modulation by a triangular wave oscillator 10 and the comparator 11 and controls the output transistor 13 through the logic element 12 by the modulated signal. 出力トランジスタ13がONの時はV INから 出力トランジスタ13コイル2へと電流が流れ、コイル2にエネルギーを蓄える と共に負荷7に電流を供給する。 Output transistor 13 current flows when the ON from V IN to the output transistor 13 coils 2 to supply current to the load 7 with storing energy in the coil 2. 一方、出力トランジスタ13がOFFの時は、 コイル2に蓄えてあったエネルギーをダイオード5を介して放出し出力電圧V 0を一定に保つ。 On the other hand, the output transistor 13 when the OFF emits energy had been accumulated in the coil 2 via the diode 5 keeps the output voltage V 0 constant.

【0005】 そして、過電流を検出していない場合、過電流検出回路14はLOW(以下、 単に“L”と記す)出力となっているが、過電流は検出するとHIGH(以下、 単に“H”と記す)出力となり出力トランジスタ13をOFF状態に保ち出力電 圧V 0を遮断し保護する。 [0005] When not detecting the overcurrent, the overcurrent detection circuit 14 is LOW (hereinafter, simply "L" hereinafter) has as an output, the overcurrent is detected HIGH (hereinafter, simply "H "and denoted) to shut off the output voltage V 0 keep the output transistor 13 becomes the output to the OFF state to protect. そして、リセット端子15よりリセット入力すると電 流検出回路14出力が再び“L”となり出力トランジスタ13をパルス幅変調に より制御して出力電圧V 0を発生する。 Then, generates an output voltage V 0 more control to the pulse width modulating the reset input to the current detection circuit 14 outputs again to "L" output transistor 13 from the reset terminal 15.

【0006】 図5(a)乃至(e)は上記回路の各部波形図であり、(a)は誤差増幅器9 及び三角波発振器10の出力信号を、また(b)乃至(e)はそれぞれ、コンパ レータ11の出力信号、過電流検出回路14の出力信号、リセット端子15に入 力されるリセット信号、出力トランジスタ13の出力信号を示している。 [0006] FIGS. 5 (a) to (e) are each part waveform diagram of the circuit, (a) shows the output signal of the error amplifier 9 and the triangular wave oscillator 10, also (b) to (e), respectively, comparator the output signal of the regulator 11, the output signal of the overcurrent detection circuit 14, a reset signal is input to the reset terminal 15 shows an output signal of the output transistor 13.

【0007】 ここでは、過電流検出回路14による過電流検出時の出力トランジスタ13の 遮断及びリセット信号の入力による出力トランジスタ13の復帰状態を示してい る。 [0007] Here, that indicates the return state of the output transistor 13 by the input of the blocking and the reset signal of the output transistor 13 of the overcurrent detection by the overcurrent detection circuit 14.

【0008】 [0008]

【考案が解決しようとする課題】 [Challenges devised to be Solved]

ところが、前記の従来技術の回路では過電流を検出すると直ちに出力トランジ スタ13をOFF状態にし保護する為、例えば負荷7の起動時等に瞬時的に流れ る過電流を検出した場合でも、出力トランジスタ13を遮断してしまう場合があ り、出力電圧V 0が安定的に出力されないという問題点があった。 However, the for the prior art circuit for protecting the output immediately transistors 13 detects an overcurrent in the OFF state, for example, even when the detected instantaneous flows Ru overcurrent, such as during start-up of the load 7, the output transistor If thus blocked 13 there is, the output voltage V 0 is a problem that not outputted stably.

【0009】 そこで本考案の目的は、異常検知回路を備えた直流安定化回路において、瞬時 的な異常、例えば負荷起動時の瞬時的な過電流等は検出せず出力電圧の安定した 直流安定化回路を実現することにある。 [0009] Accordingly, an object of the present invention, the abnormality in the DC stabilization circuit having a sensing circuit, instantaneous abnormalities, for example load start instantaneous overcurrent or the like during the stable DC output voltage regulation without detecting It is to realize a circuit.

【0010】 [0010]

【課題を解決するための手段】 In order to solve the problems]

前記目的を達成するために本考案は、入出力間に接続された出力トランジスタ と、異常状態を検知して前記出力トランジスタを遮断する異常検知回路とを備え てなる直流安定化回路において、前記異常検知回路は、異常検出部と、該異常検 出部の後段に接続され、異常状態の継続時間を検出する時間検出用カウンタと異 常状態及び正常状態間の変動回数を検出する変動検出用カウンタと、前記両カウ ンタの検出状態に応じて前記出力トランジスタを制御する出力トランジスタ制御 部と、を有してなることを特徴とする。 The present invention in order to achieve the above object, an output transistor connected between the input and the output, the DC stabilizing circuit comprising a fault detection circuit for cutting off the output transistor to detect an abnormal condition, the abnormality sensing circuit, an abnormality detection unit, said heterologous connected downstream of the normal detection unit, and time counter for detecting for detecting the duration of the abnormal state abnormal state and fluctuation detection counter for detecting the number of times of the change in the inter-normal state When, characterized by comprising a, an output transistor control unit which controls the output transistor in accordance with the detection state of both counters.

【0011】 [0011]

【作用】 [Action]

本考案による直流安定化回路は、前述のように異常検出部の後段に接続され、 異常状態の継続時間を検出する時間検出用カウンタを有し、異常状態の継続時間 が一定時間以下の時はその異常状態をノイズとしているので、例えば負荷の起動 時等に瞬時的に流れる過電流に対しても出力トランジスタが遮断されるというこ とは無く、安定した出力電圧が得られる。 DC stabilization circuit according to the present invention is connected to the subsequent stage of the abnormality detecting portion, as described above, it has a time counter for detecting for detecting the duration of the abnormal state, when the duration of the abnormal state is less than a predetermined time since the the abnormal state and noise, for example, rather than a call that also the output transistor is shut off from the instantaneously flowing overcurrent in the load when starting such a stable output voltage can be obtained.

【0012】 また、異常検出部の後段には、前記時間検出用カウンタの他に異常状態及び正 常状態間の変動回数を検出する変動検出用カウンタを設けており、ノイズとして みなされる瞬時的な異常状態でもある回数以上発生した場合には異常ありとして 出力トランジスタを遮断する。 Further, in the subsequent stage of the abnormality detecting unit, and provided with a counter for detecting variation detecting variations frequencies among other in an abnormal state and normal state of the time counter for detecting, for instantaneous that is regarded as noise in the event of more than the number of times it is also the abnormal condition to cut off the output transistor as a malfunction occurs.

【0013】 従って、出力電圧が安定しており、且つ異常状態発生時には確実に出力トラン ジスタを遮断できる高信頼性の直流安定化回路を実現できる。 [0013] Thus, the output and voltage is stabilized, and at the time of abnormal state occurs can be realized a DC stabilization circuit of high reliability can be reliably cut off the output transistor.

【0014】 [0014]

【実施例】 【Example】

本考案の一実施例について図1及び図2を参照して説明する。 An embodiment of the present invention will be described with reference to FIGS. 図1は本実施例 による直流安定化回路の回路図、図2は図1の回路図の各部の信号波形図である 。 Figure 1 is a circuit diagram of the DC stabilizing circuit according to the present embodiment, FIG. 2 is a signal waveform diagram of each part of the circuit diagram of FIG.

【0015】 ここでは、図4及び図5に示す従来例と異なる点についてのみ説明する。 [0015] Here, a description will be given only conventional example differs shown in FIGS. なお 、従来例と同一機能部分には同一記号を付している。 Incidentally, in the conventional example and the same functional portions are denoted by the same symbols.

【0016】 本実施例による直流安定化回路は、図1に示すように異常検知回路40と出力 トランジスタ制御部41とを有している。 The DC stabilization circuit according to the present embodiment includes a the abnormality detection circuit 40, as shown in FIG. 1 and an output transistor control unit 41. この異常検知回路40において、過電 流検出回路14の後段に時間検出用カウンタ16及び変動検出用カウンタ17を 設けている。 In the abnormality detection circuit 40 is provided with a time counter 16 for detecting and variation detecting counter 17 downstream of the overcurrent detection circuit 14.

【0017】 ここで、時間検出用カウンタ16は、発信器10の周期をカウントの単位とし て、過電流状態がどれくらいの間継続しているかを検出するものであり、変動検 出用カウンタ17は、正常な状態から過電流状態へ変わった回数及び過電流状態 から正常な状態へ戻った回数の総数をカウントし、変動状態がどれくらいの頻度 で発生しているかを検出するものである。 [0017] Here, the time detection counter 16, the period of the oscillator 10 as a counting unit, which detects whether the overcurrent state continues for much, counter 17 output variation biopsy , in which a count of the total number of times that has returned to a normal state from the count and the overcurrent state has changed from the normal state to the overcurrent state, detects whether variation state is occurring how often.

【0018】 両カウンタはいずれも過電流検出回路14の出力が“H”の時(過電流検出時 )にカウント動作を行ない、また、予めそれぞれのカウント数が設定されており カウント数に達すると“H”出力を出すものである。 [0018] performs a counting operation (overcurrent detection) when any two counter output of the overcurrent detection circuit 14 is "H", also when the pre respective number of count reaches the number of counts is set "H" is intended to produce the output.

【0019】 そして、上記両カウンタの出力は出力トランジスタ制御回路41の論理素子( OR素子)18を介して論理素子12へ入力されている。 [0019] Then, the output of both counters are input to the logic element 12 via the logic element (OR element) 18 of the output transistor control circuit 41.

【0020】 以上の様な構成において、過電流検出回路14が過電流を検出していない場合 は“L”出力を出すため、時間検出用カウンタ16及び変動検出力カウンタ17 はカウント動作を行なわず両カウンタの出力は“L”であり、論理素子18の出 力も“L”である。 [0020] In the above-described configuration, since the overcurrent detection circuit 14 issues a case "L" output not detecting an overcurrent, the time detection counter 16 and variation detecting force counter 17 does not perform a counting operation the output of the counters is at "L", the output of the logic element 18 is also "L". 従って、論理素子12への入力は反転されて“H”となり、 出力トランジスタ13は通常動作を行なう。 Therefore, the input to the logic element 12 is inverted to "H", the output transistor 13 performs a normal operation.

【0021】 また、過電流検出回路14が過電流を検出した場合、その過電流状態が非常に 短い時は、時間検出用カウンタ16のカウント数が設定値に満たないため時間検 出用カウンタ16は“H”出力を出さない。 Further, if the overcurrent detection circuit 14 detects an overcurrent, then the overcurrent condition is very short, for counter detect time for counting the number of times detection counter 16 does not reach the set value 16 It should not be allowed out of the "H" output. つまり、ノイズとして除去されトラ ンジスタ13は通常動作を続ける。 That is, the tiger is removed as noise Njisuta 13 continues normal operation.

【0022】 もし過電流状態が時間検出用カウンタ16の設定カウント数を超える時間継続 した場合には、異常を検知したとして時間検出用カウンタ16は“H”出力を出 し、トランジスタ13は遮断される。 [0022] If when the overcurrent state continues more time than the setting count number of times the counter 16 for detecting the time detection counter 16 as the abnormality was detected is out of the "H" output, transistor 13 is cut off that.

【0023】 ところで、ノイズとして除去される程度の短時間の過電流状態でも、繰り返し 発生すると回路に影響を及ぼす恐れがある。 By the way, even in a short time over-current condition of the extent to be removed as noise, which may affect the circuit repeatedly generates. これに対し本実施例は、変動検出用 カウンタ17によって繰り返し発生の回数がカウントされているので、設定値を 超えた時に異常が生じたとして変動検出用カウンタ17は“H”出力を出し、ト ランジスタ13が遮断される。 This embodiment with respect, since the number of recurring is counted by the fluctuation detection counter 17, the variation detection counter 17 as an abnormality has occurred when exceeding the set value is "H" issues an output, bets transistor 13 is cut off.

【0024】 以上のように本実施例によれば、例えば負荷の起動時等に瞬時的に流れる過電 流に対しては出力トランジスタの遮断動作の生じない安定した直流安定化回路を 実現できる。 According to the present embodiment as described above, for example with respect to the load momentarily flowing overcurrent, such as during start-up of can realize a stable DC stabilization circuit causing no blocking operation of the output transistor. しかも、ある時間以上継続したり、繰り返し発生する過電流状態に 対しては確実に出力トランジスタが遮断され高信頼性が得られる。 Moreover, or continuously over a certain time, reliably output transistor is cut off high reliability is obtained for the over-current condition that repeatedly occur.

【0025】 図2(a)乃至(g)は、図1の回路図の各部信号波形を示す図である。 [0025] FIGS. 2 (a) to (g) are diagrams showing signal waveforms in the circuit diagram of FIG. 図2 (a)は誤差増幅器9の出力信号及び三角波発信器10の出力信号を示す図であ る。 2 (a) is Ru FIG der showing an output signal of the output signal and the triangular wave oscillator 10 of the error amplifier 9. 図2(b)乃至(g)はそれぞれ、コンパレータ11の出力信号、過電流検 出回路14の出力信号、時間検出用カウンタ16の出力信号、変動検出用カウン タ17の出力信号、リセット入力端子15への入力信号、出力トランジスタ13 の出力信号である。 Figure 2 (b) to (g), respectively, the output signal of the comparator 11, the output signal of the overcurrent detection circuit 14, the output signal of the time counter 16 for detecting the output signal of the variation detection counter 17, a reset input terminal the input signal to 15, which is the output signal of the output transistor 13.

【0026】 この場合は、過電流検出回路14が一定時間以上過電流状態を検知したのを時 間検出用カウンタ16で検出し、出力トランジスタ13をオフする状態を示して いる。 [0026] In this case shows a state in which overcurrent detection circuit 14 detects a time between detection counter 16 from the detected overcurrent state more than a certain time, turns off the output transistor 13.

【0027】 また、その後リセット入力端子15へのリセット信号入力によって、過電流検 出回路14、時間検出用カウンタ16がオフし、出力トランジスタ13が復帰す る状態が示されている。 Further, by the subsequent reset signal input to the reset input terminal 15, the overcurrent detection circuit 14, a time counter 16 for detecting off, the output transistor 13 is shown the state you reversion.

【0028】 図3は本考案の他の実施例を示す回路図であり、ドロッパ型直流安定化回路の 例である。 [0028] FIG. 3 is a circuit diagram showing another embodiment of the present invention, an example of a dropper type direct current stabilization circuit.

【0029】 なお、図1に示す実施例と同一機能部分には同一記号を付している。 It should be noted, are denoted by the same symbols in the Examples and like functional elements shown in FIG. 本実施例 は図3に示すように、異常検知回路40′及び出力トランジスタ制御回路41′ を有している。 This embodiment, as shown in FIG. 3, has an abnormality detection circuit 40 'and the output transistor control circuit 41'. この回路において、出力電圧V 0を抵抗30,31に分圧しその 電圧と基準電圧32とを誤差増幅器33により誤差増幅し、その電圧に応じた電 流をトランジスタ34に供給し出力用トランジスタ13のベース電流を引き込む ものである。 In this circuit, the error amplifier by the output voltage V 0 of dividing resistors 30 and 31 binary error amplifier 33 and its voltage with a reference voltage 32, the output transistor 13 supplies a current corresponding to the voltage to the transistor 34 it is intended to draw the base current. 通常、過電流検出していない場合は、過電流検出回路14の出力は “L”であり時間検出用カウンタ16、変動検出用カウンタ17の出力も“L” でありNORゲート35の出力が“H”となりトランジスタ36をオン状態にし ている。 Usually, if not over-current detection, the output of the overcurrent detection circuit 14 is "L" and time counter 16 for detecting the output of and the NOR gate 35 is also output "L" of the variation detection counter 17 is " the H ", transistor 36 is in the oN state.

【0030】 また、過電流検出回路14が過電流状態を検知し、且つ、図1の実施例の場合 と同様時間検出用カウンタ16である一定の時間以上あるいは変動検出用カウン タ17である回数以上の過電流状態−正常状態の繰り返しを検知した場合には、 NORゲート35の出力が“L”となりトランジスタ36がオフ、出力トランジ スタ13がオフとなる。 Further, the number of times the overcurrent detection circuit 14 detects the overcurrent state, and a case similar to the time counter 16 for detecting counter 17 for a predetermined time or longer or fluctuation detecting an embodiment of FIG. 1 or overcurrent state - when detecting a repetition of the normal state, the output becomes "L" transistor 36 of NOR gate 35 is turned off, the output transistors 13 is turned off.

【0031】 このように本実施例においても、図1の実施例と同様の効果が得られる。 [0031] Also in this embodiment Thus, the same effect as the embodiment of FIG. 1 can be obtained.

【0032】 なお、図1及び図3の実施例では、回路の異常状態を検出する回路として過電 流検出回路を有する直流安定化回路をとり挙げたが、過電流検出回路の代わりに 異常を検知する回路として例えば過熱検出回路を有するものに対しても本案は適 用できる。 [0032] In the embodiment of FIGS. 1 and 3, it has been given taking the DC stabilization circuit having overcurrent detecting circuit as a circuit for detecting an abnormal state of the circuit, the abnormality instead of the overcurrent detection circuit merits even for those having, for example, the overheat detecting circuit as a circuit for detecting may apply.

【0033】 [0033]

【考案の効果】 Effects of the invention]

以上説明したように本考案によれば、過電流等の異常を検知する回路を備えた 直流安定化回路において、例えば負荷の起動時の瞬時的な過電流等に対しては出 力トランジスタの遮断動作が生じず安定した出力電圧が得られ、且つある時間以 上継続したり繰り返し発生する過電流に対しては確実に出力トランジスタが遮断 され高信頼性の直流安定化回路を実現できる。 According to the present invention as described above, in the DC stabilization circuit having a circuit for detecting an abnormality such as overcurrent, for example, blocking of the output transistor against instantaneous over-current of the load at startup operation is obtained a stable output voltage does not occur, can be realized a DC stabilizing circuit reliably output transistor is cut off high reliability against overcurrent in generated repeatedly or duration on than and.

【図面の簡単な説明】 BRIEF DESCRIPTION OF THE DRAWINGS

【図1】本考案の一実施例による直流安定化回路の回路図である。 1 is a circuit diagram of a DC stabilizing circuit according to an embodiment of the present invention.

【図2】(a)乃至(g)は図1の回路の各部信号波形図である。 2 (a) to (g) is a signal waveforms diagram of the circuit of Figure 1.

【図3】本考案の他の実施例による直流安定化回路の回路図である。 3 is a circuit diagram of a DC stabilization circuit according to another embodiment of the present invention.

【図4】従来例による直流安定化回路の回路図である。 4 is a circuit diagram of a DC stabilization circuit according to a conventional example.

【図5】(a)乃至(e)は図4の回路の各部信号波形図である。 5 (a) to (e) is a signal waveforms diagram of the circuit of Figure 4.

Claims (1)

    【実用新案登録請求の範囲】 [Range of utility model registration request]
  1. 【請求項1】 入出力間に接続された出力トランジスタと、異常状態を検知して前記出力トランジスタを遮断する異常検知回路とを備えてなる直流安定化回路において、 前記異常検知回路は、異常検出部と、 該異常検出部の後段に接続され、異常状態の継続時間を検出する時間検出用カウンタと異常状態及び正常状態間の変動回数を検出する変動検出用カウンタと、 前記両カウンタの検出状態に応じて前記出力トランジスタを制御する出力トランジスタ制御部とを有してなることを特徴とする直流安定化回路。 1. A output transistor connected between the input and the output, the DC stabilizing circuit comprising a fault detection circuit for cutting off the output transistor to detect an abnormal condition, the abnormality detection circuit, the abnormality detection and parts, are connected downstream of the abnormal detection unit, and the fluctuation detection counter for detecting the variation time count of the time between detecting the duration detection counter and the abnormal state and the normal state of the abnormal state, the detection state of the both counters DC stabilization circuit characterized by comprising an output transistor control unit which controls the output transistor in response to.
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