JPH05249939A - Color pallet circuit for converting digital information into analog information to prepare color pixel - Google Patents

Color pallet circuit for converting digital information into analog information to prepare color pixel

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JPH05249939A
JPH05249939A JP4093158A JP9315892A JPH05249939A JP H05249939 A JPH05249939 A JP H05249939A JP 4093158 A JP4093158 A JP 4093158A JP 9315892 A JP9315892 A JP 9315892A JP H05249939 A JPH05249939 A JP H05249939A
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JP
Japan
Prior art keywords
digital
circuit
color
input
digital information
Prior art date
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Withdrawn
Application number
JP4093158A
Other languages
Japanese (ja)
Inventor
Salvatore Arcuri
サルバドール・アーキュリ
Roy J Levy
ロイ・ジェイ・レビ
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Advanced Micro Devices Inc
Original Assignee
Advanced Micro Devices Inc
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Filing date
Publication date
Application filed by Advanced Micro Devices Inc filed Critical Advanced Micro Devices Inc
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Withdrawn legal-status Critical Current

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    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G1/00Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data
    • G09G1/28Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data using colour tubes
    • G09G1/285Interfacing with colour displays, e.g. TV receiver
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G5/00Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
    • G09G5/02Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the way in which colour is displayed
    • G09G5/06Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the way in which colour is displayed using colour palettes, e.g. look-up tables

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Abstract

PURPOSE: To increase the number of colors able to be displayed by a color pallet without proportionally increasing the size of a required memory. CONSTITUTION: The color pallet circuit 16 is provided with 1st and 2nd color lookup tables 18, 19 the addresses of storing positions in the lookup tables 18, 19 are specified by information read out from a video bit map, the contents of information stored in selected storing positions are combined by a digital adder or a digital multiplier, the combined signal is converted into an analog signal, which is used for generating a color pixel. The use of the combining means allows the generation of colors to be displayed of which number is larger than the sums of the numbers of storing positions in the lookup tables 18, 19.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【発明の背景】BACKGROUND OF THE INVENTION

【0002】[0002]

【発明の分野】この発明は色表示の発生に関連するディ
ジタル電子工学の分野に関し、かつより特定的には色表
示を発生するための駆動信号の発生に利用される色パレ
ット回路に関する。
FIELD OF THE INVENTION The present invention relates to the field of digital electronics related to the generation of color displays, and more particularly to color palette circuits utilized in the generation of drive signals for generating color displays.

【0003】[0003]

【従来の技術】図1は高度に単純化され、かつブロック
図の形状での色パレット回路1への典型的な先行技術の
試みを示す。典型的な現在のCMOS色パレット回路は
集積回路チップ上で実現されかつ参照記号2によって示
されるブロックは集積回路の境界を示し、すなわち、境
界2の範囲内の回路はチップ上に見つけられかつそれら
は入力および出力が外部的なものであるということを示
す。色パレット回路1は色ルックアップテーブル3を含
み、それは典型的にはその各々が24ビット幅である2
56の記憶位置を有するRAM装置であり、色ルックア
ップテーブル3における記憶位置の各々は外部源からの
ディジタル情報でロードされ、赤、緑および青色の成分
の組合せを規定し、256の独特の色を作り上げる。色
ルックアップテーブル3に含まれる256のアドレスは
ビデオビットマップから受信される情報によってアクセ
スされ、それは8つの個別の線を有するバス4を介して
であり、それはこの図においてバスを介する/によって
かつ/に隣接する数字8によって示される。8ビットの
アドレス入力で、記憶位置の各々の1つはもちろん独特
にアドレス指定され得る。図1において、出願全体を通
じてと同様に、平行なバスはそれを介する/を有する線
によって示されかつ平行なバスにおける個々の線の数は
/に隣接する数によって示される。色パレット回路1は
さらに赤ディジタルアナログ変換器5、緑ディジタルア
ナログ変換器6および青ディジタルアナログ変換器7を
含む。ディジタルアナログ変換器という言葉および頭文
字「DAC」はここではディジタル電圧変換器またはデ
ィジタル電流変換器を表わすために使用される。色ルッ
クアップテーブル3におけるメモリ位置がアドレス指定
されるとき、記憶位置に含まれる情報が各々が8ビット
でバス8を介して赤ディジタルアナログ変換器5に与え
られ、8ビットの緑色情報はバス9を介して緑ディジタ
ルアナログ変換器6に与えられかつ同様に8ビットの青
色情報はバス10を介して青のディジタルアナログ変換
器7に与えられる。ディジタルアナログ変換器の各々に
よって受信されるディジタル情報はアナログ信号に変換
され赤、緑および青色の成分を与え、それは色ピクセル
の発生に使用するために出力11、12および13でそ
れぞれに与えられる。ある応用において、256以上の
独特な色を提供し得ることが所望でありかつそうするた
めの典型的な先行技術の試みは付加的な記憶位置を有す
るより大きなルックアップテーブルを提供することであ
る。たとえば、4096の表示可能な色を与えるため
に、12ビットのアドレス情報を利用することが必要で
あり、4096の記憶位置をアドレス指定する。この著
しく増加する数の記憶位置を収容するために、実質的に
より大きな色ルックアップテーブルが必要とされること
がもちろん認められるが、それは相応じて集積回路チッ
プ上で実質的により広い面積を利用し、それはチップ上
に含まれることが必要とされる他の回路の点からは実行
不可能であり得る。
2. Description of the Prior Art FIG. 1 shows a typical prior art attempt at a color palette circuit 1 in the form of a highly simplified and block diagram. A typical current CMOS color palette circuit is implemented on an integrated circuit chip and the block designated by reference numeral 2 marks the boundary of the integrated circuit, ie, circuits within boundary 2 are found on the chip and they Indicates that the inputs and outputs are external. The color palette circuit 1 includes a color look-up table 3, which is typically 24 bits wide each.
A RAM device having 56 memory locations, each memory location in the color look-up table 3 being loaded with digital information from an external source, defining a combination of red, green and blue components and providing 256 unique colors. Make up. The 256 addresses contained in the color look-up table 3 are accessed by the information received from the video bitmap, which is via the bus 4 with eight individual lines, which in this figure is / is via the bus and It is indicated by the numeral 8 adjacent to /. With an 8-bit address input, each one of the storage locations can of course be uniquely addressed. In FIG. 1, as throughout the application, parallel buses are indicated by lines with / through them and the number of individual lines in a parallel bus is indicated by the number adjacent to /. The color palette circuit 1 further includes a red digital-analog converter 5, a green digital-analog converter 6 and a blue digital-analog converter 7. The terms digital-to-analog converter and the acronym "DAC" are used herein to refer to digital voltage converters or digital current converters. When a memory location in the color look-up table 3 is addressed, the information contained in the storage location is provided to the red digital-to-analog converter 5 via bus 8 in 8 bits each, and the 8 bits of green information are provided in bus 9 Via the bus to the green digital-to-analog converter 6 and likewise the 8-bit blue information is provided via the bus 10 to the blue to digital-analog converter 7. The digital information received by each of the digital-to-analog converters is converted into an analog signal to provide red, green and blue components, which are provided at outputs 11, 12 and 13 respectively for use in generating color pixels. In some applications it is desirable to be able to provide 256 or more unique colors and a typical prior art attempt to do so is to provide a larger look-up table with additional storage locations. .. For example, to provide 4096 displayable colors, it is necessary to utilize 12 bits of address information to address 4096 storage locations. It will, of course, be appreciated that a substantially larger color look-up table is required to accommodate this significantly increased number of memory locations, which correspondingly utilizes a substantially larger area on the integrated circuit chip. However, it may be infeasible in terms of other circuitry required to be included on the chip.

【0004】典型的な商業的な先行技術の色パレット回
路は、アドバンスト・マイクロ・ディバイシズ・インコ
ーポレーテッド、901 トンプソン プレイス、(Th
ompson Place)P.O.ボックス(Box )3453、サ
ニーベール、カリフォルニア、(Sunnyvale,Californi
a)94088から利用可能であり、それはAm81C
471/478と称される。この色パレットは256X
18(24)色ルックアップテーブルおよび15X18
(24)オーバーレイレジスタを使用しかつ271の色
を表示できる。この装置において、色ルックアップテー
ブルかまたはオーバーレイレジスタ(それは別のルック
アップテーブルと考えられ得る)のいずれかからの出力
はディジタルアナログ変換器に与えられ赤、緑および青
の駆動信号を発生する。回路はしかしながら、色ルック
アップテーブルからの情報をオーバーレイレジスタから
の情報と結びつけかつ結果として組合わされた情報を使
用してアナログ駆動信号を発生する能力を有さない。色
ルックアップテーブルに必要とされるメモリの大きさの
対応する実質的な増加を伴わずに著しく増加された数の
表示可能な色を与え得ることが所望である。
A typical commercial prior art color palette circuit is described in Advanced Micro Devices, Inc., 901 Thompson Place, (Th.
ompson Place) P. O. Box 3453, Sunnyvale, California, (Sunnyvale, Californi
a) Available from 94088, which is Am81C
It is called 471/478. This color palette is 256X
18 (24) color look-up table and 15X18
(24) Overlay registers can be used and 271 colors can be displayed. In this device, the output from either a color look-up table or an overlay register (which may be considered another look-up table) is applied to a digital-to-analog converter to generate the red, green and blue drive signals. The circuit, however, does not have the ability to combine the information from the color look-up table with the information from the overlay register and use the resulting combined information to generate an analog drive signal. It would be desirable to be able to provide a significantly increased number of displayable colors without a corresponding substantial increase in the amount of memory required for the color look-up table.

【0005】[0005]

【発明の概要】この発明の目的は必要とされるメモリの
大きさにおける比例的な増加なしに色パレット回路によ
って表示可能である色の数を増加させることである。
SUMMARY OF THE INVENTION It is an object of this invention to increase the number of colors that can be displayed by a color palette circuit without a proportional increase in the amount of memory required.

【0006】この発明にしたがって、前述の目的は以下
のように達成され得、それは第1および第2の色ルック
アップテーブルを利用し第1および第2の色ルックアッ
プテーブルへの別個のアドレス入力を与えることによっ
て、かつアナログ出力を与えるために複数個のディジタ
ルアナログ変換器回路に与えられた組合せ手段の結果と
して生じる出力に第1および第2のルックアップテーブ
ルの出力を組合せる組合せ手段を利用することによって
であり、その組合せは外部回路によって利用され得、色
ピクセルを発生する。
In accordance with the present invention, the foregoing object can be achieved as follows, which utilizes first and second color look-up tables to provide separate address inputs to the first and second color look-up tables. And combining means for combining the outputs of the first and second look-up tables with the resulting output of the combining means provided to the plurality of digital-to-analog converter circuits to provide an analog output. And the combination can be utilized by external circuitry to generate color pixels.

【0007】上記の目的を達成するためのこの発明の別
の特徴にしたがって、記憶位置の数よりも多くの表示可
能な色を発生することのできる色パレット回路が、色ビ
ットマップを利用して色ルックアップテーブルにおける
位置をアドレス指定することによって与えられ、その出
力は組合せ手段に与えられかつさらに、第2の入力を飽
和ビットマップから組合せ手段に与え、組合せ手段の出
力はディジタルアナログ変換器回路によって変換され色
ピクセルを作り出すためのアナログ駆動信号を与える。
According to another feature of the invention for achieving the above object, a color palette circuit capable of generating more displayable colors than the number of storage locations utilizes color bitmaps. Given by addressing a position in the color look-up table, its output is provided to the combining means and further a second input is provided from the saturation bitmap to the combining means, the output of the combining means being a digital-to-analog converter circuit. And provide an analog drive signal to produce the color pixels.

【0008】この発明の別の実施例にしたがって、色パ
レット回路が与えられ、それは色ルックアップテーブル
の位置をアドレス指定するために色ビットマップからの
第1の入力を利用しかつ複数個の組合せ回路に入力を与
える輝度ビットマップからの第2の入力を利用すること
によってメモリ記憶位置の増加なしに表示可能な色の増
加された数を発生する。組合せ回路の各々は色ルックア
ップテーブルからの情報を受取るための第2の入力を含
みかつ輝度ビットマップおよび色ビットマップからの情
報の組合された結果は組合せ手段によって組合された後
ディジタルアナログ変換器回路によってアナログ回路へ
と変換される。
In accordance with another embodiment of the present invention, a color palette circuit is provided which utilizes a first input from a color bitmap to address the location of a color look-up table and a plurality of combinations. Utilizing a second input from the intensity bitmap that feeds the circuit produces an increased number of displayable colors without increasing memory storage locations. Each of the combinational circuits includes a second input for receiving information from the color look-up table and the combined result of the information from the luminance and color bitmaps is combined by combining means before the digital-to-analog converter. The circuit converts it to an analog circuit.

【0009】この発明のさらに別の実施例にしたがっ
て、すぐ前の色パレット回路の変形として、輝度ルック
アップテーブルが輝度ビットマップからの情報を受取る
ために準備されかつ輝度ルックアップテーブルの出力は
組合せ手段に与えられ、こうして必要とされる記憶位置
の数の対応する大きな増加なしに著しく増加された数の
表示可能な色を達成する。
According to yet another embodiment of the present invention, as a variation of the previous color palette circuit, a luma lookup table is prepared to receive information from the luma bitmap and the luma lookup table outputs are combined. Provided to the means, thus achieving a significantly increased number of displayable colors without a corresponding large increase in the number of storage locations required.

【0010】この発明のさらに別の特徴にしたがって、
この発明の前述の実施例は組合せ回路とディジタルアナ
ログ変換回路との間のガンマ訂正ルックアップテーブル
をさらに利用して実現され得、これらの修正は表示装置
の明度(luminosity)の非線形性を補償すべく調整を与
え、それはたとえば表示装置へのアナログ電流入力また
は駆動電圧の機能としての陰極線管モニタであり得る。
According to yet another feature of the invention,
The above-described embodiments of the present invention may be implemented by further utilizing a gamma-correction look-up table between the combinational circuit and the digital-to-analog conversion circuit, these modifications compensating for the non-linearity of display luminosity. Adjustments are thus provided, which may be, for example, a cathode ray tube monitor as a function of analog current input to the display or drive voltage.

【0011】この発明の他の目的および利点は明細書お
よび図面の検討から明らかになるであろう。
Other objects and advantages of the present invention will become apparent from a review of the specification and drawings.

【0012】[0012]

【好ましい実施例の説明】この発明の第1の実施例は図
2に示される。図2において示されるように、色パレッ
ト回路16は色情報を示されないビデオビットマップか
らバス17を介して受取り、それは/に隣接する数字1
2によって示され、色パレット回路16に12ビットの
情報を与えるために12の線を含む。色パレット回路1
6は参照記号18によって示されまた色ルックアップテ
ーブル「A」としてブロック図の形状で示される第1の
色ルックアップテーブルを含む。色ルックアップテーブ
ル18は256の記憶位置を含み、その各々は24ビッ
トの情報をストアする能力を有する。色パレット回路1
6はまた参照記号19によって示されかつ色ルックアッ
プテーブル「B」としてブロック内で称されるされる第
2の色ルックアップテーブルを含む。色ルックアップテ
ーブル19は16の記憶位置を含み、その各々は24ビ
ットの情報をストアする能力を有する。色ルックアップ
テーブル18および19は好ましくは先行技術において
利用された型のRAM個体メモリ素子であり得る。これ
らの色ルックアップテーブルにロードされた情報は外部
源(示されず)から与えられかつローディングは先行技
術において利用されたものと同じ態様で行なわれる。色
ルックアップテーブル18をアドレス指定するために、
バス17からの12ビットのうちの8ビットが色ルック
アップテーブル18のアドレス入力に与えられる。バス
17における12の線の残りの4つは色ルックアップテ
ーブル19においてアドレスを選択するために色ルック
アップテーブル19のアドレス入力に結合される。色ル
ックアップテーブル18および色ルックアップテーブル
19からの出力は組合せ回路手段によって組合され、そ
れらはたとえばディジタル加算回路またはディジタル乗
算回路であり得る。図2に示された実施例において、デ
ィジタル加算器20は色ルックアップテーブル18およ
び色ルックアップテーブル19からの赤色成分出力を組
合せるために準備され、ディジタル加算器21は表示さ
れるべき色の緑色成分を発生するために色ルックアップ
テーブル18においてアドレス指定された記憶位置およ
び色ルックアップテーブル19においてアドレス指定さ
れた記憶位置からの結果として生じる出力を加算するた
めに利用され、かつ同様にディジタル加算器回路22は
色ルックアップテーブル18および色ルックアップテー
ブル19からの出力を組合せ表示されるべきピクセルの
色の青成分を示すディジタル信号を発生する。ディジタ
ル加算器20によって受信されたディジタル情報の和は
バス23を介してその出力からディジタルアナログ変換
器24に与えられ、それはバス23を介して受取られた
ディジタル情報をアナログ信号に変換し、それは端子2
5で利用可能である。同様に、ディジタル加算器21か
らの出力はバス27を介してディジタルアナログ変換器
26に与えられかつバス27を介して受信されたディジ
タル信号を示す大きさを有するアナログ信号は出力端子
28で与えられる。類似の態様で、ディジタル加算器2
2へと準備される色ルックアップテーブル18および色
ルックアップテーブル19のアドレス指定された記憶位
置の部分の結果として生じるディジタル和はデジタル和
を発生し、それはバス29を介してディジタル加算器2
2の出力でディジタルアナログ変換器30に与えられ、
それは受信されたディジタル信号をディジタル情報を示
すアナログ値に変換しかつ端子31でこのアナログ信号
を与える。加算器回路(20、21および22)の各々
からの出力は1ビットによって切捨てられる。
DESCRIPTION OF THE PREFERRED EMBODIMENT A first embodiment of the invention is shown in FIG. As shown in FIG. 2, the color palette circuit 16 receives color information from the video bitmap not shown via bus 17, which is the digit 1 adjacent to /.
Included twelve lines to provide the color palette circuit 16 with 12 bits of information, indicated by 2. Color palette circuit 1
6 includes a first color look-up table indicated by reference numeral 18 and shown in block diagram form as color look-up table "A". The color look-up table 18 includes 256 storage locations, each of which has the ability to store 24 bits of information. Color palette circuit 1
6 also includes a second color look-up table, indicated by reference numeral 19 and referred to in the block as color look-up table "B". The color lookup table 19 contains 16 storage locations, each of which has the ability to store 24 bits of information. Color look-up tables 18 and 19 may preferably be RAM solid state memory devices of the type utilized in the prior art. The information loaded into these color lookup tables is provided from an external source (not shown) and loading is done in the same manner as utilized in the prior art. To address the color lookup table 18,
Eight of the twelve bits from bus 17 are provided to the address inputs of color look-up table 18. The remaining four of the twelve lines on bus 17 are coupled to the address inputs of color look-up table 19 for selecting addresses in color look-up table 19. The outputs from color look-up table 18 and color look-up table 19 are combined by combinational circuit means, which may be, for example, digital summing circuits or digital multiplying circuits. In the embodiment shown in FIG. 2, a digital adder 20 is provided to combine the red component outputs from the color look-up table 18 and the color look-up table 19 and a digital adder 21 of the color to be displayed. Used to add the resulting output from the memory location addressed in color look-up table 18 and the memory location addressed in color look-up table 19 to produce the green color component, and also digitally. Adder circuit 22 combines the outputs from color look-up table 18 and color look-up table 19 to generate a digital signal indicative of the blue component of the color of the pixel to be displayed. The sum of the digital information received by the digital adder 20 is provided via its bus 23 at its output to a digital-to-analog converter 24, which converts the digital information received via the bus 23 into an analog signal, which Two
Available in 5. Similarly, the output from digital adder 21 is provided to digital-to-analog converter 26 via bus 27 and an analog signal having a magnitude indicative of the digital signal received via bus 27 is provided at output terminal 28. .. In a similar manner, the digital adder 2
The resulting digital sum of the addressed look-up portion of the color look-up table 18 and the color look-up table 19 prepared to 2 produces a digital sum, which via the bus 29, the digital adder 2
2 is given to the digital-analog converter 30 at the output,
It converts the received digital signal into an analog value representing digital information and provides this analog signal at terminal 31. The output from each of the adder circuits (20, 21 and 22) is truncated by 1 bit.

【0013】色パレット回路16は、ディジタル加算器
20、21および22と共に色ルックアップテーブル1
8および色ルックアップテーブル19を利用してビデオ
ビットマップからの12ビットの情報の入力によって達
成された4096の独特の色の表示を許容する。しかし
ながら、先行技術と比較して、色パレット回路16は合
計272のアドレス指定可能な記憶位置を有するメモリ
手段を必要とするが、単一のメモリ手段を利用する先行
技術においては、4096の独特の表示可能な色を発生
するために、メモリ手段において4096の記憶位置が
必要とされるであろう。こうして、色情報をストアする
ために複数個のメモリ手段を利用することによって必要
とされる全体の記憶位置を著しく削減しこれによって集
積回路装置、たとえば色パレット回路上で必要とされる
空間が実現される。
The color palette circuit 16 includes a digital adder 20, 21 and 22 together with a color look-up table 1.
8 and color look-up table 19 are utilized to allow the display of 4096 unique colors achieved by inputting 12 bits of information from the video bitmap. However, compared to the prior art, the color palette circuit 16 requires memory means having a total of 272 addressable storage locations, whereas in the prior art utilizing a single memory means 4096 unique. 4096 storage locations in the memory means would be required to generate the displayable colors. Thus, by utilizing a plurality of memory means to store color information, the overall storage location required is significantly reduced, thereby providing the space required on an integrated circuit device, for example a color palette circuit. To be done.

【0014】図3は図2に示された型の回路のための単
純化された例を示す。この単純化された例において、色
パレット回路36は組合せ手段38が乗算器であるとき
組合せ手段38からの出力線37で2a+b の数の独特な
色を提供するであろう。メモリAと称されかつ参照記号
39によって示される第1のメモリは図示されない源か
らその中へとロードされるディジタル情報をストアする
ために2a の記憶位置を含む。参照記号40によって示
される第2のメモリ、メモリBはディジタル情報をスト
アするために2b の記憶位置を含む。メモリAはバス4
1を介してアドレス入力を受取り、そのバスは「a」の
数のアドレス情報の線を含み、2a の記憶位置のうちの
1つを独特に識別する。アドレス信号の受信に応答し
て、メモリAは選択された記憶位置にストアされた情報
を線42を介して組合せ手段38に与える。同様に、メ
モリBは2b の記憶位置を含み、バス43を介してアド
レス情報を受取り、そのバスは「b」の数の線を含みメ
モリBにおける2b の記憶位置のいずれか1つを独特に
識別する。メモリBにおける選択された記憶位置に含ま
れる情報はメモリBの出力で与えられかつ線44を介し
て組合せ手段38の入力へと転送される。アドレス指定
されるべきメモリAおよびメモリBにおける記憶位置の
同一性はa+bの数と等しい個々の線を有する平行なバ
ス、バス45を介して与えられる。ディジタルアドレス
情報は図3における実例においてバス41および43に
細分化される単一のバス45から与えられるが、前に組
合されていない別個の入力バスがアドレス情報を与え得
るということはもちろん認められるであろう。先行技術
において、2a+b の個々の色を表示するために2a+b
記憶位置を有する単一のメモリ手段が必要とされた。
FIG. 3 shows a simplified example for a circuit of the type shown in FIG. In this simplified example, the color palette circuit 36 will provide 2 a + b number of unique colors on the output line 37 from the combining means 38 when the combining means 38 is a multiplier. A first memory, referred to as memory A and designated by reference numeral 39, contains 2 a storage locations for storing digital information loaded into it from a source not shown. A second memory, designated by reference numeral 40, memory B, contains 2 b storage locations for storing digital information. Memory A is bus 4
An address input is received via 1 and the bus contains "a" number of lines of address information to uniquely identify one of the 2a storage locations. In response to receiving the address signal, the memory A provides the information stored in the selected storage location via line 42 to the combining means 38. Similarly, memory B contains 2 b storage locations and receives address information via bus 43, which bus contains “b” number of lines and stores any one of the 2 b storage locations in memory B. Uniquely identify. The information contained in the selected storage location in memory B is provided at the output of memory B and transferred via line 44 to the input of the combining means 38. The identity of the storage locations in memory A and memory B to be addressed is provided via a parallel bus, bus 45, with individual lines equal in number to a + b. Although the digital address information is provided from the single bus 45 subdivided into buses 41 and 43 in the example of FIG. 3, it is, of course, recognized that separate, uncombined input buses may provide the address information. Will. In the prior art, a single memory means having 2a + b storage locations was required to display 2a + b individual colors.

【0015】先行技術において、たとえば図1において
示されるように、色ルックアップテーブル3内で記憶位
置をアドレス指定することによって発生されるべき色ピ
クセルの決定は予め規定されたビデオビットマップから
なされた。出願人の発明の第1の実施例において、図2
において示されるように、メモリ手段18およびメモリ
手段19の間のバス入力の数を分配することによって、
かつ組合せ手段を使用して出力を組合せることによって
さらにその後ディジタルの結果をアナログ値に変換する
ことによって表示可能な色の数は記憶位置の数の等しい
増加なしに増加される。
In the prior art, the determination of a color pixel to be generated by addressing a storage location within a color look-up table 3, for example as shown in FIG. 1, was made from a predefined video bitmap. .. In a first embodiment of Applicant's invention, FIG.
By distributing the number of bus inputs between the memory means 18 and the memory means 19, as shown in
And by combining the outputs using combining means and then by converting the digital result to an analog value, the number of colors that can be displayed is increased without an equal increase in the number of memory locations.

【0016】必要とされる記憶素子の大きさを増加させ
ることなく増加された数の表示可能な色を与えるための
代替的な実施例は図4に示される出願人の発明の第2の
実施例として示される。色パレット回路49は8つの線
を含むバス50を介して色ビットマップ(図示されず)
から色情報を受けとる。色パレット回路49への第2の
入力は4つの線を有するバス51を介して飽和ビットマ
ップ(再び図示されず)から与えられる。表示されるべ
きピクセルのために、表示されるべきピクセルの色を決
定する情報の第1の部分は色ルックアップテーブル52
における256の記憶位置のうちの1つをアドレス指定
することによって識別され、それはたとえばRAMメモ
リであり、この特定の実施例において256の記憶位置
の各々において24ビットの情報を含む。いずれかの記
憶位置にストア可能な情報のビットの数と同様にメモリ
手段に設けられた記憶位置の数は特定のシステムのニー
ズに適するように変化され得るということはもちろん認
められるであろう。色ルックアップテーブル52の25
6の記憶位置にストアされた情報は図示されない外部源
からロードされ、かつ飽和ビットマップから受取られた
情報とともに記憶位置における予め定められた情報が表
示されるであろう色を決定する。色ルックアップテーブ
ル52における各々の選択された記憶位置に対して、8
ビットの赤、8ビットの緑および8ビットの青色情報が
与えられ、赤色情報はバス53を介して赤加算器54へ
の第1の入力に与えられ、色の緑の成分のための8つの
付加的なビットの情報はバス55を介して色ルックアッ
プテーブル52における選択された記憶位置から緑加算
器56の入力のうちの1つに与えられる。同様に、表示
されるべき色の青成分を示す8ビットの情報はバス57
を介して青加算器58の1つの入力に与えられる。赤加
算器54、緑加算器56および青加算器58の第2の入
力の各々にバス51を介して情報が与えられ飽和レベル
を規定し、それはこの特定の実施例において前に示され
た加算器回路の各々に対して同様である。さらに、組合
せ回路(54、56および58)は外部源から選択的に
プログラム可能であり得、それによってそれらが行なう
ディジタル動作はプログラム制御の下で修正され得る。
色パレット回路49の特定の実施例に戻って、バス53
およびバス51を介して赤加算器54によって受取られ
た情報のディジタル加算の結果は8つの線を有するバス
59を介してDACディジタルアナログ変換器60に与
えられ、それはバス59を介して受取られたディジタル
情報を出力端子61で与えられるアナログ信号に変換す
る。赤加算器54の加算の結果として生じる最下位ビッ
トは切捨てられる。緑加算器56の出力で与えられる結
果として生じるディジタル信号は8ビットを有するバス
62によってディジタルアナログ変換器63に与えら
れ、それはバス62を介して受取られたディジタル情報
を出力端子64で与えられるアナログ信号に変換する。
緑加算器56によって発生された和の最下位ビットは切
捨てられ、それによって8ビットの出力のみが緑加算器
56によって与えられる。同様に、青加算器58のディ
ジタル加算の結果はバス65を介してディジタルアナロ
グ変換器66に与えられ、それはディジタル情報をアナ
ログ信号に変換し、それは出力端子67で与えられる。
青加算器58からの最下位ビットの切捨ては青加算器5
8から8ビットの出力を与えるように行なわれる。
An alternative embodiment for providing an increased number of displayable colors without increasing the required storage element size is an alternative embodiment of Applicant's invention shown in FIG. Shown as an example. The color palette circuit 49 receives a color bitmap (not shown) via a bus 50 containing eight lines.
Receives color information from. The second input to the color palette circuit 49 comes from a saturation bitmap (again not shown) via a bus 51 having four lines. For a pixel to be displayed, the first piece of information that determines the color of the pixel to be displayed is the color lookup table 52.
Identified by addressing one of the 256 storage locations at, which is, for example, a RAM memory, and which in this particular embodiment contains 24 bits of information at each of the 256 storage locations. It will, of course, be appreciated that the number of bits of information that can be stored in any memory location as well as the number of memory locations provided in the memory means can be varied to suit the needs of a particular system. Color lookup table 52 of 25
The information stored in the six storage locations is loaded from an external source, not shown, and together with the information received from the saturation bitmap, the predetermined information at the storage location determines the color that will be displayed. 8 for each selected storage location in the color lookup table 52
Bits of red, 8 bits of green and 8 bits of blue information are provided, the red information is provided via bus 53 to a first input to a red adder 54 for the eight green components of the color. Additional bits of information are provided via bus 55 to one of the inputs of green adder 56 from the selected storage location in color look-up table 52. Similarly, the 8-bit information indicating the blue component of the color to be displayed is on the bus 57.
To one input of the blue adder 58 via. The second inputs of red adder 54, green adder 56, and blue adder 58 are each informed via bus 51 to define the saturation level, which is the summation previously shown in this particular embodiment. The same is true for each of the instrument circuits. Further, the combinational circuits (54, 56 and 58) may be selectively programmable from an external source so that the digital operations they perform can be modified under program control.
Returning to the specific embodiment of the color palette circuit 49, the bus 53
And the result of the digital addition of the information received by the red adder 54 via bus 51 is provided to the DAC digital-to-analog converter 60 via bus 59 having eight lines, which is received via bus 59. The digital information is converted into an analog signal provided at the output terminal 61. The least significant bit resulting from the addition of red adder 54 is truncated. The resulting digital signal provided at the output of green adder 56 is provided to digital-to-analog converter 63 by bus 62 having 8 bits, which provides the digital information received on bus 62 at output 64. Convert to signal.
The least significant bit of the sum generated by the green adder 56 is truncated so that only the 8-bit output is provided by the green adder 56. Similarly, the result of the digital addition of blue adder 58 is provided via bus 65 to a digital-to-analog converter 66 which converts the digital information into an analog signal which is provided at output 67.
Truncate the least significant bit from the blue adder 58 is the blue adder 5
It is done to give an output of 8 to 8 bits.

【0017】色パレット回路49の構成で、この回路を
使用して発生され得る独特に同定された色ピクセルの最
大限の数は4096に等しくなる。色パレット回路49
の代替的な実施例は飽和ビットマップによって与えられ
る情報のビットの数の増加、色ルックアップテーブル5
2における記憶位置の各々に含まれるビットの数の増
加、および/または色ルックアップテーブル52におけ
る記憶位置の数の増加を含む。色パレット回路49のさ
らに別の代替的な実施例は組合せ手段(赤加算器54、
緑加算器56および青加算器58)の各々とそれらのそ
れぞれの相関のディジタルアナログ変換器との間にガン
マ訂正ルックアップテーブルの包含を伴う。ガンマ訂正
ルックアップテーブルの使用はまたこの発明の第7、第
8および第9の実施例と関連して説明される。前におよ
びその後に説明されるように、色パレット回路とともに
使用される表示装置の明度が与えられた駆動電圧または
駆動電流に関して非線形であるとき、さらに正確な色表
示が達成され、そのときガンマ訂正が利用される。
With the configuration of color palette circuit 49, the maximum number of uniquely identified color pixels that can be generated using this circuit will be equal to 4096. Color palette circuit 49
Alternative embodiment of increasing the number of bits of information provided by the saturation bitmap, color lookup table 5
2 includes increasing the number of bits contained in each of the memory locations and / or increasing the number of memory locations in the color lookup table 52. Yet another alternative embodiment of the color palette circuit 49 is a combination means (red adder 54,
With the inclusion of a gamma correction look-up table between each of the green adders 56 and blue adders 58) and their respective correlated digital-to-analog converters. The use of gamma correction look-up tables is also described in connection with the seventh, eighth and ninth embodiments of this invention. As explained before and after, a more accurate color display is achieved when the brightness of the display device used with the color palette circuit is non-linear with respect to a given drive voltage or drive current, then the gamma correction. Is used.

【0018】この発明の第3の実施例は図5に示され
る。第3の実施例において、色パレット回路70は色ビ
ットマップ(図示されず)からの第1の入力および輝度
ビットマップ(再び図示されず)からの第2の入力を利
用し、表示されるべき色を規定する。色パレット回路7
0は色ルックアップテーブル71を利用し、それは64
のアドレス指定可能な記憶位置を含み、その各々は24
ビットの情報をストアすることが可能である。色ルック
アップテーブル71内での記憶位置によって規定される
べき各々の色についての特徴は図示されない外部源から
色ルックアップテーブル71にロードされる。色ビット
マップからの情報はバス72を介して色ルックアップテ
ーブル71内で予め定められた記憶位置を選択するため
に利用され、そのバスは6つの線を有し、色ルックアッ
プテーブル71のアドレス入力に接続される。色ルック
アップテーブル71におけるアドレスの選択の際に、2
4の位置の内の8つにおける情報はバス73を介してデ
ィジタル乗算器74に伝送され、それはそのディジタル
情報をバス75を介して輝度ビットマップから受信され
たディジタル情報で乗算し、ディジタル積を与え、それ
はバス76を介してディジタルアナログ変換器77に与
えられ、それは受信されたディジタル情報をアナログ信
号に変換し、それは端子78で与えられる。端子78で
の結果として生じるアナログ信号は表示されるべき色ピ
クセルの赤成分の発生において使用される。類似の態様
で、色ルックアップテーブル71におけるアドレス指定
された記憶位置からの別の8ビットがバス79を介して
ディジタル乗算器80に与えられる。色ルックアップテ
ーブル71からディジタル乗算器80への8ビットの情
報の提示と同時に、バス75を介するディジタル乗算器
80への第2の入力はバス79を介して受取られたディ
ジタル情報で乗算されるとき、その出力でディジタル積
を発生し、その積はバス81を介してディジタルアナロ
グ変換器82に与えられ、それは受取られたディジタル
情報をアナログ信号に変換し、それが端子83で与えら
れる。色ピクセルの青成分を発生するために、8ビット
の情報が色ルックアップテーブル71におけるアドレス
指定された位置からバス85を介してディジタル乗算器
84に与えられる。バス85およびバス75からディジ
タル乗算器84によって受取られた情報の積はバス86
を介してディジタルアナログ変換器87に与えられ、そ
れはディジタル情報をアナログ信号に変換し、それは端
子88で与えられる。6ビット×8ビットの乗算が14
ビットを有する積を発生するということが認められるで
あろう。色パレット回路70において、赤乗算器74、
緑乗算器80および青乗算器84の出力は6つの最下位
ビットを落とすことによって8ビットへと切捨てられ
る。色パレット回路70を利用することによって、独特
な表示可能な色の最大限の数は4096となる。色パレ
ット回路70に対する修正は色ルックアップテーブルに
おける記憶位置の数の増加、および輝度ビットマップか
ら与えられる情報のビットの増加を含み得る。図5に示
されるこの発明の実施例はそれぞれのビットマップにお
けるデータが色度および輝度情報を表示するために便利
に組織され得るために特に所望である。
A third embodiment of the invention is shown in FIG. In the third embodiment, the color palette circuit 70 utilizes a first input from a color bitmap (not shown) and a second input from a luminance bitmap (not shown again) to be displayed. Specifies the color. Color palette circuit 7
0 uses the color lookup table 71, which is 64
Addressable storage locations, each of which is 24
It is possible to store bits of information. The features for each color to be defined by its location in the color look-up table 71 are loaded into the color look-up table 71 from an external source not shown. The information from the color bitmap is used to select a predetermined storage location in the color look-up table 71 via the bus 72, which bus has six lines and the address of the color look-up table 71. Connected to input. When selecting an address in the color lookup table 71, 2
The information in eight of the four positions is transmitted via bus 73 to a digital multiplier 74, which multiplies the digital information with the digital information received from the luminance bitmap via bus 75 to produce a digital product. Present, which is provided via bus 76 to a digital-to-analog converter 77, which converts the received digital information into an analog signal, which is provided at terminal 78. The resulting analog signal at terminal 78 is used in generating the red component of the color pixel to be displayed. In a similar manner, another 8 bits from the addressed storage location in color look-up table 71 is provided to digital multiplier 80 via bus 79. At the same time as presenting the 8-bit information from the color look-up table 71 to the digital multiplier 80, the second input to the digital multiplier 80 via bus 75 is multiplied by the digital information received via bus 79. It then produces a digital product at its output, which is applied via bus 81 to a digital-to-analog converter 82, which converts the received digital information into an analog signal, which is applied at terminal 83. Eight bits of information are provided from the addressed location in color look-up table 71 to digital multiplier 84 via bus 85 to generate the blue component of the color pixel. The product of the information received by digital multiplier 84 from bus 85 and bus 75 is bus 86.
To a digital-to-analog converter 87, which converts the digital information into an analog signal, which is provided at terminal 88. 6 bits x 8 bits multiplication is 14
It will be appreciated that it produces a product with bits. In the color palette circuit 70, the red multiplier 74,
The outputs of green multiplier 80 and blue multiplier 84 are truncated to 8 bits by dropping the 6 least significant bits. By utilizing the color palette circuit 70, the maximum number of unique displayable colors is 4096. Modifications to the color palette circuit 70 may include increasing the number of storage locations in the color look-up table and increasing the bits of information provided from the intensity bitmap. The embodiment of the invention shown in FIG. 5 is particularly desirable because the data in each bitmap can be conveniently organized to display chromaticity and luminance information.

【0019】この発明の第4の実施例は図6に示され
る。色パレット回路91は色ビットマップおよび輝度ビ
ットマップからの入力を利用する。図5と図6とを比較
することによって認められるように、図6において多数
の回路エレメントは図5において利用されるそれらと同
じである。より特定的には、その共通性は色ルックアッ
プテーブル71、ディジタル乗算器74、80および8
4、ならびにディジタルアナログ変換器77、82およ
び87を含む。図5における回路に加えて、色パレット
回路91は輝度ルックアップテーブルを有し、それは参
照記号92によって示され、64のアドレス指定可能な
記憶位置を有し、その各々は6ビットの情報をストアす
ることが可能である。輝度ルックアップテーブル92に
ストアされた情報は外部源(図示されず)から従来の回
路(再び図示されず)を使用してロードされる。輝度ビ
ットマップからの情報はバス75を介して輝度ルックア
ップテーブル92のアドレス入力に与えられる。輝度ル
ックアップテーブル92における選択された記憶位置に
ストアされた情報はバス93によってディジタル乗算器
回路74、80および84上の入力に与えられる。輝度
ルックアップテーブルが輝度情報上での変形を許容する
ために、色パレット回路91は特定的に有利である。こ
の発明の第5の実施例は図7において示され、そこで色
パレット回路97が示される。この実施例において、表
示されるべき色は色ビットマップ(図示されず)および
輝度ビットマップ(図示されず)からの情報の組合せに
よって決定される。色パレット回路97は色ルックアッ
プテーブル98を含み、それはメモリ素子のいずれかの
形状であり得、それは好ましくはこの実施例に対しては
64のアドレス指定可能な記憶位置を含み、その各々は
24ビットの情報をストアすることが可能である。表示
可能な色に関する情報は従来の手段によってかつ従来の
回路を使用して色ルックアップテーブル98にロードさ
れる。記憶位置を色ルックアップテーブル98において
アドレス指定するために、アドレス情報を与えるための
6つの個々の線を有するバス99は色ルックアップテー
ブル98のアドレス入力に接続される。この実施例にお
いて、乗算ディジタルアナログ変換器回路は色ルックア
ップテーブル98から受取られた情報と輝度ビットマッ
プから受取られた情報とを組合せるために利用される。
より特定的には、乗算ディジタルアナログ変換器回路1
00は受取られた情報を変換しかつ出力端子101で表
示されるべき色ピクセルの赤成分に準備されるべき駆動
を示すアナログ信号を与える。同様に、乗算ディジタル
アナログ回路102は受取られた情報をアナログ信号に
変換し出力端子103で緑の駆動信号に情報を与える。
表示されるべきピクセルの青成分は、受信された入力に
基づいて出力端子105でアナログ信号を発生する乗算
ディジタルアナログ変換器回路104によって発生され
る。色ルックアップテーブル98における記憶位置がア
ドレス指定されるとき、8ビットの情報がバス106を
介して乗算ディジタルアナログ変換器回路100のディ
ジタル入力に与えられる。アドレス指定された記憶位置
内の付加的な8つのセルにおける情報はバス107を介
して乗算ディジタルアナログ変換器回路102のディジ
タル入力に与えられ、かつアドレス指定された記憶位置
内の別の8つの記憶セルにおける情報はバス108を介
して乗算ディジタルアナログ変換器回路104に与えら
れる。バス106ないし108を介して与えられる情報
は情報の第1の部分を与えるために利用され、その情報
は色ピクセルを発生するために出力端子101、103
および105上でアナログ信号を最終的に発生するべく
使用されるであろう。表示されるべき色ピクセルを発生
することにおいて利用される第2の信号成分の源は輝度
ビットマップである。この第2の信号成分はバス109
を介して輝度ビットマップから受取られたディジタル情
報を変換することによって発生されかつディジタルアナ
ログ変換器回路110の入力に与えられる。非乗算ディ
ジタルアナログ変換器回路であるディジタルアナログ変
換器回路110によって発生されたアナログ信号は、線
111によって乗算ディジタルアナログ変換器回路10
0に、線112によって乗算ディジタルアナログ変換器
回路102にかつ線113によって乗算ディジタルアナ
ログ変換器回路104に与えられる。色ルックアップテ
ーブル98およびディジタルアナログ変換器回路110
からの入力の受信に応答して、これらの組合された信号
は出力端子101で赤成分のために、103で緑の成分
のために、かつ105で青の成分のためにアナログ駆動
信号を発生する。色パレット回路97は特定的には有利
であり、なぜならそれが高価でない乗算ディジタルアナ
ログ変換器で実現され得るからである。
A fourth embodiment of the invention is shown in FIG. The color palette circuit 91 utilizes inputs from the color and luminance bitmaps. Many circuit elements in FIG. 6 are the same as those utilized in FIG. 5, as will be appreciated by comparing FIGS. More specifically, the commonality is color look-up table 71, digital multipliers 74, 80 and 8
4 and digital-to-analog converters 77, 82 and 87. In addition to the circuit in FIG. 5, the color palette circuit 91 has a luminance look-up table, which is designated by the reference numeral 92, has 64 addressable storage locations, each of which stores 6 bits of information. It is possible to The information stored in the luminance look-up table 92 is loaded from an external source (not shown) using conventional circuitry (not shown again). Information from the intensity bitmap is provided via bus 75 to the address inputs of the intensity lookup table 92. The information stored at the selected storage location in the luminance look-up table 92 is provided by bus 93 to the inputs on digital multiplier circuits 74, 80 and 84. The color palette circuit 91 is particularly advantageous because the luminance look-up table allows transformations on the luminance information. A fifth embodiment of the invention is shown in FIG. 7, where the color palette circuit 97 is shown. In this example, the color to be displayed is determined by a combination of information from a color bitmap (not shown) and a luminance bitmap (not shown). Color palette circuit 97 includes a color look-up table 98, which may be in the form of any of the memory elements, which preferably includes 64 addressable storage locations for this embodiment, each of which is 24. It is possible to store bits of information. Information about the displayable colors is loaded into the color look-up table 98 by conventional means and using conventional circuitry. To address a storage location in the color look-up table 98, a bus 99 having six individual lines for providing address information is connected to the address input of the color look-up table 98. In this embodiment, a multiplying digital-to-analog converter circuit is utilized to combine the information received from the color look-up table 98 with the information received from the luminance bitmap.
More specifically, the multiplication digital-analog converter circuit 1
00 transforms the information received and provides at the output 101 an analog signal indicating the drive to be prepared for the red component of the color pixel to be displayed. Similarly, the multiplying digital-analog circuit 102 converts the received information into an analog signal and provides the green driving signal with the information at the output terminal 103.
The blue component of the pixel to be displayed is generated by a multiplying digital-to-analog converter circuit 104 which produces an analog signal at output 105 based on the received input. When a storage location in the color look-up table 98 is addressed, 8 bits of information are provided via bus 106 to the digital input of the multiplying digital to analog converter circuit 100. The information in the additional eight cells in the addressed storage location is provided to the digital input of the multiplying digital-to-analog converter circuit 102 via bus 107 and in another eight storage locations in the addressed storage location. The information in the cells is provided to the multiplying digital-to-analog converter circuit 104 via bus 108. The information provided via buses 106-108 is utilized to provide a first portion of the information which is output 101, 103 to generate color pixels.
And will be used to ultimately generate an analog signal on 105. The second source of signal components utilized in generating the color pixels to be displayed is the intensity bitmap. This second signal component is the bus 109
Generated by converting the digital information received from the luminance bitmap via and provided to the input of the digital-to-analog converter circuit 110. The analog signal generated by the digital-to-analog converter circuit 110, which is a non-multiplying digital-to-analog converter circuit, is transmitted by line 111 to the multiplying digital-to-analog converter circuit 10.
0 to the multiplying digital-to-analog converter circuit 102 by line 112 and to the multiplying digital-to-analog converter circuit 104 by line 113. Color look-up table 98 and digital-to-analog converter circuit 110.
In response to receiving an input from, these combined signals generate an analog drive signal at the output terminal 101 for the red component, 103 for the green component, and 105 for the blue component. To do. The color palette circuit 97 is particularly advantageous because it can be implemented with a cheap multiplying digital-to-analog converter.

【0020】この発明の第6の実施例は図8に示され
る。色パレット回路97(図7において)と図8におけ
る色パレット回路115とを比較することによって認め
られるであろうように、利用される一定の回路エレメン
トは同じであり、したがって両方の回路において同じ参
照記号で示される。輝度情報においての変形を許容する
ために、輝度ルックアップテーブル116が与えられ
る。輝度ルックアップテーブル116はいずれかの従来
の周知のメモリ手段の形状を取り得、かつこの実施例に
おいては64の記憶位置を含み、その各々は6ビットの
情報をストアすることができる。輝度ルックアップテー
ブル116の64の記憶位置にストアされるべき情報は
図示されない外部源からユーザによってかつ従来の手段
によってロードされる。輝度ビットマップから受取られ
た輝度情報はバス109を介して輝度ルックアップテー
ブル116のアドレス入力に与えられる。輝度ルックア
ップテーブル116における記憶位置がアドレス指定さ
れるとき、その記憶位置に含まれる情報はバス117を
介してディジタルアナログ変換器回路110に与えら
れ、それは非乗算ディジタルアナログ変換器回路であ
る。ディジタルアナログ変換器回路110の出力で発生
されたアナログ信号は線111によって乗算ディジタル
アナログ変換器回路100に結合される。同じ信号はま
た線112によって乗算ディジタルアナログ変換器回路
102に結合されかつ同様に線113によって乗算ディ
ジタルアナログ変換器回路104に結合される。色パレ
ット回路115はたとえば図7に示される色パレット回
路97に対して有利であり、そこでは、それは輝度情報
における変形を許容する。色パレット回路97および色
パレット回路115において、出力発生回路、およびよ
り特定的には乗算ディジタルアナログ変換器回路10
0、102および104は変換されたアナログ信号の乗
算を利用しそれらのそれぞれの出力端子で出力電圧を発
生する。発生されたアナログ信号を乗算する代わりに、
これらの出力発生回路が、たとえばそれらをともに加算
することによって受取られた入力信号を類推的に組合せ
ることができるということももちろん認められるであろ
う。
A sixth embodiment of the invention is shown in FIG. As will be appreciated by comparing the color palette circuit 97 (in FIG. 7) and the color palette circuit 115 in FIG. 8, the certain circuit elements utilized are the same, and thus the same reference in both circuits. Indicated by a symbol. A luminance look-up table 116 is provided to allow transformations in the luminance information. Luminance look-up table 116 may take the form of any conventional, well-known memory means, and in this embodiment includes 64 storage locations, each of which may store 6 bits of information. The information to be stored in the 64 storage locations of the luminance look-up table 116 is loaded by the user and by conventional means from an external source not shown. Luminance information received from the luma bitmap is provided to address inputs of luma lookup table 116 via bus 109. When a storage location in the luminance look-up table 116 is addressed, the information contained in that storage location is provided to the digital-to-analog converter circuit 110 via bus 117, which is a non-multiplying digital-to-analog converter circuit. The analog signal produced at the output of digital-to-analog converter circuit 110 is coupled to multiplying digital-to-analog converter circuit 100 by line 111. The same signal is also coupled by line 112 to the multiplying digital-to-analog converter circuit 102 and also by line 113 to the multiplying-to-analog converter circuit 104. Color palette circuit 115 is advantageous over, for example, color palette circuit 97 shown in FIG. 7, where it allows for variations in luminance information. In the color palette circuit 97 and the color palette circuit 115, an output generation circuit, and more specifically, a multiplication digital-analog converter circuit 10
0, 102 and 104 utilize the multiplication of the converted analog signals to generate the output voltage at their respective output terminals. Instead of multiplying the generated analog signal,
It will, of course, be appreciated that these output generating circuits can analogically combine the received input signals, for example by adding them together.

【0021】この発明の第7の実施例は、図9に示さ
れ、色パレット回路121を含む。色パレット回路12
1において、多数の回路エレメントは色パレット回路7
0(図5に示される)において利用されたものと同じで
あり、したがって同様の回路構成要素は図5で使用され
た同じ参照記号によって示される。いずれかの状況にお
いて、表示装置の明度の非線形性を補償するために色パ
レット回路においてガンマ訂正を与えることは所望であ
る。色パレット回路121において、ガンマ訂正はガン
マ訂正ルックアップテーブルを含むことによって達成さ
れ、各々の色成分に対して1つずつが発生され、たとえ
ば赤ガンマ訂正ルックアップテーブル122、緑ガンマ
訂正ルックアップテーブル123および青ガンマ訂正ル
ックアップテーブル124である。この実施例におい
て、ガンマ訂正ルックアップテーブルの各々は256の
別個にアドレス指定可能な記憶位置を含み、その各々の
記憶位置は8ビットの幅である。これらのガンマ訂正ル
ックアップテーブルはたとえば個体メモリのようないず
れかの適当なメモリ手段を使用して実現され得る。ガン
マ訂正を達成するために利用されるべき情報は図示され
ない従来の手段によって外部源からユーザの要求にした
がってロードされる。動作において、色ビットマップか
らの入力および輝度ビットマップからの入力はディジタ
ル乗算器回路74、80および84の各々から出力を発
生する。乗算器74、80および84によって発生され
た積の6最下位ビットの切捨てが行なわれ、それによっ
てこれらの乗算器から8出力のみを与える。バス76は
乗算器回路74の出力を赤ガンマ訂正ルックアップテー
ブル122のアドレス入力に結合させ、赤ガンマ訂正ル
ックアップテーブル122内の256の記憶位置の1つ
を規定しかつ選択された記憶位置における情報はバス1
25を介してディジタルアナログ変換器77の入力に与
えられ、それは受取られたディジタル信号を出力端子7
8でアナログ信号に変換する。ディジタル乗算器80か
らの出力はバス81を介して緑ガンマ訂正ルックアップ
テーブル123のアドレス入力に与えられかつ選択され
た記憶位置における情報はバス126を介して緑ガンマ
訂正ルックアップテーブル123の出力からディジタル
アナログ変換器回路82の入力に与えられ、その回路は
受取られたディジタル信号をアナログ信号に変換し、そ
れは出力端子83で与えられる。同様に、ディジタル乗
算器84からの出力はバス86を介して青ガンマ訂正ル
ックアップテーブル124のアドレス入力に供給され、
かつ選択された記憶位置における情報はバス127を介
してディジタルアナログ変換器回路87の入力に伝送さ
れる。受取られたディジタル信号はアナログ電圧に変換
され、それは出力端子88で与えられる。色パレット回
路121は色の表示における色の輝度情報を利用するシ
ステムで使用されるとき特定的に有利である。
The seventh embodiment of the invention is shown in FIG. 9 and includes a color palette circuit 121. Color palette circuit 12
1, a number of circuit elements are color palette circuits 7
0 (shown in FIG. 5), and thus similar circuit components are designated by the same reference symbols used in FIG. In either situation, it is desirable to provide gamma correction in the color palette circuit to compensate for non-linearities in display brightness. In the color palette circuit 121, gamma correction is accomplished by including a gamma correction look-up table, one for each color component, such as a red gamma correction look-up table 122, a green gamma correction look-up table. 123 and a blue gamma correction lookup table 124. In this embodiment, each of the gamma correction look-up tables includes 256 individually addressable storage locations, each storage location being 8 bits wide. These gamma correction look-up tables may be implemented using any suitable memory means, such as solid state memory. The information to be used to achieve the gamma correction is loaded from an external source at the user's request by conventional means not shown. In operation, the input from the color bitmap and the input from the luminance bitmap produce outputs from each of the digital multiplier circuits 74, 80 and 84. A truncation of the 6 least significant bits of the product produced by the multipliers 74, 80 and 84 is performed, thereby providing only 8 outputs from these multipliers. Bus 76 couples the output of multiplier circuit 74 to the address input of red gamma correction look-up table 122 to define one of 256 memory locations in red gamma correction look-up table 122 and at the selected memory location. Information is bus 1
25 to the input of the digital-to-analog converter 77, which receives the received digital signal at the output terminal 7.
Convert to analog signal at 8. The output from the digital multiplier 80 is provided via bus 81 to the address input of the green gamma correction lookup table 123 and the information at the selected storage location is output from the output of the green gamma correction lookup table 123 via bus 126. Applied to the input of a digital-to-analog converter circuit 82, the circuit converts the received digital signal into an analog signal, which is provided at output terminal 83. Similarly, the output from digital multiplier 84 is provided via bus 86 to the address input of blue gamma correction lookup table 124,
And the information in the selected storage location is transmitted to the input of the digital-to-analog converter circuit 87 via the bus 127. The received digital signal is converted to an analog voltage, which is provided at output terminal 88. The color palette circuit 121 is particularly advantageous when used in a system that utilizes color intensity information in a color display.

【0022】この発明の第8の実施例は図10において
示され、かつ色パレット回路132を含む。色パレット
回路132は出力端子25、28および31でアナログ
信号を発生し、表示されるべきピクセルのための赤、緑
および青色成分をそれぞれに規定する。表示されるべき
ピクセルの色はビデオビットマップからバス17を介す
る入力から発生され、かつ多くの点において図2に示さ
れるこの発明の第1の実施例と同様に動作する。対応す
る図2および図10における回路の構成要素は対応する
参照記号によって示される。色パレット回路132は、
赤、緑および青色成分にガンマ訂正を与えることによっ
て図2に示される色パレット回路16に改良された色演
出(rendition )を与える。さらに特定的には、ガンマ
訂正ルックアップテーブル133はディジタル加算器2
0とディジタルアナログ変換器24との間に介在され
る。ディジタル加算器20からのバス23はガンマ訂正
ルックアップテーブル133にアドレス入力を与えかつ
アドレス指定された記憶位置に含まれる情報はバス13
4を介してディジタルアナログ変換器24に与えられ
る。表示されるべきピクセルの緑の成分に対する色訂正
を与えるために、ガンマ訂正ルックアップテーブル13
5はそのアドレス入力がバス27に接続されかつガンマ
訂正ルックアップテーブル135における選択された記
憶位置における情報はバス136を介してディジタルア
ナログ変換器26の入力に与えられる。最後に、ガンマ
訂正ルックアップテーブル137はそのアドレス入力で
バス29を介して、選択された記憶位置のためにアドレ
スを受け取り、かつ選択された記憶位置に含まれる情報
をバス138を介してディジタルアナログ変換器30に
与える。色パレット回路132は色パレット回路16に
関して付加的なレベルの複雑化(sophistication)を与
え、それは色パレット回路132を使用することによっ
て、表示装置に与えられるアナログ駆動信号の機能とし
て表示装置の明度の非線形性を補償することが可能にな
るからである。
An eighth embodiment of the invention is shown in FIG. 10 and includes a color palette circuit 132. Color palette circuit 132 produces analog signals at outputs 25, 28 and 31 to respectively define the red, green and blue components for the pixel to be displayed. The color of the pixel to be displayed is generated from the input via bus 17 from the video bitmap and in many respects operates similarly to the first embodiment of the invention shown in FIG. Corresponding circuit components in FIGS. 2 and 10 are indicated by corresponding reference symbols. The color palette circuit 132
Gamma correction is applied to the red, green and blue components to provide improved color rendition to the color palette circuit 16 shown in FIG. More specifically, the gamma correction look-up table 133 is used by the digital adder 2
It is interposed between 0 and the digital-analog converter 24. The bus 23 from the digital adder 20 provides an address input to the gamma correction look-up table 133 and the information contained in the addressed storage location is the bus 13
4 to the digital-analog converter 24. A gamma correction look-up table 13 is provided to provide color correction for the green component of the pixel to be displayed.
5 has its address input connected to bus 27 and the information at the selected storage location in gamma correction lookup table 135 is provided to the input of digital to analog converter 26 via bus 136. Finally, the gamma correction look-up table 137 receives at its address input via bus 29 the address for the selected storage location and the information contained in the selected storage location via the digital analog via bus 138. It is given to the converter 30. The color palette circuit 132 provides an additional level of sophistication with respect to the color palette circuit 16, which, by using the color palette circuit 132, determines the brightness of the display device as a function of the analog drive signals provided to the display device. This is because it becomes possible to compensate for the non-linearity.

【0023】図11に示さる色パレット回路142はこ
の発明の第9の実施例を示す。表示されるべきピクセル
の赤、緑および青の色の成分は色ルックアップテーブル
71、輝度ルックアップテーブル92、組合せ回路7
4、80および84を使用して発生され、それらはこの
実施例において、ディジタル乗算器回路であり、そこで
は赤、緑および青ガンマ訂正が赤ガンマ訂正ルックアッ
プテーブル143、緑ガンマ訂正ルックアップテーブル
144および青ガンマ訂正ルックアップテーブル145
をそれぞれに使用することによって達成される。表示さ
れるべきピクセルのためにバス76上に現われるディジ
タル情報は赤ガンマ訂正ルックアップテーブル143の
アドレス入力に結合され、かつアドレス指定された記憶
位置における情報はバス146を介してディジタルアナ
ログ変換器77に転送される。緑ガンマ訂正を達成する
ために、バス81上のディジタル信号は緑ガンマ訂正ル
ックアップテーブル144のアドレス入力に与えられ、
かつ選択された記憶位置から結果として生じる出力はバ
ス147を介してディジタルアナログ変換器82に与え
られる。青ガンマ訂正ルックアップテーブル145にス
トアされた青ガンマ訂正情報はバス148を介してディ
ジタルアナログ変換器87に与えられ、転送された情報
は青ガンマ訂正ルックアップテーブル145における記
憶位置に含まれる情報であり、それはバス86を介して
青ガンマ訂正ルックアップテーブル145のアドレス入
力に結合されたディジタル情報に基づいてアドレス指定
される。色パレット回路91を色パレット回路142と
比較することによって、多数の回路エレメントが共通で
あり、したがってそれらは同じ参照記号によって同一化
されるということが理解されるであろう。色パレット回
路142において利用されるガンマ訂正ルックアップテ
ーブルはたとえば個体メモリのようないずれかの適当な
メモリ手段から構成され得る。ガンマ訂正ルックアップ
テーブルの各々内の記憶位置にストアされるべき情報は
色パレット回路142が利用されるであろうシステムに
おける他のパラメータによって決定される。色パレット
回路142はビットマップにおけるピクセルの表示にお
いてより大きな適応性を与える。
The color palette circuit 142 shown in FIG. 11 represents the ninth embodiment of the present invention. The red, green and blue color components of the pixel to be displayed are the color look-up table 71, the luminance look-up table 92, the combinational circuit 7
4, 80 and 84, which are digital multiplier circuits in this embodiment, where the red, green and blue gamma corrections are the red gamma correction look-up table 143, the green gamma correction look-up table. 144 and blue gamma correction lookup table 145
This is achieved by using The digital information appearing on bus 76 for the pixel to be displayed is coupled to the address input of red gamma correction look-up table 143, and the information at the addressed storage location is transferred via bus 146 to digital to analog converter 77. Transferred to. To achieve green gamma correction, the digital signal on bus 81 is provided to the address input of green gamma correction look-up table 144,
And the resulting output from the selected storage location is provided to digital-to-analog converter 82 via bus 147. The blue gamma correction information stored in the blue gamma correction look-up table 145 is given to the digital-analog converter 87 via the bus 148, and the transferred information is the information contained in the storage position in the blue gamma correction look-up table 145. Yes, it is addressed based on digital information coupled to the address input of the blue gamma correction look-up table 145 via bus 86. By comparing the color palette circuit 91 with the color palette circuit 142, it will be understood that many circuit elements are common and therefore they are identified by the same reference symbols. The gamma correction look-up table utilized in color palette circuit 142 may be comprised of any suitable memory means, such as a solid state memory. The information to be stored in storage locations within each of the gamma correction look-up tables is determined by other parameters in the system in which the color palette circuit 142 will be utilized. The color palette circuit 142 provides greater flexibility in the display of pixels in the bitmap.

【0024】上記はこの発明を行なうためのいくつかの
実施例の説明である。この発明が上の説明に制限され
ず、前掲の特許請求の範囲によってのみ制限されること
はもちろん理解される。
The above is a description of several embodiments for carrying out the invention. It is of course understood that the invention is not limited to the above description, but only by the claims which follow.

【図面の簡単な説明】[Brief description of drawings]

【図1】典型的な先行技術の色パレット回路を示すブロ
ック図である。
FIG. 1 is a block diagram illustrating a typical prior art color palette circuit.

【図2】この発明の第1の実施例を示す図である。FIG. 2 is a diagram showing a first embodiment of the present invention.

【図3】第1および第2のメモリが表示可能な色の合計
の数を増加させるために利用される一般的な場合を数学
的に示す図である。
FIG. 3 mathematically illustrates the general case where the first and second memories are used to increase the total number of colors that can be displayed.

【図4】表示可能な色が色ビットマップからの入力およ
び飽和ビットマップからの情報を使用して発生され、そ
こでは組合せ手段が加算器であるこの発明の第2の実施
例を示す図である。
FIG. 4 is a diagram showing a second embodiment of the present invention in which a displayable color is generated using input from a color bitmap and information from a saturation bitmap, where the combining means is an adder. is there.

【図5】表示された色が色ビットマップおよび輝度ビッ
トマップからの入力を使用して発生され、そこでは組合
せ手段が乗算器であるこの発明の第3の実施例を示す図
である。
FIG. 5 shows a third embodiment of the invention in which the displayed colors are generated using inputs from a color bitmap and an intensity bitmap, where the combining means is a multiplier.

【図6】色ルックアップテーブルおよび輝度ルックアッ
プテーブルからの情報が表示されるべき色を発生するた
めにディジタルで組合されるこの発明の第4の実施例を
示す図である。
FIG. 6 shows a fourth embodiment of the invention in which information from a color look-up table and a luminance look-up table is digitally combined to generate the color to be displayed.

【図7】表示されるべき色が出力ディジタルアナログ変
換器において、(乗法で)色ルックアップテーブルから
の情報と輝度ビットマップから受取られたディジタル情
報から変換されたアナログ情報とを類推的に組合せるこ
とによって決定されるこの発明の第5の実施例を示す図
である。
FIG. 7: The colors to be displayed at the output digital-to-analog converter analogically combine (multiplicatively) the information from the color look-up table and the analog information converted from the digital information received from the luminance bitmap. It is a figure which shows the 5th Example of this invention determined by this.

【図8】表示されるべき色が色ルックアップテーブルか
らの色情報および輝度ルックアップテーブルからの輝度
情報のアナログ乗法によって発生されるこの発明の第6
の実施例を示す図である。
FIG. 8 is a sixth aspect of the invention in which the color to be displayed is generated by analog multiplication of the color information from the color look-up table and the luminance information from the luminance look-up table.
It is a figure which shows the Example of.

【図9】ガンマ訂正ルックアップテーブルが色ルックア
ップテーブルからの色情報および輝度ビットマップから
の輝度情報(乗算器が色情報と輝度情報とを組合せるた
めに使用され)と共に利用され、表示されるべき色を発
生するこの発明の第7の実施例を示す図である。
FIG. 9 is a gamma correction look-up table utilized and displayed with color information from a color look-up table and luma information from a luma bitmap (a multiplier is used to combine the chroma and luma information). It is a figure which shows the 7th Example of this invention which produces | generates the color which should be.

【図10】ガンマ訂正が第1および第2の色ルックアッ
プテーブルからの組合された出力(ここで組合せは加算
器回路の使用によって達成される)と共に与えられ、表
示されるべき色を発生するこの発明の第8の実施例を示
す図である。
FIG. 10: Gamma correction is provided with combined output from the first and second color look-up tables (where the combination is accomplished by use of an adder circuit) to produce the color to be displayed. It is a figure which shows the 8th Example of this invention.

【図11】ガンマ訂正が色ルックアップテーブルおよび
輝度ルックアップテーブルからの組合された情報(ここ
で組合せは乗算器回路を使用することによって達成され
る)を利用するシステムとともに与えられ、表示される
べき色を発生するこの発明の第9の実施例を示す図であ
る。
FIG. 11: Gamma correction is provided and displayed with a system utilizing combined information from a color look-up table and an intensity look-up table, where the combination is achieved by using a multiplier circuit. It is a figure which shows the 9th Example of this invention which produces a power color.

【符号の説明】[Explanation of symbols]

16 色パレット回路 17 バス 18 色ルックアップテーブル 19 色ルックアップテーブル 24 ディジタルアナログ変換器 26 ディジタルアナログ変換器 54 赤加算器 56 緑加算器 58 青加算器 16-color palette circuit 17-bus 18-color look-up table 19-color look-up table 24 Digital-analog converter 26 Digital-analog converter 54 Red adder 56 Green adder 58 Blue adder

───────────────────────────────────────────────────── フロントページの続き (72)発明者 ロイ・ジェイ・レビ アメリカ合衆国、97520 オレゴン州、ア シュランド、シスキユー・ブールバード、 514 ─────────────────────────────────────────────────── ─── Continuation of the front page (72) Inventor Roy Jay Levi United States, 97520 Siskiyou Boulevard, Ashland, Oregon, 514

Claims (15)

【特許請求の範囲】[Claims] 【請求項1】 ビデオビットマップからディジタル情報
を受取りかつ他の手段によって色ピクセルを作り出すた
めの使用のために前記ディジタル情報をnの構成要素を
有するアナログ情報へと変換するための色パレット回路
であって、前記回路は、 複数個の記憶位置を有しディジタル情報をストアするた
めの第1のメモリ手段を含み、前記第1のメモリ手段は
前記ビデオビットマップからディジタル情報を受取るた
めのアドレス入力を有しかつ回路手段を含み、それは前
記アドレス入力に結合され前記ビデオビットマップから
のディジタル情報の受信に応答して記憶位置を選択し、
前記第1のメモリ手段は選択されたアドレスにおいてス
トアされたディジタル情報のn部分を与えるためのn出
力端子と、選択されたアドレスにおける前記ディジタル
情報の前記n部分を前記n出力端子のそれぞれのものに
結合する手段とを有し、 複数個の記憶位置を有しディジタル情報をストアするた
めの第2のメモリ手段を含み、前記第2のメモリ手段は
前記ビデオビットマップからディジタル情報を受取るた
めのアドレス入力を有しかつ回路手段を含み、それは前
記アドレス入力に結合され、前記ビデオビットマップか
らのディジタル情報の受信に応答して記憶位置を選択
し、前記第2のメモリ手段は選択されたアドレスからの
ディジタル情報のn部分を与えるためのn出力端子と、
選択されたアドレスにおける前記ディジタル情報の前記
n部分を前記n出力端子のそれぞれのものに結合する手
段とを有し、 nディジタル組合せ回路をさらに含み、その各々は第1
および第2の入力端子ならびに出力端子を有し、前記n
ディジタル組合せ回路の各々は回路手段を含み、それは
前記第1および第2の入力端子での信号の受信に応答し
て前記出力端子で信号を発生しかつ与え、それは前記第
1および第2の入力端子で受けとられる信号の組合せの
結果であり、 前記nディジタル組合せ回路の各々の前記第1の入力端
子を前記第1のメモリ手段の出力端子に結合する手段
と、 前記ディジタル組合せ回路手段の各々の前記第2の入力
端子を前記第2のメモリ手段の出力端子に結合する手段
と、 nディジタルアナログ変換回路とを含み、各々は前記n
ディジタル組合せ回路の相関のものから信号を受信する
ための入力端子とディジタル信号の受信に応答してアナ
ログ信号を与えるための出力端子とを有し、さらに、 前記ディジタルアナログ変換回路の各々の入力端子をそ
の相関のディジタル組合せ回路の出力端子に結合するた
めの手段を含む色パレット回路。
1. A color palette circuit for receiving digital information from a video bitmap and converting said digital information into analog information having n components for use by other means to produce color pixels. Wherein the circuit includes a first memory means having a plurality of storage locations for storing digital information, the first memory means including an address input for receiving digital information from the video bitmap. And including circuit means for selecting a storage location in response to receiving digital information from the video bit map coupled to the address input,
The first memory means has an n output terminal for providing an n portion of digital information stored at a selected address, and an n output terminal for supplying the n portion of the digital information at a selected address. A second memory means having a plurality of storage locations for storing digital information, the second memory means for receiving digital information from the video bitmap. An address input is included and includes circuit means coupled to the address input for selecting a storage location in response to receiving digital information from the video bit map, the second memory means for selecting the selected address. N output terminals for providing the n part of the digital information from
Means for coupling the n portion of the digital information at a selected address to each one of the n output terminals, and further comprising an n digital combination circuit, each of which comprises a first
And a second input terminal and an output terminal, wherein n
Each of the digital combinational circuits includes circuit means for generating and providing a signal at said output terminal in response to receiving a signal at said first and second input terminals, said first and second inputs. Means for coupling the first input terminal of each of the n digital combination circuits to an output terminal of the first memory means, which is the result of a combination of signals received at the terminals; and each of the digital combination circuit means. Means for coupling said second input terminal to an output terminal of said second memory means, and n digital-to-analog conversion circuit, each of said n
It has an input terminal for receiving a signal from the correlation circuit of the digital combination circuit and an output terminal for giving an analog signal in response to the reception of the digital signal, and further, each input terminal of the digital-analog conversion circuit. A color palette circuit including means for coupling the output to the output of the correlating digital combinational circuit.
【請求項2】 前記ディジタル組合せ回路が加算器回路
である、請求項1に記載の色パレット回路。
2. The color palette circuit of claim 1, wherein the digital combination circuit is an adder circuit.
【請求項3】 前記ディジタル組合せ回路が乗算器回路
である、請求項1に記載の色パレット回路。
3. The color palette circuit according to claim 1, wherein the digital combination circuit is a multiplier circuit.
【請求項4】 前記ディジタルアナログ変換回路の入力
端子をその相関のディジタル組合せ回路の出力に結合さ
せる前記手段がガンマ訂正を与えるための回路手段を含
む、請求項1ないし3のいずれかに記載の色パレット回
路。
4. The method according to claim 1, wherein said means for coupling the input terminal of said digital-to-analog conversion circuit to the output of its correlated digital combination circuit comprises circuit means for providing gamma correction. Color palette circuit.
【請求項5】 色ビットマップからディジタル情報を受
取るための第1の入力端子と、飽和ビットマップからデ
ィジタル情報を受取るための第2の入力端子とを有し、
それらに応答して他の手段によって色ピクセルを発生す
るための使用のためにn構成要素を有するアナログ情報
を発生する色パレット回路であって、前記回路は、 表示可能な色を示すディジタル情報をストアするための
複数個の記憶位置を有するメモリ手段を含み、前記メモ
リ手段は前記第1の入力端子に結合され前記色ビットマ
ップからディジタル情報を受信するためのアドレス入力
を有しかつ回路手段を含み、それは前記アドレス入力に
結合され前記色ビットマップからのディジタル情報の受
信に応答して記憶位置を選択し、前記メモリ手段は選択
されたアドレスにおいてストアされたディジタル情報の
n部分を与えるためのn出力端子と、選択されたアドレ
スにおける前記ディジタル情報の前記n部分を前記n出
力端子のそれぞれのものへと結合する手段とを有し、 nディジタル組合せ回路を含み、その各々は第1および
第2の入力端子ならびに出力端子を有し、前記nディジ
タル組合せ回路の各々は回路手段を含み、それは前記第
1および第2の入力端子での信号の受信に応答して前記
出力端子で信号を発生しかつ与え、それは前記第1およ
び第2の入力端子で受信された信号の組合せの結果であ
り、 前記ディジタル組合せ回路の各々の第1の入力端子を前
記メモリ手段の前記n出力端子の相関のものに結合する
手段と、 前記色パレット回路の前記第2の入力端子を前記nディ
ジタル組合せ回路の各々の前記第2の入力端子に結合す
る手段と、 nディジタルアナログ変換回路とを含み、各々は前記デ
ィジタル組合せ回路の相関のものから信号を受信するた
めの入力端子とディジタル信号の受信に応答してアナロ
グ信号を与えるための出力端子とを有し、 各々のディジタルアナログ変換回路の入力端子をその相
関のディジタル組合せ回路の出力端子に結合するための
手段をさらに含む色パレット回路。
5. A first input terminal for receiving digital information from the color bitmap and a second input terminal for receiving digital information from the saturation bitmap,
A color palette circuit responsive thereto to generate analog information having n components for use by other means to generate color pixels, said circuit providing digital information indicative of a displayable color. Memory means having a plurality of storage locations for storing, said memory means having an address input coupled to said first input terminal for receiving digital information from said color bit map and circuit means. For selecting a storage location in response to receiving digital information from the color bitmap coupled to the address input, the memory means for providing an n portion of digital information stored at the selected address. an n output terminal and the n portion of the digital information at the selected address for each of the n output terminals. And n means for combining digital circuits, each of which has a first and a second input terminal and an output terminal, each of said n digital combination circuits including circuit means, Generating and providing a signal at the output terminal in response to receiving a signal at the first and second input terminals, which is the result of a combination of signals received at the first and second input terminals. Means for coupling the first input terminal of each of said digital combinational circuits to the correlation of said n output terminals of said memory means, and said second input terminal of said color palette circuit for said n digital combinational circuit. Means for coupling to each of said second input terminals; and n digital-to-analog conversion circuits, each for inputting a signal from a correlator of said digital combinational circuits An output terminal for providing an analog signal in response to receiving a digital signal, the color further comprising means for coupling the input terminal of each digital-to-analog conversion circuit to the output terminal of its associated digital combinational circuit. Pallet circuit.
【請求項6】 前記ディジタル組合せ回路が加算器回路
である、請求項5に記載の色パレット回路。
6. The color palette circuit according to claim 5, wherein the digital combination circuit is an adder circuit.
【請求項7】 各々のディジタルアナログ変換回路の入
力端子をその相関のディジタル組合せ回路の出力端子に
結合させる前記手段がガンマ訂正を与えるための回路手
段を含む、請求項5または6のいずれかに記載の色パレ
ット回路。
7. A method according to claim 5, wherein said means for coupling the input terminal of each digital-to-analog conversion circuit to the output terminal of its correlated digital combination circuit comprises circuit means for providing gamma correction. The described color palette circuit.
【請求項8】 色ビットマップからディジタル情報を受
取るための第1の入力端子と、輝度ビットマップからデ
ィジタル情報を受取るための第2の入力端子とを有し、
それに応答して他の手段で色ピクセルを発生するための
使用のためのn構成要素を有するアナログ情報を発生す
る色パレット回路であって、前記回路は、 表示可能な色を示すディジタル情報をストアするための
複数個の記憶位置を有するメモリ手段を含み、前記メモ
リ手段は前記第1の入力端子に結合され前記色ビットマ
ップからディジタル情報を受取るためのアドレス入力を
有し、かつ回路手段を含み、それは前記アドレス入力に
結合され、それは前記色ビットマップからのディジタル
情報の受信に応答して、記憶位置を選択し、前記メモリ
手段は選択されたアドレスにおいてストアされたディジ
タル情報のn部分を与えるためのn出力端子と、選択さ
れたアドレスにおける前記ディジタル情報の前記n部分
を前記n出力端子のそれぞれのものに結合させる手段と
を有し、 nディジタル組合せ回路をさらに含み、各々は第1およ
び第2の入力端子ならびに出力端子を有し、前記nディ
ジタル組合せ回路の各々は回路手段を含み、それは前記
第1および第2の入力端子での信号の受信に応答して前
記出力端子で信号を発生しかつ与え、それは前記第1お
よび第2の入力端子で受信された信号の組合せの結果で
あり、 前記ディジタル組合せ回路の各々の第1の入力端子を前
記メモリ手段の前記n出力端子の相関のものに結合させ
る手段と、 前記色パレット回路の前記第2の入力端子を前記nディ
ジタル組合せ回路の各々の前記第2の入力端子に結合さ
せる手段と、 nディジタルアナログ変換回路とを含み、各々は前記デ
ィジタル組合せ回路の相関のものから信号を受取るため
の入力端子と、ディジタル信号の受信に応答してアナロ
グ信号を与えるための出力端子とを有し、 ディジタルアナログ変換回路の各々の入力端子をその相
関のディジタル組合せ回路の出力端子に結合させる手段
をさらに含む色パレット回路。
8. A first input terminal for receiving digital information from a color bitmap and a second input terminal for receiving digital information from a luminance bitmap,
A color palette circuit responsive thereto for generating analog information having n components for use by other means to generate color pixels, said circuit storing digital information indicative of a displayable color. A memory means having a plurality of storage locations for storing the data, the memory means having an address input coupled to the first input terminal for receiving digital information from the color bitmap and including circuit means. , Which is coupled to the address input, which in response to receiving digital information from the color bitmap, selects a storage location, the memory means providing the n portion of the digital information stored at the selected address. And n output terminals for each of the n output terminals of the digital information at the selected address. Means for coupling to said ones, further comprising n digital combinational circuits, each having first and second input terminals and an output terminal, each of said n digital combinational circuits including circuit means, said Generating and providing a signal at the output terminal in response to receiving a signal at the first and second input terminals, which is a result of the combination of signals received at the first and second input terminals; Means for coupling the first input terminal of each of said digital combinational circuits to the correlating one of said n output terminals of said memory means, and said second input terminal of said color palette circuit for each of said n digital combinational circuits. Means for coupling to the second input terminal of the digital input circuit, and an n digital-to-analog conversion circuit, each input for receiving a signal from the correlation of the digital combinational circuit. A terminal and an output terminal for providing an analog signal in response to the reception of the digital signal, further comprising means for coupling each input terminal of the digital-to-analog conversion circuit to the output terminal of its correlated digital combination circuit. Color palette circuit.
【請求項9】 前記ディジタル組合せ回路が乗算器回路
である、請求項8に記載の色パレット回路。
9. The color palette circuit according to claim 8, wherein the digital combination circuit is a multiplier circuit.
【請求項10】 ディジタルアナログ変換回路の各々の
入力端子をその相関の組合せ回路の出力端子に結合させ
る前記手段がガンマ訂正を与えるための回路手段を含
む、請求項8ないし9のいずれかに記載の回路。
10. A method according to claim 8, wherein the means for coupling each input terminal of the digital-to-analog conversion circuit to the output terminal of its correlating combinational circuit comprises circuit means for providing gamma correction. Circuit.
【請求項11】 色ビットマップからディジタル情報を
受取るための第1の入力端子と輝度ビットマップからデ
ィジタル情報を受取るための第2の入力端子とを有し、
他の手段によって色ピクセルを作り出すための使用のた
めに前記ディジタル情報をn構成要素を有するアナログ
情報に変換する色パレット回路であって、前記回路は、 ディジタル情報をストアするための複数個の記憶位置を
有する第1のメモリ手段を含み、前記第1のメモリ手段
は前記第1の入力端子に結合され前記色ビットマップか
らディジタル情報を受取るためのアドレス入力を有しか
つ回路手段を含み、それは前記アドレス入力に結合さ
れ、それは前記色ビットマップからのディジタル情報の
受信に応答して記憶位置を選択し、前記第1のメモリ手
段は選択されたアドレスにおいてストアされたディジタ
ル情報のn部分を与えるためのn出力端子と、選択され
たアドレスにおける前記ディジタル情報の前記n部分を
前記n出力端子のそれぞれのものへと結合させる手段と
を有し、 複数個の記憶位置を有しディジタル情報をストアするた
めの第2のメモリ手段を含み、前記第2のメモリ手段は
前記第2の入力端子に結合され前記輝度ビットマップか
らディジタル情報を受取るためのアドレス入力を有しか
つ回路手段を含み、それは前記アドレス入力に結合さ
れ、それは前記輝度ビットマップからのディジタル情報
の受信に応答して記憶位置を選択し、前記第2のメモリ
手段は選択されたアドレスからのディジタル情報を与え
るための出力端子と、選択されたアドレスにおける前記
ディジタル情報を前記出力端子に結合させるための手段
とを有し、 nディジタル組合せ回路をさらに含み、各々は第1およ
び第2の入力端子ならびに出力端子を有し、前記nディ
ジタル組合せ回路の各々は回路手段を含み、それは前記
第1および第2の入力端子での信号の受信に応答して前
記出力端子で信号を発生しかつ与え、それは前記第1お
よび第2の入力端子で受信された信号の組合せの結果で
あり、 前記nディジタル組合せ回路の各々の前記第1の入力端
子を前記第1のメモリ手段の出力端子に結合させる手段
と、 前記ディジタル組合せ回路手段の各々の前記第2の入力
端子を前記第2のメモリ手段の前記出力端子に結合させ
る手段と、 nディジタルアナログ変換回路とを含み、各々は前記n
ディジタル組合せ回路の相関のものから信号を受取るた
めの入力端子とディジタル信号の受信に応答してアナロ
グ信号を与えるための出力端子とを有し、 前記ディジタルアナログ変換回路の各々の入力端子をそ
の相関のディジタル組合せ回路の出力端子に結合させる
手段をさらに含む色パレット回路。
11. A first input terminal for receiving digital information from a color bitmap and a second input terminal for receiving digital information from a luminance bitmap,
A color palette circuit for converting the digital information into analog information having n components for use to create color pixels by other means, the circuit comprising a plurality of stores for storing the digital information. A first memory means having a location, said first memory means having an address input coupled to said first input terminal for receiving digital information from said color bitmap and including circuit means, Coupled to the address input, which selects a storage location in response to receiving digital information from the color bitmap, the first memory means providing n portions of digital information stored at a selected address. And an n output terminal for transmitting the n portion of the digital information at the selected address to the n output terminal. A second memory means having a plurality of storage locations for storing digital information, the second memory means having a plurality of storage locations, and a second memory means for storing digital information. Comprising an address input coupled to a terminal for receiving digital information from the intensity bitmap and including circuit means, coupled to the address input for storing in response to receiving digital information from the intensity bitmap. Selecting a location, the second memory means has an output terminal for providing digital information from a selected address, and means for coupling the digital information at the selected address to the output terminal. , N digital combination circuits, each having first and second input terminals and an output terminal, said n digital combination circuits Each includes circuit means for generating and providing a signal at said output terminal in response to receiving a signal at said first and second input terminals, which is received at said first and second input terminals. Means for coupling the first input terminal of each of the n digital combinational circuits to the output terminal of the first memory means, and the second of each of the digital combinational circuit means. Means for coupling the input terminal of the second memory means to the output terminal of the second memory means;
An input terminal for receiving a signal from the correlating one of the digital combinational circuits and an output terminal for providing an analog signal in response to the reception of the digital signal, each input terminal of said digital-to-analog converting circuit having its correlation Color palette circuit further comprising means for coupling to an output terminal of the digital combination circuit of.
【請求項12】 前記ディジタル組合せ回路が乗算器回
路である、請求項11に記載の色パレット回路。
12. The color palette circuit of claim 11, wherein the digital combination circuit is a multiplier circuit.
【請求項13】 前記ディジタルアナログ変換回路の入
力端子をその相関のディジタル組合せ回路の出力に結合
させる前記手段がガンマ訂正を与えるための回路手段を
含む、請求項11ないし12のいずれかに記載の色パレ
ット回路。
13. A method according to claim 11, wherein the means for coupling the input terminal of the digital-to-analog conversion circuit to the output of its correlated digital combination circuit comprises circuit means for providing gamma correction. Color palette circuit.
【請求項14】 色ビットマップからディジタル情報を
受取るための第1の入力端子と、輝度ビットマップから
ディジタル情報を受取るための第2の入力端子とを有
し、それに応答して他の手段で色ピクセルを発生するた
めの使用のためのn構成要素を有するアナログ情報を発
生する色パレット回路であって、前記回路は、 複数個の記憶位置を有し表示可能な色を示すディジタル
情報をストアするためのメモリ手段を含み、前記メモリ
手段は前記第1の入力端子に結合され前記色ビットマッ
プからディジタル情報を受取るためのアドレス入力を有
しかつ回路手段を含み、それは前記アドレス入力に結合
され、それは前記色ビットマップからのディジタル情報
の受信に応答して記憶位置を選択し、前記メモリ手段は
選択されたアドレスにストアされたディジタル情報の部
分を与えるためのn出力端子と選択されたアドレスにお
ける前記ディジタル情報の前記n部分を前記n出力端子
のそれぞれのものに結合させる手段とを有し、 nディジタルアナログ変換および組合せ回路を含み、各
々は第1および第2の入力端子ならびに出力端子を有
し、前記nディジタルアナログ変換および組合せ回路の
各々は回路手段を含み、それは前記第1および第2の入
力端子での信号の受信に応答して前記出力端子でアナロ
グ信号を発生しかつ与え、それは前記第1および第2の
入力端子で受信された信号の組合せの結果であり、 前記ディジタルアナログ変換および組合せ回路の各々の
第1の入力端子を前記メモリ手段の前記n出力端子の相
関のものに結合させる手段と、 入力端子および出力端子を有するディジタルアナログ変
換回路と、 前記色パレット回路の前記第2の入力端子を前記ディジ
タルアナログ変換回路の前記入力端子に結合させる手段
と、 前記ディジタルアナログ変換回路の前記出力端子を前記
nディジタルアナログ変換および組合せ回路の各々の前
記第2の入力端子に結合させるための手段とを含む色パ
レット回路。
14. A first input terminal for receiving digital information from a color bitmap and a second input terminal for receiving digital information from a luminance bitmap, responsive to other means. A color palette circuit for generating analog information having n components for use to generate color pixels, said circuit having a plurality of storage locations for storing digital information indicative of a displayable color. Memory means for activating, said memory means having an address input coupled to said first input terminal for receiving digital information from said color bitmap and including circuit means, which is coupled to said address input. , It selects a storage location in response to receiving digital information from the color bitmap, and the memory means stores at a selected address. An n output terminal for providing a portion of the digital information and means for coupling the n portion of the digital information at a selected address to each of the n output terminals, n digital-to-analog conversion and combination A circuit, each having first and second input terminals and an output terminal, each of said n digital-to-analog conversion and combination circuits including circuit means, which is a signal at said first and second input terminals. In response to the reception of an analog signal at the output terminal and which is a result of the combination of the signals received at the first and second input terminals, each of the digital-to-analog conversion and combinational circuits. Means for coupling a first input terminal to a correlation of the n output terminals of the memory means, and an input terminal and an output terminal A digital-analog conversion circuit, means for coupling the second input terminal of the color palette circuit to the input terminal of the digital-analog conversion circuit, and the output terminal of the digital-analog conversion circuit for the n-digital-analog conversion, Means for coupling to the second input terminal of each of the combinational circuits.
【請求項15】 前記色パレット回路の前記第2の入力
端子を前記ディジタルアナログ変換回路の前記入力端子
に結合させるための前記手段が複数個のデータ記憶位置
を有し色輝度情報をストアするためのメモリ手段を含
む、請求項14に記載の色パレット回路。
15. The means for coupling the second input terminal of the color palette circuit to the input terminal of the digital-to-analog conversion circuit has a plurality of data storage locations for storing color luminance information. 15. The color palette circuit of claim 14 including the memory means of.
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