JPH0480131U - - Google Patents

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JPH0480131U
JPH0480131U JP12339090U JP12339090U JPH0480131U JP H0480131 U JPH0480131 U JP H0480131U JP 12339090 U JP12339090 U JP 12339090U JP 12339090 U JP12339090 U JP 12339090U JP H0480131 U JPH0480131 U JP H0480131U
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JP
Japan
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circuits
input circuit
latch circuits
filter
filter circuits
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JP12339090U
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Description

【図面の簡単な説明】
第１図はこの考案の一実施例を示す入力回路の
回路図、第２図は第１図の入力回路のタイミング
チヤート、第３図は従来の入力回路の回路図、第
４図は第３図の入力回路のタイミングチヤートで
ある。 図において、１ａ，２ａ，３ａ，１ｃ，２ｃ，
３ｃはクロツクドインバータ、１ｂ，２ｂ，３ｂ
はインバータ、４はＮＡＮＤ回路を示す。なお、
図中、同一符号は同一、または相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. クロツク信号の異なる複数のラツチ回路とフイ
    ルタ回路を備え、このラツチ回路とフイルタ回路
    によつてノイズを除去することを特徴とする入力
    回路。
JP12339090U 1990-11-22 1990-11-22 Pending JPH0480131U (ja)

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JP12339090U JPH0480131U (ja) 1990-11-22 1990-11-22

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JPH0480131U true JPH0480131U (ja) 1992-07-13

Family

ID=31871100

Family Applications (1)

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JP12339090U Pending JPH0480131U (ja) 1990-11-22 1990-11-22

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JP (1) JPH0480131U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2015142192A (ja) * 2014-01-28 2015-08-03 公立大学法人首都大学東京 マスタースレーブ型のフリップフロップ装置

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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