JPH0461416A - High temperature leakage compensation circuit for transistor circuit - Google Patents

High temperature leakage compensation circuit for transistor circuit

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JPH0461416A
JPH0461416A JP17143190A JP17143190A JPH0461416A JP H0461416 A JPH0461416 A JP H0461416A JP 17143190 A JP17143190 A JP 17143190A JP 17143190 A JP17143190 A JP 17143190A JP H0461416 A JPH0461416 A JP H0461416A
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JP
Japan
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transistor
circuit
current
lateral pnp
collector
Prior art date
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JP17143190A
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Japanese (ja)
Inventor
Minoru Nagata
稔 永田
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Toshiba Corp
Original Assignee
Toshiba Corp
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Publication of JPH0461416A publication Critical patent/JPH0461416A/en
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Abstract

PURPOSE:To execute high temperature leakage compensation of a lateral PNP transistor(TR) with a small circuit scale by connecting an emitter of a 2nd lateral PNP TR whose base is opened to a collector of a 1st lateral PNP TR. CONSTITUTION:A base of a 1st lateral PNP TR Q1 whose emitter is connected to a power supply Vcc is connected to an input terminal IN. A collector of the TR Q1 is connected to an output terminal OUT and also connected to an emitter of a 2nd lateral PNP TR Q2 whose collector is connected to ground. A base of the TR Q2 is opened. Thus, the effect of a leakage current of the lateral PNP TR is cancelled with a simple circuit and the high temperature leakage compensation circuit for a TR circuit suitable for integrated circuit is obtained.

Description

【発明の詳細な説明】 [発明の目的] (産業上の利用分野) この発明は、高温時におけるトランジスタのリーク電流
を補償するトランジスタ回路の高温リーク補償回路に関
する。
DETAILED DESCRIPTION OF THE INVENTION [Object of the Invention] (Industrial Application Field) The present invention relates to a high temperature leak compensation circuit for a transistor circuit that compensates for leak current of a transistor at high temperatures.

(従来の技術) 第3図は、特開平1−155712号公報に記載された
従来の高温リーク補償回路を示すものである。
(Prior Art) FIG. 3 shows a conventional high temperature leak compensation circuit described in Japanese Patent Laid-Open No. 1-155712.

第3図において、トランジスタQ1は出力用に使用して
いるPNPトランジスタである。トランジスタQ2は高
温リーク電流がトランジスタQ1の l/nであるPN
P トランジスタである。トランジスタQ+、Q2は共
にN型エピタキシャル層をベースとし、このエピタキシ
ャル層にP型の拡散層を形成してこれをエミッタとコレ
クタとした、いわゆるラテラルPNP型トランジスタで
あり、トランジスタQ2の素子形成面積をトランジスタ
Q1の1/nとしている。トランジスタQ3、Q、およ
び抵抗R1、R2は、図示の通り電流ミラ−回路を構成
し、Q3は入力トランジスタ、Q4は出力トランジスタ
である。トランジスタQ3と電源VCC間にはQ2が直
列接続されている。さらに、トランジスタQ4コレクタ
にトランジスタQ1のコネクターが接続されるとともに
出力端子OUTに接続されている。なお、トランジスタ
Q2のベースは他に接続されないオープン状態である。
In FIG. 3, transistor Q1 is a PNP transistor used for output. Transistor Q2 is a PN whose high temperature leakage current is l/n of transistor Q1.
P transistor. Transistors Q+ and Q2 are both so-called lateral PNP transistors, which are based on an N-type epitaxial layer, with a P-type diffusion layer formed in this epitaxial layer and used as the emitter and collector. It is set to 1/n of the transistor Q1. Transistors Q3, Q and resistors R1, R2 constitute a current mirror circuit as shown, with Q3 being an input transistor and Q4 being an output transistor. Q2 is connected in series between transistor Q3 and power supply VCC. Furthermore, the connector of the transistor Q1 is connected to the collector of the transistor Q4, and is also connected to the output terminal OUT. Note that the base of the transistor Q2 is in an open state and is not connected to anything else.

抵抗R1とR2はR1: R2=n : 1の関係にあ
り、Q3のベース電流がQ3のベース電流のn倍となる
。すなわち、電流ミラー比は1:nである。
Resistors R1 and R2 have a relationship of R1:R2=n:1, and the base current of Q3 is n times the base current of Q3. That is, the current mirror ratio is 1:n.

ここで、トランジスタQ4のコレクタ電流を11、トラ
ンジスタQ1のコレクタ電流を12、トランジスタQ4
のコレクタ電流を13とし、さらに、出力端子OUTに
流れる出力電流をIOとすれば、次の関係が成立つ。高
温動作時においてトランジスタQ1にリーク電流か流れ
るが、その値はトランジスタQ2のリーク電流11のn
倍である。電流ミラー回路の電流ミラー比は1:nであ
るため、I 3 = n X I 1である。したがっ
て、I2に含まれるリーク電流はトランジスタQ4のコ
レクタ電流として吸収され、出力端子に流れる電流1o
はリーク電流を打消したものとなる。特に、トランジス
タの特性上高温時に著しく増加するリーク電流の影響な
くしている。
Here, the collector current of transistor Q4 is 11, the collector current of transistor Q1 is 12, and the collector current of transistor Q4 is 11.
If the collector current of is 13 and the output current flowing to the output terminal OUT is IO, then the following relationship holds true. During high-temperature operation, a leakage current flows through the transistor Q1, but its value is n of the leakage current 11 of the transistor Q2.
It's double. Since the current mirror ratio of the current mirror circuit is 1:n, I 3 = n X I 1 . Therefore, the leakage current contained in I2 is absorbed as the collector current of transistor Q4, and the current 1o flowing to the output terminal is
is obtained by canceling the leakage current. In particular, it eliminates the influence of leakage current, which increases significantly at high temperatures due to the characteristics of transistors.

このように、高温度動作時におけるトランジスタのリー
ク電流を吸収することができるため、広い温度範囲にわ
たって誤動作のない信頼性の高いトランジスタ制御回路
を構成することができる。
In this way, leakage current of the transistor during high-temperature operation can be absorbed, so a highly reliable transistor control circuit that does not malfunction over a wide temperature range can be constructed.

しかしながら、上記従来のリーク補償回路では、補償し
たい1個のPNP トランジスタQ1に対し、モニター
用のPNP LランジスタQ2の他にカレントミラー回
路を構成するトランジスタQ3、Q4を用意する必要で
あることから、回路規模か増大するという問題があった
However, in the conventional leakage compensation circuit described above, it is necessary to prepare transistors Q3 and Q4 forming a current mirror circuit in addition to the PNP L transistor Q2 for monitoring for one PNP transistor Q1 to be compensated. There was a problem that the circuit scale increased.

(発明が解決しようとする課題) 上記した従来の回路では、リーク電流を補償したいトラ
ンジスタ毎にリーク電流モニター用トランジスタの他に
カレントミラー回路が必要であるため、回路規模が増大
する欠点を有していた。
(Problems to be Solved by the Invention) The conventional circuit described above has the drawback of increasing the circuit scale because a current mirror circuit is required in addition to a leak current monitoring transistor for each transistor whose leak current is to be compensated. was.

この発明は、ラテラルPNPトランジスタの高温リーク
補償を少ない回路規模で実現するものである。
This invention realizes high-temperature leak compensation of a lateral PNP transistor with a small circuit scale.

[発明の構成コ (課題を解決するための手段) この発明のトランジスタ回路の高温リーク補償回路は、
出力段または出力段の一部となる第1のラテラルPNP
トランジスタと、このトランジスタのコレクタ(または
エミッタ)が出力端子に接続されてなるトランジスタ回
路にあって、ベースをオープン状態とした第2のラテラ
ルPNP トランジスタのエミッタ(またはコレクタ)
を前記第1のラテラルPNP トランジスタのコレクタ
(またはエミッタ)に接続してなることを特徴とするも
のである。
[Configuration of the Invention (Means for Solving the Problems) The high temperature leak compensation circuit for a transistor circuit of the present invention comprises:
a first lateral PNP that is the output stage or part of the output stage;
In a transistor circuit consisting of a transistor and the collector (or emitter) of this transistor connected to an output terminal, the emitter (or collector) of a second lateral PNP transistor whose base is open.
is connected to the collector (or emitter) of the first lateral PNP transistor.

(作用) 上記した手段によりラテラルPNP トランジスタの高
温リーク補償を、ベースをオープン状態にしたラテラル
PNP トランジスタを1個追加してリーク電流成分を
、ベースをオープンにしたラテラルPNPトランジスタ
のみでリーク電流で打消すことができる。
(Function) By the means described above, high temperature leakage compensation of the lateral PNP transistor can be achieved by adding one lateral PNP transistor with the base open, and the leakage current component can be compensated for by using only the lateral PNP transistor with the base open. Can be erased.

(実施例) 以下、この発明の一実施例につき図面を参照して詳細に
説明する。
(Example) Hereinafter, an example of the present invention will be described in detail with reference to the drawings.

第1図において、エミッタが電源Vccに接続されたラ
テラルPNP トランジスタQ1のベースは入力端IN
に接続しである。トランジスタQ1のコレクタは出力端
子OUTに接続するとともに、コレクタが接地されたラ
テラルPNPトランジスタQ2のエミッタに接続しであ
る。トランジスタQ2のベースはオープン状態にしであ
る。トランジスタQ1、Q2の各ベースと接地間に図示
の極性で接続しであるDl、D2は、ラテラルPNPト
ランジスタの構造上発生する寄生ダイオードである。
In Figure 1, the base of a lateral PNP transistor Q1 whose emitter is connected to the power supply Vcc is the input terminal IN
It is connected to. The collector of the transistor Q1 is connected to the output terminal OUT, and the collector is connected to the emitter of a lateral PNP transistor Q2 whose collector is grounded. The base of transistor Q2 is left open. Dl and D2, which are connected between the bases of transistors Q1 and Q2 and ground with the polarities shown, are parasitic diodes that occur due to the structure of the lateral PNP transistor.

ここで、寄生ダイオードD1に流れる電流11は寄生ダ
イオードD1に印加する電圧v1、寄生ダイオードD1
の逆方向の飽和電流をISIとすると、 I  +  −ISI  (exp(V+  /Vy 
 )   1  )から求められる。但し、VTはサー
マルボルテージと呼ばれる絶対温度に対する係数で、常
温では281V程度の値である。この値は寄生ダイオー
ドの通常の使用状態では逆バイアスになっており、その
バイアス電圧は少なくとも数百■Vはあるのが普通であ
る。このため、寄生ダイオードD1に流れる電流は上式
かられかるように、寄生ダイオードD1の逆方向飽和電
流181にほぼ等しい。この電流はトランジスタQ1の
ベース電流となるため、トランジスタQ1のコレクタに
はβ11SI(β1はトランジスタQ1の電流増幅率)
の電流がリーク電流として流れることになる。
Here, the current 11 flowing through the parasitic diode D1 is the voltage v1 applied to the parasitic diode D1, and the voltage v1 applied to the parasitic diode D1 is
If the saturation current in the reverse direction is ISI, then I + −ISI (exp(V+ /Vy
) is obtained from 1). However, VT is a coefficient with respect to absolute temperature called thermal voltage, and has a value of about 281V at normal temperature. This value is reverse biased when the parasitic diode is normally used, and the bias voltage is usually at least several hundreds of volts. Therefore, the current flowing through the parasitic diode D1 is approximately equal to the reverse saturation current 181 of the parasitic diode D1, as seen from the above equation. This current becomes the base current of transistor Q1, so β11SI (β1 is the current amplification factor of transistor Q1) is applied to the collector of transistor Q1.
This current will flow as a leakage current.

一方、トランジスタQ2のベースに接続される寄生ダイ
オードD2の逆方向飽和電流IS2は寄生ダイオードD
1の逆方向飽和電流ISIと等しくなる。この寄生ダイ
オードD2の場合も通常数百mV以上の電圧で逆バイア
スされているため、流れる電流は寄生ダイオードD1の
ときと同様、そのダイオードの逆方向飽和電流IS2と
等しくなる。この電流IS2はトランジスタQ2のベー
ス電流となるため、トランジスタQ2のエミッタにはト
ランジスタQ2の電流増幅率をβ2とすると、IS2・
(1+β2)の電流が流れる。通常、トランジスタの電
流増幅率は1より十分大きいため、トランジスタQ2の
エミッタに流れる電流は182・β2にほぼ等しいもの
となる。
On the other hand, the reverse saturation current IS2 of the parasitic diode D2 connected to the base of the transistor Q2 is
It becomes equal to the reverse saturation current ISI of 1. Since this parasitic diode D2 is normally reverse biased with a voltage of several hundred mV or more, the current that flows is equal to the reverse saturation current IS2 of the diode, as in the case of the parasitic diode D1. This current IS2 becomes the base current of the transistor Q2, so if the current amplification factor of the transistor Q2 is β2, the emitter of the transistor Q2 is
A current of (1+β2) flows. Normally, the current amplification factor of a transistor is sufficiently larger than 1, so the current flowing through the emitter of transistor Q2 is approximately equal to 182·β2.

したかって、出力用トランジスタQ1とトランジスタQ
2を同一形状で構成してペア性をとれば、l5I−IS
2、β1−β2と見なせるようになるため、トランジス
タQ1のリーク電流成分181・β1をトランジスタQ
2のリーク電流成分ISI・β2で打消し、出力端市O
UTはリーク電流による影響を受けなくなる。
Therefore, output transistor Q1 and transistor Q
2 with the same shape and pair characteristics, l5I-IS
2. Since it can be regarded as β1-β2, the leakage current component 181·β1 of transistor Q1 can be expressed as
2 leakage current component ISI・β2 cancels it out, output end city O
The UT is no longer affected by leakage current.

第2図は、この発明の他の実施例を示すもので、この実
施例か第1図と異なるところは、電源と接地間にその出
力側が直列接続されたトランジスタQ1、Q2の位置を
入替えるとともに、出力端子OUTを出力用トランジス
タQ1のエミッタに接続した点である。
FIG. 2 shows another embodiment of the present invention, and the difference between this embodiment and FIG. 1 is that the positions of transistors Q1 and Q2, whose output sides are connected in series between the power supply and ground, are swapped. Also, the output terminal OUT is connected to the emitter of the output transistor Q1.

この場合でも、トランジスタQ1を構成するベース・サ
ブストレート間の寄生ダイオードD1の逆方向飽和電流
をISIとすると、これはそのままトランジスタQ1の
ベース電流となる。トランジスタQ1のエミッタにはト
ランジスタQ1の電流増幅率β1をβ1〉〉1とすると
、はぼISI・β1の電流がリーク電流として流れる。
Even in this case, if ISI is the reverse saturation current of the parasitic diode D1 between the base and the substrate forming the transistor Q1, this becomes the base current of the transistor Q1. Assuming that the current amplification factor β1 of the transistor Q1 is β1>>1, a current of approximately ISI·β1 flows as a leakage current in the emitter of the transistor Q1.

一方、ベースがオープン状態のトランジスタQ2のベー
スに付く寄生ダイオードD2の逆方向飽和電流をIS2
とすると、それがそのままトランジスタQ2のベース電
流となるため、トランジスタQ2の電流増幅率β2とす
ると、トランジスタQ2のコレクタにはIS2・βの電
流が流れる。したかって、トランジスタQ2とQlと同
し特性のものを使用すればβ1−β2、l5I−IS2
と見なせるため、トランジスタQ1のリーク電流成分を
打ち消すことができる。
On the other hand, the reverse saturation current of the parasitic diode D2 attached to the base of the transistor Q2 whose base is open is IS2.
Then, since this becomes the base current of the transistor Q2 as it is, if the current amplification factor of the transistor Q2 is β2, a current of IS2·β flows through the collector of the transistor Q2. Therefore, if transistors Q2 and Ql with the same characteristics are used, β1-β2, l5I-IS2
Therefore, the leakage current component of the transistor Q1 can be canceled.

[発明の効果] 以上記載したように、この発明によれば、ラテラルPN
P トランジスタのリーク電流の影響を簡単な回路で打
ち消すことができ、特に集積回路化に適したトランジス
タ回路の高温リーク補償回路を得ることができる。
[Effect of the invention] As described above, according to the present invention, the lateral PN
The influence of the leakage current of the P transistor can be canceled out with a simple circuit, and a high temperature leakage compensation circuit for a transistor circuit particularly suitable for integration into an integrated circuit can be obtained.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はこの発明の一実施例を示す回路図、第2図はこ
の発明の他の実施例を示す回路図、第3図は従来の回路
図である。 Ql、Q2・・・トランジスタ OUT・・・・・・・・・出力端子
FIG. 1 is a circuit diagram showing one embodiment of the present invention, FIG. 2 is a circuit diagram showing another embodiment of the invention, and FIG. 3 is a conventional circuit diagram. Ql, Q2...Transistor OUT...Output terminal

Claims (2)

【特許請求の範囲】[Claims] (1)出力段または出力段の一部となる第1のラテラル
PNPトランジスタと、このトランジスタのコレクタが
出力端子に接続されてなるトランジスタ回路にあって、
ベースをオープン状態とした第2のラテラルPNPトラ
ンジスタのエミッタを前記第1のラテラルPNPトラン
ジスタのコレクタに接続してなることを特徴とするトラ
ンジスタ回路の高温リーク補償回路。
(1) A transistor circuit including a first lateral PNP transistor that is an output stage or a part of the output stage, and a collector of this transistor connected to an output terminal,
1. A high temperature leak compensation circuit for a transistor circuit, characterized in that the emitter of a second lateral PNP transistor whose base is open is connected to the collector of the first lateral PNP transistor.
(2)出力段または出力段の一部となる第1のラテラル
PNPトランジスタと、このトランジスタのエミッタが
出力端子に接続されてなるトランジスタ回路にあって、
ベースをオープン状態とした第2のラテラルPNPトラ
ンジスタのコレクタを前記第1のラテラルPNPトラン
ジスタのエミッタに接続してなることを特徴とするトラ
ンジスタ回路の高温リーク補償回路。
(2) A transistor circuit including a first lateral PNP transistor that is an output stage or a part of the output stage, and an emitter of this transistor connected to an output terminal,
1. A high-temperature leak compensation circuit for a transistor circuit, characterized in that the collector of a second lateral PNP transistor whose base is open is connected to the emitter of the first lateral PNP transistor.
JP17143190A 1990-06-29 1990-06-29 High temperature leakage compensation circuit for transistor circuit Pending JPH0461416A (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5908322A (en) * 1996-06-24 1999-06-01 Yazaki Corporation Joint connector

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5908322A (en) * 1996-06-24 1999-06-01 Yazaki Corporation Joint connector

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