JPH0457248B2 - - Google Patents
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- JPH0457248B2 JPH0457248B2 JP59222699A JP22269984A JPH0457248B2 JP H0457248 B2 JPH0457248 B2 JP H0457248B2 JP 59222699 A JP59222699 A JP 59222699A JP 22269984 A JP22269984 A JP 22269984A JP H0457248 B2 JPH0457248 B2 JP H0457248B2
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- 238000004804 winding Methods 0.000 claims description 8
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/04—Modifications for accelerating switching
- H03K17/042—Modifications for accelerating switching by feedback from the output circuit to the control circuit
- H03K17/0422—Anti-saturation measures
Landscapes
- Dc-Dc Converters (AREA)
- Electronic Switches (AREA)
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は、スイツチングトランジスタの駆動回
路に関し、更に詳しくは、トランジスタを高速に
スイツチングすることのできる駆動回路に関する
ものである。DETAILED DESCRIPTION OF THE INVENTION (Field of Industrial Application) The present invention relates to a driving circuit for switching transistors, and more particularly to a driving circuit that can switch transistors at high speed.
（従来の技術）
第４図は、スイツチング電源におけるスイツチ
ングトランジスタと、このトランジスタのベース
駆動回路の接続概念図である。この図において、
Vinは入力直流電圧、Ｔは１次巻線n1、２次巻線
n2を有したトランス、Ｑは１次巻線n1に入力直流
電圧Vinをスイツチングして（オン、オフして）
与えるスイツチングトランジスタ、DRはこのス
イツチングトランジスタのベース駆動回路であ
る。(Prior Art) FIG. 4 is a conceptual diagram of a connection between a switching transistor in a switching power supply and a base drive circuit of this transistor. In this diagram,
Vin is input DC voltage, T is primary winding n 1 , secondary winding
A transformer with n 2 , Q switches (turns on and off) the input DC voltage Vin to the primary winding n 1 .
The switching transistor given, DR, is the base drive circuit of this switching transistor.
第５図は、第４図において、トランジスタＱを
高速にスイツチングさせるベース駆動回路DRか
らのベース電流波形図である。 FIG. 5 is a base current waveform diagram from the base drive circuit DR which switches the transistor Q at high speed in FIG. 4.
高速スイツチングを実現するために、ベース電
流IBは、はじめに、十分なオーバドライブが行な
える振巾IBPとし、次に、トランジスタＱを飽和
させるのに必要な振巾IB1（IC／hfE）とする。こ
れによつて、トランジスタＱをオン状態とする。
続いて、逆ベース電流IB2をTSの時間流し、高速
ターンオフさせる。 To achieve high-speed switching, the base current I B is first set to an amplitude I BP that provides sufficient overdrive, and then set to an amplitude I B1 (IC/hfE) that is necessary to saturate the transistor Q. shall be. This turns transistor Q on.
Subsequently, a reverse base current I B2 is applied for a time period of TS, resulting in a high-speed turn-off.
（発明が解決しようとする問題点）
このようなベース電流によつて、トランジスタ
Ｑをスイツチングさせる従来の駆動回路において
は、軽負荷時にもベース電流IBの振巾、IBP，IB1
が一定であるために、ストレージタイムTSが長
くなり、オン・オフの制御動作が不安定になると
いう問題点があつた。(Problems to be Solved by the Invention) In the conventional drive circuit that switches the transistor Q using such a base current, the amplitude of the base current I B , I BP , I B1
Since TS is constant, there is a problem that the storage time TS becomes long and the on/off control operation becomes unstable.
このような問題点を解決するために、従来、第
６図に示すように、スイツチングトランジスタＱ
のベース及びコレクタにダイオードD1，D2を接
続し、トランジスタＱのVCE（Sat）が一定値以
下になると、ベース電流をダイオードD2へ分流
させ、Ｑを非飽和駆動するようにしたものであ
る。しかしながら、このような従来例によれば、
軽負荷時に、ストレージは増加しないが、逆に重
負荷時に、トランジスタＱのVCE（ON）が大き
くなるため、損失が増加するという問題点があ
る。 In order to solve these problems, conventionally a switching transistor Q is used as shown in FIG.
Diodes D 1 and D 2 are connected to the base and collector of transistor Q, and when the VCE (Sat) of transistor Q falls below a certain value, the base current is shunted to diode D 2 and Q is driven into non-saturation. be. However, according to such conventional examples,
When the load is light, the storage does not increase, but when the load is heavy, the VCE(ON) of the transistor Q increases, resulting in an increase in loss.
本発明は、このような従来技術における問題点
に鑑みてなされたもので、その目的は、軽負荷時
にストレージタイムの増加を招くことはなく、ま
た、重負荷時に損失増加が生することのない、従
つて、高速で、かつ安定にスイツチング動作を行
なわせることの可能な駆動回路を実現しようとす
るものである。 The present invention has been made in view of the problems in the prior art, and its purpose is to avoid an increase in storage time when the load is light and to avoid an increase in loss when the load is heavy. Therefore, it is an object of the present invention to realize a drive circuit capable of performing a switching operation at high speed and stably.
（問題点を解決するための手段）
前記した問題点を解決する本発明は、
トランスの一次巻線に直列に接続され直流信号
をオン、オフして当該一次巻線に与えるスイツチ
ングトランジスタの駆動回路であつて、
ドライブ信号が印加される入力端子と、
この入力端子と前記スイツチングトランジスタ
のベースとの間に接続されたコンデンサＣとダイ
オードＤ１との直列回路と、
この直列回路と並列に接続され前記スイツチン
グトランジスタのベース回路に定常ベース電流を
提供する抵抗Ｒと、
前記コンデンサＣとダイオードＤ１の共通接続
点と前記スイツチングトランジスタのコレクタ間
に接続したダイオードＤ２と
を設けたことを特徴とするスイツチングトランジ
スタの駆動回路である。(Means for Solving the Problems) The present invention, which solves the problems described above, includes driving a switching transistor that is connected in series to the primary winding of a transformer and turns on and off a DC signal to apply it to the primary winding. The circuit comprises an input terminal to which a drive signal is applied, a series circuit of a capacitor C and a diode D1 connected between this input terminal and the base of the switching transistor, and a series circuit connected in parallel with this series circuit. and a resistor R for providing a steady base current to the base circuit of the switching transistor; and a diode D2 connected between the common connection point of the capacitor C and the diode D1 and the collector of the switching transistor. This is a driving circuit for a switching transistor.
（実施例）
第１図は、本発明駆動回路の一実施例の接続図
である。この実施例ではスイツチング電源に用い
られている場合を示す。図において、Ｑは入力直
流電圧Vinをオン・オフしてトランスＴの１次巻
線n1に与えるスイツチングトランジスタ、Ｒは抵
抗で、一端がトランジスタＱのベースに、他端が
オン・オフのための駆動信号（ベース電流）が与
えられる端子１０に接続されており、定常ベース
電流経路を形成している。Ｃはコンデンサ、D1
はダイオードで、これらは互いに直列に接続さ
れ、この直列回路が抵抗Ｒと並列に接続されてい
る。D2はダイオードで、コンデンサＣとダイオ
ードD1の共通接続点と、トランジスタＱのコレ
クタ間に接続されている。(Embodiment) FIG. 1 is a connection diagram of an embodiment of the drive circuit of the present invention. This embodiment shows a case where the device is used as a switching power source. In the figure, Q is a switching transistor that turns on and off the input DC voltage Vin and supplies it to the primary winding n1 of the transformer T, and R is a resistor, one end of which connects to the base of transistor Q, and the other end of which turns on and off the input DC voltage Vin. It is connected to a terminal 10 to which a drive signal (base current) is applied, forming a steady base current path. C is a capacitor, D 1
are diodes, which are connected in series with each other, and this series circuit is connected in parallel with the resistor R. D2 is a diode connected between the common connection point of capacitor C and diode D1 and the collector of transistor Q.
コンデンサＣとダイオードD1の直列回路及び
ダイオードD2は、オーバードライブ電流経路を
形成している。 The series circuit of capacitor C and diode D 1 and diode D 2 form an overdrive current path.
このように構成した回路の動作を次に説明す
る。まず、負荷が定常状態の場合、端子１０に与
えられるベース電流は、抵抗Ｒを介してトランジ
スタＱのベースに供給され、このトランジスタＱ
は十分に飽和する。この定常状態では、ダイオー
ドD1，D2によるバイパス路は機能しない。 The operation of the circuit configured in this way will be explained next. First, when the load is in a steady state, the base current applied to the terminal 10 is supplied to the base of the transistor Q via the resistor R.
is fully saturated. In this steady state, the bypass path by diodes D 1 and D 2 does not function.
次に負荷が軽い場合、オーバードライブ電流
IBPがコンデンサＣ、ダイオードD1を介してトラ
ンジスタＱのベースに与えられる。これによつて
トランジスタＱは直ちに飽和状態になる。そして
コレクタ電圧が十分低くなると、このオーバード
ライブ電流IBPは、ダイオードD2側に分流する。 Next, when the load is light, the overdrive current
IBP is applied to the base of transistor Q via capacitor C and diode D1 . This immediately brings transistor Q into saturation. When the collector voltage becomes sufficiently low, this overdrive current I BP is shunted to the diode D 2 side.
このような動作によつて、負荷の軽い、重いに
よつて、トランジスタＱのベースに与えられるオ
ーバーライブ量が自動的に、最適な量に自己平衡
する。 By such an operation, the amount of overdrive applied to the base of the transistor Q is automatically self-balanced to an optimum amount depending on whether the load is light or heavy.
また、トランジスタＱのターンオン時において
も、オーバードライブ量が負荷の大小に応じて加
減されるため、ターンオン時のストレージタイム
TSが負荷の大小によつて、大巾に変化すること
はない。従つて、負荷の大小にかかわらず、常に
高速で、かつ安定にスイツチング動作を行なわせ
ることができる。 Also, when the transistor Q is turned on, the overdrive amount is adjusted depending on the load, so the storage time at the time of turn-on is
TS does not change significantly depending on the load. Therefore, regardless of the magnitude of the load, the switching operation can always be performed at high speed and stably.
第２図及び第３図は、本発明の他の実施例の要
部の接続図である。 FIGS. 2 and 3 are connection diagrams of main parts of other embodiments of the present invention.
第２図の実施例においては、トランジスタQ2
を付加したものである。このトランジスタQ2の
ベースは、コンデンサＣとダイオードD1の共通
接続点に接続され、コレクタ及びエミツタは、ト
ランジスタＱのエミツタ及びベースにそれぞれ接
続されており、トランジスタＱのターンオフ時に
おけるスピードアツプを行なう役目をしている。 In the embodiment of FIG. 2, transistor Q 2
is added. The base of this transistor Q2 is connected to the common connection point of the capacitor C and the diode D1 , and the collector and emitter are connected to the emitter and base of the transistor Q, respectively, to speed up the turn-off of the transistor Q. playing a role.
第３図の実施例は、トランジスタＱをオン、オ
フするための駆動信号（ベース電流）を、トラン
ジスタT2を介して、絶縁して与えるようにした
ものである。 In the embodiment shown in FIG. 3, a drive signal (base current) for turning on and off the transistor Q is applied in an insulated manner via the transistor T2 .
第７図は、本発明の駆動回路の動作状態におけ
る等化回路を示す概念図である。 FIG. 7 is a conceptual diagram showing the equalization circuit in the operating state of the drive circuit of the present invention.
(a)は、スイツチングトランジスタＱがオンとな
る過渡状態での駆動電流の流れを示している。 (a) shows the flow of drive current in a transient state when the switching transistor Q is turned on.
コンデンサＣとダイオードD1の直列回路に駆
動電流が流れ、これがベースに供給されてスイツ
チングトランジスタＱが直ちにオンとなる。 A driving current flows through the series circuit of the capacitor C and the diode D1 , and this is supplied to the base, and the switching transistor Q is immediately turned on.
ここで、コンデンサＣに流れる電流が過剰な場
合、その過剰分はダイオードD2側にバイパスす
る。 Here, if the current flowing through the capacitor C is excessive, the excess amount is bypassed to the diode D2 side.
(b)は、スイツチングトランジスタＱがオン状態
に落ちついた定常状態での等化回路である。 (b) shows the equalization circuit in a steady state when the switching transistor Q has settled into the on state.
この状態では、抵抗Ｒを介して駆動電流が流
れ、これがスイツチングトランジスタＱのベース
に供給されており、直列回路を構成しているダイ
オードD1の順方向電圧の影響を受けないように
なつている。 In this state, the drive current flows through the resistor R and is supplied to the base of the switching transistor Q, so that it is not affected by the forward voltage of the diode D1 that makes up the series circuit. There is.
（発明の効果）
上記説明したように、本発明によれば、軽負荷
時にストレージタイムの増加を招くことはなく、
また、重負荷時に損失増加が生ずることのないス
イツチングトランジスタの駆動回路が実現でき
る。(Effects of the Invention) As explained above, according to the present invention, there is no increase in storage time during light loads;
Further, it is possible to realize a switching transistor drive circuit that does not cause an increase in loss during heavy loads.
また、本発明においては、スイツチングトラン
ジスタＱがオン状態に落ちついた定常状態では、
回路構成要素であるダイオードD1の順方向電圧
の影響を受けないという効果がある。 Furthermore, in the present invention, in the steady state when the switching transistor Q has settled into the on state,
This has the effect of not being affected by the forward voltage of the diode D1 , which is a circuit component.
第１図〜第３図は本発明回路の一例を示す接続
図、第４図はスイツチングトランジスタの駆動回
路の接続概念図、第５図は第４図における駆動回
路からのベース電流波形図、第６図は従来回路の
接続図、第７図は、本発明の駆動回路の動作状態
における等化回路を示す概念図である。
Ｑ……スイツチングトランジスタ、Ｃ……コン
デンサ、D1，D2……ダイオード、Ｒ……抵抗。
1 to 3 are connection diagrams showing an example of the circuit of the present invention, FIG. 4 is a conceptual connection diagram of a switching transistor drive circuit, and FIG. 5 is a base current waveform diagram from the drive circuit in FIG. 4. FIG. 6 is a connection diagram of a conventional circuit, and FIG. 7 is a conceptual diagram showing an equalization circuit in an operating state of the drive circuit of the present invention. Q...Switching transistor, C...Capacitor, D1 , D2 ...Diode, R...Resistance.
Claims (1)
号をオン、オフして当該一次巻線に与えるスイツ
チングトランジスタの駆動回路であつて、 ドライブ信号が印加される入力端子と、 この入力端子と前記スイツチングトランジスタ
のベースとの間に接続されたコンデンサＣとダイ
オードＤ１との直列回路と、 この直列回路と並列に接続され前記スイツチン
グトランジスタのベース回路に定常ベース電流を
提供する抵抗Ｒと、 前記コンデンサＣとダイオードＤ１の共通接続
点と前記スイツチングトランジスタのコレクタ間
に接続したダイオードＤ２と を設けたことを特徴とするスイツチングトランジ
スタの駆動回路。[Scope of Claims] 1. A driving circuit for a switching transistor connected in series to a primary winding of a transformer, which turns on and off a DC signal and applies it to the primary winding, comprising an input terminal to which a drive signal is applied; , a series circuit of a capacitor C and a diode D1 connected between this input terminal and the base of the switching transistor; and a series circuit connected in parallel with this series circuit to provide a steady base current to the base circuit of the switching transistor. A driving circuit for a switching transistor, comprising: a resistor R; and a diode D2 connected between a common connection point of the capacitor C and the diode D1 and a collector of the switching transistor.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59222699A JPS61101119A (en) | 1984-10-23 | 1984-10-23 | Drive circuit of switching transistor |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59222699A JPS61101119A (en) | 1984-10-23 | 1984-10-23 | Drive circuit of switching transistor |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61101119A JPS61101119A (en) | 1986-05-20 |
| JPH0457248B2 true JPH0457248B2 (en) | 1992-09-11 |
Family
ID=16786525
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59222699A Granted JPS61101119A (en) | 1984-10-23 | 1984-10-23 | Drive circuit of switching transistor |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61101119A (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4968487B2 (en) | 2010-03-08 | 2012-07-04 | サンケン電気株式会社 | Gate drive circuit |
-
1984
- 1984-10-23 JP JP59222699A patent/JPS61101119A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61101119A (en) | 1986-05-20 |
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