JPH0448022Y2 - - Google Patents
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- Publication number
- JPH0448022Y2 JPH0448022Y2 JP1985009284U JP928485U JPH0448022Y2 JP H0448022 Y2 JPH0448022 Y2 JP H0448022Y2 JP 1985009284 U JP1985009284 U JP 1985009284U JP 928485 U JP928485 U JP 928485U JP H0448022 Y2 JPH0448022 Y2 JP H0448022Y2
- Authority
- JP
- Japan
- Prior art keywords
- mode
- flip
- selection switch
- flop
- terminal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000010586 diagram Methods 0.000 description 6
- 239000003990 capacitor Substances 0.000 description 3
- 230000007257 malfunction Effects 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
- 230000001960 triggered effect Effects 0.000 description 2
Landscapes
- Electronic Switches (AREA)
Description
(イ) 産業上の利用分野
本考案はTV受像機等におけるモード切換回路
に関する。 (ロ) 従来技術 従来、VTR、ビデオデイスク等のビデオ機器
が接続できる外部入力端子付のTV受像機は、例
えば特開昭58−159076号公報の如く、TVモード
及び外部入力モードを選択するモード切換回路を
備えると共に、選択したモードを表示する表示手
段を備えている。 上記モード切換回路は従来、例えば、第３図及
び第４図の様であつた。 同図において、SW１，SW２は第１及び第２
選択スイツチであり、第１選択スイツチの押圧に
よりTVモードを選択し、第２選択スイツチの１
回の押圧毎に第１及び第２外部入力モードを交互
に選択する。 １は第１フリツプフロツプ（以下、第1FFと称
す）であり、この第1FFは第１選択スイツチSW
１押圧時、端子Ａがロー、端子Ｂがハイとなり、
また第２選択スイツチSW２押圧時、端子Ｂがロ
ー、端子Ａがハイとなる。よつて、前記端子Ｂに
接続された第１出力端子Ｏ１には第１選択スイツ
チSW１の押圧によりTVモード表わすハイの切
換出力が出力される。２は第２フリツプフロツプ
（以下第2FFと称す）であり、この第2FFはTVモ
ードのとき端子Ｃがロー、端子Ｄがハイとなつて
おり第２選択スイツチSW２の押圧時、第２トリ
ガ回路Ｔ２からのトリガパルスにより端子Ｄがハ
イからローに変わると共に端子Ｃがローからハイ
に変わる。よつて前記端子Ｃ，Ｄに夫々接続され
た第２及び第３出力端子Ｏ２，Ｏ３は夫々ハイ、
ローとなり第１外部入力モードを表わす。 更に前記第２選択スイツチSW２を押圧する
と、第１トリガ回路Ｔ１からのトリガパルスによ
り端子Ｃがハイからローに変わると共に端子Ｄが
ローからハイに変わる。よつて、前記第２、第３
出力端子出力は夫々ロー、ハイとなり第２外部入
力モードを表わす。 従つて、各モードにおける各出力端子の出力状
態は次表の如くなる。
に関する。 (ロ) 従来技術 従来、VTR、ビデオデイスク等のビデオ機器
が接続できる外部入力端子付のTV受像機は、例
えば特開昭58−159076号公報の如く、TVモード
及び外部入力モードを選択するモード切換回路を
備えると共に、選択したモードを表示する表示手
段を備えている。 上記モード切換回路は従来、例えば、第３図及
び第４図の様であつた。 同図において、SW１，SW２は第１及び第２
選択スイツチであり、第１選択スイツチの押圧に
よりTVモードを選択し、第２選択スイツチの１
回の押圧毎に第１及び第２外部入力モードを交互
に選択する。 １は第１フリツプフロツプ（以下、第1FFと称
す）であり、この第1FFは第１選択スイツチSW
１押圧時、端子Ａがロー、端子Ｂがハイとなり、
また第２選択スイツチSW２押圧時、端子Ｂがロ
ー、端子Ａがハイとなる。よつて、前記端子Ｂに
接続された第１出力端子Ｏ１には第１選択スイツ
チSW１の押圧によりTVモード表わすハイの切
換出力が出力される。２は第２フリツプフロツプ
（以下第2FFと称す）であり、この第2FFはTVモ
ードのとき端子Ｃがロー、端子Ｄがハイとなつて
おり第２選択スイツチSW２の押圧時、第２トリ
ガ回路Ｔ２からのトリガパルスにより端子Ｄがハ
イからローに変わると共に端子Ｃがローからハイ
に変わる。よつて前記端子Ｃ，Ｄに夫々接続され
た第２及び第３出力端子Ｏ２，Ｏ３は夫々ハイ、
ローとなり第１外部入力モードを表わす。 更に前記第２選択スイツチSW２を押圧する
と、第１トリガ回路Ｔ１からのトリガパルスによ
り端子Ｃがハイからローに変わると共に端子Ｄが
ローからハイに変わる。よつて、前記第２、第３
出力端子出力は夫々ロー、ハイとなり第２外部入
力モードを表わす。 従つて、各モードにおける各出力端子の出力状
態は次表の如くなる。
【表】
尚、Ｄ１〜Ｄ８は第１〜第８ダイオードであ
る。 また、前記第１〜第３出力端子には、第１〜第
３トランジスタのTr１〜Tr３ベースが接続さ
れ、この第１〜第３トランジスタの各コレクタに
は第１〜第3LED Ｌ１〜Ｌ３が接続されている。 よつて、TVモード時は、第１出力端子Ｏ１が
ハイのため第１トランジスタTr１及び第1LED
Ｌ１がオンとなりTVモード表示を為す。尚、こ
のとき、第３出力端子Ｏ３もハイとなるが、第
1LED Ｌ１のカソードと第3LDE Ｌ３のアノー
ドとの間に接続された第９ダイオードＤ９がオン
となることにより、第3LED Ｌ３はオフのまま
である。 第１外部入力モード時は、第２出力端子Ｏ２の
みがハイとなるため、第２トランジスタTr２及
び第2LED Ｌ２がオンとなり第１外部入力モー
ド表示を為す。 更に、第２外部入力モード時は、第３出力端子
Ｏ３のみがハイとなるため、第３トランジスタ
Tr３及び第3LED Ｌ３がオンとなり第２外部入
力モード表示を為す。 上述の従来回路において、TVモード時に第２
選択スイツチを一度押すと、第１外部入力モード
が選択され、２度押すと第２外部入力モードが選
択されるのであるが、例えば、前記第２選択スイ
ツチの１度目の押圧時間が極めて短かい場合第２
トリガ回路Ｔ２からのトリガパルスのパルスエネ
ルギーが小さくなり前記第1FFは反転するが前記
第2FFにトリガがかからない。よつて、本来、
TVモードから、第２選択スイツチSW２を押す
と、第１外部入力モードが選択されるはずである
のに、第２外部入力モードが選択されてしまうと
いう誤動作が発生していた。 (ハ) 考案が解決しようとする問題点 本考案は上述の点に鑑み為されたものであり、
モード選択スイツチの押圧時間が極めて短かい場
合でも誤動作することのないモード切換回路を提
供するものである。 (ニ) 問題点を解決するための手段 本考案は、第１モードを選択する第１選択スイ
ツチと、第２若しくは第３モードを選択する第２
選択スイツチと、その出力端子に前記第１モード
を表わす出力を導出する第１フリツプフロツプ
と、その出力端子に前記第２若しくは第３モード
を表わす出力を導出する、第２フリツプフロツプ
と、前記第１及び第２フリツプフロツプ間を接続
する接続手段とを備える。 (ホ) 作用 上述の手段により、前記第２フリツプフロツプ
は第１フリツプフロツプの反転式の出力レベル変
化によりトリガされる。 (ヘ) 実施例 以下、図面に従い本考案の一実施例を説明す
る。 第１図及び第２図は本実施例における概略ブロ
ツク図及び回路図であり、第３図と同一部分には
同一図番を付し説明を省略する。 本実施例の特徴は第1FF１の端子Ａと第2FF２
の第２トリガ端子Ｐとの間にコンデンサＣ及び第
10ダイオードＤ１０の直列接続体を接続した点に
ある。 上述の回路においてTVモード時に第２選択ス
イツチSW２を押圧すると、第1FF１が反転して、
端子Ａがローからハイになる。このハイ出力が第
2FF２の第２トリガ端子ＰにコンデンサＣ及び第
10ダイオードＤ１０を介して微分パルスとして供
給される。よつて、前記第２選択スイツチの押圧
時間が短かく、第２トリガ回路Ｔ２からのトリガ
パルスのエネルギーが小さい場合でも第2FFは、
前記微分パルスにより確実にトリガされ反転され
る。 (ト) 考案の効果 上述の如く本考案に依ればモード選択スイツチ
押圧時の誤動作がなくなる。
る。 また、前記第１〜第３出力端子には、第１〜第
３トランジスタのTr１〜Tr３ベースが接続さ
れ、この第１〜第３トランジスタの各コレクタに
は第１〜第3LED Ｌ１〜Ｌ３が接続されている。 よつて、TVモード時は、第１出力端子Ｏ１が
ハイのため第１トランジスタTr１及び第1LED
Ｌ１がオンとなりTVモード表示を為す。尚、こ
のとき、第３出力端子Ｏ３もハイとなるが、第
1LED Ｌ１のカソードと第3LDE Ｌ３のアノー
ドとの間に接続された第９ダイオードＤ９がオン
となることにより、第3LED Ｌ３はオフのまま
である。 第１外部入力モード時は、第２出力端子Ｏ２の
みがハイとなるため、第２トランジスタTr２及
び第2LED Ｌ２がオンとなり第１外部入力モー
ド表示を為す。 更に、第２外部入力モード時は、第３出力端子
Ｏ３のみがハイとなるため、第３トランジスタ
Tr３及び第3LED Ｌ３がオンとなり第２外部入
力モード表示を為す。 上述の従来回路において、TVモード時に第２
選択スイツチを一度押すと、第１外部入力モード
が選択され、２度押すと第２外部入力モードが選
択されるのであるが、例えば、前記第２選択スイ
ツチの１度目の押圧時間が極めて短かい場合第２
トリガ回路Ｔ２からのトリガパルスのパルスエネ
ルギーが小さくなり前記第1FFは反転するが前記
第2FFにトリガがかからない。よつて、本来、
TVモードから、第２選択スイツチSW２を押す
と、第１外部入力モードが選択されるはずである
のに、第２外部入力モードが選択されてしまうと
いう誤動作が発生していた。 (ハ) 考案が解決しようとする問題点 本考案は上述の点に鑑み為されたものであり、
モード選択スイツチの押圧時間が極めて短かい場
合でも誤動作することのないモード切換回路を提
供するものである。 (ニ) 問題点を解決するための手段 本考案は、第１モードを選択する第１選択スイ
ツチと、第２若しくは第３モードを選択する第２
選択スイツチと、その出力端子に前記第１モード
を表わす出力を導出する第１フリツプフロツプ
と、その出力端子に前記第２若しくは第３モード
を表わす出力を導出する、第２フリツプフロツプ
と、前記第１及び第２フリツプフロツプ間を接続
する接続手段とを備える。 (ホ) 作用 上述の手段により、前記第２フリツプフロツプ
は第１フリツプフロツプの反転式の出力レベル変
化によりトリガされる。 (ヘ) 実施例 以下、図面に従い本考案の一実施例を説明す
る。 第１図及び第２図は本実施例における概略ブロ
ツク図及び回路図であり、第３図と同一部分には
同一図番を付し説明を省略する。 本実施例の特徴は第1FF１の端子Ａと第2FF２
の第２トリガ端子Ｐとの間にコンデンサＣ及び第
10ダイオードＤ１０の直列接続体を接続した点に
ある。 上述の回路においてTVモード時に第２選択ス
イツチSW２を押圧すると、第1FF１が反転して、
端子Ａがローからハイになる。このハイ出力が第
2FF２の第２トリガ端子ＰにコンデンサＣ及び第
10ダイオードＤ１０を介して微分パルスとして供
給される。よつて、前記第２選択スイツチの押圧
時間が短かく、第２トリガ回路Ｔ２からのトリガ
パルスのエネルギーが小さい場合でも第2FFは、
前記微分パルスにより確実にトリガされ反転され
る。 (ト) 考案の効果 上述の如く本考案に依ればモード選択スイツチ
押圧時の誤動作がなくなる。
第１図及び第２図は本考案の一実施例における
モード切換回路のブロツク図及び回路図、第３図
及び第４図は従来回路のブロツク図及び回路図で
ある。 １，２……第１、第2FF、SW１，SW２……
第１、第２選択スイツチ、Ｌ１〜Ｌ３……第１〜
第3LED、Ｃ……コンデンサ、Ｄ１０……第10ダ
イオード。
モード切換回路のブロツク図及び回路図、第３図
及び第４図は従来回路のブロツク図及び回路図で
ある。 １，２……第１、第2FF、SW１，SW２……
第１、第２選択スイツチ、Ｌ１〜Ｌ３……第１〜
第3LED、Ｃ……コンデンサ、Ｄ１０……第10ダ
イオード。
Claims (1)
- 複数のモードのうち第１モードを選択する第１
選択スイツチと、前記複数のモードのうち第２若
しくは第３モードを選択する第２選択スイツチ
と、前記第１選択スイツチの操作によりその出力
端子に前記第１モードを表わす出力を導出する第
１フリツプフロツプと、前記第１フリツプフロツ
プの出力端子が第１モードを表わす出力に対して
反転しているとき、前記第２選択スイツチの操作
によりその出力端子に前記第２若しくは第３モー
ドを表わす出力を導出する第２フリツプフロツプ
と、前記第１フリツプフロツプの反転時の出力レ
ベル変化により前記第２フリツプフロツプをトリ
ガすべく前記第１フロツプフリツプの出力端子と
前記第２フリツプフロツプのトリガ入力端子との
間に微分回路とを備えるモード切換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1985009284U JPH0448022Y2 (ja) | 1985-01-25 | 1985-01-25 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1985009284U JPH0448022Y2 (ja) | 1985-01-25 | 1985-01-25 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61126626U JPS61126626U (ja) | 1986-08-08 |
| JPH0448022Y2 true JPH0448022Y2 (ja) | 1992-11-12 |
Family
ID=30489354
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1985009284U Expired JPH0448022Y2 (ja) | 1985-01-25 | 1985-01-25 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0448022Y2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61116436U (ja) * | 1984-12-28 | 1986-07-23 |
-
1985
- 1985-01-25 JP JP1985009284U patent/JPH0448022Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61126626U (ja) | 1986-08-08 |
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