JPH0433188B2 - - Google Patents

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JPH0433188B2
JPH0433188B2 JP59219872A JP21987284A JPH0433188B2 JP H0433188 B2 JPH0433188 B2 JP H0433188B2 JP 59219872 A JP59219872 A JP 59219872A JP 21987284 A JP21987284 A JP 21987284A JP H0433188 B2 JPH0433188 B2 JP H0433188B2
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JP
Japan
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pixel data
recording
scanning
read
correction data
Prior art date
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JP59219872A
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Japanese (ja)
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JPS6199458A (en
Inventor
Shuji Matsuyama
Hisakatsu Ochi
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NEC Corp
Original Assignee
Nippon Electric Co Ltd
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Publication date
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Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は画信号修正装置に関し、特に振動ミラ
を用いる平面走査形の写真電送受信装置におい
て、記録光点の非等速性に起因する記録画の歪補
正を行う画信号修正装置に関する。
DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to an image signal correction device, and in particular, in a flat scanning photoelectric transmitter/receiver device using a vibrating mirror, recording caused by non-uniform velocity of a recording light spot. The present invention relates to an image signal correction device that corrects image distortion.

〔従来技術〕[Prior art]

一般に、振動ミラを用いる平面走査形の写真電
送受信装置では、走査時における振動ミラの振れ
速度が一定であると、感光記録媒体上を走査する
記録光点の走査速度は中央部で遅く周辺部で早く
なることはよく知られている。そのため、等速走
査で原画から読取られた画素ごとの画素データを
そのまま記録すると、上記した特性から記録画に
おける主走査方向の周辺部が中央部に比べて拡が
りをもつ歪を発生する。
In general, in a flat scanning photoelectric transmitter/receiver that uses a vibrating mirror, if the vibration speed of the vibrating mirror is constant during scanning, the scanning speed of the recording light spot that scans the photosensitive recording medium is slower in the center and slower in the periphery. It is well known that it is faster. Therefore, if the pixel data for each pixel read from the original image by constant speed scanning is recorded as is, the above-mentioned characteristics will cause distortion in which the periphery of the recorded image in the main scanning direction is more expansive than the central area.

従来の振動ミラを用いる写真電送受信装置にお
ける画信号修正装置は、振動ミラの駆動電力に上
記した非等速性を補正するデータを加算し、走査
時における振動ミラの振れ速度を可変制御するこ
とにより、記録光点の走査速度が一定になるよう
補正している。
An image signal correction device in a conventional photoelectric transmitting/receiving device using a vibrating mirror adds data for correcting the above-mentioned non-uniform velocity to the driving power of the vibrating mirror, and variably controls the vibration speed of the vibrating mirror during scanning. The scanning speed of the recording light spot is corrected to be constant.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

しかしながら、上記した従来方法では完全なデ
ータの作成が困難であり、かつ振動ミラの振れ速
度が早くなると、物理的に可変速度制御がむつか
しくなり完全な補正が不可能になるため、補正不
完全な部分の記録画に副走査方向に平行した濃度
むらを発生するという問題がある。
However, with the conventional method described above, it is difficult to create complete data, and when the vibration speed of the vibrating mirror increases, variable speed control becomes physically difficult and complete correction becomes impossible. There is a problem in that density unevenness parallel to the sub-scanning direction occurs in some recorded images.

本発明の目的は、画素データそれぞれの時間的
位置を記録光点の走査速度の時刻の変化に反比例
して変えることにより、濃度むらの発生を防止で
きかつ完全な修正補正データが容易に作成できる
画信号修正装置を提供することにある。
An object of the present invention is to prevent the occurrence of density unevenness and easily create complete correction data by changing the temporal position of each pixel data in inverse proportion to the time change in the scanning speed of the recording light spot. An object of the present invention is to provide an image signal correction device.

〔問題点を解決するための手段〕[Means for solving problems]

本発明の画信号修正装置は、光源、振動ミラを
備える平面走査形の記録光学系と、後続する走査
線に対応する画素データを書込み中に先行する走
査線に対応する画素データを読出す少くとも2走
査線に対応する前記画素データを格納する容量を
有する第1の記憶手段と、走査に先立つ準備期間
に前記記録光学系からの記録光点の記録走査部位
における非等速性に起因する前記画素データそれ
ぞれに対応する前記記録光点それぞれの位置誤差
を相殺するよう、前記第1の記憶手段に対する前
記画素データそれぞれ読出タイミング制御するそ
れぞれの補正データを書込み、かつ該補正データ
をもつて前記画素データの読出しを行い該読出し
結果に基づき前記補正データを順次更新して修正
補正データを作成する第2の記憶手段と、該第2
の記憶手段に並列に設け前記修正補正データを格
納し、かつ記録走査時に前記修正補正データをも
つて前記画素データの前記読出タイミングを制御
する第3の記憶手段とを含んで構成される。
The image signal correction device of the present invention includes a planar scanning type recording optical system including a light source and a vibrating mirror, and a system that reads out pixel data corresponding to a preceding scanning line while writing pixel data corresponding to a subsequent scanning line. A first storage means having a capacity for storing the pixel data corresponding to two scanning lines, and a recording light spot from the recording optical system due to non-uniform velocity at the recording scanning part during the preparation period prior to scanning. In order to cancel the positional error of each of the recording light spots corresponding to each of the pixel data, correction data for controlling the readout timing of each of the pixel data to the first storage means is written, and the correction data is used to a second storage means for reading pixel data and sequentially updating the correction data based on the readout result to create modified correction data;
and third storage means provided in parallel with the storage means for storing the modified correction data and controlling the readout timing of the pixel data with the modified correction data during recording scanning.

〔作用〕[Effect]

本発明は、走査に先立つ調整期間に、第2の記
憶手段としてのRAMに記録光点の記録走査部位
における速度変化に起因する、1走査線に対応す
る画素データはそれぞれに対する記録光点の位置
誤差を相殺する、画素データごとの補正データを
キーボードなどから書込み、その補正データで読
出タイミングを制御して第1の記憶手段に格納し
た走査線ごとの画素データの読出しを行い、読出
し結果に基づき補正データを順次正しい値に更新
することにより第2の記憶手段に格納されるデー
タを完全な修正補正データにする。修正補正デー
タを第3の記憶手段としてのROMに書込み、記
録走査時にROMから修正補正データを読出し
て、第1の記憶手段に対する読出タイミングの制
御を行うことにより、振動ミラの非等速性に起因
する記録画における濃度むらの発生を防止する画
信号修正装置を実現するものである。
In the present invention, during an adjustment period prior to scanning, pixel data corresponding to one scanning line is stored in a RAM serving as a second storage means, and the position of the recording light spot for each scanning line is Correction data for each pixel data that cancels out the error is written from a keyboard or the like, and the read timing is controlled by the correction data to read out the pixel data for each scanning line stored in the first storage means, and based on the readout result. By sequentially updating the correction data to correct values, the data stored in the second storage means is made into complete corrected correction data. The non-uniform velocity of the vibrating mirror can be corrected by writing the correction correction data into the ROM as the third storage means, reading the correction correction data from the ROM during recording scanning, and controlling the read timing for the first storage means. The object of the present invention is to realize an image signal correction device that prevents the occurrence of density unevenness in recorded images due to the above-mentioned problems.

これにより、書替えが面倒なROMに最終の完
全なデータを書込むことができ、初めに第2の記
憶手段に書込む補正データは粗いもので行い、そ
のあと記録の測定結果に応じて補正データの細部
を修正すればよい。従つて、初期調整が容易で調
整工数を短縮できかつ完全な修正補正データを
ROMに格納できる利点がある。
As a result, it is possible to write the final complete data to the ROM, which is difficult to rewrite. First, the correction data written to the second storage means is rough, and then the correction data is written according to the recording measurement results. All you have to do is modify the details. Therefore, initial adjustment is easy, adjustment man-hours can be shortened, and complete correction data can be obtained.
It has the advantage of being stored in ROM.

〔実施例〕〔Example〕

以下に、本発明の実施例について図面を参照し
て詳細に説明する。
Embodiments of the present invention will be described in detail below with reference to the drawings.

第1図は本発明の一実施例を示すブロツク図
で、画信号修正装置はA/D変換回路1と、第1
の記憶手段としての記憶部2と、分周器3と、書
込カウンタ4と、読出カウンタ5と、可変分周器
6と、第2の記憶手段としてRAM7と、第3の
記憶手段としてROM8と、反転回路9と、書込
読出制御回路10と、D/A変換回路11と、記
録回路12と、記録部13とを含む。
FIG. 1 is a block diagram showing an embodiment of the present invention, in which the image signal correction device includes an A/D conversion circuit 1, a first
A storage section 2 as a storage means, a frequency divider 3, a write counter 4, a read counter 5, a variable frequency divider 6, a RAM 7 as a second storage means, and a ROM 8 as a third storage means. , an inversion circuit 9 , a write/read control circuit 10 , a D/A conversion circuit 11 , a recording circuit 12 , and a recording section 13 .

以下に、第1図に示す実施例の動作について、
第2図および第3図を参照して詳細に説明する。
第2図は第1図における記録部13の要部斜視
図、第3図は第1図における記憶部2の動作を説
明するためのタイムチヤートである。
The operation of the embodiment shown in FIG. 1 will be explained below.
This will be explained in detail with reference to FIGS. 2 and 3.
2 is a perspective view of a main part of the recording section 13 in FIG. 1, and FIG. 3 is a time chart for explaining the operation of the storage section 2 in FIG. 1.

第1図において、画素信号DAはそれぞれの画
素濃度に対応する電圧値をもつ画素ごとの一連の
入力信号で、A/D変換回路1に供給されてそれ
ぞれの電圧値に応じて多値符号化された画素デー
タdiに変換される。
In FIG. 1, the pixel signal D A is a series of input signals for each pixel having a voltage value corresponding to each pixel density, and is supplied to the A/D conversion circuit 1 and converted into a multilevel code according to each voltage value. pixel data di.

記憶部2は切換え器21,23,24および2
6と、RAM22および25とを備える。RAM
22および25はそれぞれ1走査線に対応する画
素データdiを格納できる容量を有し、一方が書込
み中は他方が読出すというように交互に書込み読
出しを繰返す。
The storage unit 2 includes switchers 21, 23, 24 and 2.
6, and RAMs 22 and 25. RAM
Each of 22 and 25 has a capacity capable of storing pixel data di corresponding to one scanning line, and one repeats writing and reading alternately, such that while one is writing, the other is reading.

書込読出制御回路10は位相信号Pの立上りご
とに、切替え器21,23および切替え器24,
26それぞれに書込読出指示信号Eおよびを供
給する。書込読出指示信号Eおよびは一方が
「ハイ」のとき他方が「ロー」になる信号で、
RAM22および25は書込読出指示信号Eおよ
びが「ハイ」のとき書込み「ロー」とき読出し
を指示される。
The write/read control circuit 10 switches switches 21 and 23 and switches 24 and 24 at each rise of the phase signal P.
A write/read instruction signal E and are supplied to each of 26 and 26 respectively. The write/read instruction signal E is a signal in which when one is “high”, the other becomes “low”,
The RAMs 22 and 25 are instructed to write when the write/read instruction signal E is "high" and to read when the write/read instruction signal E is "low".

同期クロツクS1は画素周期のn倍の周期をも
ち、分周器3で1/n分周された画素クロツクS2
が書込カウンタ4に供給される。
The synchronous clock S1 has a period n times the pixel period, and the pixel clock S2 is divided by 1/n by the frequency divider 3.
is supplied to the write counter 4.

書込読出制御回路10は反転位相信号の立上
りごとに「ハイ」になり、次の反転位相信号の
立下りごとに「ロー」になるカウンタ起動信号F
を発生し、書込カウンタ4および読出カウンタ5
に供給する。
The write/read control circuit 10 outputs a counter activation signal F which becomes "high" every time the inverted phase signal rises and becomes "low" every time the next inverted phase signal falls.
is generated, and the write counter 4 and read counter 5
supply to.

書込カウンタ4はカウンタ起動信号Fが「ハ
イ」の期間、画素クロツクS2を計数して書込アド
レスWEを発生し、「ロー」になつたとき初期値
に設定される。
The write counter 4 counts the pixel clock S2 while the counter activation signal F is "high" to generate a write address WE, and is set to the initial value when it becomes "low".

書込読出指示信号Eが「ハイ」の期間は、切替
え器21からm番目の走査線に対応する画素デー
タdiがRAM22に供給される。一方、切替え器
23から書込アドレスWEがRAM22に供給さ
れて、書込アドレスWEの指示にしたがつて、
RAM22のm番目の走査線に対応する画素デー
タdiが書込まれる。
During the period when the write/read instruction signal E is "high", pixel data di corresponding to the m-th scanning line is supplied from the switch 21 to the RAM 22. On the other hand, the write address WE is supplied from the switch 23 to the RAM 22, and according to the instruction of the write address WE,
Pixel data di corresponding to the m-th scanning line of the RAM 22 is written.

(m+1)番目の走査線に対する位相信号Pで
書込読出指示信号が「ハイ」になり、切替え器
24および26が書込み状態になつて、上記と同
様にRAM25に(m+1)番目の走査線に対応
する画素データdiが書込まれる。
The write/read instruction signal becomes "high" with the phase signal P for the (m+1)th scanning line, the switchers 24 and 26 enter the writing state, and the (m+1)th scanning line is written to the RAM 25 in the same manner as above. Corresponding pixel data di is written.

一方、m番目の走査線に対応する画素データdi
をRAM22に書込み中は、書込読出指示信号
が「ロー」で、切替え器24および26は読出し
状態になつている。
On the other hand, pixel data di corresponding to the m-th scanning line
While writing the data into the RAM 22, the write/read instruction signal is "low" and the switches 24 and 26 are in the read state.

ここで、RAM22および25の読出動作の説
明に先立ち、第2図に示す記録部13について述
べる。
Here, prior to explaining the read operation of the RAMs 22 and 25, the recording section 13 shown in FIG. 2 will be described.

第2図に示すように、記録部13は記録光学系
14と、1対の送りローラ16,17と、記録媒
体15とを備える。
As shown in FIG. 2, the recording section 13 includes a recording optical system 14, a pair of feed rollers 16 and 17, and a recording medium 15.

記録光学系14はヘリウム・ネオンレーザなど
の光源141と、光変調器142と、スリツト板
143と、レンズ144と、振動ミラ145とを
備える。
The recording optical system 14 includes a light source 141 such as a helium/neon laser, an optical modulator 142, a slit plate 143, a lens 144, and a vibrating mirror 145.

光源141からのレーザビームは光変調器14
2で偏向され、スリツト板143のスリツトをと
おり、レンズ144で所定サイズの記録光にな
る。レンズ144からの記録光は振動ミラ145
で反射され、記録媒体15の記録走査部位18上
に記録光点を形成する。
The laser beam from the light source 141 is transmitted to the optical modulator 14
2, passes through the slit of the slit plate 143, and becomes recording light of a predetermined size at the lens 144. The recording light from the lens 144 is sent to the vibrating mirror 145.
, and forms a recording light spot on the recording scanning portion 18 of the recording medium 15 .

光変調器142は、例えば、音響光学効果を利
用するAO変調器で、記録回路12からの記録信
号D′Rの電圧値に応じてレーザビームの偏向を行
う。従つて、記録信号D′Rが黒に相当する電圧値
のとき、光変調器142からのレーザビームがス
リツト板143のスリツトの全面を通過し、白に
相当する電圧値のときスリツト板143に遮られ
てスリツトを通過しないように光変調器142の
偏向量を設定することにより、記録走査部位18
上の記録光点の光量を記録信号D′Rの電圧値に応
じて変調することができる。
The optical modulator 142 is, for example, an AO modulator that utilizes an acousto-optic effect, and deflects the laser beam according to the voltage value of the recording signal D′ R from the recording circuit 12. Therefore, when the recording signal D' R has a voltage value corresponding to black, the laser beam from the optical modulator 142 passes through the entire surface of the slit of the slit plate 143, and when the recording signal D'R has a voltage value corresponding to white, it passes through the slit plate 143. By setting the deflection amount of the optical modulator 142 so that it does not pass through the slit, the recording scanning portion 18
The light intensity of the upper recording light spot can be modulated according to the voltage value of the recording signal D' R .

振動ミラ145は一方向に主走査速度で所定角
度振れ、反対方向に高速の戻り速度で初期位置ま
で復帰する振動を繰返し、レンズ144からの記
録光を記録走査部位18の初期位置Bから主走査
終了位置Cの範囲で主走査移動させる。
The vibrating mirror 145 vibrates by a predetermined angle in one direction at a main scanning speed and returns to the initial position at a high return speed in the opposite direction, repeating the vibration, and main-scans the recording light from the lens 144 from the initial position B of the recording scanning part 18. Main scanning movement is performed within the range of end position C.

記録媒体15は平面状であり、従つて、記録走
査部位18上を移動する記録光点の速度は、振動
ミラの主走査方向の振れ速度を一定に設定する
と、中央部で遅く周辺部へゆくにしたがつて早く
なる。それ故、一定速度で読取られた画信号その
まま記録すると、記録画に左右が拡がる歪を発生
する。
The recording medium 15 is flat, and therefore, when the vibration speed of the vibrating mirror in the main scanning direction is set constant, the speed of the recording light spot moving on the recording scanning part 18 is slower in the center and moves toward the periphery. It gets faster as the time increases. Therefore, if an image signal read at a constant speed is recorded as it is, a distortion will occur in the recorded image that spreads from side to side.

記録媒体15は1対の送りローラ16,17で
挾持されて、副走査方向Aに副走査速度で移動し
記録走査が行われる。
The recording medium 15 is held between a pair of feed rollers 16 and 17, and is moved in the sub-scanning direction A at a sub-scanning speed to perform printing scanning.

次に、第1図を参照して、RAM22および2
5の読出動作を説明する。
Next, referring to FIG.
The read operation of No. 5 will be explained.

画信号の記録に先立つ初期調整時に、記録回路
12から画素クロツクS2に同期する一定周期のパ
ルス信号を記録部13に供給し、記録部13で記
録媒体15に記録を作成する。記録画の副走査方
向に平行する線間隔を計測し、それぞれの線間隔
の差が零になるよう読出カウンタ5の読出タイミ
ングを制御する、可変分周器6の分周比を変化さ
せる補正データを1走査線に対応するそれぞれの
画素データごとにRAM7に書込む。
During initial adjustment prior to recording an image signal, a pulse signal of a constant period synchronized with the pixel clock S2 is supplied from the recording circuit 12 to the recording section 13, and the recording section 13 creates a record on the recording medium 15. Correction data that changes the frequency division ratio of the variable frequency divider 6, which measures the line spacing parallel to the sub-scanning direction of the recorded image and controls the read timing of the read counter 5 so that the difference between the respective line spacings becomes zero. is written into the RAM 7 for each pixel data corresponding to one scanning line.

RAM7へ書込み時は、端子71に例えばキー
ボードから補正データ入力し、端子72から「ロ
ー」の書込イネーブル信号H、端子73から「ロ
ー」の読出イネーブル信号Kを入力する。このと
き、反転回路9でROM8の反転読出イネーブル
信号は「ハイ」になり、ROM8の読出しは行
われない。
When writing to the RAM 7, correction data is input to the terminal 71 from, for example, a keyboard, a "low" write enable signal H is input from the terminal 72, and a "low" read enable signal K is input from the terminal 73. At this time, the inversion read enable signal for the ROM 8 becomes "high" in the inversion circuit 9, and reading from the ROM 8 is not performed.

可変分周器6はRAM7からの補正データに応
じて、別に供給される同期クロツクS1の分周比を
変化させ、読出クロツクS3を読出カウンタ5に供
給する。従つて、可変分周器6の分周比が1/n
のときは、読出カウンタ5からRAM22および
25に供給される読出アドレスREの読出タイミ
ングは書込アドレスWEと同じになる。
The variable frequency divider 6 changes the frequency division ratio of the separately supplied synchronous clock S 1 in accordance with the correction data from the RAM 7 and supplies the read clock S 3 to the read counter 5 . Therefore, the frequency division ratio of the variable frequency divider 6 is 1/n
In this case, the read timing of the read address RE supplied from the read counter 5 to the RAMs 22 and 25 is the same as that of the write address WE.

読出カウンタ5はカウンタ起動信号Fが「ハ
イ」の期間、読出クロツクS3を計数して読出アド
レスREを発生し、「ロー」になつたとき初期値に
設定される。
The read counter 5 counts the read clock S3 while the counter activation signal F is "high" to generate a read address RE, and is set to the initial value when it becomes "low".

A/D変換回路1に上記した画素クロツクS2
同期したパルス信号を供給し、前述した書込み方
法でRAM22および25に符号化したパルス信
号を順次書込む。まず、RAM22に書込みが行
われ、次にRAM25に書込み中にRAM22が
読出し状態になる。
A pulse signal synchronized with the above-mentioned pixel clock S2 is supplied to the A/D conversion circuit 1, and the encoded pulse signals are sequentially written into the RAMs 22 and 25 using the above-described writing method. First, writing is performed to RAM 22, and then, while writing to RAM 25, RAM 22 becomes in a read state.

いま、主走査方向に1番目からN番目までの画
素それぞれに対応する画素データd1,〜,dN
が配列されていて、1番目の画素データd1に対
する補正データが(n+3)であるとする。画素
データd1に対する読出アドレスREがRAM2
2に供給され、画素データd1が読出されると同
時に、RAM7に供給されて(n+3)の補正デ
ータがRAM7から可変分周器6に供給される。
Now, pixel data d1, ~, dN corresponding to each of the 1st to Nth pixels in the main scanning direction
Assume that the correction data for the first pixel data d1 is (n+3). Read address RE for pixel data d1 is RAM2
At the same time that the pixel data d1 is read out, it is also supplied to the RAM 7, and (n+3) correction data is supplied from the RAM 7 to the variable frequency divider 6.

可変分周器6は1/(n+3)の分周比にな
り、同期クロツクS1を1/(n+3)分周した読
出クロツクS3を発生し、読出カウンタ5に供給す
る。読出カウンタ5は読出クロツクS3を計数し、
2番目の画素データd2の読出アドレスREを発
生して、画素データd2がRAM22から読出さ
れる。
The variable frequency divider 6 has a frequency division ratio of 1/(n+3), generates a read clock S3 by dividing the frequency of the synchronous clock S1 by 1/(n+3), and supplies it to the read counter 5. The read counter 5 counts the read clock S3 ,
A read address RE for the second pixel data d2 is generated, and the pixel data d2 is read from the RAM 22.

2番目の画素データd2に対する補正データが
(n+2)とすると、画素データd2に対する読
出アドレスREがRAM7に供給され(n+2)
の補正データがRAM7から可変分周器6に供給
される。従つて、可変分周器6が1/(n+2)
の分周比になり、同期クロツクS1を1/(n+
2)分周した読出クロツクS3が読出カウンタ5に
供給される。読出カウンタ5は読出クロツクS3
計数して、画素データd3に対する読出アドレス
REを発生し、RAM22から画素データd3を
読出す。同時に、RAM7から画素データd3に
対する補正データを読出す。
If the correction data for the second pixel data d2 is (n+2), the read address RE for the pixel data d2 is supplied to the RAM 7 (n+2).
The correction data is supplied from the RAM 7 to the variable frequency divider 6. Therefore, the variable frequency divider 6 is 1/(n+2)
The frequency division ratio becomes 1 /(n+
2) The frequency-divided read clock S3 is supplied to the read counter 5. The read counter 5 counts the read clock S3 and determines the read address for the pixel data d3.
Generate RE and read pixel data d3 from RAM22. At the same time, correction data for the pixel data d3 is read from the RAM 7.

以下、同様に進行してN番目の画素データdN
までの読出アドレスREが、補正データに応じた
読出タイミングで順次発生し、RAM22の読出
しを終る。
Thereafter, the process proceeds in the same way to obtain the Nth pixel data dN.
The read addresses RE up to this point are sequentially generated at read timings according to the correction data, and reading from the RAM 22 is completed.

RAM22から読出された符号化パルス信号に
対応するそれぞれの画素データdiはD/A変換回
路11に供給される。
Each pixel data di corresponding to the encoded pulse signal read out from the RAM 22 is supplied to the D/A conversion circuit 11.

D/A変換回路11は修正された多値の符号化
パルス信号を、画素データごとに対応する電圧値
に変換して記録信号DRを出力し、記録回路12
で増幅した後、記録部13に供給して記録する。
The D/A conversion circuit 11 converts the modified multi-level encoded pulse signal into a voltage value corresponding to each pixel data and outputs a recording signal D R.
After amplifying the signal, the signal is supplied to the recording section 13 and recorded.

次に位相信号Pで書込読出指示信号Eが「ハ
イ」になり、反転書込読出指示信号Eが「ロー」
になると、RAM25に書込まれた1走査線に対
応する符号化パルス信号に対する画素データdiを
読出し、上記と同様に記録する。
Next, the write/read instruction signal E becomes "high" with the phase signal P, and the inverted write/read instruction signal E becomes "low".
Then, the pixel data di corresponding to the encoded pulse signal corresponding to one scanning line written in the RAM 25 is read out and recorded in the same manner as above.

以上の動作を複数回繰返し、得られる記録画の
副走査方向に平行する線間隔を計測して、計測結
果に基づき補正データの修正値を求め、端子71
からRAM7に書込んで補正データの修正を行
う。この修正を繰返すことにより、完全に位置誤
差を矯正できる修正補正データがRAM7に格納
される。
The above operation is repeated multiple times, the line spacing parallel to the sub-scanning direction of the resulting recorded image is measured, the correction value of the correction data is determined based on the measurement result, and the terminal 71
The correction data is corrected by writing it to RAM7. By repeating this correction, corrected correction data that can completely correct the position error is stored in the RAM 7.

次に、端子74から外部のロムライタにRAM
7の修正補正データを供給し、ROM8に修正補
正データを書込んだ後、ROM8を所定位置に装
着し、端子71,72,73および74をハイイ
ンピーダンスにして初期調整を終る。
Next, connect the RAM to the external ROM writer from terminal 74.
After supplying the modified correction data of No. 7 and writing the modified correction data into the ROM 8, the ROM 8 is installed in a predetermined position and the terminals 71, 72, 73 and 74 are set to high impedance to complete the initial adjustment.

以上の、書込み読出しのタイミング関係の1例
を第3図に示す。
An example of the above write/read timing relationship is shown in FIG.

すなわち、書込みのための画素クロツクS2が同
期クロツクS1の5クロツクごとに発生し、それに
対する読出クロツクS3が画素データ順にそれぞれ
同期クロツクS1の4クロツクSで3画素データ、
5クロツクで2画素データ、6クロツクで3画素
データに対応して発生した場合の、画素データご
との書込画素データと読出画素データとのタイミ
ング関係である。
That is, the pixel clock S2 for writing is generated every five clocks of the synchronizing clock S1 , and the corresponding read clock S3 generates three pixel data in four clocks S of the synchronizing clock S1 in the order of pixel data.
This is the timing relationship between write pixel data and read pixel data for each pixel data when 5 clocks correspond to 2 pixel data and 6 clocks correspond to 3 pixel data.

次に、記録走査時は、前述したように、RAM
22および25に走査線ごとの画素データdiが順
次書込まれる。また、端子72がハイインピーダ
ンスになつていて、ROM8の読出イネーブルOE
が「ロー」、RAM7の読出イネーブルOEは「ハ
イ」になり、ROM8が読出し状態になる。
Next, when recording and scanning, as mentioned above, the RAM
Pixel data di for each scanning line is sequentially written into 22 and 25. In addition, the terminal 72 is set to high impedance, and the read enable OE of ROM8 is set to high impedance.
is "low", the read enable OE of RAM7 becomes "high", and ROM8 enters the read state.

この状態で、上記したたRAM7からの補正デ
ータの読出しと同様に、ROM8から修正補正デ
ータが画素データdiに対する読出アドレスREご
とに読出され、可変分周器6の分周比が修正補正
データに応じて変化して、読出カウンタ5からの
読出アドレスREの発生タイミングが制御される。
In this state, similar to the reading of the correction data from the RAM 7 described above, the modified correction data is read from the ROM 8 for each read address RE for the pixel data di, and the frequency division ratio of the variable frequency divider 6 is adjusted to the modified correction data. The timing of generation of the read address RE from the read counter 5 is controlled accordingly.

従つて、D/A変換回路11からの記録信号
DRは振動ミラ145の非等速性に起因する画素
データごとの位置誤差が補正された時間配列にな
り、記憶部13で再生される記録画に歪が発生し
ない。
Therefore, the recording signal from the D/A conversion circuit 11
D R has a time array in which the positional error of each pixel data due to the non-uniformity of the vibrating mirror 145 is corrected, and no distortion occurs in the recorded image reproduced in the storage unit 13.

〔発明の効果〕〔Effect of the invention〕

以上述べたように、本発明の画信号修正装置は
第1の記憶手段と、第2の記憶手段としてRAM
と、第3の記憶手段としてROMとを追加して、
予め補正データを第2の記憶手段で順次更新して
完全な修正補正データを作成し、得られた修正補
正データを第3の記憶手段に格納して、第1の記
憶手段に格納した画素データごとの読出タイミン
グを対応するそれぞれの修正補正データで制御す
ることにより、完全な修正補正データが極めて容
易に作成でき、かつ記録画における画素データそ
れぞれの時間的位置を記録光点の走査速度の刻々
の変化に反比例して変化し、記録画に濃度むらが
発生することを防止できるので、調整工数を短縮
できかつ画質を向上できるという効果がある。
As described above, the image signal correction device of the present invention includes a RAM as the first storage means and a RAM as the second storage means.
and by adding ROM as a third storage means,
The correction data is sequentially updated in advance in the second storage means to create complete correction correction data, the obtained correction correction data is stored in the third storage means, and the pixel data stored in the first storage means is By controlling the readout timing of each pixel with the corresponding correction correction data, complete correction correction data can be created extremely easily. It changes in inverse proportion to the change in , and it is possible to prevent density unevenness from occurring in the recorded image, which has the effect of reducing the number of adjustment steps and improving the image quality.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の一実施例を示すブロツク図、
第2図は第1図における記録部の要部斜視図、第
3図は第1図における記憶部の動作を説明するた
めのタイムチヤートである。 図において、2……記憶部、5……読出カウン
タ、6……可変分周器、7,22,25……
RAM、8……ROM、13……記録部、14…
…記録光学系。
FIG. 1 is a block diagram showing one embodiment of the present invention;
2 is a perspective view of a main part of the recording section in FIG. 1, and FIG. 3 is a time chart for explaining the operation of the storage section in FIG. 1. In the figure, 2...Storage unit, 5...Read counter, 6...Variable frequency divider, 7, 22, 25...
RAM, 8...ROM, 13...recording section, 14...
...recording optical system.

Claims (1)

【特許請求の範囲】[Claims] 1 光源、振動ミラを備える平面走査形の記録光
学系と、後続する走査線に対応する画素データを
書込み中に先行する走査線に対応する画素データ
を読出す少くとも2走査線に対応する前記画素デ
ータを格納する容量を有する第1の記憶手段と、
走査に先立つ準備期間に前記記録光学系からの記
録光点の記録走査部位における非等速性に起因す
る前記画素データそれぞれに対応する前記記録光
点それぞれの位置誤差を相殺するよう、前記第1
の記憶手段に対する前記画素データそれぞれ読出
タイミングを制御するそれぞれの補正データを書
込み、かつ該補正データをもつて前記画素データ
の読出しを行い該読出し結果に基づき前記補正デ
ータを順次更新して修正補正データを作成する第
2の記憶手段と、該第2の記憶手段に並列に設け
前記修正補正データを格納し、かつ記録走査時に
前記修正補正データをもつて前記画素データの前
記読出タイミングを制御する第3の記憶手段とを
含むことを特徴とする画信号修正装置。
1. A planar scanning type recording optical system including a light source and a vibrating mirror, and a recording optical system corresponding to at least two scanning lines for reading out pixel data corresponding to a preceding scanning line while writing pixel data corresponding to a subsequent scanning line. a first storage means having a capacity to store pixel data;
During the preparation period prior to scanning, the first recording light spot is configured to cancel the positional error of each of the recording light spots corresponding to each of the pixel data due to non-uniform velocity of the recording light spot from the recording optical system in the recording scanning region.
Write respective correction data for controlling the readout timing of each of the pixel data into the storage means, read out the pixel data with the correction data, update the correction data sequentially based on the readout result, and create modified correction data. a second storage means for creating the pixel data, and a second storage means for storing the modified correction data provided in parallel in the second storage means, and controlling the readout timing of the pixel data with the modified correction data during recording scanning. 3. An image signal modifying device comprising:
JP59219872A 1984-10-19 1984-10-19 Image signal correcting device Granted JPS6199458A (en)

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JPS6199458A JPS6199458A (en) 1986-05-17
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