JPH0424688Y2 - - Google Patents
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- JPH0424688Y2 JPH0424688Y2 JP1986081640U JP8164086U JPH0424688Y2 JP H0424688 Y2 JPH0424688 Y2 JP H0424688Y2 JP 1986081640 U JP1986081640 U JP 1986081640U JP 8164086 U JP8164086 U JP 8164086U JP H0424688 Y2 JPH0424688 Y2 JP H0424688Y2
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Description
【考案の詳細な説明】
〔産業上の利用分野〕
本考案は、高圧パルスの波高値を変化させて偏
向電流を増減するCRT（陰極線管）試験器におい
て使用されるトランジスタ駆動の偏向電流出力回
路に関する。[Detailed description of the invention] [Field of industrial application] The invention is a transistor-driven deflection current output circuit used in a CRT (cathode ray tube) tester that increases or decreases the deflection current by changing the peak value of a high-voltage pulse. Regarding.
CRT試験器においては、小型のCRTから大型
のCRTに到るまで、各種の偏向コイルに流す電
流（偏向電流）の異なるCRTの特性を検査する
ために、偏向電流の大きさをCRTに応じて増減
する必要がある場合がある。
In a CRT tester, the magnitude of the deflection current is adjusted depending on the CRT in order to test the characteristics of different CRTs, ranging from small CRTs to large CRTs. It may be necessary to increase or decrease.
このため、従来のCRT試験器においては、水
平出力回路の出力トランジスタに対する電流電圧
を変化させることにより、高圧パルス（鋸歯状
波）の波高値を変化させ、偏向電流を増減するよ
うにしていた。 For this reason, in conventional CRT testers, by changing the current voltage to the output transistor of the horizontal output circuit, the peak value of the high voltage pulse (sawtooth wave) is changed, and the deflection current is increased or decreased.
しかし、従来のCRT試験器においては、水平
出力回路の出力トランジスタのベース駆動電流
が、出力トランジスタに対する電源電圧の変化に
無関係に一定であつた。このため、水平出力回路
の出力、すなわち出力トランジスタに流れる電流
量に応じて出力トランジスタの蓄積電荷に起因し
て、鋸歯状波の波形の遅延時間が変化し、所望の
波形の偏向電流が得られなくなるという問題があ
つた。また、電流の増加に従つて、蓄積電荷によ
る遅れ時間が増加し高速スイツチングに適さない
という問題があつた。
However, in conventional CRT testers, the base drive current of the output transistor of the horizontal output circuit remains constant regardless of changes in the power supply voltage to the output transistor. Therefore, depending on the output of the horizontal output circuit, that is, the amount of current flowing through the output transistor, the delay time of the sawtooth waveform changes due to the accumulated charge of the output transistor, making it difficult to obtain a deflection current with the desired waveform. I had a problem with it disappearing. Another problem is that as the current increases, the delay time due to accumulated charge increases, making it unsuitable for high-speed switching.
本考案は、流すべき偏向電流の大きさに応じて
電源電圧を変化させた場合でも、CRTの偏向コ
イルを駆動する偏向電流が常に適正な値に設定さ
れ、出力トランジスタの蓄積時間が増加すること
がないCRT試験器の偏向電流出力回路を提供す
ることを目的とする。 This invention enables the deflection current that drives the CRT's deflection coil to be always set to an appropriate value even when the power supply voltage is changed depending on the magnitude of the deflection current to be passed, thereby increasing the storage time of the output transistor. The purpose is to provide a deflection current output circuit for a CRT tester that is free.
この目的を達成するため、本考案のCRT試験
器の偏向電流出力回路は、ベースにスイツチング
信号が供給される駆動トランジスタと、この駆動
トランジスタからの信号がそのベースに供給され
るエミツタ接地された出力トランジスタとを備
え、この出力トランジスタのコレクタと可変電圧
源端子との間にチヨークトランスの一次コイルを
接続し、前記出力トランジスタのコレクタとエミ
ツタとの間に水平偏向コイルと共振コンデンサの
並列回路を接続し、前記チヨークトランスの二次
側コイルに整流回路を接続するとともに、その整
流された電圧を前記駆動トランジスタのコレク
タ・エミツタ間に供給する構成としたことを特徴
とする。
To achieve this purpose, the deflection current output circuit of the CRT tester of the present invention consists of a drive transistor whose base is supplied with a switching signal, and an emitter-grounded output whose base is supplied with a signal from this drive transistor. a transistor, a primary coil of a choke transformer is connected between the collector of the output transistor and a variable voltage source terminal, and a parallel circuit of a horizontal deflection coil and a resonant capacitor is connected between the collector and emitter of the output transistor. A rectifier circuit is connected to the secondary coil of the chiyoke transformer, and the rectified voltage is supplied between the collector and emitter of the drive transistor.
本考案では、可変電圧源の電圧を増大させるに
つれてスイツチング用出力トランジスタのベース
ドライブ電流が増加するように働く。これにより
CRTの偏向コイルを駆動する偏向電流は常に適
正な値に設定され、蓄積電荷による入力出力間の
時間遅れは出力に拘わらず一定に管理され、また
その遅れ時間は極力小さいものとなる。
The present invention works to increase the base drive current of the switching output transistor as the voltage of the variable voltage source increases. This results in
The deflection current that drives the CRT's deflection coil is always set to an appropriate value, and the time delay between input and output due to accumulated charge is managed to be constant regardless of the output, and the delay time is kept as small as possible.
以下、本考案の実施例について図面を参照して
説明する。
Embodiments of the present invention will be described below with reference to the drawings.
第１図は本考案によるトランジスタ駆動回路の
第１実施例を示す。図において、そのベースにス
イツチング信号が供給される駆動トランジスタ１
のエミツタは接地され、そのコレクタは駆動トラ
ンス２の一次側コイル２ａと抵抗器３の直列回路
を介して、例えば0V〜100Vの間で変化する正極
性の直流電圧が供給される可変電圧源端子４に接
続される。また、駆動トランス２の一次側コイル
２ａと抵抗器３の接続点はコンデンサ５を介して
接地される。駆動トランス２の二次側コイル２ｂ
は出力トランジスタ６のベース・エミツタ間に接
続され、出力トランジスタ６のエミツタは接地さ
れ、そのコレクタはチヨークトランス７の一次側
コイル７ａを介して、上述の可変電圧源端子４に
接続される。 FIG. 1 shows a first embodiment of a transistor drive circuit according to the present invention. In the figure, a drive transistor 1 whose base is supplied with a switching signal
The emitter of is grounded, and its collector is a variable voltage source terminal to which a positive DC voltage varying between 0V and 100V is supplied, for example, through a series circuit of the primary coil 2a of the drive transformer 2 and the resistor 3. Connected to 4. Further, a connection point between the primary coil 2a of the drive transformer 2 and the resistor 3 is grounded via a capacitor 5. Secondary coil 2b of drive transformer 2
is connected between the base and emitter of the output transistor 6, the emitter of the output transistor 6 is grounded, and its collector is connected to the above-mentioned variable voltage source terminal 4 via the primary coil 7a of the choke transformer 7.
また、出力トランジスタ６のコレクタ・エミツ
タ間にはダンパーダイオード８、共振コンデンサ
９および水平偏向コイル１０の並列回路が接続さ
れる。 Further, a parallel circuit including a damper diode 8, a resonant capacitor 9, and a horizontal deflection coil 10 is connected between the collector and emitter of the output transistor 6.
更に、本考案の第１実施例においては、チヨー
クトランス７の二次側コイル７ｂの中点が接地さ
れ二次側コイル７ｂの両端がダイオード１１，１
２の各アノードに接続され、ダイオード１１，１
２の各カソードが共通接続される。この共通接続
点がコンデンサ１３を介して接地されると共に、
抵抗器１４を介して、駆動トランス２の一次側コ
イル２ａと抵抗器３の接続点に接続される。 Furthermore, in the first embodiment of the present invention, the middle point of the secondary coil 7b of the chiyoke transformer 7 is grounded, and both ends of the secondary coil 7b are connected to the diodes 11, 1.
connected to each anode of diodes 11,1
The two cathodes are commonly connected. This common connection point is grounded via the capacitor 13, and
It is connected to the connection point between the primary coil 2 a of the drive transformer 2 and the resistor 3 via the resistor 14 .
つぎに動作を説明する。 Next, the operation will be explained.
駆動トランジスタ１で、駆動トランス２の一次
側コイル２ａに流れる電流が断続されることによ
り、駆動トランス２の二次側コイル２ｂに駆動パ
ルスが発生する。この駆動パルスが出力トランジ
スタ６のベースに供給され、出力トランジスタ６
がオンオフされ、偏向コイル１０には鋸歯状波の
偏向電流が流れる。なお、この水平出力回路自体
の動作は周知なので詳細な説明は省略する。この
とき、可変電圧源端子４の電圧を可変することに
より出力トランジスタ６に対する電源電圧が変更
され、水平偏向コイル１０に流れる偏向電流を増
減することができる。 A drive pulse is generated in the secondary coil 2b of the drive transformer 2 by intermittent current flowing through the primary coil 2a of the drive transformer 2 by the drive transistor 1. This drive pulse is supplied to the base of the output transistor 6, and the output transistor 6
is turned on and off, and a sawtooth wave deflection current flows through the deflection coil 10. Note that since the operation of this horizontal output circuit itself is well known, detailed explanation will be omitted. At this time, by varying the voltage of the variable voltage source terminal 4, the power supply voltage to the output transistor 6 is changed, and the deflection current flowing through the horizontal deflection coil 10 can be increased or decreased.
また、チヨークトランス７の二次側コイル７ｂ
に発生するパルス電圧がダイオード１１，１２お
よびコンデンサ１３から構成される整流回路１５
により直流化され、駆動トランジスタ１に対する
電源電圧として供給される。したがつて、例え
ば、可変電圧源端子４の電圧を高くして水平偏向
コイル１０に流れる偏向電流を増加させた場合、
駆動トランス２の二次側コイル２ｂからの出力が
大となり、出力トランジスタ６に対するベース駆
動電流も増加し、出力トランジスタ６の電流増加
に伴う蓄積時間の増加を抑えることができる。 In addition, the secondary coil 7b of the Chiyoke transformer 7
The pulse voltage generated in the rectifier circuit 15 consisting of diodes 11, 12 and a capacitor 13
The voltage is converted into a direct current and supplied as a power supply voltage to the drive transistor 1. Therefore, for example, if the voltage at the variable voltage source terminal 4 is increased to increase the deflection current flowing through the horizontal deflection coil 10,
The output from the secondary coil 2b of the drive transformer 2 increases, the base drive current for the output transistor 6 also increases, and an increase in the storage time due to an increase in the current of the output transistor 6 can be suppressed.
更に、可変電圧源端子４からの電圧も、抵抗器
３を介して、駆動トランジスタ１に対する電源電
圧として供給されるので、一層補償効果を高める
ことができる。 Furthermore, since the voltage from the variable voltage source terminal 4 is also supplied as a power supply voltage to the drive transistor 1 via the resistor 3, the compensation effect can be further enhanced.
つぎに、本考案の第２実施例について第２図を
参照して説明する。 Next, a second embodiment of the present invention will be described with reference to FIG.
図において、そのベースにスイツチング信号が
供給される駆動トランジスタ１のエミツタは抵抗
器１６を介して負電源端子１７に接続されると共
に、コンデンサ１８を介して接地される。また、
駆動トランジスタ１のコレクタは出力トランジス
タ６のベースに直流的に接続されると共に、イン
ダクタンス素子１９を介して接地される。出力ト
ランジスタ６のコレクタはチヨークトランス７の
一次側コイル７ａを介して可変電圧源端子４に接
続され、そのエミツタは接地される。また、出力
トランジスタ６のコレクタ・エミツタ間にはダン
パーダイオード８、共振コンデンサ９および水平
偏向コイル１０の並列回路が接続される。 In the figure, the emitter of a drive transistor 1 whose base is supplied with a switching signal is connected to a negative power supply terminal 17 via a resistor 16 and grounded via a capacitor 18. Also,
The collector of the drive transistor 1 is connected to the base of the output transistor 6 in a DC manner and is grounded via an inductance element 19. The collector of the output transistor 6 is connected to the variable voltage source terminal 4 via the primary coil 7a of the choke transformer 7, and its emitter is grounded. Further, a parallel circuit including a damper diode 8, a resonant capacitor 9, and a horizontal deflection coil 10 is connected between the collector and emitter of the output transistor 6.
更に、チヨークトランス７の二次側コイル７ｂ
の中点が接地され、二次側コイル７ｂの両端がダ
イオード２０，２１の各カソードに接続され、ダ
イオード２０，２１の各アノードが共通接続さ
れ、この共通接続点がコンデンサ２２を介して接
地されると共に、抵抗器２３を介して、駆動トラ
ンジスタ１と抵抗器１６の接続点に接続される。 Furthermore, the secondary coil 7b of the Chiyoke transformer 7
The middle point is grounded, both ends of the secondary coil 7b are connected to the cathodes of the diodes 20 and 21, the anodes of the diodes 20 and 21 are commonly connected, and this common connection point is grounded via the capacitor 22. At the same time, it is connected to the connection point between the drive transistor 1 and the resistor 16 via the resistor 23.
つぎに動作について説明する。 Next, the operation will be explained.
駆動トランジスタ１がオンになると、接地−イ
ンダクタンス素子１９−駆動トランジスタ１のコ
レクタ・エミツタ通路−抵抗器１６−負電源端子
１７の経路で電流が流れてインダクタンス素子１
９にエネルギが蓄積される。これと共に、出力ト
ランジスタ６のベースが負に引かれ、ベース電荷
が引き抜かれ、出力トランジスタ６はカツトオフ
する。このとき、第１図の実施例に比して、駆動
トランジスタ１のコレクタと出力トランジスタ６
のベースの間には、駆動トランス２のリーケージ
インダクタンスが存在しないため、ベース電荷を
急激に引き抜くことができ、出力トランジスタ６
を急速にカツトオフすることができる。すなわ
ち、出力トランジスタ６をオフする際、出力トラ
ンジスタ６のベースから蓄積電荷を強制的に引き
抜くことができるため、蓄積時間を大幅に短縮で
き、高速スイツチングが可能になる。 When the drive transistor 1 is turned on, a current flows through the path of the ground, the inductance element 19, the collector/emitter path of the drive transistor 1, the resistor 16, and the negative power supply terminal 17.
Energy is stored in 9. At the same time, the base of the output transistor 6 is pulled negative, the base charge is extracted, and the output transistor 6 is cut off. At this time, compared to the embodiment shown in FIG. 1, the collector of the drive transistor 1 and the output transistor 6
Since there is no leakage inductance of the drive transformer 2 between the bases of the output transistor 6, the base charge can be rapidly extracted, and the output transistor 6
can be cut off rapidly. That is, when the output transistor 6 is turned off, the accumulated charge can be forcibly extracted from the base of the output transistor 6, so that the accumulation time can be significantly shortened and high-speed switching becomes possible.
つぎに、駆動トランジスタ１がオフになると、
インダクタンス素子１９に蓄積されたエネルギに
よりインダクタンス素子１９の両端電圧が上昇
し、出力トランジスタ６のベース電位が0.6V程
度になつたとき、インダクタンス素子１９から出
力トランジスタ６のベースに電流が流れ、出力ト
ランジスタ６がオンになる。 Next, when drive transistor 1 is turned off,
When the voltage across the inductance element 19 increases due to the energy stored in the inductance element 19 and the base potential of the output transistor 6 reaches approximately 0.6V, a current flows from the inductance element 19 to the base of the output transistor 6, and the output transistor 6 is turned on.
上述の動作が繰り返されることにより、偏向コ
イル１０には鋸歯状波の偏向電流が流れる。この
とき、可変電圧源端子４の電圧を可変することに
より出力トランジスタ６に対する電源電圧が変更
され、水平偏向コイル１０に流れる偏向電流を増
減することができる。 By repeating the above-described operation, a sawtooth wave deflection current flows through the deflection coil 10. At this time, by varying the voltage of the variable voltage source terminal 4, the power supply voltage to the output transistor 6 is changed, and the deflection current flowing through the horizontal deflection coil 10 can be increased or decreased.
更に、チヨークトランス７の二次側コイル７ｂ
に発生するパルス電圧がダイオード２０，２１お
よびコンデンサ２２から構成される整流回路２４
により直流化され、駆動トランジスタ１のエミツ
タに供給される。したがつて、例えば、可変電圧
源端子４の電圧を高くして水平偏向コイル１０に
流れる偏向電流を増加させた場合、駆動トランジ
スタ１のコレクタ・エミツタ間電圧が上昇するの
で、出力トランジスタ６のベース駆動電流も増加
し、出力トランジスタ６の電流増加に伴う蓄積時
間の増加を抑えるとができる。 Furthermore, the secondary coil 7b of the Chiyoke transformer 7
The pulse voltage generated in the rectifier circuit 24 consisting of diodes 20, 21 and a capacitor 22
The voltage is converted into a direct current and supplied to the emitter of the drive transistor 1. Therefore, for example, if the voltage at the variable voltage source terminal 4 is increased to increase the deflection current flowing through the horizontal deflection coil 10, the voltage between the collector and emitter of the drive transistor 1 will increase, so that the voltage at the base of the output transistor 6 will increase. The drive current also increases, and an increase in storage time due to an increase in the current of the output transistor 6 can be suppressed.
以上述べたように、本考案によれば、各種の
CRTの試験に際して可変電圧源端子の電圧を増
減したときに、出力トランジスタのベース電流も
それに応じて増減するようにしたので、出力トラ
ンジスタに対するベース駆動電流をそのCRTの
偏向電流に応じた常に適正な値となるようにする
ことができる。したがつて、蓄積電荷に起因する
入力・出力間の遅延時間を、出力の大きさに無関
係に一定に管理することができ検査上都合が良
い。また、遅延時間を短くすることができるの
で、高速スイツチングに適するという効果があ
る。
As mentioned above, according to the present invention, various types of
When testing a CRT, when the voltage at the variable voltage source terminal is increased or decreased, the base current of the output transistor is also increased or decreased accordingly, so the base drive current for the output transistor is always adjusted to the appropriate level according to the deflection current of the CRT. value. Therefore, the delay time between input and output caused by accumulated charges can be kept constant regardless of the magnitude of the output, which is convenient for inspection. Furthermore, since the delay time can be shortened, there is an effect that it is suitable for high-speed switching.
第１図は、本考案の第１実施例によるCRT試
験器の偏向電流出力回路を示す回路図、第２図は
本考案の第２実施例によるCRT試験器の偏向電
流出力回路を示す回路図である。
１……駆動トランジスタ、２……駆動トラン
ス、４……可変電圧源端子、６……出力トランジ
スタ、７……チヨークトランス、８……ダンパー
ダイオード、９……共振コンデンサ、１０……水
平偏向コイル、１１，１２……ダイオード、１３
……コンデンサ、１５……整流回路、１７……負
電源端子、１９……インダクタンス素子、２０，
２１……ダイオード、２４……整流回路。
FIG. 1 is a circuit diagram showing a deflection current output circuit of a CRT tester according to a first embodiment of the present invention, and FIG. 2 is a circuit diagram showing a deflection current output circuit of a CRT tester according to a second embodiment of the present invention. It is. 1... Drive transistor, 2... Drive transformer, 4... Variable voltage source terminal, 6... Output transistor, 7... Chiyoke transformer, 8... Damper diode, 9... Resonance capacitor, 10... Horizontal deflection Coil, 11, 12...Diode, 13
... Capacitor, 15 ... Rectifier circuit, 17 ... Negative power supply terminal, 19 ... Inductance element, 20,
21...diode, 24...rectifier circuit.
Claims (1)
ランジスタ１と、この駆動トランジスタ１からの
信号がそのベースに供給されるエミツタ接地され
た出力トランジスタ６とを備え、この出力トラン
ジスタ６のコレクタと可変電圧源端子４との間に
チヨークトランス７の一次コイル７ａを接続し、
前記出力トランジスタ６のコレクタとエミツタと
の間に水平偏向コイル１０と共振コンデンサ９の
並列回路を接続し、前記チヨークトランス７の二
次側コイル７ｂに整流回路を接続するとともに、
その整流された電圧を前記駆動トランジスタ１の
コレクタ・エミツタ間に供給する構成としたこと
を特徴とするCRT試験器の偏向電流出力回路。 It comprises a drive transistor 1 whose base is supplied with a switching signal, and an output transistor 6 whose base is supplied with a signal from the drive transistor 1 whose emitter is grounded. The primary coil 7a of the Chiyoke transformer 7 is connected between the
A parallel circuit of a horizontal deflection coil 10 and a resonant capacitor 9 is connected between the collector and emitter of the output transistor 6, and a rectifier circuit is connected to the secondary coil 7b of the York transformer 7.
A deflection current output circuit for a CRT tester, characterized in that the rectified voltage is supplied between the collector and emitter of the drive transistor 1.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1986081640U JPH0424688Y2 (en) | 1986-05-28 | 1986-05-28 |
Applications Claiming Priority (1)
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|---|---|---|---|
| JP1986081640U JPH0424688Y2 (en) | 1986-05-28 | 1986-05-28 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62193371U JPS62193371U (en) | 1987-12-09 |
| JPH0424688Y2 true JPH0424688Y2 (en) | 1992-06-11 |
Family
ID=30933562
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1986081640U Expired JPH0424688Y2 (en) | 1986-05-28 | 1986-05-28 |
Country Status (1)
| Country | Link |
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| JP (1) | JPH0424688Y2 (en) |
Families Citing this family (1)
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|---|---|---|---|---|
| JP2705231B2 (en) * | 1989-07-25 | 1998-01-28 | ソニー株式会社 | Horizontal drive circuit |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS582916A (en) * | 1981-06-29 | 1983-01-08 | Nec Corp | Switching power supply circuit |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57128249U (en) * | 1981-02-02 | 1982-08-10 |
-
1986
- 1986-05-28 JP JP1986081640U patent/JPH0424688Y2/ja not_active Expired
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS582916A (en) * | 1981-06-29 | 1983-01-08 | Nec Corp | Switching power supply circuit |
Also Published As
| Publication number | Publication date |
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| JPS62193371U (en) | 1987-12-09 |
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