JPH04172547A - Data storage device with data protective function - Google Patents

Data storage device with data protective function

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JPH04172547A
JPH04172547A JP2301533A JP30153390A JPH04172547A JP H04172547 A JPH04172547 A JP H04172547A JP 2301533 A JP2301533 A JP 2301533A JP 30153390 A JP30153390 A JP 30153390A JP H04172547 A JPH04172547 A JP H04172547A
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JP
Japan
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data
battery
volatile storage
storage means
storage device
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Application number
JP2301533A
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Japanese (ja)
Inventor
Yoshibumi Yamao
山尾 義文
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Casio Computer Co Ltd
Original Assignee
Casio Computer Co Ltd
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Publication date
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Abstract

PURPOSE:To obtain a data storage device with data protective function by transferring some that should be preserved by storage out of data that are in store in a volatile storage means to an electrically reloadable non-volatile storage means when replacing the battery with a new one. CONSTITUTION:When a slide switch SW5 is slid as far as an off position in order to replace battery E with a new one, CPU 1a detects that battery E is to be replaced and carries out a received data saving processing. First, the CPU 1a sends a signal Y to a DC-DC converter 6, and sets a voltage to be supplied to E<2>PROM 5 at 5V that is necessary for writing. Further, a clock signal is sent RTOM5 to specify a leading address for saving area, followed by sending a writing command signal to ROM 5 to make it writable. Furthermore, of received data units stored in RAM 1c, those to which a protect flag have been set up are read out and synchronized with the clock signal, followed by transferring them to ROM 5, further followed by sequentially storing them in a saving area.

Description

【発明の詳細な説明】 [発明の技術分野] 本発明はデータ保護機能付きデータ記憶装置に関する。[Detailed description of the invention] [Technical field of invention] The present invention relates to a data storage device with data protection functions.

[従来技術とその問題点] 従来のデータ保護機能付きデータ記憶装置としては、記
憶保持専用の電池を設けるもの或は容量の大きいバック
アップコンデンサを設けるもの等があった。
[Prior Art and its Problems] Conventional data storage devices with a data protection function include those equipped with a battery exclusively for memory retention, or those equipped with a large-capacity backup capacitor.

しかし、この種のものは、上記記憶保持専用の電池が寿
命で記憶保持ができなくなっていることに気付かず電源
電池交換等を行なったときは、貴重な記憶データを失な
うことがあり、また、バックアップコンデンサでは、限
られた時間の記憶保持しかできず、電池交換時等におい
ては、その時間的余裕に関し十分満足できるものではな
かった。
However, with this type of device, if you replace the power supply battery without realizing that the memory retention battery has reached the end of its lifespan and is no longer able to retain memory, you may lose valuable stored data. In addition, the backup capacitor can only maintain memory for a limited time, and the time margin when replacing the battery is not sufficiently satisfactory.

[発明の目的] 本発明は上述の如き事情に鑑みてなされたものであり、
電池交換等に際し、−層完全な記憶保持ができるデータ
保護機能付きデータ記憶装置の提供を目的とする。
[Object of the invention] The present invention has been made in view of the above circumstances, and
The purpose of the present invention is to provide a data storage device with a data protection function that can maintain complete memory when replacing batteries or the like.

[発明の要点J 本発明は上述した目的を達成するために、電池交換に際
しては、揮発性の記憶手段に記憶されているデータのう
ち記憶保持すべきものを電気的に書換え可能な不揮発性
記憶手段に転送して記憶するようにしたことを要旨とす
る。
[Summary of the Invention J In order to achieve the above-mentioned object, the present invention provides a non-volatile storage means that can electrically rewrite data to be stored and retained among the data stored in the volatile storage means when replacing the battery. The gist is that the information is transferred to and stored in the computer.

[実施例コ 以下、図面に示す一実施例に基づいて本発明を具体的に
説明する。なお、本実施例はメツセージデータ受信機能
付きベージング受信機のデータ記憶装置に本発明を適用
したものである。
[Embodiment] The present invention will be specifically described below based on an embodiment shown in the drawings. In this embodiment, the present invention is applied to a data storage device of a paging receiver with a message data receiving function.

第1図は、ページング受信機の回路構成を示す図である
。すなわち、CPU1a、デコーダlb、RAM1cか
らなるデコーダ等内蔵のワンチップマイクロコンピュー
タ1を中心に他の回路部が、これに接続する構成となっ
ている。無線部3はアンテナ2で受信されたFM信号を
復調等する回路であり、波形整形部4は無線部3から復
調されて送られてきた信号波の波形を整える回路部であ
る。
FIG. 1 is a diagram showing the circuit configuration of a paging receiver. That is, the configuration is centered around a one-chip microcomputer 1 with a built-in decoder including a CPU 1a, a decoder lb, and a RAM 1c, and other circuit sections are connected to this. The radio section 3 is a circuit that demodulates the FM signal received by the antenna 2, and the waveform shaping section 4 is a circuit section that shapes the waveform of the signal wave demodulated and sent from the radio section 3.

E2 FROM5はコネクタ5a、5b、5cを介して
デコーダ等内蔵ワンチップマイクロコンピュータlに、
またコネクタ5dを介してDC−DCコンバータ6に接
続されたE2 FROMで、当該ベージング受信機に割
当てられているアドレスデータを記憶している自己アド
レスデータ記憶エリア(該エリアへの上記アドレスデー
タの書込ミハ、ベージングサービス会社等がROMライ
タ等により行なう)と、RAM1cの所定のデータが転
送されてきたとき、それを記憶する退避データ記憶エリ
アとを備え、デコーダ1bからのクロック信号に同期し
てデコーダibに上記アドレスデータを送り、CPU1
aからのクロック信号に同期してCPolaとの間で上
記所定のデータの授受を行なう回路部である。
E2 FROM 5 connects to the one-chip microcomputer l with built-in decoder etc. via connectors 5a, 5b, and 5c.
Also, in the E2 FROM connected to the DC-DC converter 6 via the connector 5d, there is a self-address data storage area that stores the address data assigned to the paging receiver (the address data cannot be written to this area). The decoder 1b is synchronized with the clock signal from the decoder 1b, and has a save data storage area for storing the predetermined data of the RAM 1c when it is transferred. sends the above address data to decoder ib, and CPU1
This is a circuit unit that exchanges the above-mentioned predetermined data with CPola in synchronization with a clock signal from a.

DC−DCコンバータ6は電源電池Eよりの電圧をCP
U1aからの信号に応じた電圧に切替えてE2 FRO
M5に与る回路部である。すなわち、E2 FROM5
に記憶されている受信データを読出すときにCPU1a
から送られてくる信号Xを受けて電源電池Eからの電圧
を1.5 VにしてE2 FROM5に与え、E2 F
ROM5に受信7−−タを書込むときにCPUIJLか
ら送られてくる信号Yを受けて電源電池Eからの電圧を
5vにしてE2 P110M5に与える回路である。
The DC-DC converter 6 converts the voltage from the power supply battery E into CP
Switch to the voltage according to the signal from U1a and E2 FRO
This is a circuit section that applies to M5. That is, E2 FROM5
When reading received data stored in the CPU 1a
In response to the signal
This circuit receives the signal Y sent from the CPUIJL when writing the reception data to the ROM5, converts the voltage from the power supply battery E to 5V, and supplies it to the E2 P110M5.

デコーダ1bはCPU1aからの信号を受けてE2 F
ROM5に前記クロック信号を送ってE2FROMに記
憶されているアドレスデータを取り込み、以後、自己へ
の送信タイミング毎に無線部3および波形整形部4に電
源を間欠供給すると共に、波形整形部4から送られてき
た受信信号を。
The decoder 1b receives the signal from the CPU 1a and decodes E2F.
The clock signal is sent to the ROM 5 to fetch the address data stored in the E2FROM, and thereafter, power is intermittently supplied to the wireless section 3 and the waveform shaping section 4 at each transmission timing to the self, and the data is sent from the waveform shaping section 4. received signals.

取り込んだアドレスデータに基づいて解読し、それが自
己に対して送られてきたものであるときは、それをCP
U1aに送る回路である。
Decode it based on the captured address data, and if it is sent to yourself, send it to the CP.
This is the circuit that sends it to U1a.

CPolaは、各種スイッチの開閉状態等に応じて各回
路部へ信号を送って、それらを制御する回路部である。
CPola is a circuit unit that sends signals to each circuit unit according to the open/close states of various switches and controls them.

RAM1cはCPU1aから送られてくる受信データ等
を記憶する回路部である。なお、該RAMlcには、送
られてきた受信データが記憶保護を要するものであると
きは、その旨を示すプロテクトフラグを立てるエリアも
設けられている。
The RAM 1c is a circuit section that stores received data etc. sent from the CPU 1a. The RAMlc is also provided with an area in which a protect flag is set if the received data that has been sent requires storage protection.

電池蓋開閉検出スイッチsw】は電源電池Eの収納部の
蓋が開かれたときにオン状態となり、上記蓋が閉じられ
たときにオフ状態となるスイッチである。リセットスイ
ッチSW2は、スピーカ8による鳴音の停止、或いはL
CD9による受信データの表示等を停止する際に操作す
るスイッチである0表示スイッチSW3はRAM1cに
記憶されている受信データを順次LCD9に表示してい
く際等に操作されるスイッチである。プロテクトスイッ
チSW4は、受信したデータが記憶保護を要するもので
あるときに、該データのRAM1cにおける記憶部のフ
ラグエリアに、その旨を示すプロテクトフラグを立てる
べく操作するスイッチである。スライドスイッチSWs
はCPU1aに接続している接点PI 、P2 と、接
地している接点P3とを備え、スライド位置によりこれ
らを選択的に接続する。なお、該スライドスイッチSW
sの接点PI 、P2 を接点P3 に接続する鳴音ポ
ジションは、受信があったとき受信音を発生せしめる鳴
音モードにするときに選択され、接点P2のみを接点P
3に接続する無音ポジションは受信があっても上記受信
音を発生せしめない無音モードにするときに選択され、
接点P+ 、P2のいずれもが接点P3に接続しないオ
フポジションは、後述の電源電池Eから各回路部への電
力供給を停止する際に選択される。
The battery cover opening/closing detection switch sw is a switch that is turned on when the lid of the storage section of the power source battery E is opened, and turned off when the lid is closed. The reset switch SW2 is used to stop the sound from the speaker 8 or to
The 0 display switch SW3, which is a switch operated to stop displaying received data on the CD 9, is a switch operated when sequentially displaying received data stored in the RAM 1c on the LCD 9. The protect switch SW4 is a switch that is operated when the received data requires storage protection, to set a protect flag indicating this in the flag area of the storage section of the RAM 1c of the data. Slide switch SWs
has contacts PI, P2 connected to the CPU 1a and a contact P3 grounded, and these are selectively connected depending on the sliding position. In addition, the slide switch SW
The sound position where contacts PI and P2 of s are connected to contact P3 is selected when setting the sound mode to generate a reception sound when there is a reception, and connects only contact P2 to contact P3.
The silent position connected to 3 is selected to set the silent mode in which the above-mentioned reception sound is not generated even if there is a reception,
The off position, in which neither contact P+ nor P2 is connected to contact P3, is selected when stopping power supply from power supply battery E to each circuit section, which will be described later.

スピーカドライバ7はCPU1aからの信号を受けて、
スピーカ8を駆動して受信音等を発生せしめる回路部で
ある。LCD9はCPU1aの信号を受け、受信データ
等を表示する回路部である。
The speaker driver 7 receives the signal from the CPU 1a,
This is a circuit section that drives the speaker 8 to generate received sound and the like. The LCD 9 is a circuit section that receives signals from the CPU 1a and displays received data and the like.

また、電源電池Eは各回路部に電力を供給する電源電池
である。
Further, the power supply battery E is a power supply battery that supplies power to each circuit section.

次に、以上の如くに構成された未実施例の動作について
説明する。
Next, the operation of the non-embodiment configured as described above will be explained.

例えば、いまRAM1cには、既に受信した受信データ
が多数記憶されており、その中のいくつかは、記憶保護
をすべきもので、前記プロテクトフラグが立てられてい
るものとする。ここで、電源電池Eの交換等のためスラ
イドスイッチSW5を前述のオフポジションにスライド
せしめたとき、或いは、電源電池Eの収納部の蓋を開け
たときは(なお、スライドスイッチSW5をオフポジシ
ョンした後に上記蓋を開けたときも同様となる)ごCP
U1aは接点P、、P2 を介して与えられる信号レベ
ルがアースレベルでなくなったこと或いは電池蓋開閉検
出スイッチSWIがオン状態となりこれを介して与えら
れる信号レベルがアースレベルになったことより、電源
電池Eが交換されることを検出し、以下の受信データ退
避処理を実行する。すなわち、先ず、DC−DCコンバ
ータ6に信号Yを送り、E2 FROM5に供給する電
源電圧を書込みに必要な5vにせしめ1次いでクロック
信号をE2 FROM5に送り、前記退避エリアの先頭
アドレスを指定した後、E2FROM5に書込み指令信
号を送り、E2 FROM5を書込み可能状態に設定す
る。然る後、RAM1cに記憶されている受信データの
うちプロテクトフラグが立てられているものを読出し、
該受信データをクロック信号とともに該信号に同期させ
てE2 FROM5に転送し、上記退避エリアに順次記
憶せしめていく。
For example, it is assumed that a large amount of received data that has already been received is stored in the RAM 1c, some of which should be protected, and the protect flag has been set. Here, when you slide the slide switch SW5 to the above-mentioned off position to replace the power battery E, or when you open the lid of the storage compartment for the power battery E (note that when you slide the slide switch SW5 to the off position) The same thing will happen when you open the above lid later)
U1a is connected to the power supply because the signal level applied via contacts P, P2 is no longer the ground level, or the battery cover opening/closing detection switch SWI is turned on and the signal level applied via it becomes the ground level. It is detected that the battery E is replaced, and the following received data saving process is executed. That is, first, a signal Y is sent to the DC-DC converter 6 to set the power supply voltage supplied to the E2 FROM 5 to 5V necessary for writing, and then a clock signal is sent to the E2 FROM 5 to specify the start address of the save area. , sends a write command signal to the E2FROM5, and sets the E2FROM5 to a writable state. After that, among the received data stored in the RAM 1c, the data with the protect flag set is read out,
The received data is transferred to the E2 FROM 5 in synchronization with the clock signal and sequentially stored in the save area.

以上の如くして、記憶保護をすべき受信データがE2 
FROM5の退避エリアに書込まれた後には、電源電池
Eが取外され各回路部への電源供給が停止されても、こ
のE2 FROM5の記憶は消去されることがないので
、十分な記憶保持ができることになる。
As described above, the received data that should be protected is E2.
After being written to the save area of FROM5, even if the power supply battery E is removed and the power supply to each circuit is stopped, the memory of this E2 FROM5 will not be erased, so sufficient memory retention will be ensured. will be possible.

また、上記の如くして電源電池Eの交換を終えた後、電
源電池Eの収納部の蓋を閉じ、電池蓋開閉検出スイッチ
SW+ をオフ状態としたとき、或いはスライドスイッ
チSWsを鳴音ボジションン又は無音ポジションとした
ときは、電池蓋開閉検出スイッチSWI を介して送ら
れてくる信号のレベルがアースレベルではなくなったこ
と或いは接点PI 、P2のうちの少なくても一方を介
して送られてくる信号のレベルがアースレベルになった
ことより、CPU1aは、電池交換等が終了したことを
検出し、以下の処理を実行する。すなわち5先ず、DC
−DCコンバータ6に信号Xを送り、E2 FROM5
に供給する電源電圧を読出しの際の1.5V、!−L、
次イテ、CPU1a4*、デコーダlbに起動信号を与
えてE2 FROM5からの自己アドレスデータの読取
りおよびその記憶処理を行なわしめ、更に、受信電波と
の同期確立のための処理へと進ませる。
In addition, after replacing the power battery E as described above, when the lid of the storage compartment of the power battery E is closed and the battery lid opening/closing detection switch SW+ is turned off, or when the slide switch SWs is turned to the sound position or When the silent position is set, the level of the signal sent via the battery cover opening/closing detection switch SWI is no longer the ground level, or the signal sent via at least one of the contacts PI and P2. Since the level of has become the ground level, the CPU 1a detects that battery replacement etc. have been completed, and executes the following processing. That is, 5 First, DC
- Send signal X to DC converter 6, E2 FROM5
1.5V when reading the power supply voltage supplied to the ! -L,
Next, a start signal is given to the CPU 1a4* and the decoder lb to read the self-address data from the E2 FROM 5 and store it, and then proceed to the process for establishing synchronization with the received radio waves.

また、デコーダ1bでの上記記憶処理が終了したときに
は、CPU1aはE2 PROM5にクロック信号を送
って退避レジスタに退避せしめておいた前記受信データ
をシリアルに読取り、これをRAM1cに転送して記憶
せしめる。
Further, when the above storage process in the decoder 1b is completed, the CPU 1a sends a clock signal to the E2 PROM 5, serially reads the received data saved in the save register, and transfers it to the RAM 1c for storage.

次に本発明の他の実施例について説明する。第2図は該
実施例の回路構成を示すものであり、概ね、前述の実施
例の回路構成に等しいが(第2図において第1図と同一
符号のものは同一機能を有する)、以下の点で異なって
いる。前述の実施例ではE2 PflOM5が自己アド
レ4スデータと記憶保護を要する受信データとを記憶す
る構成であったが、本実施例では自己アドレスデータを
記憶するROM (ID−ROMI O&)k記憶ms
をwする受信データを退避させるためのROM (E2
FROMI Ob)とを別体構成としている。また、前
述の実施例には設けられていなかったモード切換スイッ
チS、Wmが設けられており、これにより、受信データ
をLCD9に表示等する際の通常モード以外に、電話番
号データ等をLCD9に表示せしめる際の電話番号モー
ドおよびその電話番号データを書込む際の電話番号書込
みモード等を選択できるようになっている。
Next, other embodiments of the present invention will be described. Figure 2 shows the circuit configuration of this embodiment, which is generally the same as the circuit configuration of the previous embodiment (in Figure 2, the same reference numerals as in Figure 1 have the same functions), but the following: They differ in some respects. In the above-described embodiment, the E2 PflOM5 was configured to store self-address data and received data that requires memory protection, but in this embodiment, the ROM (ID-ROMI O&)k storage ms stores self-address data.
ROM (E2
FROMI Ob) is a separate structure. In addition, mode changeover switches S and Wm, which were not provided in the above-mentioned embodiments, are provided, so that in addition to the normal mode for displaying received data on the LCD 9, telephone number data etc. can be displayed on the LCD 9. It is possible to select the telephone number mode for displaying, the telephone number writing mode for writing the telephone number data, etc.

本実施例の如き構成にしたときは、E2 FROMlo
bに自己アドレスデータを記憶させる必要がないのでE
2 FROMI Obに対するデータの入出力をシリア
ルではなく、4ビット単位等にして、パラレルに行なえ
、延いては書込み、読出しエリアをアドレスで指定でき
ることになる。
When configured as in this embodiment, E2 FROMlo
There is no need to store self-address data in b, so E
2. Data input/output to/from FROMI Ob can be performed in parallel, not serially, but in units of 4 bits, etc., and by extension, writing and reading areas can be specified by addresses.

なお、この発明は上記実施例に限定されず、この発明を
逸脱しない範囲内において種々変形応用可能である0例
えば、前述の一実施例は、記憶保護を要するとし、受信
時にプロテクトフラグを立てた受信データのみをE2 
FROMに退避せしめるものであったが、E2 FRO
M内の退避エリアの容量をRAM内の受信メツセージ記
憶エリアの容量と等しくて、全ての受信データを退避せ
しめるようにしてもよいことは無論である。
Note that this invention is not limited to the embodiments described above, and can be modified and applied in various ways without departing from the scope of the invention. Only the received data is sent to E2.
It was intended to be saved to FROM, but E2 FRO
Of course, the capacity of the save area in M may be made equal to the capacity of the received message storage area in the RAM, so that all received data can be saved.

[発明の効果] 本発明は以上詳細したように、電池交換に際しては、揮
発性の記憶手段に記憶されているデータのうち記憶保持
すべきものを電気的に書換え可能な不揮発性記憶手段に
転送して記憶するようにしたデータ保護機能付きデータ
記憶装置に係るものであるから、電池交換等に際し、−
層完全な記憶保持ができるデータ保護機能付きデータ記
憶装置の提供を可能とする。
[Effects of the Invention] As detailed above, the present invention transfers the data stored in the volatile storage means to the electrically rewritable nonvolatile storage means when replacing the battery. Since this relates to a data storage device with a data protection function that stores data using
It is possible to provide a data storage device with a data protection function that can maintain complete storage.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の一実施例の回路構成を示す図、第2図
は本発明の他の実施例の回路構成を示す図である。 l・・・・・・デコーダ等内蔵ワンチップマイコン。 2・・・・・・アンテナ、3・・・・・・無線部、4・
・・・・・波形整形部、5、iob・・・・・・E2 
FROM、6・・・・・・DC−DCコンバータ、7・
・・・・・スピーカドライバ、8・・・・・・スピーカ
、9・・・・・・LCD、10a・・・・・・ID−f
lOM、la・・・・・・CPU、1b・・・・・・デ
コーダ、lc・・・・・・RAM、SW+・・・・・・
電池蓋開閉検出スイッチ、SW2・・・・・・リセット
スイッチ、SW3・・・・・・表示スイッチ、SWs・
・・・・・プロテクトスイッチ、SWs・・・・・・ス
ライドスイッチ、S W m・・・・・・モード切換ス
イッチ。 特許出願人  カシオ計算機株式会社
FIG. 1 is a diagram showing a circuit configuration of one embodiment of the invention, and FIG. 2 is a diagram showing a circuit configuration of another embodiment of the invention. l...One-chip microcontroller with built-in decoder, etc. 2...Antenna, 3...Radio section, 4.
...Waveform shaping section, 5, iob...E2
FROM, 6...DC-DC converter, 7.
...Speaker driver, 8 ...Speaker, 9 ...LCD, 10a ... ID-f
lOM, la...CPU, 1b...decoder, lc...RAM, SW+...
Battery cover opening/closing detection switch, SW2...Reset switch, SW3...Display switch, SWs...
...Protect switch, SWs...Slide switch, SWm...Mode changeover switch. Patent applicant Casio Computer Co., Ltd.

Claims (3)

【特許請求の範囲】[Claims] (1)各回路部に電力を供給する電源電池と、上記電源
電池から各回路部への電力供給の断続を指令するのに用
いられる電源スイッチと、データを入力する入力手段と
、 上記入力手段によって入力されたデータを記憶するラン
ダムアクセスの揮発性記憶手段と、上記揮発性記憶手段
から転送されてきたデータを記憶する電気的に書換え可
能な不揮発性記憶手段と、 前記電源スイッチが操作され、電源電池からの電力供給
が開始されるときに、前記不揮発性記憶手段に記憶され
ている所定のデータを上記揮発性記憶手段に転送して記
憶せしめ、他方、該電源スイッチが操作され、電源電池
からの電力供給が停止されるときには上記揮発性記憶手
段のデータを上記不揮発性記憶に転送して記憶させる制
御手段を備えたことを特徴とするデータ保護機能付きデ
ータ記憶装置。
(1) A power supply battery that supplies power to each circuit section, a power switch used to instruct on/off of power supply from the power supply battery to each circuit section, an input means for inputting data, and the input means random-access volatile storage means for storing data input by the user; and electrically rewritable non-volatile storage means for storing data transferred from the volatile storage means; when the power switch is operated, When power supply from the power source battery is started, predetermined data stored in the non-volatile storage means is transferred to and stored in the volatile storage means, and on the other hand, when the power switch is operated, the power source battery 1. A data storage device with a data protection function, comprising: control means for transferring and storing data in said volatile storage means to said nonvolatile storage when power supply from said volatile storage means is stopped.
(2)上記請求項(1)記載のデータ保護機能付きデー
タ記憶装置において、電源スイッチに替えて電池収納部
の蓋の開閉検出スイッチにしたことを特徴とするデータ
保護機能付きデータ記憶装置。
(2) A data storage device with a data protection function as set forth in claim (1), characterized in that the power switch is replaced by a switch for detecting opening/closing of a lid of the battery compartment.
(3)上記請求項(1)又は(2)記載のデータ保護機
能付きデータ記憶装置において、入力手段は送信されて
きた電波を受信する無線受信器であることを特徴とする
データ保護機能付きデータ記憶装置。
(3) In the data storage device with a data protection function according to claim (1) or (2), the input means is a wireless receiver that receives transmitted radio waves. Storage device.
JP2301533A 1990-11-07 1990-11-07 Data storage device with data protective function Pending JPH04172547A (en)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007018428A (en) * 2005-07-11 2007-01-25 Denso Wave Inc Personal digital assistance
US7424627B2 (en) 2003-05-22 2008-09-09 Canon Kabushiki Kaisha Storage device protection system, method for protecting hard disk thereof, medium for providing control program, and control program

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