JPH04172082A - Digital electronic still camera - Google Patents
Digital electronic still cameraInfo
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- JPH04172082A JPH04172082A JP2299041A JP29904190A JPH04172082A JP H04172082 A JPH04172082 A JP H04172082A JP 2299041 A JP2299041 A JP 2299041A JP 29904190 A JP29904190 A JP 29904190A JP H04172082 A JPH04172082 A JP H04172082A
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Landscapes
- Color Television Image Signal Generators (AREA)
Abstract
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は量子化雑音の影響を少なくLS/Nが良好なデ
ジタル電子スチルカメラに関する。DETAILED DESCRIPTION OF THE INVENTION (Field of Industrial Application) The present invention relates to a digital electronic still camera that is less affected by quantization noise and has a good LS/N.
(従来の技術)
第4図は本発明が実施される対象のデジタル電子スチル
カメラの構成を示すブロック図である。(Prior Art) FIG. 4 is a block diagram showing the configuration of a digital electronic still camera to which the present invention is implemented.
この動作の概要を説明すると、補色市松方式の電荷結合
形イメージセンサ−(以下、単にCODという)lから
の出力信号はアンプ2で増幅され、A/D変換器3でデ
ジタルデータに変換される。To give an overview of this operation, the output signal from a complementary color checkerboard charge-coupled image sensor (hereinafter simply referred to as COD) is amplified by an amplifier 2 and converted to digital data by an A/D converter 3. .
そのデジタルデータはメモリ制御回路6によりアドレス
等が制御されるフレームメモリ4に記憶される。そして
、このフレームメモリ4に記憶されたデジタルデータは
プロセス部5で演算処理された後、エンコーダ7で符号
化を行ないD/A変換器8でアナログ信号(NTSC信
号)に変換する。The digital data is stored in a frame memory 4 whose addresses and the like are controlled by a memory control circuit 6. The digital data stored in the frame memory 4 is subjected to arithmetic processing in the processing unit 5, then encoded in the encoder 7, and converted into an analog signal (NTSC signal) in the D/A converter 8.
この場合、CCD1の画素と1対1に対応する形でフレ
ームメモリ4に記憶し、そのデータを基にフレーム画を
出力する。In this case, the data is stored in the frame memory 4 in a one-to-one correspondence with the pixels of the CCD 1, and a frame image is output based on the data.
(発明が解決しようとする課題)
上記構成のデジタル電子スチルカメラにおいて、CCD
1の出力信号であるCy(シアン)、G(グリーン)、
Ye(イエロー)、 Mg(マゼンタ)にはCODの
分光感度特性により出力レベルに差がある。(Problem to be Solved by the Invention) In the digital electronic still camera having the above configuration, the CCD
1 output signals Cy (cyan), G (green),
Ye (yellow) and Mg (magenta) have different output levels depending on the spectral sensitivity characteristics of COD.
これを従来のように1つのアンプ2で増幅する場合、A
/D変換器3への入力レベルが決まっているためレベル
の大きい出力信号(Cy、 Ye)がA/D変換器3の
フルスケールになるように増幅率を決めている。この結
果、レベルの小さい出力信号(G、Mg)はA/D変換
器3のフルスケールまで増幅することが出来ず、量子化
雑音の影響をより多く受けるので、Cy、Yeに比べG
、MgのS/Nが悪くなるという問題があった。When amplifying this with one amplifier 2 as in the past, A
Since the input level to the A/D converter 3 is fixed, the amplification factor is determined so that the output signals (Cy, Ye) with high levels become the full scale of the A/D converter 3. As a result, low-level output signals (G, Mg) cannot be amplified to the full scale of the A/D converter 3 and are more affected by quantization noise, so G
, there was a problem that the S/N of Mg deteriorated.
他方、上記と反対にレベルの小さい出力信号(G、Mg
)がA/D変換器3のフルスケールになるように増幅率
を決めると、レベルの大きい出力信号(Cy、 Ye)
のレベルが過度になり過ぎ、所定レベルを越えた分につ
いては、色の再現が出来ず同色となってしまうので、レ
ベルの大きい出力信号(Cy、 Ye)に基づいて増幅
率を定めることになる。 本発明はこのような問題点を
解決し、CODの出力信号Cy、G、Ye、Mgを夫々
別々に取出し、夫々をA/D変換器3のフルスケールま
で増幅することにより、レベルの小さい出力信号(G、
Mg)のS/Nを良くすることを目的とする。On the other hand, contrary to the above, low level output signals (G, Mg
) is the full scale of A/D converter 3, the output signal (Cy, Ye) with a high level
If the level becomes excessive and exceeds a predetermined level, colors cannot be reproduced and the colors will be the same, so the amplification factor will be determined based on the output signal (Cy, Ye) with a large level. . The present invention solves these problems by extracting the COD output signals Cy, G, Ye, and Mg separately and amplifying each to the full scale of the A/D converter 3, thereby producing a low-level output. Signal (G,
The purpose is to improve the S/N of Mg).
(課題を解決するための手段)
本発明は上記課題を解決し目的を達成するため、電荷結
合形イメージセンサ−と、該イメージセンサ−の出力信
号を増幅するアンプと、該アンプにより増幅された信号
をデジタルデータに変換するA/D変換器と、該A/D
変換器により変換されたデジタルデータを記憶するフレ
ームメモリと、該フレームメモリのアドレス制御等を行
なうメモリ制御回路と、前記フレームメモリに記憶され
たデジタルデータを演算処理するプロセス部と、該プロ
セス部で演算処理後のデジタルデータの符号化を行なう
エンコーダと、該エンコーダからのデジタルデータをア
ナログ信号に変換するD/A変換器とから構成され、前
記電荷結合形イメージセンサ−の画素と1対1に対応す
る形で前記フレームメモリに記憶し、その記憶データを
基にフレーム画を出力するデジタル電子スチルカメラに
おいて、前記電荷結合形イメージセンサ−の出力信号G
、Cy、Ye、Mgを夫々別々に増幅するように前記ア
ンプを構成したことを特徴とする。(Means for Solving the Problems) In order to solve the above problems and achieve the objects, the present invention includes a charge-coupled image sensor, an amplifier that amplifies the output signal of the image sensor, and a charge-coupled image sensor that amplifies the output signal of the image sensor. An A/D converter that converts a signal into digital data, and the A/D
a frame memory that stores digital data converted by the converter; a memory control circuit that performs address control of the frame memory; a process unit that performs arithmetic processing on the digital data stored in the frame memory; It is composed of an encoder that encodes digital data after arithmetic processing, and a D/A converter that converts the digital data from the encoder into an analog signal, and is connected one-to-one with the pixels of the charge-coupled image sensor. In a digital electronic still camera that stores data in the frame memory in a corresponding form and outputs a frame image based on the stored data, the output signal G of the charge-coupled image sensor
, Cy, Ye, and Mg, respectively.
(作 用)
本発明はCODの出力信号Cy、G、Ye、Mgを夫々
A/D変換器のフルスケールまで各アンプにより増幅す
ることにより、レベルの小さい出力信号(G、Mg)の
S/Nを良好にすることができる。(Function) The present invention amplifies the output signals Cy, G, Ye, and Mg of the COD by each amplifier up to the full scale of the A/D converter. N can be made good.
(実施例)
第1図は本発明の一実施例に係るアンプ2の回路構成図
を示す。図中、21.22は1/2H,(水平同期周波
数)で切換接点21a、 22aが切換る切換スイッチ
、23.24.25.26は夫々増幅率A、B、C。(Embodiment) FIG. 1 shows a circuit configuration diagram of an amplifier 2 according to an embodiment of the present invention. In the figure, 21.22 is a switch whose switching contacts 21a and 22a switch at 1/2H (horizontal synchronization frequency), and 23.24.25.26 are amplification factors A, B, and C, respectively.
Dを有する出力信号Cy、Q、Ye、Mgの各アンプ、
27.28は2f、(サブキャリア周波数)で切換接点
27a、 28aが切換る切換スイッチ、29はl/2
V。each amplifier of the output signal Cy, Q, Ye, Mg with D;
27.28 is 2f, (subcarrier frequency) switching contacts 27a and 28a are changeover switches, 29 is l/2
V.
(垂直同期周波数)で切換接点29aが切換る切換スイ
ッチである。The switching contact 29a is a changeover switch that changes at the vertical synchronization frequency.
上記各切換スイッチ21.22.27.28及び29は
全て同期して切換動作が行われる電子スイッチであり、
図面には理解を容易にするため模式的に示しである。The above-mentioned changeover switches 21, 22, 27, 28 and 29 are all electronic switches whose switching operations are performed synchronously,
The drawings are shown schematically for ease of understanding.
第2図はCGDIからの読出し方法を説明するための図
であって、同図(])はCCD色フィルター配列図で1
区画が1画素を示す。また同図(2)は同図(1)の出
力信号である偶フィールド(ア)のS、信号(Cy)、
S、信号(Ye)及び奇フィールド(イ)のS、信号
(Mg、 G)、 S、信号CG、Mg)を示す。Figure 2 is a diagram for explaining the reading method from the CGDI, and the figure ( ]) is a CCD color filter array diagram.
A section indicates one pixel. In addition, (2) in the same figure shows the output signal of the even field (A), which is the output signal in (1) in the same figure, the signal (Cy),
S, signal (Ye) and odd field (A) S, signal (Mg, G), S, signal CG, Mg) are shown.
第3図はフレームメモリ4の記憶配列を示す図であり、
同図(1)は偶フイールドメモリ(Cy、 Ye)、同
図(2)は奇フイールドメモリ(Mg、G)を示し、記
憶時は時系列的に奇、偶フイールドメモリに順次記憶さ
れ、読出し時は奇、偶フイールドメモリが同時に読出さ
れる。FIG. 3 is a diagram showing the storage arrangement of the frame memory 4,
(1) in the same figure shows the even field memory (Cy, Ye), and (2) in the same figure shows the odd field memory (Mg, G). During storage, the data is sequentially stored in the odd and even field memories in chronological order, and the data is read out. Odd and even field memories are read simultaneously.
次に動作を説明すると偶フィールド(ア)のS I I
S3信号はCyアンプ23. Yeアンプ25で夫々A
/D変換器3のフルスケールまで増幅し、切換スイッチ
27及び29を介してA/D変換器3へ出力される。Next, to explain the operation, even field (A) S I I
The S3 signal is sent to the Cy amplifier 23. A each with Ye amplifier 25
The signal is amplified to the full scale of the A/D converter 3 and output to the A/D converter 3 via the changeover switches 27 and 29.
一方、奇フィールドのS、、 S、信号は切換スイッチ
21.22を介してMgアンプ26.Gアンプ24、次
にGアンプ24. Mgアンプ26と、これらの繰返し
で夫々A/D変換器3のフルスケールまで増幅し、切換
スイッチ28及び29を介してA/D変換器3へ出力さ
れる。On the other hand, the odd field S, , S, signals are sent to the Mg amplifier 26 . G amplifier 24, then G amplifier 24. By repeating these steps, the Mg amplifier 26 amplifies the signal up to the full scale of the A/D converter 3, and outputs it to the A/D converter 3 via the changeover switches 28 and 29.
そして、A/D変換器3で変換されたデジタルデータは
第4図に示すメモリ制御回路6により、第3図に示すメ
モリ記憶配列でフレームメモリ4の奇偶フィールドメモ
リ(2)、 (1)に時系列により記憶する。Then, the digital data converted by the A/D converter 3 is sent to the odd-even field memories (2) and (1) of the frame memory 4 by the memory control circuit 6 shown in FIG. 4 in the memory storage arrangement shown in FIG. Store in chronological order.
プロセス部5はフレームメモリ4に記憶されたデジタル
データに上記記憶時とは異なる順番、つまり、奇偶フィ
ールドメモリを同時に読出し、プロセス部5に信号Cy
、G、Ye、Mgの4画素分のデータを送る。この4画
素分のデータは1回目の読出しく第1フイールド)と2
回目の読出しく第2フイールド)では異なった画素を読
出す。The processing section 5 reads out the digital data stored in the frame memory 4 in a different order from the above-mentioned storage time, that is, the odd-even field memory simultaneously, and sends a signal Cy to the processing section 5.
, G, Ye, and Mg. These 4 pixels worth of data are read out for the first time (1st field) and 2
In the second readout (second field), different pixels are read out.
このようにして、CCD内で行なわれた重置画素ずれを
メモリ制御回路6のメモリアドレス制御で行なう。この
信号Cy、G、Ye、Mgを基にプセス部5で、以下の
演算を行なう。In this way, the overlapping pixel shift carried out within the CCD is carried out by the memory address control of the memory control circuit 6. Based on the signals Cy, G, Ye, and Mg, the processing section 5 performs the following calculations.
ただし、A、B、C,Dはアンプ23〜26の増幅率だ
だし、α、βは係数。However, A, B, C, and D are the amplification factors of amplifiers 23 to 26, and α and β are coefficients.
上式(1)及び(2)で得られたR、G、Bにγ変換。γ conversion to R, G, and B obtained by the above formulas (1) and (2).
マトリクス演算、白バランス演算を行ない、Y。Perform matrix calculation and white balance calculation, Y.
R−Y、B−Yを算出する。そして、このY、 R−Y
、B−Yをエンコーダ7でデジタル的にコンポジットの
デジタルデータに変換し、D/A変換器8でアナログ信
号(NTSC信号)にして出力する。Calculate RY and BY. And this Y, R-Y
, B-Y are digitally converted into composite digital data by an encoder 7, and converted into an analog signal (NTSC signal) by a D/A converter 8 and output.
(発明の効果)
以上説明したように本発明は、CODの出力信号Cy、
G、Ye、Mgを夫々A/D変換器のフルスケールまで
増幅しているので量子化雑音の影響が少なくなりS/N
が良くなる。(Effects of the Invention) As explained above, the present invention provides the COD output signal Cy,
Since G, Ye, and Mg are each amplified to the full scale of the A/D converter, the influence of quantization noise is reduced and the S/N is
gets better.
【図面の簡単な説明】
第1図は本発明の一実施例に係るアンプの回路構成図、
第2図はCCD1からの読出し方法の説明図、第3図は
フレームメモリのメモリ記憶列を示す図、第4図は本発
明が実施される対象のデジタル電子スチルカメラの構成
を示すブロック図である。
l ・・・電荷結合形イメージセンサ−(CCD)、
2 ・・・アンプ、 3 ・・・A/D変換器、 4・
・・フレームメモリ、 5・・・プロセス部、 6 ・
・・メモリ制御回路、 7・・・エンコーダ、 8 ・
・・D/A変換器、21、22.27.28.29・・
・切換スイッチ、23・・・Cyアンプ、24・・・G
アンプ、25・・・Yeアンプ、26・・・Mgアンプ
。
特許出願人 株式会社 リ コ −
しれ→
第4図
第2
第3
4西フイールドメーリ
フ)偶フィールド
S+ 、、、 Cy、Cy、Cy、Cy;−−−・・c
y 、cy、cy 、cy・−・52、、、 Ye、Y
e、Ye、Ye 、−−−−−、・Ye 、Ve、Ve
、Ye、−・・イ) 苛フィールド
S+、、、 Mg 、Mg 、Mg 、Mg、−、−G
、G、G、G −52−G、G、G、G−・−・・・M
g、Mg、Mg、Mg−・・図
tフィールドメモリ[BRIEF DESCRIPTION OF THE DRAWINGS] FIG. 1 is a circuit diagram of an amplifier according to an embodiment of the present invention;
FIG. 2 is an explanatory diagram of a reading method from the CCD 1, FIG. 3 is a diagram showing a memory storage column of a frame memory, and FIG. 4 is a block diagram showing the configuration of a digital electronic still camera to which the present invention is implemented. be. l...charge-coupled image sensor (CCD),
2...Amplifier, 3...A/D converter, 4.
...Frame memory, 5.Process section, 6.
...Memory control circuit, 7...Encoder, 8.
...D/A converter, 21, 22.27.28.29...
・Selector switch, 23...Cy amplifier, 24...G
Amplifier, 25...Ye amplifier, 26...Mg amplifier. Patent applicant Rico Co., Ltd. → Fig. 4 Fig. 2 3 4 West field mail life) Even field S+ , Cy, Cy, Cy, Cy;---...c
y, cy, cy, cy...52,,, Ye, Y
e, Ye, Ye,------,・Ye, Ve, Ve
,Ye,-...I) Strong field S+,,, Mg, Mg, Mg, Mg,-,-G
, G, G, G -52-G, G, G, G-...M
g, Mg, Mg, Mg-...Figure t field memory
Claims (1)
出力信号を増幅するアンプと、該アンプにより増幅され
た信号をデジタルデータに変換するA/D変換器と、該
A/D変換器により変換されたデジタルデータを記憶す
るフレームメモリと、該フレームメモリのアドレス制御
等を行なうメモリ制御回路と、前記フレームメモリに記
憶されたデジタルデータを演算処理するプロセス部と、
該プロセス部で演算処理後のデジタルデータの符号化を
行なうエンコーダと、該エンコーダからのデジタルデー
タをアナログ信号に変換するD/A変換器とから構成さ
れ、前記電荷結合形イメージセンサーの画素と1対1に
対応する形で前記フレームメモリに記憶し、その記憶デ
ータを基にフレーム画を出力するデジタル電子スチルカ
メラにおいて、 前記電荷結合形イメージセンサーの出力信号Cy、G、
Ye、Mgを夫々別々に増幅するように前記アンプを構
成したことを特徴とするデジタル電子スチルカメラ。[Scope of Claims] A charge-coupled image sensor, an amplifier that amplifies the output signal of the image sensor, an A/D converter that converts the signal amplified by the amplifier into digital data, and the A/D converter. a frame memory that stores digital data converted by the frame memory; a memory control circuit that performs address control of the frame memory; and a process unit that performs arithmetic processing on the digital data stored in the frame memory;
The processing unit includes an encoder that encodes digital data after arithmetic processing, and a D/A converter that converts the digital data from the encoder into an analog signal, and is connected to the pixels of the charge-coupled image sensor. In a digital electronic still camera that stores data in the frame memory in a pair-to-one correspondence and outputs a frame image based on the stored data, output signals Cy, G, and
A digital electronic still camera characterized in that the amplifier is configured to amplify Ye and Mg separately.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2299041A JPH04172082A (en) | 1990-11-06 | 1990-11-06 | Digital electronic still camera |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2299041A JPH04172082A (en) | 1990-11-06 | 1990-11-06 | Digital electronic still camera |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04172082A true JPH04172082A (en) | 1992-06-19 |
Family
ID=17867449
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2299041A Pending JPH04172082A (en) | 1990-11-06 | 1990-11-06 | Digital electronic still camera |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04172082A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2002037861A3 (en) * | 2000-11-01 | 2002-07-25 | Koninkl Philips Electronics Nv | Processing of color signals in a color camera |
-
1990
- 1990-11-06 JP JP2299041A patent/JPH04172082A/en active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2002037861A3 (en) * | 2000-11-01 | 2002-07-25 | Koninkl Philips Electronics Nv | Processing of color signals in a color camera |
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