JPH0369211B2 - - Google Patents
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- JPH0369211B2 JPH0369211B2 JP58055139A JP5513983A JPH0369211B2 JP H0369211 B2 JPH0369211 B2 JP H0369211B2 JP 58055139 A JP58055139 A JP 58055139A JP 5513983 A JP5513983 A JP 5513983A JP H0369211 B2 JPH0369211 B2 JP H0369211B2
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Description
【発明の詳細な説明】
本発明は、VCR（Voltage Controlled
Resistor）として知られている電圧制御型抵抗回
路に関する。[Detailed Description of the Invention] The present invention provides a VCR (Voltage Controlled
This relates to voltage-controlled resistance circuits known as resistors.
テープレコーダ等において、伝達される信号の
圧縮・伸長を行うノイズリダクシヨンシステムが
多用されているが、このノイズリダクシヨンシス
テムに上記VCRが使用されている。その一例を
述べると、演算増幅器の形態に構成された増幅器
の第１の入力端子に伝達信号を供給し、第２の入
力端子に基準電圧を供給する。そして演算増幅器
の出力信号を次段の信号増幅器へ供給するととも
に、第１の入力端子へ負帰還する。 Noise reduction systems that compress and expand transmitted signals are often used in tape recorders and the like, and the VCR described above is used in this noise reduction system. By way of example, a transfer signal is provided at a first input terminal of an amplifier configured in the form of an operational amplifier, and a reference voltage is provided at a second input terminal. Then, the output signal of the operational amplifier is supplied to the next stage signal amplifier, and is also negatively fed back to the first input terminal.
本願発明に先立ち、本発明者等が上記VCRに
つき検討したところによると、上記演算増幅器の
初段増幅回路は差動対になされたトランジスタに
よつて構成されているが、各トランジスタを流れ
るコレクタ電流に差が生じた場合、第１及び第２
の入力端子間にオフセツト電圧が発生することが
判明した。 Prior to the present invention, the inventors studied the above-mentioned VCR and found that the first stage amplification circuit of the above-mentioned operational amplifier is composed of a differential pair of transistors, but the collector current flowing through each transistor If there is a difference, the first and second
It was found that an offset voltage was generated between the input terminals of the
上記オフセツト電圧が発生すると、その電圧差
が演算増幅器によつて増幅されるので、あたかも
入力信号が供給されるようになる。従つて、オフ
セツト電圧が発生した場合、小入力信号が供給さ
れても増幅することができず、正確なVCR動作
が行われないことが明らかになつた。 When the offset voltage is generated, the voltage difference is amplified by the operational amplifier, so that it becomes as if an input signal is being supplied. Therefore, it has become clear that when an offset voltage occurs, even if a small input signal is supplied, it cannot be amplified and accurate VCR operation cannot be performed.
本発明は上述の如き実状からなされたものであ
り、その目的とするところは、オフセツト電圧の
発生を防止して、入力信号の電圧レベルに対応し
た正確な抵抗制御を行い得る電圧制御型抵抗回路
を提供することにある。 The present invention was made in view of the above-mentioned circumstances, and its purpose is to provide a voltage-controlled resistance circuit that can prevent the occurrence of offset voltage and perform accurate resistance control corresponding to the voltage level of an input signal. Our goal is to provide the following.
以下、第１図を参照して本発明の一実施例を述
べる。なお、図示の電圧制御型抵抗回路（以下に
おいてVCRという）は、テープレコーダのノイ
ズリダクシヨンシステムに用いられているものと
する。そして、ノイズリダクシヨンシステムとし
ては、ドルビーＢ型ノイズ・リダクシヨン・シス
テムとして当業者間に周知のものであつてよい
（ドルビーという言葉は、ドルビー研究所の登録
商標である）。 An embodiment of the present invention will be described below with reference to FIG. It is assumed that the illustrated voltage-controlled resistance circuit (hereinafter referred to as VCR) is used in a noise reduction system of a tape recorder. The noise reduction system may be one known to those skilled in the art as a Dolby B noise reduction system (the word Dolby is a registered trademark of Dolby Laboratories).
入力端子T1には、例えばＲチヤンネルの音声
信号を整流した電圧信号が供給される。差動対を
構成するトランジスタQ1のベースは、基準電圧
VREF1によつて所定の電圧レベルに保持される。
抵抗R1，R2は利得調整用であり、CS1は定電流回
路である。 For example, a voltage signal obtained by rectifying an R channel audio signal is supplied to the input terminal T1 . The base of transistor Q 1 forming the differential pair is connected to the reference voltage
It is held at a predetermined voltage level by V REF1 .
Resistors R 1 and R 2 are for gain adjustment, and CS 1 is a constant current circuit.
そして、トランジスタQ1，Q2は電圧−電流変
換回路として動作し、トランジスタQ1，Q2の各
ベース電圧差が両者を流れるコレクタ電流の差と
なる。直列接続されたダイオードD1，D2とD3，
D4とは、電流−電圧変換回路として動作する。
なお、ダイオードD5は、電圧レベルのレベルシ
フト用と見做してよい。 The transistors Q 1 and Q 2 operate as a voltage-current conversion circuit, and the difference in base voltage of the transistors Q 1 and Q 2 becomes the difference in collector current flowing between them. Diodes D 1 , D 2 and D 3 connected in series,
D4 operates as a current-voltage conversion circuit.
Note that the diode D5 may be considered to be used for level shifting the voltage level.
差動対に構成されたトランジスタQ3，Q4は、
電圧−電流変換回路として動作する。トランジス
タQ3，Q4の出力端には、トランジスタQ5，Q6，
Q7で構成されたカレントミラー回路が設けられ
ている。従つて、基準電圧VREF1と入力信号との
電圧差に対応してトランジスタQ3，Q4を流れる
電流が変化し、その電流変化に対応した出力電圧
がトランジスタQ2のベースに帰還されると同時
に、出力端子T2から導出される。この出力電圧
は、次段の信号増幅器（図示せず）へ供給され
る。 Transistors Q 3 and Q 4 configured as a differential pair are
Operates as a voltage-current conversion circuit. At the output terminals of transistors Q 3 and Q 4 , transistors Q 5 , Q 6 ,
A current mirror circuit consisting of Q7 is provided. Therefore, if the current flowing through transistors Q 3 and Q 4 changes in response to the voltage difference between the reference voltage V REF1 and the input signal, and the output voltage corresponding to the current change is fed back to the base of transistor Q 2 . At the same time, it is derived from the output terminal T 2 . This output voltage is supplied to the next stage signal amplifier (not shown).
ところで、トランジスタQ21，Q22，Q23，Q24，
Q25，Q26はカレントミラー回路であり、これに
よりトランジスタQ3，Q4を流れる電流に誤差を
生じないように構成されている。トランジスタ
Q25のベース電流Ib25は、＋VCC電源からトランジ
スタQ22を介して供給される。トランジスタQ21
には、上記電流Ib25と同一量の電流IAが流れる。
電流IAはトランジスタQ23，Q24によつて分流さ
れ、IA／２の電流が出力端子T2とトランジスタ
Q2のベースとに流れる。なお、トランジスタQ24
によつて分流されたIA／２の電流は、Ｌチヤンネ
ル用に設けられた他のVCRへ供給される。 By the way, the transistors Q 21 , Q 22 , Q 23 , Q 24 ,
Q 25 and Q 26 are current mirror circuits, which are configured so that no errors occur in the currents flowing through the transistors Q 3 and Q 4 . transistor
The base current I b25 of Q 25 is supplied via transistor Q 22 from the +V CC power supply. transistor Q 21
A current I A of the same amount as the current I b25 flows through.
Current I A is shunted by transistors Q 23 and Q 24 , and a current of I A /2 flows between output terminal T 2 and transistor
Flows into the base of Q 2 . In addition, transistor Q 24
The current of I A /2 shunted by is supplied to another VCR provided for the L channel.
上記IA／２の電流を、トランジスタQ2のベース
と出力端子T2とに供給することは極めて重要で
ある。この電流を供給しない場合は、トランジス
タQ2のベース電流と信号増幅器のベース電流と
が、トランジスタQ3を介してのみ供給されるこ
とになる。従つて、トランジスタQ3のコレクタ
電流が、言わば電流吸込み動作によつて増大する
ことになる。電流増幅率hfeの逆数で、トランジ
スタQ3のベース電流が変動する。そして、トラ
ンジスタQ1のコレクタ電流が変動し、トランジ
スタQ1，Q2のベース間にオフセツト電圧が発生
する。 It is extremely important to supply the current I A /2 to the base of the transistor Q 2 and to the output terminal T 2 . If this current is not supplied, the base current of transistor Q 2 and the base current of the signal amplifier will be supplied only through transistor Q 3 . Therefore, the collector current of transistor Q3 increases due to a so-called current sinking operation. The base current of transistor Q3 varies with the reciprocal of the current amplification factor hfe . Then, the collector current of transistor Q1 fluctuates, and an offset voltage is generated between the bases of transistors Q1 and Q2 .
しかし、トランジスタQ23を介してIA／２の電
流を供給することにより、トランジスタQ3のベ
ース電流の変動が防止される。この結果、トラン
ジスタQ3，Q4のベースにオフセツト電圧が発生
せず、トランジスタQ1，Q2のベース間にもオフ
セツト電圧が発生しない。 However, by supplying a current of I A /2 through transistor Q 23 , fluctuations in the base current of transistor Q 3 are prevented. As a result, no offset voltage is generated at the bases of transistors Q 3 and Q 4 , and no offset voltage is generated between the bases of transistors Q 1 and Q 2 .
次に電流Ib25の設定方法について述べると、抵
抗RAの抵抗値を選定することによつて、＋VCC電
源からトランジスタQ25，Q26、抵抗RAを介して
流れる電流IBが調整される。一方、オフセツト電
圧を防止するためのIA／２の電流は予め計算し得
るので、電流IA，Ib25も容量に決定される。従つ
て、電流Ｉb25から電流IBも決定され、この電流
量が抵抗RAによつて定められる。 Next, we will discuss how to set the current I b25 . By selecting the resistance value of the resistor R A , the current I B flowing from the +V CC power supply through the transistors Q 25 , Q 26 and the resistor R A can be adjusted. Ru. On the other hand, since the current I A /2 for preventing offset voltage can be calculated in advance, the currents I A and I b25 are also determined as capacitances. Therefore, the current I B is also determined from the current Ib25, and the amount of this current is determined by the resistor RA .
なお、Ｒチヤンネルの信号伝達経路に上記
VCRを一個設ければ、トランジスタQ24を介して
得られる電流によつてＬチヤンネルの信号伝達経
路についても同様なVCR動作を行わせることが
できる。従つて、少ない回路素子数でありなが
ら、入力信号のレベルの如何を問わず、正確な
VCR動作が行われる。 In addition, the above-mentioned signal transmission path of the R channel is
If one VCR is provided, a similar VCR operation can be performed on the L channel signal transmission path using the current obtained through the transistor Q24 . Therefore, despite the small number of circuit elements, accurate
VCR operation is performed.
以上に本発明の一実施例を述べたが、本発明を
適用したVCRは、ノイズリダクシヨンシステム
のみでなく、プリアンプの入力バイアスにおける
オフセツト補償用として使用することができる。
更に、リニアICに広く使用することが可能であ
る。 Although one embodiment of the present invention has been described above, a VCR to which the present invention is applied can be used not only for a noise reduction system but also for offset compensation in the input bias of a preamplifier.
Furthermore, it can be widely used in linear ICs.
本発明は上述の如く、電圧制御型抵抗回路の入
力オフセツト電圧の発生を未然に防止し得るの
で、小入力信号の場合であつても正確な抵抗制御
を行うことができる。また、回路構成が簡単であ
り、半導体集積回路化に適している。 As described above, the present invention can prevent the occurrence of an input offset voltage in a voltage-controlled resistance circuit, so that accurate resistance control can be performed even in the case of a small input signal. Furthermore, the circuit configuration is simple and suitable for semiconductor integrated circuits.
第１図は本発明の一実施例を示す電圧制御型抵
抗回路の回路図である。
Q1，Q2……差動対を構成するトランジスタ、
Q3，Q4……差動対を構成するトランジスタ、Q5，
Q6，Q7……カレントミラー回路を構成するトラ
ンジスタ、Q21，Q22，Q23，Q24，Q25，Q26……
カレントミラー回路を構成するトランジスタ、
RA……抵抗、D1，D2，D3，D4……ダイオード。
FIG. 1 is a circuit diagram of a voltage controlled resistance circuit showing one embodiment of the present invention. Q 1 , Q 2 ...transistors forming a differential pair,
Q 3 , Q 4 ...Transistors forming a differential pair, Q 5 ,
Q 6 , Q 7 ... Transistors forming the current mirror circuit, Q 21 , Q 22 , Q 23 , Q 24 , Q 25 , Q 26 ...
Transistors that constitute a current mirror circuit,
R A ...Resistance, D1 , D2 , D3 , D4 ...Diode.
Claims (1)
の入力端子に制御信号が供給される第１の増幅回
路と、上記第１の増幅回路の出力信号を上記第２
の入力端子に帰還する第２の増幅回路と、第１の
入力端子に基準電圧が供給され、第２の入力端子
に制御信号が供給される第３の増幅回路と、上記
第３の増幅回路の出力信号を上記第２の入力端子
に帰還する第４の増幅回路と、単一の電流補正回
路を有する電圧制御型抵抗回路において、上記電
流補正回路は二つの定電流を出力するカレントミ
ラー回路により構成され、上記電流補正回路から
の定電流出力を上記第１の増幅回路の上記第２の
入力端子及び上記第３の増幅回路の上記第２の入
力端子にそれぞれ供給し、上記単一の電流補正回
路によつて上記第１及び第３の増幅回路の各入力
端子間それぞれにおけるオフセツト電圧の発生を
防止することを特徴とする電圧制御型抵抗回路。1 A reference voltage is supplied to the first input terminal, and the second
a first amplifier circuit to which a control signal is supplied to the input terminal of the first amplifier circuit; and an output signal of the first amplifier circuit is supplied to the second amplifier circuit;
a second amplifier circuit whose first input terminal is supplied with a reference voltage and whose second input terminal is supplied with a control signal; A fourth amplifier circuit that feeds back an output signal of the output signal to the second input terminal, and a voltage-controlled resistance circuit that includes a single current correction circuit, wherein the current correction circuit is a current mirror circuit that outputs two constant currents. , which supplies the constant current output from the current correction circuit to the second input terminal of the first amplifier circuit and the second input terminal of the third amplifier circuit, and A voltage-controlled resistance circuit characterized in that a current correction circuit prevents generation of offset voltages between input terminals of the first and third amplifier circuits.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58055139A JPS59182618A (en) | 1983-04-01 | 1983-04-01 | Voltage controlled type resistance circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58055139A JPS59182618A (en) | 1983-04-01 | 1983-04-01 | Voltage controlled type resistance circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59182618A JPS59182618A (en) | 1984-10-17 |
| JPH0369211B2 true JPH0369211B2 (en) | 1991-10-31 |
Family
ID=12990441
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58055139A Granted JPS59182618A (en) | 1983-04-01 | 1983-04-01 | Voltage controlled type resistance circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59182618A (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2823867B2 (en) * | 1988-07-14 | 1998-11-11 | ローム株式会社 | Variable gain amplifier |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52116052A (en) * | 1976-03-04 | 1977-09-29 | Nat Semikondakutaa Yuu Kei Ltd | Electronic impedance device |
-
1983
- 1983-04-01 JP JP58055139A patent/JPS59182618A/en active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52116052A (en) * | 1976-03-04 | 1977-09-29 | Nat Semikondakutaa Yuu Kei Ltd | Electronic impedance device |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59182618A (en) | 1984-10-17 |
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