JPH0336271U - - Google Patents

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JPH0336271U
JPH0336271U JP9614889U JP9614889U JPH0336271U JP H0336271 U JPH0336271 U JP H0336271U JP 9614889 U JP9614889 U JP 9614889U JP 9614889 U JP9614889 U JP 9614889U JP H0336271 U JPH0336271 U JP H0336271U
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sync chip
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chip level
circuit
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  • Synchronizing For Television (AREA)

Description

【図面の簡単な説明】
第1図は本考案による同期分離回路の一実施例
を示すブロツク図、第2図は同期分離回路本体内
に設けられているスライス回路を示すブロツク図
、第3図は従来の同期分離方法を示す信号波形図
、第4図は従来回路の欠点の説明図である。 1……同期分離回路本体、2……クランプ回路
、3……アナログ/デジタル変換回路、4……最
小値検出回路(シンクチツプレベル検出手段)、
5……減算器、6……デユーテイ比変換回路、7
……積分回路、8……閾値レベル制御手段。

Claims (1)

  1. 【実用新案登録請求の範囲】 入力されたビデオ信号と、ペデスタルレベル及
    びシンクチツプレベルの中間の閾値レベルとを比
    較して上記ビデオ信号から同期信号を分離する同
    期分離回路において、 入力された上記ビデオ信号のシンクチツプレベ
    ルを検出するシンクチツプレベル検出手段と、 検出されたシンクチツプレベルに応じて、上記
    閾値レベルを制御する閾値レベル制御手段とを備
    えたことを特徴とする同期分離回路。
JP9614889U 1989-08-17 1989-08-17 Pending JPH0336271U (ja)

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JP9614889U JPH0336271U (ja) 1989-08-17 1989-08-17

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JP9614889U JPH0336271U (ja) 1989-08-17 1989-08-17

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JPH0336271U true JPH0336271U (ja) 1991-04-09

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