JPH03280699A - Sound field effect automatic controller - Google Patents

Sound field effect automatic controller

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JPH03280699A
JPH03280699A JP2081889A JP8188990A JPH03280699A JP H03280699 A JPH03280699 A JP H03280699A JP 2081889 A JP2081889 A JP 2081889A JP 8188990 A JP8188990 A JP 8188990A JP H03280699 A JPH03280699 A JP H03280699A
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JP
Japan
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signal
output
circuit
signals
field effect
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Application number
JP2081889A
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Japanese (ja)
Inventor
Masaichiro Maeda
前田 雅一郎
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Toshiba Corp
Original Assignee
Toshiba Corp
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Publication date
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Publication of JPH03280699A publication Critical patent/JPH03280699A/en
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Abstract

PURPOSE:To eliminate noise due to changeover between an audio part and a musical sound part by mixing two signals in stereo transmission and a differential signal and outputting the mixed signals so that the mixture ratio is changed complimentarily in response to the lapse of time from a point of time when the audio part and the musical sound part of an audio signal are switched. CONSTITUTION:A differential signal generating circuit 15 outputs a difference (c) between two signals a, b in stereo transmission in audio signals of plural channels. A mixing circuit 21 mixes the two signals a, b and the output (c) from the differential signal generating circuit 15 and outputs the result so that the mixture ratio is changed complimentarily in response to the lapse of time from a point of time of changeover of the result of decision outputted from a decision means 19 deciding the audio part and the musical sound part of an audio signal are switched. Then a sound field effect circuit 17 provides a sound field effect to an output from the mixing circuit 21. Then the mixture rate where the difference signal (c) is mixed in L, R signals changes gradually from a point of time of the changeover of the audio part and the musical sound part thereby preventing generation of noise.

Description

【発明の詳細な説明】 [発明の目的] (産業上の利用分野) この発明はオーディオ信号に、臨場感(サラウンド効果
)、残響等の音場効果を付加する音場効果回路において
、音声パートにかがる音場効果を音声部分に対して効果
が表れないようにした音場効果自動制御装置に関する。
[Detailed Description of the Invention] [Objective of the Invention] (Industrial Application Field) This invention is a sound field effect circuit that adds sound field effects such as presence (surround effect) and reverberation to an audio signal. The present invention relates to an automatic sound field effect control device that prevents a darkening sound field effect from appearing on audio parts.

(従来の技術) 今日のオーディオの分野における技術的進展は著しく、
モノラルからステレオと、さらにアナログからデジタル
へと、より原音に近づくべ(技術の移行がなされてきた
。更に、近年においては、聴取者の好みに応じて音楽ン
ース等に加工を施し、独創性のある音場を形成する技術
の要望が高くなってきている。
(Prior art) Technological progress in the field of audio today is remarkable.
From monaural to stereo, and from analog to digital, there has been a shift in technology to get closer to the original sound.Furthermore, in recent years, music has been processed to suit the listener's tastes, and originality has been improved. There is an increasing demand for technology for forming a certain sound field.

こうした要望に答えるものとして、例えばサラウンドシ
ステムと呼ばれる音場効果回路がある。
To meet these demands, there is, for example, a sound field effect circuit called a surround system.

サラウンドシステムは、第9図に示すように、オーディ
オ系に音場効果回路が付加されるものである。
As shown in FIG. 9, the surround system is one in which a sound field effect circuit is added to the audio system.

第9図において、1はCD、テープレコーダ等からのオ
ーディオ信号を入力する音声入力端子である。この音声
入力端子1は低域通過フィルタ2に接続されており、音
声入力端子1に与えられた畜産信号は低域通過フィルタ
2を通ってA/D変換器3でデジタル信号に変換される
。A/D変換器3で変換されたデジタル信号は、音場効
果回路4に入力され、遅延処理を含むデジタル処理によ
って、コンサートホールや他の演奏会場の前方、後方か
ら聞こえてくる残響音信号を付加されて出力される。こ
れらデジタルの原信号と残響音信号は、それぞれD/A
変換器5.6によりアナログ信号に変換され、低域通過
フィルタ7.8及び増幅器9.10を通り、フロント側
の左右スピーカ11及びリヤ側の左右スピーカ12によ
り拡声される。
In FIG. 9, reference numeral 1 denotes an audio input terminal for inputting audio signals from a CD, tape recorder, etc. This audio input terminal 1 is connected to a low-pass filter 2, and the livestock signal applied to the audio input terminal 1 passes through the low-pass filter 2 and is converted into a digital signal by an A/D converter 3. The digital signal converted by the A/D converter 3 is input to the sound field effect circuit 4, and through digital processing including delay processing, reverberant sound signals heard from the front and rear of a concert hall or other performance venue are processed. It is added and output. These digital original signals and reverberant sound signals are each D/A
The signal is converted into an analog signal by a converter 5.6, passes through a low-pass filter 7.8 and an amplifier 9.10, and is amplified by the left and right speakers 11 on the front side and the left and right speakers 12 on the rear side.

オーディオ系に上記音場効果回路を付加することで、聴
取者は、あたかもコンサートホールやスポーツ会場に居
るような臨場感を体験することができるのである。
By adding the above-mentioned sound field effect circuit to the audio system, listeners can experience a sense of presence as if they were in a concert hall or sports venue.

ところで、上記音場効果回路では、例えばコンサートホ
ールと同等の雰囲気を作り出す場合、例えば残響時間1
秒ないし2秒程度の残響音を生成するのであるが、音楽
の場面ばかりでなく、例えば司会者が登場した場面にま
で上記残響音が付加されてしまい、聴取者にとって不自
然で聞き取り難いという問題がある。
By the way, in the above sound field effect circuit, when creating an atmosphere equivalent to a concert hall, for example, the reverberation time is 1.
The reverberation sound is generated for about 1 to 2 seconds, but the problem is that the reverberation sound is added not only to music scenes, but also to scenes where the presenter appears, making it unnatural and difficult for the listener to hear. There is.

また、スポーツ会場と同等の臨場感を出す場合、音場効
果回路4は、例えば100m5ec程度でエコー音を生
成するのであるが、観客の声援ばかりでなく、司会者や
解説者の音声にまでエコー音がかかってしまっていた。
Furthermore, in order to create a sense of presence equivalent to that of a sports venue, the sound field effect circuit 4 generates an echo sound at about 100m5ec, for example, and the sound echoes not only from the cheering of the audience, but also from the voices of the presenters and commentators. There was a sound.

上述の問題点を解消するため、第9図に示すように、シ
ラブル(音節)検出回路13によって、オーディオ信号
における音声パートと楽音パートとの特徴により、いず
れのパートかを示す2値信号を生成し、この2値信号に
基づいてオーディオ信号が音楽のパートであるか、人声
による音声パートであるかを論理回路14で判定する回
路を提案した(例えば特願昭63−163448)。
In order to solve the above-mentioned problem, as shown in FIG. 9, a syllable detection circuit 13 generates a binary signal indicating which part it is, based on the characteristics of the voice part and musical tone part in the audio signal. However, a circuit was proposed in which a logic circuit 14 determines whether an audio signal is a music part or a human voice part based on this binary signal (for example, Japanese Patent Application No. 163448/1983).

すなわち、第9図において、論理回路14の出力は音場
効果回路4の動作を制御する制御信号となり、この−制
御信号により音場効果回路4は、東南パートのときに音
場効果を付加した信号を出し、音声パートのときには音
場効果を付加しない原信号を出力している。
That is, in FIG. 9, the output of the logic circuit 14 becomes a control signal that controls the operation of the sound field effect circuit 4, and this control signal causes the sound field effect circuit 4 to add a sound field effect during the southeast part. During the audio part, the original signal without any sound field effects is output.

また、ステレオ信号などの2チャネル信号の場合、音声
信号が主に2チヤネルの同相成分として記録、または伝
送されることに着目し、特願昭63−331769に開
示されているように、L信号とR信号との差信号を生成
し、これと各り、R信号とを、音声パートと楽音パー、
トの判定結果に応じて選択的に出力させた信号に音場効
果をかける例がある。
In addition, in the case of a two-channel signal such as a stereo signal, focusing on the fact that audio signals are mainly recorded or transmitted as two-channel in-phase components, the L signal A difference signal between the R signal and the R signal is generated, and this and the R signal are used as the voice part and the musical tone part, respectively.
There is an example in which a sound field effect is applied to a signal that is selectively output in accordance with the result of the determination.

第10図において、入力端子TPII、 TP12に導
かれる入力信号■、■は、それぞれステレオの1信号と
R信号である。入力信号■、■は出力端子TP21.T
P22にそのまま出力信号■、■とじて導出してステレ
オ出力となる。
In FIG. 10, the input signals (1) and (2) led to the input terminals TPII and TP12 are a stereo 1 signal and an R signal, respectively. Input signals ■ and ■ are output terminals TP21. T
The output signals ① and ② are directly derived from P22, and a stereo output is obtained.

また、入力信号■、■は、差信号作成回路15に入力(
a、b)して同相信号成分の除去されたLRの差信号(
c、d)となり、これら差信号C1dと入力信号a、b
とをアナログスイッチSW1〜SW4から成る切替回路
16に入力し、出力として上記差信号c、dか入力信号
a、bがのいずれかによる出力e、fを得る。これら信
号e、fに対し音場効果回路11による音場効果が加え
られる。
In addition, the input signals ■ and ■ are input to the difference signal generation circuit 15 (
a, b) and the in-phase signal component is removed from the LR difference signal (
c, d), and these difference signals C1d and input signals a, b
are input to a switching circuit 16 consisting of analog switches SW1 to SW4, and outputs e and f are obtained by either the difference signals c and d or the input signals a and b. A sound field effect by a sound field effect circuit 11 is added to these signals e and f.

シラブル検出回路18及び論理回路19は、第9図と同
様に、シラブル検出回路18がらの2値信号を論理回路
19にて判定して、上記切替え回路16を制御する制御
信号を生成している。
Similar to FIG. 9, the syllable detection circuit 18 and the logic circuit 19 determine the binary signal from the syllable detection circuit 18 in the logic circuit 19 to generate a control signal for controlling the switching circuit 16. .

この第10図に示す回路によれば、司会者のアナウンス
や役者のセリフ部分の明瞭度を保ちつつ、観客の声援や
東南パートには充分な音場効果を付加することができる
According to the circuit shown in FIG. 10, sufficient sound field effects can be added to the audience's cheers and the southeast part while maintaining the clarity of the host's announcement and the actors' lines.

しかしながら、上記音場効果装置によれば、音声パート
と東南パートの切替わり時に、その変化がノイズとなっ
てスピーカから拡声されてしまい、聴取者にそのノイズ
が聞き取られてしまう場合があった。即ち、同相成分の
信号と逆相成分の信号の位相差が大きい場合、上述の切
替わり時にボッ音が現れるという不都合があった。
However, according to the above-mentioned sound field effect device, when switching between the audio part and the southeast part, the change becomes noise and is amplified from the speaker, and the noise may be heard by the listener. That is, when the phase difference between the in-phase component signal and the anti-phase component signal is large, there is an inconvenience that a popping sound appears at the time of the above-mentioned switching.

(発明が解決しようとする課題) 以上のごとく、第10図に示す従来の切替え方式は、音
声パートと東南パートの切替わり時にノイズが現れ、聴
取者にそのノイズが聞き取られてしまう欠点があった。
(Problems to be Solved by the Invention) As described above, the conventional switching method shown in FIG. 10 has the disadvantage that noise appears when switching between the audio part and the southeast part, and the noise is audible to the listener. Ta.

そこでこの発明は、音声パートと楽音パートの切替わり
に応じた音場効果の切替えによるノイズをなくし、自然
な音場効果がかかるようにした音場効果自動制御装置の
提供を目的とする。
SUMMARY OF THE INVENTION An object of the present invention is to provide an automatic sound field effect control device that eliminates noise caused by switching sound field effects in response to switching between a voice part and a musical tone part, and provides a natural sound field effect.

[発明の構成] (課題を解決するための手段) 第1の発明は、複数チャネルより成るオーディオ信号の
うちステレオ伝送となる2信号の差分を出力する差信号
作成回路と、前記2信号をそのまま通過させる線路と、
前記オーディオ信号の音声パートと楽音パートを判定す
る判定手段とを有し、更に、前記各2信号と前記差分信
号作成回路からの出力とを混合し、その混合比が前記判
定手段から出力する判定結果の切替わり時点より時間経
過に応じて相補的に変化するように出力する混合回路と
、この混合回路からの出力に音場効果を付加する音場効
果回路とを具備する。
[Structure of the Invention] (Means for Solving the Problems) The first invention provides a difference signal generation circuit that outputs a difference between two signals for stereo transmission among audio signals consisting of a plurality of channels, and A line to pass through,
a determination means for determining a voice part and a musical tone part of the audio signal, and further for mixing each of the two signals and an output from the difference signal creation circuit, and outputting the mixing ratio from the determination means. The apparatus includes a mixing circuit that outputs an output that changes complementary with the passage of time from the point in time when the result is switched, and a sound field effect circuit that adds a sound field effect to the output from the mixing circuit.

第2の発明は、上記混合回路の混合比が前記判定手段か
ら出力する判定結果の切替わり時点より萄間経過に応じ
て相補的に対数変化するようにしたことを特徴とする。
A second aspect of the present invention is characterized in that the mixing ratio of the mixing circuit changes logarithmically in a complementary manner in accordance with the lapse of the spacing from the time point when the judgment result output from the judgment means changes.

(作用) 上記構成によれば、差信号がり、R信号に混合される混
合割合が、楽音パート時と音声パート時との切替わり時
点から暫時変化する形となるので、ボッ音のようなノイ
ズを生ずることがない。
(Function) According to the above configuration, the mixing ratio of the difference signal and the R signal changes temporarily from the time of switching between the musical tone part and the voice part, so that noises such as bouncing sounds are generated. will not occur.

(実施例) 以下、この発明を図示の実施例によって詳細に説明する
(Example) Hereinafter, the present invention will be explained in detail with reference to illustrated examples.

第1図はこの発明に係る音場効果自動制御装置の一実施
例を示すブロック図である。
FIG. 1 is a block diagram showing an embodiment of an automatic sound field effect control device according to the present invention.

第1図において、入力信号■、■は、ステレオ伝送によ
る2チヤネルオ一デイオ信号であり、入力端子TPI1
. TP12に印加される。これら入力信号■、■は、
フロント側スピーカへの出力信号■、■として〜出力端
子TP21.TP22から直接出力され、かつシラブル
検出回路18に入力されるとともに、A/D変換l52
0を介して差信号作成回路15にも入力されている。
In FIG. 1, the input signals ■ and ■ are two-channel audio signals transmitted by stereo transmission, and the input terminals TPI1
.. Applied to TP12. These input signals ■, ■ are
As output signals ■ and ■ to the front speakers ~output terminal TP21. It is directly output from the TP22 and input to the syllable detection circuit 18, and is also input to the A/D conversion l52.
It is also input to the difference signal generation circuit 15 via 0.

差信号作成回路15は、入力信号■、■に相当する入力
a、bを減算器に入力し、その差信号を出力Cとして導
出する。差信号作成回路15からの出力Cと、A/D変
換器20からの信号a、bは、混合回路21に入力され
る。
The difference signal generation circuit 15 inputs inputs a and b corresponding to the input signals ■ and ■ to a subtracter, and derives the difference signal as an output C. Output C from the difference signal generation circuit 15 and signals a and b from the A/D converter 20 are input to a mixing circuit 21.

混合回路21は、独立した二つの積和演算部で構成され
ている。すなわち、混合回路21は、乗算器mO、ml
と加算器A1とからなる第1の積和篩部と、乗算器mo
 、m2と加算器A2とからなる第2の積和篩部とで構
成されている。ここで、乗算器m1は、差信号作成回路
15への入力信号号aが入力され、乗算器m1の出力は
、加算器A1の第一入力端子に導かれている。乗算器m
2は、差信号作成回路15の入力信号すが入力され、乗
算器m2の出力は、加算器A2の第1入力端子に供給さ
れている。乗算器mOは、差信号作成回路15がらの出
力Cが入力され、乗算器mOの出力はそれぞれ加算器A
1とA2各第2入力端子に供給されている。加算器A1
とA2の各出力は、それぞれ音場効果回路17への入力
信号e、fとなる。
The mixing circuit 21 is composed of two independent product-sum operation sections. That is, the mixing circuit 21 includes multipliers mO, ml
and an adder A1, and a multiplier mo
, m2 and a second product-sum sieve section consisting of an adder A2. Here, the input signal a to the difference signal generation circuit 15 is input to the multiplier m1, and the output of the multiplier m1 is led to the first input terminal of the adder A1. multiplier m
2 receives the input signal of the difference signal generating circuit 15, and the output of the multiplier m2 is supplied to the first input terminal of the adder A2. The output C from the difference signal generation circuit 15 is input to the multiplier mO, and the output from the multiplier mO is input to the adder A.
1 and A2 are supplied to each second input terminal. Adder A1
The outputs of A2 and A2 become input signals e and f to the sound field effect circuit 17, respectively.

音場効果回路17は、例えばサラウンド効果を付加する
デジタル音声プロセッサであり、D/A変換器22を通
して出力短端子TP13. TP14にそれぞれ音場効
果出力信号■、■を導出している。
The sound field effect circuit 17 is, for example, a digital audio processor that adds a surround effect, and is connected to the short output terminals TP13. through the D/A converter 22. Sound field effect output signals ■ and ■ are respectively derived from TP14.

シラブル検出回路18は、後述するように、音声パート
と楽音パートとがそれぞれ特徴部分を有することを利用
して、それぞれのパートに応じた2値信号を出力する。
As will be described later, the syllable detection circuit 18 utilizes the fact that the voice part and musical tone part each have characteristic parts, and outputs a binary signal corresponding to each part.

シラブル検出回路18からの2fii信号は、論理回路
19に入力される。論理回路19は、音声パートから楽
音パートへの切替わり、及び楽音パートから音声パート
への切替わりを判定した判定出力を生成する。シラブル
検出回路18と論理回路19により、楽音パートか音声
パートかを判定する判定手段が構成される。
The 2fii signal from the syllable detection circuit 18 is input to the logic circuit 19. The logic circuit 19 generates a determination output that determines the switching from the voice part to the musical tone part and the transition from the musical tone part to the voice part. The syllable detection circuit 18 and the logic circuit 19 constitute a determining means for determining whether the part is a musical tone part or a voice part.

乗算係数発生回路23は、後述するように、論理回路1
9のからの楽音パート、音声パートの切替りを判定した
出力を基に、入力端子TP11. TP12からの信号
■、■と差信号作成回路15からの出力信号Cとの混合
比を制御する乗算係数を発生する。
The multiplication coefficient generation circuit 23 is connected to the logic circuit 1 as described later.
Based on the output that determines the switching between the musical tone part and the audio part from No. 9, input terminal TP11. A multiplication coefficient is generated to control the mixing ratio of the signals (1) and (2) from the TP 12 and the output signal C from the difference signal generation circuit 15.

乗算係数は、2系統の積和演算部に対応して2種類成牛
される。1つの乗算係数01は、混合回路21の乗算器
m1 、m2を制御し、1つの乗算係数C2は、乗算器
mOを制御する。
Two types of multiplication coefficients are provided corresponding to the two systems of product-sum calculation units. One multiplication coefficient 01 controls multipliers m1 and m2 of the mixing circuit 21, and one multiplication coefficient C2 controls multiplier mO.

次に、シラブル検出回路18の具体的回路を第2図によ
り説明する。
Next, a specific circuit of the syllable detection circuit 18 will be explained with reference to FIG.

この回路は、入力信号■、■のうち一方を判定する回路
を示す。TP3は、入力信号1又は2を、アナログコン
パレータ25の一方の入力端子に供給する。このアナロ
グコンパレータ25の他方の入力端子には、入力オーデ
ィオ信号における楽音パートと音声パートとを区別する
ために、エンベロープの変動部を検出するしきい値電圧
が、例えば可変抵抗器等のトリマ一部品によって設定さ
れて印加されている。これにより、アナログコンパレー
タ25からは、入力オーディオ信号の振幅が前記しきい
値電圧より大ぎい平坦部と、小さい変動部とを区別する
信号が得られる。
This circuit shows a circuit that determines one of the input signals (2) and (2). TP3 supplies input signal 1 or 2 to one input terminal of analog comparator 25. The other input terminal of the analog comparator 25 is connected to a trimmer component such as a variable resistor, for example, with a threshold voltage for detecting a fluctuation part of the envelope in order to distinguish between a musical tone part and a voice part in the input audio signal. It is set and applied by. As a result, the analog comparator 25 obtains a signal that distinguishes between a flat part where the amplitude of the input audio signal is greater than the threshold voltage and a fluctuating part where the amplitude is small.

前記アナログコンパレータ25の出力は、再トリガー型
単安定マルチバイブレータ26に入力している。この単
安定マルチバイブレータ26は、二つの出力端子Q、U
を取り出し、一方の出力Qをダイオード及びコンデンサ
等によって構成した波形整形回路26aを介してナント
ゲート28の一方の入力端子に供給し、出力Uをナント
ゲート28の一方の入力端子に供給している。前記ナン
トゲート28の出力は、再トリガ型単安定マルチバイブ
レータ29に供給し、この単安定マルチバイブレータ2
9は出力Qを前記ナントゲート28の他方の入力端子に
フィードバックしている。この構成による単安定マルチ
バイブレータ29により、入力オーディオ信号の変動部
の時間幅に関係なく、1べての変動部を検出した2値信
号を得ることができる。また、この2値信号は、前記ナ
ントゲート27の他方の入力端子に入り、単安定マルチ
バイブレータ26からの出力と論理比較する。単安定マ
ルチバイブレータ29は、単安定マルチバイブレータ2
6より長い安定期間が設定されており、これにより、ナ
ントゲート27の出力は、一定の時間より長い変動部の
みをピックアップ指標した2値信号を表づことになる。
The output of the analog comparator 25 is input to a retrigger type monostable multivibrator 26. This monostable multivibrator 26 has two output terminals Q and U.
is taken out, one output Q is supplied to one input terminal of the Nandts gate 28 via a waveform shaping circuit 26a constituted by a diode and a capacitor, and the output U is supplied to one input terminal of the Nandts gate 28. . The output of the Nant gate 28 is supplied to a retrigger type monostable multivibrator 29, and this monostable multivibrator 2
9 feeds back the output Q to the other input terminal of the Nandt gate 28. With the monostable multivibrator 29 having this configuration, it is possible to obtain a binary signal in which all the fluctuation parts are detected, regardless of the time width of the fluctuation parts of the input audio signal. This binary signal also enters the other input terminal of the Nant gate 27 and is logically compared with the output from the monostable multivibrator 26. Monostable multivibrator 29 is monostable multivibrator 2
A stable period longer than 6 is set, so that the output of the Nant gate 27 represents a binary signal in which only the fluctuation part longer than a certain period of time is picked up as an index.

尚、2値信号の示す変動部を一定の時間幅より長いもの
をピックアップするようにした理由は、音声信号の性質
に基づいている。
The reason for picking up the variable portions of the binary signal that are longer than a certain time width is based on the characteristics of the audio signal.

次に、論理回路19の構成を第3図を参照して説明する
Next, the configuration of the logic circuit 19 will be explained with reference to FIG.

第3図において、端子TP5は、第2図における端子T
P4からの2値信号を導出している。端子TP5からの
2値信号は、フリップフロップ回路31a、31b 1
及びアンドゲート31Cにて構成された立下り検出回路
31に入力する。この立下り検出回路31は、りOツク
発生器30からのクロック信号によって各フリップフロ
ップ回路31a、31bが動作するようになっている。
In FIG. 3, the terminal TP5 is the terminal T in FIG.
A binary signal from P4 is derived. The binary signal from the terminal TP5 is sent to the flip-flop circuits 31a, 31b 1
and an AND gate 31C. In this fall detection circuit 31, each flip-flop circuit 31a, 31b is operated by a clock signal from a low clock generator 30.

2値信号の立下りを示す検出パルスは、アンドゲート3
1Cより導出し、く第一の)カウンター33に入る。
The detection pulse indicating the fall of the binary signal is detected by the AND gate 3.
It is derived from 1C and enters the first) counter 33.

カウンター33は、カウント出力をラッチ機能付きノリ
ツブ70ツブ34を介してコンパレータ35゜36に供
給する。これら]ンパレータ35,36は、それぞれ予
、め設定操作されたレジスタ37.38からのレジスト
値と前記フリップフロップ34がらのカウント値とを比
較する。コンパレータ35の比較結果は、ノット回路4
5を介してそれぞれラッチ回路41及びアンドゲート4
4の一方の端子に入力している。
The counter 33 supplies a count output to comparators 35 and 36 via a knob 70 and a knob 34 with a latch function. These] comparators 35 and 36 compare the register values from the registers 37 and 38, which have been set in advance, with the count value of the flip-flop 34, respectively. The comparison result of the comparator 35 is the not circuit 4.
5 respectively to the latch circuit 41 and the AND gate 4
It is input to one terminal of 4.

コンパレータ36の比較結果は、アンドゲート43を介
してカウンター39に入力している。上記カウンター3
9は、レジスタ40に設定されたレジスタ値をオーバー
フロー値として、上記アンドゲート43を介して入力す
るコンパレータ36の出力をカウントしている。したが
って、コンパレータ36の出力レジスタ40に設定され
たレジスト値を超えると、カウンター39は、キャリー
信号としての出力を、ノット回路46を介して上記ラッ
チ回路41及びアンドゲート44の他方の端子に供給す
る。
The comparison result of the comparator 36 is input to the counter 39 via an AND gate 43. Above counter 3
9 counts the output of the comparator 36 input via the AND gate 43, using the register value set in the register 40 as an overflow value. Therefore, when the register value set in the output register 40 of the comparator 36 is exceeded, the counter 39 supplies an output as a carry signal to the latch circuit 41 and the other terminal of the AND gate 44 via the NOT circuit 46. .

一方、カウンター32a1フリツプフロツプ32b32
cにて構成した回路は、クロック発生器3oがらのクロ
ック信号によって動作するタイミング信号発生回路を構
成している。このタイミング信号発生回路は、上記カウ
ンター33をクリヤーする信号を7リツプフロツプ32
bより、フリップフロップ34にラッチさせる信号を7
リツプ70ツブ32cよりそれぞれ出力して、所定の回
路に供給している。
On the other hand, counter 32a1 flip-flop 32b32
The circuit constructed by c constitutes a timing signal generation circuit that operates in response to a clock signal from the clock generator 3o. This timing signal generation circuit sends a signal that clears the counter 33 to the seven lip-flop 32.
From b, the signal to be latched by the flip-flop 34 is set to 7.
The signals are outputted from the lip 70 and the tube 32c and supplied to a predetermined circuit.

これらフリップフロップ32b、32Cの出力によって
、オーディオ信号を所定の単位区間に区切っている。
The audio signal is divided into predetermined unit sections by the outputs of these flip-flops 32b and 32C.

尚、フリップフロップ32cの出力は、前記アンドゲー
ト43の他方の入力端子にも供給される。また、りOツ
ク発生器30は、カウンター33及び39も駆動してい
る。
Note that the output of the flip-flop 32c is also supplied to the other input terminal of the AND gate 43. The stock generator 30 also drives counters 33 and 39.

しかして、前記ラッチ回路41は、それぞれコンパレー
タ35、カウンター39に基づく出力をフリップフロッ
プ42を介して端子TP6に導出する。この端子TP6
より導出する信号は、第1図にお1ブる乗算係数発生回
路23に入力される。
Thus, the latch circuit 41 outputs outputs based on the comparator 35 and the counter 39, respectively, via the flip-flop 42 to the terminal TP6. This terminal TP6
The signal derived from this is input to the multiplication coefficient generation circuit 23 shown in FIG.

更に、乗算係数発生回路23の構成例を第4図を参照し
て説明する。
Further, a configuration example of the multiplication coefficient generation circuit 23 will be explained with reference to FIG.

論理回路19により生成された判定出力は、端子51か
らラッチ回路53に入力し、更にラッチ回路54゜55
を介してクロック発生器52からのクロックの3クロッ
ク分遅延される。ラッチ回路53の出力とラッチ回路5
4の出力とは、それぞれ排他論理和ゲート55にそれぞ
れ入力する。排他論理和ゲート55は、上記判定出力が
レベル変化するタイミング以後のクロック立上がりから
1クロック周期の間パルスを呈する信号を形成する。こ
の排他論理和出力はカウンタ59にリセット信号として
入力する。
The judgment output generated by the logic circuit 19 is input to the latch circuit 53 from the terminal 51, and further to the latch circuits 54 and 55.
The clock from the clock generator 52 is delayed by three clocks. Output of latch circuit 53 and latch circuit 5
The outputs of 4 are input to exclusive OR gates 55, respectively. The exclusive OR gate 55 forms a signal that exhibits a pulse for one clock cycle from the rise of the clock after the timing at which the level of the determination output changes. This exclusive OR output is input to the counter 59 as a reset signal.

カウンタ59は、この発明による乗算係数CI。Counter 59 is a multiplication coefficient CI according to the present invention.

C2の元となる信号を発生する回路であり、上記クロッ
ク発生器52からのクロックをカウントし、あるオーバ
ーフロー値でキャリー信号を発生してカウントイネーブ
ルを行う。
This circuit generates a signal that is the source of C2, counts the clock from the clock generator 52, and generates a carry signal at a certain overflow value to enable the count.

カウンタ59の出力は、ラッチ回路61を介してセレク
タ57の第2入力端子群とセレクタ58の第1入力端子
群に入力するとともに、ノット回路62を介して上記セ
レクタ57の第1入力端子群と、セレクタ58の第2入
力端子群に入力している。これらセレクタ57.58は
、上記ラッチ回路56がらの出力によって第1入力端子
群と第1入力端子群の信号を選択的に出力し、端子63
.64に乗算係数01゜C2をそれぞれ導出する。
The output of the counter 59 is input to the second input terminal group of the selector 57 and the first input terminal group of the selector 58 via the latch circuit 61, and is input to the first input terminal group of the selector 57 via the knot circuit 62. , are input to the second input terminal group of the selector 58. These selectors 57 and 58 selectively output the signals of the first input terminal group and the first input terminal group according to the output of the latch circuit 56, and
.. 64 and the multiplication coefficient 01°C2 are respectively derived.

なお、カウンタ59の出力は、nピット構成であり、ラ
ッチ回路61はこれらnビットの出力をセレクタ57.
58とノット回路62にそれぞれ導出するとともに、ノ
ット回路62は、セレクタ57.58にそれぞれカウン
タ59からのnビットを反転したnビットの出力をそれ
ぞれセレクタ57.58に入力している。また、ラッチ
回路61は、排他論理和ゲート55の出力とクロック発
生器52からの出力とをアンドゲート60を介してラッ
チ制御として入力している。
Note that the output of the counter 59 has an n-bit configuration, and the latch circuit 61 outputs these n bits to the selector 57 .
58 and a NOT circuit 62, respectively, and the NOT circuit 62 inputs n-bit outputs obtained by inverting the n-bits from the counter 59 to the selectors 57 and 58, respectively. Further, the latch circuit 61 receives the output of the exclusive OR gate 55 and the output from the clock generator 52 via an AND gate 60 as latch control.

これにより、ラッチ回路61は、リセット後のカウンタ
59の出力をラッチ後、クロックのタイミング変化する
カウンタ出力を次々にラッチする。
Thereby, the latch circuit 61 latches the reset output of the counter 59 and then successively latches the counter outputs whose clock timing changes.

次に、第1図の構成による動作を説明する。Next, the operation of the configuration shown in FIG. 1 will be explained.

まず、第5図、第6図及び第7図は、第2図、第3図及
び第4図で説明したシラブル検出回路18、論理回路1
9及び乗算係数発生回路23の動作を説明するタイミン
グチャートである。
First, FIGS. 5, 6, and 7 show the syllable detection circuit 18 and logic circuit 1 explained in FIGS. 2, 3, and 4.
9 is a timing chart illustrating the operations of the multiplication coefficient generation circuit 23 and the multiplication coefficient generation circuit 23.

第4図において、信号SOは入力オーディオ信号を、S
lはアナログコンパレータ25の出力を、S2は単安定
マルチバイブレータ26の出力Qを、S2’ は波形整
形回路26aの出力を、s3は単安定マルチバイブレー
タ26の出力口を、S4はナントゲート28の出力を、
S5は単安定マルチバイブレータ29の出力を、S6は
シラブル検出回路18の出力信号であるナントゲート2
7の出力信号をそれぞれ示している。
In FIG. 4, the signal SO is the input audio signal S
l is the output of the analog comparator 25, S2 is the output Q of the monostable multivibrator 26, S2' is the output of the waveform shaping circuit 26a, s3 is the output port of the monostable multivibrator 26, and S4 is the output of the Nantes gate 28. output,
S5 is the output signal of the monostable multivibrator 29, and S6 is the output signal of the syllable detection circuit 18, which is the Nant gate 2.
7 output signals are shown respectively.

入力オーディオ信号は、SOに示すように、振幅が平坦
状となる部分X、振幅が間欠的に途切れる部分Y、とぎ
れた間隔が小さいがYよりは連続性のある部分X′等の
波形部分を呈する。このシラブル検出回路18は、前記
X及びX′の部分をを楽音パートと判定し、Yの部分を
音声パートと判定している。
As shown in SO, the input audio signal has waveform parts such as a part X where the amplitude is flat, a part Y where the amplitude is intermittently interrupted, and a part X' where the interruption interval is small but is more continuous than Y. present. The syllable detection circuit 18 determines that the X and X' portions are musical tone parts, and the Y portion is determined to be a voice part.

アナログコンパレータ25は、入力オーディオ信号の振
幅が所定レベルを超える毎にパルスを出力する。したが
って、信号S1は、入力オーディオ信号の一つひとつの
サイクル波形に対応してバースト状に連続するか、途切
れるパルス列信号となる。そして、パルス列の部分は、
入力オーディオ信号が所定レベルより大きな部分に対応
する。
The analog comparator 25 outputs a pulse every time the amplitude of the input audio signal exceeds a predetermined level. Therefore, the signal S1 becomes a pulse train signal that continues in a burst shape or is interrupted in response to each cycle waveform of the input audio signal. And the pulse train part is
Corresponds to a portion where the input audio signal is greater than a predetermined level.

次に、単安定マルチバイブレータ26は、入力オーディ
オ信号の最大周波数を基準に準安定期間が設定されてい
るので、信号S1のパルス列が続く期間はハイレベルを
呈し、パルスが発生しない期間はロウレベルを呈する信
号S2を出力Qとして導出する。そして、U出力S3は
、S2を反転した信号となる。更に、信号32’は、信
号S2の立ち上がりを検出したパルス列となる。
Next, since the monostable multivibrator 26 has a quasi-stable period set based on the maximum frequency of the input audio signal, it exhibits a high level during the period when the pulse train of the signal S1 continues, and a low level during the period when no pulse occurs. The resulting signal S2 is derived as the output Q. Then, the U output S3 becomes a signal obtained by inverting S2. Further, the signal 32' is a pulse train that detects the rising edge of the signal S2.

一方、ナントゲート28の出力S4は、単安定マルチバ
イブレータ29の準安定期間より長い間隔で振幅の途切
れる変動部が発生する場合は、S2’と同じ信号となる
が、X7部分のように、単安定マルチバイブレータ29
の準安定期間より短い間隔で発生する場合には、最初の
部分に対応したパルスで単安定マルチバイブレータ29
を反転し、後の振幅変動開部は検出されない。こうして
、ナントゲート27からは、一定の時間幅より長い振幅
変動部と振幅の連続する部分に対応してハイレベル及び
ロウレベルに変化する2値信号S6が得られる。
On the other hand, the output S4 of the Nant gate 28 becomes the same signal as S2' when a fluctuation part in which the amplitude is interrupted at an interval longer than the metastable period of the monostable multivibrator 29 occurs, but the output S4 of the Nant gate 28 becomes the same signal as S2'. Stable multivibrator 29
If the pulses corresponding to the first part occur at intervals shorter than the metastable period of the monostable multivibrator 29
is reversed, and the later amplitude fluctuation opening is not detected. In this way, a binary signal S6 is obtained from the Nant gate 27, which changes to a high level and a low level corresponding to an amplitude fluctuation part longer than a certain time width and a continuous part of amplitude.

このように生成された2値信号S6は、論理回路19の
立下り検出回路31に入力される。
The binary signal S6 generated in this manner is input to the fall detection circuit 31 of the logic circuit 19.

第6図において、第5図と同一信号には同一の符号を付
す。S7は立下り検出回路31の出力を、S 8. S
 9はフリップフロップ32C,32bの各出力を、8
10はカウンター33の出力を、811はコンパレータ
35の出力を、312はコンパレータ36の出力を、S
13はアンドゲート43の出力を、S15はノット回路
45の出力を、S16はノット回路4Gの出力を、S1
7は論理回路19の出力信号であってフリップフロップ
42の出力信号である。
In FIG. 6, the same signals as in FIG. 5 are given the same symbols. S7 is the output of the fall detection circuit 31, S8. S
9 represents each output of the flip-flops 32C and 32b.
10 is the output of the counter 33, 811 is the output of the comparator 35, 312 is the output of the comparator 36, S
13 is the output of the AND gate 43, S15 is the output of the NOT circuit 45, S16 is the output of the NOT circuit 4G, S1
7 is an output signal of the logic circuit 19, which is an output signal of the flip-flop 42.

さて、立下り検出回路31の出力する信号S7は、2値
信号の立ち下がりを検出するので、振動変動部が発生す
る毎に、パルスを呈する信号となる。
Now, since the signal S7 output from the fall detection circuit 31 detects the fall of a binary signal, it becomes a signal that exhibits a pulse every time a vibration fluctuation section occurs.

この信号S7は、カウンター33に入力されることによ
り、カウンター33でカウントされる。この場合、カウ
ンター33は、フリップフロップ32bからの信号S9
によってクリヤーされている。これにより、カウンター
33は、一定の皇位期間内における振幅変動部の数をカ
ウントすることになる。こうしてカウントされたカウン
ト値は、信号S8のタイミングで7リツプフロツブ34
に転送されて出力される。
This signal S7 is input to the counter 33 and counted by the counter 33. In this case, the counter 33 receives the signal S9 from the flip-flop 32b.
It has been cleared by. Thereby, the counter 33 counts the number of amplitude fluctuation parts within a certain period of imperial reign. The count value thus counted is transferred to the 7 lip flop 34 at the timing of the signal S8.
is transferred to and output.

コンパレ〜り35,36は、上記フリップフロップ34
からのカウント値と、各レジスタ37.38に設定され
たレジスタ値とを比較する。ここで、レジスタ37に設
定される値は、音声パートと判定できる振幅変動部の発
生頻度に基づいて定めている。また、レジスタ38は、
楽音パートと判定できる振幅変動部の発生頻度に基づい
て定めている。具体的には、単位期間内の信号S7にお
けるパルスが1個以内であれば楽音パートと判定する。
Comparators 35 and 36 are the flip-flops 34
The count value from and the register value set in each register 37 and 38 are compared. Here, the value set in the register 37 is determined based on the frequency of occurrence of an amplitude variation portion that can be determined to be a voice part. Further, the register 38 is
It is determined based on the frequency of occurrence of amplitude fluctuation parts that can be determined to be musical tone parts. Specifically, if the number of pulses in the signal S7 within a unit period is one or less, it is determined that it is a musical tone part.

尚、図では、楽音パートでは、0,1.・・・、1.O
と発生し、音声パートでは4,3と発生している。
In the figure, in the musical tone part, 0, 1, . ..., 1. O
This occurs as 4 and 3 in the audio part.

今、仮に、楽音パートを入力しており、制御信号317
がハイレベルを呈している状態から話を進める。なお、
楽音パートでは、信号315.316ともハイレベルと
なっており、制御信号817はロウレベルを呈している
Now, suppose we are inputting a musical tone part and the control signal 317
Let's proceed from a state in which the state is at a high level. In addition,
In the musical tone part, both signals 315 and 316 are at high level, and control signal 817 is at low level.

楽音パートでは、振幅変動部の発生頻度が少ないために
、]コンパレータ5の出力811はロウレベルを示し、
コンパレータ36の出力812はハイレベルを示す。楽
音パートから音声パートに変わり、信号S7におけるパ
ルスが4個カウントされると、コンパレータ35の出力
811がハイレベルに、コンパレータ36の出力812
がロウレベルに変わる。ここに、信号811のパルスは
、ノット回路45を介して信号815となってラッチ回
路41に入力されるので、楽音パートから音声パートに
変わるときには、フリップフロップ42の入力信号は、
信号816がそのままで、信号815がロウレベルに変
化する。このため、音声パートが入力したという判定が
行われて、制御信号Sj7はロウレベルからハイレベル
に変わる。
In the musical tone part, since the amplitude fluctuation part occurs less frequently, the output 811 of the comparator 5 shows a low level,
The output 812 of the comparator 36 indicates a high level. When the musical tone part changes to the voice part and four pulses in the signal S7 are counted, the output 811 of the comparator 35 goes high, and the output 812 of the comparator 36 goes high.
changes to low level. Here, the pulse of the signal 811 is inputted to the latch circuit 41 as a signal 815 via the knot circuit 45, so when changing from the musical tone part to the voice part, the input signal of the flip-flop 42 is
While the signal 816 remains unchanged, the signal 815 changes to low level. Therefore, it is determined that the voice part has been input, and the control signal Sj7 changes from low level to high level.

次に、音声パートから楽音パートへの切り換わり検出動
作を説明する。
Next, the operation of detecting a change from a voice part to a musical tone part will be explained.

信号812は、音声パート時にロウレベルを呈している
。アンドゲート43は、信号812と信号s8とのアン
ド出力813を導出するので、コンパレータ35,36
によって、楽音パートと判定される期間に、信号S8に
おけるパルスを通す。したがって、アンドゲート43の
出力する信@s13は、信号812に基づく音声パート
判定期間において、単位期間の周期で発生する信号S1
3の中のパルスP1をカウンター39に供給する。ここ
に、カウンター39は、信号815と信号S16のアン
ド出力である信号814によってロード状態にされるの
で、カウンター39はパルスP1をカウントし、このカ
ウント値がレジスタ40の値を超えると、所定のキャリ
ー信号を出力して信号516をロウレベルにする。
The signal 812 is at a low level during the voice part. Since the AND gate 43 derives an AND output 813 of the signal 812 and the signal s8, the comparators 35 and 36
Accordingly, a pulse in the signal S8 is passed during a period determined to be a musical tone part. Therefore, the signal @s13 output by the AND gate 43 is the signal S1 generated at the cycle of the unit period in the voice part determination period based on the signal 812.
The pulse P1 of 3 is supplied to the counter 39. Here, the counter 39 is put into a loaded state by the signal 814 which is the AND output of the signal 815 and the signal S16, so the counter 39 counts the pulse P1, and when this count value exceeds the value of the register 40, a predetermined A carry signal is output to set the signal 516 to low level.

このようにして信号816がロウレベルに切り換わる時
期を遅らせているから、コンパレータ35によって楽音
パートと判定し、信号S15がハイレベルを示しても、
フリップフロップ42の動作に変わりはなく、制御信号
817はハイレベルのままである。
In this way, the timing at which the signal 816 switches to low level is delayed, so even if the comparator 35 determines that it is a musical tone part and the signal S15 indicates a high level,
There is no change in the operation of the flip-flop 42, and the control signal 817 remains at a high level.

一方、信号816がロウレベルになると、信@S15が
ハイレベルであるので、フリップフロップ42が反転動
作し、制御信号S17をロウレベルに切り換える。
On the other hand, when the signal 816 becomes low level, since the signal @S15 is high level, the flip-flop 42 performs an inverting operation and switches the control signal S17 to low level.

こうして制御信号S17が生成され、この制t[I信号
S17は乗算係数発生回路23に入力される。
In this way, the control signal S17 is generated, and this control signal S17 is input to the multiplication coefficient generation circuit 23.

第7図において、第6図と同一信号には同一の符号を付
ず。S17は論理回路19の出力であって楽音パートか
音声パートかを示す制御信号であり、仮に楽音パートが
ロウレベルで、音声パートがハイレベルを示している。
In FIG. 7, the same signals as in FIG. 6 are not given the same symbols. S17 is an output of the logic circuit 19 and is a control signal indicating whether the part is a musical tone part or a voice part. For example, the musical tone part is at a low level and the voice part is at a high level.

また、信号S17の判定変化間隔(to −t4 、t
4/ 〜t8 )は最低75m5である。これは、音声
パートのセリフやアナウンスのスピーチ等の文単位、文
節単位、あるいは促音等で発生するバースト状の無音区
間が略75m5と言われており、上記倫理回路(第3図
参照)において、このような無音区間を判定対象とする
ことがないようにしているからである。仮に、1分に8
00文字の早い速度で話していても、1文字当たり75
m5かかる。文、文節、促音は、この一連の文字が連な
って形成されるので、実際には、75m5より長い間隔
で変化が生じることになる。信号818はクロック発生
器52の出力クロックを、819はラッチ回路56の出
力信号を、820は排他的論理和ゲート55の出力信号
を、821は論理和ゲート60の出力信号を、822は
カウンタ59の出力を、823はラッチ回路61の出力
を、S24はノット回路62の出力を、825は乗算係
数発生回路23の出力する乗算係数02の波形を、82
6は乗算係数発生回路23の出力する乗算係数C1の波
形を、それぞれ示している。
Further, the determination change interval (to −t4, t
4/~t8) is at least 75m5. This is because the burst-like silence period that occurs in sentences, phrases, and consonants, such as lines in voice parts and announcement speeches, is said to be approximately 75 m5.In the ethical circuit (see Figure 3), This is because such silent sections are not subject to determination. If 8 per minute
75 per character even if you speak at a fast speed of 00 characters.
It takes m5. Sentences, phrases, and consonants are formed by stringing these letters together, so changes actually occur at intervals longer than 75m5. Signal 818 is the output clock of the clock generator 52, 819 is the output signal of the latch circuit 56, 820 is the output signal of the exclusive OR gate 55, 821 is the output signal of the OR gate 60, and 822 is the output signal of the counter 59. 823 is the output of the latch circuit 61, S24 is the output of the NOT circuit 62, 825 is the waveform of the multiplication coefficient 02 output from the multiplication coefficient generation circuit 23, 82
6 shows the waveform of the multiplication coefficient C1 output from the multiplication coefficient generation circuit 23, respectively.

信号817はクロックパルスs18によって同期化され
、3クロック分遅延した信号819になる。信号S19
の立上り時t2は、判定出力S17における楽音パート
から音声パートへの判定変化点10より、クロック81
8の一周期以内の微小時間αと3クロック期間遅れてい
る。また、排他的論理和ゲート55の出力信号820は
、楽音パート、音声パトの判定変化点to以時のクロッ
クの立上り時(tl)より1周期区間ハイレベルパルス
P2を呈する。この出力信号820のパルスP2により
、カウンタ59はリセットされ、初期値をrOJと(る
。カウンタ59の出力822は、クロック818をカウ
ントし歩進を続け、8クロツク目で最大値「7」になる
。カウンタ59の出力値S22は、ラッチ回路61に保
持される。ラッチ回路61の出力S23と信号822と
は、1クロック期間の遅延がある。
Signal 817 is synchronized by clock pulse s18 and becomes signal 819 delayed by three clocks. Signal S19
The rising time t2 is determined by the clock 81 from the judgment change point 10 from the musical tone part to the voice part in the judgment output S17.
There is a delay of 3 clock periods from the minute time α within one period of 8. Further, the output signal 820 of the exclusive OR gate 55 exhibits a high level pulse P2 for one cycle period from the rising edge of the clock (tl) after the determination change point to of the musical tone part and the voice part. The counter 59 is reset by the pulse P2 of the output signal 820, and the initial value is set to rOJ. The output value S22 of the counter 59 is held in the latch circuit 61. There is a delay of one clock period between the output S23 of the latch circuit 61 and the signal 822.

ラッチ回路61の出力823が上記のように、rOJ〜
「7」へと段階的にアップ変化する信号であると、ノッ
ト回路62より出力する信号824は、「7」〜「0」
へと段階的にダウン変化する。セレクタ57は、信号S
19のハイレベル期間に第2入力端子群の信号を選択出
力し、ロウレベル期間に第2入力端子群の信号を選択出
力する。従って、制御信号817に由来する信号819
がロウレベルからハイレベルに変化する音声パートの区
間には1、乗算係数02が325に示すアップ形となり
、乗算係数C1が826に示すようにダウン形となる。
As mentioned above, the output 823 of the latch circuit 61 is rOJ~
If the signal changes stepwise up to "7", the signal 824 output from the knot circuit 62 will change from "7" to "0".
It gradually changes down to . The selector 57 receives the signal S
The signals of the second input terminal group are selectively output during the high level period of 19, and the signals of the second input terminal group are selectively output during the low level period. Therefore, the signal 819 derived from the control signal 817
In the section of the voice part where the signal changes from low level to high level, the multiplication coefficient 02 is 1, the multiplication coefficient 02 is in the up form as shown at 325, and the multiplication coefficient C1 is in the down form as shown at 826.

尚、信号325.826の最大値「7」は減衰量、もし
くは減衰ステップ幅を意味するので、値が大きいほど切
替わり特性が滑らかになる。実際には、全体の減衰量と
聴覚上のレベル変化の検知限0.2(dB)(この値は
、参考文献、「「感覚士知覚心理学ハンドブック」、第
709頁、誠信書房刊」に記載されている)のステップ
幅で変化させればよい。
Note that the maximum value "7" of the signal 325.826 means the amount of attenuation or the attenuation step width, so the larger the value, the smoother the switching characteristics. In reality, the detection limit for the overall attenuation and auditory level change is 0.2 (dB) (this value is given in the reference book, ``Handbook of Sensory Perceptual Psychology'', p. 709, published by Seishin Shobo). It may be changed by the step width (as described).

時刻t4に制御信号817が音声パートから楽音パート
に変化することにより、t4よりα時間後の時刻t5に
カウンタ59はリセットされ、出り値は「0」となる。
As the control signal 817 changes from the voice part to the musical tone part at time t4, the counter 59 is reset at time t5, α time after t4, and the output value becomes "0".

そして、カウンタ59は時刻t5より3りOツク経過後
の時刻t6で、「0」から「7」に段階的にアップする
信号S22を出力する。
The counter 59 then outputs a signal S22 that increases stepwise from "0" to "7" at time t6 after three zeros have passed since time t5.

従って、ラッチ回路61の出力は、時刻t6よりrOJ
〜「7」に段階的にアップする信号となる。
Therefore, the output of the latch circuit 61 is rOJ from time t6.
The signal increases step by step to 7.

ラッチ回路61の出力823が上記のように、rOJ〜
「7」へとアップ変化する信号であると、ノット回路6
2より出力する信号S24は、「71〜「0」へとダウ
ン変化する。セレクタ57は、信号S19がロウレベル
であるので、第1入力端子群の信号を選択出力し、セレ
クタ58は、第1入力端子群の信号を選択出力する。従
って、制願信@S17に由来する信号819がハイレベ
ルからロウレベルに変化する楽音パートへの変化区間に
は、乗算係数02が825に示すように、ダウン形の信
号となり、乗算係数01が826に示すようにアップ形
の信号となる。
As mentioned above, the output 823 of the latch circuit 61 is rOJ~
If the signal changes up to "7", the knot circuit 6
The signal S24 output from 2 changes down from "71" to "0". Since the signal S19 is at a low level, the selector 57 selectively outputs the signals of the first input terminal group, and the selector 58 selectively outputs the signals of the first input terminal group. Therefore, in the transition period from the high level to the musical tone part where the signal 819 derived from the request signal @S17 changes from high level to low level, the multiplication coefficient 02 becomes a down-type signal as shown at 825, and the multiplication coefficient 01 becomes a down-type signal as shown at 826. The signal becomes an up-type signal as shown in .

尚、減衰量を60 (dB)にすると、ビット数nは1
0程あればよく、そのとき時刻tO〜t3は、102ク
ロツク必要になる。クロック発振器52からのクロック
パルスの周期をコンパクトディスク等の約22μS (
44,1ktlZ)にすると、t3〜to=23iSと
なる。したがって、t4〜10の最大変化幅である75
ilSに比べ充分に短い期間に歩進動作は終了する。
Furthermore, if the attenuation amount is 60 (dB), the number of bits n is 1
It is sufficient if it is about 0, and in that case, 102 clocks are required from time tO to t3. The period of the clock pulse from the clock oscillator 52 is set to approximately 22 μS (
44,1ktlZ), t3~to=23iS. Therefore, the maximum change width from t4 to 10 is 75
The stepping operation ends in a sufficiently shorter period than ilS.

このように、アップダウン変化が相補的な乗算係数CI
 、C2によって混合回路21の乗算器m1 。
In this way, the multiplication coefficient CI whose up and down changes are complementary
, C2 of the multiplier m1 of the mixing circuit 21.

m2及びmOが制御されると、楽音パートから音声パー
トに変わるt2〜t2の区間では、信号aとbに対する
の減衰量が最小で、差信号Cに対重る減衰量が最大の出
力より、信号a、bに対するの減衰かが最大で、差信号
Cに対する減衰量が最小に変わる出力に音場効果がかか
る。また、音声パートから楽音パートに変わる16〜t
7の同期しているので、各サンプリング区間では、信号
aとbに対するの減衰量が最大で、差信号Cに対する減
衰量が最小の出力より、信号a、bに対するの減衰量が
最小で、差信号Cに対する減衰量が最大に変わる出力に
音場効果がかかる。
When m2 and mO are controlled, in the interval from t2 to t2 when the musical tone part changes to the voice part, the attenuation amount for the signals a and b is the minimum, and the attenuation amount for the difference signal C is the maximum. The sound field effect is applied to the output where the amount of attenuation for the signals a and b is maximum and the amount of attenuation for the difference signal C is the minimum. Also, 16~t changes from the voice part to the musical part.
7 are synchronized, so in each sampling period, the output with the maximum attenuation for signals a and b and the minimum attenuation for difference signal C has the minimum attenuation for signals a and b, and the difference The sound field effect is applied to the output where the amount of attenuation for signal C changes to the maximum.

以下更に、音場効果を付加するオーディオ系の動作を詳
細に説明する。
Below, the operation of the audio system that adds the sound field effect will be explained in detail.

入力信号■、■がシラブル検出回路18に入力されて、
楽音パート、あるいは音声パートに応じて2値化号S6
を出力する。この2値化号S6を取り込んだ論理回路1
9は、入力信号■、■が音声パートであると判定すると
、制御信号517をハイレベルとして乗算係数発生回路
23に与える。これにより、乗算係数発生回路23の乗
算係数01は最大値から次第にrOJになり、また乗算
係数C2はOから次第に最大値になる。一方、乗算係数
発生回路23のり臼ツク発生回路52からのクロックパ
ルス818は、A/D変換器20のサンプリング信号と
同期しているので、各サンプリング毎に混合回路21の
乗算器mO〜m2にて乗算が行われる。よって、混合回
路21の出力端子e、fには、A/D変換器20の出力
信号a、bより差信号作成回路15からの差信号Cの割
合が次第に大きくなるように変化してゆく信号が出力さ
れる。そして、最終的に混合回路21の乗算器ml 、
m2が非導通状態となり、乗算器mOが導通状態になっ
て、音声パート時にはセリフやアナウンス等の同相信号
は音場効果回路17に供給されず、差信号のみが供給さ
れることになる。
The input signals ■ and ■ are input to the syllable detection circuit 18,
Binary code S6 depending on the musical tone part or voice part
Output. Logic circuit 1 that takes in this binary code S6
When the control signal 9 determines that the input signals ① and ② are voice parts, it supplies the control signal 517 to the multiplication coefficient generation circuit 23 at a high level. As a result, the multiplication coefficient 01 of the multiplication coefficient generation circuit 23 gradually becomes rOJ from the maximum value, and the multiplication coefficient C2 gradually becomes the maximum value from 0. On the other hand, since the clock pulse 818 from the multiplier generation circuit 52 of the multiplication coefficient generation circuit 23 is synchronized with the sampling signal of the A/D converter 20, the clock pulse 818 is sent to the multipliers mO to m2 of the mixing circuit 21 for each sampling. Multiplication is performed. Therefore, the output terminals e and f of the mixing circuit 21 receive a signal that changes so that the proportion of the difference signal C from the difference signal generation circuit 15 gradually becomes larger than the output signals a and b of the A/D converter 20. is output. Finally, the multiplier ml of the mixing circuit 21,
m2 becomes non-conductive, multiplier mO becomes conductive, and during the voice part, in-phase signals such as lines and announcements are not supplied to the sound field effect circuit 17, and only the difference signal is supplied.

一方、再び、倫理回路19において楽音パートであると
判定されると、乗算係数発生回路23の出力C1は「0
」から次第に最大値になり、またその出力C2は最大値
から次第にrOJになる。また、乗算係数発生回路23
のクロック発生回路52からのクロックパルスS18は
、A/D変換器20のサンプリング信号と同期している
ので、各サンプリング毎に混合回路21の乗算器mO〜
m2にて乗算が行われる。これによって、混合回路21
の出力端子e、fには、差信号作成回路15の出力信号
CからA/D変換器20の出力信号a、bに次第に変化
してゆく信号が出力される。そして、最終的に混合回路
21の乗算器ml、m2が導通状態になり、乗算器mO
が非導通状態となって、楽音パート時には信号a、bが
音場効果回路17に供給される。
On the other hand, when the logic circuit 19 again determines that it is a musical tone part, the output C1 of the multiplication coefficient generation circuit 23 is "0".
”, the output C2 gradually reaches the maximum value, and its output C2 gradually reaches rOJ from the maximum value. In addition, the multiplication coefficient generation circuit 23
Since the clock pulse S18 from the clock generation circuit 52 is synchronized with the sampling signal of the A/D converter 20, the multiplier mO~ of the mixing circuit 21 is generated for each sampling.
Multiplication is performed in m2. As a result, the mixing circuit 21
A signal that gradually changes from the output signal C of the difference signal generation circuit 15 to the output signals a and b of the A/D converter 20 is output to the output terminals e and f of. Finally, the multipliers ml and m2 of the mixing circuit 21 become conductive, and the multiplier mO
becomes non-conductive, and signals a and b are supplied to the sound field effect circuit 17 during the musical tone part.

こうして、司会者の声と観衆の声援が入り交じったオー
ディオソースの場合でも、司会者の声には音場効果がか
からず、周囲の声援に音場効果がかかるという制御が可
能になる。
In this way, even in the case of an audio source in which the voice of the presenter and the cheering of the audience are mixed, it is possible to perform control such that the sound field effect is not applied to the voice of the presenter and the sound field effect is applied to the cheering of the surroundings.

第8図は、乗算係数発生手段の他の構成例を示すブロッ
ク図である。
FIG. 8 is a block diagram showing another example of the configuration of the multiplication coefficient generating means.

第1図の乗算係数発生手段としては、第4図に示づよう
に乗算係数発生回路23において乗算係数をバイナリカ
ウンタ59による歩道値と同じくしていたが、第8図に
示づように乗算係数発生回路23の出力CI 、C2に
対して対数変換した乗算係数を有するテーブルを記憶し
たR OM 101.102を用いて乗算係数を得るよ
うにした手段であってもよい。
As shown in FIG. 1, the multiplication coefficient generation circuit 23 uses the same multiplication coefficient as the sidewalk value obtained by the binary counter 59 as shown in FIG. The multiplication coefficients may be obtained by using ROMs 101 and 102 that store tables containing multiplication coefficients obtained by logarithmically transforming the outputs CI and C2 of the coefficient generation circuit 23.

ここで、ROM 101,102には、アドレス値にそ
って対数上で等間隔の乗算係数値を書き込んでおき、当
該アドレスを選択すれば乗算係数がデータとして出力さ
れるようにしである。そして、乗算係数発生回路23の
出力CI 、C2は、ROM 101102のアドレス
入力として入力する。これによりROM 101.10
2からは、乗算係数CI’、C2’が導出されるので、
これらを混合回路21の乗算器m1.m2に与えるよう
にすればよい。
Here, multiplication coefficient values are written in the ROMs 101 and 102 at equal intervals on a logarithm along the address value, so that when the address is selected, the multiplication coefficient is output as data. The outputs CI and C2 of the multiplication coefficient generation circuit 23 are input as address inputs of the ROM 101102. This allows ROM 101.10
2, the multiplication coefficients CI' and C2' are derived, so
These are multiplied by the multiplier m1 of the mixing circuit 21. What is necessary is to give it to m2.

このようにすると、例えば0.2[dB]等のステップ
の減衰曲線やあるいは任意の減衰曲線が簡便に得ること
ができる。また、乗算係数発生回路23内のバイナリカ
ウンタ59のビット数と第1図の乗算器mO〜m2の係
数語長を異なる数に設定できるので、より精度の高い信
号処理も可能になる。
In this way, an attenuation curve with steps of, for example, 0.2 [dB] or an arbitrary attenuation curve can be easily obtained. Further, since the number of bits of the binary counter 59 in the multiplication coefficient generation circuit 23 and the coefficient word length of the multipliers mO to m2 in FIG. 1 can be set to different numbers, more accurate signal processing is also possible.

また、このようにするための回路構成も簡単になる。尚
、処理速度によっては、ROM101102を一つとし
て多重化して使用することもできる。
Moreover, the circuit configuration for doing this also becomes simple. Note that depending on the processing speed, the ROMs 101102 may be used in multiplexed form.

加えて、上記乗算係数発生の方法によれば、上記第4図
の実施例が乗算係数発生回路23で使用するクロックパ
ルスの周期をA/D変換器20のサンプリング周期と同
一としたが、異なる周期の信号としてもよい。その場合
、乗算器mO〜m2によるサンプリング値(信号)と係
数値の演算時に同一サンプリング中に係数値が変化しな
い処理をすればよい。
In addition, according to the method of generating multiplication coefficients, the period of the clock pulse used in the multiplication coefficient generation circuit 23 in the embodiment shown in FIG. It may also be a periodic signal. In that case, when the multipliers mO to m2 calculate the sampling values (signals) and coefficient values, it is sufficient to perform processing such that the coefficient values do not change during the same sampling.

更に、上記乗算係数発生の処理方法を実現するにデジタ
ル処理をしているので、シグナルプロセッサやマイクロ
コンピュータによるソフトウェア処理を使用することが
できる。
Furthermore, since digital processing is used to realize the above multiplication coefficient generation processing method, software processing by a signal processor or a microcomputer can be used.

上記発明による音場効果制御は、上記各実施例のように
デジタル信号の段階で行ったが、アナログ信号の段階で
行ってもよい。このようにアナログ式に音場効果制御を
行う場合には、音場効果回路としてアナログ式の!積回
路(VCA等)を用いればよい。
Although the sound field effect control according to the invention described above is performed at the stage of digital signals as in each of the above embodiments, it may also be performed at the stage of analog signals. When performing analog sound field effect control in this way, analog ! A product circuit (such as a VCA) may be used.

また、入力オーディオ信号が2チヤネルの場合で説明し
たが、多チャネルの信号の場合でも同窓の信号成分が含
まれる2信号間で互いに差成分を出力することで、この
発明を適用することができる。
Further, although the explanation has been made for the case where the input audio signal is two channels, the present invention can be applied to multi-channel signals by outputting the difference component between two signals that include signal components of the same window. .

更に、音場効果出力信号を入力オーディオ信号の数に関
係なく任意に増設した音場効果回路を用いた場合でも、
同様な効果が生じる。
Furthermore, even when using a sound field effect circuit in which the sound field effect output signal is arbitrarily added regardless of the number of input audio signals,
A similar effect occurs.

[発明の効果] 以上述べたようにこの発明によれば、音声パトと楽音パ
ートとの間の音場効果に大きな差を生じることなく、自
然な音場効果をかけることができ、かつ音声パートと楽
音パートとの間の切り換えを自然な形で円滑に行うこと
ができる。
[Effects of the Invention] As described above, according to the present invention, it is possible to apply a natural sound field effect without creating a large difference in the sound field effect between the audio part and the musical part, and and musical tone parts can be smoothly and naturally switched.

【図面の簡単な説明】[Brief explanation of drawings]

第1図はこの発明に係る音場効果自動制御装置の一実施
例を示すブロック図、第2図、第3図及び第4図は第1
図に示す実施例の各構成要素を詳細に説明する具体的回
路図、第5図、第6図及び第7図はこの発明の詳細な説
明するためのタイミングチャート、第8図はこの発明の
他の実施例を示すブロック図、第9図及び第10図は従
来の音場効果自動制御装置を示すブロック図である。 15・・・差信号作成回路、17・・・音場効果回路、
18・・・シラブル検出回路、19・・・倫理回路、2
0・・・A/D変換器、21・・・混合回路、22・・
・D/A変換器、23・・・乗算係数発生回路。 勇(@パートーー+−一 @P)V ト 一一一余合パ ト
FIG. 1 is a block diagram showing an embodiment of the automatic sound field effect control device according to the present invention, and FIGS.
5, 6, and 7 are timing charts for explaining the present invention in detail. FIG. A block diagram showing another embodiment, FIGS. 9 and 10 are block diagrams showing a conventional automatic sound field effect control device. 15... Difference signal creation circuit, 17... Sound field effect circuit,
18...Syllable detection circuit, 19...Ethical circuit, 2
0...A/D converter, 21...Mixing circuit, 22...
- D/A converter, 23... multiplication coefficient generation circuit. Yuu (@Part-+-1 @P)V

Claims (2)

【特許請求の範囲】[Claims] (1)複数チャネルより成るオーディオ信号のうちステ
レオ伝送となる2信号の差分を出力する差信号作成回路
と、 前記2信号をそのまま通過させる線路と、 前記オーディオ信号の音声パートと楽音パートを判定す
る判定手段と、 前記各2信号と前記差分信号作成回路からの出力とを混
合し、その混合比が前記判定手段から出力する判定結果
の切替わり時点より時間経過に応じて相補的に変化する
ように出力する混合回路と、この混合回路からの出力に
音場効果を付加する音場効果回路とを具備したことを特
徴とする音場効果自動制御装置。
(1) A difference signal creation circuit that outputs the difference between two signals for stereo transmission among audio signals consisting of multiple channels, a line that passes the two signals as they are, and determines the voice part and musical tone part of the audio signal. a determining means for mixing each of the two signals and an output from the differential signal generating circuit so that the mixing ratio changes complementary with time from a point in time when the determination results outputted from the determining means are switched; 1. An automatic sound field effect control device comprising: a mixing circuit that outputs an output to the mixing circuit; and a sound field effect circuit that adds a sound field effect to the output from the mixing circuit.
(2)複数チャネルより成るオーディオ信号のうちステ
レオ伝送となる2信号の差分を出力する差信号作成回路
と、 前記2信号をそのまま通過させる線路と、 前記オーディオ信号の音声パートと楽音パートを判定す
る判定手段と、 前記各2信号と前記差分信号作成回路からの出力とを混
合し、その混合比が前記判定手段から出力する判定結果
の切替わり時点より時間経過に応じて相補的に対数変化
するように出力する混合回路と、 この混合回路からの出力に音場効果を付加する音場効果
回路とを具備したことを特徴とする音場効果自動制御装
置。
(2) A difference signal creation circuit that outputs the difference between two signals for stereo transmission among audio signals consisting of multiple channels, a line that passes the two signals as they are, and determines the voice part and musical tone part of the audio signal. a determining means for mixing each of the two signals and an output from the differential signal generating circuit, the mixing ratio of which changes logarithmically in a complementary manner over time from a switching point in time between the determination results output from the determining means; What is claimed is: 1. A sound field effect automatic control device comprising: a mixing circuit that outputs a sound field effect as shown in FIG.
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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20030082299A (en) * 2002-04-17 2003-10-22 (주)크레디트사운드 Sound signal processing system of audio mixer
JP2010283620A (en) * 2009-06-04 2010-12-16 Kyushu Institute Of Technology Circuit for controlling surround effect
JP2010288262A (en) * 2009-05-14 2010-12-24 Yamaha Corp Signal processing apparatus
CN101977345A (en) * 2010-09-29 2011-02-16 华宏千 KTV (Karaok Television) compartment sound box system

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