JPH0320117B2 - - Google Patents

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JPH0320117B2
JPH0320117B2 JP55059370A JP5937080A JPH0320117B2 JP H0320117 B2 JPH0320117 B2 JP H0320117B2 JP 55059370 A JP55059370 A JP 55059370A JP 5937080 A JP5937080 A JP 5937080A JP H0320117 B2 JPH0320117 B2 JP H0320117B2
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JP
Japan
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data
pulse
rate
telephone
microprocessor
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JP55059370A
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Japanese (ja)
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JPS55149591A (en
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Andoryu Suteiibunson Robaato
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JII II SHII PURETSUSHII TEREKOMYUNIKEESHONZU Ltd
Original Assignee
JII II SHII PURETSUSHII TEREKOMYUNIKEESHONZU Ltd
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Publication date
Application filed by JII II SHII PURETSUSHII TEREKOMYUNIKEESHONZU Ltd filed Critical JII II SHII PURETSUSHII TEREKOMYUNIKEESHONZU Ltd
Publication of JPS55149591A publication Critical patent/JPS55149591A/en
Publication of JPH0320117B2 publication Critical patent/JPH0320117B2/ja
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04MTELEPHONIC COMMUNICATION
    • H04M9/00Arrangements for interconnection not involving centralised switching
    • H04M9/02Arrangements for interconnection not involving centralised switching involving a common line for all parties

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  • Engineering & Computer Science (AREA)
  • Signal Processing (AREA)
  • Sub-Exchange Stations And Push- Button Telephones (AREA)
  • Dc Digital Transmission (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)
  • Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明はデータ処理回路に関するものであり、
具体的には、しかしこれに限定されるものではな
いが、電話装置においてデータ処理装置からデー
タパルスのバーストを受信するのに使用するその
ような回路に関するものである。
[Detailed Description of the Invention] [Field of Industrial Application] The present invention relates to a data processing circuit,
In particular, but not exclusively, it relates to such a circuit for use in a telephone device to receive bursts of data pulses from a data processing device.

[従来の技術] 中央制御装置および多数の関連する電話端末か
らなる電話装置において、電話端末は呼のない状
態で長期間遊休している場合が多い。しかし、中
央制御装置は電話端末のいずれかで発生するどん
な変化にもすみやかに応動することが要求され
る。
[Prior Art] In a telephone system consisting of a central control unit and a large number of associated telephone terminals, the telephone terminals are often idle for long periods of time without any calls. However, the central controller is required to react quickly to any changes occurring at any of the telephone terminals.

[発明が解決しようとする課題] したがつて各電話端末を連続的にモニタし、そ
の電話端末で発生した変化に関するデータを妥当
な期間内に中央制御装置に送ることが望ましい。
さらに、電話システムが押ボタンの操作に応答し
て電話端末間に必要な通話路を設定すると、押ボ
タンを短い期間だけ押すような操作にも制御装置
が確実に応答するようにしなければならない。
SUMMARY OF THE INVENTION It is therefore desirable to continuously monitor each telephone terminal and to send data regarding changes occurring at that telephone terminal to a central control unit within a reasonable period of time.
Additionally, once the telephone system responds to pushbutton operations to establish the necessary communication paths between telephone terminals, the controller must also ensure that the control device responds to operations that involve pressing the pushbutton for only a short period of time.

よつて、本発明の目的は、受信パルスバースト
を迅速かつ正確に検出することにある。
It is therefore an object of the present invention to detect received pulse bursts quickly and accurately.

[課題を解決するための手段] 本発明のデータ処理回路は、プレフイツクスパ
ルスとこのパルスに続きこのパルスよりもパルス
幅の短い複数のデータパルスとから成るパルスバ
ーストを受信するためのデータ処理回路であつ
て、入力信号は、各バーストの間で前記データパ
ルスの送信速度よりも遅い第1速度で標本化さ
れ、プレフイツクスパルスの検出の際には前記デ
ータパルスの送信速度よりも速い第2速度で標本
化され、前記データパルスのうちの第1データパ
ルスの検出の際には前記データパルスの送信速度
と同じ第3速度で標本化されるものである。
[Means for Solving the Problems] A data processing circuit of the present invention performs data processing for receiving a pulse burst consisting of a prefix pulse and a plurality of data pulses that follow this pulse and have a pulse width shorter than this pulse. the circuit, wherein the input signal is sampled during each burst at a first rate that is slower than the transmission rate of the data pulses and, upon detection of a prefix pulse, faster than the transmission rate of the data pulses; The data is sampled at a second rate, and when a first data pulse of the data pulses is detected, it is sampled at a third rate, which is the same as the transmission rate of the data pulses.

第1の周期的速度は実質的に前記パルスの伝送
速度より遅く、第2の周期的速度は実質的に前記
伝送速度より速く、第3の周期的速度は実質的に
前記伝送速度と同じであることが好ましい。
A first periodic rate is substantially less than the pulse transmission rate, a second periodic rate is substantially faster than the transmission rate, and a third periodic rate is substantially the same as the transmission rate. It is preferable that there be.

本発明によれば、上記のような構成および作用
により受信パルスバーストを迅速かつ正確に検出
することが可能となる。
According to the present invention, it is possible to detect received pulse bursts quickly and accurately with the above-described configuration and operation.

[作用及び実施例] 本発明によるデータ処理装置を含む電話装置の
一例を添附図面を参照して以下に説明する。
[Operations and Examples] An example of a telephone device including a data processing device according to the present invention will be described below with reference to the accompanying drawings.

第1図を参照すると、中央制御装置1、集線装
置2ならびに3台の電話端末3,4および5から
なる電話装置が示されている。各電話端末3,4
および5はデータ処理回路すなわちデータインタ
ーフエース6、電話機7、表示パネル8およびキ
ーパツド9を有する。各電話機7はそれぞれ加入
者線11および集線装置2を介して中央制御装置
1の制御によつて、中継線10に接続される。
Referring to FIG. 1, a telephone system is shown comprising a central control unit 1, a line concentrator 2 and three telephone terminals 3, 4 and 5. Each telephone terminal 3, 4
and 5 have a data processing circuit or data interface 6, a telephone 7, a display panel 8 and a keypad 9. Each telephone set 7 is connected to a trunk line 10 via a subscriber line 11 and a line concentrator 2 under the control of the central control unit 1, respectively.

第2図も参照すると、各データインターフエー
ス6はマイクロプロセツサ13を有し、その動作
速度は周波数制御装置14、入力バツフア回路1
5および出力バツフア回路16によつて制御され
る。
Referring also to FIG. 2, each data interface 6 has a microprocessor 13 whose operating speed is determined by a frequency controller 14, an input buffer circuit 1
5 and an output buffer circuit 16.

マイクロプロセツサ13は中央制御装置1から
各データ伝送路12および入力バツフア回路15
を介してデータを受信する。マイクロプロセツサ
13は受信したデータを使用して1組のランプま
たは発光ダイオード21ないし28が存在すれば
そのうちのいずれを点灯すべきかを判定する。可
聴警報装置(図示せず)も同様の方法で制御する
ことができる。
The microprocessor 13 connects the central controller 1 to each data transmission path 12 and input buffer circuit 15.
Receive data via. Microprocessor 13 uses the received data to determine which of the set of lamps or light emitting diodes 21-28, if any, should be lit. An audible alarm device (not shown) can also be controlled in a similar manner.

このマイクロプロセツサは、キーパツド9のボ
タンまたはスイツチの接点41ないし48が存在
すればそのいずれが動作したかの検出も行い、こ
れらのボタンの動作に関するデータを内部メモリ
(図示せず)に記憶する。ボタンの動作に関する
データは、中央制御装置1からデータを受信後出
力バツフア回路16およびデータ伝送路12を経
由して中央制御装置1へ転送される。実際には接
点41ないし48のうちの1つは対応する電話機
7のフツクスイツチの接点であつてもよい。
This microprocessor also detects whether any of the buttons or switch contacts 41 to 48 on the keypad 9 have been activated, and stores data regarding the operation of these buttons in an internal memory (not shown). . After receiving the data from the central control device 1, data regarding button operations is transferred to the central control device 1 via the output buffer circuit 16 and the data transmission line 12. In fact, one of the contacts 41 to 48 may be a contact of a corresponding telephone 7 switch.

中央制御装置1とデータインターフエース6と
の間でデータ交換を行つていないときは、マイク
ロプロセツサ13はキーパツド9の接点41ない
し48を走査してこれらのボタンが存在すればそ
のいずれが作動しているかを判定する。すなわ
ち、マイクロプロセツサ13は信号を出力50な
いし53のそれぞれに順次印加し、入力17およ
び18について信号の返送を調べる。たとえば接
点42の対応するボタンのみを操作したとすれ
ば、出力52の信号は入力17のみに現われる。
この場合出力50,51および53の信号は入力
17,18のいずれにも現われることはない。キ
ーパツド9の走査を完了すると、マイクロプロセ
ツサ13は入力19を標本化して、中央制御装置
1から現在データバーストを受信中であるかどう
かを判定する。これはプレフイツクスパルスで示
され、これは入力19の2進状態の変化を現わし
このデータバーストに先行する。このプレフイツ
クスが存在しないとマイクロプロセツサ13は前
述のようにキーパツド9の走査に戻る。
When no data is being exchanged between the central control unit 1 and the data interface 6, the microprocessor 13 scans the contacts 41 to 48 of the keypad 9 to determine which of these buttons, if any, is activated. Determine whether That is, microprocessor 13 sequentially applies a signal to each of outputs 50-53 and examines inputs 17 and 18 for returning signals. For example, if only the corresponding button of contact 42 is operated, the signal at output 52 will appear only at input 17.
In this case the signals at outputs 50, 51 and 53 do not appear at either input 17 or 18. Upon completion of scanning keypad 9, microprocessor 13 samples input 19 to determine whether it is currently receiving a data burst from central controller 1. This is indicated by a prefix pulse, which represents a change in the binary state of input 19 and precedes this data burst. In the absence of this prefix, microprocessor 13 returns to scanning keypad 9 as described above.

プレフイツクスパルスが入力19に存在する
と、マイクロプロセツサ13はキーパツド9の走
査を中止して、その入力19の2進状態の更なる
変化がそのプレフイツクスの終了および入力デー
タバーストのスタートビツトの開始を表わすまで
入力19の繰返し標本値をとる。ここでマイクロ
プロセツサ13は入力19を標本化する速度を変
えて実質的に入力データバーストのビツト速度で
この入力を標本化する。
When a prefix pulse is present at input 19, microprocessor 13 stops scanning keypad 9 so that a further change in the binary state of input 19 signals the end of the prefix and the beginning of the start bit of the input data burst. Iteratively samples input 19 until it represents . Here, microprocessor 13 varies the rate at which it samples input 19 to sample this input at substantially the bit rate of the input data burst.

各データインターフエース6のマイクロプロセ
ツサ13はそのそれぞれの内部クロツク(図示せ
ず)の制御によつて動作し、このクロツクは各周
波数制御装置14によつて制御されている。各マ
イクロプロセツサ13のそれぞれのクロツクは、
中央制御装置1からデータを受信しているとき各
入力19の標本化が中央制御装置1によるビツト
伝送速度と実質的に同じ速度で行われるようにな
されている。この速度をここではビツト速度と称
する。1つのデータパルスを送信するのに中央制
御装置1が要する時間をビツト周期と称する。
The microprocessor 13 of each data interface 6 operates under the control of its respective internal clock (not shown), which clock is controlled by a respective frequency controller 14. Each clock of each microprocessor 13 is
The sampling of each input 19 when receiving data from the central controller 1 is arranged to occur at substantially the same rate as the bit transmission rate by the central controller 1. This speed is referred to herein as the bit speed. The time required by the central controller 1 to transmit one data pulse is called a bit period.

マイクロプロセツサ13がその入力データ流の
第1の標本値をとる前に、すなわちプレフイツク
スパルスの終了を検出すると、1ビツト周期の半
分の間遅延する。マイクロプロセツサ13は実質
的にそのビツト速度で入力19を標本化している
ので、これによつて入力データバーストの各ビツ
トがそれぞれのビツト周期中実質的に半分だけ標
本化されることが確実になる。
Before microprocessor 13 takes the first sample of its input data stream, ie, detects the end of the prefix pulse, there is a delay of half a bit period. Since microprocessor 13 is sampling input 19 substantially at its bit rate, this ensures that each bit of the input data burst is sampled substantially only half of the time during each bit period. Become.

入力データバーストを受信すると、マイクロプ
ロセツサ13は約2ビツト周期分だけ遅延し、つ
ぎに接点41ないし48の動作に関する蓄積デー
タを中央制御装置1へ転送する。
Upon receiving the input data burst, the microprocessor 13 delays by approximately two bit periods and then forwards the accumulated data regarding the operation of the contacts 41 to 48 to the central controller 1.

蓄積データの転送を終了すると、マイクロプロ
セツサ13は中央制御装置1から受信したこのデ
ータを使用して表示パネル8の指定のランプを点
灯したり消灯したりし、または可聴警報器(図示
せず)を鳴らしたり止めたりする。
After completing the transfer of the stored data, the microprocessor 13 uses this data received from the central controller 1 to turn on or off designated lamps on the display panel 8, or to set off an audible alarm (not shown). ) to start or stop the sound.

ここで第3図を参照して中央制御装置1と電話
端末3,4および5のそれぞれとの間の信号方式
を詳細に説明する。
The signaling system between the central control unit 1 and each of the telephone terminals 3, 4 and 5 will now be described in detail with reference to FIG.

中央制御装置1は電話端末3,4および5のそ
れぞれのデータ伝送路12を順次走査する。中央
制御装置1がたとえば電話端末3のデータ伝送路
12の走査を開始すると2進の「1」を表わす信
号60がこれによつてデータ伝送路12に印加さ
れる。この信号60はここではプレフイツクスパ
ルスと称するが、3ビツト周期にわたつて中央制
御装置1によつて保持される。前に述べたよう
に、電話端末3のデータインターフエース6は最
初に低い標本化速度、例えば各2〜2.75ビツト周
期ごとにデータ伝送路12を標本化するが、デー
タ伝送路12の標本化が該低標本速度で行なわれ
る標本点は第3図において矢印68で表わされて
いる。
The central control unit 1 sequentially scans the data transmission paths 12 of each of the telephone terminals 3, 4 and 5. When the central control unit 1 starts scanning the data transmission line 12 of the telephone terminal 3, for example, a signal 60 representing a binary "1" is thereby applied to the data transmission line 12. This signal 60, referred to herein as a prefix pulse, is held by the central controller 1 for three bit periods. As previously mentioned, the data interface 6 of the telephone terminal 3 initially samples the data transmission line 12 at a low sampling rate, e.g. The sample points made at the low sample rate are represented by arrows 68 in FIG.

プレフイツクス60は3ビツト周期の間データ
伝送路12に保持されているので、少なくとも1
個の標本点68が発生してからプレフイツクス6
0を除去しなければならない。データインターフ
エース6がプレフイツクス60を検出すると、標
本点69で示すように標本化速度がビツト速度の
6倍に増加する。
Since the prefix 60 is held in the data transmission path 12 for 3 bit periods, at least 1
Prefix 6 is generated after 68 sample points are generated.
0 must be removed. When data interface 6 detects prefix 60, the sampling rate increases to six times the bit rate, as indicated by sample point 69.

3ビツト周期が経過すると、中央制御装置1は
2進「0」信号をデータ伝送路12に印加する。
この信号はスタートビツト61と称するが、1ビ
ツト周期の間中央制御装置1によつて保持され
る。データ伝送路12の2進状態の変化を1ビツ
ト周期の1/6以内にデータインターフエース6に
よつて検出し、つぎにインターフエース6はその
標本化速度を実質的に標本点70で示されるよう
なビツト速度に変更する。
When three bit periods have elapsed, the central controller 1 applies a binary "0" signal to the data transmission line 12.
This signal, called start bit 61, is held by central controller 1 for one bit period. Changes in the binary state of the data transmission line 12 are detected by the data interface 6 within 1/6 of one bit period, and the interface 6 then changes its sampling rate substantially as indicated by the sample point 70. Change the bit speed to .

スタートビツト61が終了すると中央制御装置
1は2進データ信号62をデータ伝送路12に順
次印加し、これは8個のデータビットを表わす。
データ信号62はすでに説明したようにデータイ
ンターフエース6によつて受信され蓄積される。
At the end of the start bit 61, the central controller 1 sequentially applies a binary data signal 62 to the data transmission line 12, representing eight data bits.
Data signal 62 is received and stored by data interface 6 as previously described.

ここで中央制御装置1は電話端末3のキーパツ
ド9の接点41ないし48の動作に関係するデー
タを受信しなければならない。このデータの伝送
は約2ビツト周期である期間20ののち開始す
る。この期間20中、中央制御装置1は標本点7
1で示すように1ビツト周期当り約6回の速度で
データ伝送路12を繰り返し標本化する。データ
インターフエース6は2進「1」を表わす。信号
64をデータ伝送路12に印加し、これはキーパ
ツト9のボタンの動作に関する蓄積データを表わ
す1バースト分のデータパルスの開始を中央制御
装置1に示すものである。中央制御装置1は信号
64を検出して、つぎにその標本化速度を標本点
72に示すようなビット速度に変更する。スター
ト信号64が終了すると、データインターフエー
ス6はキーパツド9のボタンの動作に関する8個
のデータビットを表わす2進信号65をデータ伝
送路12に印加する。信号65は中央制御装置1
によつて受信され蓄積される。
The central control unit 1 must now receive data relating to the operation of the contacts 41 to 48 of the keypad 9 of the telephone terminal 3. The transmission of this data begins after period 20, which is approximately 2 bit periods. During this period 20, the central controller 1
The data transmission line 12 is repeatedly sampled at a rate of about 6 times per bit period, as indicated by 1. Data interface 6 represents a binary "1". A signal 64 is applied to the data line 12 which indicates to the central controller 1 the beginning of a burst of data pulses representing stored data relating to the operation of the buttons on the keypad 9. Central controller 1 detects signal 64 and then changes its sampling rate to a bit rate as shown at sample point 72. Upon completion of the start signal 64, the data interface 6 applies a binary signal 65 to the data transmission line 12 representing eight data bits relating to the operation of the buttons on the keypad 9. Signal 65 is central control unit 1
received and stored by.

ここで中央制御装置1は1ビツト周期66の間
遅延し、つぎにつぎの電話端末4の各データ伝送
路12の走査を開始するが、これは、電話端末4
の各データバーストの前にそのデータ伝送路に2
進「1」信号67を与えることによつて行われ
る。
The central controller 1 then delays for one bit period 66 and then starts scanning each data transmission line 12 of the next telephone terminal 4;
2 on the data transmission path before each data burst of
This is done by providing a binary ``1'' signal 67.

電話端末3,4および5の各データ伝送路12
をすべて上述のような方法で走査してしまうと、
中央制御装置1はこの受信したデータに応動し
て、たとえば集線装置2に電話端末3,4および
5のうちの1つと中継線10との間の接続を設定
される。この期間中(これは必ずしも一定の期間
である必要はないが)、データ伝送路12の走査
は行われない。
Each data transmission path 12 of telephone terminals 3, 4 and 5
If all are scanned using the method described above,
In response to the received data, the central control unit 1 establishes a connection between one of the telephone terminals 3, 4 and 5 and the trunk line 10 in the line concentrator 2, for example. During this period (although this does not necessarily have to be a fixed period), the data transmission line 12 is not scanned.

中央制御装置1が電話端末3,4および5から
受信したデータによつて要求されるそのすべての
タスクを終了すると、上に述べた走査シーケンス
を繰り返す。
When the central controller 1 has completed all its tasks required by the data received from the telephone terminals 3, 4 and 5, it repeats the scanning sequence described above.

たとえば電話端末3から中継線10への接続は
つぎのようにして行われる。電話機7の送受器を
あげて各キーパツド9のボタンを操作して中継線
10への接続を要求することを示す。この送受器
をあげてボタンを操作する動作は各データインタ
ーフエース6によつて検出され、これは走査され
るとこれらの動作に関するデータを中央制御装置
1へ転送する。すべての電話端末3,4および5
の走査が完了すると、中央制御装置1は集線装置
2によつて中継線10と電話端末3の電話機7の
各通話路11との間に接続を設定する。つぎにダ
イヤルインパルスおよび通話の送信が公知の方法
で行われる。
For example, the connection from the telephone terminal 3 to the trunk line 10 is performed as follows. This indicates that a connection to the trunk line 10 is requested by lifting the handset of the telephone 7 and operating the buttons on each keypad 9. These handset-up and button-actuating actions are detected by each data interface 6, which, when scanned, transmits data relating to these actions to the central control unit 1. All telephone terminals 3, 4 and 5
When the scanning is completed, the central control unit 1 uses the line concentrator 2 to establish a connection between the trunk line 10 and each communication path 11 of the telephone set 7 of the telephone terminal 3. The dial impulse and transmission of the call are then performed in a known manner.

電話端末3,4および5を順次走査すると、中
央制御装置1は中継線10が使用中であることを
データインターフエース6に示すデータを各電話
端末のそれぞれのデータインターフエース6に送
出する。このデータを受信するとデータインター
フエース6はその対応する表示パネル8のランプ
を点灯して中継点10が使用中であることを表示
する。
As the telephone terminals 3, 4 and 5 are sequentially scanned, the central control unit 1 sends data to the respective data interface 6 of each telephone terminal indicating to the data interface 6 that the trunk line 10 is in use. Upon receiving this data, the data interface 6 lights up the lamp on the corresponding display panel 8 to indicate that the relay point 10 is in use.

電話機3の送受器を戻すと、これは対応するデ
ータインターフエース6によつて検出され、この
情報をそれぞれのデータを伝送路12を経由して
中央制御装置1へすでに述べた方法で送る。各デ
ータ伝送路12の走査が完了すると、中央制御装
置1は集線装置2によつて中継線10と電話端末
3の各通話路11との間の接続を復旧させる。つ
づいてデータ伝送路12を走査して、中央制御装
置1は各電話端末3,4および5のそれぞれのデ
ータインターフエース6にデータを送り、中継線
10が使用中であることを示すランプを消灯させ
る。
When the handset of the telephone 3 is put back on, it is detected by the corresponding data interface 6 and sends this information via the transmission line 12 to the central control unit 1 in the manner already described. When the scanning of each data transmission path 12 is completed, the central control device 1 causes the line concentrator 2 to restore the connection between the trunk line 10 and each communication path 11 of the telephone terminal 3. Next, by scanning the data transmission line 12, the central control unit 1 sends data to the data interface 6 of each telephone terminal 3, 4, and 5, and turns off the lamp indicating that the trunk line 10 is in use. let

たとえばキーパツド9の他のボタンを使用し
て、他の電話端末の1つとの接続を要求したり、
そのキーパツドに対応する電話端末に着信呼が接
続されないようにすることを要求することもでき
る。
For example, by using other buttons on keypad 9, you can request a connection to one of the other telephone terminals;
You may also request that incoming calls not be connected to the telephone terminal associated with that keypad.

表示パネル8の他のランプは必要に応じて電話
機7のいずれが使用中であるかを表示したり、電
話端末3,4および5のうちの他のものへ着信す
る呼をその表示パネルに対応した電話機へ自動的
に転送中であることを表示するようにしてもよ
い。
Other lamps on the display panel 8 may be used to indicate which of the telephones 7 is in use or to indicate which of the telephone terminals 3, 4 and 5 an incoming call is directed to that display panel. It may also be possible to display a message indicating that the transfer is being automatically transferred to the selected telephone.

上述の装置に類似した他の方式のこれより大き
なシステム(図示せず)においては電話端末が多
数あつてもよい。その場合中央制御装置1の走査
サイクルは長くなり、たとえばそのような電話端
末を10台含むシステムではデータ伝送路12をす
べて走査するのに要する時間は37.5ミリ秒のオー
ダになる。データ伝送路の最後のものを走査して
からデータ伝送路の最初のものをつぎに走査する
までの間には約25ミリ秒のオーダの期間がある。
その間に中央制御装置1はその制御機能を実行す
る。したがつてたとえば電話端末3のデータ伝送
路12を1回走査してからこれをつぎに走査する
までの間には、62.5ミリ秒のオーダの期間が経過
する。
In other larger systems (not shown) similar to the apparatus described above, there may be a large number of telephone terminals. In that case, the scanning cycle of the central control unit 1 becomes long; for example, in a system including 10 such telephone terminals, the time required to scan all the data transmission lines 12 is on the order of 37.5 milliseconds. There is a period on the order of about 25 milliseconds between scanning the last of the data transmission paths and scanning the first of the data transmission paths.
Meanwhile, the central control unit 1 carries out its control functions. Therefore, for example, a period on the order of 62.5 milliseconds elapses between scanning the data transmission line 12 of the telephone terminal 3 once and scanning it again.

この62.5ミリ秒の期間はキーパツド9のボタン
の接点41ないし48の最小の動作および復旧時
間よりも長く、この最小の動作および復旧時間は
40ミリ秒のオーダである。したがつて接点41な
いし48に関するデータを直接中央制御装置1へ
送ると、キーパツド9の1つのボタンを操作する
最低の時間が経過する。
This 62.5 millisecond period is longer than the minimum movement and recovery time of the button contacts 41-48 of the keypad 9;
It is on the order of 40 milliseconds. Therefore, if the data relating to the contacts 41 to 48 are sent directly to the central control unit 1, the minimum time for operating one button of the keypad 9 will elapse.

マイクロプロセツサ13は、接点41ないし4
8の最小の動作および復旧時間より非常に短かい
間隔でこれらの接点を標本化するように構成され
ている。マイクロプロセツサ13はその出力50
ないし53へ順次信号を印加して、接点41ない
し48があればそのいずれが閉成しているかをそ
の入力17及び18を調べることによつて判定す
る。たとえば接点44だけが閉じていると、マイ
クロプロセツサ13によつてその出力50に与え
られる信号は入力17だけに現われる。この場合
出力51,52および53の信号は入力17およ
び18のいずれにも現われない。1組の接点の閉
成を検出すると、マイクロプロセツサ13は閉成
したものとして検出した1組の接点に関する各ビ
ットを内部メモリ(図示せず)に設定する。
The microprocessor 13 has contacts 41 to 4.
These contacts are configured to be sampled at intervals much shorter than the minimum operation and recovery times of 8. The microprocessor 13 has its output 50
By sequentially applying signals to contacts 41-53, it is determined which, if any, of contacts 41-48 are closed by examining their inputs 17 and 18. For example, if only contact 44 is closed, the signal provided by microprocessor 13 at its output 50 will appear only at input 17. In this case the signals at outputs 51, 52 and 53 do not appear at any of inputs 17 and 18. Upon detecting the closure of a set of contacts, microprocessor 13 sets each bit in an internal memory (not shown) associated with the set of contacts detected as closed.

マイクロプロセツサ13は、入力19の2進状
態の変化がスタート信号の受信を示すまで接点4
1ないし48の状態の変化をさらに走査する。こ
のスタート信号は中央制御装置1からのデータバ
ーストの送信に先行する。
Microprocessor 13 closes contact 4 until a change in the binary state of input 19 indicates receipt of a start signal.
Further scan for 1 to 48 state changes. This start signal precedes the transmission of a data burst from the central controller 1.

マイクロプロセツサが1組の接点の状態の最初
の変化に関するデータを転送する前にその接点の
組の状態の別の変化を検出したときは、中央制御
装置1にそのデータを転送してしまうまでその内
部メモリ内の各ビツトを修正することはない。そ
の接点の組の状態のこのような別な変化に関する
データは各データ伝送路12をつきに走査すると
きに中央制御装置1へ転送される。
If the microprocessor detects another change in the state of a set of contacts before it has transferred data regarding the first change in the state of that set of contacts, it will not be able to wait until it has transferred the data to the central controller 1. It does not modify each bit in its internal memory. Data regarding such further changes in the state of the contact set is transferred to the central control unit 1 as each data transmission line 12 is scanned one after the other.

[発明の効果] 本発明を要約すると、中央プロセツサ制御を行
う電話システムは各データ回路を有する電話機を
備えている。各データ回路は各キーパツドおよび
そのボタンの状態に関する蓄積データを走査す
る。各蓄積データは中央プロセツサからの要求に
応じてそのプロセツサへ送信される。データ回路
はキーパツドのボタンを走査して、つぎに中央プ
ロセツサに接続されたデータ入力を走査する。中
央プロセツサからのプレフイツクスパルスを検出
するとこのデータ回路はスタートパルスを検出す
るまでこのデータ入力を繰り返し標本化する。ス
タートパルスが検出されるとデータ回路はそのビ
ツト速度でデータ入力を走査する。キーパツドの
1つのボタンがプロセツサからの各要求の合間に
1回以上状態を変えても、つぎの変化に関するそ
れぞれのデータがこのデータ回路によつて修正さ
れることはない。
[Effects of the Invention] To summarize the present invention, a central processor controlled telephone system includes a telephone set having respective data circuits. Each data circuit scans stored data regarding the state of each keypad and its buttons. Each stored data is sent to the central processor in response to requests from the central processor. The data circuitry scans the keypad buttons, which in turn scan the data inputs connected to the central processor. Upon detection of a prefix pulse from the central processor, the data circuit repeatedly samples this data input until a start pulse is detected. When a start pulse is detected, the data circuit scans the data input at that bit rate. If one button on the keypad changes state more than once between each request from the processor, the respective data for the next change will not be modified by this data circuit.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の装置を示すブロツク図、第2
図は第1図の一部を詳細に示す図、第3図は第1
図のデータインターフエースおよび中央制御装置
の動作を説明する波形を示す図である。 主要部分の符号説明、1……中央制御装置、6
……データインターフエース、8……表示パネ
ル、9……キーパツド、12……データ伝送路、
13……マイクロプロセツサ、14……周波数制
御装置、15……入力バツフア回路、16……出
力バツフア回路。
FIG. 1 is a block diagram showing the apparatus of the present invention, FIG.
The figure shows a part of Fig. 1 in detail, and Fig. 3 shows the details of Fig. 1.
FIG. 3 is a diagram showing waveforms illustrating the operation of the data interface and central control unit shown in the figure. Explanation of symbols for main parts, 1...Central control unit, 6
...Data interface, 8...Display panel, 9...Keypad, 12...Data transmission line,
13...Microprocessor, 14...Frequency control device, 15...Input buffer circuit, 16...Output buffer circuit.

Claims (1)

【特許請求の範囲】 1 プレフイツクスパルスとこのパルスに続きこ
のパルスよりもパルス幅の短い複数のデータパル
スとから成るパルスバーストを受信するためのデ
ータ処理回路であつて、 入力信号は、各バーストの間で前記データパル
スの送信速度よりも遅い第1速度で標本化され、
プレフイツクスパルスの検出の際には前記データ
パルスの送信速度よりも速い第2速度で標本化さ
れ、前記データパルスのうちの第1データパルス
の検出の際には前記データパルスの送信速度と同
じ第3速度で標本化されるデータ処理回路。
[Claims] 1. A data processing circuit for receiving a pulse burst consisting of a prefix pulse and a plurality of data pulses that follow this pulse and have a pulse width shorter than this pulse, wherein each input signal is sampled at a first rate slower than the transmission rate of the data pulses during the burst;
When detecting a prefix pulse, sampling is performed at a second rate faster than the transmission rate of the data pulse, and when detecting a first data pulse of the data pulses, the sampling rate is faster than the transmission rate of the data pulse. Data processing circuitry sampled at the same third rate.
JP5937080A 1979-05-04 1980-05-02 Data processor circuit Granted JPS55149591A (en)

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
GB7915673 1979-05-04

Publications (2)

Publication Number Publication Date
JPS55149591A JPS55149591A (en) 1980-11-20
JPH0320117B2 true JPH0320117B2 (en) 1991-03-18

Family

ID=10504973

Family Applications (1)

Application Number Title Priority Date Filing Date
JP5937080A Granted JPS55149591A (en) 1979-05-04 1980-05-02 Data processor circuit

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JP (1) JPS55149591A (en)
AU (1) AU5789980A (en)
GB (1) GB2050760A (en)
ZA (1) ZA802544B (en)

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE3407981C2 (en) * 1983-03-24 1986-12-18 Dainippon Screen Seizo K.K., Kyoto A method for recording an image on a photosensitive material and an apparatus for carrying out the method

Family Cites Families (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS53100834U (en) * 1977-01-19 1978-08-15

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JPS55149591A (en) 1980-11-20
AU5789980A (en) 1980-11-06
GB2050760A (en) 1981-01-07
ZA802544B (en) 1981-04-29

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