JPH0316069Y2 - - Google Patents

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JPH0316069Y2
JPH0316069Y2 JP17738282U JP17738282U JPH0316069Y2 JP H0316069 Y2 JPH0316069 Y2 JP H0316069Y2 JP 17738282 U JP17738282 U JP 17738282U JP 17738282 U JP17738282 U JP 17738282U JP H0316069 Y2 JPH0316069 Y2 JP H0316069Y2
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voltage
line
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analog
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Description

【考案の詳細な説明】 本考案は、配電線の保護用接地回路の接地抵抗
を測定する接地抵抗計に関するものである。
[Detailed Description of the Invention] The present invention relates to a grounding resistance meter that measures the grounding resistance of a protective grounding circuit of a power distribution line.

ヨーロツパ諸国などのように電力配電方式に3
相4線式を採用している所では、保護用接地回路
の接地抵抗を測定するのに第1図に示すような測
定方法を取つている。図において、Pは電源、L
はライン、LOはニユートラル・ライン、Vはラ
インLとニユートラル・ラインLO間のライン電
圧、SWはスイツチ、Rは既知抵抗、r,r′は分
圧用抵抗、Eは抵抗R両端電圧、Aは増幅器(ピ
ーク・デテクタ)、Dはダイオード、Cはコンデ
ンサ、Mはメータを示す。すなわち、従来は、ラ
インLを既知抵抗Rを通してスイツチSWにより
瞬間的に接地し、その時流れる電流Iの値又はこ
れを電圧に変換した値Eをピーク・ホールドして
メータMの目盛りを読み取つていた(メータMの
目盛りはオーム値に換算してある。)。
3 in the power distribution system, such as in European countries.
In places where a phase 4-wire system is used, the method shown in Figure 1 is used to measure the grounding resistance of the protective grounding circuit. In the figure, P is the power supply, L
is the line, L O is the neutral line, V is the line voltage between line L and neutral line L O , SW is the switch, R is the known resistance, r and r' are the voltage dividing resistors, E is the voltage across the resistor R, A is an amplifier (peak detector), D is a diode, C is a capacitor, and M is a meter. That is, conventionally, the line L was momentarily grounded by a switch SW through a known resistor R, and the scale of the meter M was read by peak-holding the value of the current I flowing at that time or the value E obtained by converting it into a voltage. (The scale of meter M has been converted to an ohm value.)

このとき流れる電流Iは、接地抵抗をZとする
と、 I=V/R+Z で表わされる。すなわち、Z=∞のとき、I=
0、Z=0のときI=V/Rとなり、メータMの
目盛りは0から大きくなるにつれ次第に詰まつた
不平等目盛りとなる。したがつて、かかる従来の
測定方法では、低抵抗を測定しようとすると高い
抵抗は測れず、高い抵抗を測ろうとすると低い抵
抗は高精度で測定できないというジレンマがあつ
た。このため高低2つのレンジを設けたりしてい
るが、いずれにせよ高精度の測定は望めなかつ
た。また、この方法のより大きな欠点は、ライン
電圧が測定の瞬間動いたり、或いはライン・アー
ス間の導通期間が正弦波のピーク値に達する前に
終了したりすると、測定値がその影響を受けて変
動することであつた。
The current I flowing at this time is expressed as I=V/R+Z, where Z is the grounding resistance. That is, when Z=∞, I=
0, when Z=0, I=V/R, and the scale of the meter M becomes an unequal scale that gradually becomes smaller as it increases from 0. Therefore, with such conventional measuring methods, there was a dilemma in that when trying to measure low resistance, high resistance could not be measured, and when trying to measure high resistance, low resistance could not be measured with high accuracy. For this reason, two ranges, high and low, were installed, but in any case, highly accurate measurements could not be expected. Also, a bigger disadvantage of this method is that if the line voltage moves at the moment of measurement, or if the line-to-ground conduction period ends before the peak value of the sine wave is reached, the measured value will be affected. It was subject to change.

本考案は、上述のような欠点を除去したもの
で、電源ラインLから既知抵抗Rを通して瞬間的
にアースに短絡する操作は同じであるが、測定値
を引出す方法が異なる。以下、図面により本考案
を具体的に説明する。
The present invention eliminates the above-mentioned drawbacks, and although the operation of instantaneously shorting the power line L to ground through the known resistance R is the same, the method of extracting the measured value is different. Hereinafter, the present invention will be explained in detail with reference to the drawings.

第2図は、本考案の実施例を示す略式回路図で
ある。図において、第1図と対応する部分には同
一又は類似の符号を付しとある。D3は抵抗Rの
両端に接続した整流用ダイオードD4は抵抗Rの
アース側の一端とニユートラル・ラインLO間に
接続した整流用ダイオード、A/Dは2重積分方
式のアナログ・デジタル・コンバータを示す。ま
ず、スイツチSWを瞬時閉じた時に抵抗R両端に
生じる電圧Eを整流・分圧し、この分圧した電圧
をピーク・ホールドし、その出力を基準信号
E′refとしてアナログ・デジタル・コンバータ
A/Dの基準電圧(レフアレンス)端子に入れ
る。一方、接地短絡電流Iによつて接地抵抗Z両
端の電圧に等しい電圧E′(E′=IZ)が抵抗Rの接
地側の一端とニユートラル・ラインLOとの間に
生じる。ここに、電圧EとE′の和はライン電圧V
と等しい関係にある。この電圧E′を電圧Eの場合
と同じ分圧比で整流・分圧し、その分圧した電圧
をピーク・ホールドし、その出力を入力信号Ein
としてアナログ・デジタル・コンバータA/Dの
入力端子に入れる。なお、電圧E,E′を分圧する
のは、電圧E,E′が非常に大きい値になるので
ICで処理できる電圧まで下げるためである。
FIG. 2 is a schematic circuit diagram showing an embodiment of the present invention. In the figure, parts corresponding to those in FIG. 1 are designated by the same or similar symbols. D 3 is a rectifier diode connected to both ends of resistor R. D 4 is a rectifier diode connected between one end of the ground side of resistor R and the neutral line L O. A/D is a double integration type analog/digital converter. Converter shown. First, the voltage E generated across the resistor R when the switch SW is momentarily closed is rectified and divided, this divided voltage is held at its peak, and the output is used as the reference signal.
Insert as E'ref into the reference voltage (reference) terminal of the analog-to-digital converter A/D. On the other hand, due to the ground short-circuit current I, a voltage E'(E'=IZ) equal to the voltage across the ground resistor Z is generated between one end on the ground side of the resistor R and the neutral line L O. Here, the sum of voltages E and E' is line voltage V
There is an equal relationship with This voltage E' is rectified and divided at the same voltage division ratio as voltage E, the divided voltage is held at its peak, and the output is used as the input signal Ein.
input to the input terminal of the analog-to-digital converter A/D. Note that dividing the voltages E and E' is necessary because the voltages E and E' have very large values.
This is to lower the voltage to a level that can be processed by the IC.

ここで、既に公知であるが2重積分方式のアナ
ログ・デジタル・コンバータについて簡単に説明
する。第3図はそのブロツク図、第4図及び第5
図はその動作説明図である。まず、スイツチS1
一定時間tだけオンして入力電圧Einを積分す
る。この時間tは、カウンタが例えば1000カウン
トするに要する時間に設定する。一定時間tが終
了すると同時にスイツチS1をオフ、スイツチS2
オンとし、入力電圧Einと逆極性の基準電圧Eref
を積分する。先に積分された入力電圧が0になつ
た瞬間、比較器が働いて積分回路の動作を停止さ
せる。カウンタは、スイツチS2がオンとなつて比
較器が動作するまでの時間t′をカウントし、その
カウント数を表示部に入れる。この場合、Ein×
t=Eref×t′、したがつて、Ein=(Eref×t′)/
tの関係が成立する。ここで、tとErefは一定で
あるから、入力電圧Einはt′すなわちカウント数
に比例する。第4図は大きさの比が2:3の2つ
の電圧Ein1,Ein2が1000カウント及び1500カ
ウントで表わされる様子を示している。よつて、
2重積分方式のアナログ・デジタル・コンバータ
をデジタル・ボルト・メータとして用いることが
できる。
Here, a well-known double integral type analog-to-digital converter will be briefly described. Figure 3 is its block diagram, Figures 4 and 5.
The figure is an explanatory diagram of the operation. First, the switch S1 is turned on for a certain period of time t to integrate the input voltage Ein. This time t is set to the time required for the counter to count 1000, for example. At the end of the fixed time t, switch S 1 is turned off and switch S 2 is turned on, and the reference voltage Eref with the opposite polarity to the input voltage Ein is set.
Integrate. The moment the previously integrated input voltage becomes 0, the comparator operates and stops the operation of the integrating circuit. The counter counts the time t' from when the switch S2 is turned on until the comparator operates, and enters the counted number on the display. In this case, Ein×
t=Eref×t′, therefore Ein=(Eref×t′)/
The relationship t holds true. Here, since t and Eref are constant, the input voltage Ein is proportional to t', that is, the count number. FIG. 4 shows how two voltages Ein1 and Ein2 with a magnitude ratio of 2:3 are represented by 1000 counts and 1500 counts. Then,
A double-integrating analog-to-digital converter can be used as a digital volt meter.

以上は基準電圧Erefが一定の場合であつたが、
基準電圧Erefが変化する電圧E′refである場合を
考える。E′refが入力電圧Einに等しいときは、第
5図に示すように積分の傾斜は共にEin/R′C′で
同じであるから、E′refによるカウントは入力電
圧Einの積分カウント1000と同じである。E′refが
入力電圧Einの1/2のときは、傾斜はEin/
2R′C′となるから、Ein×t=Ein/2×t′、したがつ てt′=2tでカウント数は2000となる。逆に、E′ref
が2Einのときは、傾斜が2Ein/R′C′でt′=t/2
となり、表示カウントは500となる。すなわち、
一定の基準電圧Erefの代わりに変化する電圧
E′refを入れると、このアナログ・デジタル・コ
ンバータは、入力電圧Einと基準電圧E′refとの比
Ein/E′refを表示することになる。
The above was a case where the reference voltage Eref was constant, but
Consider the case where the reference voltage Eref is a changing voltage E′ref. When E'ref is equal to the input voltage Ein, the slope of the integral is the same for both Ein/R'C' as shown in Figure 5, so the count by E'ref is equal to the integral count of 1000 for the input voltage Ein. It's the same. When E′ref is 1/2 of the input voltage Ein, the slope is Ein/
Since 2R'C', Ein×t=Ein/2×t', therefore, t'=2t and the count is 2000. Conversely, E′ref
When is 2Ein, the slope is 2Ein/R′C′ and t′=t/2
Therefore, the display count will be 500. That is,
Varying voltage instead of constant reference voltage Eref
E′ref, this analog-to-digital converter calculates the ratio between the input voltage Ein and the reference voltage E′ref.
Ein/E′ref will be displayed.

本考案は、このような2重積分方式のアナロ
グ・デジタル・コンバータの性質を利用するもの
である。再び第2図に戻り、抵抗Rを10Ω、電源
電圧を240Vとすると、短絡電流Iは240/10+10= 12ampとなる。それぞれの電圧降下E,E′は、共
に120Vである。これを1/100に分圧し、E′ref及
びEinとしてコンバータA/Dに入力すると、上
述のようにEin/E′ref(=E′/E)=1.2/1.2=1
を表示する。ここで、E′=IZ,E=IRなので
E′/E=Z/Rであり、Rは既知であるから表示
Ein/E′refは接地抵抗Zに比例する。よつて、デ
ジタル・ポイントを予め設定して10倍の数字を表
示するようにすれば、上記の場合10が表示されコ
ンバータA/Dは接地抵抗Zの値10Ωを直接表示
することになる。すなわち、接地抵抗Zが15Ωの
ときは、I=240/10+15=9.6ampでそれぞれの電圧 降下E,E′は96V,144Vとなり、これを1/100に
分圧してコンバータA/Dに入力すると、1.44/0.96 ×10=15(Ω)が表示れる。
The present invention utilizes the properties of such a double integral type analog-to-digital converter. Returning to Figure 2 again, if the resistance R is 10Ω and the power supply voltage is 240V, the short circuit current I will be 240/10+10=12amp. The respective voltage drops E and E' are both 120V. If this voltage is divided to 1/100 and inputted to the converter A/D as E'ref and Ein, Ein/E'ref (=E'/E) = 1.2/1.2 = 1 as described above.
Display. Here, since E′=IZ, E=IR
E′/E=Z/R, and R is known, so display
Ein/E′ref is proportional to the grounding resistance Z. Therefore, if the digital point is set in advance to display a number multiplied by 10, then in the above case 10 will be displayed and the converter A/D will directly display the value of the ground resistance Z of 10Ω. In other words, when the grounding resistance Z is 15Ω, I = 240/10 + 15 = 9.6amp, and the voltage drops E and E' are 96V and 144V, respectively.If you divide this into 1/100 and input it to the converter A/D, , 1.44/0.96 × 10 = 15 (Ω) is displayed.

また、電源電圧が240Vから極端に1/10の24V
になつたとしても、抵抗R=10Ω、接地抵抗Z=
10Ωのとき、I=24/10+10=1.2ampでそれぞれの 電圧降下は12V,12Vとなり、これを1/100に分
圧してコンバータA/Dに入力すると、表示は
0.12/0.12×10=10(Ω)となる。同様に、Z=15Ωの ときは、0.144/0.096×10=15(Ω)が表示される。こ のようにコンバータA/Dの表示は、電源電圧に
は関係なく、接地抵抗そのものを直線的に極めて
高い精度で表わすものとなる。
In addition, the power supply voltage is 24V, which is extremely 1/10 from 240V.
Even if it becomes , resistance R = 10Ω, grounding resistance Z =
When 10Ω, I = 24/10 + 10 = 1.2amp, the respective voltage drops will be 12V and 12V, and if you divide this into 1/100 and input it to the converter A/D, the display will be
0.12/0.12×10=10(Ω). Similarly, when Z=15Ω, 0.144/0.096×10=15(Ω) is displayed. In this way, the display of the converter A/D linearly represents the ground resistance itself with extremely high accuracy, regardless of the power supply voltage.

以上説明したとおり、本考案によれば、3相4
線式のようにニユートラル・ラインを有する配電
線の接地回路の接地抵抗を低い場合も高い場合も
高精度で、しかも、ライン電圧の変動や測定の際
に加わる瞬間的電圧の大きさには無関係に測定す
ることができる。
As explained above, according to the present invention, three-phase four-phase
The grounding resistance of the grounding circuit of a distribution line with a neutral line, such as a wire system, can be determined with high accuracy regardless of whether it is low or high, and is independent of line voltage fluctuations and the magnitude of the instantaneous voltage applied during measurement. can be measured.

なお、本考案は、3相4線式のものに限らず、
ニユートラル・ラインを用いる配電線ならば単相
3線式のものにも適用しうるものである。
Note that this invention is not limited to three-phase, four-wire systems.
If the distribution line uses a neutral line, it can also be applied to a single-phase three-wire type.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来例を示す略式回路図、第2図は本
考案の実施例を示す略式回路図、第3図は本考案
にいる2重積分式アナログ・デジタル・コンバー
タのブロツク図、第4及び第5図はその動作説明
図である。 L……ライン、SW……スイツチR……既知抵
抗、D3,r,r′……第1の整流・分圧手段、LO
…ニユートラル・ライン、D4,r,r′……第2の
整流・分圧手段、(A1,D1,C1),(A2,D2,C2
……ピーク・ホールド回路、A/D……2重積分
式アナログ・デジタル・コンバータ。
Fig. 1 is a schematic circuit diagram showing a conventional example, Fig. 2 is a schematic circuit diagram showing an embodiment of the present invention, Fig. 3 is a block diagram of a double integral type analog-to-digital converter in the present invention, and Fig. 4 and FIG. 5 is an explanatory diagram of its operation. L... Line, SW... Switch R... Known resistance, D 3 , r, r'... First rectification/voltage dividing means, L O ...
...neutral line, D 4 , r, r' ... second rectification/pressure dividing means, (A 1 , D 1 , C 1 ), (A 2 , D 2 , C 2 )
...Peak hold circuit, A/D...Double integral type analog-to-digital converter.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] 配電線のラインにスイツチ及び既知抵抗を直列
に接続して上記既知抵抗の一端を接地し、この既
知抵抗の両端に第1の整流・分圧手段を接続する
と共に上記既知抵抗の接地側の一端と上記配電線
のニユートラル・ライン間に第2の整流・分圧手
段を接続し、上記スイツチを瞬間的にオンさせた
とき、上記第1の整流・分圧手段の出力をピー
ク・ホールドして2重積分式アナログ・デジタ
ル・コンバータの基準電圧端子に印加すると共
に、上記第2の整流・分圧手段の出力をピーク・
ホールドして上記アナログ・デジタル・コンバー
タの入力端子に印加し、上記アナログ・デジタ
ル・コンバータに上記配電線の接地回路の接地抵
抗を表示させるようにしたデジタル接地抵抗計。
A switch and a known resistor are connected in series to the distribution line, one end of the known resistor is grounded, a first rectifier/voltage dividing means is connected to both ends of the known resistor, and one end of the ground side of the known resistor is connected to both ends of the known resistor. A second rectifier/voltage dividing means is connected between the power line and the neutral line of the distribution line, and when the switch is momentarily turned on, the output of the first rectifier/voltage dividing means is held at its peak. The reference voltage is applied to the reference voltage terminal of the double integral analog-to-digital converter, and the output of the second rectifying/dividing means is applied to the peak voltage.
A digital ground resistance meter that holds the voltage and applies it to an input terminal of the analog-to-digital converter to cause the analog-to-digital converter to display the ground resistance of the ground circuit of the distribution line.
JP17738282U 1982-11-24 1982-11-24 digital earth resistance meter Granted JPS5980765U (en)

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