JPH0295186U - - Google Patents
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- Publication number
- JPH0295186U JPH0295186U JP227189U JP227189U JPH0295186U JP H0295186 U JPH0295186 U JP H0295186U JP 227189 U JP227189 U JP 227189U JP 227189 U JP227189 U JP 227189U JP H0295186 U JPH0295186 U JP H0295186U
- Authority
- JP
- Japan
- Prior art keywords
- load
- load circuit
- socket
- circuit
- pins
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Testing Of Individual Semiconductor Devices (AREA)
- Connecting Device With Holders (AREA)
Description
第1図は本考案の一実施例を示す斜視図、第2
図は本考案における内部の負荷回路を示す回路図
である。 1:ICPINの接続部、2:負荷回路接続部
、3:負荷の入力端子、4:負荷の電源端子、5
:負荷のGND端子、6,7,8:ネジ部、9:
ボードとの接続部、10:ICソケツト、21,
22:負荷抵抗、23:負荷容積、20:負荷回
路。
図は本考案における内部の負荷回路を示す回路図
である。 1:ICPINの接続部、2:負荷回路接続部
、3:負荷の入力端子、4:負荷の電源端子、5
:負荷のGND端子、6,7,8:ネジ部、9:
ボードとの接続部、10:ICソケツト、21,
22:負荷抵抗、23:負荷容積、20:負荷回
路。
Claims (1)
- 内部に負荷の設定を可能とする負荷回路と、該
負荷回路とICピンを接続し得る接続部とを設け
て成るICソケツト。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP227189U JPH0295186U (ja) | 1989-01-11 | 1989-01-11 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP227189U JPH0295186U (ja) | 1989-01-11 | 1989-01-11 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0295186U true JPH0295186U (ja) | 1990-07-30 |
Family
ID=31202893
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP227189U Pending JPH0295186U (ja) | 1989-01-11 | 1989-01-11 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0295186U (ja) |
-
1989
- 1989-01-11 JP JP227189U patent/JPH0295186U/ja active Pending