JPH0283481U - - Google Patents

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JPH0283481U
JPH0283481U JP16322188U JP16322188U JPH0283481U JP H0283481 U JPH0283481 U JP H0283481U JP 16322188 U JP16322188 U JP 16322188U JP 16322188 U JP16322188 U JP 16322188U JP H0283481 U JPH0283481 U JP H0283481U
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JP
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circuit
output
threshold
compares
counter
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JP16322188U
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【図面の簡単な説明】
第1図はこの考案の一実施例を示す機能ブロツ
ク図、第2図は従来の装置の一実施例を示す機能
ブロツク図である。 図において1は入力、2はCFAR回路、3は
比較回路1、4は遅延回路1、5は一致回路、6
はカウンタ、7は遅延回路2、8はスレツシヨル
ド、9は比較回路2、10は比較回路3、11は
論理和回路、12は出力である。なお、図中、同
一符号は同一、又は相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 目標検出を行うためにスレツシヨルドを発生す
    るCFAR発生回路と、そのスレツシヨルドと検
    出を行う入力とを比較する比較回路1と、その出
    力に対しある一定の遅延を与える遅延回路1と、
    その出力と上記比較回路1の出力で一致を検出す
    る一致回路と、その出力と上記遅延回路1の出力
    によつて上記比較回路1からの検出データの検出
    数をカウントするカウントと、その出力に対しあ
    る一定の遅延を与える遅延回路2と、その出力と
    スレツシヨナルドとを比較する比較回路3と、上
    記カウンタの出力とスレツシヨルドとを比較する
    比較回路2と、比較回路2の出力と比較回路3の
    出力から論理和を行う論理和回路を備えたことを
    特徴とするレーダ信号処理装置。
JP16322188U 1988-12-16 1988-12-16 Pending JPH0283481U (ja)

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JP16322188U JPH0283481U (ja) 1988-12-16 1988-12-16

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JPH0283481U true JPH0283481U (ja) 1990-06-28

Family

ID=31447753

Family Applications (1)

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JP16322188U Pending JPH0283481U (ja) 1988-12-16 1988-12-16

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JP (1) JPH0283481U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2012193961A (ja) * 2011-03-15 2012-10-11 Mitsubishi Electric Corp レーダ信号処理装置

Cited By (1)

* Cited by examiner, † Cited by third party
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JP2012193961A (ja) * 2011-03-15 2012-10-11 Mitsubishi Electric Corp レーダ信号処理装置

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