JPH02312486A - Picture data processing unit - Google Patents

Picture data processing unit

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JPH02312486A
JPH02312486A JP89132694A JP13269489A JPH02312486A JP H02312486 A JPH02312486 A JP H02312486A JP 89132694 A JP89132694 A JP 89132694A JP 13269489 A JP13269489 A JP 13269489A JP H02312486 A JPH02312486 A JP H02312486A
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JP
Japan
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image data
circuit
signal
digital filter
input
Prior art date
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Pending
Application number
JP89132694A
Other languages
Japanese (ja)
Inventor
Yuji Shigyo
執行 祐司
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Fujifilm Holdings Corp
Original Assignee
Fuji Photo Film Co Ltd
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Publication date
Application filed by Fuji Photo Film Co Ltd filed Critical Fuji Photo Film Co Ltd
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Publication of JPH02312486A publication Critical patent/JPH02312486A/en
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Abstract

PURPOSE:To simplify circuit constitution by replacing linear product sum calculation in common to a digital filter processing including simultaneous and frame processing of a picture signal into a single linear product sum arithmetic circuit and setting an arithmetic coefficient one after another in response to the calculation applied to point sequential picture data in time series. CONSTITUTION:A digital filter circuit 120 whose arithmetic coefficient is set variably, applying linear product sum calculation to an input picture data with the set arithmetic coefficient and outputting a color component data subjected to picture signal processing, a coefficient generating circuit 124 setting the arithmetic coefficient in response to the input picture data to the digital filter circuit 120 synchronously with the input picture data and a FIFO memory 138 outputting an output picture data whose color component data timing is substantially made coincident are provided and common linear product sum calculation in common to the digital filter processing including simultaneous and frame processing of the picture signal is replaced into a single linear product sum arithmetic circuit 122. Thus, the circuit constitution is simplified.

Description

【発明の詳細な説明】 技術分野 本発明は画像データ処理装置、たとえばディジタル電子
スチルカメラシステムにおいて、メモリに記憶された画
像データを、たとえばファイルや再生の目的で処理する
画像データ処理装置に関する。
TECHNICAL FIELD The present invention relates to an image data processing apparatus, such as an image data processing apparatus for processing image data stored in a memory, for example, for file or playback purposes in a digital electronic still camera system.

背景技術 撮像デバイスで撮像された画像をディジタルデータの形
で、たとえばRAMメモリカードなどの半導体記憶装置
に蓄積するディジタル電子スチルカメラが提案されてい
る。たとえば本出願人による係属中の特許出願、特願昭
132−270387参照。
BACKGROUND ART Digital electronic still cameras have been proposed that store images captured by an imaging device in the form of digital data in a semiconductor storage device such as a RAM memory card. See, for example, the applicant's pending patent application, Japanese Patent Application No. 132-270387.

ディジタル電子スチルカメラで撮影された画像は、その
画像データを記憶したメモリカードをカメラから取りは
ずし、再生装置に装填して映像千二夕やプリンタにて再
生することができる。このような再生装置は、たとえば
特開昭57−124364 、および本出願人の係属中
の特許出願、特願昭82−213058に記載されてい
る。
Images taken with a digital electronic still camera can be reproduced by removing the memory card storing the image data from the camera, loading it into a reproduction device, and using a video camera or printer. Such a reproducing device is described, for example, in Japanese Patent Application Laid-Open No. 57-124364 and in the applicant's pending patent application, Japanese Patent Application No. 82-213058.

これらの従来のディジタル電子スチルカメラシステムで
は、カメラからメモリカードに出力される画像データは
、白バランス調整、階調(γ)補正、および撮像デバイ
スの色分離フィルタ配列のますの映像信号を同時化する
同時化処理などの様々な映像信号処理を施したものであ
り、色差信号および輝度信号の形をとるものが多かった
。しかしこの従来方式では、このような映像信号処理の
機能をカメラのアナログ処理回路で担っていた。
In these conventional digital electronic still camera systems, image data output from the camera to a memory card is processed by white balance adjustment, gradation (γ) correction, and synchronized video signals of the color separation filter array of the imaging device. It is a signal that has been subjected to various types of video signal processing, such as simultaneous processing, and is often in the form of color difference signals and luminance signals. However, in this conventional method, the video signal processing function was performed by the camera's analog processing circuit.

この映像信号処理はしたがって、アナログ回路のハード
ウェア上の制約から、必ずしも理想的な同時化特性に一
致しない部分があった。また、そのような処理回路の存
在のためにカメラの回路構成が複雑であり、装置の大型
化が免れなかった。
Therefore, this video signal processing does not always match ideal synchronization characteristics due to hardware constraints of analog circuits. Furthermore, the presence of such a processing circuit complicates the circuit configuration of the camera, which inevitably increases the size of the device.

ところで、たとえばCCDなどの映像信号源から得られ
る静止画の映像信号は、TVモニタなどの画像再生装置
で明瞭な可視画像として再生するには、雑音の除去や絵
柄の輪郭の強調などの信す処理を必要とする。シの信号
処理は、第4図に例示するように、ホワイトバランス調
整1601階調(γ)補正1621輪郭強調190など
の処理を含む。
By the way, in order to reproduce a still image video signal obtained from a video signal source such as a CCD as a clear visible image on an image reproducing device such as a TV monitor, it is necessary to remove noise and emphasize the outline of the image. Requires processing. The signal processing in FIG. 4 includes processing such as white balance adjustment 1601, gradation (γ) correction 1621, and edge enhancement 190, as illustrated in FIG.

たとえば、入力映像信号が3原色、すなわち赤(R)、
祿(G)および青(B)の点順次フィールド映像信号で
ある場合は、これを同時化してフレーム映像信号に変換
するため、輝度色差化マ]・リンクス164、低域通過
フィルタ(LPF) 178など、フレーム化回路18
0など、およびRGB化マトリックス184などの様々
な機能部を必要とする。
For example, the input video signal has three primary colors, red (R),
If it is a dot-sequential field video signal of green (G) and blue (B), in order to synchronize it and convert it into a frame video signal, a luminance/color difference matrix] links 164, a low-pass filter (LPF) 178 etc., framing circuit 18
0 etc. and an RGBization matrix 184.

これらの機能部は、パイプライン処理にて実現する場合
、専用のティジタル回路を必要とする。
These functional units require dedicated digital circuits when implemented through pipeline processing.

また低域フィルタ176などのフィルタ回路は、専用の
ディジタルフィルタLSIにて実現される。また広域の
輝度信号YHは、1画素分のタイミングで作成されるの
で、色差信号R−YLおよびB−YLに対して2画素分
のタイミングの差がある。両者のタイミングの差を補償
するためには、FIFO回路166などの多くのFIF
Oメモリを設ける必要がある。
Further, filter circuits such as the low-pass filter 176 are realized by a dedicated digital filter LSI. Furthermore, since the wide-area luminance signal YH is created at the timing of one pixel, there is a timing difference of two pixels with respect to the color difference signals R-YL and B-YL. In order to compensate for the difference in timing between the two, many FIFO circuits such as the FIFO circuit 166 must be used.
It is necessary to provide O memory.

なお、点順次色信号をその時系列のままでフィルタリン
グする低域フィルタ技術は、特開昭57−145492
によって知られている。この従来技術は、複数の低域通
過フィルタおよび高域通過フィルタを低域濾波の単機能
を有する単一の低域通過フィルタで代用するものである
。この低域通過フィルタは、低域濾波以外の機能を有し
ていない。
Note that the low-pass filter technology for filtering point-sequential color signals in their time series is disclosed in Japanese Patent Laid-Open No. 57-145492.
known by. This conventional technique replaces a plurality of low-pass filters and high-pass filters with a single low-pass filter having a single function of low-pass filtering. This low-pass filter has no function other than low-pass filtering.

旦−一的 本発明はこのような従来技術の欠点を解消し、装置構成
の簡素な画像データ処理装置を提供することをl」的と
する。
SUMMARY OF THE INVENTION It is an object of the present invention to overcome the drawbacks of the prior art and to provide an image data processing device with a simple device configuration.

発明の開示 本発明によれば、点順次カラー入力画像データを受けて
低域濾波および同時化を含む画像信号処理を行なう画像
データ処理装置は、演算係数が可変的に設定可能であり
入力画像データにこの設定された演算係数による線形積
和演算を行ない、画像信号処理を行なった色成分データ
を出力するディジタルフィルタ回路と、入力画像データ
に同期してディジタルフィルタ回路に入力画像データに
応じた演算係数を設定する係数発生回路と、色成分デー
タのタイミングを実質的に一致させて出力画像データを
出力するFIFOメモリとを有するものである。
DISCLOSURE OF THE INVENTION According to the present invention, an image data processing device that receives point-sequential color input image data and performs image signal processing including low-pass filtering and synchronization is provided, in which arithmetic coefficients can be variably set. A digital filter circuit performs a linear product-sum calculation using the set calculation coefficients and outputs color component data that has undergone image signal processing, and a digital filter circuit performs calculations according to the input image data in synchronization with the input image data. It has a coefficient generation circuit that sets coefficients, and a FIFO memory that outputs output image data by substantially matching the timing of color component data.

実施例の説明 次に脇付図面を巷間して本発明の好ましい実施例を詳細
に説明する。第2図を参照すると、本発明による画像デ
ータ処理装置の実施例は、たとえば電子スチルカメラシ
ステムにおいて有利な画像再生装置に適用され、入カポ
−) 100および102を有する。画像再生装置は、
RAMなどの半導体メモリデバイスがカード状の基体に
担持されたメモリカードからこれに記憶されている画像
データを読み出して画像データ処理を施し、たとえば光
ディスクなどのファイル記憶装置に記憶したり、映像モ
ニタや画像プリンタなどの画像出力装置に再生したりす
る画像処理装置である。このような画像データが入力ポ
ート100に入力される。
DESCRIPTION OF EMBODIMENTS Preferred embodiments of the present invention will now be described in detail with reference to the accompanying drawings. Referring to FIG. 2, an embodiment of an image data processing device according to the invention is applied to an image reproduction device advantageous, for example in an electronic still camera system, and has input capacitors 100 and 102. The image reproduction device is
A semiconductor memory device such as a RAM reads out image data stored in a memory card carried by a card-like base, performs image data processing, and stores the image data in a file storage device such as an optical disk, or on a video monitor or the like. This is an image processing device that reproduces images on an image output device such as an image printer. Such image data is input to the input port 100.

ディジタル電子スチルカメラでは、これに着脱可能に装
着されたメモリカードに撮像セル対応に赤(R)、緑(
G)および青(B)の色成分信号の形で点順次のラスク
走査にて1フイールドの映像信号データが記憶される。
In a digital electronic still camera, a memory card that is removably attached to the camera has red (R) and green (
One field of video signal data is stored in the form of color component signals of G) and blue (B) by point-sequential rask scanning.

画像データが記憶されたメモリカードは、カメラから取
りはずされ、画像再生装置に装填される。画像再生装置
は、これに接続されたメモリカードに担持されているR
AMからその記憶内容を読み出し、この画像データが入
力ポート100にビット並列に入力される。また、この
読出しに同期した同期信号が入力ポート102に与えら
れ、同期信号回路104に入力される。画像信号データ
は、このような形で1フイ一ルド分が順次、繰返し入力
される。
The memory card storing image data is removed from the camera and loaded into an image playback device. The image reproducing device carries the R data on the memory card connected to it.
The memory contents are read from the AM, and this image data is input into the input port 100 in bit parallel. Further, a synchronization signal synchronized with this readout is applied to the input port 102 and input to the synchronization signal circuit 104. The image signal data is repeatedly input in sequence for one field in this manner.

画像データ処理装置は、白バランス調整1附調補正、画
素信号の同時化、輪郭強調およびフレーム化などの様々
な画像信号処理を行なう処理装置である。したがってそ
の出力+18には、処理の施されたlフレームのRGB
画像データが出力される。同時化されたRGBデータは
、色成分データR1GおよびBが1組で画像における1
画素を構成している。同時化されたRGB画像データは
、たとえばフレームバッファに蓄積され、後の画像再生
、たとえば、映像モニタへのカラー画像としての可視化
表示や、プリンタやアナログ通信装置など他の形態の画
像出力に供される。
The image data processing device is a processing device that performs various image signal processing such as white balance adjustment, tone correction, pixel signal synchronization, edge enhancement, and framing. Therefore, the output +18 contains the RGB of the processed l frame.
Image data is output. The synchronized RGB data consists of one set of color component data R1G and B, which corresponds to one set of color component data R1G and B.
It constitutes a pixel. The synchronized RGB image data is stored in a frame buffer, for example, and is used for later image reproduction, for example, for visual display as a color image on a video monitor, or for image output in other forms such as a printer or analog communication device. Ru.

画像データ処理装置は、その処理機能を概念的に第2図
に示すように、次のような画像信号処理を行なう。入力
ポート100に入力されるRGB画像データは、ホワイ
トバランス調整部180で白バランスが調整される。白
バランスが調整された画像データは次に、階調補正部1
G2にてその階調(γ)が補正される。使用したディジ
タル電子スチルカメラの撮像デバイスがγ=1である場
合、たとえば標準TV信号規格に適したγの値に階調が
補正される。
The image data processing device, whose processing functions are conceptually shown in FIG. 2, performs the following image signal processing. The white balance of the RGB image data input to the input port 100 is adjusted by a white balance adjustment section 180. The image data whose white balance has been adjusted is then sent to the gradation correction section 1.
The gradation (γ) is corrected in G2. If the imaging device of the digital electronic still camera used has γ=1, the gradation is corrected to a value of γ suitable for, for example, standard TV signal specifications.

階調の補正されたRGB画像データは次に、輝度色差化
マトリックス164にて輝度信号YLと、色差信号R−
YLおよびB−YLとに変換される。輝度信号YLは、
色信号と同程度の周波数帯域、たとえば0.7MHz程
度の低い帯域を有し、特定の画素について忠実な色の再
現に寄与させるため、隣接する2つの画素の色成分信号
を視感度に適した混合係数で混合した輝度信号である。
The gradation-corrected RGB image data is then converted into a luminance signal YL and a color difference signal R- in a luminance color difference matrix 164.
YL and B-YL. The luminance signal YL is
It has the same frequency band as the color signal, for example, a low band of about 0.7 MHz, and in order to contribute to faithful color reproduction for a specific pixel, the color component signals of two adjacent pixels are adjusted to suit the visibility. This is a luminance signal mixed using a mixing coefficient.

階調補正部1B2の出力に得られる色成分信号は、本実
施例の場合、4.2MHz程度の広帯域の輝度信号YH
としても利用され、この広域の輝度信号YHは、1画素
分のタイミングで作成される。輝度色差化マトリックス
164で得られる低域色差信号YLと階調補正部162
から得られる広域輝度信号Y)Iとの差YL−YHが減
算部+74で求められる。なお輝度信号YLは、色信号
と同程度の周波数帯域、たとえば0.7MHz程度の低
い帯域を有し、特定の画素について忠実な色の再現に寄
与させるため、隣接する2つの画素の色成分信号を視感
度に適した混合係数で混合したものである。したがって
、輝度信号YLを作成するには3画素分のタイミングを
要する。第2図の機能構成では、マトリックス164は
、低帯域の輝度信号YLを作成し、色成分信号Rおよび
Bからこれを減算することによって、色差信号R−YL
およびB−YLを作成する。
In this embodiment, the color component signal obtained as the output of the gradation correction section 1B2 is a wide band luminance signal YH of about 4.2 MHz.
This wide area luminance signal YH is created at the timing of one pixel. The low frequency color difference signal YL obtained by the luminance color difference matrix 164 and the gradation correction section 162
The difference YL-YH from the wide-area luminance signal Y)I obtained from the subtraction section +74 is obtained. Note that the luminance signal YL has a frequency band comparable to that of the color signal, for example, a low band of about 0.7 MHz, and in order to contribute to faithful color reproduction for a specific pixel, the luminance signal YL is a color component signal of two adjacent pixels. are mixed with a mixing coefficient suitable for visibility. Therefore, timing for three pixels is required to create the luminance signal YL. In the functional configuration of FIG. 2, the matrix 164 generates the color difference signal R-YL by creating a low-band luminance signal YL and subtracting it from the color component signals R and B.
and create B-YL.

色差信号R−YLおよびB−YLはそれぞれ、低域通過
フィルタ(LPF) 176および178にて、たとえ
ば0.7MHz以上の高周波成分が除去され、フレーム
化180および182が行なわれる。広域の輝度信号Y
Hは、階調補正部162から低域通過フィルタ184を
通して4.2MHz以下に帯域制限され、加算部188
に入力される。また、差信号YL−YHも低域通過フィ
ルタ188を通して加算部188に入力される。加算部
188では両信号を加算して輝度信号Yを作成し、この
輝度信号Yは次に、輪郭強調部190でその表わす絵柄
の輪郭部分が強調される。こうして輪郭の強調された輝
度信号Yは、フレーム化182が行なわれる。
The color difference signals R-YL and B-YL are subjected to low-pass filters (LPF) 176 and 178, respectively, to remove high frequency components of, for example, 0.7 MHz or higher, and to be framed 180 and 182. Wide area luminance signal Y
H is band-limited to 4.2 MHz or less from the gradation correction section 162 through the low-pass filter 184, and then passed through the addition section 188.
is input. Further, the difference signal YL-YH is also input to the adder 188 through the low-pass filter 188. An adder 188 adds both signals to create a brightness signal Y, and then an outline emphasis section 190 emphasizes the outline of the picture represented by this brightness signal Y. The luminance signal Y whose outline has been emphasized in this manner is subjected to framing 182.

ところで、入力ポートlooに入力される画像データは
、前述のように1フイ一ルド分の画像情報しか担持して
いない。そこで、フレーム化部180、182ならびに
I82にそれぞれ入力された色差信号R−YLおよびB
−YL、ならびに輝度信号Yは、それぞれのフレーム化
部で他のフィールドの画像情報が疑似的に作成され、す
なわちフレーム化される。このフレーム化は、たとえば
、Iフィールドにおいて隣接する2木の水平走査線の間
で色差信号R−YLおよびB−YL、ならびに輝度信号
Yを画素対応に相加的に平均して他方のフィールドを疑
似的に形成することによって、行なわれる。
By the way, the image data input to the input port loo carries only image information for one field, as described above. Therefore, the color difference signals R-YL and B input to the framing units 180, 182 and I82, respectively.
-YL and the luminance signal Y, image information of other fields is created in a pseudo manner in the respective framing units, that is, they are framed. This framing is performed, for example, by additively averaging the color difference signals R-YL and B-YL and the luminance signal Y between two adjacent horizontal scanning lines in the I field pixel-wise. This is done by creating a pseudo-form.

これらのフレーム(11180,182および192で
フレーム化された色差信号R−YLおよびB−Yt、、
ならびに輝度信号Yは、RGBマトリックス194に入
力され、ここで飛越し走査された2フイールドのI?C
B信号に変換される。このI?Gfl信号が出力ボート
116から出力される。したがって、この出方画像デー
タは、1画素が3原色の色成分信号RGBで構成される
ように同時化され、フレーム化されたものとなる。
These frames (color difference signals R-YL and B-Yt, framed in 11180, 182 and 192,
and the luminance signal Y is input to an RGB matrix 194, where it is interlaced scanned as a two-field I? C
It is converted into a B signal. This I? The Gfl signal is output from output port 116. Therefore, this output image data is synchronized and framed so that one pixel is composed of color component signals RGB of the three primary colors.

画像データ処理装設のこれらの機能部のうち。Of these functional parts of image data processing equipment.

輝度色差化マトリックス1θ4.減算ffB174.低
域フィルタ178.178.184および18B、加算
部188.ならびにI?CB化マトリックス184の諸
機能が本実施例では、第1図に示すように、ディジタル
フィルタ回路+20を含む単一の演算回路122によっ
て実現される。これは、上述の個々の機能部にはディジ
タルフィルタ用LSIにて処理可能な線形積和演算が多
いことと、複数の線形積和演算の組合せは単一の線形積
和演算に置換可能であることとに右目して、回路構成を
簡素化したためである。
Luminance color difference matrix 1θ4. Subtraction ffB174. Low pass filters 178, 178, 184 and 18B, adder 188. As well as I? In this embodiment, the various functions of the CB matrix 184 are realized by a single arithmetic circuit 122 including a digital filter circuit +20, as shown in FIG. This is because the individual functional units mentioned above have many linear product-sum operations that can be processed by the digital filter LSI, and the combination of multiple linear product-sum operations can be replaced with a single linear product-sum operation. This is because the circuit configuration has been simplified with special consideration.

演算回路122は、ディジタルフィルタ回路+20と、
これにフィルタ係数0n(i)を与える係数発生回路1
24を有する線形積和演算回路である。ディジタルフィ
ルタ回路120は、第3図にその1つの具体例を示すよ
うに、たとえば有限長インパルス応答(FIR) フィ
ルタにて実現される。このフィルタ回路120は、N−
1段(Nは自然数)の遅延回路(T) 12Bを有し、
その初段の入力132には階調補正回路】62から画素
データP(K)が入力される。各段の遅延回路12Bは
、同期信号部104から与えられ画素データに対応した
同期信号に同期して1画素データ分の遅延を画素データ
に与える回路である。各段12Bの入出力には乗算回路
128が接続され、それらN個の乗算回路128には係
数発生回路124からフィルタ係数0n(i)が画素デ
ータに同期して供給される。ただし、Kは3IIl+n
、mは0または正の整数、nは0.1または2.またi
はOがらN−1までの整数である。乗算回路12日の出
力は加算回路+30にて総和がとられ、画像データQ(
K)としてフィルタ回路120の出力134に出力され
る。
The arithmetic circuit 122 includes a digital filter circuit +20,
Coefficient generation circuit 1 that gives filter coefficient 0n(i) to this
This is a linear product-sum operation circuit having 24 circuits. The digital filter circuit 120 is realized, for example, by a finite impulse response (FIR) filter, as shown in one specific example in FIG. This filter circuit 120 has N-
It has one stage (N is a natural number) delay circuit (T) 12B,
Pixel data P(K) is input from the gradation correction circuit 62 to the input 132 at the first stage. The delay circuit 12B at each stage is a circuit that applies a delay of one pixel data to pixel data in synchronization with a synchronization signal that is applied from the synchronization signal section 104 and corresponds to the pixel data. A multiplication circuit 128 is connected to the input/output of each stage 12B, and the filter coefficients On(i) are supplied from the coefficient generation circuit 124 to the N multiplication circuits 128 in synchronization with the pixel data. However, K is 3IIl+n
, m is 0 or a positive integer, n is 0.1 or 2. Also i
is an integer from O to N-1. The output of the multiplier circuit 12 is summed in the adder circuit +30, and the image data Q (
K) at the output 134 of the filter circuit 120.

フィルタ係数0n(i)を発生する係数発生回路124
は、本実施例では、nxN個のフィルタ係数値が半固定
的に蓄積されているROMの形をとり。
Coefficient generation circuit 124 that generates filter coefficient 0n(i)
In this embodiment, is in the form of a ROM in which nxN filter coefficient values are stored in a semi-fixed manner.

同期信号部104から与えられる画素データ対応の同期
信号に同期してこれらの値を出力する回路である。本実
施例では、フィルタ回路120および係数発生回路12
4が1つのディジタルフィルタ用LSIで構成されてい
る。
This circuit outputs these values in synchronization with a synchronization signal corresponding to pixel data given from the synchronization signal section 104. In this embodiment, the filter circuit 120 and the coefficient generation circuit 12
4 is composed of one digital filter LSI.

フィルタ係数Cn(i)は、たとえば第5図に示すよう
に、入力データ132が色成分RGBの画素順序を繰り
返して入力される場合、R成分についてはλn、G Q
分についてはILn、またB成分についてνnと表わす
ものとする。これらの係数は次の式によって得られる。
For example, as shown in FIG. 5, when the input data 132 is input by repeating the pixel order of the color components RGB, the filter coefficient Cn(i) is λn for the R component, G Q
The minute is expressed as ILn, and the B component is expressed as νn. These coefficients are obtained by the following equations.

λn(i)=  Ct(i)−p  (i)  ・ A
rgb(n+i)+ K 命 τ c(i) δ (n
+1)gn(i)=  Ct(i) −p (i)  
・Argb(n+i)+ Ke τc(i)δ(n+1
−1)v n(i)=  Gt(i)−p  (i) 
 ・ Argb(n+i)十に・τc(i)δ(n+i
+1) ここに、低域の輝度信号YLの色成分RGBについての
分解係数をそれぞれ、at、 agおよびabとすると
、 YL=ar* R+ag* G +ab* Bである。
λn(i)=Ct(i)−p(i)・A
rgb(n+i)+K life τ c(i) δ (n
+1) gn(i) = Ct(i) −p (i)
・Argb(n+i)+Ke τc(i)δ(n+1
−1)v n(i)=Gt(i)−p(i)
・Argb(n+i) 10・τc(i)δ(n+i
+1) Here, if the resolution coefficients for the color components RGB of the low-frequency luminance signal YL are respectively at, ag, and ab, then YL=ar*R+ag*G+ab*B.

そこで δ(K)−1(n−0のとき) δ(K)=O(n=1または2のとき)とすると、 Argb(n+i)  = ar *  δ (1+i
)+6g赤 δ (n+1−1)+ab・δ(n+i+
1) で表わされる。また1色差信号系ディジタルフィルタ1
76および+78の係数をcc(i)、輝度差信号YL
−YH系ディジタルフィルタ186の係数をCd(i)
Therefore, if we set δ(K)-1 (when n-0) and δ(K)=O (when n=1 or 2), Argb(n+i) = ar * δ (1+i
)+6g red δ (n+1-1)+ab・δ(n+i+
1) It is expressed as In addition, 1 color difference signal system digital filter 1
76 and +78 coefficients as cc(i), luminance difference signal YL
−The coefficient of the YH system digital filter 186 is Cd(i)
.

また高域の輝度信号YH系のディジタルフィルタ184
の係数をCh(i)とすれば、 CL(i) = 0h(i)−Cd(i)ρ(i)=K
・τc(i)−τd(i)τc(i)= Gc(i−1
)+Cc(i)+Gc(n+1)τd(i)= Cd(
i−1)+Cd(i)+C:d(n+1)ただし、定数
には、RGB化マトリックス194の色重みであり、 R=Y+に・(R−Y) B=Y十に壷(B−Y) G = Y−(KIIar/ag)(R−Y)−(KΦ
ab/ag)(B−Y) である。また、定義されていない定数は0である。
Also, a digital filter 184 for the high-frequency luminance signal YH system.
If the coefficient of is Ch(i), then CL(i) = 0h(i)-Cd(i)ρ(i)=K
・τc(i)−τd(i)τc(i)=Gc(i−1
)+Cc(i)+Gc(n+1)τd(i)=Cd(
i-1)+Cd(i)+C:d(n+1) However, the constant is the color weight of the RGB conversion matrix 194, R=Y+(R-Y) B=Y+(R-Y) ) G = Y-(KIIar/ag)(RY)-(KΦ
ab/ag)(BY). Further, undefined constants are 0.

ディジタルフィルタ回路120の入力132に入力画像
データP(K)が入力されると、同回路+20において
これらのフィルり係数入n(i)、 μn(i)および
′νn(i)によって次の演算が行なわれ、出力データ
Q(K)が出力される。
When the input image data P(K) is input to the input 132 of the digital filter circuit 120, the circuit +20 performs the following calculation using these fill coefficients input n(i), μn(i) and ′νn(i). is performed, and output data Q(K) is output.

ここで、係数0n(i)はフィルタ係数入n(i)。Here, the coefficient 0n(i) is the filter coefficient input n(i).

μn(i)8よびνnc+)のうちのいずれカ)をとり
、第5図に例示するように、入力画像データP(K)に
応じて係数発生回路+24から与えられる。そこで、こ
の式による演算がディジタルフィルタ回路120によっ
て行なわれ、出力データQ(K)がその出力134に3
包成分RGBの形で出力される。同図の例では係数0n
(i)が9種類のうちから次々に選択的に設定されて使
用される。ディジクルフィルタ回路120には、入力画
像信号データP(K)に同期して係数Cr+(i)が選
択的に設定され、各色成分について時分割的に演算を行
なう。
.mu.n(i)8 and .nu.nc+) and is given from the coefficient generation circuit +24 according to the input image data P(K), as illustrated in FIG. Therefore, the calculation according to this formula is performed by the digital filter circuit 120, and the output data Q(K) is outputted to the output 134.
It is output in the form of envelope components RGB. In the example in the same figure, the coefficient is 0n
(i) is selectively set and used one after another from nine types. A coefficient Cr+(i) is selectively set in the digital filter circuit 120 in synchronization with the input image signal data P(K), and calculations are performed for each color component in a time-sharing manner.

上式に示されるように、1回のディジタルフィルタ処理
では処理中の1つの色成分データの173のデータしか
得られない。そこで本実施例では。
As shown in the above equation, only 173 pieces of data of one color component data being processed can be obtained in one digital filter process. Therefore, in this example.

フィルタ回路120の出力にフィールドFIFO回路1
36が設けられ、これによって各色成分データを並べか
え、実質的に同じタイミングで1つの色成分について完
全なデータが得られるようにしている。
Field FIFO circuit 1 is connected to the output of filter circuit 120.
36, which rearranges each color component data so that complete data for one color component can be obtained at substantially the same timing.

出力134の3色成分の画像データQ(K)は次に、輪
郭強調部138でその表わす絵柄の輪郭部分が強調され
、フレーム化部140で他のフィールドの画像情報が疑
似的に作成されてフレーム化される。
The output 134 three-color component image data Q(K) is then subjected to an outline emphasizing section 138 where the outline of the picture it represents is emphasized, and a framing section 140 where image information of other fields is created in a pseudo manner. Framed.

したがって出力JIBから出力される画像データは、飛
越し走査された2フイールドのRGB信号データの形を
とり、1画素が3原色の色成分信号17GBで構成され
るように同時化され、フレーム化されたものとなる。
Therefore, the image data output from the output JIB is in the form of 2-field RGB signal data that has been interlaced scanned, and is synchronized and framed so that one pixel is composed of 17 GB of color component signals of the three primary colors. It becomes something.

このように本実施例では、画像信号の同時化およびフレ
ーム化を含むディジタルフィルタ処理で共通な線形積和
演算を単一の線形積和演算回路、すなわち演算回路12
2に置き換えて、回路構成を簡素化している。演算回路
122は、第3図かられかるように最長タップ数の低域
フィルタと同じ回路構成であり、これによって他の低域
フィルタ回路や、加算および減算回路が不要になる。ま
た、フレーム化回路は1セツト140でよく、2セント
分を省略できる。したがって、第2図に示した輝度色差
化マトリックス164.減算部174.低域フィルタ1
78.178および188.加算部】88.フレーム化
部180および182.ならびにRGB化マトリックス
184は、それに対応するハードウェアが減少する。
In this way, in this embodiment, the linear product-sum calculation, which is common in digital filter processing including image signal synchronization and framing, is performed using a single linear product-sum calculation circuit, that is, the calculation circuit 12.
2 to simplify the circuit configuration. As shown in FIG. 3, the arithmetic circuit 122 has the same circuit configuration as the low-pass filter with the longest number of taps, thereby eliminating the need for other low-pass filter circuits and addition and subtraction circuits. Furthermore, one set of framing circuits 140 is sufficient, and the cost of 2 cents can be omitted. Therefore, the luminance color difference matrix 164 shown in FIG. Subtraction unit 174. Low pass filter 1
78.178 and 188. Addition part】88. Framing units 180 and 182. In addition, the RGB conversion matrix 184 has a reduced amount of corresponding hardware.

なお、広域の輝度信号YHは、1画素分のタイミングで
作成されるので、色差信号R−YLおよびB−YLに対
して2画素分のタイミングの差がある。このため、第2
図に示す機能ブロックを個別のハードウェアで実現した
とすると、第4図に示すように階調補正部162の出力
にFIFO回路168を設ける必要がある。これは、F
IFO回路168.170および+72とともに1両者
のタイミングの差を補償するものである。しかし第1図
に示す実施例では、このようなFIFO回路16[、I
fi8. +70および170 も必要とせず、フィー
ルドFIFO回路136にて各色成分データの相互間の
タイミングを調整している。したがって、信号処理に要
する回路構成が大幅に簡素化される。
Note that since the wide-area luminance signal YH is created at a timing corresponding to one pixel, there is a timing difference corresponding to two pixels with respect to the color difference signals R-YL and B-YL. For this reason, the second
If the functional blocks shown in the figure are realized by separate hardware, it is necessary to provide a FIFO circuit 168 at the output of the gradation correction section 162, as shown in FIG. This is F
It is used together with IFO circuits 168, 170 and +72 to compensate for the difference in timing between the two. However, in the embodiment shown in FIG.
fi8. +70 and +170 are not required, and the timing between each color component data is adjusted in the field FIFO circuit 136. Therefore, the circuit configuration required for signal processing is greatly simplified.

信号処理部108のL述した各要素は本実施例ではすべ
て、ディジタルの)\−トウエア回路にて有利に構成さ
れている。したがって、従来、電子スチルカメラで行な
われていたアナログ回路による映像信号処理と異なり、
ディジタル回路によるハードウェアにて画像データ処理
を実現しているので、この画像データ処理は、理想特性
に近く、しかも高速に行なうことができる。本実施例で
はまた、本装置から出力される画像データは、他のシス
テムで一般的に多く採用されている同時化されフレーム
化されたRGBデータであるので、他のシステムとの両
立性がよい。
In this embodiment, all of the above-mentioned elements of the signal processing unit 108 are advantageously constructed as digital hardware circuits. Therefore, unlike video signal processing using analog circuits that was conventionally performed in electronic still cameras,
Since image data processing is realized by hardware using digital circuits, this image data processing has close to ideal characteristics and can be performed at high speed. In this embodiment, the image data output from this device is synchronized and framed RGB data that is commonly used in other systems, so it is compatible with other systems. .

ここで説明した実施例は本発明を説明するためのもので
あって、本発明は必ずしもこれに限定されるものではな
く、本発明の精神を逸脱することなく当業者が可能な変
形および修正は本発明の範囲に含まれる。たとえは、入
力される画f4′信リデータはRGBの原色成分のもの
であったが、l1ffi 欧化された画像データであれ
ば、たとえば補色系や、輝度・色差信号系の画像データ
であっても効果的に適用できる。本実施例ではまた。同
じ回路構成にて出力116に輝度色差信号データを得る
ようにすることも可能である。その場合は、ディジタル
フィルタ回路120に与えるフィルタ係数Cn(i)を
輝度色差系に適した値にすればよい。これら入出力信号
データの要求条件に本装置を適応させるには、係数発生
回路122のROMにそれに応じた記憶データを書き込
めばよい。
The embodiments described here are for illustrating the present invention, and the present invention is not necessarily limited thereto, and variations and modifications that can be made by those skilled in the art without departing from the spirit of the present invention are possible. Within the scope of the present invention. For example, the input image f4' signal data is of RGB primary color components, but if it is l1ffi Europeanized image data, it may be complementary color system or luminance/color difference signal system image data. Can be applied effectively. Also in this example. It is also possible to obtain luminance color difference signal data at the output 116 using the same circuit configuration. In that case, the filter coefficient Cn(i) given to the digital filter circuit 120 may be set to a value suitable for the luminance/chrominance system. In order to adapt the present device to the requirements of these input/output signal data, it is sufficient to write corresponding storage data into the ROM of the coefficient generation circuit 122.

効  果 このように本発明によれば、画像信号の同時化およびフ
レーム化を含むディジタルフィルタ処理で共通な線形積
和演算を単一の線形積和演算回路に置き換え、点順次の
画像データに時系列的に行なわれる演算に応じて演算係
数を次々と設定するように構成されている。したがって
、回路構成が簡素化される。才だ、ディジタル回路によ
る/\−ドウエアにて画像データ処理を実現しているの
で、理想特性に近く、高速な画像データ処理を実現する
ことができる。本発明は、とくにディジタル電子スチル
カメラの再生装置に有利に適用される。
Effects As described above, according to the present invention, linear product-sum calculations common in digital filter processing including image signal synchronization and framing are replaced with a single linear product-sum calculation circuit, and point-sequential image data can be processed in time. The calculation coefficients are configured to be set one after another according to the calculations performed in series. Therefore, the circuit configuration is simplified. Since the image data processing is realized using a digital circuit/ware, it is possible to realize high-speed image data processing with close to ideal characteristics. The present invention is particularly advantageously applied to a playback device for a digital electronic still camera.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明による画像データ処理装置の実施例の全
体構成を示す回路ブロック図、第2図は、第1図に示す
画像データ処理装置における画像データ処理の機能を概
念的に示す機能ブロック図、 第3図は同実施例に適用されるディジタルフィルタ回路
の構成例を示すブロック図、 第4図は、同実施例の処理機能を個別の/\−ドウエア
で実現した場合の構成例を示す機能ブロック図、 t55図は、第1図に示す実施例の動作を説明するだめ
の説明図である。 主要部分の符号の説明 120、、、ディジタルフィルタ回路 +22. 、  演算回路 +24.、、係数発生回路 136、、、フィールドFIFO回路 !38...輪郭強調部 +40.、、フレーム化部 180、、、ホワイトバランス調整部 1B2.、、階調補正部 特許出願人 富士写真フィルム株式会社代 理 人 番
数 老雄 先山 隆夫 葬7f凹 7−一入カイ五弓 −一一一一一−−−−−−−−−□
−1FF、G、B 具2凹 □出111a号□ 地ji図 入力値も 逢、ワイトバウン久司引q   /60r補、よ /6
2 //:、4                    
       /6乙■度色差化マド131,7久  
FrF;01″T4 *箪 F?−YL     イL    −Yl−I   Y
l−1LPF   LPF   LPF   LPFF
IFO 1/J3 7)’II 笥   1BF3 #5 図 170     /7.? FIFOFIFO謳 /’?0 −YL      −YL     Yフレーム   
フレーム化  フレーム化/q2・八−18り
FIG. 1 is a circuit block diagram showing the overall configuration of an embodiment of the image data processing device according to the present invention, and FIG. 2 is a functional block diagram conceptually showing the function of image data processing in the image data processing device shown in FIG. Figure 3 is a block diagram showing a configuration example of a digital filter circuit applied to the same embodiment, and Figure 4 is a configuration example when the processing function of the same embodiment is realized by separate /\-ware. The functional block diagram shown in FIG. t55 is an explanatory diagram for explaining the operation of the embodiment shown in FIG. Explanation of symbols of main parts 120, . . . Digital filter circuit + 22. , Arithmetic circuit +24. ,,Coefficient generation circuit 136,,,Field FIFO circuit! 38. .. .. Contour enhancement part +40. ,,framing section 180,,,white balance adjustment section 1B2. ,, Tone correction unit patent applicant Fuji Photo Film Co., Ltd. Agent Number Number: Royusenzan Takaoso 7f Concave 7-1-in Kai Gokyu -11111------------------------□
-1FF, G, B Tool 2 recess □ Output 111a □ Earth ji map input value also meets, Wight Bown Kushibiki q /60r supplement, yo /6
2 //:, 4
/6 Otsu ■ degree color difference Mado 131,7 Ku
FrF;01″T4 *Kan F?-YL IL -Yl-I Y
l-1LPF LPF LPF LPFF
IFO 1/J3 7)'II 笥 1BF3 #5 Figure 170 /7. ? FIFOFIFO song /'? 0 -YL -YL Y frame
Framing Framing/q2・8-18ri

Claims (3)

【特許請求の範囲】[Claims] 1.点順次カラー入力画像データを受けて低域ろ波およ
び同時化を含む画像信号処理を行なう画像データ処理装
置において、該装置は、 演算係数が可変的に設定可能であり、前記入力画像デー
タに該設定された演算係数による線形積和演算を行ない
、前記画像信号処理を行なった色成分データを出力する
ディジタルフィルタ回路と、 前記入力画像データに同期して該ディジタルフィルタ回
路に該入力画像データに応じた前記演算係数を設定する
係数発生回路と、 前記色成分データのタイミングを実質的に一致させて出
力画像データを出力するFIFOメモリとを有すること
を特徴とする画像データ処理装置。
1. An image data processing device that receives point-sequential color input image data and performs image signal processing including low-pass filtering and synchronization. a digital filter circuit that performs a linear product-sum operation using set calculation coefficients and outputs the color component data that has been subjected to the image signal processing; An image data processing device comprising: a coefficient generation circuit that sets the arithmetic coefficients; and a FIFO memory that outputs output image data by substantially matching the timing of the color component data.
2.請求項1に記載の装置において、前記入力画像デー
タはフィールドの画像データであり、該装置は、該フィ
ールドの画像データをフレーム化するフレーム化手段を
含むことを特徴とする画像データ処理装置。
2. 2. The image data processing apparatus according to claim 1, wherein the input image data is image data of a field, and the apparatus includes a framing means for framing the image data of the field.
3.請求項1に記載の装置において、該装置は、前記入
力画像データの絵柄の輪郭を強調する輪郭強調手段を含
むことを特徴とする画像データ処理装置。
3. 2. The image data processing apparatus according to claim 1, further comprising an outline emphasizing means for emphasizing the outline of a picture in said input image data.
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