JPH0228830B2 - - Google Patents
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- JPH0228830B2 JPH0228830B2 JP55056986A JP5698680A JPH0228830B2 JP H0228830 B2 JPH0228830 B2 JP H0228830B2 JP 55056986 A JP55056986 A JP 55056986A JP 5698680 A JP5698680 A JP 5698680A JP H0228830 B2 JPH0228830 B2 JP H0228830B2
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- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R19/00—Arrangements for measuring currents or voltages or for indicating presence or sign thereof
- G01R19/165—Indicating that current or voltage is either above or below a predetermined value or within or outside a predetermined range of values
- G01R19/16528—Indicating that current or voltage is either above or below a predetermined value or within or outside a predetermined range of values using digital techniques or performing arithmetic operations
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Description
【発明の詳細な説明】
本発明は、計測値を所定のランクに分類するた
めの判別装置に関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a discrimination device for classifying measured values into predetermined ranks.
例えば絞り優先式の自動露出制御カメラは、そ
のフアインダ内にシヤツタ速度を確認するため
に、多数の表示ランプを備えている。そしてこの
種の自動制御回路は、動作の安定化、LSI化およ
びデジタル表示などのためにデジタル回路として
構成されている。そしてシヤツタスピード表示回
路は、シヤツタスピードの表示のときに、そのと
きの露出条件に応じてパルス数を計数し、その計
数値を一定の範囲に分類して表示し、その表示位
置からシヤツタスピードの範囲を外部に予知する
ようにしてある。 For example, an aperture-priority automatic exposure control camera is equipped with a number of indicator lamps in its viewfinder to confirm the shutter speed. This type of automatic control circuit is configured as a digital circuit for stabilization of operation, integration into LSI, digital display, etc. When displaying the shutter speed, the shutter speed display circuit counts the number of pulses according to the exposure conditions at that time, classifies and displays the counted values into a certain range, and then displays the shutter speed from that display position. The data speed range is predicted to the outside.
従来、この種のランク判別回路は、ランク(パ
ルスの計数値範囲)ごとに1つのコンパレータを
必要としている。そのためランクの数が多くなる
と、これに対応してコンパレータの数が増えるた
め、ランク設定回路は、複数となり、かつ大型の
ものとなつてカメラの小型化の要求に沿わなくな
つている。 Conventionally, this type of rank discrimination circuit requires one comparator for each rank (pulse count value range). Therefore, as the number of ranks increases, the number of comparators increases accordingly, resulting in a plurality of rank setting circuits and large size circuits, which are no longer able to meet the demands for miniaturization of cameras.
ここに本発明の目的は、この種のものの回路構
成を単純化し、従来の欠点を除去する点にある。 SUMMARY OF THE INVENTION It is an object of the present invention to simplify the circuit construction of this type of device and eliminate the drawbacks of the prior art.
以下、本発明を図に示す一実施例にもとづいて
具体的に説明する。 Hereinafter, the present invention will be specifically explained based on an embodiment shown in the drawings.
本発明の計測値ランク判別装置1は、カウンタ
2、複数のランク設定回路31,32,……3n、
判定回路4および制御回路5により構成してあ
る。 The measured value rank discriminating device 1 of the present invention includes a counter 2, a plurality of rank setting circuits 3 1 , 3 2 , . . . 3 n,
It is composed of a determination circuit 4 and a control circuit 5.
上記カウンタ2は、計測値としてのパルス信号
(S1)のパルス数を計数し、その計数出力をBCD
などのコード信号(S2)で出力するものであり、
また複数のランク設定回路31,32,……3n
は、所定のランク(計数値範囲)ごとに設けら
れ、そのランク値に対応するBCDなどのコード
信号(S3)を発生するものであり、例えばマトリ
ツクス回路などで構成してある。また判定回路4
は、上記ランク設定回路31,32,……3nのコ
ード信号(S3)と上記カウンタ2のコード信号
(S2)とを比較しそれらの一致時にパルス状の判
定信号(S4)を発生するもので、例えばコンパレ
ータ6を主要部として構成してある。さらに制御
回路5は、上記判定信号(S4)を入力として順次
歩進し、対応の上記ランク設定回路31,32,…
…3nにそれぞれ動作信号(S5)を出力するもの
であり、カウンタ7を主要部として構成してあ
る。このカウンタ7はスタート信号(S6)を受け
た時点で作動し、その複数の動作信号(S5)は、
それぞれインバータ81,82,……8nを経てラ
ンク設定回路31,32,……3nに出力され、か
つ表示ランプ91,92,……9nを経てアース1
0に達するようにしてある。なおランク設定回路
31,32,……3nは、それぞれ動作信号(S5)
を受けた時点で表示ランプ111,112,……1
1nをそれぞれ駆動し、所定のランク例えば露出
過剰(OVER)、シヤツタスピード(1000)、
(500)……、露出不足(UNDER)の表示を外部
にすることになる。 The counter 2 counts the number of pulses of the pulse signal (S 1 ) as a measurement value, and converts the counting output to BCD.
It outputs a code signal (S 2 ) such as
Also, a plurality of rank setting circuits 3 1 , 3 2 , ... 3n
is provided for each predetermined rank (count value range), and generates a code signal (S 3 ) such as BCD corresponding to the rank value, and is constructed of, for example, a matrix circuit. Also, the judgment circuit 4
compares the code signal (S 3 ) of the rank setting circuits 3 1 , 3 2 , . For example, the comparator 6 is the main part. Furthermore, the control circuit 5 sequentially steps forward with the judgment signal (S 4 ) as input, and the corresponding rank setting circuits 3 1 , 3 2 , . . .
...3n, respectively, and is configured with the counter 7 as the main part. This counter 7 operates upon receiving the start signal (S 6 ), and the plurality of operation signals (S 5 ) are as follows:
The outputs are outputted to the rank setting circuits 3 1 , 3 2 , . . . 3n through inverters 8 1 , 8 2 , .
It is set so that it reaches 0. Incidentally, the rank setting circuits 3 1 , 3 2 , . . . 3n each have an operation signal (S 5 ).
The display lamps 11 1 , 11 2 ,...1
1n respectively, and set a predetermined rank such as overexposure (OVER), shutter speed (1000),
(500)..., underexposure (UNDER) will be displayed externally.
つぎに動作を説明する。例えばカウンタ2のコ
ード信号(S2)がランク設定回路33と34の間に
ある場合を想定する。まず、カウンタ7にスター
ト信号(S6)を与えると、カウンタ7は動作信号
(S5)を第1番目のインバータ81に出力し、この
インバータ81で「L」レベルに転換して第1番
目のランク設定回路31に送る。この信号を受け
て、第1の設定値である固有のランク設定回路3
1のコード信号(S3)をコンパレータ6の一方側
に送り出す。一方、カウンタ2には前記スタート
信号(S6)と同時に計測された測定値をコード信
号(S2)に変換してコンパレータ6の他方側に送
りこんでいる。カウンタ6に入力される測定値は
光量に応じたパルス群(S1)であるので、瞬時に
入力されるものではなく、カウンタ2の値は時間
とともに逐次上昇してゆき、コンパレータ6に入
力されるコード信号(S2)も同様に逐次上昇して
ゆく。そして、この逐次上昇してゆくコード信号
(S2)とランク設定回路31のコード信号(S3)と
を比較してこれらが一致したとき、コンパレータ
6は1個のパルス状の判定信号(S4)をカウンタ
7に出力する。カウンタ7はこの判定信号(S4)
を受けて歩進し、動作信号(S5)の出力を第2番
目のインバータ82に切り換え、このインバータ
82で「L」レベルに転換して第2番目のランク
設定回路32に送る。そして、第1番目のときと
同様にしてコード信号(S2)とランク設定回路3
2のコード信号(S3)とを比較して一致したとき、
コンパレータ6は再び1個のパルス状の判定信号
(S4)をカウンタ7に出力する。以下同様にして、
カウンタ7は第3番目、第4番目と歩進してゆ
く。そして、コード信号(S2)と第4番目のラン
ク設定回路34のコード信号(S3)とは一致しな
いので、コンパレータ6からは判定信号(S4)が
出力されず、カウンタ7は歩進せず第4番目で停
止する。以上の動作の間、ランク設定回路31,
32,33,34の切り換えに従つて、表示ランプ
111,112,113,114,91,92,93,9
4も切り換わり、カウンタ7が第4番目で停止す
ると、表示ランプ114,94の点灯位置も停止し
て、その位置によりシヤツタスピード(1/250)
を表示する。なおこの表示ランプ91,92,……
9nは、例えばカメラの製造段階でシヤツタスピ
ードの検査をする場合にフアインダの内部を覗か
ないまま確認する場合に有効である。またこの出
力は、同時に測定回路などの出力としてそのスピ
ードを印字する場合あるいはその他の処理信号と
して用いられる。 Next, the operation will be explained. For example, assume that the code signal (S 2 ) of the counter 2 is between the rank setting circuits 3 3 and 3 4 . First, when a start signal (S 6 ) is given to the counter 7, the counter 7 outputs an operation signal ( S 5 ) to the first inverter 8 1 , which converts it to “L” level and starts the operation signal (S 5 ). Send to the first rank setting circuit 31 . Upon receiving this signal, the unique rank setting circuit 3 which is the first setting value
1 code signal (S 3 ) is sent to one side of the comparator 6. On the other hand, the counter 2 converts the measurement value measured at the same time as the start signal (S 6 ) into a code signal (S 2 ) and sends it to the other side of the comparator 6. The measured value input to the counter 6 is a group of pulses (S 1 ) corresponding to the amount of light, so it is not input instantaneously, but the value of the counter 2 increases sequentially over time and is input to the comparator 6. Similarly, the code signal (S 2 ) gradually rises. Then, the code signal (S 2 ) which increases sequentially is compared with the code signal (S 3 ) of the rank setting circuit 3 1 , and when they match, the comparator 6 outputs one pulse-like judgment signal ( S 4 ) is output to the counter 7. Counter 7 uses this judgment signal (S 4 )
The output of the operation signal (S 5 ) is switched to the second inverter 8 2 , which converts it to the "L" level and sends it to the second rank setting circuit 3 2 . . Then, in the same way as in the first case, the code signal (S 2 ) and the rank setting circuit 3
2 code signal (S 3 ) and when they match,
The comparator 6 again outputs one pulse-like determination signal (S 4 ) to the counter 7. Similarly below,
The counter 7 increments from the third to the fourth. Since the code signal (S 2 ) and the code signal (S 3 ) of the fourth rank setting circuit 34 do not match, the comparator 6 does not output the determination signal (S 4 ), and the counter 7 It does not move forward and stops at the 4th position. During the above operation, the rank setting circuit 3 1 ,
According to the switching of 3 2 , 3 3 , 3 4 , the display lamps 11 1 , 11 2 , 11 3 , 11 4 , 9 1 , 9 2 , 9 3 , 9
4 also switches, and when the counter 7 stops at the 4th position, the lighting positions of the indicator lamps 11 4 and 9 4 also stop, and the shutter speed (1/250) changes depending on the position.
Display. Note that these display lamps 9 1 , 9 2 , ...
9n is effective, for example, when inspecting the shutter speed at the camera manufacturing stage without looking inside the viewfinder. Further, this output is simultaneously used as an output of a measuring circuit or the like when printing the speed, or as another processing signal.
なお、上記実施例は、カメラのシヤツタスピー
ド表示用のものとして説明されているが、本発明
は、その用途に限定されるものではない。 Note that although the above embodiment has been described as one for displaying the shutter speed of a camera, the present invention is not limited to this application.
本発明では、制御回路がランク設定回路を順次
動作させるようにしているから、判定回路、特に
そのコンパレータが1つでよく、したがつてラン
ク判別装置が単純化かつ小型化でき、またこの装
置の回路要素がデジタル的な一般的回路素子すな
わちカウンタ、コンパレータなどにより構成でき
るため、製品が安価に提供できる。 In the present invention, since the control circuit sequentially operates the rank setting circuits, only one determination circuit, especially its comparator, is required, and therefore the rank determination device can be simplified and miniaturized. Since the circuit elements can be composed of general digital circuit elements, such as counters and comparators, the product can be provided at low cost.
第1図は本発明の計測値ランク判別装置のブロ
ツク線図である。
1……計測値ランク判別装置、2……カウン
タ、31,32…3n……ランク設定回路、4……
判定回路、5……制御回路、6……コンパレー
タ、7……カウンタ。
FIG. 1 is a block diagram of the measured value rank discriminating device of the present invention. DESCRIPTION OF SYMBOLS 1...Measurement value rank discrimination device, 2...Counter, 31 , 32 ...3n...Rank setting circuit, 4...
Judgment circuit, 5... Control circuit, 6... Comparator, 7... Counter.
Claims (1)
計数してその計数値をコード信号で出力するカウ
ンタと、所定のランクごとに設けられそのランク
値に対応するコード信号を発生する複数のランク
設定回路と、上記カウンタのコード信号と上記ラ
ンク設定回路のコード信号とを比較してその一致
時にパルス状の判定信号を発生する判定回路と、
上記パルス状の判定信号を受けて順次歩進し対応
する上記ランク設定回路への動作信号の出力を切
り換えるカウンタとを具備することを特徴とする
計測値ランク判別装置。 2 特許請求の範囲第1項において、判定回路
は、コンパレータで構成されていることを特徴と
する計数値ランク判別装置。 3 特許請求の範囲第1項または第2項におい
て、制御回路は、動作信号を入力として点灯する
所定ランクに対応する数の表示ランプを有するこ
とを特徴とする計数値ランク判別装置。[Claims] 1. A counter that counts pulse signals that express the value of a measured value as a number of pulses and outputs the counted value as a code signal, and a code signal that is provided for each predetermined rank and that corresponds to the rank value. a determination circuit that compares the code signal of the counter and the code signal of the rank setting circuit and generates a pulse-like determination signal when they match;
A measured value rank discriminating device comprising: a counter that sequentially increments in response to the pulsed determination signal and switches the output of the operation signal to the corresponding rank setting circuit. 2. The count rank determination device according to claim 1, wherein the determination circuit is comprised of a comparator. 3. The count rank discriminating device according to claim 1 or 2, wherein the control circuit has a number of display lamps corresponding to a predetermined rank that are turned on in response to an operation signal.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5698680A JPS56153258A (en) | 1980-04-28 | 1980-04-28 | Rank deciding device for measured value |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5698680A JPS56153258A (en) | 1980-04-28 | 1980-04-28 | Rank deciding device for measured value |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS56153258A JPS56153258A (en) | 1981-11-27 |
JPH0228830B2 true JPH0228830B2 (en) | 1990-06-26 |
Family
ID=13042809
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5698680A Granted JPS56153258A (en) | 1980-04-28 | 1980-04-28 | Rank deciding device for measured value |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS56153258A (en) |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5229019U (en) * | 1975-08-20 | 1977-03-01 |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5439963Y2 (en) * | 1975-05-30 | 1979-11-26 |
-
1980
- 1980-04-28 JP JP5698680A patent/JPS56153258A/en active Granted
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5229019U (en) * | 1975-08-20 | 1977-03-01 |
Also Published As
Publication number | Publication date |
---|---|
JPS56153258A (en) | 1981-11-27 |
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