JPH02211789A - Color signal processing circuit of digital color television receiver - Google Patents
Color signal processing circuit of digital color television receiverInfo
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Abstract
Description
【発明の詳細な説明】
（イ）産業上の利用分野
本発明はデジタルカラーテレビジョン受信機のカラー信
号処理回路に関し、特にカラーゲインコントロール及び
色相調整に関する。DETAILED DESCRIPTION OF THE INVENTION (A) Field of Industrial Application The present invention relates to a color signal processing circuit for a digital color television receiver, and particularly to color gain control and hue adjustment.
（ロ）従来の技術
デジタルカラーテレビジョン受信機（デジタルＴＶ）の
カラー処理回路は、例えば特開昭６０−１６９２９２号
（ＨＯ４Ｎ ９／６８）に示されている。(b) Prior Art A color processing circuit for a digital color television receiver (digital TV) is shown in, for example, Japanese Patent Laid-Open No. 169292/1983 (HO4N 9/68).
７４３図に従来のデジタルＴＶの一例を示す。第３図に
於いて（１０）はビデオ信号入力端子、（１２）は色副
搬送波に同期して色副搬送波周波数（ｆｓｃ）の４倍（
４ｆ ｓｃ）で発振するサンプリングクロック発生回路
、（１４）はＡ／Ｄ変換器（Ａ／Ｄ変換回路）、（１６
）はＹ／Ｃ分離回路である。Ｙ／Ｃ分離回路、（１６）
はデジタルビデオ信号を輝度信号（Ｙ）と色信号（Ｃ）
に分離する。（１８）はＡＣＣ用の制御信号発生回路で
ある。（２０）はカラーゲインマニュアル調整用の制御
信号入力端子である。（２２）はマニュアルと自動の制
御信号により、カラーゲイン信号を作成するカラーゲイ
ン信号作成回路である。（２４）はカラーゲイン用の乗
算器、（２６）はカラー復調回路である。Figure 743 shows an example of a conventional digital TV. In Figure 3, (10) is a video signal input terminal, (12) is synchronized with the color subcarrier and is four times the color subcarrier frequency (fsc).
(14) is an A/D converter (A/D conversion circuit); (16) is an A/D converter (A/D conversion circuit);
) is a Y/C separation circuit. Y/C separation circuit, (16)
is a digital video signal with luminance signal (Y) and color signal (C)
Separate into (18) is a control signal generation circuit for ACC. (20) is a control signal input terminal for manual color gain adjustment. (22) is a color gain signal creation circuit that creates a color gain signal using manual and automatic control signals. (24) is a multiplier for color gain, and (26) is a color demodulation circuit.
（２８）はディジタルローパスフィルタ、（３０）は手
動色相調整用の制御信号が印加される端子である。(28) is a digital low-pass filter, and (30) is a terminal to which a control signal for manual hue adjustment is applied.
（３４）は色相調整用（ティント用）の乗算器である。(34) is a multiplier for hue adjustment (tint).
（３６）は出力バッファ回路である。(36) is an output buffer circuit.
上記動作を説明する。The above operation will be explained.
Ｙ／Ｃ分離されたカラー信号は、まずカラーゲイン用の
乗算！（２４）ｌ二人力し、ＡＣＣがかけられるととも
に任意のカラーゲインとなるように乗算され、その後、
タロツクでラッチすることによりカラー復調され、ティ
ント用乗算器（３４）においてティントコントロール用
の乗算がおこなわれ出力されるようになっている。しか
しこの構成において、ＡＣＣとカラーゲイン用の乗算５
（２４）とティント用の乗算器（３４）の２つの乗算器
が必要である。The Y/C separated color signal is first multiplied for color gain! (24) Two people work together, apply ACC and multiply to an arbitrary color gain, then,
Color demodulation is performed by latching with tarok, multiplication for tint control is performed in a tint multiplier (34), and the resultant signal is output. However, in this configuration, the multiplication 5 for ACC and color gain is
Two multipliers are required: (24) and a multiplier for tinting (34).
（ハ）発明が解決しようとする課題
しかし、デジタル回路において乗算器は、素子数を多く
要するため、乗算器が２個必要なことはＴＣ化を図る場
合に不利である。(c) Problems to be Solved by the Invention However, since a multiplier in a digital circuit requires a large number of elements, the need for two multipliers is disadvantageous when implementing a TC.
本発明は、乗算器の数を減少せしめたカラー信号処理回
路を提供することを目的とする。SUMMARY OF THE INVENTION An object of the present invention is to provide a color signal processing circuit with a reduced number of multipliers.
（ニ）課題を解決するための手段
本発明は、ビデオ信号をＡ／Ｄコンバータ（１４）でサ
ンプリングクロックによりサンプリングしてデジタル信
号に変換し、このデジタル信号を処理するデジタルカラ
ーテレビジョン受信機に於いて、カラーゲインコントロ
ール用の乗算回路（３８）を時分割で色相コントロール
用の乗算回路として使用することを特徴とする。(d) Means for Solving the Problems The present invention provides a digital color television receiver that samples a video signal using a sampling clock using an A/D converter (14), converts it into a digital signal, and processes this digital signal. The present invention is characterized in that the multiplication circuit (38) for color gain control is used as a multiplication circuit for hue control in a time-sharing manner.
（ホ）作用
本発明では、１つの乗算器（３８）が時分割でカラーゲ
イン調整及びティント用の乗算の両方に使用出来る。(E) Function According to the present invention, one multiplier (38) can be used for both color gain adjustment and tint multiplication in a time-sharing manner.
（へ）実施例
第１図及び第２図を参照しつつ、本発明の一実施例を説
明する。尚、第３図と同一部分には同一符号を付した。(f) Embodiment An embodiment of the present invention will be described with reference to FIGS. 1 and 2. Note that the same parts as in FIG. 3 are given the same reference numerals.
（１６）はＹ／Ｃ分離回路であり、このＹ／Ｃ分離回路
（１６）のデジタルカラー信号出力は第２図に示す様に
ＩＱ信号であり、ＩＱ信号は色副搬送波Ｆｓｃで直角平
衡変調されている。つまり、４Ｆｓｃで映像信号をサン
プルした場合、このデジタルカラー信号は１ ｍ−１＋
Ｑｍ−１！ Ｉ ｍ−１，−Ｑｍ−１１１ａ＋ Ｑ
ａ＋−ｒ、、−Ｑ、、−１，。Ｉ、Ｑ ｍ＋１＋ −１
ｍ＋１＋ −Ｑ ＠＋１．・・・のデータ信号列であ
ると考えられる。(16) is a Y/C separation circuit, and the digital color signal output of this Y/C separation circuit (16) is an IQ signal as shown in Figure 2, and the IQ signal is quadrature balanced modulated with a color subcarrier Fsc. has been done. In other words, when a video signal is sampled at 4Fsc, this digital color signal is 1 m-1+
Qm-1! I m-1, -Qm-111a+ Q
a+-r,,-Q,,-1,. I, Q m+1+ -1
m+1+ -Q @+1. It is considered that the data signal sequence is...
（Ｓｔ）は入力切換えスイッチである。このスイッチの
端子（３２ａ）には当然第３図すの信号が印加され、端
子（３２ｂ）には第３図Ｃの信号が印加される。(St) is an input changeover switch. Naturally, the signal shown in FIG. 3 is applied to the terminal (32a) of this switch, and the signal shown in FIG. 3C is applied to the terminal (32b) of this switch.
スイッチ（５１）はサンプリングクロックに同期して制
御され、デジタルカラー信号り、−Ｉ、信号の内の一方
を抜き取る。又Ｑ、、−Ｑ、信号の内の一方を抜き取る
。このスイッチ（Ｓｌ）は、１．、−Ｑ。The switch (51) is controlled in synchronization with the sampling clock and extracts one of the digital color signals -I and -I. Also, one of the signals Q, , -Q, is extracted. This switch (Sl) is 1. ,-Q.
信号を抜き取って乗算器（３８）に入力する。又、この
スイッチ（Ｓｌ）は、残りの２データとして、端子（３
２ｂ）からのＡ、Ｉ、、−Ａ、Ｑ、信号を乗算器（３８
）に入力する。つまり、乗算器（３８）には第３図ｄの
信号が入力される。The signal is extracted and input to a multiplier (38). This switch (Sl) also outputs the terminal (3) as the remaining 2 data.
2b) A, I, , -A, Q, signals from the multiplier (38
). That is, the signal shown in FIG. 3d is input to the multiplier (38).
又、スイッチ（Ｓ２）は乗算値入力用のスイッチであり
、第３図ｅの信号を乗算！（３８）に入力する。Also, the switch (S2) is a switch for inputting a multiplication value, and the signal shown in Fig. 3e is multiplied! Enter in (38).
ここで（Ａ１）はゲインコントロール用の乗算値であり
、ＡＨ，Ａ−’ はティントコントロール用の乗算値で
ある。乗算器（３８）には第３図ｄの信号がデータとし
て入力され、第３図ｅの信号が乗算値（係数）として入
力されて、第３図ｆの信号を出力する。Here, (A1) is a multiplication value for gain control, and AH, A-' are multiplication values for tint control. The multiplier (38) receives the signal shown in FIG. 3 d as data, receives the signal shown in FIG. 3 e as a multiplication value (coefficient), and outputs the signal shown in FIG. 3 f.
（４０）は乗算器（３８）の出力をラッチするカラー信
号抜き取り回路である。このカラー信号抜き取り回路（
４０）は第３図ｇのタイミングの信号で乗算器（３８）
からの信号をラッチして、第３図りの信号を出力する。(40) is a color signal extraction circuit that latches the output of the multiplier (38). This color signal extraction circuit (
40) is the signal with the timing shown in Figure 3 g, and the multiplier (38)
It latches the signal from and outputs the signal shown in the third diagram.
（２６）はカラー復調回路であり、カラー信号抜き取り
回路（４０）からの第３図りの信号を夫々、第３図１．
Ｊの信号でラッチして第３図に、ｉに示す１、Ｑ信号を
出力する。(26) is a color demodulation circuit, which receives the signals shown in FIG. 3 from the color signal extracting circuit (40), respectively.
It latches with the J signal and outputs the 1 and Q signals shown at i in FIG.
（２８）はローパスフィルタである。（４２）は夫々の
１．０信号を第３図ｍの信号により時分割多重するＩ／
Ｑ信号ＭＰＸ回路であり、この回路（４２）は第３図Ｃ
の信号を出力する。この回路（４２）の出力Ｃは前述の
スイッチ（Ｓｌ）の端子（３２ｂ）に印加される。(28) is a low-pass filter. (42) is an I/O signal that time-division multiplexes each 1.0 signal with the signal in Figure 3 m.
This is a Q signal MPX circuit, and this circuit (42) is shown in Fig. 3C.
Outputs the signal. The output C of this circuit (42) is applied to the terminal (32b) of the aforementioned switch (Sl).
この信号成分は乗算器（３８）でティントコントロール
用の係数（Ａり（Ａ、″）で乗算された後に、乗算器（
３８）より出力される。This signal component is multiplied by a tint control coefficient (A,'') in a multiplier (38), and then multiplied by a coefficient (A,'') for tint control.
38).
（４４）は復調され且つティントコントロール用の係数
（Ａ２）（Ａ２’）が乗算されたＩＱ信号を抜き取る復
調カラー信号抜き取り回路である。この回路（４４）は
乗算器（３８）の出力ｆが入力され、第３図ｍに示すク
ロック信号により、この入力をラッチして、第３図Ｏに
示すティントコントロール済の復調カラー信号を出力す
る。(44) is a demodulated color signal extraction circuit which extracts the demodulated IQ signal multiplied by the coefficients (A2) (A2') for tint control. This circuit (44) receives the output f of the multiplier (38), latches this input using the clock signal shown in FIG. 3m, and outputs the tint-controlled demodulated color signal shown in FIG. 3O. do.
まず、動作を説明する。Ｉ、Ｑ信号はｆｓｃで直角平衡
変調されているがこれは第２図すの様に１ 、、Ｑ、、
−Ｉ 、、 −Ｑ□・・・の信号列となっていると考
えられる。このため、４つのサンプルデータの内２つの
サンプルデータでカラー復調可能である。又、復調され
たカラー信号１． Ｑ信号は、ともに約ｔ、ｓＭＨｚ以
下に帯域制限されているために、夫々を３．５８Ｍ Ｈ
ｚ （ｆ ｓｃ ）のクロックでサンプリングす るこ
とによりサンプリング定理を充たす信号を得ることがで
きる。First, the operation will be explained. The I and Q signals are quadrature balanced modulated by fsc, which is 1, , Q, , as shown in Figure 2.
It is thought that the signal sequence is -I, -Q□... Therefore, color demodulation is possible with two of the four sample data. Also, the demodulated color signal 1. Since both Q signals are band-limited to approximately t and sMHz or less, each is 3.58MHz.
By sampling with the clock of z (f sc ), a signal satisfying the sampling theorem can be obtained.
つまり、入力されたビデオ信号はＡ／Ｄ変換器（１４）
で４ｆｓｃでサンプリングされてデジタルビデオ信号と
なる。そして、Ｙ／Ｃ分離回路（１６）で輝度信号と分
離される。デジタルカラー信号は、乗算器（３８）でカ
ラーゲイン用の係数（Ａ１）が乗算される。In other words, the input video signal is sent to the A/D converter (14)
The video signal is sampled at 4 fsc to become a digital video signal. Then, it is separated from the luminance signal by a Y/C separation circuit (16). The digital color signal is multiplied by a color gain coefficient (A1) in a multiplier (38).
そして、乗算器（３８）は第２図ｆの信号を出力する。The multiplier (38) then outputs the signal shown in FIG. 2f.
この出力信号は、カラー信号抜き取り回路（４０）によ
りカラーゲインコントロールされたデジタルカラー信号
のみを抜き取り、第２図りの信号を出力する。カラー復
調回路（２６）はこの信号りを夫々第２図ｉ、ｊのタイ
ミングのタロツクでラッチしてＩＱ倍信号第２図に、
ｉ、）の復調をする。From this output signal, only the digital color signal whose color gain has been controlled is extracted by the color signal extraction circuit (40), and the signal shown in the second diagram is output. The color demodulation circuit (26) latches this signal with the tarlocks at the timings i and j in FIG. 2, respectively, and outputs the IQ multiplied signal as shown in FIG.
i,) is demodulated.
この信号に、ｌはローパスフィルタ（２８）を通った後
、多重されて第２図Ｃの信号となり、再びスイッチ（Ｓ
ｌ）に入力される。This signal, l, passes through a low-pass filter (28) and is multiplexed to become the signal shown in Figure 2C, which is then re-switched (S
l).
この復調済のカラー信号Ｃは乗算！（３８）でティント
コントロール用の係数（Ａｌ）（Ａｔ’）が乗算されて
出力される。そして、この信号（Ａ＋Ａ＊ Ｉｎ）（−
Ａ＋Ａ、’Ｑｎ、）のみを復調カラー信号抜き取り回路
（４４）で取り出して第２図Ｏの信号を出力する。This demodulated color signal C is multiplied! In (38), the coefficients (Al) (At') for tint control are multiplied and output. And this signal (A+A*In)(-
A+A,'Qn,) is extracted by the demodulated color signal extraction circuit (44) and outputted as the signal shown in FIG. 2O.
この信号は、カラーゲイン及びティントの調整済の信号
である。This signal is a color gain and tint adjusted signal.
（ト）発明の効果
上記の如く、本発明に依れば、カラーゲインと、ティン
トコントロール用の乗算処理を１つの乗算器（３８）で
行なえる。(g) Effects of the Invention As described above, according to the present invention, multiplication processing for color gain and tint control can be performed by one multiplier (38).
第１図は本発明の一実施例を示す図、第２図はその各部
の波形図である。
第３図は従来例を示す図である。
（１４）・・・Ａ／Ｄ変換器（Ａ／Ｄコンバータ）、（
３８）・・・乗算器（乗算回路）。FIG. 1 is a diagram showing an embodiment of the present invention, and FIG. 2 is a waveform diagram of each part thereof. FIG. 3 is a diagram showing a conventional example. (14)...A/D converter (A/D converter), (
38) Multiplier (multiplication circuit).
Claims (1)
リングクロックによりサンプリングしてデジタル信号に
変換し、このデジタル信号を処理するデジタルカラーテ
レビジョン受信機に於いて、カラーゲインコントロール
用の乗算回路（３８）を時分割で色相コントロール用の
乗算回路として使用することを特徴とするデジタルカラ
ーテレビジョン受信機のカラー信号処理回路。(1) In a digital color television receiver that samples a video signal using a sampling clock using an A/D converter (14) and converts it into a digital signal, and processes this digital signal, a multiplication circuit for color gain control ( A color signal processing circuit for a digital color television receiver, characterized in that 38) is used as a multiplication circuit for time-division hue control.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1032002A JPH02211789A (en) | 1989-02-10 | 1989-02-10 | Color signal processing circuit of digital color television receiver |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1032002A JPH02211789A (en) | 1989-02-10 | 1989-02-10 | Color signal processing circuit of digital color television receiver |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02211789A true JPH02211789A (en) | 1990-08-23 |
Family
ID=12346691
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1032002A Pending JPH02211789A (en) | 1989-02-10 | 1989-02-10 | Color signal processing circuit of digital color television receiver |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02211789A (en) |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60197087A (en) * | 1984-03-21 | 1985-10-05 | Toshiba Corp | Processing circuit of chrominance signal |
| JPS60207189A (en) * | 1984-03-31 | 1985-10-18 | 株式会社東芝 | Image signal processor |
| JPS6120482A (en) * | 1984-07-06 | 1986-01-29 | Matsushita Electric Ind Co Ltd | Color saturation and hue adjusting circuit |
| JPS61131993A (en) * | 1984-11-30 | 1986-06-19 | Nec Home Electronics Ltd | Chrominance signal adjuster |
-
1989
- 1989-02-10 JP JP1032002A patent/JPH02211789A/en active Pending
Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
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