JPH02138930U - - Google Patents
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- Publication number
- JPH02138930U JPH02138930U JP4831489U JP4831489U JPH02138930U JP H02138930 U JPH02138930 U JP H02138930U JP 4831489 U JP4831489 U JP 4831489U JP 4831489 U JP4831489 U JP 4831489U JP H02138930 U JPH02138930 U JP H02138930U
- Authority
- JP
- Japan
- Prior art keywords
- pll
- output signal
- superimposed
- noise level
- level
- Prior art date
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- Pending
Links
- 238000001514 detection method Methods 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Description
第１図及び第２図はこの考案に係るＰＬＬのロ
ツク検出回路の実施例を示し、第１図は回路図、
第２図は各部の電圧レベルの関係を示す図である
。第３図は従来の実施例を示す回路図である。 主な符号の説明、１……コンパレータ、２……
第１のオペアンプ、１０……第１の電源、４……
第２のオペアンプ、２０……第２の電源、６……
出力端子、７，８……ダイオード、９……位相比
較器。
ツク検出回路の実施例を示し、第１図は回路図、
第２図は各部の電圧レベルの関係を示す図である
。第３図は従来の実施例を示す回路図である。 主な符号の説明、１……コンパレータ、２……
第１のオペアンプ、１０……第１の電源、４……
第２のオペアンプ、２０……第２の電源、６……
出力端子、７，８……ダイオード、９……位相比
較器。
Claims (1)
- 【実用新案登録請求の範囲】 位相比較器の出力信号には雑音レベルが重畳さ
れ、この出力信号をウインドコンパレータに導び
いてＰＬＬのロツクを検出するようにしたＰＬＬ
のロツク検出回路において、 前記ウインドコンパレータの上限の設定電圧を
前記雑音レベルが重畳された出力信号の上限レベ
ルよりも高く設定し、下限の設定電圧は雑音レベ
ルが重畳された出力信号の下限レベルよりも低く
設定するように構成したことを特徴とするＰＬＬ
のロツク検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4831489U JPH02138930U (ja) | 1989-04-26 | 1989-04-26 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4831489U JPH02138930U (ja) | 1989-04-26 | 1989-04-26 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02138930U true JPH02138930U (ja) | 1990-11-20 |
Family
ID=31565012
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4831489U Pending JPH02138930U (ja) | 1989-04-26 | 1989-04-26 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02138930U (ja) |
-
1989
- 1989-04-26 JP JP4831489U patent/JPH02138930U/ja active Pending