JPH0212672B2 - - Google Patents

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JPH0212672B2
JPH0212672B2 JP58243100A JP24310083A JPH0212672B2 JP H0212672 B2 JPH0212672 B2 JP H0212672B2 JP 58243100 A JP58243100 A JP 58243100A JP 24310083 A JP24310083 A JP 24310083A JP H0212672 B2 JPH0212672 B2 JP H0212672B2
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JP
Japan
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circuit
output
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current
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Makoto Makino
Akihiro Sato
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    • BPERFORMING OPERATIONS; TRANSPORTING
    • B23MACHINE TOOLS; METAL-WORKING NOT OTHERWISE PROVIDED FOR
    • B23KSOLDERING OR UNSOLDERING; WELDING; CLADDING OR PLATING BY SOLDERING OR WELDING; CUTTING BY APPLYING HEAT LOCALLY, e.g. FLAME CUTTING; WORKING BY LASER BEAM
    • B23K11/00Resistance welding; Severing by resistance heating
    • B23K11/24Electric supply or control circuits therefor
    • B23K11/25Monitoring devices

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  • Engineering & Computer Science (AREA)
  • Mechanical Engineering (AREA)
  • Inverter Devices (AREA)

Description

【発明の詳細な説明】 本発明は、溶接電流を設定した実効値に制御す
る抵抗溶接機の定電流制御回路に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a constant current control circuit for a resistance welding machine that controls welding current to a set effective value.

従来、電源をインバータを介して溶接ガンに接
続した抵抗溶接機において、インバータの電流制
御素子として主にサイリスタが使用されている
が、該素子をオンにする(トリガする)タイミン
グを変え、導通角を制御することにより溶接電流
を制御していた。
Conventionally, in resistance welding machines where the power source is connected to the welding gun via an inverter, a thyristor is mainly used as the inverter's current control element. The welding current was controlled by controlling the .

したがつて、溶接電流を所定の実効値に制御す
るためには、一つかあるいはそれ以上前のサイク
ルの溶接電流をサンプルホールドし、そのサンプ
ルホールド値をフイードバツクして次のサイクル
の点弧角を決定していた。
Therefore, in order to control the welding current to a predetermined effective value, the welding current of one or more previous cycles is sampled and held, and the sample and hold value is fed back to determine the firing angle of the next cycle. It had been decided.

かくてそのサイクルにおいて電源電圧、溶接負
荷等が変化したとき、その影響がそのまゝ溶接電
流の変化となつて現われるから、精度上限界があ
る等の不都合があつた。
Thus, when the power supply voltage, welding load, etc. change during the cycle, the effect appears as a change in the welding current, resulting in disadvantages such as a limit in terms of accuracy.

本発明は、かかる不都合を無くすことをその目
的としたもので、電源回路をインバータを介して
溶接ガンに接続した抵抗溶接機において、前記接
続回路に介入された電流検出器と、該検出器に接
続され該接続回路に流れる電流の実効値又は実効
値に対応する値を算出する演算回路と、実効値設
定回路と、該演算回路の出力と該実効値設定回路
により設定された設定値とを比較し、該出力が設
定値と一致した時出力信号を発生する比較回路
と、最大パルス幅設定器、該設定器の出力を積分
する積分器及び前記実効値設定回路で設定された
設定値と該積分器の出力とを比較し、該積分器の
出力が該設定値と一致したとき出力信号を発生す
る比較回路から成るインバータ素子最大通電パル
ス幅設定回路と、過電流設定器及び該設定器の出
力と前記電流検出器の出力とを比較し、該電流検
出器の出力が該設定器の出力と一致したとき出力
信号を発生する比較器から成る過電流設定回路
と、前記インバータに接続されインバータを制御
するパルス幅制御回路とを備え、該パルス幅制御
回路は、前記実効値設定回路に接続された比較回
路及び前記最大通電パルス幅設定回路の比較回路
が発生する出力信号により、また前記過電流設定
回路の比較回路に接続されたラツチ回路の出力信
号により前記接続回路に流れる電流を遮断するよ
うに構成されたことを特徴とする。
The present invention aims to eliminate such inconveniences, and provides a resistance welding machine in which a power supply circuit is connected to a welding gun via an inverter. An arithmetic circuit that calculates the effective value or a value corresponding to the effective value of the current connected to the connected circuit, an effective value setting circuit, and an output of the arithmetic circuit and a setting value set by the effective value setting circuit. a comparison circuit that generates an output signal when the output matches a set value, a maximum pulse width setter, an integrator that integrates the output of the setter, and the set value set by the effective value setting circuit. an inverter element maximum energization pulse width setting circuit comprising a comparison circuit that compares the output of the integrator and generates an output signal when the output of the integrator matches the set value; an overcurrent setting device; and the setting device. an overcurrent setting circuit connected to the inverter, comprising a comparator that compares the output of the current detector with the output of the current detector and generates an output signal when the output of the current detector matches the output of the setting device; a pulse width control circuit for controlling an inverter, and the pulse width control circuit is configured to control an inverter by an output signal generated by a comparison circuit connected to the effective value setting circuit and a comparison circuit of the maximum energization pulse width setting circuit; The present invention is characterized in that the current flowing through the connection circuit is cut off by an output signal of a latch circuit connected to a comparison circuit of the overcurrent setting circuit.

以下本発明の実施例を図面につき説明する。 Embodiments of the present invention will be described below with reference to the drawings.

第1図は本発明の一実施例のブロツク図を示
す。同図において、1は電源回路で、該電源回路
1は、商用電源端子2に接続された整流回路3と
平滑回路4とから成る。5はトランジスタなどに
より構成されたインバータで、該インバータ5の
交流出力を溶接トランス6及び整流回路7を介し
て溶接ガン8に加えるようにした。
FIG. 1 shows a block diagram of one embodiment of the invention. In the figure, reference numeral 1 denotes a power supply circuit, and the power supply circuit 1 includes a rectifier circuit 3 and a smoothing circuit 4 connected to a commercial power supply terminal 2. Reference numeral 5 denotes an inverter composed of transistors, etc., and the AC output of the inverter 5 is applied to the welding gun 8 via a welding transformer 6 and a rectifier circuit 7.

該電源回路1をインバータ5を介して溶接ガン
8に接続する接続回路におけるインバータ5の入
力回路(又は溶接トランス6の2次回路)には変
流器等の電流検出器9を介入した。
A current detector 9 such as a current transformer is inserted into the input circuit of the inverter 5 (or the secondary circuit of the welding transformer 6) in the connection circuit that connects the power supply circuit 1 to the welding gun 8 via the inverter 5.

10は、該電流検出器9に接続された二乗器1
1及び積分器12からなり、前記接続回路を流れ
る電流の実効値に対応する値を算出する演算回
路、13は実効値設定回路で、該回路13は電流
設定器14と二乗器15とオーバーシユート補正
回路16とからなり、電流設定器14で設定した
電流の実効値に対応する値を出力するようにし
た。
10 is a squarer 1 connected to the current detector 9
1 and an integrator 12, which calculates a value corresponding to the effective value of the current flowing through the connection circuit; 13 is an effective value setting circuit; The output correction circuit 16 is configured to output a value corresponding to the effective value of the current set by the current setting device 14.

該実効値設定回路13を演算回路10と共に比
較器17に接続し、演算回路10の出力が実効値
設定回路13の出力と一致したとき出力信号を発
生する比較回路を構成した。
The effective value setting circuit 13 and the arithmetic circuit 10 were connected to a comparator 17 to form a comparison circuit that generates an output signal when the output of the arithmetic circuit 10 matches the output of the effective value setting circuit 13.

前記オーバーシユート補正回路16は例えばア
ツテネータから成り、接続回路に流れる電流が設
定値と一致したことを検出してからインバータ5
のトランジスタ51〜54をオフするまでの時間遅
れを補正するための回路である。この時間遅れは
電流値と相関関係があるので、正確な補正を行な
う場合はオーバーシユート補正回路6をアツテネ
ータ、差動増幅器等で構成し、該増幅器の一入力
端子を図の鎖線で示すように二乗器11に接続し
電流の二乗値も補正量の決定要素とする。
The overshoot correction circuit 16 is composed of, for example, an attenuator, and detects that the current flowing through the connected circuit matches a set value, and then controls the inverter 5.
This circuit is for correcting the time delay until the transistors 5 1 to 5 4 are turned off. Since this time delay has a correlation with the current value, in order to perform accurate correction, the overshoot correction circuit 6 should be configured with an attenuator, a differential amplifier, etc., and one input terminal of the amplifier should be connected as shown by the chain line in the figure. is connected to the squarer 11, and the square value of the current is also used as a determining factor for the correction amount.

また電流設定器14の代りに電流設定入力を二
乗器15に鎖線で示すように端子18から加える
ようにしてもよい。
Further, instead of the current setting device 14, the current setting input may be applied to the squarer 15 from the terminal 18 as shown by the chain line.

19はインバータ5の出力パルス幅を制御する
制御回路で、該回路19はNANDゲート20を
介して比較器17に接続されるパルス幅制御回路
21と発振器22とからなり、その出力をインバ
ータ5を構成するトランジスタ51,52,53
4のベースドライブ回路231,232,233
234に各接続し、パルス幅制御回路21に低レ
ベルの信号が入力しているときはインバータ5を
作動する高レベルの信号を出力し、高レベルの信
号が入力したときはインバータ5を不作動にして
電流を遮断する低レベルの信号を出力するように
した。同図において、24はインバータ5の作動
を確保するトランジスタ51〜54の最大通電パル
ス幅を設定する設定回路で、該設定回路24は最
大パルス幅設定器25と、積分器26と、該積分
器26の出力と二乗器15の出力Vref2を比較す
る比較器27とから成り、NANDゲート20を
介してパルス幅制御回路21に接続し、積分器2
0の出力が二乗器5の出力Vref2と一致し、設定
した最大パルス幅に達したとき出力する信号で該
パルス幅制御回路21を作動しインバータ5を不
作動にするようにした。28は過電流設定回路
で、該回路28は過電流設定器29とこの出力及
び電流検出器9の出力とを比較する比較器30と
からなり、ラツチ回路31を介してパルス幅制御
回路21に接続し、設定した過電流を超過したと
き出力する信号でパルス幅制御回路21を作動
し、インバータ5を不作動にしてトランジスタ5
〜54を保護するようにした。
19 is a control circuit for controlling the output pulse width of the inverter 5; Constituent transistors 5 1 , 5 2 , 5 3 ,
5 4 base drive circuits 23 1 , 23 2 , 23 3 ,
When a low level signal is input to the pulse width control circuit 21 , a high level signal is output that operates the inverter 5, and when a high level signal is input, the inverter 5 is disabled. It now outputs a low-level signal that activates and cuts off the current. In the figure, 24 is a setting circuit for setting the maximum energizing pulse width of the transistors 5 1 to 5 4 to ensure the operation of the inverter 5, and the setting circuit 24 includes a maximum pulse width setter 25, an integrator 26, and a It consists of a comparator 27 that compares the output of the integrator 26 and the output Vref 2 of the squarer 15, and is connected to the pulse width control circuit 21 via the NAND gate 20.
When the output of 0 matches the output Vref 2 of the squarer 5 and reaches the set maximum pulse width, the pulse width control circuit 21 is activated and the inverter 5 is deactivated by the signal output. Reference numeral 28 denotes an overcurrent setting circuit, which includes an overcurrent setting device 29 and a comparator 30 that compares the output of the overcurrent setting device 29 with the output of the current detector 9. When the set overcurrent is exceeded, the pulse width control circuit 21 is activated, the inverter 5 is deactivated, and the transistor 5 is activated.
1 to 5 4 are now protected.

第2図は前記パルス幅制御回路21の一例を示
す。同図において、32,33,34,35は、
それぞれANDゲート、36,37はフリツプフ
ロツプ、38はオアゲート、39はパルスで端
子の出力が短時間低レベルになる単安定マルチバ
イブレータで、同回路21は、発振器22の出力
パルスがANDゲート33に入力すると入力毎に
ANDゲート34及びANDゲート35から交互に
高レベルの信号が相互の間に短時間の低レベルの
期間を存して出力し、NANDゲート20の出力
が入力すると両ANDゲート34,35の出力が
共に低レベルになるように作動する。
FIG. 2 shows an example of the pulse width control circuit 21. In the same figure, 32, 33, 34, 35 are
36 and 37 are flip-flops, 38 is an OR gate, and 39 is a monostable multivibrator whose terminal output is at a low level for a short time with a pulse. Then for each input
High level signals are alternately output from the AND gates 34 and 35 with a short period of low level between them, and when the output of the NAND gate 20 is input, the outputs of both AND gates 34 and 35 are output. Both operate at low levels.

次に、第1図示の回路の作用について説明する
と、インバータ5が作動し、溶接ガン8に溶接電
流が供給されると、電流検出器9により接続回路
に流れる電流が検出され、演算回路10の二乗器
11から第3図Aに示すような該電流の二乗され
た電流が出力する。この電流は積分器12で積分
され、第3図Bに示すような波形の電圧を出力す
る。この電圧は接続回路に流れる電流の実効値に
対応するもので、比較器17において電流設定器
14で設定された電流値の実効値に対応する電圧
Vref1と比較され、この電圧Vref1と一致した時、
比較器17から第3図Dに示すように低レベルの
信号を出力する。
Next, to explain the operation of the circuit shown in the first diagram, when the inverter 5 is activated and welding current is supplied to the welding gun 8, the current flowing in the connecting circuit is detected by the current detector 9, and the arithmetic circuit 10 is activated. The squarer 11 outputs a current obtained by squaring the current as shown in FIG. 3A. This current is integrated by an integrator 12, and a voltage having a waveform as shown in FIG. 3B is output. This voltage corresponds to the effective value of the current flowing in the connected circuit, and is the voltage corresponding to the effective value of the current value set by the current setting device 14 in the comparator 17.
When it is compared with Vref 1 and matches this voltage Vref 1 ,
The comparator 17 outputs a low level signal as shown in FIG. 3D.

かくてこの信号はNANDゲート20を介して
パルス幅制御回路21を制御し、発振器22の出
力パルスと同期して立上り、インバータ5のトラ
ンジスタ51,52又は53,54に流れていたパル
ス電流はパルス幅制御回路21の出力が低レベル
になることにより遮断される。
Thus, this signal controlled the pulse width control circuit 21 via the NAND gate 20, rose in synchronization with the output pulse of the oscillator 22, and flowed to the transistors 5 1 , 5 2 or 5 3 , 5 4 of the inverter 5. The pulse current is cut off when the output of the pulse width control circuit 21 becomes low level.

前記電圧Vref1は前記したようにオーバーシユ
ート補正回路6により補正された値であるから、
第3図A,Bに示すように、接続回路に流れる電
流は積分器12の出力電圧がVref1と一致した時
点を経過してなお若干流れ続けても、電流が遮断
された時点で電流設定器14で設定した電流の実
効値になる。
Since the voltage Vref 1 is a value corrected by the overshoot correction circuit 6 as described above,
As shown in FIGS. 3A and 3B, even if the current flowing through the connection circuit continues to flow slightly after the point in time when the output voltage of the integrator 12 matches Vref 1 , the current setting stops when the current is cut off. This becomes the effective value of the current set by the device 14.

かくて第3図Aに示す二乗した電流波形、
、のように電源電圧、負荷抵抗の値に応じて
振幅が変化してもその各電流の実効値は設定値と
なる。
Thus, the squared current waveform shown in Figure 3A,
, even if the amplitude changes depending on the power supply voltage and the value of the load resistance, the effective value of each current remains the set value.

負荷インピーダンスが何等かの異常により特別
に高くなつて、第3図Aに示すように二乗した電
流波形の振幅が低下し、第3図Bに示すよう
に、積分器12の積分電圧が設定器24で設定し
たトランジスタ51〜54の最長通電パルス幅にな
つてもVref1に達しない時は、積分器26の出力
(第3図C)が二乗器15の出力Vref2と一致し、
比較器27より第3図Eに示すように低レベルの
信号を出力するから、この出力によりNANDゲ
ート20を介してパルス幅制御回路21が作動
し、電流が遮断される。
When the load impedance becomes particularly high due to some abnormality, the amplitude of the squared current waveform decreases as shown in FIG. 3A, and the integrated voltage of the integrator 12 decreases as shown in FIG. When Vref 1 is not reached even when the longest energizing pulse width of the transistors 5 1 to 5 4 set in 24 is reached, the output of the integrator 26 (FIG. 3C) matches the output Vref 2 of the squarer 15,
Since the comparator 27 outputs a low level signal as shown in FIG. 3E, this output activates the pulse width control circuit 21 via the NAND gate 20 and cuts off the current.

また、過負荷又は溶接ガンアームの短絡により
第3図Aに示すように、二乗した電流波形Vが過
電流検出レベルVref3を超過した時は、比較器3
0より第3図Fに示すように低レベルの信号を出
力するから、リセツトするまでラツチ回路31の
出力により通電は阻止される。尚、前記実施例で
は、演算回路10を二乗器11及び積分器12で
構成して電流の実効値に対応する値を算出するよ
うにしたが、実効値の定義から明らかなように、
更に平均化回路及び開平回路を設けて実効値を算
出するようにし、実効値設定回路13も同じよう
に構成してもよいことは勿論である。
In addition, when the squared current waveform V exceeds the overcurrent detection level Vref 3 as shown in FIG. 3A due to an overload or a short circuit in the welding gun arm, the comparator 3
0, a low level signal is output as shown in FIG. 3F, and therefore the output of the latch circuit 31 prevents current flow until reset. Incidentally, in the above embodiment, the arithmetic circuit 10 is configured with the squarer 11 and the integrator 12 to calculate the value corresponding to the effective value of the current, but as is clear from the definition of the effective value,
Of course, an averaging circuit and a square root circuit may be further provided to calculate the effective value, and the effective value setting circuit 13 may be configured in the same manner.

このように本発明によるときは、電源回路をイ
ンバータを介して溶接ガンに接続する回路に流れ
る電流の実効値又は実効値に対応する値を算出す
る演算回路を設け、その演算器の出力が設定値と
一致した時出力する信号によりパルス幅制御回路
を作動させ、インバータのトランジスタ等の素子
に流れる電流を遮断するようにしたので、電源及
び負荷の変動があつても正確に且つより高速に設
定した実効値に制御できる効果を有する。
In this way, according to the present invention, an arithmetic circuit is provided that calculates the effective value or a value corresponding to the effective value of the current flowing in the circuit that connects the power supply circuit to the welding gun via the inverter, and the output of the arithmetic unit is set. The pulse width control circuit is activated by the signal output when the value matches the value, and the current flowing through the inverter's transistors and other elements is cut off, so even if the power supply and load fluctuate, settings can be made more accurately and at higher speeds. It has the effect of being able to control the effective value.

また、インバータ素子最大通電パルス幅設定回
路の比較器が発生する出力信号及び過電流設定回
路に接続されたラツチ回路の出力信号によりパル
ス幅制御回路を作動させインバータの素子に流れ
る電流を遮断するようにしたので、負荷インピー
ダンスが何等かの異常により特別に高くなつて、
溶接電流が実効値設定回路により設定された実効
値に達しない場合でも、インバータの作動が確保
され、また溶接電流が過大になつてもインバータ
の素子が破損されることがないという効果があ
る。
In addition, the pulse width control circuit is operated by the output signal generated by the comparator of the inverter element maximum energization pulse width setting circuit and the output signal of the latch circuit connected to the overcurrent setting circuit to cut off the current flowing to the inverter elements. Therefore, if the load impedance becomes particularly high due to some abnormality,
Even when the welding current does not reach the effective value set by the effective value setting circuit, the operation of the inverter is ensured, and even if the welding current becomes excessive, the inverter elements are not damaged.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の一実施例のブロツク図、第2
図はその要部の回路図、第3図は、各部の波形を
示す図である。 1……電源回路、5……インバータ、8……溶
接ガン、10……演算回路、13……実効値設定
回路、17……比較器、19……制御回路、21
……パルス幅制御回路、22……発振器、231
〜234……ベースドライブ回路、24……設定
回路、27……比較器、28……過電流設定回
路。
FIG. 1 is a block diagram of one embodiment of the present invention, and FIG.
The figure is a circuit diagram of the main part thereof, and FIG. 3 is a diagram showing waveforms of each part. DESCRIPTION OF SYMBOLS 1... Power supply circuit, 5... Inverter, 8... Welding gun, 10... Arithmetic circuit, 13... Effective value setting circuit, 17... Comparator, 19... Control circuit, 21
... Pulse width control circuit, 22 ... Oscillator, 23 1
~23 4 ...Base drive circuit, 24...Setting circuit, 27...Comparator, 28...Overcurrent setting circuit.

Claims (1)

【特許請求の範囲】[Claims] 1 電源回路をインバータを介して溶接ガンに接
続した抵抗溶接機において、前記接続回路に介入
された電流検出器と、該検出器に接続され該接続
回路に流れる電流の実効値又は実効値に対応する
値を算出する演算回路と、実効値設定回路と、該
演算回路の出力と該実効値設定回路により設定さ
れた設定値とを比較し、該出力が設定値と一致し
た時出力信号を発生する比較回路と、最大パルス
幅設定器、該設定器の出力を積分する積分器及び
前記実効値設定回路で設定された設定値と該積分
器の出力とを比較し、該積分器の出力が該設定値
と一致したとき出力信号を発生する比較回路から
成るインバータ素子最大通電パルス幅設定回路
と、過電流設定器及び該設定器の出力と前記電流
検出器の出力とを比較し、該電流検出器の出力が
該設定器の出力と一致したとき出力信号を発生す
る比較器から成る過電流設定回路と、前記インバ
ータに接続されインバータを制御するパルス幅制
御回路とを備え、該パルス幅制御回路は、前記実
効値設定回路に接続された比較回路及び前記最大
通電パルス幅設定回路の比較回路が発生する出力
信号により、また前記過電流設定回路の比較回路
に接続されたラツチ回路の出力信号により前記接
続回路に流れる電流を遮断するように構成された
ことを特徴とする抵抗溶接機の定電流制御装置。
1. In a resistance welding machine in which a power supply circuit is connected to a welding gun via an inverter, a current detector inserted into the connection circuit and the effective value or effective value of the current connected to the detector and flowing through the connection circuit. An arithmetic circuit that calculates the value to be set, an effective value setting circuit, and an output signal that compares the output of the arithmetic circuit and the set value set by the effective value setting circuit, and generates an output signal when the output matches the set value. The output of the integrator is compared with the setting value set by the maximum pulse width setting device, the integrator that integrates the output of the setting device, and the effective value setting circuit, and the output of the integrator is An inverter element maximum energization pulse width setting circuit consisting of a comparison circuit that generates an output signal when the set value matches the overcurrent setting device, and the output of the setting device and the output of the current detector are compared, and the current an overcurrent setting circuit comprising a comparator that generates an output signal when the output of the detector matches the output of the setting device; and a pulse width control circuit connected to the inverter and controlling the inverter, the pulse width control circuit comprising: The circuit is activated by the output signals generated by the comparison circuit connected to the effective value setting circuit and the comparison circuit of the maximum energization pulse width setting circuit, and by the output signal of the latch circuit connected to the comparison circuit of the overcurrent setting circuit. A constant current control device for a resistance welding machine, characterized in that the constant current control device is configured to interrupt the current flowing through the connection circuit.
JP58243100A 1983-12-24 1983-12-24 Constant current control circuit of resistance welding machine Granted JPS60137582A (en)

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