JPH0198162A - Optical card recording information read device - Google Patents
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Abstract
Description
【発明の詳細な説明】
〈産業上の利用分野〉
この発明は、情報を光学的に記録できるカード状の記録
媒体(以下「光カード」という)につき、°情報記録ト
ラックに記録された情報を読み取るのに使用される光カ
ード記録情報読取装置に関する。[Detailed Description of the Invention] <Industrial Application Field> The present invention relates to a card-shaped recording medium (hereinafter referred to as an "optical card") in which information can be optically recorded. The present invention relates to an optical card recording information reading device used for reading information.
〈従来の技術〉
従来の光カード処理装置は、カードホルダの上方位置に
光学ヘッドを位置させ、このホルダと一体に光カードを
往復移動させることにより、光学ヘッドで光カードを走
査して記録情報を読み取るものである。この光カードの
表面には、第13図に示す如く、多数の情報記録トラッ
ク72を有する情報記録部71が設けてあり、これら情
報記録トラック72へ前記光学ヘッドにより光ビームを
照射することにより、光カード7に対する情報の記録や
再生が行われる。なお図中、73は光学ヘッドを情報記
録トラック72に追随させるためのトラックガイドであ
り、74は情報記録トラック72に形成された情報単位
を構成するピットである。<Prior Art> In a conventional optical card processing device, an optical head is positioned above a card holder, and the optical card is moved back and forth together with the holder, thereby scanning the optical card with the optical head and recording information. It is for reading. As shown in FIG. 13, an information recording section 71 having a large number of information recording tracks 72 is provided on the surface of this optical card, and by irradiating these information recording tracks 72 with a light beam from the optical head, Information is recorded on and reproduced from the optical card 7. In the figure, 73 is a track guide for causing the optical head to follow the information recording track 72, and 74 is a pit forming an information unit formed on the information recording track 72.
各情報記録トラック72は、いくつかのセクタに分かれ
、各セクタには第14図に示す如く、シンクパターン、
ヘッダバタン、データの順に情報が書き込んである。シ
ンクパターンはこの情報の読取信号と光カード記録情報
読取装置を構成する回路との同期をとるためのもので、
各セクタの先頭位置に数バイトにわたり連続して記録さ
れる。ヘッダバタンはデータの先頭を示すための8また
は16ビツト構成のものであうで、それ以降にデータが
続いている。Each information recording track 72 is divided into several sectors, and each sector has a sync pattern, as shown in FIG.
Information is written in the order of header button and data. The sync pattern is used to synchronize this information reading signal with the circuits that make up the optical card recording information reading device.
It is recorded continuously over several bytes at the beginning of each sector. The header button may be of 8 or 16 bits to indicate the beginning of the data, and the data follows.
前記ホルダが往復動作を開始すると、光カード7は光学
ヘッドに対し相対的に移動することになる。この光学ヘ
ッドが情報記録トラック72を走査して、あるセクタの
シンクパタン記録領域に入ると、光カード記録情報読取
装置では同期の開始を指令するシンク指令a (第14
図(1)参照)が生成される。続いて光学ヘッドがヘッ
ダバタンを検出すると、ヘッダ検出信号b(第14図(
2)参照)が出力され、光カード記録情報装置のデータ
リード回路がこの信号を入力すると、データの読取動作
を開始し、データ終了に至るまでデータ読取を継続する
。この場合に各セクタに記録されるデータのバイト数は
既知であるから、読み取ったデータの個数を計数し、そ
の計数値が既知の値に達したときにデータ読取動作を終
了させる。When the holder starts reciprocating, the optical card 7 will move relative to the optical head. When this optical head scans the information recording track 72 and enters the sync pattern recording area of a certain sector, the optical card recorded information reading device receives a sync command a (14th
(see Figure (1)) is generated. Next, when the optical head detects the header bang, the header detection signal b (Fig. 14 (
2)) is output, and when the data read circuit of the optical card recording information device receives this signal, it starts the data reading operation and continues reading the data until the end of the data. In this case, since the number of bytes of data recorded in each sector is known, the number of read data is counted, and when the counted value reaches a known value, the data reading operation is terminated.
〈発明が解決しようとする問題点〉
第15図は、ひとつの情報記録トラックに複数個のセク
タの情報が記録されている状態を示している。この情報
記録トランクより複数のセクタの情報を連続して読み取
る場合において、いま第2セクタで正規のヘッダパター
ンを検出できず、しかも第2セクタのデータ中のパター
ンをヘッダパターンとして誤って検出したとき、データ
リード回路はそれ以降の所定バイト数をデータとして読
み取ることになる。その結果、第2セクタと第3セクタ
とにまたがってデータの読取が行われることになり、第
2セクタのデータの読取に失敗するだけでなく、第3セ
クタのデータの読取まで失敗してしまうという問題があ
る。<Problems to be Solved by the Invention> FIG. 15 shows a state in which information of a plurality of sectors is recorded on one information recording track. When reading information in multiple sectors continuously from this information recording trunk, if a regular header pattern cannot be detected in the second sector, and the pattern in the data in the second sector is mistakenly detected as a header pattern. , the data read circuit reads the subsequent predetermined number of bytes as data. As a result, data is read across the second and third sectors, and not only does it fail to read the data in the second sector, but it also fails to read the data in the third sector. There is a problem.
この発明は、上記問題に着目してなされたもので、各セ
クタのデータの先頭を検出する動作に制限を加えること
によって、データ読取の失敗範囲を最小限度に止めるこ
とのできる新規な光カード記録情報読取装置を提供する
ことを目的とする。This invention was made with attention to the above problem, and is a novel optical card recording system that can minimize the range of data reading failures by placing restrictions on the operation of detecting the beginning of data in each sector. The purpose is to provide an information reading device.
く問題点を解決するための手段〉
上記目的を達成するため、この発明では、光カードの情
報記録トラックに記録されたセクタ毎の各情報を読み取
るための光カード記録情報読取装置において、各セクタ
に記録されたデータの先頭を検出するための先頭検出部
と、先頭検出部による検出動作を各セクタの先頭から所
定区間だけ許可するための検出許可部とを具備させてい
る。Means for Solving Problems> In order to achieve the above object, the present invention provides an optical card recorded information reading device for reading each sector of information recorded on an information recording track of an optical card. The sector is provided with a start detection section for detecting the start of data recorded in the sector, and a detection permission section for permitting the detection operation by the start detection section only in a predetermined section from the start of each sector.
〈作用〉
複数のセクタの情報を連続して読み取る場合において、
仮に先頭検出部があるセクタの記録データの先頭を検出
しないときでも、この先頭検出動作は各セクタの先頭か
ら所定区間だけ許可されているのみであるから、そのセ
クタのデータ途中でデータの先頭を誤って検出するよう
なことはない、従ってデータの先頭の検出ミスがあった
セクタについてデータの読取が困難となるのみで、他の
セクタのデータ読取に何等影響しないから、データ読取
の失敗範囲を最小限度に止めることができる。<Operation> When reading information from multiple sectors continuously,
Even if the head detector does not detect the head of recorded data in a certain sector, this head detection operation is only permitted for a predetermined period from the head of each sector, so if the head detector does not detect the head of the data in the middle of the data in that sector, There is no possibility of false detection. Therefore, it will only be difficult to read the data in the sector where the detection error at the beginning of the data occurred, and it will not affect the data reading of other sectors. It can be kept to a minimum.
〈実施例〉
第2図および第3図は、この発明の光カード記録情報読
取装置が適用実施された光カード処理装置の一例を示す
。<Embodiment> FIGS. 2 and 3 show an example of an optical card processing device to which the optical card recorded information reading device of the present invention is applied.
この光カード処理装置は、カード挿入口11を有するケ
ース1内に2本のガイド軸13.13を平行配備してガ
イド機構12を構成し、このガイド機構12にホルダ2
を往復動可能に支持すると共に、ホルダ移行路の下方に
対応してカード挿入側に光学へフド6を、奥側にカード
送り機構5を、それぞれ配設している。In this optical card processing device, a guide mechanism 12 is constructed by disposing two guide shafts 13.13 in parallel in a case 1 having a card insertion slot 11, and a holder 2 is attached to the guide mechanism 12.
An optical cover 6 is disposed on the card insertion side and a card feeding mechanism 5 is disposed on the back side corresponding to the lower part of the holder transition path.
ホルダ2は、両側辺に軸受21を設けてガイド軸13に
軸承される。このホルダ2の下面には、カード保持部2
2が形成されており、このカード保持部22は、ケース
1のカード挿入口11の位置に合わせである。The holder 2 is supported by the guide shaft 13 with bearings 21 provided on both sides. On the bottom surface of this holder 2, there is a card holding section 2.
2 is formed, and this card holding portion 22 is aligned with the position of the card insertion slot 11 of the case 1.
カード挿入口11の内側には、挿入された光カード7を
検知するための検知器31と、この検知器31の動作に
て作動して光カード7をホルダ2のカード保持部22に
対し自動的に搬出入させるカードロード/イジェクト機
構3とが設けである。Inside the card insertion slot 11, there is a detector 31 for detecting the inserted optical card 7, and the detector 31 operates to automatically insert the optical card 7 into the card holder 22 of the holder 2. A card loading/ejecting mechanism 3 is provided for loading and unloading the card.
カードロード/イジェクト機構3は、ホルダ2の下方に
位置し、回転軸32上に左右一対のローディングカム3
3.33を配備すると共に、回転軸32をプーリ、ベル
トからなる減速機構36を介してローディングモータ3
7に連繋して構成される。前記ローディングカム33は
、ゴム材からなる略半円形のカムであって、平坦カム面
34が回転軸32の上側に水平に位置したとき、ホルダ
2の下面に非接触で近接するように取り付けられている
。かくてローディングモータ37の作動によりローディ
ングカム33が回転するとき、球形カム面35が対向す
る光カード7をカード保持部22の定位置まで搬入し、
再び平坦カム面34がホルダ2に対向してモータ37が
停止する。The card loading/ejecting mechanism 3 is located below the holder 2 and has a pair of left and right loading cams 3 on a rotating shaft 32.
3.33 is installed, and the rotating shaft 32 is connected to the loading motor 3 via a speed reduction mechanism 36 consisting of a pulley and a belt.
It is constructed by connecting to 7. The loading cam 33 is a substantially semicircular cam made of a rubber material, and is attached so as to be close to the lower surface of the holder 2 without contacting it when the flat cam surface 34 is positioned horizontally above the rotating shaft 32. ing. In this way, when the loading cam 33 rotates due to the operation of the loading motor 37, the optical card 7 with the spherical cam surface 35 facing is carried into the fixed position of the card holding part 22,
The flat cam surface 34 faces the holder 2 again and the motor 37 stops.
ホルダ2の後辺には、ホルダ2の移行方向と直角をなす
ガイド軸23を設けてスライド部材24を軸承し、この
スライド部材24をカード送り機構5に連繋している。A guide shaft 23 that is perpendicular to the direction of movement of the holder 2 is provided on the rear side of the holder 2 to support a slide member 24, and the slide member 24 is linked to the card feeding mechanism 5.
カード送り機構5は、ケース41内の固定フレーム50
に2本の支軸51を軸承配備し、両支軸51にそれぞれ
プーリ52.53を軸止して無端ベルト45を捲回張設
し、この無端ベルト54の適所に連結ピン55を縦設し
て、このピン55を前記スライド部材24に担止連結し
ている。一方の支軸51の下部にはプーリ56が軸固定
され、このプーリ56にベルト等の伝動手段57を介し
て一方向回転の駆動モータ58を連繋すると共に、他方
の支軸51にはエンコーダ59を取り付けている。The card feeding mechanism 5 is connected to a fixed frame 50 inside the case 41.
Two support shafts 51 are provided as bearings, pulleys 52 and 53 are respectively fixed to both support shafts 51, and an endless belt 45 is wound and tensioned, and a connecting pin 55 is vertically installed at a suitable position on the endless belt 54. This pin 55 is supported and connected to the slide member 24. A pulley 56 is fixed to the lower part of one of the support shafts 51, and a drive motor 58 that rotates in one direction is connected to this pulley 56 via a transmission means 57 such as a belt, and an encoder 59 is connected to the other support shaft 51. is installed.
光学ヘッド6は、ホルダ2の移行方向と直交方向に配備
されたリードネジ60およびガイド軸61に軸承され、
リードネジ60は正逆回転可能なヘッド送りモータ62
に連繋されている。The optical head 6 is supported by a lead screw 60 and a guide shaft 61 arranged in a direction perpendicular to the direction of movement of the holder 2.
The lead screw 60 is a head feed motor 62 that can rotate in forward and reverse directions.
is connected to.
従、ってヘッド送りモータ62が作動すると光学ヘッド
6はガイド軸61およびリードネジ60によって光カー
ド7の送り方向と直交方向に移行し、これにより光カー
ド7の情報記録部をアクセス動作する。Therefore, when the head feed motor 62 is operated, the optical head 6 is moved by the guide shaft 61 and the lead screw 60 in a direction perpendicular to the feeding direction of the optical card 7, thereby accessing the information recording section of the optical card 7.
この光カード7は、第13図に示す如く、情報記録部7
1に複数の情報記録トラック72を備え、各情報記録ト
ラック72の複数のセクタにはMFM変調方式で情報が
記録される。前記光学ヘッド6はこの光カード7に対す
る情報の読み書きを行い、ここで読み取られたデータ信
号は第1図に示す光カード記録情報読取装置に与えられ
る。As shown in FIG. 13, this optical card 7 has an information recording section 7.
1 includes a plurality of information recording tracks 72, and information is recorded in a plurality of sectors of each information recording track 72 using the MFM modulation method. The optical head 6 reads and writes information on the optical card 7, and the data signal read here is given to the optical card recorded information reading device shown in FIG.
同図に示す装置例は、この発明の一実施例にかかるもの
であって、シンク指令発生回路4゜データセパレータ1
00.ヘッダ検出許可信号発生回路8.ヘッダ検出回路
81.ナントゲート回路85.データリード回路9およ
び、マイクロコンピュータのCPUI 01をその構成
トして含んでいる。The example of the device shown in the figure is one according to an embodiment of the present invention, and includes a sink command generation circuit 4° data separator 1
00. Header detection permission signal generation circuit 8. Header detection circuit 81. Nant gate circuit 85. The configuration includes a data read circuit 9 and a CPUI 01 of a microcomputer.
シンク指令発生回路4は光学ヘッド6よりデータ信号d
を入力してシンク指令aを発生させる。このシンク指令
aは同期の開始を指令するためのもので、光学ヘッド6
が光カード7品情報記録トランク72を走査して、各セ
クタのシンクパタンを検出したのに対応して発生せられ
る。第4図には、光カード7のデータフォーマントと共
に、このシンク指令aや、後記するヘッダ検出許可信号
C,ヘッダ検出信号すなどの発生タイミングが示しであ
る。なお第4図に示す光カード7のデータフォーマット
において、各セクタにシンクパタン、ヘッダバタン、デ
ータの順で記録されることは説明済みである。The sync command generation circuit 4 receives the data signal d from the optical head 6.
is input to generate a sink command a. This sync command a is for instructing the start of synchronization, and is for the optical head 6.
is generated in response to scanning the seven optical card information recording trunks 72 and detecting the sync pattern of each sector. FIG. 4 shows the data format of the optical card 7 as well as the timing of generation of the sync command a, a header detection permission signal C, a header detection signal S, etc., which will be described later. It has already been explained that in the data format of the optical card 7 shown in FIG. 4, the sync pattern, header button, and data are recorded in the order of each sector.
第5図はこのシンク指令発生回路4の具体例を、また第
6図はそのタイムチャートを、それぞれ示すもので、図
示例のシンク指令発生回路4は、F/V変換器41.:
27パレータ42゜単安定マルチバイブレーク43.ア
ンド回路44などで構成されている。FIG. 5 shows a specific example of this sink command generation circuit 4, and FIG. 6 shows its time chart. :
27 Palator 42° Monostable Multibibreak 43. It is composed of an AND circuit 44 and the like.
F/V変換器41はデータ信号d(第6図(1)参照)
の周波数を電圧に変換して、その変換出力e(第6図(
2)参照)をコンパレータ42に与え、コンパレータ4
2はこの入力を基準電圧と比較して、比較出力f (第
6図(3)参照)を単安定マルチパイプレーク43に与
える。単安定マルチバイブレータ43は入力信号の立ち
上がりでトリガされて出力信号g(第6図(4)参照)
を生成し、アンド回路44はこの信号gとデータリード
回路9からのデータリード信号h(第6図(6)参照)
との論理演算を行ってシンク指令a(第6図15)参照
)を生成する。The F/V converter 41 receives the data signal d (see FIG. 6 (1)).
The frequency of is converted to voltage, and the conversion output e (Figure 6 (
2)) is given to the comparator 42, and the comparator 4
2 compares this input with a reference voltage and provides a comparison output f (see FIG. 6(3)) to the monostable multipipe lake 43. The monostable multivibrator 43 is triggered by the rising edge of the input signal and outputs the output signal g (see Fig. 6 (4)).
The AND circuit 44 generates this signal g and the data read signal h from the data read circuit 9 (see FIG. 6 (6)).
A sync command a (see FIG. 6, 15) is generated by performing a logical operation with .
第1図に戻って、データセパレータ′100はMFM変
調されたデータ信号dをウィンドウWDとデータDTと
に分離して、これをヘッダ検出回路81およびデータリ
ード回路9に与える。Returning to FIG. 1, the data separator '100 separates the MFM modulated data signal d into a window WD and data DT, and supplies these to the header detection circuit 81 and data read circuit 9.
ヘッダ検出回路81は、入力したウィンドウWDおよび
データDT (第8図(11(21参照)に基づき第4
図に示すデータフォーマットのヘッダパクンを検出して
ヘッダ検出信号b(第4図(3)参照)を出力する。The header detection circuit 81 detects the input window WD and the data DT (fourth one based on FIG. 8 (see 11 (21))
It detects header punctuation in the data format shown in the figure and outputs a header detection signal b (see FIG. 4 (3)).
第7図はヘッダ検出回路81の具体例を、また第8図は
そのタイムチャートを、それぞれ示すもので、図示例の
ヘッダ検出回路81は、シフトレジスタ82.コンパレ
ータ83および。FIG. 7 shows a specific example of the header detection circuit 81, and FIG. 8 shows its time chart. Comparator 83 and.
ヘッダバタン設定部84で構成しである。このヘッダバ
タン設定部84にはデイツプスイッチなどによりヘッダ
パターンが設定され、シフトレジスタ82の8ビット並
列出力QA 、 Ql 。It consists of a header button setting section 84. A header pattern is set in the header button setting section 84 by a dip switch or the like, and the 8-bit parallel outputs QA, Ql of the shift register 82 are set.
・・・・(第8図+3) +4)参照)とヘッダバタン
設定部84の設定データとが一致したとき、コンパレー
タ83がヘッダ検出信号b(第8図(5)参照)を一致
出力として出力する。... (see Figure 8 +3) +4)) and the setting data of the header bang setting section 84 match, the comparator 83 outputs the header detection signal b (see Figure 8 (5)) as a match output. do.
第1図に戻って、ヘッダ検出許可信号発生回路8は前記
ヘッダ検出回路81によるヘッダ検出動作を各セクタの
先頭から所定区間だけ許可するためのヘッダ検出許可信
号C(第4図(2)参照)を生成するためのもので、こ
のヘッダ検出許可信号Cでナントゲート回路85を開閉
することにより、前記ヘッダ検出信号すのデータリード
回路9への送出を制御する。Returning to FIG. 1, the header detection permission signal generation circuit 8 generates a header detection permission signal C (see FIG. 4 (2) ), and by opening and closing the Nant gate circuit 85 with this header detection permission signal C, the sending of the header detection signal S to the data read circuit 9 is controlled.
第9図はヘッダ検出許可信号発生回路8の具体例を、ま
た第8図はそのタイムチャートを、それぞれ示す。図示
例のヘッダ検出許可信号発生回路8は単安定マルチバイ
ブレータ80で構成され、シンク指令a(第10図(1
)参照)の立ち上がりでトリガされてヘッダ検出許可信
号C(第10図(2)参照)を生成する。このヘッダ検
出許可信号Cは、第4図に示す如く、ヘッダ検出信号す
の発生タイミングに対応させて必要最小限のパルス幅に
設定される。FIG. 9 shows a specific example of the header detection permission signal generation circuit 8, and FIG. 8 shows its time chart. The header detection permission signal generation circuit 8 in the illustrated example is composed of a monostable multivibrator 80, and the sink command a (FIG. 10 (1)
)) and generates a header detection permission signal C (see FIG. 10 (2)). As shown in FIG. 4, this header detection permission signal C is set to the minimum necessary pulse width in accordance with the generation timing of the header detection signal S.
第1図に戻って、データリード回路9はデータセパレー
タ100よりウィンドウWDおよびデータDT (第1
2図(1) (2)参照)を入力して、1バイト単位の
リードデータをCPUI O1へ出力する。Returning to FIG. 1, the data read circuit 9 reads the window WD and the data DT (first
(see Figure 2 (1) and (2)) is input, and read data in units of 1 byte is output to CPUI O1.
第11図はデータリード回路9の具体例を、また第12
図はそのタイムチャートを、それぞれ示すもので、図示
例のデータリード回路9はシフトレジスタ90. ラッ
チ回路91.カウンタ93.フリップフロップ92.9
4.ノア回路95などを構成して含んでいる。FIG. 11 shows a specific example of the data read circuit 9, and FIG.
The figures show their time charts, and the data read circuit 9 in the illustrated example has a shift register 90. Latch circuit 91. Counter 93. flip flop 92.9
4. It constitutes and includes a NOR circuit 95 and the like.
シフトレジスタ90はウィンドウ−〇およびデータDT
(第12図(1) (2)参照)を入力してシフト動
作し、8ビツトの並列出力QA、Qm 、・・・・(第
12図(3)にQAのみを示す)をラッチ回路91へ出
力する。フリップフロップ92はヘッダ検出信号b(第
12図(4)参照)を入力し、その立ち上がりで立ち下
がるデータリード信号i(第12図(5)参照)を出力
する。このデータリード信号iはノア回路95を経てカ
ウンタ93に与えられると共に、反転回路96にも与え
られてデータリード信号h(第12図(8)参照)が生
成され、このデータリード信号りは前記シンク指令発生
回路4のアンド回路44に与えられる。Shift register 90 has window-〇 and data DT
(See Fig. 12 (1) and (2)) and shifts the 8-bit parallel outputs QA, Qm, ... (only QA is shown in Fig. 12 (3)) to the latch circuit 91. Output to. The flip-flop 92 inputs the header detection signal b (see FIG. 12 (4)) and outputs the data read signal i (see FIG. 12 (5)) which falls at the rising edge of the header detection signal b (see FIG. 12 (5)). This data read signal i is given to the counter 93 via the NOR circuit 95, and is also given to the inversion circuit 96 to generate the data read signal h (see FIG. 12 (8)). It is applied to the AND circuit 44 of the sink command generation circuit 4.
前記カウンタ93はウィンドウWDを入力してカウント
アツプ動作し、その計数値がr8Jに達すると、QA−
QDの各出力のうちQ、出力(第12図(6)参照)が
立ち上がって、これがフリップフロップ94.ラツチ回
路91および。The counter 93 inputs the window WD and performs a count-up operation, and when the counted value reaches r8J, the QA-
Among the outputs of the QD, the output Q (see FIG. 12 (6)) rises, and this is the output of the flip-flop 94. Latch circuit 91 and.
ノア回路95に与えられる。このカウンタ93は最初デ
ータリード信号iでリセットされ、それ以後は計数値が
「8」に達する毎にQD小出力リセット信号として与え
られて、計数値がクリアされる。The signal is applied to the NOR circuit 95. This counter 93 is first reset by the data read signal i, and thereafter, every time the count value reaches "8", it is given as a QD small output reset signal to clear the count value.
フリップフロップ94は前記QD小出力入力し、その立
ち上がりで立ち上がるリードフラグFG (第12図(
7)参照)を生成してCPUI O1に与える。The flip-flop 94 inputs the QD small output and outputs a read flag FG which rises at the rising edge of the QD (see FIG. 12).
7)) and provides it to CPUI O1.
前記ラッチ回路91は、カウンタ93よりQD小出力与
えられると、シフトレジスタ90の並列出力をラッチし
、またCPUI O1はフリップフロップ94よりリー
ドフラグFGを受は取ると、ランチ回路91ヘデータリ
ード指令を与えてラッチデータを取り込む。なおリード
フラグFGはCPUl0Iによるデータの読取でクリア
される。When the latch circuit 91 receives a small QD output from the counter 93, it latches the parallel output of the shift register 90, and when the CPUI O1 receives the read flag FG from the flip-flop 94, it sends a data read command to the launch circuit 91. and fetch the latch data. Note that the read flag FG is cleared when data is read by the CPUl0I.
つぎに上記光カード処理装置の動作を説明する。Next, the operation of the optical card processing device will be explained.
カード挿入待機状態では、ホルダ2はカード挿入口11
の近くに位置しており、カードロード/イジェクト機構
3のローディングカム33は平坦カム面34がホルダ2
に対向している。In the card insertion standby state, the holder 2 is inserted into the card insertion slot 11.
The loading cam 33 of the card loading/ejecting mechanism 3 has a flat cam surface 34 located near the holder 2.
is facing.
この状態において、カード挿入口11より光カード7が
挿し込まれ、これを検出器31が検出すると、ローディ
ングモータ37が作動し、球形カム面35が回転するこ
とにより、挿し込まれた光カード7はカード保持部22
に自動的に取り込まれる。In this state, when the optical card 7 is inserted from the card insertion slot 11 and the detector 31 detects this, the loading motor 37 is activated and the spherical cam surface 35 rotates, thereby causing the inserted optical card 7 to is the card holding section 22
automatically imported into.
続いてカード送り機構5の駆動モータ58が作動して無
端ベルト54が移行するとき、ベルト54に設けた連結
ピン55がスライド部材24を介してホルダ2をガイド
軸13に沿い牽引して往動移行させる。Subsequently, when the drive motor 58 of the card feeding mechanism 5 operates and the endless belt 54 moves, the connecting pin 55 provided on the belt 54 pulls the holder 2 along the guide shaft 13 via the slide member 24 and moves forward. Migrate.
連結ピン55がプーリ52の外周に到達すると、連結ピ
ン55はスライド部材24をホルダ2に対し幅方向にス
ライドさせ、プーリ52を半周して復動側へ移行する。When the connecting pin 55 reaches the outer periphery of the pulley 52, the connecting pin 55 slides the slide member 24 in the width direction with respect to the holder 2, moves half around the pulley 52, and moves to the backward motion side.
ついで連結ピン55は前記往動時と同様、スライド部材
24を介してホルダ2をガイド軸13に沿い復動移行さ
せるもので、ホルダ2は駆動モータ58の一方向連続回
転により往復動作が実現される。ホルダ2の復動時、光
カード7の情報記録トランク72が光学ヘッド6と相対
移行し、情報の記録または、再生処理が行われる。ホル
ダ2が最初の位置に復帰すると、これに連動してヘッド
送りモータ62が作動し、ガイド軸61およびリードネ
ジ60によってトラックアクセス動作し、再び同様なカ
ード送り動作が繰返し行われる。Next, the connecting pin 55 moves the holder 2 backward along the guide shaft 13 via the slide member 24, as in the forward movement, and the holder 2 is reciprocated by the continuous rotation of the drive motor 58 in one direction. Ru. When the holder 2 moves back, the information recording trunk 72 of the optical card 7 moves relative to the optical head 6, and information recording or reproduction processing is performed. When the holder 2 returns to the initial position, the head feed motor 62 is operated in conjunction with this, and the guide shaft 61 and lead screw 60 perform a track access operation, and the same card feeding operation is repeated again.
いま情報の再生処理に際して、光学ヘッド6がある情報
記録トランク72を走査して、あるセクタのシンクパタ
ーン記録領域に入ると、シンク指令発生回路4は光学ヘ
ッド6からのデータ信号dを入力して、シンク指令aを
発生させる。ヘッダ検出許可信号発生回路8がこのシン
ク指令aを入力したとき、ヘッダ検出許可信号Cを発生
させてナントゲート回路85へ出力する。During information reproduction processing, when the optical head 6 scans the information recording trunk 72 and enters the sync pattern recording area of a certain sector, the sync command generation circuit 4 inputs the data signal d from the optical head 6. , generates a sink command a. When the header detection permission signal generation circuit 8 receives this sink command a, it generates a header detection permission signal C and outputs it to the Nante gate circuit 85.
ついでヘッダ検出回路81はデータセパレータ100で
分離されたデータDTおよびウィンドウWDを入力して
ヘッダパタンを検出し、ヘッダ検出信号すをナントゲー
ト回路85へ出力する。Next, the header detection circuit 81 receives the data DT and the window WD separated by the data separator 100, detects a header pattern, and outputs a header detection signal S to the Nante gate circuit 85.
このナントゲート回路85はヘッダ検出許可信号Cがオ
ンしているとき、ヘッダ検出信号すを通過させてデータ
リード回路9へ送出する。データリード回路9ではヘッ
ダ検出信号すを受は取ると、データの読取動作を開始し
、1バイト単位のデータが次々にcptJlolに読み
込まれる。This Nant gate circuit 85 allows the header detection signal C to pass through and sends it to the data read circuit 9 when the header detection permission signal C is on. When the data read circuit 9 receives the header detection signal, it starts a data reading operation, and data in units of bytes are successively read into cptJlol.
いまヘッダ検出部81が、第4図に示す第2セクタで正
規のへッダパクンを検出できず、しかも第2セクタのデ
ータ中のパタンをヘッダバタンとして誤って読み取って
、ヘッダ検出信号b′を出力した場合を想定すると、こ
の場合にはヘッダ検出許可信号発生回路8はヘッダ検出
許可信号Cを出力していないから、このヘッダ検出信号
b′はナントゲート回路85で阻止され、データリード
回路9に送出されない。このためデータリード回路9で
はデータの読取動作は行われない(第4図(4)参照)
。Now, the header detection unit 81 is unable to detect a regular header punch in the second sector shown in FIG. In this case, since the header detection permission signal generation circuit 8 does not output the header detection permission signal C, this header detection signal b' is blocked by the Nante gate circuit 85 and sent to the data read circuit 9. Not sent. Therefore, no data reading operation is performed in the data read circuit 9 (see FIG. 4 (4)).
.
つぎにヘッダ検出部81が第3セクタで正規のヘッダバ
タンを検出して、ヘッダ検出信号bを出力すると、この
場合にはヘッダ検出許可信号発生回路8がヘッダ検出許
可信号Cを発生させているため、このヘッダ検出信号す
がナントゲート回路85を経てデータリード回路9に送
出され、データリード回路9は第3セクタのデータを確
実に読み取ることになる(第4図(4)参照)。その結
果、データの読取ミスは第2セクタに限られ、第3セク
タにその影響は及ばない。Next, when the header detection unit 81 detects a regular header bang in the third sector and outputs the header detection signal b, in this case, the header detection permission signal generation circuit 8 generates the header detection permission signal C. Therefore, this header detection signal is sent to the data read circuit 9 via the Nante gate circuit 85, and the data read circuit 9 reliably reads the data in the third sector (see FIG. 4 (4)). As a result, a data read error is limited to the second sector and does not affect the third sector.
〈発明の効果〉
この発明は上記の如(、データの先頭検出動作を各セク
タの先頭から所定区間だけ許可するから、各セクタのデ
ータの先頭が検出されずに、そのセクタのデータ途中で
データの先頭が誤検出されることはない。従って先頭検
出ミスがあったとき、そのセクタのみにつきデータの読
取ミスが生じ、他のセクタのデータ読取には何等影響を
及ぼさないから、データ読取の失敗範囲を最小限度に止
めることができるなど、発明目的を達成した顕著な効果
を奏する。<Effects of the Invention> As described above, the present invention allows the operation to detect the beginning of data only in a predetermined period from the beginning of each sector. Therefore, if there is a mistake in detecting the beginning, a data reading error will occur only for that sector, and will not affect data reading in other sectors, resulting in a data reading failure. This invention has a remarkable effect of achieving the purpose of the invention, such as being able to keep the scope to a minimum.
第1図はこの発明の一実施例にかかる光カード記録情報
読取装置の回路ブロック図、第2図はこの発明が適用実
施される光カード処理装置の機構を示す平面図、第3図
は第2図nr−m線に沿う断面図、第4図は第1図の回
路のタイムチャート、第5図はシンク指令発生回路の具
体例を示す回路ブロック図、第6図は第5図の回路のタ
イムチャート、第7図はヘッダ検出回路の具体例を示す
回路ブロック図、第8図は第7図の回路のタイムチャー
ト、第9図はヘッダ検出許可信号発生回路の具体例を示
す回路ブロック図、第10図は第9図の回路のタイムチ
ャート、第11図はデータリード回路の具体例を示す回
路ブロック図、第12図は第11図の回路のタイムチャ
ート、第13図は情報記録部を拡大して示した光カード
の平面図、第14図および第15図は従来例によるデー
タ読取動作を示すタイムチャートである。
8・・・・ヘッダ検出許可信号発生回路9・・・・デー
タリード回路
81・・・・ヘッダ検出回路
85・・・・ナントゲート回路
101・・・・CPUFIG. 1 is a circuit block diagram of an optical card recording information reading device according to an embodiment of the present invention, FIG. 2 is a plan view showing the mechanism of an optical card processing device to which the present invention is applied, and FIG. Figure 2 is a sectional view taken along the line NR-M, Figure 4 is a time chart of the circuit in Figure 1, Figure 5 is a circuit block diagram showing a specific example of the sink command generation circuit, and Figure 6 is the circuit in Figure 5. 7 is a circuit block diagram showing a specific example of the header detection circuit, FIG. 8 is a time chart of the circuit in FIG. 7, and FIG. 9 is a circuit block diagram showing a specific example of the header detection permission signal generation circuit. Figure 10 is a time chart of the circuit in Figure 9, Figure 11 is a circuit block diagram showing a specific example of a data read circuit, Figure 12 is a time chart of the circuit in Figure 11, and Figure 13 is an information recording circuit. FIGS. 14 and 15 are time charts showing a data reading operation according to a conventional example. 8...Header detection permission signal generation circuit 9...Data read circuit 81...Header detection circuit 85...Nant gate circuit 101...CPU
Claims (1)
情報を読み取るための光カード記録情報読取装置におい
て、 各セクタに記録されたデータの先頭を検出するための先
頭検出部と、 先頭検出部による検出動作を各セクタの先頭から所定区
間だけ許可するための検出許可部とを備えて成る光カー
ド記録情報読取装置。[Claims] In an optical card recorded information reading device for reading each sector-by-sector information recorded on an information recording track of an optical card, a head detecting section for detecting the head of data recorded in each sector. An optical card recorded information reading device comprising: a detection permission section for permitting a detection operation by the start detection section only in a predetermined section from the beginning of each sector.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62255237A JPH0198162A (en) | 1987-10-09 | 1987-10-09 | Optical card recording information read device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62255237A JPH0198162A (en) | 1987-10-09 | 1987-10-09 | Optical card recording information read device |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0198162A true JPH0198162A (en) | 1989-04-17 |
Family
ID=17275938
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62255237A Pending JPH0198162A (en) | 1987-10-09 | 1987-10-09 | Optical card recording information read device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0198162A (en) |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5671809A (en) * | 1979-11-15 | 1981-06-15 | Matsushita Electric Ind Co Ltd | Recording and reproducing device of digital type |
JPS60182558A (en) * | 1984-02-29 | 1985-09-18 | Nippon Telegr & Teleph Corp <Ntt> | Synchronizing control system of cassette type magnetic tape device |
JPS61246930A (en) * | 1985-04-23 | 1986-11-04 | Dainippon Printing Co Ltd | Recording method for light digital data |
JPS62132238A (en) * | 1985-12-03 | 1987-06-15 | Dainippon Printing Co Ltd | Recording method for optical digital data |
-
1987
- 1987-10-09 JP JP62255237A patent/JPH0198162A/en active Pending
Patent Citations (4)
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A131 | Notification of reasons for refusal |
Effective date: 20060919 Free format text: JAPANESE INTERMEDIATE CODE: A131 |
|
A02 | Decision of refusal |
Effective date: 20070327 Free format text: JAPANESE INTERMEDIATE CODE: A02 |