JPH0138499Y2 - - Google Patents

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JPH0138499Y2
JPH0138499Y2 JP1980129399U JP12939980U JPH0138499Y2 JP H0138499 Y2 JPH0138499 Y2 JP H0138499Y2 JP 1980129399 U JP1980129399 U JP 1980129399U JP 12939980 U JP12939980 U JP 12939980U JP H0138499 Y2 JPH0138499 Y2 JP H0138499Y2
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average unit
unit weight
output
gate circuit
divider
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Description

【考案の詳細な説明】 本考案は個数計算はかりに関する。[Detailed explanation of the idea] The present invention relates to a piece counting scale.

従来の個数計算はかりでは、サンプルの平均単
重が変わるたびに、テンキー操作によつて新たな
平均単重をキーインしたり、あるいは再び既知数
のサンプルを載置して、その時の計重値と前記既
知数とから新たな平均単重を算出した上で、個数
の計算を行つているのが現状である。平均単重が
変わるたびの平均単重の上記設定操作は煩わし
く、特に決まつた数種の平均単重を使い分けて個
数計算を行う場合などには操作性の悪いものであ
る。
With conventional piece counting scales, each time the average unit weight of a sample changes, you have to key in the new average unit weight using the numeric keypad, or place a known number of samples again and calculate the current weight value. Currently, the number of pieces is calculated after calculating a new average unit weight from the known number. The above-mentioned operation for setting the average unit weight each time the average unit weight changes is troublesome, and is particularly inconvenient when calculating the number of pieces by using several fixed average unit weights.

そこで本考案は上記問題点を回避すべく成され
たものであつて、平均単重を記憶可能なメモリ装
置を設け、該メモリ装置から適宜所定の平均単重
を読み出して使用するよう構成して、操作性の向
上を期待できる個数計算はかりを提供するもので
ある。
Therefore, the present invention has been made in order to avoid the above-mentioned problems, and is configured such that a memory device capable of storing average unit weight is provided, and a predetermined average unit weight is read out from the memory device and used. , provides a counting scale that can be expected to improve operability.

以下本考案の一実施例を図面に基づいて説明す
る。
An embodiment of the present invention will be described below based on the drawings.

1は増幅器2を介したロードセル3出力信号を
デジタル値に変換するアナログ・デジタル変換
器、4は風袋記憶用のメモリ、5はアナログ・デ
ジタル変換器1出力を被減数として受入れ、メモ
リ4出力を減数として受入れる風袋引き用減算
器、6,7はそれぞれ減算器5出力とメモリ4出
力をI/N〔例えばN=5〕するI/N回路、8,
9はI/N回路6,7出力の下1位を四捨五入し
て補正するまるめ回路、10,11は最小目盛変
更用の掛算器で、掛算器10はまるめ回路8出力
を係数K倍して重量表示部12に出力し、掛算器
11はまるめ回路9出力を係数K倍して風袋表示
部13に出力する。14は個数算出用の第1の割
算器としての割算器で、未知数のサンプルの計重
値として前記I/N回路6出力信号を受入れ、除
数として平均単重を表わす信号Daを受入れる。
15は割算器14出力を前記係数K倍する掛算器
で、算出結果は下1位を四捨五入して個数表示部
16にデジタル表示される。
1 is an analog-to-digital converter that converts the load cell 3 output signal via amplifier 2 into a digital value, 4 is a memory for tare storage, 5 is an analog-to-digital converter that accepts the output of 1 as the minuend, and subtracts the output of memory 4. 6 and 7 are I/N circuits that connect the output of the subtractor 5 and the output of the memory 4 (for example, N=5), 8,
9 is a rounding circuit that rounds off and corrects the lowest digit of the output of I/N circuits 6 and 7, 10 and 11 are multipliers for changing the minimum scale, and multiplier 10 multiplies the output of rounding circuit 8 by a coefficient K. The multiplier 11 multiplies the output of the rounding circuit 9 by a coefficient K and outputs the result to the tare display section 13. A divider 14 serves as a first divider for calculating the number of pieces, and accepts the output signal of the I/N circuit 6 as the weight value of the unknown number of samples, and receives the signal Da representing the average unit weight as the divisor.
A multiplier 15 multiplies the output of the divider 14 by the coefficient K, and the calculation result is rounded off to the nearest whole number and digitally displayed on the number display section 16.

ここでアナログ・デジタル変換器1の分解能を
15000とし、前記係数K=1とすると、ひよう量
3Kg、最小目盛1gのはかりとなる。また係数K
=2とすると、ひよう量6Kg、最小目盛2g、ま
た係数K=5とすると、ひよう量15Kg、最小目盛
5gのはかりとなる。
Here, the resolution of analog-to-digital converter 1 is
15000 and the coefficient K=1, the scale has a weighing capacity of 3 kg and a minimum scale of 1 g. Also, the coefficient K
If = 2, the scale has a weighing capacity of 6 kg and a minimum scale of 2 g, and if the coefficient K = 5, the scale has a weighing capacity of 15 kg and a minimum scale of 5 g.

平均単重を表わす信号Daは次のようにして与
えられる。
The signal Da representing the average unit weight is given as follows.

17は演算部で、所定間隔でゲート18を介し
て前記減算器5出力W(t)をn回〔n≧2で例えば
n=5〕繰返して読み取り、第1回目〜第5回目
の各読み取り回の値がW1,W2,W3,W4,W5
あつたとすると、実質的には W1+W2+W3+W4+W5/n・N=〓〓W(t)/25 〔g〕 の演算によつて相加平均を算出するものである
が、ここでは〔5t=1 W(t)〕・40の演算によつて単位
がミリグラムに変換されている。19はテンキー
20によつてキーインされた置数値を記憶するレ
ジスタで、平均単重あるいはサンプル個数として
の数値が書き込まれており、所定のクリア信号C
によつてクリアされる。21は第2の割算器とし
ての割算器で、演算部17の出力を被除数とし、
レジスタ19の出力を除数としている。22は割
算器21出力を記憶するレジスタ、23はレジス
タ22出力を前記係数K倍する掛算器、24はレ
ジスタ19出力あるいは掛算器23出力を択一的
に出力する第1のゲート回路でゲート25,2
6,27から成る。28は前記ゲート18と第1
のゲート回路24を制御するキースイツチ〔以
下、個数キーと称す〕で、操作前はゲート18
をオフ状態、第1のゲート回路24をレジスタ1
9の出力状態とし、操作後は次いで消去指示スイ
ツチ〔図示せず〕または前記テンキー20の操作
を検出するまで操作状態をホールドして、ゲート
18をオン状態、第1のゲート回路24を掛算器
23の出力状態とする。29は書き込み/読み出
しのモードがスイツチ30によつて選択されるメ
モリ装置で、商用電源とは別のバツテリによつて
バツクアツプされたRAMから構成されており、
書き込みモードではアドレス信号Aによつて指定
される番地にその時の前記第1のゲート回路24
出力信号を書き込み、読み出しモードではアドレ
ス信号Aによつて指定される番地に予め書き込ま
れている値を平均単重として読み出す。31はメ
モリ装置29に書き込み/読み出し番地に対応す
る前記アドレス信号Aを出力する番地指定部で、
ここでは例えば9個の平均単重を適宜書き込み/
読み出しの別を指示する押釦スイツチSW1〜SW9
が設けられている。32は前記第1のゲート回路
24出力あるいはメモリ装置29の読み出し出力
Bを択一的に出力する第2のゲート回路で、出力
状態はスイツチ33によつて選択され、該第2の
ゲート回路32出力は平均単重を表わす前記信号
Daとして前記割算器14に除数として入力され、
また平均単重表示部34によつて重量表示され
る。
17 is an arithmetic unit that repeatedly reads the output W (t) of the subtracter 5 through the gate 18 at predetermined intervals n times [n≧2, for example, n=5], and reads each of the first to fifth readings. If the values of times are W 1 , W 2 , W 3 , W 4 , W 5 , then practically W 1 + W 2 + W 3 + W 4 + W 5 /n・N=〓〓W (t) /25 The arithmetic mean is calculated by the calculation [g], but here the unit is converted to milligrams by the calculation [ 5t=1 W (t) ]·40. Reference numeral 19 denotes a register for storing the set value entered using the numeric keypad 20, in which the average unit weight or the number of samples is written, and a predetermined clear signal C is written.
Cleared by . 21 is a divider as a second divider, which takes the output of the arithmetic unit 17 as the dividend;
The output of register 19 is used as the divisor. 22 is a register that stores the output of the divider 21; 23 is a multiplier that multiplies the output of the register 22 by the coefficient K; 24 is a first gate circuit that selectively outputs the output of the register 19 or the output of the multiplier 23; 25,2
It consists of 6,27. 28 is the gate 18 and the first
A key switch (hereinafter referred to as the number key) that controls the gate circuit 24 of the gate 18 before operation.
is in the off state, the first gate circuit 24 is in the register 1
After the operation, the operation state is held until the operation of the erase instruction switch (not shown) or the numeric keypad 20 is detected, the gate 18 is turned on, and the first gate circuit 24 is turned on as a multiplier. 23 output state. Reference numeral 29 denotes a memory device whose write/read mode is selected by a switch 30, and is composed of a RAM backed up by a battery separate from the commercial power supply.
In the write mode, the first gate circuit 24 at the address specified by the address signal A at that time is
The output signal is written, and in the read mode, the value written in advance at the address designated by the address signal A is read out as the average unit weight. 31 is an address specifying unit that outputs the address signal A corresponding to the write/read address to the memory device 29;
For example, write the average unit weight of 9 pieces as appropriate/
Push button switches SW 1 to SW 9 to indicate different readout
is provided. 32 is a second gate circuit that selectively outputs the output of the first gate circuit 24 or the read output B of the memory device 29; the output state is selected by the switch 33; The output is the signal representing the average unit weight.
Da is input as a divisor to the divider 14,
The average unit weight display section 34 also displays the weight.

このように構成したため、個数キー28の操
作前にテンキー20を介してレジスタ19にキー
インされた値は単位をミリグラムとして第1のゲ
ート回路24を介してメモリ装置29に供給さ
れ、また第2のゲート回路32を介して割算器1
4と平均単重表示部34に供給さる。この状態で
番地指定部31の押釦スイツチSW1〜SW9のうち
の何れか1つ〔例えばSW1〕とスイツチ30を操
作してメモリ装置29にその時のレジスタ19の
内容を書き込むと、レジスタ19の内容を一旦ク
リアしても、再び同じ平均単重で個数の算出を行
うような場合には、スイツチ33を前記読み出し
出力Bの出力状態として、前記押釦スイツチSW1
を選択操作することによつて、テンキー20でキ
ーインせずとも予め書き込まれた平均単重を読み
出して、迅速に個数の計算が行える。
With this configuration, the value keyed into the register 19 via the numeric keypad 20 before operating the number key 28 is supplied to the memory device 29 via the first gate circuit 24 in milligrams; Divider 1 via gate circuit 32
4 and is supplied to the average unit weight display section 34. In this state, if you operate one of the pushbutton switches SW 1 to SW 9 (for example, SW 1 ) of the address specifying section 31 and the switch 30 to write the contents of the register 19 at that time into the memory device 29, the contents of the register 19 at that time are written. If you want to calculate the number of pieces using the same average unit weight again even after clearing the contents, set the switch 33 to the output state of the readout output B and press the push button switch SW 1 .
By selecting , the average unit weight written in advance can be read out without having to key in using the numeric keypad 20, and the number of pieces can be quickly calculated.

また既知数E個〔例えばE=50〕のサンプルの
荷重をロードセル3に作用させ、テンキー20を
介してレジスタ19に既知数Eの“50”をキーイ
ンし、次いで個数キー28を操作すると、割算
器17は自動的にn回分の相加平均を算出し、割
算器21は算出された平均単重をレジスタ22に
ホールドさせ、掛算器23と第1のゲート回路2
4を介してメモリ装置29に供給され、またレジ
スタ19の場合と同様に第2のゲート回路32を
介して割算器14と平均単重表示部34に掛算器
23出力が供給される。この状態で番地指定部3
1の押釦スイツチSW1〜SW9のうちの何れか1つ
〔例えばSW2〕とスイツチ30を操作してメモリ
装置29にその時の掛算器23の出力を書き込む
と、レジスタ22の内容を一旦クリアした場合
に、再び既知数E個のサンプルを載置して平均単
重の算出を実行せずとも、スイツチ33と番地指
定部31の押釦スイツチSW2の操作によつて、迅
速に個数の算出を行える。
In addition, by applying the load of a known number of E samples (for example, E = 50) to the load cell 3, keying in the known number E of "50" in the register 19 via the numeric keypad 20, and then operating the number key 28, the The multiplier 17 automatically calculates the arithmetic average of n times, the divider 21 causes the calculated average unit weight to be held in the register 22, and the multiplier 23 and the first gate circuit 2
Similarly to the register 19, the output of the multiplier 23 is supplied to the divider 14 and the average unit weight display section 34 via the second gate circuit 32. In this state, address specification section 3
When the output of the multiplier 23 at that time is written into the memory device 29 by operating one of the push button switches SW 1 to SW 9 [for example, SW 2 ] and the switch 30, the contents of the register 22 are temporarily cleared. In this case, the number can be quickly calculated by operating the switch 33 and the push button switch SW 2 of the address designation section 31, without having to place the known number of E samples again and calculate the average unit weight. can be done.

なお未知数のサンプルの個数を計算するには、
未知数のサンプルの荷重をロードセル3に作用さ
せ、割算器14でレジスタ19あるいは掛算器2
3またはメモリ装置29から読み出された前記記
号Daを除数として演算され、演算結果が掛算器
15を介して個数表示部34に求める個数が表示
される。
To calculate the number of unknown samples,
The load of the unknown sample is applied to the load cell 3, and the divider 14 applies the load to the register 19 or the multiplier 2.
3 or the symbol Da read from the memory device 29 as a divisor, and the result of the calculation is passed through the multiplier 15 to display the desired number on the number display section 34.

以上説明のように本考案の個数計算はかりによ
ると、平均単重をメモリ装置に書き込んでおき、
適宜メモリ装置からワンタツチ操作で読み出して
使用することができるため、従来のように平均単
重が変わる度にいちいちテンキーによる平均単重
のキーイン操作あるいは既知数のサンプルを載置
しての平均単重の算出操作を実行する必要がな
い。しかも、第2の割算器と第1のゲート回路を
設け、第1のゲート回路の出力をメモリ装置の書
き込み入力に供給したため、計重値から算出した
平均単重の値を、直接にメモリ装置に書き込むこ
とができ、算出された平均単重を入力装置を操作
してわざわざキーインする必要もなく、個数計算
はかりの操作性を著しく向上させることができる
ものである。
As explained above, according to the piece counting scale of the present invention, the average unit weight is written in the memory device,
Since it can be read out from the memory device and used with a single touch, you can use the key-in operation using the numeric keypad to read the average unit weight each time the average unit weight changes, as in the past, or load the average unit weight by placing a known number of samples. There is no need to perform calculation operations. Moreover, since a second divider and a first gate circuit were provided, and the output of the first gate circuit was supplied to the write input of the memory device, the value of the average unit weight calculated from the weight value could be directly stored in the memory. It is possible to write the calculated average unit weight into the device, and there is no need to manually input the calculated average unit weight by operating the input device, thereby significantly improving the operability of the piece counting scale.

【図面の簡単な説明】[Brief explanation of the drawing]

図面は本考案による個数計算はかりの一実施例
の構成図である。 1……アナログ・デジタル変換器、3……ロー
ドセル、14,21……割算器、16……個数表
示部、20……テンキー、24……第1のゲート
回路、29……メモリ装置、31……番地指定
部、32……第2のゲート回路、34……平均単
重表示部。
The drawing is a block diagram of an embodiment of a counting scale according to the present invention. DESCRIPTION OF SYMBOLS 1... Analog-digital converter, 3... Load cell, 14, 21... Divider, 16... Number display section, 20... Numeric keypad, 24... First gate circuit, 29... Memory device, 31...Address designation section, 32...Second gate circuit, 34...Average unit weight display section.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] 未知数のサンプルの計重値を被除数とし、前記
サンプルの平均単重を除数として第1の割算器1
4で前記未知数を算出するとともに、複数の平均
単重値を記憶可能なメモリ装置29と、数値入力
用の入力装置20と、前記計重値を被除数とし前
記入力装置20から入力されたサンプル既知数を
除数として割算して平均単重値を算出する第2の
割算器21と、前記入力装置20から入力された
単重値と第2の割算器21の出力に発生した平均
単重値の内の一方を選択して出力する第1のゲー
ト回路24と、第1のゲート回路24の出力値と
前記メモリ装置29から読み出した平均単重値の
一方を選択して出力する第2のゲート回路32と
を設け、第2のゲート回路32の出力値を第1の
割算器14の除数入力に供給し、第1のゲート回
路24の出力を前記メモリ装置29の書き込み入
力に供給した個数計算はかり。
A first divider 1 with the weighted value of the unknown sample as the dividend and the average unit weight of the sample as the divisor.
4, a memory device 29 capable of storing a plurality of average unit weight values, an input device 20 for inputting numerical values, and a known sample input from the input device 20 with the weight value as a dividend. a second divider 21 that calculates an average unit weight value by dividing the number as a divisor; A first gate circuit 24 selects and outputs one of the weight values, and a first gate circuit 24 selects and outputs one of the output value of the first gate circuit 24 and the average unit weight value read from the memory device 29. 2 gate circuits 32 are provided, the output value of the second gate circuit 32 is supplied to the divisor input of the first divider 14, and the output of the first gate circuit 24 is supplied to the write input of the memory device 29. Supplied piece counting scale.
JP1980129399U 1980-09-10 1980-09-10 Expired JPH0138499Y2 (en)

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS53141072A (en) * 1977-05-15 1978-12-08 Shinkou Denshi Kk Method for counting number of parts by way of scale

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