JPH0132694B2 - - Google Patents
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- JPH0132694B2 JPH0132694B2 JP56018263A JP1826381A JPH0132694B2 JP H0132694 B2 JPH0132694 B2 JP H0132694B2 JP 56018263 A JP56018263 A JP 56018263A JP 1826381 A JP1826381 A JP 1826381A JP H0132694 B2 JPH0132694 B2 JP H0132694B2
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- JP
- Japan
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- signal
- circuit
- wires
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- unit
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- 238000001514 detection method Methods 0.000 claims description 11
- 230000008054 signal transmission Effects 0.000 claims description 7
- 239000003990 capacitor Substances 0.000 claims description 3
- 230000005540 biological transmission Effects 0.000 claims description 2
- 230000001934 delay Effects 0.000 claims 1
- 238000009499 grossing Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 5
- 230000010355 oscillation Effects 0.000 description 5
- 239000004020 conductor Substances 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 238000000034 method Methods 0.000 description 1
- 238000002360 preparation method Methods 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
- 230000035939 shock Effects 0.000 description 1
Landscapes
- Arrangements For Transmission Of Measured Signals (AREA)
- Alarm Systems (AREA)
- Dc Digital Transmission (AREA)
- Small-Scale Networks (AREA)
- Selective Calling Equipment (AREA)
Description
【発明の詳細な説明】
本発明は、操作スイツチ、リミツトスイツチ、
光電スイツチ、近接スイツチ、温度スイツチ、シ
ヨツクスイツチなどの広義の検出器の、機械的接
点または半導体スイツチング素子のON、OFFに
よるデータを、中央制御装置等の機器に伝えるた
めの信号伝送装置に関する。
光電スイツチ、近接スイツチ、温度スイツチ、シ
ヨツクスイツチなどの広義の検出器の、機械的接
点または半導体スイツチング素子のON、OFFに
よるデータを、中央制御装置等の機器に伝えるた
めの信号伝送装置に関する。
従来、複数のスイツチ等の信号を機器に伝える
には、直列ないし並列接続が可能な場合を除きそ
れぞれに１本の導線を用いた１対１接続がなされ
るのが普通である。ところで１対１接続には以下
に述べる問題点がある。
には、直列ないし並列接続が可能な場合を除きそ
れぞれに１本の導線を用いた１対１接続がなされ
るのが普通である。ところで１対１接続には以下
に述べる問題点がある。
(1) 検出器と同数の電線、それを受付ける端子が
必要であり、部品代、配線工数の面でコスト高
になる。
必要であり、部品代、配線工数の面でコスト高
になる。
(2) 接地線あるいはシヤーシ等と信号線が離れる
ため、雑音を拾い易い。
ため、雑音を拾い易い。
上記欠点中、第２のものを除くため、各検出器
毎に１対の対撚線で伝送する方法もあるが、各検
出器毎に電源が必要であり、また、接地電位の差
を補うための分離が必要であるという欠点を有し
ている。
毎に１対の対撚線で伝送する方法もあるが、各検
出器毎に電源が必要であり、また、接地電位の差
を補うための分離が必要であるという欠点を有し
ている。
上述したような種々な欠点は一対の撚線（回路
的には平行２線）間に多数の子機を接続し、各子
機にアドレスを設定し親機からアドレス指定信号
を送つてそのアドレスを有する子機から信号を送
らせるとか、親機が各子機に一斉に信号を送り、
各子機はその信号を検出してそれを時間の基準点
とし、各子機毎に予め設定してあるタイミングで
親機に発信すると云う構成で略全面的に解決でき
る。本発明はこのような構成を更に進めて、各子
機の駆動電源を上記平行２線から供給するように
すると共に、各子機と平行２線との接続に当つて
平行２線の極性を考慮しなくてもよいようにしよ
うとするものである。
的には平行２線）間に多数の子機を接続し、各子
機にアドレスを設定し親機からアドレス指定信号
を送つてそのアドレスを有する子機から信号を送
らせるとか、親機が各子機に一斉に信号を送り、
各子機はその信号を検出してそれを時間の基準点
とし、各子機毎に予め設定してあるタイミングで
親機に発信すると云う構成で略全面的に解決でき
る。本発明はこのような構成を更に進めて、各子
機の駆動電源を上記平行２線から供給するように
すると共に、各子機と平行２線との接続に当つて
平行２線の極性を考慮しなくてもよいようにしよ
うとするものである。
第１図は本発明が適用される信号伝送装置の全
体構成を示す。Ａは親機でＣ１，Ｃ２等は子機で
ある。Ｄ１，Ｄ２等は検出器でスイツチング素子
Ｓ１，Ｓ２等と直列に接続され、この直列接続が
平行２線Ｌ１，Ｌ２間に多数接続される。子機Ｃ
１，Ｃ２等は予め定められた互に異るタイミング
で自分に対応しているスイツチング素子を導通さ
せる。２線Ｌ１，Ｌ２間には親機Ａによつて電圧
が印加されている。そこで例えば或るタイミング
でＣ１がＳ１を導通させたとき、検出器Ｄ１が
ONの状態にあつたとすると２線Ｌ１，Ｌ２間が
短絡される。親機Ａは２線Ｌ１，Ｌ２間短絡を検
知し、かつそのタイミングによつてＤ１がONし
ていたことを検知する。Ｃ１，Ｃ２等が対応する
スイツチング素子を導通させるタイミングが互に
異つているから、親機Ａは一対の平行２線Ｌ１，
Ｌ２間に多数の検出器が接続されていても、それ
らを区別して何れがONの信号を出しているかを
検知できる。本発明はこのような構成で各子機を
駆動する電源を２線Ｌ１，Ｌ２によつて供給し、
かつ各子機が対応するスイツチング素子を導通さ
せるタイミングが何等かの形で親機によつて制御
され、かつこの制御信号が２線Ｌ１，Ｌ２を通し
て親機から子機に送られるようになつている装置
を対象としている。
体構成を示す。Ａは親機でＣ１，Ｃ２等は子機で
ある。Ｄ１，Ｄ２等は検出器でスイツチング素子
Ｓ１，Ｓ２等と直列に接続され、この直列接続が
平行２線Ｌ１，Ｌ２間に多数接続される。子機Ｃ
１，Ｃ２等は予め定められた互に異るタイミング
で自分に対応しているスイツチング素子を導通さ
せる。２線Ｌ１，Ｌ２間には親機Ａによつて電圧
が印加されている。そこで例えば或るタイミング
でＣ１がＳ１を導通させたとき、検出器Ｄ１が
ONの状態にあつたとすると２線Ｌ１，Ｌ２間が
短絡される。親機Ａは２線Ｌ１，Ｌ２間短絡を検
知し、かつそのタイミングによつてＤ１がONし
ていたことを検知する。Ｃ１，Ｃ２等が対応する
スイツチング素子を導通させるタイミングが互に
異つているから、親機Ａは一対の平行２線Ｌ１，
Ｌ２間に多数の検出器が接続されていても、それ
らを区別して何れがONの信号を出しているかを
検知できる。本発明はこのような構成で各子機を
駆動する電源を２線Ｌ１，Ｌ２によつて供給し、
かつ各子機が対応するスイツチング素子を導通さ
せるタイミングが何等かの形で親機によつて制御
され、かつこの制御信号が２線Ｌ１，Ｌ２を通し
て親機から子機に送られるようになつている装置
を対象としている。
上述した本発明の対象装置では２線Ｌ１，Ｌ２
を親機に接続するときの極性を間違えないように
しなければならない。また各子機を２線Ｌ１，Ｌ
２間に接続するときの極性も間違えないようにし
なければならない。スイツチング素子Ｓ１，Ｓ２
等が有極性のものであるときはその接続方向も問
題になる。スイツチング素子にCMOS型FETを
用いるときは双極性であるからスイツチング素子
に関しては問題がなくなる。CMOSFETの代り
にマグネツトリレーを用いてもよい。本発明は２
線Ｌ１，Ｌ２を親機に接続する場合及び子機を２
線Ｌ１，Ｌ２間に接続する場合、一々極性を考え
なくてもよいように子機を無極性化することを目
的としている。以下実施例によつて本発明を説明
する。
を親機に接続するときの極性を間違えないように
しなければならない。また各子機を２線Ｌ１，Ｌ
２間に接続するときの極性も間違えないようにし
なければならない。スイツチング素子Ｓ１，Ｓ２
等が有極性のものであるときはその接続方向も問
題になる。スイツチング素子にCMOS型FETを
用いるときは双極性であるからスイツチング素子
に関しては問題がなくなる。CMOSFETの代り
にマグネツトリレーを用いてもよい。本発明は２
線Ｌ１，Ｌ２を親機に接続する場合及び子機を２
線Ｌ１，Ｌ２間に接続する場合、一々極性を考え
なくてもよいように子機を無極性化することを目
的としている。以下実施例によつて本発明を説明
する。
第２図は本発明の一実施例装置における子機の
構成を示す。平行２線Ｌ１，Ｌ２間には直流電圧
が印加されている。親機は多数の子機を順に走査
して第１図におけるスイツチング素子Ｓ１，Ｓ２
等を順に導通させて行く。第２図でＳは第１図の
Ｓ１等に相当し、Ｄは第１図のＤ１等に相当す
る。親機は子機走査に当つてスタート信号を各子
機に送る。この信号は短時間２線Ｌ１，Ｌ２間電
圧を０にするもので第３図にＡで示すようなパル
ス信号である。各子機はこのパルス信号を検出し
て各自に計時動作を開始し、各子機毎に予め定め
られた時間後に短時間スイツチング素子Ｓを導通
させる。このとき検出器ＤがONしていると２線
Ｌ１，Ｌ２間が短絡されるので子機からの発信も
第３図Ｂに示すようなパルスとなる。子機は２線
Ｌ１，Ｌ２から電源を得ているので、第３図に示
すように電源電圧がＶと０との間を変動しては困
るから整流器を介して２線Ｌ１，Ｌ２間電圧をコ
ンデンサに保持してこれを電源としている。かつ
この電源をＬ１，Ｌ２の極性に無関係にするため
ダイオードｄ１〜ｄ４で両波整流回路を構成し、
その出力をコンデンサＫで平滑化して子機に対し
て一定極性の電源としている。
構成を示す。平行２線Ｌ１，Ｌ２間には直流電圧
が印加されている。親機は多数の子機を順に走査
して第１図におけるスイツチング素子Ｓ１，Ｓ２
等を順に導通させて行く。第２図でＳは第１図の
Ｓ１等に相当し、Ｄは第１図のＤ１等に相当す
る。親機は子機走査に当つてスタート信号を各子
機に送る。この信号は短時間２線Ｌ１，Ｌ２間電
圧を０にするもので第３図にＡで示すようなパル
ス信号である。各子機はこのパルス信号を検出し
て各自に計時動作を開始し、各子機毎に予め定め
られた時間後に短時間スイツチング素子Ｓを導通
させる。このとき検出器ＤがONしていると２線
Ｌ１，Ｌ２間が短絡されるので子機からの発信も
第３図Ｂに示すようなパルスとなる。子機は２線
Ｌ１，Ｌ２から電源を得ているので、第３図に示
すように電源電圧がＶと０との間を変動しては困
るから整流器を介して２線Ｌ１，Ｌ２間電圧をコ
ンデンサに保持してこれを電源としている。かつ
この電源をＬ１，Ｌ２の極性に無関係にするため
ダイオードｄ１〜ｄ４で両波整流回路を構成し、
その出力をコンデンサＫで平滑化して子機に対し
て一定極性の電源としている。
１は親機から送られて来るスタート信号即ち第
３図のＡの信号を検出する検出回路であり、Ｔは
検出回路１からの検出信号でスタートするタイミ
ング回路である。検出回路１及びタイミング回路
Ｔが上述した電源により駆動される。検出回路１
も２線Ｌ１，Ｌ２への接続も無極性であることが
必要である。この点については後述するので、先
にタイミング回路の動作について説明しておく。
検出回路１によつて第３図Ａのスタート信号が検
出されるとフリツプフロツプＦがセツトされ、Ｆ
のセツト出力が印加されるとカウンタ２がクロツ
クパルスの計数を始める。クロツクパルスは水晶
によつて発振周期が一定に保たれているパルス発
生器PGから出力される。フリツプフロツプＦが
セツトされると以後検出回路１が第３図の信号Ｂ
（子機からの発信）を検出してもＦはセツトされ
たまゝだからカウンタ２の動作は変らない。カウ
ンタ２はｎ進カウンタで計数ｎになつたとき、計
数ｎの出力信号でフリツプフロツプＦをリセツト
する。ここで以後再び親機からスタート信号が送
られて来るのに備えられる。カウンタ２の計数出
力は一致回路３において設定回路４に予め設定し
てある数値出力と比較され両者が一致したとき、
一致回路３から出される信号でスイツチング素子
Ｓが導通せしめられる。従つてＳの導通している
期間はカウンタ２に印加されるクロツクの一周期
に相当する。クロツクパルス発生器PGは各子機
及び親機にあつて発振周期は全部等しくしてあ
る。原発振の周波数をクロツクパルスの周波数よ
り高くしておき、その原発振を分周してクロツク
パルスを作るようにし、フリツプフロツプＦのセ
ツト出力の立上りとその後の最初の原発振の出力
パルスとのアンドによつて分周動作を開始させる
ようにして、各子機におけるカウンタの計数歩進
の位相のばらつきを原発振の周期以内に納めるこ
とができるので、各子機及び親機におけるクロツ
クパルス発生器PG間の同期をとる必要はない。
親機にも一致回路２及び設定回路３を除いて子機
と同じ回路があつてスタート信号を出した後計時
動作を行い、第３図のＢの信号を検出した時のス
タート時点からの時間によりどの子機からの発信
かを判定する。
３図のＡの信号を検出する検出回路であり、Ｔは
検出回路１からの検出信号でスタートするタイミ
ング回路である。検出回路１及びタイミング回路
Ｔが上述した電源により駆動される。検出回路１
も２線Ｌ１，Ｌ２への接続も無極性であることが
必要である。この点については後述するので、先
にタイミング回路の動作について説明しておく。
検出回路１によつて第３図Ａのスタート信号が検
出されるとフリツプフロツプＦがセツトされ、Ｆ
のセツト出力が印加されるとカウンタ２がクロツ
クパルスの計数を始める。クロツクパルスは水晶
によつて発振周期が一定に保たれているパルス発
生器PGから出力される。フリツプフロツプＦが
セツトされると以後検出回路１が第３図の信号Ｂ
（子機からの発信）を検出してもＦはセツトされ
たまゝだからカウンタ２の動作は変らない。カウ
ンタ２はｎ進カウンタで計数ｎになつたとき、計
数ｎの出力信号でフリツプフロツプＦをリセツト
する。ここで以後再び親機からスタート信号が送
られて来るのに備えられる。カウンタ２の計数出
力は一致回路３において設定回路４に予め設定し
てある数値出力と比較され両者が一致したとき、
一致回路３から出される信号でスイツチング素子
Ｓが導通せしめられる。従つてＳの導通している
期間はカウンタ２に印加されるクロツクの一周期
に相当する。クロツクパルス発生器PGは各子機
及び親機にあつて発振周期は全部等しくしてあ
る。原発振の周波数をクロツクパルスの周波数よ
り高くしておき、その原発振を分周してクロツク
パルスを作るようにし、フリツプフロツプＦのセ
ツト出力の立上りとその後の最初の原発振の出力
パルスとのアンドによつて分周動作を開始させる
ようにして、各子機におけるカウンタの計数歩進
の位相のばらつきを原発振の周期以内に納めるこ
とができるので、各子機及び親機におけるクロツ
クパルス発生器PG間の同期をとる必要はない。
親機にも一致回路２及び設定回路３を除いて子機
と同じ回路があつてスタート信号を出した後計時
動作を行い、第３図のＢの信号を検出した時のス
タート時点からの時間によりどの子機からの発信
かを判定する。
第４図は検出回路１を無極性化した回路を示
す。第５図はその動作を示すタイムチヤートであ
る。５はパルス発生器で第５図に示すように２相
のパルス信号φ１，φ２を出力している。このパ
ルス発生器は第２図のクロツクパルス発生器PG
と同じ原発振器によつて駆動されている。クロツ
クパルスはφ１のパルスを例えば８個計数して１
クロツクパルスを出力するものである。第４図に
戻つて、６は一ビツトシフトレジスタでφ１でデ
ータを読込みφ２で出力する。INは入力端子で
第３図Ａの信号が入力される。第５図Ａ１は第３
図のスタート信号Ａの先端部を示す。Ａ２は子機
のＬ１，Ｌ２〜の接続が逆になつた場合でスター
ト信号の先端はローからハイに立上る。まずＡ１
の場合について述べる。Ａ１の立下りはφ１のイ
のパルスでシフトレジスタ６に読込まれφ２のロ
のパルスで出力されるから、６の出力は第５図
のようになる。Ａ１の信号と６の出力とが不一致
回路７に入力され、両者不一致のとき出力１が出
るので７の出力は第５図のようになる。この信
号がスタート信号の検出信号となる。スタート信
号の先端が立上りになる第５図Ａ２の場合シフト
レジスタ６の出力は第５図′のようになり不一
致回路７の出力は′のようになつて′はと同
じである。
す。第５図はその動作を示すタイムチヤートであ
る。５はパルス発生器で第５図に示すように２相
のパルス信号φ１，φ２を出力している。このパ
ルス発生器は第２図のクロツクパルス発生器PG
と同じ原発振器によつて駆動されている。クロツ
クパルスはφ１のパルスを例えば８個計数して１
クロツクパルスを出力するものである。第４図に
戻つて、６は一ビツトシフトレジスタでφ１でデ
ータを読込みφ２で出力する。INは入力端子で
第３図Ａの信号が入力される。第５図Ａ１は第３
図のスタート信号Ａの先端部を示す。Ａ２は子機
のＬ１，Ｌ２〜の接続が逆になつた場合でスター
ト信号の先端はローからハイに立上る。まずＡ１
の場合について述べる。Ａ１の立下りはφ１のイ
のパルスでシフトレジスタ６に読込まれφ２のロ
のパルスで出力されるから、６の出力は第５図
のようになる。Ａ１の信号と６の出力とが不一致
回路７に入力され、両者不一致のとき出力１が出
るので７の出力は第５図のようになる。この信
号がスタート信号の検出信号となる。スタート信
号の先端が立上りになる第５図Ａ２の場合シフト
レジスタ６の出力は第５図′のようになり不一
致回路７の出力は′のようになつて′はと同
じである。
本発明信号伝送装置は上述したような構成で、
親機に接続された平行２線間に多数の子機を接続
する方式で平行２線を信号伝送にも、子機への電
源供給にも利用するものにおいて、上記平行２線
の極性を考慮しないでよいから装置を設置するに
当り配線作業が楽で誤配線の心配が全くない。
親機に接続された平行２線間に多数の子機を接続
する方式で平行２線を信号伝送にも、子機への電
源供給にも利用するものにおいて、上記平行２線
の極性を考慮しないでよいから装置を設置するに
当り配線作業が楽で誤配線の心配が全くない。
第１図は本発明の対象となつている信号伝送装
置の構成を示す略図、第２図は本発明の一実施例
装置の要部を示すブロツク図、第３図は伝送２線
間に現れる信号波形図、第４図は上記実施例にお
けるスタート信号検出回路の図、第５図はその動
作を示すタイムチヤートである。 Ａ……親機、Ｃ１，Ｃ２……子機、Ｄ１，Ｄ２
……検出器、Ｓ１，Ｓ２……スイツチング素子、
Ｌ１，Ｌ２……平行２線。
置の構成を示す略図、第２図は本発明の一実施例
装置の要部を示すブロツク図、第３図は伝送２線
間に現れる信号波形図、第４図は上記実施例にお
けるスタート信号検出回路の図、第５図はその動
作を示すタイムチヤートである。 Ａ……親機、Ｃ１，Ｃ２……子機、Ｄ１，Ｄ２
……検出器、Ｓ１，Ｓ２……スイツチング素子、
Ｌ１，Ｌ２……平行２線。
Claims (1)
- １ 親機に接続されて相互間に電圧が印加されて
いる平行２線間に相互並列に多数の子機を接続
し、各子機は上記平行２線を通して親機からの信
号を受けて所定のタイミングで発信を行う構成に
おいて、各子機は上記平行２線間に両波整流回路
及び平滑用コンデンサよりなる電源回路を接続し
て自身の駆動電源とし、上記平行２線間電圧と同
電圧の変化を遅延させる回路の出力とを不一致回
路に印加し、同不一致回路から出力される不一致
信号によつて親機からの信号の検出信号とするよ
うにしたことを特徴とする信号伝送装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1826381A JPS57132296A (en) | 1981-02-10 | 1981-02-10 | Signal transmitter |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1826381A JPS57132296A (en) | 1981-02-10 | 1981-02-10 | Signal transmitter |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57132296A JPS57132296A (en) | 1982-08-16 |
| JPH0132694B2 true JPH0132694B2 (ja) | 1989-07-10 |
Family
ID=11966781
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1826381A Granted JPS57132296A (en) | 1981-02-10 | 1981-02-10 | Signal transmitter |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57132296A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006522380A (ja) * | 2003-09-15 | 2006-09-28 | ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング | センサ |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5235906A (en) * | 1975-09-17 | 1977-03-18 | Hitachi Ltd | Correcting circuit for input signal polarity |
| JPS52109804A (en) * | 1976-01-09 | 1977-09-14 | Post Office | Data transmission system |
-
1981
- 1981-02-10 JP JP1826381A patent/JPS57132296A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5235906A (en) * | 1975-09-17 | 1977-03-18 | Hitachi Ltd | Correcting circuit for input signal polarity |
| JPS52109804A (en) * | 1976-01-09 | 1977-09-14 | Post Office | Data transmission system |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006522380A (ja) * | 2003-09-15 | 2006-09-28 | ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング | センサ |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57132296A (en) | 1982-08-16 |
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