JPH01311708A - Graphic equalizer - Google Patents
Graphic equalizerInfo
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- JPH01311708A JPH01311708A JP63143071A JP14307188A JPH01311708A JP H01311708 A JPH01311708 A JP H01311708A JP 63143071 A JP63143071 A JP 63143071A JP 14307188 A JP14307188 A JP 14307188A JP H01311708 A JPH01311708 A JP H01311708A
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- Tone Control, Compression And Expansion, Limiting Amplitude (AREA)
Abstract
Description
【発明の詳細な説明】
〈産業上の利用分野〉
本発明はの表示素子の輝度を制御するグラフィックイコ
ライザに係り、特に２つの表示パターンを輝度の違いに
より明確に表示できるグラフィックイコライザに関する
。DETAILED DESCRIPTION OF THE INVENTION <Industrial Application Field> The present invention relates to a graphic equalizer for controlling the brightness of a display element, and more particularly to a graphic equalizer that can clearly display two display patterns based on the difference in brightness.
〈従来技術〉
オーディオ機器のグラフィックイコライザには、各周波
数帯域における信号レベルを直視的に表示したり（スペ
アナ表示）、イコライザカーブ（ＥＱカーブ）を表示し
たりするための表示器（スペアナ表示器）が装備されて
おり、スペアナ表示に際しては各周波数帯域の信号レベ
ルが実時間で帯グラフ状に表示されるようになっている
。このため、聴取者はスペアナ表示を一目見るだけで低
域。<Prior art> The graphic equalizer of audio equipment has a display device (spectral analyzer display) that directly displays the signal level in each frequency band (spectral analyzer display) and displays the equalizer curve (EQ curve). When displaying the spectrum analyzer, the signal level of each frequency band is displayed in real time in the form of a band graph. For this reason, listeners can detect low frequencies just by looking at the spectrum analyzer display.
高域、あるいは中域の信号レベルを認識できると共に、
各帯域が所望のレベル特性を有しているか否かを容易に
判別することができる。なお、このスペアナ表示によれ
ば、各周波数帯域につき信号レベルが小さいときは下方
の表示素子が点灯し。In addition to being able to recognize signal levels in the high or mid range,
It can be easily determined whether each band has desired level characteristics. According to this spectrum analyzer display, when the signal level is low for each frequency band, the lower display element lights up.
信号レベルが大きくなるにつれて上部の表示素子まで点
灯する。As the signal level increases, even the upper display elements light up.
一方、ＥＱカーブ表示に際しては折線状にＥＱカーブが
表示されるようになっており、該表示によりＥ Ｑカー
ブを確認したり所望の特性に設定できる。On the other hand, when displaying the EQ curve, the EQ curve is displayed in the form of a broken line, and the EQ curve can be checked and set to desired characteristics using this display.
〈発明が解決しようとする課題〉
かかる従来のグラフィックイコライザでは、スペアナ表
示によりレベルの変化を確認しながらイコライザ（ＥＱ
）カーブを設定することができなかった。<Problem to be solved by the invention> In such a conventional graphic equalizer, the equalizer (EQ
) The curve could not be set.
以上から本発明の目的は、２つの表示パターン（例えば
スペアナ、ＥＱカーブ）を輝度の違いにより同時に明確
に表示できるグラフィックイコライザを提供することで
ある。From the above, it is an object of the present invention to provide a graphic equalizer that can clearly display two display patterns (for example, spectrum analyzer and EQ curve) at the same time based on differences in brightness.
く課題を解決するための手段〉
第１図は本発明の一実施例を示すグラフィックイコラザ
のブロック構成図である。Means for Solving the Problems> FIG. 1 is a block diagram of a graphic equalizer showing an embodiment of the present invention.
１はレベル検出器、２はタイミング制御手段２ａ２表示
パターン切換制御手段２ｂを有するコン１−ロールマイ
コン、３は表示ユニツｔ−，Ｄｉはディジット駆動信号
である。1 is a level detector, 2 is a controller 1-roll microcomputer having timing control means 2a2 and display pattern switching control means 2b, 3 is a display unit t-, and Di is a digit drive signal.
〈作用〉
本発明においては、表示パターン切換制御手段２ｂが所
定のタイミングで第１の表示パターンと、第１の表示パ
ターンに別の表示パターンが合成さ九た第２の表示パタ
ーンとを切り換えて表示させることにより、所定時間内
での第１の表示パターンの表示回数を１１１ｊ記別の表
示パターンの表示回数以上に設定する５、なお、タイミ
ング制御手段２ａは第１の表示パターンと第２の表示パ
ターンにおけるディジット駆動信号Ｉ）１のパルス幅を
可変することにより、第１および第２の表示パターンの
１サイクル当りの表示時間を設定する。<Operation> In the present invention, the display pattern switching control means 2b switches at a predetermined timing between the first display pattern and the second display pattern in which another display pattern is combined with the first display pattern. By displaying, the number of times the first display pattern is displayed within a predetermined period of time is set to be greater than or equal to the number of times the display pattern specified in 111j is displayed. By varying the pulse width of the digit drive signal I)1 in the display pattern, the display time per cycle of the first and second display patterns is set.
〈実施例〉
第１図は本考案の一実施例を示すグラフィックイコライ
ザのブロック構成図である。<Embodiment> FIG. 1 is a block diagram of a graphic equalizer showing an embodiment of the present invention.
１は各周波数９１シ域におけるオーディオ信号レベルを
検出するレベル検出部、２はタイミング制御手段２ａ、
表示パターン切換制御手段２ｂ等を有するコントロール
マイコン、３は各周波数帯域に対応させて表示素子列が
配列された表示ユニット。1 is a level detection unit that detects the audio signal level in each 91 frequency range; 2 is a timing control means 2a;
A control microcomputer includes display pattern switching control means 2b, etc., and 3 is a display unit in which rows of display elements are arranged corresponding to each frequency band.
４はオーディオ信号ＡＳの周波数特性を制御するための
イコライザ部、５は各種キーを備えた操作部、６はディ
ジットドライバ、７はセグメントドライバであり、それ
ぞれ表示ユニット３の各表示素子を駆動してスペアナ／
イコライザ特性表示を行う。4 is an equalizer section for controlling the frequency characteristics of the audio signal AS, 5 is an operation section equipped with various keys, 6 is a digit driver, and 7 is a segment driver, each of which drives each display element of the display unit 3. Spectrum analyzer/
Displays equalizer characteristics.
レベル検出器ｌは、オーディオ信号ＡＳの周波数帯域を
ｉ（ｊは整数）分割した時、各周波数帯域毎にバンドパ
スフィルタＢＰＦｉを有するフィルタ部１ａと１周期的
に所定のバンドパスフィルタＢＰＦｉの出力Ｌｉを選択
する周波数時分割回路１ｂと、入力された信号レベルＬ
を基準レベルと比較してＪステップ（ｊは整数）のどの
ステップにあるかを判断するレベル比較器１ｃを有して
いる。When the frequency band of the audio signal AS is divided into i (j is an integer), the level detector l includes a filter section 1a having a band pass filter BPFi for each frequency band and an output of a predetermined band pass filter BPFi in one cycle. Frequency time division circuit 1b that selects Li and input signal level L
It has a level comparator 1c that compares the level with a reference level to determine which step of J steps (j is an integer) the current level is in.
タイミング制御手段２ａは、バンドパスフィルタ出力Ｌ
ｉの切換信号ＢＣ３やセグメント即動信号ＳＪ、ディジ
ット關動信号Ｄｉを出力させるタイミングを制御する。The timing control means 2a has a bandpass filter output L.
It controls the timing of outputting the switching signal BC3 of i, the segment immediate motion signal SJ, and the digit motion signal Di.
そして、タイミング制御手段２ａは、設定により第１の
表示パターンと第２の表示パターン（第１の表示パター
ンと別の表示パターンを合成したもの）におけるディジ
ット駆動信号Ｄｉのパルス幅を可変することができる。The timing control means 2a can vary the pulse width of the digit drive signal Di in the first display pattern and the second display pattern (a combination of the first display pattern and another display pattern) by setting. can.
表示パターン切換制御手段２ｂは、所定のタイミングで
第１の表示パターンと、第１の表示パターンに別の表示
パターンが合成された第２の表示パターンとを切り換え
て表示させることにより、所定時間内での第１の表示パ
ターンの表示回数を前記別の表示パターンの表示回数以
上に設定する。The display pattern switching control means 2b switches and displays the first display pattern and the second display pattern, which is a combination of the first display pattern and another display pattern, at a predetermined timing, thereby displaying the first display pattern within a predetermined time. The number of times the first display pattern is displayed is set to be greater than or equal to the number of times the other display pattern is displayed.
また、表示パターン切換制御手段２ｂは輝度制御手段を
兼ねており１表示パターンと信号レベルに基いて点灯表
示する表示素子を決定し、タイミング信号に基いてセグ
メント信号Ｓｊを出力する。The display pattern switching control means 2b also serves as a brightness control means, determines display elements to be lit and displayed based on one display pattern and the signal level, and outputs a segment signal Sj based on a timing signal.
イコライザ制御手段２Ｃは、設定されたＥＱカーブに従
ってイコライザ部４を制御し、オーディオ信号ＡＳの各
周波数帯域のイコライザレベルを制御する。The equalizer control means 2C controls the equalizer section 4 according to the set EQ curve, and controls the equalizer level of each frequency band of the audio signal AS.
表示ユニット３は、第２図（ａ）、（ｂ）に示すように
表示盤面１０の右方向へ６０，１２０゜２５０、・・（
七）の周波数目盛を有する周波数軸Ｘが、上方向へＭＩ
ＮからＭＡＸまでの信号レベル軸ｙが割り当てられてい
る。なお１周波数目盛は帯域の中心周波数を示している
。そして、各周波数帯域毎に複数（例えば１３個）の表
示素子１０ａが一列に信号レベル軸方向へ並べられて表
示素子列２０−１．２０−２． ・・、２０−ｉが形
成されている。As shown in FIGS. 2(a) and 2(b), the display unit 3 moves 60, 120 degrees, 250 degrees,...(
7) The frequency axis X having the frequency scale is upwardly MI
A signal level axis y from N to MAX is assigned. Note that one frequency scale indicates the center frequency of the band. A plurality of (for example, 13) display elements 10a are arranged in a row in the signal level axis direction for each frequency band, and display element rows 20-1, 20-2. ..., 20-i are formed.
第２図（ａ）には第１の表示パターンとなるＥＱシカ−
表示（図中開部）が、また第２図（ｂ）にはＥＱシカ−
表示にスペアナ表示（図中Ｚ部）が合成された第２の表
示パターンがそれぞれ表示されている。Figure 2(a) shows the EQ deer which is the first display pattern.
The display (opening in the figure) is also shown in Figure 2 (b).
A second display pattern in which a spectrum analyzer display (section Z in the figure) is combined with the display is displayed.
本発明による表示パターン切換制御手段２ｂは、最初し
こ第１の表示パターンを表示させ、次に第２の表示パタ
ーンを表示させる。続いて、再び第１の表示パターンを
表示させ、第１の表示パターンと第２の表示パターンを
交互に表示させる。このように表示パターンを切り換え
て表示させると。The display pattern switching control means 2b according to the present invention first displays the first display pattern and then displays the second display pattern. Subsequently, the first display pattern is displayed again, and the first display pattern and the second display pattern are displayed alternately. If you switch the display pattern like this and display it.
ＥＱシカ−表示は第１および第２の表示パターンの両方
で表示され、スペアナ表示は第２の表示パターンのみで
表示される。このため、ＥＱシカ−表示がスペアナ表示
よりも高輝度のように人間の目に映る。The EQ deer display is displayed in both the first and second display patterns, and the spectrum analyzer display is displayed only in the second display pattern. Therefore, the EQ deer display appears to the human eye to have higher brightness than the spectrum analyzer display.
このように高輝度で見せたい第１の表示パターン（この
実施例ではＥＱシカ−表示）と、低輝度で見せたい表示
パターン（この実施例ではスペアナ表示）を含む第２の
表示パターンの表示回数を１：１ （すなわち２回に１
回）とすることで１表示パターン毎に輝度差を設けるこ
とができる。In this way, the number of display times of the first display pattern that you want to show at high brightness (EQ deer display in this example) and the second display pattern that includes the display pattern that you want to show at low brightness (spectrum analyzer display in this example) 1:1 (i.e. 1 in 2
times), it is possible to provide a brightness difference for each display pattern.
また、輝度差を更に拡大したい場合は、２：１゜３：１
．・・・等の表示回数に設定することにより可能である
。ただし、このような表示回数による輝度制御では、所
定時間内に１つの表示パターンが表示される回数（フレ
ーム周波数）が低下する。Also, if you want to further expand the brightness difference, use 2:1 ° 3:1
．． This is possible by setting the number of display times such as... However, in such brightness control based on the number of display times, the number of times one display pattern is displayed within a predetermined time (frame frequency) decreases.
一般に本件のグラフィックイコライザ等のダイナミック
表示には１００七以上のフレーム周波数が必要とされて
いるので、これを確保するために表示パターン切り換え
タイミングを高速化しなければならない（例えば表示回
数が３；１なら１つの表示パターンを２．５ｍ５ｅｃ以
内で切り換えなければならない）、シかし、コントロー
ルマイコン２の処理スピードによる制約や、表示桁数（
周波数帯域数）が多くなφはど１つの表示パターンを表
示し終わるまでの時間が掛るため、表示パターン切り換
えタイミングの高速化にはおのずと限界がある。以下に
表示回数に頼らない、換言すれば表示回数１：１のまま
で輝度差を拡大するための動作を説明する。Generally, a frame frequency of 1007 or more is required for dynamic display such as the graphic equalizer in this case, so in order to ensure this, the display pattern switching timing must be accelerated (for example, if the number of displays is 3; One display pattern must be switched within 2.5m5ec), markings, restrictions due to the processing speed of the control microcomputer 2, and the number of display digits (
Since it takes time to finish displaying one display pattern when φ has a large number of frequency bands, there is naturally a limit to speeding up the display pattern switching timing. The following describes an operation for expanding the brightness difference without relying on the number of displays, in other words, with the number of displays remaining 1:1.
第３図は第１および第２の表示パターンにおけるディジ
ット駆動信号Ｄｉとセグメント駆動信号Ｓｊを示すタイ
ミングチャートである。FIG. 3 is a timing chart showing the digit drive signal Di and segment drive signal Sj in the first and second display patterns.
図において５Ｔは１桁の表示時間（１周波数帯域の表示
時間）に相当する高輝度表示の表示時間、Ｔ／Ｎは低輝
度表示の表示時間、ただしＮは任意の定数である。In the figure, 5T is a high brightness display time corresponding to a one-digit display time (one frequency band display time), T/N is a low brightness display time, and N is an arbitrary constant.
図示のように本発明によるタイミング制御手段２ａは、
第１の表示パターンと第２の表示パターンにおけるディ
ジット駆動信号Ｄｉのパルス幅。As shown in the figure, the timing control means 2a according to the present invention includes:
Pulse width of the digit drive signal Di in the first display pattern and the second display pattern.
すなわち高輝度表示の表示時間Ｔと低輝度表示の表示時
間Ｔ／Ｎを可変することにより、第１および第２の表示
パターンの表示時間を設定する。すなわち、高輝度にて
点灯させたい表示パターンである第１の表示パターンは
ディジット駆動信号Ｄｉのパルス幅を最大にし、低輝度
にて点灯させたい表示パターンを含む第２の表示パター
ンはディジット駆動信号Ｄｉのパルス幅を輝度に応じて
狭くする。That is, by varying the display time T for high brightness display and the display time T/N for low brightness display, the display times for the first and second display patterns are set. That is, the first display pattern, which is a display pattern to be lit at high brightness, maximizes the pulse width of the digit drive signal Di, and the second display pattern, which includes a display pattern to be lit at low brightness, is the digit drive signal. The pulse width of Di is narrowed according to the brightness.
このように１桁の表示時間を変えずに、換言すればフレ
ーム周波数を変えずにディジット駆動信号Ｄｉのパルス
幅を変えることにより、輝度差を得ることができる。な
お、セグメント駆動信号Ｓｊのパルス幅を可変しても同
様の効果を奏する。In this way, the brightness difference can be obtained by changing the pulse width of the digit drive signal Di without changing the display time of one digit, in other words, without changing the frame frequency. Note that the same effect can be obtained even if the pulse width of the segment drive signal Sj is varied.
第４図はスペアナ表示の模式図であり、７バンドのスペ
アナ表示器を示している。FIG. 4 is a schematic diagram of a spectrum analyzer display, showing a seven-band spectrum analyzer display.
図中、第１の表示パターンとなるワマークは明点灯（図
中開部）、０マークと合成されて第２の表示パターンと
なるスペアナ表示は暗点灯（図中［］部）で表示される
。In the figure, the wa mark, which is the first display pattern, is brightly lit (the open part in the figure), and the spectrum analyzer display, which is combined with the 0 mark and becomes the second display pattern, is darkly lit (the [] part in the figure). .
この実施例では各周波数成分につき、スペアナ表示は時
間と共に変化するが、ワマークは静止しているので、そ
の表示の違いがわかる。このように本発明による輝度制
御を用いて文字、数字、記号の少なくとも１つを第１の
表示パターンとすることにより、スペアナ表示器の大型
デイスプレィを有効に利用でき、ユーザに視覚的に楽し
いグラフィックイコライザを提供することができる。In this embodiment, the spectrum analyzer display changes with time for each frequency component, but the mark is stationary, so the difference in the display can be seen. In this way, by using the brightness control according to the present invention to set at least one of letters, numbers, and symbols as the first display pattern, the large display of the spectrum analyzer can be used effectively, and the user can enjoy visually pleasing graphics. Equalizer can be provided.
〈発明の効果〉
以上本発明によれば、所定のタイミングで第１の表示パ
ターンと、第１の表示パターンに別の表示パターンが合
成された第２の表示パターンとを切り換えて表示させる
表示パターン切換制御手段を設け、この表示パターン切
換制御手段により。<Effects of the Invention> According to the present invention, a display pattern is provided in which the first display pattern and the second display pattern, which is a combination of the first display pattern and another display pattern, are switched and displayed at a predetermined timing. A switching control means is provided, and by this display pattern switching control means.
所定時間内での第１の表示パターンの表示回数を前記別
の表示パターン（第３の表示パターン）の表示回数以上
に設定し、更に第］の表示パターンと第２の表示パター
ンにおけるディジット耗動信号のパルス輻を可変するタ
イミング制御手段を設け、このタイミング制御手段によ
り、第１および第２の表示パターンの表示時間を設定す
るように構成したから、第１．第３の２つの表示パター
ンの輝度を可変することができ、同時にかつ明確に表示
できる。The number of times the first display pattern is displayed within a predetermined period of time is set to be greater than or equal to the number of times the other display pattern (third display pattern) is displayed; Since the timing control means for varying the pulse intensity of the signal is provided, and the display time of the first and second display patterns is set by the timing control means, the first and second display patterns can be set. The brightness of the third two display patterns can be varied and can be displayed simultaneously and clearly.
第１図は本発明の一実施例を示すグラフィックイコラザ
のブロック構成図、
第２図＜ａ）、（ｂ）は第１および第２の表示パターン
を示すための表示ユニッ１への外観説明図、
第３図は第１および第２の表示パターンにおけるディジ
ット駆動信号Ｄ１とセグメント駆動信号Ｓ 、ｊを示す
タイミングチャート、
第４図はスペアナ表示の模式図。
１・・レベル検出器、
２・・コントロールマイコン。
２ａ・・タイミング制御手段
２ｂ・・表示パターン切換制御手段
３・・表示ユニット。
Ｄｉ・・ディジット駆動信号。
特許出願人 アルパイン株式会社代理人
弁理士 齋藤千幹第３図
第４図
四Ｓ枦、（
口鼎FIG. 1 is a block diagram of a graphic equalizer showing an embodiment of the present invention, and FIG. FIG. 3 is a timing chart showing the digit drive signal D1 and segment drive signals S and j in the first and second display patterns, and FIG. 4 is a schematic diagram of a spectrum analyzer display. 1. Level detector, 2. Control microcomputer. 2a...Timing control means 2b...Display pattern switching control means 3...Display unit. Di...Digital drive signal. Patent Applicant Alpine Co., Ltd. Agent Patent Attorney Chiki Saito Figure 3 Figure 4 4S, (Kuchiding
Claims (1)
に別の表示パターンが合成された第２の表示パターンと
をサイクリックに表示するグラフィックイコライザであ
って、 所定のタイミングで前記第１の表示パターンと前記第２
の表示パターンとを切り換えて表示させる表示パターン
切換制御手段を有することを特徴とするグラフィックイ
コライザ。（２）前記第１の表示パターンと前記第２の
表示パターンにおけるディジット駆動信号のパルス幅に
差を持たせるタイミング制御手段を有することを特徴と
する特許請求の範囲第１項記載のグラフィックイコライ
ザ。 （３）前記第１の表示パターンは、文字、数字、記号の
少なくとも１つを表すことを特徴とする特許請求の範囲
第１項および第２項記載のグラフィックイコライザ。[Scope of Claims] (1) A graphic equalizer that cyclically displays a first display pattern and a second display pattern in which another display pattern is synthesized with the first display pattern, the graphic equalizer comprising: The first display pattern and the second display pattern are displayed at the timing of
1. A graphic equalizer comprising display pattern switching control means for switching and displaying a display pattern. (2) The graphic equalizer according to claim 1, further comprising timing control means for causing a difference in pulse width of the digit drive signal between the first display pattern and the second display pattern. (3) The graphic equalizer according to claims 1 and 2, wherein the first display pattern represents at least one of letters, numbers, and symbols.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14307188A JP2575813B2 (en) | 1988-06-10 | 1988-06-10 | Graphic equalizer |
Applications Claiming Priority (1)
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|---|---|---|---|
| JP14307188A JP2575813B2 (en) | 1988-06-10 | 1988-06-10 | Graphic equalizer |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01311708A true JPH01311708A (en) | 1989-12-15 |
| JP2575813B2 JP2575813B2 (en) | 1997-01-29 |
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ID=15330245
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14307188A Expired - Fee Related JP2575813B2 (en) | 1988-06-10 | 1988-06-10 | Graphic equalizer |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2575813B2 (en) |
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| JP2575813B2 (en) | 1997-01-29 |
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