JPH01264014A - Diode switch circuit - Google Patents
Diode switch circuitInfo
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- JPH01264014A JPH01264014A JP9283488A JP9283488A JPH01264014A JP H01264014 A JPH01264014 A JP H01264014A JP 9283488 A JP9283488 A JP 9283488A JP 9283488 A JP9283488 A JP 9283488A JP H01264014 A JPH01264014 A JP H01264014A
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Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は高周波数帯の伝送路などに用いられる、ダイオ
ードスイッチ回路に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a diode switch circuit used in high frequency band transmission lines.
ダイオードスイッチング回路は伝送路途中などに挿入さ
れ、外部から与えられる制御信号により伝送信号の導通
、遮断の制御が行われる。第６図に示す従来のダイオー
ドスイッチ回路は、信号入力端子１および信号出力端子
２、制御信号入力端子３および４を有している。この制
御信号入力端子３および４は、たとえば伝送信号の監視
装置（図示せず）に接続されており、伝送信号に異常が
認められると、伝送信号を遮断するような制御信号を与
えられる。すなわち、第６図のダイオードスイッチ回路
において、通常は制御信号入力端子３に（＝）、４に（
＋）の極性を有する制御信号が与えられる。このような
制御信号に対し、ダイオード７および８はＯＦＦ、ダイ
オード５がＯＮとなるため、信号入力端子１に入力され
た伝送信号は、直流カット用のコンデンサ１６．ダイオ
ード５およびコンデンサ１７を介して信号出力端子２か
ら出力される。A diode switching circuit is inserted in the middle of a transmission path, and conduction/cutoff of a transmission signal is controlled by a control signal applied from the outside. The conventional diode switch circuit shown in FIG. 6 has a signal input terminal 1, a signal output terminal 2, and control signal input terminals 3 and 4. The control signal input terminals 3 and 4 are connected to, for example, a transmission signal monitoring device (not shown), and when an abnormality is detected in the transmission signal, a control signal is given to cut off the transmission signal. That is, in the diode switch circuit shown in FIG. 6, normally (=) is applied to control signal input terminal 3 and (
A control signal having a polarity of +) is applied. In response to such a control signal, diodes 7 and 8 are turned off and diode 5 is turned on, so that the transmission signal input to the signal input terminal 1 is passed through the DC cut capacitor 16. The signal is output from the signal output terminal 2 via the diode 5 and the capacitor 17.
一方、伝送信号に異常があった場合、監視装置からの制
御信号の極性が反転し、制御信号入力端子３には（＋）
の、端子４には（−）の極性を有する制御信号が与えら
れる。そのためダイオード７および８は○Ｎ、ダイオー
ド５はＯＦＦとなり、伝送信号はダイオード５で遮断さ
れる。また、各ダイオード５，７および８に並列接続さ
れた抵抗１０．１２および１４は十分値の大きいものを
使用しているため、抵抗１０を通って信号出力端子２か
ら出力される伝送信号はほとんどない。On the other hand, if there is an abnormality in the transmission signal, the polarity of the control signal from the monitoring device is reversed, and the control signal input terminal 3 becomes (+).
A control signal having a (-) polarity is applied to the terminal 4 of. Therefore, diodes 7 and 8 are turned on, diode 5 is turned off, and the transmission signal is cut off by diode 5. Also, since the resistors 10, 12 and 14 connected in parallel to the diodes 5, 7 and 8 have sufficiently large values, almost no transmission signal is output from the signal output terminal 2 through the resistor 10. do not have.
このようなダイオードスイッチ回路において、スイッチ
がＯＦＦ （ダイオード５が０ＦＦ）の時、第６図のダ
イオードスイッチ回路は等価的に第７図の様に書くこと
ができる。上述したように抵抗１０は十分大きい値を有
しているので、信号入力端子１から見たインピーダンス
はショートとなり、インピーダンスの整合を取ることが
不可能となる。In such a diode switch circuit, when the switch is OFF (diode 5 is OFF), the diode switch circuit shown in FIG. 6 can be equivalently written as shown in FIG. 7. As described above, since the resistor 10 has a sufficiently large value, the impedance seen from the signal input terminal 1 becomes a short circuit, making it impossible to match the impedance.
そのため、このダイオードスイッチ回路を定インピーダ
ンス回路で使用すると、インピーダンス不整合により信
号の反射が起きるという問題があった。Therefore, when this diode switch circuit is used in a constant impedance circuit, there is a problem in that signal reflection occurs due to impedance mismatch.
本発明の目的は、上記の問題点を解決した、スイッチＯ
ＦＦ時にもインピーダンス整合をとることが可能なダイ
オードスイッチ回路を提供することにある。The object of the present invention is to solve the above-mentioned problems by using a switch O.
An object of the present invention is to provide a diode switch circuit that can perform impedance matching even during FF operation.
そのため、本発明では従来インピーダンス的にショート
となっていた線路にインピーダンス整合用の抵抗を設け
ることにより、上記目的を達成している。Therefore, in the present invention, the above object is achieved by providing an impedance matching resistor on a line that has conventionally been short-circuited in terms of impedance.
次に、本発明について図面を参照して説明する。 Next, the present invention will be explained with reference to the drawings.
第１図は、本発明の第１の実施例を示す回路図である。FIG. 1 is a circuit diagram showing a first embodiment of the present invention.
第１図において、本発明のダイオードスイッチ回路は、
第６図に示した従来回路の制御信号入力端子３とダイオ
ード７の間にインピーダンス整合用の抵抗１３を直列に
挿入したことを特徴としている。このため、制御信号入
力端子３に（±）、端子４に（−）の極性を有する制御
信号が印加されてダイオード５がＯＦＦになった時の第
１図の等価回路は第２図の様になり、データ入力端子１
から見たインピーダンスは抵抗１３で終端され、この抵
抗１３の値により、インピーダンス整合を行うことが可
能となる。In FIG. 1, the diode switch circuit of the present invention is
This circuit is characterized in that a resistor 13 for impedance matching is inserted in series between the control signal input terminal 3 and the diode 7 of the conventional circuit shown in FIG. Therefore, when a control signal having a polarity of (±) is applied to the control signal input terminal 3 and a control signal having a polarity of (-) is applied to the terminal 4, and the diode 5 is turned off, the equivalent circuit in FIG. 1 is as shown in FIG. and data input terminal 1
The impedance seen from is terminated by a resistor 13, and the value of this resistor 13 makes it possible to perform impedance matching.
前述した通り、ダイオードスイッチ回路は制御信号によ
り伝送信号の導通、遮断を行うことを目的とした回路だ
が、第１図に示した回路において、ダイオード５がＯＦ
Ｆの場合でも、抵抗１０およびコンデンサ１７を通り、
信号出力端子２から伝送信号がわずかながら出力されて
しまう。この、スイッチＯＦＦ時の出力を減少させた、
本発明の第２実施例を第３図に示す。As mentioned above, the diode switch circuit is a circuit whose purpose is to conduct or cut off transmission signals using control signals.
Even in the case of F, it passes through the resistor 10 and capacitor 17,
A small amount of the transmission signal is output from the signal output terminal 2. This reduces the output when the switch is OFF,
A second embodiment of the invention is shown in FIG.
第３図に示す本発明の第２実施例は、第１図に示した第
１実施例の回路において、スイッチＯＦＦ時に出力され
た信号を減衰する手段を付加したものである。この手段
は、ダイオードと抵抗の並列回路２つと、１つのコンデ
ンサとから構成されている。２つの並列回路のうち、ダ
イオード６および抵抗１１からなる第１の並列回路は、
第１図におけるダイオード５と抵抗１０の並列回路と、
第２のコンデンサ１７との接続点に、ダイオードの同極
性電極（７ノードと７ノード、又はカソードとカソード
）を接続する形で接続される。また、ダイオード９から
なるもう一つの並列回路は、第１の並列回路と第２のコ
ンデンサ１７との接続点に、ダイオードの同極性電極を
接続する形で接続されている。コンデンサ２０はその一
端を第２の並列回路に、他端を接地されている。さらに
コンデンサ２０と第２の並列回路の接続点は、制御信号
入力端子３に接続されている。A second embodiment of the present invention shown in FIG. 3 is obtained by adding means for attenuating the signal output when the switch is OFF to the circuit of the first embodiment shown in FIG. This means consists of two parallel circuits of diodes and resistors and one capacitor. Of the two parallel circuits, the first parallel circuit consisting of the diode 6 and the resistor 11 is
A parallel circuit of a diode 5 and a resistor 10 in FIG. 1,
The same polarity electrodes (7 nodes and 7 nodes, or cathodes and cathodes) of diodes are connected to the connection point with the second capacitor 17. Another parallel circuit including the diode 9 is connected to the connection point between the first parallel circuit and the second capacitor 17 by connecting the same polarity electrodes of the diode. The capacitor 20 has one end connected to the second parallel circuit and the other end connected to ground. Further, a connection point between the capacitor 20 and the second parallel circuit is connected to the control signal input terminal 3.
第３図の回路において、制御信号入力端子３に（−）の
、４に（＋）の電位を有する制御信号が与えられると、
ダイオード７〜９はＯＦＦ、ダイオード５および６はＯ
Ｎとなり、伝送データはデータ入力端子１からデータ出
力端子２へ伝わる。In the circuit shown in FIG. 3, when a control signal having a (-) potential is applied to the control signal input terminal 3 and a (+) potential to the control signal input terminal 4,
Diodes 7 to 9 are OFF, diodes 5 and 6 are OFF.
N, and the transmission data is transmitted from data input terminal 1 to data output terminal 2.
制御信号の極性が反転すると、ダイオード５および６は
ＯＦＦ、ダイオード７〜９はＯＮとなる。When the polarity of the control signal is reversed, diodes 5 and 6 are turned off and diodes 7 to 9 are turned on.
この時、データ入力端子ｌから入力されたデータは、ダ
イオード５で遮断される。しかし抵抗１０を介して出力
される信号はＯＮのダイオード８を通りアースされるか
、ダイオード６および抵抗１１で遮断されるため、信号
出力端子２から出力される信号はさらに減少する。第３
図に示したダイオードスイッチ回路がＯＦＦの場合の等
価回路を、第４図に示す。第５図は本発明の第３の実施
例を示す回路図である。今まで説明したきた第１および
第２の実施例において、抵抗１２はダイオード７および
抵抗１３に並列接続されているが、抵抗１２はダイオー
ド７がＯＦＦの時の電流回避用の抵抗であり、その値は
非常に大きいものであるから、その接続をダイオード７
のみに並列となるように接続しても、本発明の本質には
変わりがないことは明らかである。At this time, the data input from the data input terminal l is blocked by the diode 5. However, since the signal outputted through the resistor 10 passes through the ON diode 8 and is grounded, or is blocked by the diode 6 and the resistor 11, the signal outputted from the signal output terminal 2 further decreases. Third
FIG. 4 shows an equivalent circuit when the diode switch circuit shown in the figure is OFF. FIG. 5 is a circuit diagram showing a third embodiment of the present invention. In the first and second embodiments described so far, the resistor 12 is connected in parallel to the diode 7 and the resistor 13, but the resistor 12 is a resistor for avoiding current when the diode 7 is OFF; Since the value is very large, connect it with diode 7.
It is clear that the essence of the present invention does not change even if the two are connected in parallel.
また、全ての実施例において、全てのダイオードの極性
を反転し、同時に制御電流の極性を反転しても、やはり
本発明には何ら変わりはない。Further, in all the embodiments, even if the polarities of all diodes are reversed and the polarities of the control currents are simultaneously reversed, the present invention will not change at all.
以上説明したように本発明は、ダイオードスイッチ回路
において、データ入力用端子と制御信号入力端子とを結
ぶ線路に、インピーダンス整合用の抵抗を設けることに
より、スイッチＯＦＦの状態でもインピーダンスの整合
を行なうことが可能となる利点がある。As explained above, the present invention provides impedance matching even when the switch is OFF by providing an impedance matching resistor on the line connecting the data input terminal and the control signal input terminal in the diode switch circuit. It has the advantage of being possible.
第１図は本発明の第１の実施例を示す回路図、第２図は
第１図のダイオードスイッチ回路がＯＦＦの時の等価回
路図、第３図は本発明の第２の実施例を示す回路図、第
４図は第３図のダイオードスイッチ回路がＯＦＦの時の
等価回路図、第５図は本発明の第３の実施例を示す回路
図、第６図は従来のダイオードスイッチ回路の回路図、
第７図は第６図のダイオードスイッチ回路がＯＦＦの時
の等価回路図をそれぞれ示す。
第１図〜第７図において、
１・・・・・・信号入力端子、２・・・・・・信号出力
端子、３．４・・・・・・制御信号入力端子、５〜９・
・・・・・ダイオード、１０〜１５・・・・・・抵抗、
１６〜２０・・・・・・コンデンサ。
代理人 弁理士 内 原 音
Ｎ ゛慢
五ｑ回Fig. 1 is a circuit diagram showing a first embodiment of the present invention, Fig. 2 is an equivalent circuit diagram when the diode switch circuit of Fig. 1 is OFF, and Fig. 3 is a circuit diagram showing a second embodiment of the invention. 4 is an equivalent circuit diagram when the diode switch circuit in FIG. 3 is OFF, FIG. 5 is a circuit diagram showing the third embodiment of the present invention, and FIG. 6 is a conventional diode switch circuit. circuit diagram,
FIG. 7 shows equivalent circuit diagrams when the diode switch circuit of FIG. 6 is OFF. 1 to 7, 1... signal input terminal, 2... signal output terminal, 3.4... control signal input terminal, 5-9.
...Diode, 10-15...Resistance,
16-20... Capacitor. Agent Patent Attorney Uchihara Oto N 5q times
Claims (1)
この信号入力端子に接続された第１のコンデンサと、 この第１のコンデンサの他端に接続された第１のダイオ
ードと、この第１のダイオードに並列接続された第１の
抵抗とからなる第１の並列回路と、 この第１の並列回路に一端が接続された第２のコンデン
サと、 この第２のコンデンサの他端に接続された信号出力端子
と、 前記第１のコンデンサと前記第１の並列回路との接続点
に、前記第１のダイオードの電極と同一種類の電極が接
続された第２のダイオードと、 この第２のダイオードの残りの電極に一端が接続された
第２の抵抗と、 この第２の抵抗の他端に一端が接続され、他端が接地さ
れた第３のコンデンサと、 この第３のコンデンサと前記第２の抵抗の接続点に設け
られた第１の制御信号入力端子と、前記第２のダイオー
ドがＯＦＦの場合、電流をバイパスする手段と、前記第
１の並列回路と前記第２のコンデンサとの接続点に、前
記第１のダイオードの電極と同一種類の電極が接続され
た第３のダイオードと、この第３のダイオードに並列接
続された第３の抵抗からなる第２の並列回路と、 この第２の並列回路に一端が接続され、他端が接地され
た第４のコンデンサと、 この第４のコンデンサと前記第２の並列回路との接続点
に設けられた、第２の制御信号入力端子とから構成され
たことを特徴とするダイオードスイッチ回路。 ２、前記電流をバイパスする手段が、前記第２のダイオ
ードに並列接続された抵抗であることを特徴とする特許
請求の範囲第１項記載のダイオードスイッチ回路。 ３、前記電流をバイパスする手段が、前記第２のダイオ
ードおよび前記第２の抵抗に並列接続された抵抗である
ことを特徴とする特許請求の範囲第１項記載のダイオー
ドスイッチ回路。 ４、前記第１の並列回路と前記第２のコンデンサとの間
に配置され前記第１のダイオードの電極と同一種類の電
極が接続された第４のダイオードと、この第４のダイオ
ードに並列接続された第４の抵抗からなる第３の並列回
路と、 この第３の並列回路と前記第２のコンデンサとの接続点
に、前記第４のダイオードの電極と同一種類の電極が接
続された第５のダイオードと、この第５のダイオードに
並列接続された第５の抵抗とからなる第４の並列回路と
、 この第４の並列回路に一端が接続され、他端が接地され
た第５のコンデンサと、 この第５のコンデンサと前記第４の並列回路との接続点
と、前記第１の制御信号入力端子とを接続する手段を有
することを特徴とする特許請求の範囲第１項記載のダイ
オードスイッチ回路。[Claims] 1. A signal input terminal for receiving a signal from a transmission line, a first capacitor having one end connected to the signal input terminal, and a first capacitor connected to the other end of the first capacitor. a first parallel circuit consisting of a diode and a first resistor connected in parallel to the first diode, a second capacitor having one end connected to the first parallel circuit, and a second capacitor having one end connected to the first parallel circuit; a second diode having a signal output terminal connected to the other end of the capacitor, and an electrode of the same type as the electrode of the first diode connected to a connection point between the first capacitor and the first parallel circuit; a second resistor having one end connected to the remaining electrode of the second diode; a third capacitor having one end connected to the other end of the second resistor and the other end grounded; a first control signal input terminal provided at a connection point between the third capacitor and the second resistor; a means for bypassing current when the second diode is OFF; and a first parallel circuit. and the second capacitor, the third diode is connected to the same type of electrode as the electrode of the first diode, and the third resistor is connected in parallel to the third diode. a second parallel circuit; a fourth capacitor having one end connected to the second parallel circuit and the other end grounded; and a fourth capacitor provided at a connection point between the fourth capacitor and the second parallel circuit. and a second control signal input terminal. 2. The diode switch circuit according to claim 1, wherein the means for bypassing the current is a resistor connected in parallel to the second diode. 3. The diode switch circuit according to claim 1, wherein the means for bypassing the current is a resistor connected in parallel to the second diode and the second resistor. 4. A fourth diode arranged between the first parallel circuit and the second capacitor and connected to the same type of electrode as the electrode of the first diode, and connected in parallel to the fourth diode. a third parallel circuit consisting of a fourth resistor, and a third parallel circuit having an electrode of the same type as the electrode of the fourth diode connected to a connection point between the third parallel circuit and the second capacitor. a fourth parallel circuit consisting of a diode No. 5 and a fifth resistor connected in parallel to the fifth diode, and a fifth parallel circuit having one end connected to the fourth parallel circuit and the other end grounded. Claim 1, further comprising means for connecting a capacitor, a connection point between the fifth capacitor and the fourth parallel circuit, and the first control signal input terminal. Diode switch circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9283488A JPH01264014A (en) | 1988-04-14 | 1988-04-14 | Diode switch circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9283488A JPH01264014A (en) | 1988-04-14 | 1988-04-14 | Diode switch circuit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01264014A true JPH01264014A (en) | 1989-10-20 |
Family
ID=14065458
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9283488A Pending JPH01264014A (en) | 1988-04-14 | 1988-04-14 | Diode switch circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01264014A (en) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02117219A (en) * | 1988-10-27 | 1990-05-01 | Nec Corp | Diode switch circuit |
| US5100989A (en) * | 1987-09-04 | 1992-03-31 | Hoechst Aktiengesellschaft | Resin acid esters based on novolak oxyalkylates, their preparation and their use |
| US5159297A (en) * | 1990-05-31 | 1992-10-27 | Fujitsu Limited | Switching circuit having constant impedance regardless switching operation thereof |
-
1988
- 1988-04-14 JP JP9283488A patent/JPH01264014A/en active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5100989A (en) * | 1987-09-04 | 1992-03-31 | Hoechst Aktiengesellschaft | Resin acid esters based on novolak oxyalkylates, their preparation and their use |
| JPH02117219A (en) * | 1988-10-27 | 1990-05-01 | Nec Corp | Diode switch circuit |
| US5159297A (en) * | 1990-05-31 | 1992-10-27 | Fujitsu Limited | Switching circuit having constant impedance regardless switching operation thereof |
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