JPH01160774U - - Google Patents
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- Publication number
- JPH01160774U JPH01160774U JP5705288U JP5705288U JPH01160774U JP H01160774 U JPH01160774 U JP H01160774U JP 5705288 U JP5705288 U JP 5705288U JP 5705288 U JP5705288 U JP 5705288U JP H01160774 U JPH01160774 U JP H01160774U
- Authority
- JP
- Japan
- Prior art keywords
- memory
- frame memory
- address
- system memory
- image
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Studio Circuits (AREA)
Description
第１図は本考案の画像処理装置のブロツク図、
第２図は本考案に係るフレームメモリのアドレス
配置図、第３図は本考案に係るフレームメモリの
アドレスの構成図、第４図は従来の画像処理装置
のブロツク図である。 １０……入力バツフアメモリ、１１……マイク
ロプロセツサ、１２……システムメモリ、１３…
…フレームメモリ、１４……表示装置コントロー
ラ、１５……表示装置。
第２図は本考案に係るフレームメモリのアドレス
配置図、第３図は本考案に係るフレームメモリの
アドレスの構成図、第４図は従来の画像処理装置
のブロツク図である。 １０……入力バツフアメモリ、１１……マイク
ロプロセツサ、１２……システムメモリ、１３…
…フレームメモリ、１４……表示装置コントロー
ラ、１５……表示装置。
Claims (1)
- 複数の画像を所定の配列で同一画面中に表示す
る表示装置と、前記表示装置に表示する画面を組
立てる画像信号を記憶するフレームメモリと、前
記一つ分の画像を組立てるための画像信号を記憶
するシステムメモリとを備え、前記フレームメモ
リは前記システムメモリの整数倍のメモリ容量を
持ち、前記フレームメモリのアドレスは、その上
位アドレスが前記システムメモリに格納された画
像の前記フレームメモリ中の配列位置を示し、そ
の下位アドレスが前記システムメモリに格納され
た前記画像のアドレスと対応するよう構成されて
いることを特徴とする画像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5705288U JPH01160774U (ja) | 1988-04-27 | 1988-04-27 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5705288U JPH01160774U (ja) | 1988-04-27 | 1988-04-27 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01160774U true JPH01160774U (ja) | 1989-11-08 |
Family
ID=31282908
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5705288U Pending JPH01160774U (ja) | 1988-04-27 | 1988-04-27 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01160774U (ja) |
-
1988
- 1988-04-27 JP JP5705288U patent/JPH01160774U/ja active Pending