JP7490299B2 - スキップ変換フラグ符号化 - Google Patents
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Description
本出願は、2021年6月17日に出願された米国仮出願第63/212,080号と、2022年1月12日に出願された通常の米国出願第17/574,164号とを基礎にして、これらの出願の優先権の利益を主張する。双方の出願の全体が参照によって本明細書に援用される。
一部の例示的な実施形態では、イントラまたはインターコーディングされたユニットである現在のコーディングされたブロックについて、skip_txfmフラグシグナリングは、コーディングユニットレベルよりも細かいレベル(またはより細かい粒度)であるように構成され得る。
以下のさらなる例示的な実施形態は、現在のイントラコーディングされたブロックまたはインターコーディングされたブロックのための変換ブロックのEOBシグナリングに適用される。
・skip_txfm_U、V、またはYは1としてシグナリングされる。
・複数のU、V、またはY変換ブロックがコーディングされたブロック中に存在する。
・コーディング順序における最後のU、V、またはY変換ブロックを除く全てのU、V、またはY変換ブロックは、1のEOBスキップフラグを有する(これらが0変換ブロックであることを示す)。
・skip_txfm_UVは1としてシグナリングされる。
・複数のCbおよびCr変換ブロックがコーディングユニット中に存在する。
・コーディング順序におけるクロマチャネルからの最後の変換ブロックを除く全ての変換ブロックは、1のEOBスキップフラグを含む(これらが0変換ブロックであることを示す)。
付記A:頭字語
JEM:共同探索モデル
VVC:多用途ビデオコーディング
BMS:ベンチマークセット
MV:動きベクトル
HEVC:高効率ビデオコーディング
SEI:補足拡張情報
VUI:ビデオユーザビリティ情報
GOP:ピクチャグループ
TU:変換ユニット
PU:予測ユニット
CTU:コーディングツリーユニット
CTB:コーディングツリーブロック
PB:予測ブロック
HRD:仮想参照デコーダ
SNR:信号対雑音比
CPU:中央処理装置
GPU:グラフィックス処理装置
CRT:陰極線管
LCD:液晶ディスプレイ
OLED:有機発光ダイオード
CD:コンパクトディスク
DVD:デジタルビデオディスク
ROM:読取り専用メモリ
RAM:ランダムアクセスメモリ
ASIC:特定用途向け集積回路
PLD:プログラマブル論理デバイス
LAN:ローカルエリアネットワーク
GSM:モバイル通信用グローバルシステム
LTE:ロングタームエボリューション
CANBus:コントローラエリアネットワークバス
USB:ユニバーサルシリアルバス
PCI:周辺構成要素相互接続
FPGA:フィールドプログラマブルゲートエリア
SSD:ソリッドステートドライブ
IC:集積回路
HDR:ハイダイナミックレンジ
SDR:標準ダイナミックレンジ
JVET:共同ビデオ探索チーム
MPM:最確モード
WAIP:広角イントラ予測
CU:コーディングユニット
PU:予測ユニット
TU:変換ユニット
CTU:コーディングツリーユニット
PDPC:位置依存予測組み合わせ
ISP:イントラサブパーティション
SPS:シーケンスパラメータ設定
PPS:ピクチャパラメータセット
APS:適応パラメータセット
VPS:ビデオパラメータセット
DPS:デコーディングパラメータセット
ALF:適応ループフィルタ
SAO:サンプル適応オフセット
CC-ALF:交差成分適応ループフィルタ
CDEF:制約付き指向性強化フィルタ
CCSO:交差成分サンプルオフセット
LSO:ローカルサンプルオフセット
LR:ループ復元フィルタ
AV1:AOMedia Video 1
AV2:AOMedia Video 2
102 矢印
103 矢印
104 正方形ブロック
201 現在のブロック
300 通信システム
310 端末デバイス
320 端末デバイス
330 端末デバイス
340 端末デバイス
350 ネットワーク
400 通信システム
401 ビデオソース
402 ストリーム
403 ビデオエンコーダ
404 符号化されたビデオデータ
405 ストリーミングサーバ
406 クライアントサブシステム
407 コピー
408 クライアントサブシステム
409 コピー
410 ビデオデコーダ
413 ビデオ取り込みサブシステム
420 電子デバイス
430 電子デバイス
501 チャネル
510 ビデオデコーダ
512 ディスプレイ
515 バッファメモリ
520 パーサ
521 シンボル
530 電子デバイス
531 受信機
551 スケーラ/逆変換ユニット
552 イントラ予測ユニット
553 動き補償予測ユニット
556 ループフィルタユニット
557 参照ピクチャメモリ
558 現在ピクチャバッファ
601 ビデオソース
603 ビデオエンコーダ
620 電子デバイス、エンコーダ
630 ソースコーダ
632 コーディングエンジン
633 デコーダ、復号ユニット
634 参照ピクチャメモリ
635 予測器
640 送信機
643 ビデオシーケンス
645 エントロピーコーダ
650 コントローラ
660 通信チャネル
703 ビデオエンコーダ
721 汎用コントローラ
722 イントラエンコーダ
723 残差計算器
724 残差エンコーダ
725 エントロピーエンコーダ
726 スイッチ
728 残差デコーダ
730 インターエンコーダ
810 ビデオデコーダ
871 エントロピーデコーダ
872 イントラデコーダ
873 残差デコーダ
874 再構成モジュール
880 インターデコーダ
1002 T型パーティション
1004 T型パーティション
1006 T型パーティション
1008 T型パーティション
1010 正方形のパーティション
1102 垂直二分割
1104 水平二分割
1106 垂直三分割
1108 水平三分割
1202 正方形パーティション、パーティション
1204 正方形パーティション、パーティション
1206 正方形パーティション、パーティション
1208 正方形パーティション、パーティション
1302 正方形コーディングブロック
1402 インターコーディングされたブロック
1800 コンピュータシステム
1801 キーボード
1802 マウス
1803 トラックパッド
1805 ジョイスティック
1806 マイク
1807 スキャナ
1808 カメラ
1809 スピーカ
1810 タッチ画面
1820 CD/DVD ROM/RW
1821 光学媒体
1822 thumb-drive
1823 ソリッドステートドライブ
1840 コア
1841 中央処理装置(CPU)
1842 グラフィックス処理装置(GPU)
1843 フィールドプログラマブルゲートエリア(FPGA)
1844 ハードウェアアクセラレータ
1845 読出し専用メモリ(ROM)
1846 ランダムアクセスメモリ(RAM)
1847 内部大容量ストレージ
1848 システムバス
1849 ペリフェラルバス
1850 グラフィックスアダプタ
1854 ネットワークインタフェイス
1855 通信ネットワーク
Claims (18)
- デコーダが実行する、ビデオデータを復号するための方法であって、前記方法は、
ルマコーディングされたブロックに関連付けられたルマ変換スキップフラグを含むコーディングされたビットストリームを受信するステップであって、前記ルマコーディングされたブロックは、n個の変換ブロックを含み、nは、正の整数である、ステップと、
前記コーディングされたビットストリームを介して、前記ルマコーディングされたブロックと同じ場所に配置された少なくとも1つのクロマコーディングされたブロックに関連する少なくとも1つのクロマ変換スキップフラグを受信するステップであって、前記少なくとも1つのクロマコーディングされたブロックは、m個の変換ブロックを含み、mは正の整数であり、同じ場所に配置されるとは、異なるチャネル中の2つのコーディングされたブロックが同じ空間位置にあることを指す、ステップと、
前記ルマ変換スキップフラグに基づいて、前記ルマコーディングされたブロックの前記n個の変換ブロックを復号するステップと、
前記少なくとも1つのクロマ変換スキップフラグに基づいて、前記少なくとも1つのクロマコーディングされたブロックの前記m個の変換ブロックを復号するステップと、を含む、方法。 - 前記少なくとも1つのクロマコーディングされたブロックは、CbコーディングされたブロックとCrコーディングされたブロックとを含み、
前記少なくとも1つのクロマ変換スキップフラグは、前記Cbコーディングされたブロックと前記Crコーディングされたブロックとにそれぞれ関連付けられたCb変換スキップフラグとCr変換スキップフラグとを含み、
前記少なくとも1つのクロマ変換スキップフラグに基づいて前記少なくとも1つのクロマコーディングされたブロックの前記m個の変換ブロックを復号するステップは、
前記Cb変換スキップフラグに基づいて、前記Cbコーディングされたブロックの前記m個の変換ブロックを復号するステップと、
前記Cr変換スキップフラグに基づいて、前記Crコーディングされたブロックの前記m個の変換ブロックを復号するステップと、を含む、
請求項1に記載の方法。 - 前記ルマ変換スキップフラグ、前記Cb変換スキップフラグ、および前記Cr変換スキップフラグの各々は、対応するコンテキストに基づいて符号化され、前記対応するコンテキストが、前記ルマ変換スキップフラグ、前記Cb変換スキップフラグ、および前記Cr変換スキップフラグの前記各々に関連付けられた色チャネルに基づいて決定される、請求項2に記載の方法。
- 前記ルマコーディングされたブロック、前記Crコーディングされたブロック、およびCbコーディングされたブロックの中のターゲットコーディングされたブロックに対応する前記ルマ変換スキップフラグ、前記Cr変換スキップフラグ、および前記Cb変換スキップフラグの中のターゲット変換スキップフラグが非スキップに設定され、かつ前記ターゲットコーディングされたブロック中の最後の変換ブロックを除く全ての変換ブロックに関連するブロック終了(EOB)スキップフラグをコーディング順序に従ってコーディングしていると判定したことに応答して、
前記ターゲットコーディングされたブロックの前記最後の変換ブロックのためのEOBスキップフラグがシグナリングされないが、対応するEOBが存在すると判定するステップをさらに含む、請求項2に記載の方法。 - 前記ルマコーディングされたブロック、前記Crコーディングされたブロック、および前記Cbコーディングされたブロックの各々中の前記変換ブロックは、各変換ブロック中の変換係数を符号化するとき、符号化走査順序によって順序付けられる、請求項4に記載の方法。
- 前記ターゲットコーディングされたブロックは、イントラコード化され、均一区分方式に従って変換ブロックに区分される、請求項4に記載の方法。
- 前記ターゲットコーディングされたブロックは、インターコード化され、再帰的区分方式に従って変換ブロックに区分される、請求項4に記載の方法。
- 前記ターゲットコーディングされたブロックは、イントラコード化またはインターコード化され、前記ターゲットコーディングされたブロックは、
PARTITION_SPILT方式
PARTITION_HORZ方式
PARTITION_VERT方式
PARTITION_HORZ4方式、または
PARTITION_VERT4方式、の方式のうちの1つを介して区分される、請求項4に記載の方法。 - 前記少なくとも1つのクロマコードブロックは、CbコーディングされたブロックとCrコーディングされたブロックとを含み、
前記少なくとも1つのクロマ変換スキップフラグは、前記Cbコーディングされたブロックと前記Crコーディングされたブロックの両方のための組み合わされたクロマ変換スキップフラグを含み、
前記少なくとも1つのクロマ変換スキップフラグに基づいて前記少なくとも1つのクロマコーディングされたブロックの前記m個の変換ブロックを復号するステップは、
前記組み合わされたクロマ変換スキップフラグに基づいて、前記Cbコーディングされたブロックの前記m個の変換ブロックと前記Crコーディングされたブロックの前記m個の変換ブロックとを復号するステップを含む、
請求項1に記載の方法。 - 前記ルマコーディングされたブロック、前記組み合わされたCrコーディングされたブロック、およびCbコーディングされたブロックとの中のターゲットコーディングされたブロックに対応する、前記ルマ変換スキップフラグおよび前記組み合わされたクロマ変換スキップフラグの中のターゲット変換スキップフラグが非スキップに設定され、かつ前記ターゲットコーディングされたブロック中の最後の変換ブロックを除く全ての変換ブロックに関連するブロック終了(EOB)スキップフラグをコーディング順序に従ってコーディングしていると判定したことに応答して、
前記ターゲットコーディングされたブロックの前記最後の変換ブロックのためのEOBスキップフラグがシグナリングされないが、対応するEOBが存在すると判定するステップをさらに含む、請求項9に記載の方法。 - 前記ルマコーディングされたブロック、ならびに前記組み合わされたCrコーディングされたブロックおよびCbコーディングされたブロックの各々中の前記変換ブロックは、各変換ブロック中の変換係数を符号化するとき、符号化走査順序によって順序付けられる、請求項10に記載の方法。
- 前記ターゲットコーディングされたブロックは、イントラコード化され、均一区分方式に従って変換ブロックに区分される、請求項10に記載の方法。
- 前記ターゲットコーディングされたブロックは、インターコード化され、再帰的区分方式に従って変換ブロックに区分される、請求項10に記載の方法。
- 前記ターゲットコーディングされたブロックは、イントラコード化またはインターコード化され、前記ターゲットコーディングされたブロックは、
PARTITION_SPILT方式
PARTITION_HORZ方式
PARTITION_VERT方式
PARTITION_HORZ4方式、または
PARTITION_VERT4方式、の方式のうちの1つを介して区分される、請求項10に記載の方法。 - 前記ルマ変換スキップフラグは、前記n個の変換ブロックにおける全ての変換係数が0であるかどうかを示す、請求項1~14のいずれか一項に記載の方法。
- 前記少なくとも1つのクロマ変換スキップフラグは、前記m個の変換ブロックにおける全ての変換係数が0であるかどうかを示す、請求項1~15のいずれか一項に記載の方法。
- 請求項1~16のいずれか一項に記載の方法を行うように構成されたデバイス。
- 1つ以上のプロセッサに、請求項1~16のいずれか一項に記載の方法を実行させるためのコンピュータプログラム。
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