JP7277154B2 - Power supply and image forming apparatus - Google Patents

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Description

本発明は、電源装置及び電源装置を備える画像形成装置に関し、低消費電力モード時における出力電圧の電圧精度の向上を図る技術に関する。 The present invention relates to a power supply and an image forming apparatus equipped with the power supply, and more particularly to a technique for improving voltage accuracy of an output voltage in a low power consumption mode.

プリンタ等のスリープ状態の消費電力を低減するために、次のような電源装置が提案されている。同期整流方式の降圧型ＤＣＤＣコンバータへの入力電圧を下げ、ハイサイドＦＥＴのオンデューティを１００％にし、入力電圧をそのまま出力することでＤＣＤＣコンバータのスイッチング損失を低減する電源装置が提案されている（例えば、特許文献１参照）。 2. Description of the Related Art In order to reduce the power consumption of a printer or the like in a sleep state, the following power supply device has been proposed. A power supply device has been proposed that reduces the switching loss of the DCDC converter by lowering the input voltage to a synchronous rectification step-down DCDC converter, setting the on-duty of the high-side FET to 100%, and outputting the input voltage as it is ( For example, see Patent Document 1).

特開２０１０－１４２０７１号公報JP 2010-142071 A

しかしながら、降圧型ＤＣＤＣコンバータの入力電圧を下げ、ＰチャンネルハイサイドＦＥＴのオンデューティを１００％にした場合であっても、コイルの抵抗によって出力電圧がドロップしてしまい、出力電圧の精度が低下してしまうおそれがある。また、効率を向上させるため、ＰチャンネルＦＥＴよりオン抵抗が小さいＮチャンネルＦＥＴをハイサイドＦＥＴとして用いる降圧型ＤＣＤＣコンバータがある。この場合、ハイサイドＦＥＴのオンデューティを１００％でオンするためには、降圧型ＤＣＤＣコンバータの入力電圧より高い電圧でハイサイドＦＥＴを駆動する必要がある。そのため、降圧型ＤＣＤＣコンバータの入力電圧より高い電圧を生成する電源回路を別途設けなければ、ハイサイドＦＥＴのオンデューティを１００％でオンすることができない。このため、入力電圧が出力電圧の目標電圧に近い場合、出力電圧がドロップして必要な出力電圧を得られないおそれがある。 However, even if the input voltage of the step-down DCDC converter is lowered and the on-duty of the P-channel high-side FET is set to 100%, the output voltage drops due to the resistance of the coil, and the accuracy of the output voltage decreases. There is a risk of Also, in order to improve efficiency, there is a step-down DCDC converter that uses an N-channel FET, which has a smaller on-resistance than a P-channel FET, as a high-side FET. In this case, in order to turn on the high-side FET with an on-duty of 100%, it is necessary to drive the high-side FET with a voltage higher than the input voltage of the step-down DCDC converter. Therefore, the on-duty of the high-side FET cannot be turned on at 100% unless a separate power supply circuit that generates a voltage higher than the input voltage of the step-down DCDC converter is provided. Therefore, when the input voltage is close to the target voltage of the output voltage, the output voltage may drop and the required output voltage may not be obtained.

本発明は、このような状況のもとでなされたもので、低消費電力モードにおいて、電源装置における出力電圧の電圧精度を向上させることを目的とする。 SUMMARY OF THE INVENTION It is an object of the present invention to improve the voltage accuracy of the output voltage of a power supply device in the low power consumption mode.

上述した課題を解決するために、本発明は、以下の構成を備える。 In order to solve the above problems, the present invention has the following configurations.

（１）第１の状態と前記第１の状態よりも消費電力が低い第２の状態とで動作することが可能な電源装置であって、交流電圧を第１の直流電圧に変換して前記第１の直流電圧を出力する第１の電源と、前記第１の状態において前記第１の電源から出力された前記第１の直流電圧を前記第１の直流電圧よりも低い第２の直流電圧に変換して前記第２の直流電圧を出力し、前記第２の状態において動作を停止する第２の電源と、前記第２の電源の入出力間に接続されており、前記第１の状態において動作を停止しており、前記第１の状態から前記第２の状態に遷移すると出力電圧が前記第２の直流電圧に維持されるように定電圧制御で動作する第３の電源と、前記第１の状態のときに前記第１の直流電圧が第１の電圧値となるように前記第１の電源を制御し、前記第２の状態のときに前記第１の直流電圧が前記第１の電圧値よりも低い第２の電圧値となるように前記第１の電源を制御する第１の制御手段と、を備え、前記第１の制御手段は、前記第１の直流電圧を、前記第１の状態においては前記第１の電圧値を含む第１の範囲内で調整し、前記第２の状態においては前記第２の電圧値を含む第２の範囲内で調整し、前記第１の電源に第１のＰＷＭ信号を出力し、前記第１のＰＷＭ信号のオンデューティを０％から１００％の間で制御することにより、前記第１の直流電圧を前記第１の範囲内又は前記第２の範囲内で調整し、前記第２の電源は、少なくとも１つのスイッチング素子と、前記スイッチング素子のオン又はオフを制御する第２の制御手段と、を有し、前記第２の制御手段が前記スイッチング素子のオンデューティを制御するとき、前記オンデューティは１００％より低い所定のオンデューティに制限されており、前記第１の制御手段は、前記第１の状態から前記第２の状態に遷移するときに、前記第１の直流電圧が前記第２の電圧値となるように前記第１の電源を制御するとともに、前記スイッチング素子を前記所定のオンデューティよりも高いオンデューティで駆動するための前記第１の直流電圧となるように前記第１のＰＷＭ信号のオンデューティを調整することを特徴とする電源装置。 (1) A power supply device capable of operating in a first state and a second state in which power consumption is lower than that in the first state, wherein the AC voltage is converted into a first DC voltage and the a first power supply that outputs a first DC voltage; and a second DC voltage that is lower than the first DC voltage, the first DC voltage output from the first power supply in the first state. and outputting the second DC voltage and stopping the operation in the second state; and a third power supply that operates under constant voltage control so that the output voltage is maintained at the second DC voltage when transitioning from the first state to the second state; The first power supply is controlled so that the first DC voltage has a first voltage value in the first state, and the first DC voltage is the first voltage value in the second state. and a first control means for controlling the first power supply to have a second voltage value lower than the voltage value of the In a first state, adjustment is made within a first range including the first voltage value; in the second state, adjustment is made within a second range including the second voltage value; By outputting a first PWM signal to the power supply and controlling the on-duty of the first PWM signal between 0% and 100%, the first DC voltage is within the first range or the adjusting within a second range, said second power supply comprising at least one switching element and second control means for controlling on or off of said switching element, said second control means controls the on-duty of the switching element, the on-duty is limited to a predetermined on-duty lower than 100%, and the first control means switches from the first state to the second state. To control the first power supply so that the first DC voltage becomes the second voltage value when transitioning, and to drive the switching element with an on-duty higher than the predetermined on-duty. wherein the on-duty of the first PWM signal is adjusted so that the first DC voltage of .

（２）記録材に画像を形成する画像形成部と、前記（１）に記載の電源装置と、を備えることを特徴とする画像形成装置。 (2) An image forming apparatus comprising: an image forming unit that forms an image on a recording material; and the power supply device according to (1).

本発明によれば、低消費電力モードにおいて、電源装置における出力電圧の電圧精度を向上させることができる。 According to the present invention, it is possible to improve the voltage accuracy of the output voltage in the power supply device in the low power consumption mode.

実施例１～３のレーザビームプリンタの概略図Schematic diagram of laser beam printer of Examples 1 to 3 実施例１～３の電源装置の概略図Schematic diagram of the power supply device of Examples 1 to 3 実施例１の第１の電源の回路構成図Circuit configuration diagram of the first power supply of the first embodiment 実施例１の第２の電源及び第３の電源の回路構成図Circuit configuration diagram of the second power supply and the third power supply of the first embodiment 実施例１、２のスタンバイ、スリープ間の遷移を示すタイミングチャート4 is a timing chart showing transitions between standby and sleep in Examples 1 and 2; 実施例２の第２の電源及び第３の電源の回路構成図Circuit configuration diagram of the second power supply and the third power supply of the second embodiment 実施例３の第２の電源及び第３の電源の回路構成図Circuit configuration diagram of second power supply and third power supply of embodiment 3 実施例３のスタンバイ、スリープ間の遷移を示すタイミングチャートTiming chart showing transition between standby and sleep in the third embodiment

以下、図面を参照しながら本発明の実施の形態について説明する。 BEST MODE FOR CARRYING OUT THE INVENTION Hereinafter, embodiments of the present invention will be described with reference to the drawings.

実施例１の電源装置１０８を画像形成装置に適用した場合について、図１から図４を参照しながら説明する。なお、本発明の電源装置は、動作状態、待機状態、及び休止状態を有する他の装置に適用してもよい。 A case where the power supply device 108 of the first embodiment is applied to an image forming apparatus will be described with reference to FIGS. 1 to 4. FIG. It should be noted that the power supply device of the present invention may be applied to other devices having an operating state, a standby state, and a sleep state.

［レーザビームプリンタの説明］
図１に画像形成装置の一例として、レーザビームプリンタの概略構成を示す。レーザビームプリンタ１００（以下、プリンタ１００という）は、感光ドラム１０１、帯電部１０２、現像部１０３を備えている。感光ドラム１０１は、静電潜像が形成される像担持体である。帯電部１０２は、感光ドラム１０１を一様に帯電する。現像部１０３は、感光ドラム１０１に形成された静電潜像をトナーにより現像することでトナー像を形成する。感光ドラム１０１上（像担持体上）に形成されたトナー像をカセット１０４から供給された記録材としてのシートＰに転写部１０５によって転写し、シートＰに転写した未定着のトナー像を定着器１０６によって定着してトレイ１０７に排出する。この感光ドラム１０１、帯電部１０２、現像部１０３、転写部１０５が画像形成部（画像形成手段）である。また、プリンタ１００は、電源装置１０８を備え、電源装置１０８からモータ等の駆動部と制御部５００へ電力を供給している。制御部５００は、ＣＰＵ（不図示）及びメモリ５０１を有しており、画像形成部による画像形成動作やシートＰの搬送動作等を制御している。ＣＰＵの要求電圧精度から、実施例１の電圧精度の規格は、例えば５Ｖ±５％（Ｖｍｉｎ＝４．７５Ｖ～Ｖｍａｘ＝５．２５Ｖ）とする。プリンタ１００は、プリント動作を終了させると所定時間が経過した後、プリント動作をすぐに実行できるスタンバイ状態に遷移する。更に所定時間が経過した後、プリンタ１００は待機時の消費電力を低減するため、スタンバイ状態から低消費電力モードであるスリープ状態に遷移する。プリンタ１００は第２の状態であるスリープ状態、第１の状態であるスタンバイ状態、プリント状態の３つの状態を持ち、制御部５００がそれぞれの状態に遷移させる。なお、本発明の電源装置を適用することができる画像形成装置は、図１に例示された構成に限定されない。 [Explanation of laser beam printer]
FIG. 1 shows a schematic configuration of a laser beam printer as an example of an image forming apparatus. A laser beam printer 100 (hereinafter referred to as printer 100 ) includes a photosensitive drum 101 , a charging section 102 and a developing section 103 . A photosensitive drum 101 is an image carrier on which an electrostatic latent image is formed. A charging unit 102 uniformly charges the photosensitive drum 101 . A developing unit 103 forms a toner image by developing the electrostatic latent image formed on the photosensitive drum 101 with toner. A toner image formed on the photosensitive drum 101 (on the image carrier) is transferred by a transfer unit 105 onto a sheet P serving as a recording material supplied from a cassette 104, and the unfixed toner image transferred onto the sheet P is transferred to a fixing device. It is fixed by 106 and discharged to a tray 107 . The photosensitive drum 101, charging section 102, developing section 103, and transfer section 105 constitute an image forming section (image forming means). The printer 100 also includes a power supply device 108 that supplies power to a drive unit such as a motor and the control unit 500 . The control unit 500 has a CPU (not shown) and a memory 501, and controls the image forming operation of the image forming unit, the conveying operation of the sheet P, and the like. Based on the required voltage accuracy of the CPU, the voltage accuracy standard of the first embodiment is, for example, 5 V±5% (Vmin=4.75 V to Vmax=5.25 V). The printer 100 transitions to a standby state in which the printing operation can be immediately executed after a predetermined period of time has passed after the printing operation is completed. Further, after a predetermined period of time has passed, the printer 100 transitions from the standby state to the sleep state, which is a low power consumption mode, in order to reduce power consumption during standby. The printer 100 has three states: a sleep state as a second state, a standby state as a first state, and a print state. Note that the image forming apparatus to which the power supply device of the present invention can be applied is not limited to the configuration illustrated in FIG.

［電源装置の説明］
図２に電源装置１０８の概略構成の一例を示す。交流電源１１０から入力された交流電圧は、第１の電源２００（以下、ＡＣＤＣコンバータ２００という）に入力され、ＡＣＤＣコンバータ２００によって第１の直流電圧である直流出力電圧２１８（以下、出力電圧２１８という）に変換され降圧される。出力電圧２１８は、第２の電源３００（以下、ＤＣＤＣコンバータ３００という）に入力され、ＤＣＤＣコンバータ３００によって第２の直流電圧である直流出力電圧３１８（以下、出力電圧３１８という）に降圧される。第３の電源４００（以下、レギュレータ４００という）は、ＤＣＤＣコンバータ３００の入出力間に接続されている。ロードスイッチ（以下、ロードＳＷと表記する）６００には、出力電圧３１８が入力されており、ロードＳＷ６００のスイッチ素子をオン状態（接続状態）又はオフ状態（遮断）（非接続状態）にすることで、負荷への出力電圧５１８の出力を制御している。 [Description of power supply]
FIG. 2 shows an example of a schematic configuration of the power supply device 108. As shown in FIG. An AC voltage input from an AC power supply 110 is input to a first power supply 200 (hereinafter referred to as an ACDC converter 200), and the ACDC converter 200 outputs a first DC voltage, a DC output voltage 218 (hereinafter referred to as an output voltage 218). ) and stepped down. The output voltage 218 is input to a second power supply 300 (hereinafter referred to as DCDC converter 300), and is stepped down by the DCDC converter 300 to a DC output voltage 318 (hereinafter referred to as output voltage 318) which is a second DC voltage. A third power supply 400 (hereinafter referred to as a regulator 400 ) is connected between the input and output of the DCDC converter 300 . An output voltage 318 is input to a load switch (hereinafter referred to as load SW) 600, and the switch element of the load SW 600 is turned on (connected state) or off (disconnected) (disconnected state). and controls the output of the output voltage 518 to the load.

第１の制御手段である制御部５００は、ＡＣＤＣコンバータ２００、ＤＣＤＣコンバータ３００、ロードＳＷ６００と電気的に接続されており、それぞれに信号を出力することにより制御している。以下、各信号について説明する。ＰＷＭ信号１３５は、ＡＣＤＣコンバータ２００へ入力されており、出力電圧２１８を調整するための信号である。ＰＷＭ信号３３５は、ＤＣＤＣコンバータ３００へ入力されており、出力電圧３１８の目標電圧値を調整するための信号である。ＰＷＭ信号４３５は、レギュレータ４００へ入力されており、出力電圧３１８の目標電圧値を調整するための信号である。ＡＣＤＣコンバータ出力電圧切り替え信号２０１は、ＡＣＤＣコンバータ２００に入力されており、出力電圧２１８の目標電圧を切り替えるための信号である。ＤＣＤＣコンバータ起動信号３０１は、ＤＣＤＣコンバータ３００に入力されており、ＤＣＤＣコンバータ３００の動作、停止を制御するための信号である。ロードＳＷ制御信号６０１は、ロードＳＷ６００に入力されており、出力電圧５１８の出力を制御するための信号である。レギュレータ起動信号４０１は、レギュレータ４００に入力されており、レギュレータ４００の動作、停止を制御するための信号である。制御部５００には、電源として出力電圧３１８が供給されている。 A control unit 500, which is first control means, is electrically connected to the ACDC converter 200, the DCDC converter 300, and the load SW 600, and controls them by outputting signals to each of them. Each signal will be described below. PWM signal 135 is input to ACDC converter 200 and is a signal for adjusting output voltage 218 . PWM signal 335 is input to DCDC converter 300 and is a signal for adjusting the target voltage value of output voltage 318 . PWM signal 435 is input to regulator 400 and is a signal for adjusting the target voltage value of output voltage 318 . ACDC converter output voltage switching signal 201 is input to ACDC converter 200 and is a signal for switching the target voltage of output voltage 218 . A DCDC converter start signal 301 is input to the DCDC converter 300 and is a signal for controlling the operation and stop of the DCDC converter 300 . A load SW control signal 601 is input to the load SW 600 and is a signal for controlling the output of the output voltage 518 . A regulator start signal 401 is input to the regulator 400 and is a signal for controlling the operation and stop of the regulator 400 . An output voltage 318 is supplied to the control unit 500 as a power supply.

［ＡＣＤＣコンバータ２００の説明］
図３にＡＣＤＣコンバータ２００の回路構成の一例を示す。ＡＣＤＣコンバータ２００の回路構成を説明する。交流電源１１０から入力された交流電圧は、回路保護用の電流ヒューズ２０３と整流ダイオードブリッジ２０４を介して全波整流され、１次平滑コンデンサ２０５（以下、平滑コンデンサ２０５という）により平滑され直流電圧となる。更に、平滑コンデンサ２０５に充電された直流電圧は、起動抵抗２０６を介し、電源ＩＣ２０９のＳＴ端子に供給され、電源ＩＣ２０９の起動電圧に達すると、電源ＩＣ２０９が起動する。電源ＩＣ２０９は、スイッチング素子である電界効果トランジスタ（以下、ＦＥＴと表記する）２０７の制御手段である。電源ＩＣ２０９が起動すると、電源ＩＣ２０９は、ＤＲＶ端子から抵抗２１０を介してＦＥＴ２０７のゲート端子にＦＥＴ２０７を駆動するためのパルス信号を出力する。パルス信号がハイレベルとなっている期間において、ＦＥＴ２０７が導通状態になると、トランス２０８の１次巻線Ｎｐの両端に平滑コンデンサ２０５の直流電圧が印加される。このとき、トランス２０８の２次巻線Ｎｓ側にも電圧が誘起されるが、ダイオード２１６のアノード側を負とする電圧であるため、ダイオード２１６は導通状態とならず、トランス２０８の２次側にエネルギーは伝達されない。同様に、トランス２０８の補助巻線Ｎｂ側にも電圧が誘起されるが、ダイオード２１１のアノード側を負とする電圧であるため、ダイオード２１１は導通状態とはならず、補助巻線Ｎｂにもエネルギーは伝達されない。したがって、トランス２０８の１次巻線Ｎｐを流れる電流はトランス２０８の励磁電流だけで、トランス２０８には励磁電流の２乗に比例したエネルギーが蓄積される。なお、励磁電流は時間に比例して増大する。 [Description of ACDC converter 200]
FIG. 3 shows an example of the circuit configuration of the ACDC converter 200. As shown in FIG. A circuit configuration of the ACDC converter 200 will be described. An AC voltage input from an AC power supply 110 is full-wave rectified through a current fuse 203 for circuit protection and a rectifying diode bridge 204, smoothed by a primary smoothing capacitor 205 (hereinafter referred to as smoothing capacitor 205), and converted into a DC voltage. Become. Furthermore, the DC voltage charged in the smoothing capacitor 205 is supplied to the ST terminal of the power supply IC 209 via the starting resistor 206, and when it reaches the starting voltage of the power supply IC 209, the power supply IC 209 is started. A power supply IC 209 is control means for a field effect transistor (hereinafter referred to as FET) 207 which is a switching element. When the power supply IC 209 is activated, the power supply IC 209 outputs a pulse signal for driving the FET 207 from the DRV terminal through the resistor 210 to the gate terminal of the FET 207 . When the FET 207 becomes conductive while the pulse signal is high level, the DC voltage of the smoothing capacitor 205 is applied across the primary winding Np of the transformer 208 . At this time, a voltage is also induced on the secondary winding Ns side of the transformer 208, but since the voltage is such that the anode side of the diode 216 is negative, the diode 216 does not become conductive and the secondary side of the transformer 208 does not become conductive. no energy is transferred to Similarly, a voltage is induced on the side of the auxiliary winding Nb of the transformer 208, but the voltage is such that the anode side of the diode 211 is negative. No energy is transferred. Therefore, the current flowing through the primary winding Np of the transformer 208 is only the excitation current of the transformer 208, and energy proportional to the square of the excitation current is stored in the transformer 208. FIG. Note that the excitation current increases in proportion to time.

次に、電源ＩＣ２０９のＤＲＶ端子からローレベルのパルス信号が出力されると、パルス信号のローレベルの期間において、ＦＥＴ２０７は導通状態から非導通状態となる。ＦＥＴ２０７が非導通状態になると、トランス２０８の各巻線には、ＦＥＴ２０７が導通状態のときとは逆極性の電圧が誘起される。その結果、トランス２０８の２次巻線Ｎｓには、ダイオード２１６のアノード側を正とする電圧が誘起され、ダイオード２１６が導通状態となる。そして、トランス２０８に蓄積されたエネルギーが、整流平滑回路を構成するダイオード２１６及び平滑コンデンサ２１７によって整流、平滑され、直流電圧として出力電圧２１８が出力される。また、補助巻線Ｎｂには、ダイオード２１１のアノード側を正とする電圧が誘起され、ダイオード２１１が導通状態となる。そして、ダイオード２１１を介してコンデンサ２１３が充電され、コンデンサ２１３に充電された直流電圧は電源ＩＣ２０９のＶＣＣ端子に供給される。 Next, when a low-level pulse signal is output from the DRV terminal of the power supply IC 209, the FET 207 changes from the conductive state to the non-conductive state during the low-level period of the pulse signal. When the FET 207 is in a non-conducting state, a voltage opposite in polarity to that when the FET 207 is in a conducting state is induced in each winding of the transformer 208 . As a result, a voltage is induced in the secondary winding Ns of the transformer 208 with the anode side of the diode 216 being positive, and the diode 216 becomes conductive. The energy stored in the transformer 208 is rectified and smoothed by a diode 216 and a smoothing capacitor 217 that form a rectifying and smoothing circuit, and an output voltage 218 is output as a DC voltage. In addition, a voltage is induced in the auxiliary winding Nb so that the anode side of the diode 211 becomes positive, and the diode 211 becomes conductive. A capacitor 213 is charged through a diode 211 , and the DC voltage charged in the capacitor 213 is supplied to the VCC terminal of the power supply IC 209 .

出力電圧２１８の電圧制御について、ＰＷＭ信号１３５及びＡＣＤＣコンバータ出力電圧切り替え信号２０１（図３には「２４Ｖ／５Ｖ＿ＣＨＧ」と図示）がオフ（ローレベル）の場合について説明する。ＡＣＤＣコンバータ２００では、出力電圧２１８の電圧制御は次のように行われる。まず、トランス２０８の２次側に生成された出力電圧２１８は、直列に接続されたレギュレーション抵抗２２３と、抵抗１２３、抵抗１２５及び抵抗１２８の合成抵抗と、抵抗２２４及び抵抗２２６によって分圧される。分圧された電圧は、シャントレギュレータ２２５のＲＥＦ端子に入力される。そして、シャントレギュレータ２２５のＲＥＦ端子に入力された電圧レベルに応じたフィードバック信号がシャントレギュレータ２２５のＫ端子から出力される。シャントレギュレータ２２５のＫ端子は、フォトカプラ２１５のフォトダイオード２１５ｄと接続されている。また、フォトカプラ２１５のフォトトランジスタ２１５ｔは電源ＩＣ２０９のＦＢ端子に接続されている。シャントレギュレータ２２５のＫ端子から出力されたフィードバック信号は、フォトカプラ２１５を介して、電源ＩＣ２０９のＦＢ端子に入力される。抵抗２２１は、フォトカプラ２１５のフォトダイオード２１５ｄ（ＬＥＤ）に流れる電流を制限するための抵抗である。そして、電源ＩＣ２０９は、ＦＢ端子から入力されたフィードバック信号に基づいて、ＤＲＶ端子からパルス信号を出力し、ＦＥＴ２０７のスイッチング制御を行うことで、出力電圧２１８の安定した制御を行うことができる。電源ＩＣ２０９のＧＮＤ端子は平滑コンデンサ２０５の低電位側に接続されている。なお、図１中の電源ＩＣ２０９の内の符号は、各端子の名称である。 Voltage control of the output voltage 218 will be described in the case where the PWM signal 135 and the ACDC converter output voltage switching signal 201 (shown as "24V/ 5V_CHG " in FIG. 3) are off (low level). In ACDC converter 200, voltage control of output voltage 218 is performed as follows. First, the output voltage 218 generated on the secondary side of the transformer 208 is divided by the serially connected regulation resistor 223, the combined resistance of the resistors 123, 125 and 128, and the resistors 224 and 226. . The divided voltage is input to the REF terminal of the shunt regulator 225 . A feedback signal corresponding to the voltage level input to the REF terminal of the shunt regulator 225 is output from the K terminal of the shunt regulator 225 . A K terminal of the shunt regulator 225 is connected to the photodiode 215 d of the photocoupler 215 . Also, the phototransistor 215t of the photocoupler 215 is connected to the FB terminal of the power IC 209 . A feedback signal output from the K terminal of the shunt regulator 225 is input to the FB terminal of the power supply IC 209 via the photocoupler 215 . A resistor 221 is a resistor for limiting the current flowing through the photodiode 215 d (LED) of the photocoupler 215 . Based on the feedback signal input from the FB terminal, the power supply IC 209 outputs a pulse signal from the DRV terminal and performs switching control of the FET 207, thereby stably controlling the output voltage 218. FIG. A GND terminal of the power supply IC 209 is connected to the low potential side of the smoothing capacitor 205 . It should be noted that the reference numerals in the power supply IC 209 in FIG. 1 are the names of respective terminals.

出力電圧２１８は、スタンバイ状態及びプリント状態に必要な電圧とスリープ状態に必要な電圧の２種類あり、出力電圧２１８は、それぞれの状態で切り替えることができる。スリープ状態で出力電圧２１８を切り替える理由は、スリープ状態ではモータ等の駆動部や画像形成部を駆動させる必要がなく、スリープ時に必要な電圧のみ出力できればよいためである。そのため、出力電圧２１８の目標電圧をできるだけ出力電圧３１８の目標電圧に近い値に設定し、電源装置１０８の効率を向上させている。また、出力電圧２１８は、ロードＳＷ（不図示）を介して、モータ等の駆動部や画像形成部である感光ドラム１０１、帯電部１０２、現像部１０３、転写部１０５と電気的に接続されている。すなわち、これらの部材が負荷２１９である。ロードＳＷ（不図示）は、スタンバイ状態及びプリント状態にオン状態となり、モータ等の駆動部や画像形成部へ電力供給を行い、スリープ状態にオフ状態となり、消費電力を低減している。 There are two types of output voltage 218, a voltage necessary for the standby state and print state and a voltage necessary for the sleep state, and the output voltage 218 can be switched in each state. The reason why the output voltage 218 is switched in the sleep state is that in the sleep state there is no need to drive a driving unit such as a motor or the image forming unit, and it is sufficient to output only the necessary voltage in the sleep state. Therefore, the target voltage of the output voltage 218 is set as close to the target voltage of the output voltage 318 as possible to improve the efficiency of the power supply device 108 . In addition, the output voltage 218 is electrically connected to the photosensitive drum 101, the charging unit 102, the developing unit 103, and the transfer unit 105, which are a driving unit such as a motor and an image forming unit, through a load switch (not shown). there is These members are the loads 219 . A load switch (not shown) is turned on in the standby state and the print state to supply power to a driving unit such as a motor and the image forming unit, and is turned off in the sleep state to reduce power consumption.

［出力電圧２１８の切替え制御］
（ＰＷＭ信号１３５のオンデューティが０％の場合）
（スタンバイ状態及びプリント状態）
ＰＷＭ信号１３５が出力されていない、すなわち、図３中、ＰＷＭ信号１３５のオンデューティが０％である場合を例にして、出力電圧２１８の切替え制御について説明する。なお、ＰＷＭ信号１３５のオンデューティとは、ＰＷＭ信号１３５の１周期に対するオン時間の比率であり、以下、単にデューティともいう。出力電圧２１８の具体的な電圧値は、スタンバイ状態及びプリント状態においては、例えば約２４Ｖであり、スリープ状態では約５Ｖである。 [Switching control of output voltage 218]
(When the on-duty of the PWM signal 135 is 0%)
(standby state and print state)
Switching control of the output voltage 218 will be described by taking as an example the case where the PWM signal 135 is not output, that is, the on-duty of the PWM signal 135 is 0% in FIG. Note that the on-duty of the PWM signal 135 is the ratio of the on-time to one period of the PWM signal 135, and is hereinafter simply referred to as the duty. A specific voltage value of the output voltage 218 is, for example, about 24V in the standby state and print state, and about 5V in the sleep state.

まず、プリンタ１００のスタンバイ状態及びプリント状態において、電源装置１０８は、出力電圧２１８をモータ等の駆動部や画像形成部等の負荷２１９へ供給している。このとき、制御部５００は、ハイレベルのＡＣＤＣコンバータ出力電圧切替え信号２０１を出力し、抵抗２２８と抵抗２２９とで分圧された電圧がＦＥＴ２２７のゲート端子に供給される。これによりＦＥＴ２２７がオンして、ＦＥＴ２２７のドレイン端子とソース端子との間が導通するため、抵抗２２６が無視できる状態となる。ＰＷＭ信号１３５は、抵抗１２７を介してトランジスタ１２６のベース端子に入力され、ＰＷＭ信号１３５のデューティが０％の場合には非導通状態となる。このとき、出力電圧２１８を、抵抗２２３、抵抗１２３、抵抗１２５、抵抗１２８から成る合成抵抗と、抵抗２２４とで分圧した電圧が、シャントレギュレータ２２５のＲＥＦ端子にフィードバックされ、出力電圧２１８が制御される。 First, in the standby state and printing state of the printer 100, the power supply device 108 supplies an output voltage 218 to a load 219 such as a driving section such as a motor and an image forming section. At this time, the control unit 500 outputs a high-level ACDC converter output voltage switching signal 201 , and the voltage divided by the resistors 228 and 229 is supplied to the gate terminal of the FET 227 . As a result, the FET 227 is turned on, and the drain terminal and the source terminal of the FET 227 are electrically connected, so that the resistance 226 becomes negligible. The PWM signal 135 is input to the base terminal of the transistor 126 via the resistor 127, and when the duty of the PWM signal 135 is 0%, it becomes non-conducting. At this time, the voltage obtained by dividing the output voltage 218 by the combined resistor consisting of the resistors 223, 123, 125, and 128 and the resistor 224 is fed back to the REF terminal of the shunt regulator 225, and the output voltage 218 is controlled. be done.

抵抗２２３、抵抗２２４、抵抗２２６、抵抗１２３、抵抗１２５、抵抗１２８、抵抗１２９の抵抗値を、それぞれＲ２２３、Ｒ２２４、Ｒ２２６、Ｒ１２３、Ｒ１２５、Ｒ１２８、Ｒ１２９とする。抵抗２２３、抵抗１２３、抵抗１２５、抵抗１２８の合成抵抗値をＲ２２３ＯＦＦ、シャントレギュレータ２２５のリファレンス電圧をＶＲＥＦとする。前述の合成抵抗値Ｒ２２３ＯＦＦは、以下の式（１）で表される。

Figure 0007277154000001
計算の簡略化のため、ＦＥＴ２２７のオン抵抗を無視できる程小さいとすると、２４Ｖ出力時における出力電圧２１８（Ｖ２４Ｖ＿ＯＦＦ）は、次の式（２）で求められる値となるように制御される。
Figure 0007277154000002
 具体的な数値の設定例として、Ｖ２４Ｖ＝２４Ｖとする。 The resistance values of resistors 223, 224, 226, 123, 125 , 128 , and 129 are defined as R223 , R224 , R226, R123, R125 , R128 , and R129 , respectively. Assume that the combined resistance value of the resistors 223, 123, 125, and 128 is R 223OFF , and the reference voltage of the shunt regulator 225 is V REF . The aforementioned combined resistance value R 223OFF is represented by the following equation (1).
Figure 0007277154000001
 Assuming that the on-resistance of the FET 227 is negligibly small for simplification of calculation, the output voltage 218 (V 24V — OFF ) at the time of 24V output is controlled to the value obtained by the following equation (2).
Figure 0007277154000002
 As an example of setting specific numerical values, V 24V =24V.

（スリープ状態）
次にプリンタ１００のスリープ状態において、電源装置１０８は出力電圧２１８をスタンバイ状態及びプリント状態に比べて下げている状態であり、その出力電圧値は約５Ｖである。このとき、制御部５００は、ローレベルのＡＣＤＣコンバータ出力電圧切替え信号２０１を出力し、抵抗２２８と抵抗２２９で分圧された電圧がＦＥＴ２２７のゲート端子に供給される。これによりＦＥＴ２２７がオフし、抵抗２２６の両端がオープンしている状態となる。計算の簡略化のためＦＥＴ２２７のオフ時に流れる電流を０Ａとすると、５Ｖ出力時における出力電圧２１８（Ｖ５Ｖ＿ＯＦＦ）は、次の式（３）で求められる値となるように制御される。

Figure 0007277154000003
具体的な数値の設定例として、Ｖ５Ｖ＝５．１５Ｖとする。 (sleep state)
Next, in the sleep state of the printer 100, the power supply 108 is in a state where the output voltage 218 is lowered compared to the standby state and print state, and the output voltage value is about 5V. At this time, the control unit 500 outputs a low-level ACDC converter output voltage switching signal 201 , and the voltage divided by the resistors 228 and 229 is supplied to the gate terminal of the FET 227 . As a result, the FET 227 is turned off and both ends of the resistor 226 are open. Assuming that the current that flows when the FET 227 is off is 0 A for the sake of simplicity of calculation, the output voltage 218 (V 5V — OFF ) at the time of 5V output is controlled to the value obtained by the following equation (3).
Figure 0007277154000003
 As an example of setting specific numerical values, V 5V =5.15V.

［ＤＣＤＣコンバータ３００の説明］
図４に降圧型ＤＣＤＣコンバータ３００、レギュレータ４００の内部回路の一例を示す。降圧型ＤＣＤＣコンバータ３００（以下、ＤＣＤＣコンバータ３００という）の回路構成を説明する。ＤＣＤＣコンバータ３００は、スイッチング素子であるＮチャンネルハイサイドＦＥＴ３６０（以下、ハイサイドＦＥＴ３６０という）をオンしている間は、インダクタ３５２を介してコンデンサ３５３に電流が流れる。一方、ハイサイドＦＥＴ３６０をオフしている間は、インダクタ３５２に蓄えられたエネルギーがＮチャンネルローサイドＦＥＴ３５１（以下、ローサイドＦＥＴ３５１という）を介して出力される。なお、ハイサイドＦＥＴ３６０はＰチャンネルＦＥＴ、ローサイドＦＥＴ３５１はＰチャンネルＦＥＴ又は整流ダイオードであってもよい。 [Description of DCDC converter 300]
FIG. 4 shows an example of an internal circuit of the step-down DCDC converter 300 and the regulator 400. As shown in FIG. A circuit configuration of a step-down DCDC converter 300 (hereinafter referred to as DCDC converter 300) will be described. In the DCDC converter 300 , current flows through the capacitor 353 via the inductor 352 while the N-channel high-side FET 360 (hereinafter referred to as high-side FET 360 ), which is a switching element, is turned on. On the other hand, while the high-side FET 360 is turned off, the energy stored in the inductor 352 is output via the N-channel low-side FET 351 (hereinafter referred to as low-side FET 351). The high-side FET 360 may be a P-channel FET, and the low-side FET 351 may be a P-channel FET or a rectifying diode.

［ＤＣＤＣコンバータ３００の説明］
第２の制御手段である電源ＩＣ３５８は、ＰＷＭ制御によってハイサイドＦＥＴ３６０、ローサイドＦＥＴ３５１を交互にオンさせる。これにより電源ＩＣ３５８は、出力電圧３１８をフィードバックしながら、目標電圧になるようにハイサイドＦＥＴ３６０とローサイドＦＥＴ３５１のオンデューティを制御している。ＶＣＣ端子は、電源ＩＣ３５８の電源端子であり、出力電圧２１８が入力されている。ＤＲＶＨ端子は、抵抗３５９を介してハイサイドＦＥＴ３６０のゲート端子に接続されている。ＤＲＶＬ端子は、抵抗３６１を介して、ローサイドＦＥＴ３５１のゲート端子に接続されている。ＦＢ端子は、出力電圧３１８を抵抗３５４と抵抗３５５で分圧した電圧が入力されている。電源ＩＣ３５８は、ＦＢ端子に入力された電圧と電源ＩＣ３５８の内部の基準電圧とを比較し、出力電圧３１８が目標電圧になるようにＤＲＶＨ端子とＤＲＶＬ端子に駆動信号を出力している。電源ＩＣ３５８は、出力電圧３１８が目標電圧よりも低い場合はハイサイドＦＥＴ３６０のオンデューティが高くなるようにＤＲＶＨ端子に駆動信号を出力する。電源ＩＣ３５８は、出力電圧３１８が目標電圧よりも高い場合はローサイドＦＥＴ３５１のオンデューティが高くなるようにＤＲＶＬ端子に駆動信号を出力する。ＥＮ端子は、電源ＩＣ３５８の起動及び停止を制御する端子である。ＥＮ端子にハイレベルのＤＣＤＣコンバータ起動信号３０１が入力されると、電源ＩＣ３５８は起動し、ＥＮ端子にローレベルのＤＣＤＣコンバータ起動信号３０１が入力されると、電源ＩＣ３５８は停止する。ＥＮ端子には、抵抗３３０を介してＤＣＤＣコンバータ起動信号３０１が入力される。 [Description of DCDC converter 300]
A power supply IC 358, which is the second control means, alternately turns on the high-side FET 360 and the low-side FET 351 by PWM control. As a result, the power supply IC 358 controls the on-duty of the high-side FET 360 and the low-side FET 351 so as to achieve the target voltage while feeding back the output voltage 318 . A VCC terminal is a power supply terminal of the power supply IC 358 and receives the output voltage 218 . The DRVH terminal is connected to the gate terminal of high side FET 360 via resistor 359 . The DRVL terminal is connected to the gate terminal of low-side FET 351 via resistor 361 . A voltage obtained by dividing the output voltage 318 by resistors 354 and 355 is input to the FB terminal. The power supply IC 358 compares the voltage input to the FB terminal with a reference voltage inside the power supply IC 358, and outputs drive signals to the DRVH terminal and the DRVL terminal so that the output voltage 318 becomes the target voltage. The power supply IC 358 outputs a drive signal to the DRVH terminal so that the on-duty of the high-side FET 360 becomes high when the output voltage 318 is lower than the target voltage. The power supply IC 358 outputs a drive signal to the DRVL terminal so that the on-duty of the low-side FET 351 becomes high when the output voltage 318 is higher than the target voltage. The EN terminal is a terminal for controlling start and stop of the power supply IC 358 . When the DCDC converter start signal 301 of high level is input to the EN terminal, the power supply IC 358 is started, and when the DCDC converter start signal 301 of low level is input to the EN terminal, the power supply IC 358 is stopped. A DCDC converter activation signal 301 is input to the EN terminal via a resistor 330 .

ＤＣＤＣコンバータ３００によって制御される出力電圧３１８をＶ５Ｖ＿ＤＣＤＣ、電源ＩＣ３５８内部の基準電圧をＶＦＢ（ＤＣＤＣ）、抵抗３５４、抵抗３５５の抵抗値をそれぞれＲ３５４、Ｒ３５５とする。出力電圧３１８であるＶ５Ｖ＿ＤＣＤＣは、以下の式（４）で表される電圧になるように制御される。

Figure 0007277154000004
具体的な数値の例として、Ｖ５Ｖ＿ＤＣＤＣ＝５．２１Ｖとする。 Let V5V_DCDC be the output voltage 318 controlled by the DCDC converter 300, VFB (DCDC) be the reference voltage inside the power supply IC 358, and R354 and R355 be the resistance values of the resistors 354 and 355 , respectively. V 5V_DCDC , which is the output voltage 318, is controlled to be the voltage represented by the following equation (4).
Figure 0007277154000004
 As an example of specific numerical values, V 5V_DCDC =5.21V.

（入力電圧の違いによる出力電圧３１８の電力精度）
次に、入力電圧（ＡＣＤＣコンバータ２００の出力電圧２１８）の違いによるＤＣＤＣコンバータ３００の出力電圧３１８の電圧精度について説明する。入力電圧が高い場合（スタンバイ状態及びプリント状態）（出力電圧２１８（Ｖ２４Ｖ））は、入力電圧（２４Ｖ）と出力電圧（５．２１Ｖ）との電圧差が大きく、ＤＣＤＣコンバータ３００のオンデューティが低い。すなわち、ＤＣＤＣコンバータ３００のスイッチング時のハイサイドＦＥＴ３６０のオフ期間が長い。そのため、電源ＩＣ３５８の内部にあるブートストラップ回路（不図示）内のコンデンサへの充電期間が十分あり、ハイサイドＦＥＴ３６０を駆動するのに必要な電圧まで昇圧することができ、ハイサイドＦＥＴ３６０を駆動することができる。つまり、入力電圧が高い場合では、ハイサイドＦＥＴ３６０を駆動できるため、出力電圧３１８を目標電圧に制御することができる。 (Power Accuracy of Output Voltage 318 Due to Difference in Input Voltage)
Next, the voltage accuracy of the output voltage 318 of the DCDC converter 300 due to the difference in the input voltage (the output voltage 218 of the ACDC converter 200) will be described. When the input voltage is high (standby state and print state) (output voltage 218 (V 24V )), the voltage difference between the input voltage (24V) and the output voltage (5.21V) is large, and the on-duty of the DCDC converter 300 is low. That is, the OFF period of the high-side FET 360 during switching of the DCDC converter 300 is long. Therefore, there is enough time to charge the capacitor in the bootstrap circuit (not shown) inside the power supply IC 358, and the voltage required to drive the high-side FET 360 can be boosted to drive the high-side FET 360. be able to. That is, when the input voltage is high, the high-side FET 360 can be driven, so the output voltage 318 can be controlled to the target voltage.

一方、入力電圧が低い場合（スリープ状態）（出力電圧２１８（Ｖ５Ｖ））は、入力電圧（５．１５Ｖ）と出力電圧（５．２１Ｖ）との差が小さく、ＤＣＤＣコンバータ３００のオンデューティが大きい。すなわち、ＤＣＤＣコンバータ３００のスイッチング時のハイサイドＦＥＴ３６０のオフ期間が短い。そのため、電源ＩＣ３５８の内部にあるブートストラップ回路（不図示）内のコンデンサへの充電期間が不十分になり、ハイサイドＦＥＴ３６０を駆動するのに必要な電圧まで昇圧することができず、ハイサイドＦＥＴ３６０を十分に駆動することができない。つまり、入力電圧が低い場合では、ハイサイドＦＥＴ３６０を十分に駆動することができないため、出力電圧３１８を目標電圧に制御することができず、出力電圧がドロップしてしまう。また、ハイサイドＦＥＴ３６０のオンデューティを１００％で駆動するということは、ハイサイドＦＥＴ３６０のオフ期間がないことを意味する。このため、電源ＩＣ３５８の内部にあるブートストラップ回路（不図示）内のコンデンサへの充電ができず、新たに電源回路が別途必要となってしまい、高価な電源ＩＣが必要となってしまう。また、安価な電源ＩＣでは、別の電源回路を有していないため、ハイサイドＦＥＴ３６０の最大オンデューティに制限があるものが多い。実施例１では電源ＩＣ３５８の最大オンデューティの制限は、例えば所定のオンデューティである８０％であると定義する。 On the other hand, when the input voltage is low (sleep state) (output voltage 218 (V 5V )), the difference between the input voltage (5.15V) and the output voltage (5.21V) is small, and the on-duty of DCDC converter 300 is big. That is, the OFF period of the high-side FET 360 during switching of the DCDC converter 300 is short. Therefore, the charging period for the capacitor in the bootstrap circuit (not shown) inside the power supply IC 358 becomes insufficient, and the voltage required to drive the high side FET 360 cannot be boosted, and the high side FET 360 can not be sufficiently driven. That is, when the input voltage is low, the high-side FET 360 cannot be sufficiently driven, so the output voltage 318 cannot be controlled to the target voltage, and the output voltage drops. Also, driving the high-side FET 360 with an on-duty of 100% means that the high-side FET 360 does not have an off period. For this reason, the capacitor in the bootstrap circuit (not shown) inside the power supply IC 358 cannot be charged, and a new power supply circuit is separately required, resulting in the need for an expensive power supply IC. In addition, many inexpensive power supply ICs do not have a separate power supply circuit, and therefore have limits on the maximum on-duty of the high-side FET 360 . In the first embodiment, the maximum on-duty limit of the power supply IC 358 is defined as, for example, a predetermined on-duty of 80%.

このように最大オンデューティの制限がある電源ＩＣを用いる場合、入力電圧が低下し最大オンデューティの制限値（例えば８０％）に達すると、前述したようにハイサイドＦＥＴを１００％でオンすることができない。このため、出力電圧３１８がドロップしてしまい、要求される出力電圧３１８の電圧精度を満足することができない。そこで、ＤＣＤＣコンバータ３００とは別にレギュレータ４００を設けている。この場合、ＤＣＤＣコンバータ３００が最大オンデューティに達して出力電圧３１８がドロップしてしまう際に、抵抗７８４を介してハイレベルのレギュレータ起動信号４０１を出力することによりレギュレータ４００を動作させる。レギュレータ４００を動作させることにより、出力電圧３１８のドロップを防いでいる。 When using a power supply IC with such a maximum on-duty limit, when the input voltage drops and reaches the maximum on-duty limit value (for example, 80%), the high-side FET is turned on at 100% as described above. can't As a result, the output voltage 318 drops, and the required voltage accuracy of the output voltage 318 cannot be satisfied. Therefore, a regulator 400 is provided separately from the DCDC converter 300 . In this case, when the DCDC converter 300 reaches the maximum on-duty and the output voltage 318 drops, the regulator 400 is operated by outputting the high-level regulator activation signal 401 through the resistor 784 . By operating the regulator 400, the output voltage 318 is prevented from dropping.

［レギュレータ４００の説明］
レギュレータ４００の回路構成を説明する。レギュレータ４００は、シリーズレギュレータであり、ＦＥＴ３８５のゲート‐ソース間電圧を制御し、ＦＥＴ３８５のドレイン‐ソース間に印加される電圧を制御して出力電圧３１８を定電圧に制御している。出力電圧３１８は、レギュレーション抵抗３７４、抵抗３７６とで分圧され、シャントレギュレータ３８７のＲＥＦ端子に入力される。そして、シャントレギュレータ３８７のＲＥＦ端子に入力された電圧レベルに応じたフィードバック信号がシャントレギュレータ３８７のＫ端子から出力される。シャントレギュレータ３８７のＫ端子の電圧は、抵抗３８０を出力電圧２１８でプルアップして、ツェナーダイオード３９４を介し、抵抗３８３と抵抗３９３とで分圧された後、トランジスタ３８２のベース端子へ電気的に接続されている。抵抗３８１は、ＦＥＴ３８５のゲート‐ソース間に接続され、ゲート‐ソース間の電位安定のために用いられる。トランジスタ３８２は、シャントレギュレータ３８７のＫ端子から出力されるフィードバック信号によりＦＥＴ３８５のゲート端子の電圧を調整している。なお、シャントレギュレータ３８７は、出力電圧３１８を目標電圧に制御できるような素子（コンパレータやオペアンプ等）であればよい。ツェナーダイオード３９４は、フィードバック信号の電圧を降圧し、トランジスタ３８２を確実にオン、オフさせるために接続されている。シャントレギュレータ３８７のＫ端子の電圧範囲が広いものであれば、Ｋ端子の電圧を降圧せずにトランジスタ３８２を制御できるため、ツェナーダイオード３９４は削除してしまってもよい。なお、トランジスタ３８２の暗電流が小さい場合は、暗電流によってＦＥＴ３８５がオンしてしまうおそれがないため、抵抗３９３と抵抗３８３とで分圧する必要がなく、抵抗３９３を削除してしまってもよい。なお、シャントレギュレータ３８７のＫ端子には、抵抗７８４を介してレギュレータ起動信号４０１が接続されている。 [Explanation of Regulator 400]
A circuit configuration of regulator 400 will be described. The regulator 400 is a series regulator, controls the voltage between the gate and source of the FET 385, controls the voltage applied between the drain and source of the FET 385, and controls the output voltage 318 to a constant voltage. The output voltage 318 is divided by the regulation resistors 374 and 376 and input to the REF terminal of the shunt regulator 387 . A feedback signal corresponding to the voltage level input to the REF terminal of the shunt regulator 387 is output from the K terminal of the shunt regulator 387 . The voltage of the K terminal of the shunt regulator 387 pulls up the resistor 380 with the output voltage 218, passes through the Zener diode 394, is divided by the resistors 383 and 393, and is electrically connected to the base terminal of the transistor 382. It is connected. A resistor 381 is connected between the gate and source of the FET 385 and used for stabilizing the potential between the gate and source. The transistor 382 adjusts the voltage of the gate terminal of the FET 385 according to the feedback signal output from the K terminal of the shunt regulator 387 . The shunt regulator 387 may be any element (comparator, operational amplifier, etc.) that can control the output voltage 318 to the target voltage. Zener diode 394 is connected to step down the voltage of the feedback signal to ensure that transistor 382 is turned on and off. If the voltage range of the K terminal of the shunt regulator 387 is wide, the Zener diode 394 may be omitted because the transistor 382 can be controlled without stepping down the voltage of the K terminal. When the dark current of the transistor 382 is small, the FET 385 is not turned on by the dark current. Note that the K terminal of the shunt regulator 387 is connected to the regulator activation signal 401 through the resistor 784 .

（定電圧制御）
レギュレータ４００の定電圧制御について説明する。出力電圧３１８が目標電圧よりも高い場合はＫ端子の電圧が下がり、トランジスタ３８２のベース電流が低下するのでコレクタ電流も低下する。そのため、ＦＥＴ３８５のゲート‐ソース間電圧が低下し、ＦＥＴ３８５のドレイン‐ソース間のオン抵抗が上昇するので、出力電圧３１８が低下する。なお、出力電圧３１８がＤＣＤＣコンバータ３００によってレギュレータ４００の目標電圧よりも高い電圧に制御されている場合は、ＦＥＴ３８５はオフ状態（オン抵抗が最大）となり、レギュレータ４００は停止する。出力電圧３１８が目標電圧よりも低い場合はＫ端子の電圧が上がり、トランジスタ３８２のベース電流が上昇するのでコレクタ電流も上昇する。そのため、ＦＥＴ３８５のゲート‐ソース間電圧が上昇し、ＦＥＴ３８５のドレイン‐ソース間のオン抵抗が低下するので、出力電圧３１８が上昇する。 (constant voltage control)
Constant voltage control of regulator 400 will be described. When the output voltage 318 is higher than the target voltage, the voltage at the K terminal decreases, the base current of the transistor 382 decreases, and the collector current also decreases. As a result, the gate-source voltage of the FET 385 decreases and the on-resistance between the drain and source of the FET 385 increases, thereby decreasing the output voltage 318 . When the output voltage 318 is controlled by the DCDC converter 300 to a voltage higher than the target voltage of the regulator 400, the FET 385 is turned off (on-resistance is maximum), and the regulator 400 stops. When the output voltage 318 is lower than the target voltage, the voltage at the K terminal rises and the base current of the transistor 382 rises, so the collector current also rises. As a result, the gate-source voltage of the FET 385 increases and the on-resistance between the drain and source of the FET 385 decreases, so the output voltage 318 increases.

レギュレータ４００によって制御される出力電圧３１８をＶ５Ｖ＿ＲＥＧとする。シャントレギュレータ３８７の基準電圧をＶＲＥＦ（ＲＥＧ）、抵抗３７４、抵抗３７６の抵抗値をそれぞれＲ３７４、Ｒ３７６とすると、Ｖ５Ｖ＿ＲＥＧは、以下の式（５）で表される電圧になるように制御される。

Figure 0007277154000005
具体的な数値の例として、Ｖ５Ｖ＿ＲＥＧ＝５．２Ｖとする。 Let the output voltage 318 controlled by the regulator 400 be V 5V_REG . Assuming that the reference voltage of the shunt regulator 387 is V REF(REG) and the resistance values of the resistors 374 and 376 are R 374 and R 376 respectively, V 5V_REG is set to the voltage represented by the following equation (5). controlled.
Figure 0007277154000005
 As an example of specific numerical values, V 5V_REG =5.2V.

（レギュレータの動作）
レギュレータ４００の動作について説明する。入力電圧が高い場合は（出力電圧２１８（Ｖ２４Ｖ））、ＤＣＤＣコンバータ３００が出力電圧３１８を目標電圧となるように制御できるので、レギュレータ４００は、前述した通りＦＥＴ３８５をオフするように制御する。具体的には、ＤＣＤＣコンバータ３００が出力電圧３１８を例えばＶ５Ｖ＿ＤＣＤＣ＝５．２１Ｖで制御しているときは、レギュレータ４００は、ＤＣＤＣコンバータ３００が出力した出力電圧３１８の電圧をフィードバックする。そしてレギュレータ４００は、レギュレータ４００の出力電圧３１８の目標電圧Ｖ５Ｖ＿ＲＥＧより高いと判断する。このため、前述した通り、レギュレータ４００はＦＥＴ３８５をオフに制御する。次に、入力電圧が低い場合は（出力電圧２１８（Ｖ５Ｖ））、前述したようにＤＣＤＣコンバータ３００が出力電圧３１８を目標電圧Ｖ５Ｖ＿ＤＣＤＣ＝５．２１Ｖになるように制御できなくなり、出力電圧３１８が低下する。出力電圧３１８がレギュレータ４００の出力電圧の目標電圧Ｖ５Ｖ＿ＲＥＧ＝５．２Ｖより低くなると、レギュレータ４００が起動し出力電圧３１８を定電圧制御する。 (Operation of regulator)
The operation of regulator 400 will be described. When the input voltage is high (output voltage 218 (V 24V )), the DCDC converter 300 can control the output voltage 318 to the target voltage, so the regulator 400 controls the FET 385 to turn off as described above. Specifically, when the DCDC converter 300 controls the output voltage 318 at V 5V_DCDC =5.21 V, for example, the regulator 400 feeds back the voltage of the output voltage 318 output by the DCDC converter 300 . The regulator 400 then determines that the output voltage 318 of the regulator 400 is higher than the target voltage V 5V_REG . Therefore, as described above, the regulator 400 controls the FET 385 to be off. Next, when the input voltage is low (output voltage 218 (V 5V )), the DCDC converter 300 cannot control the output voltage 318 to the target voltage V 5V_DCDC =5.21V as described above, and the output voltage 318 decreases. When the output voltage 318 becomes lower than the target voltage V 5V_REG =5.2V of the output voltage of the regulator 400 , the regulator 400 is activated and the output voltage 318 is under constant voltage control.

次に、レギュレータ４００の出力電圧３１８の目標電圧Ｖ５Ｖ＿ＲＥＧ（５．２Ｖ）をＤＣＤＣコンバータ３００の出力電圧３１８の目標電圧Ｖ５Ｖ＿ＤＣＤＣ（５．２１Ｖ）よりも低くしている理由を説明する。レギュレータ４００がＦＥＴ３８５をオンするように制御する場合、レギュレータ４００への入力電圧と出力電圧との差が小さい又はほとんど差がない状態で行い、ＦＥＴ３８５による損失を低減させる必要がある。ＤＣＤＣコンバータ３００が出力電圧３１８を目標電圧に制御している間は、レギュレータ４００への入力電圧が高い状態であり、レギュレータ４００がＦＥＴ３８５をオンさせてしまうとＦＥＴ３８５による損失が大きくなってしまう。そのため、ＤＣＤＣコンバータ３００が出力電圧３１８を目標電圧に制御できる場合において、レギュレータ４００の出力電圧３１８の目標電圧をＤＣＤＣコンバータ３００の出力電圧の目標電圧よりも低く設定する。これにより、ＦＥＴ３８５をオフするようにしている。ここで、ＤＣＤＣコンバータ３００が出力電圧３１８を目標電圧に制御できる場合とは、レギュレータ４００への入力電圧が高い場合である。 Next, the reason why the target voltage V 5V_REG (5.2V) of the output voltage 318 of the regulator 400 is lower than the target voltage V 5V_DCDC (5.21V) of the output voltage 318 of the DCDC converter 300 will be explained. When the regulator 400 controls the FET 385 to turn on, it is necessary to reduce the loss due to the FET 385 by performing the control under the condition that the difference between the input voltage and the output voltage of the regulator 400 is small or almost zero. While the DCDC converter 300 is controlling the output voltage 318 to the target voltage, the input voltage to the regulator 400 is high, and if the regulator 400 turns on the FET 385, the loss due to the FET 385 increases. Therefore, when the DCDC converter 300 can control the output voltage 318 to the target voltage, the target voltage of the output voltage 318 of the regulator 400 is set lower than the target voltage of the output voltage of the DCDC converter 300 . As a result, the FET 385 is turned off. Here, the case where the DCDC converter 300 can control the output voltage 318 to the target voltage is the case where the input voltage to the regulator 400 is high.

このように、入力電圧が高い場合（スタンバイ状態及びプリント状態）（出力電圧２１８（Ｖ２４Ｖ））、出力電圧３１８はＤＣＤＣコンバータ３００によって目標電圧Ｖ５Ｖ＿ＤＣＤＣとなるように制御される。入力電圧が高い場合、レギュレータ４００の動作は停止される。入力電圧が低い場合（スリープ状態）（出力電圧２１８（Ｖ５Ｖ））、レギュレータ４００が動作し、出力電圧３１８はレギュレータ４００によって目標電圧Ｖ５Ｖ＿ＲＥＧとなるように制御される。 Thus, when the input voltage is high (standby state and print state) (output voltage 218 (V 24V )), the output voltage 318 is controlled by the DCDC converter 300 to the target voltage V 5V_DCDC . When the input voltage is high, regulator 400 is deactivated. When the input voltage is low (sleep state) (output voltage 218 (V 5V )), the regulator 400 operates and the output voltage 318 is controlled by the regulator 400 to the target voltage V 5V_REG .

（レギュレータの効果）
次に、レギュレータ４００の効果を説明する。ＤＣＤＣコンバータ３００は、入力電圧が低下した場合、前述した通り、ハイサイドＦＥＴ３６０のオンデューティが高くなり、電源ＩＣ３５８が出力できる最大オンデューティ（例えば８０％）に達する。電源ＩＣ３５８が出力できる最大オンデューティに達した状態では、出力電圧３１８をスイッチング状態では目標電圧に保つことができず、出力電圧３１８は目標電圧よりも低下してしまう。具体的には、出力電圧３１８の負荷がなく、ＤＣＤＣコンバータ３００の出力電圧３１８の目標電圧Ｖ５Ｖ＿ＤＣＤＣ＝５．２１Ｖとする。そうすると、ＤＣＤＣコンバータ３００への入力電圧（ＡＣＤＣコンバータ２００の出力電圧２１８Ｖ５Ｖ＝５．２Ｖ付近）が低下していった場合、ハイサイドＦＥＴ３６０を１００％で駆動できない。このため、ＤＣＤＣコンバータ３００の出力電圧３１８（Ｖ５Ｖ＿ＤＣＤＣ＝５．２１Ｖ以下）が低下してしまう。そのため、そのままＤＣＤＣコンバータ３００への入力電圧が低下していくと出力電圧３１８も低下するので、前述した電圧精度の規格を満足することができない。具体的には、Ｖ５Ｖ＿ＤＣＤＣ＜Ｖｍｉｎとなる。 (Effect of regulator)
Next, the effects of regulator 400 will be described. When the input voltage of the DCDC converter 300 drops, as described above, the on-duty of the high-side FET 360 increases and reaches the maximum on-duty (for example, 80%) that the power supply IC 358 can output. When the power supply IC 358 reaches the maximum on-duty output, the output voltage 318 cannot be maintained at the target voltage in the switching state, and the output voltage 318 drops below the target voltage. Specifically, there is no load on the output voltage 318, and the target voltage V5V_DCDC of the output voltage 318 of the DCDC converter 300 is set to 5.21V. Then, when the input voltage to the DCDC converter 300 (the output voltage of the ACDC converter 200 is around 218V 5V =5.2V), the high-side FET 360 cannot be driven at 100%. Therefore, the output voltage 318 (V 5V_DCDC =5.21 V or less) of the DCDC converter 300 is lowered. Therefore, if the input voltage to the DCDC converter 300 continues to drop, the output voltage 318 will also drop, so the voltage accuracy standard described above cannot be satisfied. Specifically, V 5V_DCDC <Vmin.

そこで、レギュレータ４００は、ＤＣＤＣコンバータ３００への入力電圧が低下していった場合において、前述した通りＦＥＴ３８５によって、出力電圧３１８を定電圧制御する。具体的には、出力電圧３１８の負荷がなく、ＤＣＤＣコンバータ３００の出力電圧３１８の目標電圧Ｖ５Ｖ＿ＤＣＤＣ＝５．２１Ｖとする。そうすると、ＤＣＤＣコンバータ３００への入力電圧（ＡＣＤＣコンバータ２００の出力電圧Ｖ５Ｖ＝５．２Ｖ付近）が低下していった場合、ハイサイドＦＥＴ３６０を１００％で駆動できない。このため、ＤＣＤＣコンバータ３００の出力電圧３１８（Ｖ５Ｖ＿ＤＣＤＣ＝５．２１Ｖ以下）が低下する。ところが、レギュレータ４００は、出力電圧３１８をフィードバックし、ＦＥＴ３８５によって出力電圧３１８を定電圧制御するため、レギュレータ４００の出力電圧（Ｖ５Ｖ＿ＲＥＧ＝５．２Ｖ）の電圧精度を満足することができる。したがって、ＤＣＤＣコンバータ３００への入力電圧が低下していく場合においも、前述した電圧精度の規格を満足することができる。具体的には、Ｖｍｉｎ＜Ｖ５Ｖ＿ＲＥＧ＜Ｖｍａｘとなる。 Therefore, when the input voltage to the DCDC converter 300 decreases, the regulator 400 controls the output voltage 318 to a constant voltage using the FET 385 as described above. Specifically, there is no load on the output voltage 318, and the target voltage V5V_DCDC of the output voltage 318 of the DCDC converter 300 is set to 5.21V. Then, when the input voltage to the DCDC converter 300 (the output voltage V 5V of the ACDC converter 200 is about 5.2 V) decreases, the high-side FET 360 cannot be driven at 100%. Therefore, the output voltage 318 (V 5V_DCDC =5.21 V or less) of the DCDC converter 300 decreases. However, since the regulator 400 feeds back the output voltage 318 and performs constant voltage control on the output voltage 318 by the FET 385, the voltage accuracy of the output voltage (V 5V_REG =5.2 V) of the regulator 400 can be satisfied. Therefore, even when the input voltage to the DCDC converter 300 decreases, it is possible to satisfy the voltage accuracy standard described above. Specifically, Vmin< V5V_REG <Vmax.

［ＰＷＭ信号１３５による出力電圧２１８の調整範囲］
（ＰＷＭ信号１３５のオンデューティが０％のとき）
図３のＡＣＤＣコンバータ２００の回路図を用いて、ＰＷＭ信号１３５のオンデューティが０％から１００％に変化したときの出力電圧２１８の調整範囲について説明する。前述したように、制御部５００から出力されたＰＷＭ信号１３５のデューティが０％のとき、２４Ｖ出力時（スタンバイ状態又はプリント状態）における出力電圧２１８（Ｖ２４Ｖ＿ＯＦＦ）は、式（２）で表される。また５Ｖ出力時（スリープ状態）における出力電圧２１８（Ｖ５Ｖ＿ＯＦＦ）は式（３）で表される。「＿ＯＦＦ」は、ＰＷＭ信号１３５のオンデューティが０％ということを表している。このときの出力電圧２１８は、出力電圧２１８の取りうる電圧の中で最も低い電圧となる。 [Adjustment range of output voltage 218 by PWM signal 135]
(When the on-duty of PWM signal 135 is 0%)
The adjustment range of output voltage 218 when the on-duty of PWM signal 135 changes from 0% to 100% will be described using the circuit diagram of ACDC converter 200 in FIG. As described above, when the duty of the PWM signal 135 output from the control unit 500 is 0%, the output voltage 218 (V 24V_OFF ) at the time of 24V output (standby state or print state) is expressed by equation (2). be. Also, the output voltage 218 (V 5V — OFF ) during 5V output (sleep state) is expressed by Equation (3). " _OFF " indicates that the on-duty of the PWM signal 135 is 0%. The output voltage 218 at this time is the lowest voltage among possible voltages of the output voltage 218 .

（ＰＷＭ信号１３５のオンデューティが１００％のとき）
次にＰＷＭ信号１３５のオンデューティが１００％のとき、トランジスタ１２６がオンする。ここで、抵抗２２４、抵抗１２３、抵抗１２５、抵抗１２９の合成抵抗値をＲ２２４ＯＮとする。抵抗２２４、抵抗２２６、抵抗１２３、抵抗１２５、抵抗１２９の合成抵抗値をＲ２２６ＯＮとする。計算の簡略化のためにトランジスタ１２６のコレクタ－エミッタ間の飽和電圧ＶＣＥ（ｓａｔ）及びＦＥＴ２２７のオン抵抗を無視できる程小さいとすると、それぞれ次の式（６）及び式（７）で表される。

Figure 0007277154000006
Figure 0007277154000007
 このときの２４Ｖ出力時（スタンバイ状態又はプリント状態）における出力電圧２１８（Ｖ２４Ｖ＿ＯＮ）と、５Ｖ出力時（スリープ状態）における出力電圧２１８（Ｖ５Ｖ＿ＯＮ）は、次の式（８）及び式（９）で求められる値となるように制御される。
Figure 0007277154000008
Figure 0007277154000009
 「＿ＯＮ」は、ＰＷＭ信号１３５のオンデューティが１００％ということを表している。このときの出力電圧２１８は、出力電圧２１８の取りうる電圧の中で最も高い電圧となる。 (When the on-duty of PWM signal 135 is 100%)
Next, when the on-duty of PWM signal 135 is 100%, transistor 126 is turned on. Here, the combined resistance value of resistors 224, 123, 125, and 129 is assumed to be R 224ON . Assume that the combined resistance value of resistors 224, 226, 123, 125, and 129 is R226ON . Assuming that the collector-emitter saturation voltage V CE(sat) between the collector and the emitter of the transistor 126 and the on-resistance of the FET 227 are negligibly small for the sake of simplification of calculation, they are expressed by the following equations (6) and (7), respectively. be.
Figure 0007277154000006
Figure 0007277154000007
 At this time, the output voltage 218 (V 24V_ON ) at the time of 24V output (standby state or print state) and the output voltage 218 (V 5V_ON ) at the time of 5V output (sleep state) are given by the following equations (8) and (9). ) is controlled to be the value obtained by
Figure 0007277154000008
Figure 0007277154000009
 " _ON " indicates that the on-duty of the PWM signal 135 is 100%. The output voltage 218 at this time is the highest voltage among possible voltages of the output voltage 218 .

（ＰＷＭ信号１３５のオンデューティが０％と１００％以外のとき）
次にＰＷＭ信号１３５が０％と１００％以外のデューティである場合の動作について説明する。ＰＷＭ信号１３５は、抵抗１２７で制限された電流でトランジスタ１２６を駆動する。ＰＷＭ信号１３５のデューティに応じた電圧が抵抗１２５とコンデンサ１２４の時定数でコンデンサ１２４に充電される。コンデンサ１２４の両端電圧を電圧１３６とする。ここで、抵抗１２５とコンデンサ１２４の時定数は、ＰＷＭ信号１３５の周波数に対して大きく設定される。つまり、出力電圧２１８のリプル電圧を下げるために、電圧１３６は直流化されている。直流化された電圧１３６は、電流調整用の抵抗１２３を介して、シャントレギュレータ２２５のＲＥＦ端子にリファレンス電圧ＶＲＥＦとして供給される。リファレンス電圧ＶＲＥＦとして供給されるシャントレギュレータ２２５のＲＥＦ端子への電流供給量を調整することで、出力電圧２１８が調整される。つまり、ＰＷＭ信号１３５のデューティに応じて出力電圧２１８が調整される。 (When the on-duty of the PWM signal 135 is other than 0% and 100%)
Next, the operation when the PWM signal 135 has a duty other than 0% and 100% will be described. PWM signal 135 drives transistor 126 with a current limited by resistor 127 . A voltage corresponding to the duty of the PWM signal 135 is charged to the capacitor 124 with the time constant of the resistor 125 and the capacitor 124 . The voltage across capacitor 124 is voltage 136 . Here, the time constant of resistor 125 and capacitor 124 is set to be large with respect to the frequency of PWM signal 135 . In other words, the voltage 136 is DC-converted to reduce the ripple voltage of the output voltage 218 . The DC voltage 136 is supplied as a reference voltage V REF to the REF terminal of the shunt regulator 225 via the current adjusting resistor 123 . The output voltage 218 is adjusted by adjusting the amount of current supplied to the REF terminal of the shunt regulator 225, which is supplied as the reference voltage VREF . That is, the output voltage 218 is adjusted according to the duty of the PWM signal 135. FIG.

以上により、ＰＷＭ信号１３５を０％から１００％に変化させたとき、２４Ｖ出力時における出力電圧２１８（Ｖ２４Ｖ）の取りうる範囲は、式（２）と式（８）から次の式（１０）で表される。また、５Ｖ出力時における出力電圧２１８（Ｖ５Ｖ）の取りうる範囲は、式（３）と式（９）から次の式（１１）で表される。

Figure 0007277154000010
Figure 0007277154000011
 From the above, when the PWM signal 135 is changed from 0% to 100%, the possible range of the output voltage 218 (V 24V ) at the time of 24V output is obtained from the following equation (10) from the equations (2) and (8). ). Also, the possible range of the output voltage 218 (V 5V ) at the time of 5V output is represented by the following formula (11) based on the formulas (3) and (9).
Figure 0007277154000010
Figure 0007277154000011

［ＰＷＭ信号１３５のデューティの算出方法］
目標とする出力電圧２１８からＰＷＭ信号１３５のデューティを算出する方法について説明する。説明の簡便化のため、トランジスタ１２６のコレクタ－エミッタ間の飽和電圧ＶＣＥ（ｓａｔ）を無視できる程小さいとすると、ＰＷＭ信号１３５のデューティと出力電圧２１８とは、およそ比例関係にある。２４Ｖ出力時と５Ｖ出力時のＰＷＭ信号１３５のデューティをそれぞれＤ２４Ｖ、Ｄ５Ｖとする。Ｄ２４Ｖ、Ｄ５Ｖは、目標となる出力電圧２１８の電圧値Ｖ２４Ｖ＿Ｔ及びＶ５Ｖ＿Ｔを用いて、次の式（１２）及び式（１３）で表すことができる。

Figure 0007277154000012
Figure 0007277154000013
 [Method for calculating duty of PWM signal 135]
A method of calculating the duty of the PWM signal 135 from the target output voltage 218 will be described. For simplicity of explanation, assuming that the collector-emitter saturation voltage V CE(sat) of the transistor 126 is so small that it can be ignored, the duty of the PWM signal 135 and the output voltage 218 are approximately proportional. The duty of the PWM signal 135 when outputting 24V and when outputting 5V is assumed to be D24V and D5V , respectively. D 24V and D 5V can be expressed by the following equations (12) and (13) using voltage values V 24V_T and V 5V_T of the target output voltage 218 .
Figure 0007277154000012
Figure 0007277154000013

よって目標とする出力電圧２１８の電圧値Ｖ２４Ｖ＿Ｔ及びＶ５Ｖ＿Ｔに対して、およそのＰＷＭ信号１３５のデューティを定めることができる。しかしながら実際には、ＰＷＭ信号１３５の立ち上がり時間、立ち下がり時間や飽和電圧ＶＣＥ（ｓａｔ）が存在するため誤差が存在する。精度よく目標の出力電圧２１８を出力するためには、ＰＷＭ信号１３５のデューティの調整が必要である。あらかじめ最適な電圧値となるデューティをメモリ５０１に格納して制御部５００により読み出してもよいし、制御部５００のＡＤコンバータ（不図示）でモニタしてフィードバックしてもよい。メモリ５０１に格納するデータとしてはデューティ［％］、オン時間、オンのクロック数等である。 Therefore, the approximate duty of the PWM signal 135 can be determined for the target voltage values V 24V_T and V 5V_T of the output voltage 218 . In practice, however, there is an error due to the rise time and fall time of the PWM signal 135 and the saturation voltage VCE (sat) . In order to accurately output the target output voltage 218, it is necessary to adjust the duty of the PWM signal 135. FIG. The duty that provides the optimum voltage value may be stored in advance in the memory 501 and read out by the control unit 500, or may be monitored by an AD converter (not shown) of the control unit 500 and fed back. The data stored in the memory 501 include the duty [%], the ON time, the number of ON clocks, and the like.

具体的な数値の例としてＶＲＥＦ＝２．５Ｖ、Ｒ２２３＝３９ｋΩ、Ｒ２２４＝４．３ｋΩ、Ｒ２２６、＝３３ｋΩ、Ｒ１２３＝４７ｋΩ、Ｒ１２５＝１ｋΩ、Ｒ１２８＝２２０ｋΩ、Ｒ１２９＝１ｋΩとする。この場合、ＰＷＭ信号１３５のデューティを変えることによって、出力電圧２１８は、スタンバイ状態又はプリント状態のときには、第１の範囲内である２２．２９Ｖ＜Ｖ２４Ｖ＜２７．１６Ｖとなるように調整される。また、出力電圧２１８は、スリープ状態のときには、第２の範囲内である４．７８Ｖ＜Ｖ５Ｖ＜７．１０Ｖとなるように調整される。また、スタンバイ状態又はプリント状態のときの最適な電圧値をＶ２４Ｖ＝２４．０Ｖとすると、ＰＷＭ信号１３５のデューティはＤ２４Ｖ＝３５．０％となる。スリープ状態のときの最適な電圧値をＶ５Ｖ＝５．１５Ｖとすると、ＰＷＭ信号１３５のデューティはＤ５Ｖ＝１５．９％となる。 As specific numerical examples, V REF =2.5 V, R 223 =39 kΩ, R 224 =4.3 kΩ, R 226 =33 kΩ, R 123 =47 kΩ, R 125 =1 kΩ, R 128 =220 kΩ, R 129 = 1 kΩ. In this case, by changing the duty of the PWM signal 135, the output voltage 218 is adjusted to be 22.29V< V24V <27.16V, which is within the first range, during the standby state or print state. . In addition, the output voltage 218 is adjusted in the sleep state so that 4.78V< V5V <7.10V, which is within the second range. Also, if the optimum voltage value in the standby state or print state is V 24V =24.0V, the duty of the PWM signal 135 is D 24V =35.0%. Assuming that the optimum voltage value in the sleep state is V 5V =5.15V, the duty of the PWM signal 135 is D 5V =15.9%.

［制御動作の説明］
図５にプリンタ１００がスタンバイ状態からスリープ状態へ遷移する場合の電源装置１０８の動作のタイミングチャートを示す。図５の説明において、各々の定数を前述した具体的な数値を用いることとする。つまり、ＶＲＥＦ＝２．５Ｖ、Ｒ２２３＝３９ｋΩ、Ｒ２２４＝４．３ｋΩ、Ｒ２２６＝３３ｋΩ、Ｒ１２３＝４７ｋΩ、Ｒ１２５＝１ｋΩ、Ｒ１２８＝２２０ｋΩ、Ｒ１２９＝１ｋΩ、とする。また、ＶＦＢ（ＤＣＤＣ）＝１．２４Ｖ、Ｒ３７４＝３９ｋΩ、Ｒ３７６＝１４．７ｋΩ、ＶＲＥＦ（ＲＥＧ）＝１．２４Ｖ、Ｒ３５４＝４７ｋΩ、Ｒ３５５＝１４．７ｋΩ、とする。出力電圧２１８の電圧調整範囲は、上述した２２．２９Ｖ＜Ｖ２４Ｖ＜２７．１６Ｖ、４．７８Ｖ＜Ｖ５Ｖ＜７．１０Ｖである。出力電圧３１８はＶ５Ｖ＿ＤＣＤＣ＝５．２１Ｖ、Ｖ５Ｖ＿ＲＥＧ＝５．２０Ｖとなるように制御される。 [Explanation of control operation]
FIG. 5 shows a timing chart of the operation of the power supply device 108 when the printer 100 transitions from the standby state to the sleep state. In the description of FIG. 5, the specific numerical values described above are used for each constant. That is, V REF =2.5 V, R 223 =39 kΩ, R 224 =4.3 kΩ, R 226 =33 kΩ, R 123 =47 kΩ, R 125 =1 kΩ, R 128 =220 kΩ, and R 129 =1 kΩ. Also, V FB(DCDC) =1.24 V, R 374 =39 kΩ, R 376 =14.7 kΩ, V REF(REG) =1.24 V, R 354 =47 kΩ, R 355 =14.7 kΩ. The voltage adjustment range of the output voltage 218 is 22.29V< V24V <27.16V and 4.78V< V5V <7.10V as described above. The output voltage 318 is controlled such that V5V_DCDC =5.21V and V5V_REG =5.20V.

図５のグラフは、横軸が時間ｔ、縦軸は、（ｉ）はＡＣＤＣコンバータ出力電圧切り替え信号２０１の出力（ハイレベル（Ｈｉｇｈ）又はローレベル（Ｌｏｗ））を示す。（ｉｉ）は出力電圧２１８の波形（２４Ｖ、５．１５Ｖ）、（ｉｉｉ）はレギュレータ起動信号４０１の出力（オン（ＯＮ）又はオフ（ＯＦＦ））を示す。（ｉｖ）はＤＣＤＣコンバータ起動信号３０１の出力（オン（ＯＮ）又はオフ（ＯＦＦ））、（ｖ）はロードＳＷ制御信号６０１の出力（オン（ＯＮ）又はオフ（ＯＦＦ））を示している。 In the graph of FIG. 5, the horizontal axis represents time t, the vertical axis represents (i) the output (high level (High) or low level (Low)) of the ACDC converter output voltage switching signal 201 . (ii) shows the waveform (24 V, 5.15 V) of the output voltage 218, and (iii) shows the output (on (ON) or off (OFF)) of the regulator activation signal 401. FIG. (iv) indicates the output (on (ON) or off (OFF)) of the DCDC converter start signal 301, and (v) indicates the output (on (ON) or off (OFF)) of the load SW control signal 601. FIG.

（スタンバイ状態からスリープ状態への遷移）
スタンバイ状態（又はプリント状態）において、ＡＣＤＣコンバータ出力電圧切り替え信号２０１はハイレベル、出力電圧２１８は２４．０Ｖとなっている。また、レギュレータ起動信号４０１はオフ、ＤＣＤＣコンバータ起動信号３０１はオン、ロードＳＷ制御信号６０１はオンとなっている。出力電圧２１８はＶ２４Ｖ＝２４．０Ｖ（Ｄ２４Ｖ＝３５．０％）、出力電圧３１８はＶ５Ｖ＿ＤＣＤＣ＝５．２１Ｖとなっている。レギュレータ４００はオフ状態である。 (transition from standby state to sleep state)
In the standby state (or print state), the ACDC converter output voltage switching signal 201 is high level and the output voltage 218 is 24.0V. Also, the regulator activation signal 401 is off, the DCDC converter activation signal 301 is on, and the load SW control signal 601 is on. The output voltage 218 is V 24V =24.0V (D 24V =35.0%), and the output voltage 318 is V 5V_DCDC =5.21V. Regulator 400 is off.

タイミングＴａは、プリンタ１００がスタンバイ状態に遷移してから所定時間ｔｓが経過したタイミングを示している。前述したように、プリンタ１００はスタンバイ状態に遷移してから所定時間が経過すると、プリンタ１００の消費電力を低減するために制御部５００はプリンタ１００をスリープ状態に遷移させる。タイミングＴａにおいて、制御部５００は、ＡＣＤＣコンバータ出力電圧切り替え信号２０１をハイレベルからローレベルに切り替える。前述したように、ＡＣＤＣコンバータ２００は、ＡＣＤＣコンバータ出力電圧切り替え信号２０１がハイレベルのときには出力電圧２１８が２４Ｖとなるように制御する。ＡＣＤＣコンバータ２００は、ＡＣＤＣコンバータ出力電圧切り替え信号２０１がローレベルのときには出力電圧２１８がおよそ５Ｖ（前述の定数ではＰＷＭ信号１３５のデューティによって４．７８Ｖ＜Ｖ５Ｖ＜７．１０Ｖの電圧値）となるように制御する。 A timing Ta indicates a timing at which a predetermined time ts has elapsed after the printer 100 transitioned to the standby state. As described above, after a predetermined period of time has passed since the printer 100 transitioned to the standby state, the control unit 500 transitions the printer 100 to the sleep state in order to reduce the power consumption of the printer 100 . At timing Ta, the control unit 500 switches the ACDC converter output voltage switching signal 201 from high level to low level. As described above, the ACDC converter 200 controls the output voltage 218 to 24V when the ACDC converter output voltage switching signal 201 is at high level. When the ACDC converter output voltage switching signal 201 is at low level, the ACDC converter 200 has an output voltage 218 of approximately 5 V (with the aforementioned constant, the voltage value of 4.78 V<V 5 V <7.10 V depending on the duty of the PWM signal 135). to control.

また制御部５００は、タイミングＴａのスタンバイ状態からスリープ状態に移行する際に、ＰＷＭ信号１３５のデューティを変更する。その理由は、ＤＣＤＣコンバータ３００が動作可能な入力電圧（＝出力電圧２１８）かつ、極力低い入力電圧に出力電圧２１８を調整するためである。前述の通り、ＤＣＤＣコンバータ３００の最大デューティは８０％であるため、出力電圧２１８を目標電圧５．１５Ｖに制御する場合、出力電圧２１８が５．１５Ｖ／８０％＝６．４４ＶまでＤＣＤＣコンバータ３００は動作可能である。例えば、ＰＷＭ信号１３５のデューティは式（１３）からＤ５Ｖ＝８２．６％とすれば出力電圧２１８は６．７０Ｖとなる。このように、制御部５００は、タイミングＴａにおいて、ＰＷＭ信号１３５のデューティを３５％から８２．６％に切り替えることにより、出力電圧２１８の目標電圧値（Ｖ５Ｖ＿Ｔ）を６．７０Ｖに調整する。これにより出力電圧２１８が低下した際も、ＤＣＤＣコンバータ３００が目標電圧である５．２１Ｖを出力することが可能となる。 Further, the control unit 500 changes the duty of the PWM signal 135 when shifting from the standby state at the timing Ta to the sleep state. The reason for this is to adjust the output voltage 218 to an input voltage (=output voltage 218) at which the DCDC converter 300 can operate and as low an input voltage as possible. As described above, the maximum duty of the DCDC converter 300 is 80%. Therefore, when controlling the output voltage 218 to the target voltage of 5.15V, the DCDC converter 300 operates until the output voltage 218 is 5.15V/80%=6.44V. It is operable. For example, if the duty of the PWM signal 135 is D 5V =82.6% from equation (13), the output voltage 218 will be 6.70V. In this way, the control unit 500 adjusts the target voltage value ( V5V_T ) of the output voltage 218 to 6.70V by switching the duty of the PWM signal 135 from 35% to 82.6% at the timing Ta. As a result, even when the output voltage 218 drops, the DCDC converter 300 can output the target voltage of 5.21V.

タイミングＴｂは、出力電圧２１８が６．７０Ｖとなったタイミングである。出力電圧２１８が２４．０Ｖから６．７Ｖになるまでの時間がＴ１である。タイミングＴｂにおいて、制御部５００はレギュレータ起動信号４０１をオンした後、ＤＣＤＣコンバータ起動信号３０１をオフにする。すると、出力電圧３１８の制御が、ＤＣＤＣコンバータ３００からレギュレータ４００へと切り替わる。このように、ＤＣＤＣコンバータ３００が動作可能な電圧範囲の下限（例えば、６．４４Ｖ）近く（例えば、６．７Ｖ）まで動作させ、レギュレータ４００の動作を開始するタイミングを極力出力電圧２１８が下がったタイミングとする。これにより、レギュレータ４００のＦＥＴ３８５のドレイン‐ソース間に印加される電圧を低くすることができる。これにより、なるべくドレイン‐ソース間電圧の耐圧が低い安価でオン抵抗の低いＦＥＴ３８５を選択することが可能となる。またタイミングＴｂにおいて、出力電圧２１８を目標電圧の５．１５Ｖにするため、ＰＷＭ信号１３５のデューティをさらに変更する。出力電圧２１８を５．１５Ｖとする場合、ＰＷＭ信号１３５のデューティは式（１３）からＤ５Ｖ＝１５．９％となる。 Timing Tb is the timing when the output voltage 218 becomes 6.70V. The time it takes for the output voltage 218 to change from 24.0V to 6.7V is T1. At timing Tb, the controller 500 turns on the regulator activation signal 401 and then turns off the DCDC converter activation signal 301 . Control of the output voltage 318 then switches from the DCDC converter 300 to the regulator 400 . In this way, the DCDC converter 300 is operated to near the lower limit (eg, 6.44 V) of the operable voltage range (eg, 6.7 V), and the output voltage 218 is lowered as much as possible at the timing of starting the operation of the regulator 400. Timing. As a result, the voltage applied between the drain and source of FET 385 of regulator 400 can be lowered. As a result, it is possible to select an inexpensive FET 385 with a low drain-source voltage withstand voltage and a low on-resistance. At the timing Tb, the duty of the PWM signal 135 is further changed in order to set the output voltage 218 to the target voltage of 5.15V. When the output voltage 218 is 5.15 V, the duty of the PWM signal 135 is D 5V =15.9% from equation (13).

タイミングＴｃは、出力電圧２１８が５．１５Ｖとなったタイミングである。出力電圧２１８が６．７Ｖから５．１５Ｖになるまでの時間がＴ２である。タイミングＴｃにおいて、制御部５００はロードＳＷ制御信号６０１をオフし、ＦＥＴ６００をオフすることで、スリープ状態において必要のないＦＥＴ６００後段の負荷への電圧供給を停止する。例えば、プリント中の記録材の位置を検知する紙搬送センサ（不図示）等への電圧供給を停止すること等が挙げられる。これにより、スリープ状態の消費電力を更に低減することができる。以上により、プリンタ１００はスタンバイ状態からスリープ状態への遷移が完了する。 Timing Tc is the timing when the output voltage 218 becomes 5.15V. The time it takes for the output voltage 218 to change from 6.7V to 5.15V is T2. At timing Tc, the control unit 500 turns off the load SW control signal 601 to turn off the FET 600, thereby stopping the voltage supply to the load after the FET 600, which is not necessary in the sleep state. For example, the voltage supply to a paper transport sensor (not shown) or the like that detects the position of the recording material during printing may be stopped. Thereby, the power consumption in the sleep state can be further reduced. As described above, the transition of the printer 100 from the standby state to the sleep state is completed.

なお、スリープ状態において出力電圧２１８はＶ５Ｖ＝５．１５Ｖ（Ｄ５Ｖ＝１５．９％）であり、ＤＣＤＣコンバータ３００がオフ、レギュレータ４００がオンであり、Ｖ５Ｖ＿ＲＥＧ＝５．２０Ｖである。このため、レギュレータ４００のＦＥＴ３８５は１００％オン状態となり、出力電圧３１８は５．１５Ｖが出力される。 Note that in the sleep state, the output voltage 218 is V 5V =5.15V (D 5V =15.9%), the DCDC converter 300 is off, the regulator 400 is on, and V 5V_REG =5.20V. Therefore, the FET 385 of the regulator 400 is 100% ON, and the output voltage 318 is 5.15V.

（スリープ状態からスタンバイ状態への遷移）
次に、プリンタ１００がスリープ状態からスタンバイ状態へ遷移する場合の電源装置１０８の動作について説明する。例えば、パーソナルコンピュータ等の外部機器（不図示）からプリンタ１００にプリント指示が通知されると、プリント動作を開始するために制御部５００はプリンタ１００をスリープ状態からスタンバイ状態に遷移させる。 (Transition from sleep state to standby state)
Next, the operation of the power supply device 108 when the printer 100 transitions from the sleep state to the standby state will be described. For example, when the printer 100 is notified of a print instruction from an external device (not shown) such as a personal computer, the control unit 500 causes the printer 100 to transition from the sleep state to the standby state in order to start the print operation.

タイミングＴｄにおいて、制御部５００は、ロードＳＷ制御信号６０１をオフからオンに切替え、ロードＳＷ６００をオン状態にさせることで、出力電圧５１８へ電力を供給する。時間Ｔ３はロードＳＷ６００のオン待ち時間である。 At timing Td, the control unit 500 switches the load SW control signal 601 from off to on to turn on the load SW 600 , thereby supplying power to the output voltage 518 . Time T3 is the turn-on waiting time of load switch 600 .

次に、タイミングＴｅにおいて、制御部５００は、ＡＣＤＣコンバータ出力電圧切り替え信号２０１をローレベルからハイレベルにするとともに、ＰＷＭ信号１３５のデューティを変更する。ここで、出力電圧２１８の目標電圧を２４．０Ｖにするため、ＰＷＭ信号１３５のデューティは式（１２）からＤ２４Ｖ＝３５．０％とする。 Next, at timing Te, the control unit 500 changes the ACDC converter output voltage switching signal 201 from low level to high level and changes the duty of the PWM signal 135 . Here, in order to set the target voltage of the output voltage 218 to 24.0 V, the duty of the PWM signal 135 is set to D 24V =35.0% from equation (12).

次にタイミングＴｆは、出力電圧２１８が６．７Ｖになるタイミングである。出力電圧２１８が５．１５Ｖから６．７Ｖになるまでの時間がＴ４である。このとき、制御部５００は、ＤＣＤＣコンバータ起動信号３０１をオンした後、レギュレータ起動信号４０１をオフする。タイミングＴｆを決める方法としては、例えば出力電圧２１８をＡＤ変換して制御部５００によってモニタしてもよいし、出力電圧２１８の立ち上がり時間から予測してもよい。 Timing Tf is the timing at which the output voltage 218 becomes 6.7V. The time it takes for the output voltage 218 to change from 5.15V to 6.7V is T4. At this time, the controller 500 turns off the regulator start signal 401 after turning on the DCDC converter start signal 301 . As a method of determining the timing Tf, for example, the output voltage 218 may be AD-converted and monitored by the control unit 500, or it may be predicted from the rising time of the output voltage 218. FIG.

タイミングＴｇは、出力電圧２１８が２４．０Ｖになるタイミングである。出力電圧２１８が６．７Ｖから２４．０Ｖになるまでの時間がＴ５である。タイミングＴｇにおいてスタンバイ状態への遷移が完了する。 Timing Tg is the timing at which the output voltage 218 becomes 24.0V. The time it takes for the output voltage 218 to change from 6.7V to 24.0V is T5. The transition to the standby state is completed at timing Tg.

また実施例１では、シャントレギュレータ２２５のＲＥＦ端子へ接続される抵抗値（Ｒ２２４＋Ｒ２２６）をＦＥＴ２２７によって（Ｒ２２４＋Ｒ２２６）やＲ２２４に切替えることで、出力電圧２１８の切替え（２４Ｖ／５Ｖ）を行っている。しかし、ＰＷＭ信号１３５のデューティの制御のみで出力電圧２１８について２４Ｖと５Ｖを出力することも可能である。具体的な数値の例として、ＶＲＥＦ＝２．５Ｖ、Ｒ２２３＝３９ｋΩ、Ｒ２２４＝４．３ｋΩ、Ｒ２２６＝３３ｋΩ、Ｒ１２３＝１ｋΩ、Ｒ１２５＝２．２ｋΩ、Ｒ１２８＝１ｋΩ、Ｒ１２９＝４７ｋΩとする。式（１１）から、このときの出力電圧２１８（ＶＯ）は、４．７０Ｖ＜ＶＯ＜２７．１２Ｖとなるように制御される。ただし、同じ分解能のＰＷＭ信号１３５において、５Ｖから２４ＶまでＰＷＭ信号１３５で調整する方が、細かく出力電圧２１８を調整できないことに留意する必要がある。 In the first embodiment, the resistance value (R 224 +R 226 ) connected to the REF terminal of the shunt regulator 225 is switched to (R 224 +R 226 ) or R 224 by the FET 227 to switch the output voltage 218 (24V/5V )It is carried out. However, it is also possible to output 24V and 5V for the output voltage 218 only by controlling the duty of the PWM signal 135 . As specific numerical examples, V REF =2.5 V, R 223 =39 kΩ, R 224 =4.3 kΩ, R 226 =33 kΩ, R 123 =1 kΩ, R 125 =2.2 kΩ, R 128 =1 kΩ, R 129 = 47 kΩ. From equation (11), the output voltage 218 (V O ) at this time is controlled so as to satisfy 4.70V<V O <27.12V. However, it should be noted that adjusting the PWM signal 135 from 5 V to 24 V cannot finely adjust the output voltage 218 with the PWM signal 135 having the same resolution.

また実施例１では、ＰＷＭ信号１３５によって出力電圧２１８を調整している。しかし、例えば制御部５００のＤＡコンバータ（不図示）等を用いて、接続点１３６に所定の直流電圧を出力し、シャントレギュレータ２２５のＲＥＦ端子の電圧を調整することで出力電圧２１８を調整してもよいし、他の方法で調整してもよい。 Further, in Example 1, the output voltage 218 is adjusted by the PWM signal 135 . However, for example, using a DA converter (not shown) of the control unit 500 or the like, a predetermined DC voltage is output to the connection point 136, and the voltage of the REF terminal of the shunt regulator 225 is adjusted to adjust the output voltage 218. or adjusted in other ways.

以上説明したように、実施例１によれば、ＤＣＤＣコンバータ３００への入力電圧（出力電圧２１８）を低下させる省電力（スリープ）状態に遷移する際に、ＦＥＴ３８５への印加電圧を極力下げることが可能になる。また、省電力（スリープ）状態において、ＤＣＤＣコンバータ３００のスイッチング動作を停止することで消費電力を下げつつ、出力電圧３１８の電圧精度を向上させることが可能となる。 As described above, according to the first embodiment, the voltage applied to the FET 385 can be lowered as much as possible when transitioning to the power saving (sleep) state in which the input voltage (output voltage 218) to the DCDC converter 300 is lowered. be possible. In addition, by stopping the switching operation of the DCDC converter 300 in the power saving (sleep) state, it is possible to improve the voltage accuracy of the output voltage 318 while reducing the power consumption.

以上、実施例１によれば、低消費電力モードにおいて、電源装置における出力電圧の電圧精度を向上させることができる。 As described above, according to the first embodiment, it is possible to improve the voltage accuracy of the output voltage in the power supply device in the low power consumption mode.

実施例１では、ＡＣＤＣコンバータ２００の出力電圧２１８をＰＷＭ信号１３５によって調整する構成について説明した。実施例２では、出力電圧２１８に加えて、出力電圧３１８のＤＣＤＣコンバータ３００による目標電圧をＰＷＭ信号で調整する構成について説明する。以下では、実施例１の電源装置１０８と同じ構成については、同じ符号を付し、説明を省略する。図２及び図３は実施例２においても同じ回路構成である。図６に実施例２における第２の電源３００及びレギュレータ４００の回路図を示す。実施例１に比べて、ＤＣＤＣコンバータ３００のフィードバック部を調整する第２のＰＷＭ信号であるＰＷＭ信号３３５を追加している。 In the first embodiment, the configuration in which the output voltage 218 of the ACDC converter 200 is adjusted by the PWM signal 135 has been described. In a second embodiment, in addition to the output voltage 218, a configuration will be described in which the target voltage of the output voltage 318 by the DCDC converter 300 is adjusted with a PWM signal. Below, the same components as those of the power supply device 108 of the first embodiment are denoted by the same reference numerals, and descriptions thereof are omitted. 2 and 3 also have the same circuit configuration in the second embodiment. FIG. 6 shows a circuit diagram of the second power supply 300 and the regulator 400 in the second embodiment. A PWM signal 335, which is a second PWM signal for adjusting the feedback section of the DCDC converter 300, is added as compared with the first embodiment.

制御部５００は、抵抗３２７を介して、ＤＣＤＣコンバータ３００のトランジスタ３２６のベース端子にＰＷＭ信号３３５を出力する。抵抗３２５とコンデンサ３２４は、図３の抵抗１２５とコンデンサ１２４からなる回路と同様に所定の時定数で動作する回路である。図６のＤＣＤＣコンバータ３００において、追加された抵抗３２３、抵抗３２５、抵抗３２８、抵抗３２９、コンデンサ３２４、トランジスタ３２６、抵抗３２７は、電源ＩＣ３５８のＦＢ端子に入力される電圧値を変更するための回路である。抵抗３２３は、抵抗３５４と抵抗３５５との接続点Ｂに接続されている。 Control unit 500 outputs PWM signal 335 to the base terminal of transistor 326 of DCDC converter 300 via resistor 327 . A resistor 325 and a capacitor 324 are circuits that operate with a predetermined time constant, like the circuit composed of the resistor 125 and the capacitor 124 in FIG. In the DCDC converter 300 of FIG. 6, the added resistors 323, 325, 328, 329, capacitor 324, transistor 326, and resistor 327 are circuits for changing the voltage value input to the FB terminal of the power supply IC 358. is. The resistor 323 is connected to the connection point B between the resistors 354 and 355 .

また、レギュレータ４００は、実施例１のレギュレータ４００の変形例を示しており、ツェナーダイオード３９４及び抵抗３９３が省略され、トランジスタ３８２はＦＥＴ４８２に変更されている。更に、実施例１では、レギュレータ４００のトランジスタ３８２のベース端子には抵抗３８３及びツェナーダイオード３９４、抵抗３８０を介して出力電圧２１８が接続されていた。実施例２では、ＦＥＴ４８２のゲート端子には抵抗３８３及び抵抗３８０を介して出力電圧３１８が接続されている。更に、ロードＳＷ６００を具体的にＦＥＴ６００とし、ロードＳＷ制御信号６０１は、抵抗６０２を介してＦＥＴ６００のゲート端子に出力されている。 Also, the regulator 400 shows a modified example of the regulator 400 of the first embodiment, in which the Zener diode 394 and the resistor 393 are omitted, and the transistor 382 is changed to an FET482. Furthermore, in Example 1, the output voltage 218 was connected to the base terminal of the transistor 382 of the regulator 400 via the resistor 383 , the Zener diode 394 and the resistor 380 . In Example 2, the output voltage 318 is connected to the gate terminal of the FET 482 via the resistors 383 and 380 . Furthermore, the load SW 600 is specifically an FET 600 , and the load SW control signal 601 is output to the gate terminal of the FET 600 via a resistor 602 .

［ＰＷＭ信号３３５による出力電圧３１８の調整範囲］
（ＰＷＭ信号３３５のデューティが０％のとき）
ＰＷＭ信号３３５のデューティが０％のとき、トランジスタ３２６は非導通状態となる。ここで、抵抗３２３、抵抗３２５、抵抗３２８、抵抗３２９、の抵抗値を、それぞれＲ３２３、Ｒ３２５、Ｒ３２８、Ｒ３２９、抵抗３５４、抵抗３２３、抵抗３２５、抵抗３２８の合成抵抗値をＲ３５４ＯＦＦ、とする。そうすると、合成抵抗Ｒ３５４ＯＦＦは、以下の式（１４）で表すことができる。

Figure 0007277154000014
このときの出力電圧３１８（Ｖ５Ｖ＿ＤＣＤＣ＿ＯＦＦ）は、電源ＩＣ３５８内部の基準電圧をＶＦＢ（ＤＣＤＣ）とすると、次の式（１５）で求められる値となるように制御される。
Figure 0007277154000015
 [Adjustment range of output voltage 318 by PWM signal 335]
(When duty of PWM signal 335 is 0%)
When the duty of PWM signal 335 is 0%, transistor 326 is non-conductive. Here , R _ 354 OFF . Then, the combined resistance R 354OFF can be expressed by the following equation (14).
Figure 0007277154000014
 The output voltage 318 (V 5V_DCDC_OFF ) at this time is controlled to a value obtained by the following equation (15), where V FB (DCDC) is the reference voltage inside the power supply IC 358 .
Figure 0007277154000015

（ＰＷＭ信号３３５のデューティが１００％のとき）
ＰＷＭ信号３３５のデューティが１００％のとき、抵抗３５５の抵抗値をＲ３５５、抵抗３５５、抵抗３２３、抵抗３２５、抵抗３２９の合成抵抗値Ｒ３５５ＯＮとする。計算の簡略化のためにトランジスタ３２６のコレクタ－エミッタ間の飽和電圧ＶＣＥ（ｓａｔ）を無視できる程小さいとすると、式（１６）で表すことができる。

Figure 0007277154000016
このときの出力電圧３１８（Ｖ５Ｖ＿ＤＣＤＣ＿ＯＮ）は、式（１７）で表されるように制御される。
Figure 0007277154000017
 (When duty of PWM signal 335 is 100%)
When the duty of the PWM signal 335 is 100%, the resistance value of the resistor 355 is R 355 , the combined resistance value R 355ON of the resistors 355 , 323 , 325 and 329 . Assuming that the collector-emitter saturation voltage V CE(sat) of the transistor 326 is negligibly small for simplification of calculation, it can be expressed by the equation (16).
Figure 0007277154000016
 The output voltage 318 (V 5V_DCDC_ON ) at this time is controlled as represented by Equation (17).
Figure 0007277154000017

（出力電圧３１８の取り得る範囲）
よってＰＷＭ信号３３５を０％から１００％に変化させたとき、出力電圧３１８（Ｖ５Ｖ＿ＤＣＤＣ）の取り得る範囲は、式（１５）及び式（１７）から次の式（１８）で表される。

Figure 0007277154000018
(Possible range of output voltage 318)
Therefore, when the PWM signal 335 is changed from 0% to 100%, the possible range of the output voltage 318 ( V5V_DCDC ) is represented by the following formula (18) from formulas (15) and (17).
Figure 0007277154000018

ＶＦＢ（ＤＣＤＣ）＝１．２４Ｖ、Ｒ３５４＝３９ｋΩ、Ｒ３５５＝１２ｋΩ、Ｒ３２３＝１０ｋΩ、Ｒ３２５＝１０ｋΩ、Ｒ３２８＝４７０ｋΩ、Ｒ３２９＝１ｋΩ、とする。そうすると、式（１８）から出力電圧３１８（Ｖ５Ｖ＿ＤＣＤＣ）は、第３の範囲内である４．９７Ｖ＜Ｖ５Ｖ＿ＤＣＤＣ＜７．５７Ｖとなるように制御される。また、ＰＷＭ信号３３５のデューティＤ５Ｖ＿ＤＣＤＣと出力電圧３１８（Ｖ５Ｖ＿ＤＣＤＣ）とは比例関係にあり、Ｄ５Ｖ＿ＤＣＤＣは目標となる出力電圧３１８の電圧値Ｖ５Ｖ＿ＤＣＤＣ＿Ｔを用いて、次の式（１９）で表すことができる。

Figure 0007277154000019
Let V FB(DCDC) = 1.24 V, R 354 = 39 kΩ, R 355 = 12 kΩ, R 323 = 10 kΩ, R 325 = 10 kΩ, R 328 = 470 kΩ, and R 329 = 1 kΩ. Then, from equation (18), the output voltage 318 ( V5V_DCDC ) is controlled to be 4.97V< V5V_DCDC <7.57V within the third range. Also, the duty D 5V_DCDC of the PWM signal 335 and the output voltage 318 (V 5V_DCDC ) are in a proportional relationship, and D 5V_DCDC is expressed by the following equation (19) using the voltage value V 5V_DCDC_T of the target output voltage 318 be able to.
Figure 0007277154000019

実施例２では、Ｖ５Ｖ＿ＤＣＤＣ＝５．２４Ｖとするため、デューティＤ５Ｖ＿ＤＣＤＣを１０．３％とする。ＰＷＭ信号３３５を用いることによって、スタンバイ状態における出力電圧３１８を調整することが可能となる。 In Example 2, since V 5V_DCDC =5.24 V, the duty D 5V_DCDC is set to 10.3%. By using the PWM signal 335, it is possible to regulate the output voltage 318 in the standby state.

［制御動作の説明］
実施例２においても実施例１の図５を用いて説明する。図５は、プリンタ１００がスタンバイ状態からスリープ状態へ遷移する場合の電源装置１０８の動作のタイミングチャートを示す図である。スタンバイ状態（又はプリント状態）において、ＡＣＤＣコンバータ出力電圧切り替え信号２０１はハイレベル、出力電圧２１８は２４．０Ｖである。また、スタンバイ状態（又はプリント状態）において、レギュレータ起動信号４０１はオフ、ＤＣＤＣコンバータ起動信号３０１はオン、ロードＳＷ制御信号６０１はオンとなっている。出力電圧２１８はＶ２４Ｖ＝２４．０Ｖ（Ｄ２４Ｖ＝３５．０％）、出力電圧３１８はＶ５Ｖ＿ＤＣＤＣ＝５．２４Ｖとなっている。レギュレータ４００はオフ状態である。タイミングチャートとしては実施例１と同じであるため、説明を省略する。 [Explanation of control operation]
Embodiment 2 will also be described with reference to FIG. 5 of Embodiment 1. FIG. FIG. 5 is a timing chart of the operation of the power supply device 108 when the printer 100 transitions from the standby state to the sleep state. In the standby state (or print state), the ACDC converter output voltage switching signal 201 is high level and the output voltage 218 is 24.0V. In the standby state (or print state), the regulator activation signal 401 is off, the DCDC converter activation signal 301 is on, and the load SW control signal 601 is on. The output voltage 218 is V 24V =24.0V (D 24V =35.0%), and the output voltage 318 is V 5V_DCDC =5.24V. Regulator 400 is off. Since the timing chart is the same as that of the first embodiment, the description is omitted.

図５のタイミングチャートに表れない実施例１との違いは、次のようになる。ＤＣＤＣコンバータ３００の最大デューティは８０％であるため、出力電圧３１８を目標電圧５．２４Ｖに制御する場合、出力電圧２１８が５．２４Ｖ／８０％＝６．５５ＶまでＤＣＤＣコンバータ３００は動作可能である。実施例２では出力電圧３１８が５．２４Ｖであるため、ＤＣＤＣコンバータ３００の動作可能である電圧範囲が実施例１とは異なっている。また、実施例２では、ＤＣＤＣコンバータ３００の最大デューティを８０％としている。しかし、最大デューティ１００％が可能なＤＣＤＣコンバータ３００であれば、ＤＣＤＣコンバータ起動信号３０１をオフしなくともＤＣＤＣコンバータ３００の損失を削減することが可能となる。この場合、図５のタイミングＴｂにおいて目標出力電圧値をスリープ状態における出力電圧２１８の調整範囲の最大値（７．１Ｖ）に近い７．０Ｖとし、最大デューティ８０％のときの出力電圧２１８（６．７Ｖ）よりも大きくする。これにより、ＤＣＤＣコンバータ３００が１００％オンするので、ＤＣＤＣコンバータ３００のスイッチング動作による損失を削減することができる。 Differences from the first embodiment that do not appear in the timing chart of FIG. 5 are as follows. Since the maximum duty of the DCDC converter 300 is 80%, when controlling the output voltage 318 to the target voltage of 5.24V, the DCDC converter 300 can operate until the output voltage 218 is 5.24V/80% = 6.55V. . Since the output voltage 318 is 5.24 V in the second embodiment, the voltage range in which the DCDC converter 300 can operate is different from that in the first embodiment. Moreover, in Example 2, the maximum duty of the DCDC converter 300 is set to 80%. However, if the DCDC converter 300 is capable of a maximum duty of 100%, it is possible to reduce the loss of the DCDC converter 300 without turning off the DCDC converter start signal 301 . In this case, the target output voltage value at timing Tb in FIG. .7V). As a result, the DCDC converter 300 is turned on 100%, so the loss due to the switching operation of the DCDC converter 300 can be reduced.

また実施例２では、ＡＣＤＣコンバータ２００の目標出力電圧及びＤＣＤＣコンバータ３００の目標出力電圧を調整するためにＰＷＭ信号を出力したが、ＤＣＤＣコンバータ３００のみにＰＷＭ信号３３５を出力してもよい。このとき、ＡＣＤＣコンバータ２００が２４Ｖを出力しているモード（スタンバイ状態又はプリント状態）において、出力電圧３１８の電圧精度の向上が可能となる。以上説明したように、実施例２によれば、実施例１に加えて、スタンバイ状態及びプリント状態における出力電圧３１８を調整することにより、出力電圧の精度を向上させることが可能となる。 Further, in the second embodiment, the PWM signal is output to adjust the target output voltage of the ACDC converter 200 and the target output voltage of the DCDC converter 300, but the PWM signal 335 may be output only to the DCDC converter 300. At this time, in the mode (standby state or print state) in which the ACDC converter 200 outputs 24V, it is possible to improve the voltage accuracy of the output voltage 318 . As described above, according to the second embodiment, in addition to the first embodiment, it is possible to improve the accuracy of the output voltage by adjusting the output voltage 318 in the standby state and the print state.

以上、実施例２によれば、低消費電力モードにおいて、電源装置における出力電圧の電圧精度を向上させることができる。 As described above, according to the second embodiment, it is possible to improve the voltage accuracy of the output voltage in the power supply device in the low power consumption mode.

実施例１では、ＡＣＤＣコンバータ２００の出力電圧２１８をＰＷＭ信号１３５で調整する構成について説明した。実施例３では出力電圧２１８に加えて、出力電圧３１８のレギュレータ４００による目標電圧を第３のＰＷＭ信号であるＰＷＭ信号４３５で調整する構成について説明する。以下では、実施例１の電源装置１０８と同じ構成については、同じ符号を付し、説明を省略する。図２及び図３は実施例３においても同じ回路構成である。図７に実施例３における第２の電源３００及びレギュレータ４００の回路図を示す。実施例１に比べて、レギュレータ４００のフィードバック部を調整するＰＷＭ信号４３５を追加し、レギュレータ起動信号４０１を削除している。 In the first embodiment, the configuration for adjusting the output voltage 218 of the ACDC converter 200 with the PWM signal 135 has been described. In the third embodiment, in addition to the output voltage 218, a configuration will be described in which the target voltage of the output voltage 318 by the regulator 400 is adjusted by the PWM signal 435, which is the third PWM signal. Below, the same components as those of the power supply device 108 of the first embodiment are denoted by the same reference numerals, and descriptions thereof are omitted. 2 and 3 also have the same circuit configuration in the third embodiment. FIG. 7 shows a circuit diagram of the second power supply 300 and the regulator 400 according to the third embodiment. Compared to the first embodiment, a PWM signal 435 for adjusting the feedback section of the regulator 400 is added and the regulator activation signal 401 is deleted.

制御部５００は、抵抗４２７を介して、レギュレータ４００のトランジスタ４２６のベース端子にＰＷＭ信号４３５を出力する。抵抗４２５とコンデンサ４２４は、図３の抵抗１２５とコンデンサ１２４からなる回路と同様に所定の時定数で動作する回路である。図７のレギュレータ４００において、追加された抵抗４２３、抵抗４２５、抵抗４２８、抵抗４２９、コンデンサ４２４、トランジスタ４２６、抵抗４２７は、シャントレギュレータ３８７のＲＥＦ端子に入力される電圧値を変更するための回路である。 Control unit 500 outputs PWM signal 435 to the base terminal of transistor 426 of regulator 400 via resistor 427 . A resistor 425 and a capacitor 424 are circuits that operate with a predetermined time constant, like the circuit composed of the resistor 125 and the capacitor 124 in FIG. In regulator 400 of FIG. 7, added resistors 423, 425, 428, 429, capacitor 424, transistor 426, and resistor 427 are circuits for changing the voltage value input to the REF terminal of shunt regulator 387. is.

また、レギュレータ４００は、実施例２のレギュレータ４００と同様に、実施例１のツェナーダイオード３９４及び抵抗３９３が省略され、トランジスタ３８２はＦＥＴ４８２に変更されている。更に、実施例１では、レギュレータ４００のトランジスタ３８２のベース端子には抵抗３８３及びツェナーダイオード３９４、抵抗３８０を介して出力電圧２１８が接続されていた。実施例３でも、ＦＥＴ４８２のゲート端子には抵抗３８３及び抵抗３８０を介して出力電圧３１８が接続されている。 Further, the regulator 400 is similar to the regulator 400 of the second embodiment in that the Zener diode 394 and the resistor 393 of the first embodiment are omitted, and the transistor 382 is replaced with an FET482. Furthermore, in Example 1, the output voltage 218 was connected to the base terminal of the transistor 382 of the regulator 400 via the resistor 383 , the Zener diode 394 and the resistor 380 . Also in Example 3, the output voltage 318 is connected to the gate terminal of the FET 482 via the resistors 383 and 380 .

［ＰＷＭ信号４３５による出力電圧３１８の調整範囲］
（ＰＷＭ信号４３５のデューティが０％のとき）
ＰＷＭ信号４３５のデューティが０％のとき、抵抗４２３、抵抗４２５、抵抗４２８、抵抗４２９の抵抗値を、それぞれＲ４２３、Ｒ４２５、Ｒ４２８、Ｒ４２９、抵抗４５４、抵抗４２３、抵抗４２５、抵抗４２８の合成抵抗値をＲ４５４ＯＦＦ、とする。そうすると、合成抵抗Ｒ４５４ＯＦＦは、次の式（２０）で表すことができる。

Figure 0007277154000020
このときの出力電圧３１８（Ｖ５Ｖ＿ＲＥＧ＿ＯＦＦ）は、シャントレギュレータ３８７内部の基準電圧をＶＲＥＦ（ＲＥＧ）とすると、次の式（２１）で求められる値となるように制御される。
Figure 0007277154000021
 [Adjustment range of output voltage 318 by PWM signal 435]
(When duty of PWM signal 435 is 0%)
When the duty of the PWM signal 435 is 0%, the resistance values of the resistors 423 , 425 , 428 and 429 are respectively changed to R423, R425, R428 , R429, resistor 454, resistor 423, resistor 425 and resistor The combined resistance value of 428 is R 454OFF . Then, the combined resistance R454OFF can be expressed by the following equation (20).
Figure 0007277154000020
 The output voltage 318 (V 5V_REG_OFF ) at this time is controlled to a value obtained by the following equation (21), where V REF (REG) is the reference voltage inside the shunt regulator 387 .
Figure 0007277154000021

（ＰＷＭ信号４３５のデューティが１００％のとき）
ＰＷＭ信号４３５のデューティが１００％のとき、抵抗４５５の抵抗値をＲ４５５、抵抗４５５、抵抗４２３、抵抗４２５、抵抗４２９の合成抵抗値Ｒ４５５ＯＮ、とする。計算の簡略化のためにトランジスタ４２６のコレクタ－エミッタ間の飽和電圧ＶＣＥ（ｓａｔ）を無視できる程小さいとすると、次の式（２２）で表すことができる。

Figure 0007277154000022
このときの出力電圧３１８（Ｖ５Ｖ＿ＲＥＧ＿ＯＮ）は、次の式（２３）で表されるように制御される。
Figure 0007277154000023
 (When duty of PWM signal 435 is 100%)
When the duty of the PWM signal 435 is 100%, the resistance value of the resistor 455 is R 455 , and the combined resistance value R 455ON of the resistors 455, 423, 425, and 429 is set. Assuming that the collector-emitter saturation voltage V CE(sat) of the transistor 426 is negligibly small for simplification of calculation, it can be expressed by the following equation (22).
Figure 0007277154000022
 The output voltage 318 ( V5V_REG_ON ) at this time is controlled as represented by the following equation (23).
Figure 0007277154000023

（出力電圧３１８の取り得る範囲）
よってＰＷＭ信号４３５を０％から１００％に変化させたとき、出力電圧３１８（Ｖ５Ｖ＿ＲＥＧ）の取りうる範囲は、式（２１）及び式（２３）から次の式（２４）で表される。

Figure 0007277154000024
(Possible range of output voltage 318)
Therefore, when the PWM signal 435 is changed from 0% to 100%, the possible range of the output voltage 318 ( V5V_REG ) is represented by the following formula (24) from formulas (21) and (23).
Figure 0007277154000024

ここで、ＶＲＥＦ（ＲＥＧ）＝１．２４Ｖ、Ｒ４５４＝３９ｋΩ、Ｒ４５５＝１２ｋΩ、Ｒ４２３＝１０ｋΩ、Ｒ４２５＝１０ｋΩ、Ｒ４２８＝４７０ｋΩ、Ｒ４２９＝１ｋΩ、とする。式（２４）から出力電圧３１８（Ｖ５Ｖ＿ＲＥＧ）は、第４の範囲内である４．９７Ｖ＜Ｖ５Ｖ＿ＲＥＧ＜７．５７Ｖとなるように制御される。また、ＰＷＭ信号４３５のデューティＤ５Ｖ＿ＲＥＧと出力電圧３１８（Ｖ５Ｖ＿ＲＥＧ）とは比例関係にあり、Ｄ５Ｖ＿ＲＥＧは目標となる出力電圧３１８の電圧値Ｖ５Ｖ＿ＲＥＧ＿Ｔを用いて、次の式（２５）で表すことができる。

Figure 0007277154000025
Here, VREF (REG) = 1.24V, R454 = 39kΩ, R455 = 12kΩ, R423 = 10kΩ, R425 = 10kΩ, R428 = 470kΩ, and R429 = 1kΩ. From equation (24), the output voltage 318 ( V5V_REG ) is controlled such that 4.97V< V5V_REG <7.57V, which is within the fourth range. Further, the duty D5V_REG of the PWM signal 435 and the output voltage 318 ( V5V_REG ) are in a proportional relationship, and D5V_REG is expressed by the following equation (25) using the voltage value V5V_REG_T of the target output voltage 318. be able to.
Figure 0007277154000025

［制御動作の説明］
図８にプリンタ１００がスタンバイ状態からスリープ状態へ遷移する場合の電源装置１０８の動作のタイミングチャートを示す。図５のタイミングチャートに比べて、（ｉｉｉ）レギュレータ起動信号４０１を削除し、スリープ状態における出力電圧３１８を５．２０Ｖとしている。 [Explanation of control operation]
FIG. 8 shows a timing chart of the operation of the power supply device 108 when the printer 100 transitions from the standby state to the sleep state. Compared to the timing chart of FIG. 5, (iii) the regulator activation signal 401 is eliminated and the output voltage 318 in the sleep state is set to 5.20V.

（スタンバイ状態からスリープ状態への遷移）
スタンバイ状態（及びプリント状態）において、ＡＣＤＣコンバータ出力電圧切り替え信号２０１はハイレベル、出力電圧２１８は２４．０Ｖ、ＤＣＤＣコンバータ起動信号３０１はオン、ロードＳＷ制御信号６０１はオンとなっている。出力電圧２１８はＶ２４Ｖ＝２４．０Ｖ（Ｄ２４Ｖ＝３５．０％）、出力電圧３１８はＶ５Ｖ＿ＤＣＤＣ＝５．２０Ｖとなっている。レギュレータ４００の目標電圧値Ｖ５Ｖ＿ＲＥＧ＿Ｔは５．１５Ｖ（Ｄ５Ｖ＿ＲＥＧ＝６．８％）である。Ｖ５Ｖ＿ＲＥＧ＿Ｔよりも出力電圧３１８の方が高いため、レギュレータ４００のＦＥＴ３８５は１００％オフ状態となる。このように、実施例３では、レギュレータ４００にレギュレータ起動信号４０１を入力しなくてもよい。 (transition from standby state to sleep state)
In the standby state (and print state), the ACDC converter output voltage switching signal 201 is high level, the output voltage 218 is 24.0 V, the DCDC converter start signal 301 is on, and the load SW control signal 601 is on. The output voltage 218 is V 24V =24.0V (D 24V =35.0%), and the output voltage 318 is V 5V_DCDC =5.20V. The target voltage value V 5V_REG_T of the regulator 400 is 5.15V (D 5V_REG =6.8%). Since output voltage 318 is higher than V 5V_REG_T , FET 385 of regulator 400 is 100% off. Thus, in the third embodiment, it is not necessary to input the regulator activation signal 401 to the regulator 400 .

タイミングＴａで、制御部５００はプリンタ１００をスリープ状態に遷移させるため、ＡＣＤＣコンバータ出力電圧切り替え信号２０１をハイレベルからローレベルに切り替える。出力電圧２１８は、約５Ｖとなるように制御される。また、制御部５００は、ＰＷＭ信号１３５のデューティを変更する。その理由は、ＤＣＤＣコンバータ３００が動作可能な入力電圧（＝出力電圧２１８）かつ、極力低い入力電圧に出力電圧２１８を調整するためである。前述の通り、ＤＣＤＣコンバータ３００の最大デューティは８０％であるため、出力電圧３１８を目標電圧５．２０Ｖに制御する場合、出力電圧２１８が５．２０Ｖ／８０％＝６．５ＶまでＤＣＤＣコンバータ３００は動作可能である。例えば、ＰＷＭ信号１３５のデューティは式（１３）からＤ５Ｖ＝８２．６％とすれば出力電圧２１８は６．７０Ｖとなる。これにより出力電圧２１８が低下した際も、ＤＣＤＣコンバータ３００が目標電圧である５．２０Ｖを出力することが可能となる。 At timing Ta, the control unit 500 switches the ACDC converter output voltage switching signal 201 from high level to low level in order to transition the printer 100 to the sleep state. The output voltage 218 is controlled to be approximately 5V. Also, the control unit 500 changes the duty of the PWM signal 135 . The reason for this is to adjust the output voltage 218 to an input voltage (=output voltage 218) at which the DCDC converter 300 can operate and an input voltage as low as possible. As described above, the maximum duty of the DCDC converter 300 is 80%. Therefore, when controlling the output voltage 318 to the target voltage of 5.20V, the DCDC converter 300 operates until the output voltage 218 is 5.20V/80%=6.5V. It is operable. For example, if the duty of the PWM signal 135 is D 5V =82.6% from equation (13), the output voltage 218 will be 6.70V. As a result, even when the output voltage 218 drops, the DCDC converter 300 can output the target voltage of 5.20V.

タイミングＴｂは、出力電圧２１８が６．７０Ｖとなったタイミングである。出力電圧２１８が２４．０Ｖから６．７Ｖになるまでの時間がＴ１である。タイミングＴｂにおいて、ＰＷＭ信号４３５のデューティを変更した後、ＤＣＤＣコンバータ起動信号３０１をオフにする。すると出力電圧３１８の制御がＤＣＤＣコンバータ３００からレギュレータ４００へと切り替わる。このときのＰＷＭ信号４３５のデューティは、式（２５）からＤ５Ｖ＿ＲＥＧ＝８．７％とすれば、出力電圧３１８は５．２０Ｖとなるように制御される。このように、制御部５００は、タイミングＴｂにおいて、ＰＷＭ信号４３５のデューティを８．７％に変更する。更に、制御部５００は、出力電圧２１８を目標電圧の５．２０Ｖにするため、ＰＷＭ信号１３５のデューティを変更する。出力電圧２１８を５．２０Ｖとする場合、ＰＷＭ信号１３５のデューティは式（１３）からＤ５Ｖ＝１８．０％となる。 Timing Tb is the timing when the output voltage 218 becomes 6.70V. The time it takes for the output voltage 218 to change from 24.0V to 6.7V is T1. At timing Tb, after changing the duty of the PWM signal 435, the DCDC converter start signal 301 is turned off. Control of the output voltage 318 then switches from the DCDC converter 300 to the regulator 400 . If the duty of the PWM signal 435 at this time is D 5V_REG =8.7% from equation (25), the output voltage 318 is controlled to 5.20V. In this way, control section 500 changes the duty of PWM signal 435 to 8.7% at timing Tb. Furthermore, the control unit 500 changes the duty of the PWM signal 135 in order to set the output voltage 218 to the target voltage of 5.20V. When the output voltage 218 is 5.20 V, the duty of the PWM signal 135 is D 5V =18.0% from equation (13).

タイミングＴｃは、出力電圧２１８が５．２０Ｖとなったタイミングである。出力電圧２１８が６．７Ｖから５．２０Ｖになるまでの時間がＴ２である。タイミングＴｃにおいて、制御部５００は、Ｖ５Ｖ＿ＲＥＧ＝５．２４Ｖとするため、ＰＷＭ信号４３５のデューティをＤ５Ｖ＿ＲＥＧ＝１０．３％に変更する（式（２５）より）。上述したように、出力電圧２１８がレギュレータ４００の目標電圧値よりも低いため（５．２０Ｖ＜５．２４Ｖ）、レギュレータ４００のＦＥＴ３８５は１００％オン状態となる。ＰＷＭ信号４３５によってレギュレータ４００の出力電圧３１８の目標値を調整することで確実にＦＥＴ３８５を１００％オン状態とすることが可能となる。 Timing Tc is the timing when the output voltage 218 becomes 5.20V. The time it takes for the output voltage 218 to change from 6.7V to 5.20V is T2. At the timing Tc, the control unit 500 changes the duty of the PWM signal 435 to D5V_REG =10.3% in order to set V5V_REG = 5.24V (from equation (25)). As mentioned above, since output voltage 218 is lower than the target voltage value of regulator 400 (5.20V<5.24V), FET 385 of regulator 400 is 100% on. By adjusting the target value of the output voltage 318 of the regulator 400 with the PWM signal 435, the FET 385 can be reliably turned on 100%.

更に制御部５００は、ロードＳＷ制御信号６０１をオフし、ＦＥＴ６００をオフすることで、スリープ状態において必要のないＦＥＴ６００後段の負荷への電圧供給を停止する。例えば、プリント中の記録材の位置を検知する紙搬送センサ（不図示）等がある。これによりスリープ状態の消費電力をさらに低減する。以上によりプリンタ１００はスタンバイ状態からスリープ状態への遷移が完了する。 Furthermore, the control unit 500 turns off the load SW control signal 601 to turn off the FET 600, thereby stopping the voltage supply to the load after the FET 600, which is not necessary in the sleep state. For example, there is a paper transport sensor (not shown) that detects the position of the recording material during printing. This further reduces power consumption in the sleep state. As described above, the printer 100 completes the transition from the standby state to the sleep state.

なおスリープ状態において出力電圧２１８はＶ５Ｖ＝５．２０Ｖ（Ｄ５Ｖ＝１８．０％）であり、ＤＣＤＣコンバータ３００がオフ、レギュレータ４００のＦＥＴ３８５が１００％オン状態となり、出力電圧３１８は５．２０Ｖが出力される。 In the sleep state, the output voltage 218 is V 5V =5.20V (D 5V =18.0%), the DCDC converter 300 is off, the FET 385 of the regulator 400 is 100% on, and the output voltage 318 is 5.20V. is output.

（スリープ状態からスタンバイ状態への遷移）
次に、プリンタ１００がスリープ状態からスタンバイ状態へ遷移する場合の電源装置１０８の動作について説明する。タイミングＴｄにおいて、制御部５００は、ロードＳＷ制御信号６０１をオフからオンに切り替え、ロードＳＷ６００をオン状態にさせることで、出力電圧５１８へ電力を供給する。時間Ｔ３はロードＳＷ６００のオン待ち時間である。 (Transition from sleep state to standby state)
Next, the operation of the power supply device 108 when the printer 100 transitions from the sleep state to the standby state will be described. At timing Td, the control unit 500 switches the load SW control signal 601 from off to on to turn on the load SW 600 , thereby supplying power to the output voltage 518 . Time T3 is the turn-on waiting time of load switch 600 .

次に、タイミングＴｅにおいて、制御部５００は、ＡＣＤＣコンバータ出力電圧切り替え信号２０１をローレベルからハイレベルにするとともに、ＰＷＭ信号１３５のデューティを変更する。目標電圧を２４．０Ｖにするため、ＰＷＭ信号１３５のデューティは式（１２）からＤ２４Ｖ＝３５．０％とする。更に、制御部５００は、Ｖ５Ｖ＿ＲＥＧ＝５．２０Ｖとするため、ＰＷＭ信号４３５のデューティをＤ５Ｖ＿ＲＥＧ＝８．７％に変更する（式（２５）より）。 Next, at timing Te, the control unit 500 changes the ACDC converter output voltage switching signal 201 from low level to high level and changes the duty of the PWM signal 135 . In order to set the target voltage to 24.0 V, the duty of the PWM signal 135 is set to D 24V =35.0% from equation (12). Further, the control unit 500 changes the duty of the PWM signal 435 to D 5V_REG =8.7% in order to set V 5V_REG =5.20 V (from equation (25)).

次にタイミングＴｆは、出力電圧２１８が６．７Ｖになるタイミングである。出力電圧２１８が５．２０Ｖから６．７Ｖになるまでの時間がＴ４である。このとき、制御部５００は、ＤＣＤＣコンバータ起動信号３０１をオンする。タイミングＴｆを決める方法としては、出力電圧２１８をＡＤ変換して制御部５００でモニタしてもよいし、出力電圧２１８の立ち上がり時間から予測してもよい。 Timing Tf is the timing at which the output voltage 218 becomes 6.7V. The time it takes for the output voltage 218 to change from 5.20V to 6.7V is T4. At this time, the control unit 500 turns on the DCDC converter start signal 301 . As a method of determining the timing Tf, the output voltage 218 may be AD-converted and monitored by the control unit 500, or it may be predicted from the rising time of the output voltage 218. FIG.

タイミングＴｇは出力電圧２１８が２４．０Ｖになるタイミングである。出力電圧２１８が６．７Ｖから２４．０Ｖになるまでの時間がＴ５である。このとき、Ｖ５Ｖ＿ＲＥＧ＝５．１５Ｖとするため、ＰＷＭ信号４３５のデューティをＤ５Ｖ＿ＲＥＧ＝６．８％に変更する（式（２５）より）。上述したように、Ｖ５Ｖ＿ＲＥＧ＿Ｔよりも出力電圧３１８の方が高いため（＞５．１５Ｖ）、レギュレータ４００のＦＥＴ３８５は１００％オフ状態となる。タイミングＴｇにてスタンバイ状態への遷移が完了する。 Timing Tg is the timing at which the output voltage 218 becomes 24.0V. The time it takes for the output voltage 218 to change from 6.7V to 24.0V is T5. At this time, in order to set V 5V_REG =5.15 V, the duty of the PWM signal 435 is changed to D 5V_REG =6.8% (from equation (25)). As mentioned above, since the output voltage 318 is higher than V 5V_REG_T (>5.15V), FET 385 of regulator 400 is 100% off. The transition to the standby state is completed at timing Tg.

また実施例３では、ＡＣＤＣコンバータ２００の目標出力電圧及びレギュレータ４００の目標出力電圧へＰＷＭ信号を出力したが、レギュレータ４００のみにＰＷＭ信号４３５を出力してもよい。このとき、ＡＣＤＣコンバータ２００が約５Ｖを出力している低消費電力モードにおいて、出力電圧３１８の電圧精度の向上が可能となる。 Further, in the third embodiment, the PWM signal is output to the target output voltage of the ACDC converter 200 and the target output voltage of the regulator 400, but the PWM signal 435 may be output to the regulator 400 only. At this time, it is possible to improve the voltage accuracy of the output voltage 318 in the low power consumption mode in which the ACDC converter 200 outputs about 5V.

以上説明したように、実施例３によれば、実施例１に加えて、スリープ状態における出力電圧３１８を調整することにより電圧精度を向上させることが可能となる。また、レギュレータ起動信号４０１を削除することができるため、実施例１よりも安価に出力電圧精度の向上が可能となる。 As described above, according to the third embodiment, in addition to the first embodiment, it is possible to improve the voltage accuracy by adjusting the output voltage 318 in the sleep state. Further, since the regulator activation signal 401 can be eliminated, it is possible to improve the accuracy of the output voltage at a lower cost than in the first embodiment.

以上、実施例３によれば、低消費電力モードにおいて、電源装置における出力電圧の電圧精度を向上させることができる。 As described above, according to the third embodiment, it is possible to improve the voltage accuracy of the output voltage in the power supply device in the low power consumption mode.

２００ ＡＣＤＣコンバータ
３００ ＤＣＤＣコンバータ
４００ レギュレータ
５００ 制御部 200 ACDC converter 300 DCDC converter 400 regulator 500 control unit

Claims (9)

第１の状態と前記第１の状態よりも消費電力が低い第２の状態とで動作することが可能な電源装置であって、
交流電圧を第１の直流電圧に変換して前記第１の直流電圧を出力する第１の電源と、
前記第１の状態において前記第１の電源から出力された前記第１の直流電圧を前記第１の直流電圧よりも低い第２の直流電圧に変換して前記第２の直流電圧を出力し、前記第２の状態において動作を停止する第２の電源と、
前記第２の電源の入出力間に接続されており、前記第１の状態において動作を停止しており、前記第１の状態から前記第２の状態に遷移すると出力電圧が前記第２の直流電圧に維持されるように定電圧制御で動作する第３の電源と、
前記第１の状態のときに前記第１の直流電圧が第１の電圧値となるように前記第１の電源を制御し、前記第２の状態のときに前記第１の直流電圧が前記第１の電圧値よりも低い第２の電圧値となるように前記第１の電源を制御する第１の制御手段と、
を備え、
前記第１の制御手段は、前記第１の直流電圧を、前記第１の状態においては前記第１の電圧値を含む第１の範囲内で調整し、前記第２の状態においては前記第２の電圧値を含む第２の範囲内で調整し、前記第１の電源に第１のＰＷＭ信号を出力し、前記第１のＰＷＭ信号のオンデューティを０％から１００％の間で制御することにより、前記第１の直流電圧を前記第１の範囲内又は前記第２の範囲内で調整し、
前記第２の電源は、少なくとも１つのスイッチング素子と、前記スイッチング素子のオン又はオフを制御する第２の制御手段と、を有し、
前記第２の制御手段が前記スイッチング素子のオンデューティを制御するとき、前記オンデューティは１００％より低い所定のオンデューティに制限されており、
前記第１の制御手段は、前記第１の状態から前記第２の状態に遷移するときに、前記第１の直流電圧が前記第２の電圧値となるように前記第１の電源を制御するとともに、前記スイッチング素子を前記所定のオンデューティよりも高いオンデューティで駆動するための前記第１の直流電圧となるように前記第１のＰＷＭ信号のオンデューティを調整することを特徴とする電源装置。 A power supply device capable of operating in a first state and a second state with lower power consumption than the first state,
a first power supply that converts an AC voltage into a first DC voltage and outputs the first DC voltage;
converting the first DC voltage output from the first power supply in the first state into a second DC voltage lower than the first DC voltage and outputting the second DC voltage; a second power supply that stops operating in the second state;
It is connected between the input and output of the second power supply, stops operating in the first state, and changes the output voltage to the second DC when transitioning from the first state to the second state. a third power supply operating under constant voltage control to maintain the voltage;
The first power supply is controlled so that the first DC voltage has a first voltage value in the first state, and the first DC voltage is controlled to the first voltage value in the second state. a first control means for controlling the first power supply to have a second voltage value lower than the first voltage value;
with
The first control means adjusts the first DC voltage within a first range including the first voltage value in the first state, and adjusts the second DC voltage in the second state. adjusting within a second range including the voltage value of, outputting a first PWM signal to the first power supply, and controlling the on-duty of the first PWM signal between 0% and 100% By adjusting the first DC voltage within the first range or within the second range,
The second power supply has at least one switching element and second control means for controlling on or off of the switching element,
When the second control means controls the on-duty of the switching element, the on-duty is limited to a predetermined on-duty lower than 100%,
The first control means controls the first power supply so that the first DC voltage becomes the second voltage value when the first state transitions to the second state. and adjusting the on-duty of the first PWM signal so as to achieve the first DC voltage for driving the switching element with an on-duty higher than the predetermined on-duty. . 前記第１の制御手段は、前記第２の状態から前記第１の状態に遷移するときに、前記第１の直流電圧が前記第２の電圧値から前記第１の電圧値に上昇する前に前記第２の電源の動作を開始させるように制御することを特徴とする請求項１に記載の電源装置。 The first control means, when transitioning from the second state to the first state, before the first DC voltage rises from the second voltage value to the first voltage value 2. The power supply device according to claim 1, wherein said second power supply is controlled to start operating. 前記第１の制御手段は、前記第２の電源に第２のＰＷＭ信号を出力し、前記第１の状態における前記第２のＰＷＭ信号のオンデューティを０％から１００％の間で制御することにより、前記第２の直流電圧を第３の範囲内で調整することを特徴とする請求項１又は請求項２に記載の電源装置。 The first control means outputs a second PWM signal to the second power supply and controls the on-duty of the second PWM signal in the first state between 0% and 100%. 3. The power supply device according to claim 1 , wherein the second DC voltage is adjusted within a third range by: 前記第１の制御手段は、前記第３の電源に第３のＰＷＭ信号を出力し、前記第２の状態における前記第３のＰＷＭ信号のオンデューティを０％から１００％の間で制御することにより、前記第２の直流電圧を第４の範囲内で調整することを特徴とする請求項１から請求項３のいずれか１項に記載の電源装置。 The first control means outputs a third PWM signal to the third power supply, and controls the on-duty of the third PWM signal in the second state between 0% and 100%. The power supply device according to any one of claims 1 to 3 , wherein the second DC voltage is adjusted within a fourth range by: 前記第２の直流電圧を負荷に供給する接続状態と、前記負荷への前記第２の直流電圧の供給を遮断する非接続状態とのいずれかの状態となるロードスイッチを備え、
前記第１の制御手段は、前記第２の電源の動作を停止させた後に前記ロードスイッチを前記非接続状態とするように制御することを特徴とする請求項１から請求項４のいずれか１項に記載の電源装置。 a load switch that is in either a connected state that supplies the second DC voltage to the load or a non-connected state that cuts off the supply of the second DC voltage to the load;
5. The load switch according to any one of claims 1 to 4 , wherein the first control means controls the load switch to be in the disconnected state after stopping the operation of the second power supply. A power supply as described above. 前記第２の直流電圧を負荷に供給する接続状態と、前記負荷への前記第２の直流電圧の供給を遮断する非接続状態とのいずれかの状態となるロードスイッチを備え、
前記第１の制御手段は、前記第２の電源の動作を開始させる前に前記ロードスイッチを前記接続状態とするように制御することを特徴とする請求項１から請求項４のいずれか１項に記載の電源装置。 a load switch that is in either a connected state that supplies the second DC voltage to the load or a non-connected state that cuts off the supply of the second DC voltage to the load;
5. The first control means controls the load switch to be in the connected state before starting the operation of the second power supply . A power supply as described in . 前記第２の状態において、前記第３の電源が前記第２の直流電圧を制御するための目標電圧値は、前記第２の電源が前記第２の直流電圧を制御するための目標電圧値よりも低い値に設定されていることを特徴とする請求項１から請求項６のいずれか１項に記載の電源装置。 In the second state, the target voltage value for the third power supply to control the second DC voltage is higher than the target voltage value for the second power supply to control the second DC voltage. 7. The power supply device according to any one of claims 1 to 6 , characterized in that , is also set to a low value. 前記第３の電源は、シリーズレギュレータであることを特徴とする請求項１から請求項７のいずれか１項に記載の電源装置。 8. The power supply device according to claim 1 , wherein said third power supply is a series regulator. 記録材に画像を形成する画像形成部と、
請求項１から請求項８のいずれか１項に記載の電源装置と、
を備えることを特徴とする画像形成装置。 an image forming unit that forms an image on a recording material;
A power supply device according to any one of claims 1 to 8 ;
An image forming apparatus comprising:
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