JP7251671B2 - ネットワークシステムの制御方法および制御装置 - Google Patents
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Description
本発明によるネットワーク制御方法は、記憶手段が、複数のサーバがそれぞれプログラム可能論理回路に対応しているかどうかの情報と、前記複数のサーバそれぞれで起動する仮想マシンと、前記プログラム可能論理回路にインストールされているプログラムと、の対応関係を保持し、制御手段が、前記対応関係に基づいて、前記複数のサーバのうち更新するプログラムをインストールしているプログラム可能論理回路に対応するサーバを特定し、前記更新するプログラムをインストールしているプログラム可能論理回路で動作している仮想マシンのデータ処理を前記特定したサーバのCPU(Central Processing Unit)に代行させる、ことを特徴とする。
本発明の実施形態によれば、サーバ上で仮想化ネットワーク機能(VNF)が動作しうるネットワークシステムにおいて、サーバに含まれるプログラム可能論理回路と、サーバで起動する仮想マシン(VM)と、サーバのVMで実現するVNFと、の対応関係を用いてネットワークを制御する。たとえば、どのサーバがプログラム可能論理回路に対応しているか、プログラム可能論理回路にどのプログラムがインストールされているか、どのサーバにどのVM、どのVNFが動作しているか、を示す情報を参照することで、更新すべきVMおよび/またはプログラム可能論理回路を特定することができる。このように、プログラム可能論理回路に関する情報とそれに対応付けられたVM/VNF情報とを用いることで、プログラム可能論理回路の回路構成プログラムの更新、VMの追加/更新に伴ったプログラム可能論理回路の追加/更新等の制御を実行することができ、プログラム可能論理回路を含むネットワークの効率的な制御が可能となる。
図2に例示するように、コントローラ10は、管理装置11からの指示に従って、複数のサーバからなる下位レイヤネットワーク20と複数のVNFからなる上位レイヤネットワーク30とを制御する。ここでは、図の簡略化のために、下位レイヤネットワーク20がサーバA、B、CおよびDからなり、上位レイヤネットワーク30が仮想ネットワーク機能VNF-1~VNF-5からなるものとする。
1.1)制御装置
本発明の一実施形態によるコントローラ10は、ネットワークシステムにおけるサーバおよびスイッチを制御し、管理装置11からの指示に従ってFPGA、VMあるいはVNFの制御および経路制御を実行する。
以下、説明の複雑化を回避するために、図5に示すシステムを参照しながら本実施形態による制御方法について説明する。すなわち、サーバX、YがFPGA対応、サーバZがFPGA非対応とし、コントローラ10が管理装置11の指示に従って各サーバのVM/FPGAと各スイッチとを制御するものとする。制御の具体例を説明するための構成を図6に示す。
<VNF更新>
図8に示すように、管理装置11からVM更新およびFPGAプログラムF-A1.1のバージョンアップを含むVNF-Bの更新が指示されると(動作S201)、コントローラ10の制御部106は、機能管理部102の管理テーブルを参照して、VNF-Bに対応づけられたサーバXのFPGAおよびVM2と、サーバYのFPGAおよびVM4とを特定し、さらにFPGA管理部103の管理テーブルを参照して、サーバXのFPGAプログラムF-A1.1を特定する。そして、制御部106は、ネットワークインタフェース104を通して、対象となるサーバXのVM2をVM2’へ更新し、FPGAプログラムをF-A1.1からF-A1.2へバージョンアップし、また、サーバYのVM4をVM4’へ更新する(動作S202)。以上の更新が完了すると、制御部106は機能管理部102およびFPGA管理部103の管理テーブルを図9Aおよび図9Bに示すように更新する。
図10に示すように、管理装置11からFPGAプログラムF-A1.1のバージョンアップが指示されると(動作S301)、コントローラ10の制御部106は、FPGA管理部103の管理テーブルを参照して、サーバXのFPGAプログラムF-A1.1を特定する。そして、制御部106は、ネットワークインタフェース104を通して、対象となるサーバXのFPGAプログラムをF-A1.1からF-A1.2へバージョンアップする(動作S302)。以上の更新が完了すると、制御部106はFPGA管理部103の管理テーブルを図11に示すように更新する。
図12はFGPAプログラム更新制御の他の例を示す。図12において、管理装置11からFPGAプログラムF-A1.1のバージョンアップが指示されると(動作S401)、コントローラ10は、対象となるサーバXのFPGAプログラムをF-A1.1からF-A1.2へバージョンアップする(動作S402)。その際、FPGAが行っていたVM2のデータ処理はCPU側で代理処理される(動作S403)。これにより、一時的なマイグレーション等を実行することなく、FPGA更新中のデータ処理を続行することができる。
上述したように、本実施形態によるネットワーク制御によれば、サーバに含まれるFPGAと、サーバで起動する仮想マシン(VM)と、サーバのVMで実現するVNFと、の対応関係を用いることで、更新すべきVMおよび/またはFPGAを特定することができる。これにより、FPGAプログラムの更新、VMの追加/更新に伴ったFPGAの追加/更新等の制御を実行することができ、FPGAを含むネットワークの効率的な制御が可能となる。
上述した実施形態では、管理装置11がコントローラ10を通してネットワークシステムを一括管理する場合を例示したが、管理装置11とコントローラ10とを一体化した管理装置がネットワークを一括管理してもよい。たとえば、図15に示すように、管理装置12に上述した管理装置11およびコントローラ10の機能がふくまれており、管理装置12がネットワークシステムを一括管理することもできる。
11、12 管理装置
12a,12b 管理部
20 下位レイヤネットワーク
21-1 CPU
21-2 FPGA
22-1 CPU
30 上位レイヤネットワーク
101 ネットワーク管理部
102 機能管理部
103 FPGA管理部
104 ネットワークインタフェース
105 管理インタフェース
106 制御部
107 プログラムメモリ
VNF 仮想ネットワーク機能
Claims (8)
- 複数のサーバがそれぞれプログラム可能論理回路に対応しているかどうかの情報と、前記複数のサーバそれぞれで起動する仮想マシンと、前記プログラム可能論理回路にインストールされているプログラムと、の対応関係を記憶する手段と、
前記対応関係に基づいて、前記複数のサーバのうち更新するプログラムをインストールしているプログラム可能論理回路に対応するサーバを特定し、前記更新するプログラムをインストールしているプログラム可能論理回路で動作している仮想マシンのデータ処理を前記特定したサーバのCPU(Central Processing Unit)に代行させる制御手段と、
からなる制御装置。 - 前記制御手段が、前記更新するプログラムをインストールしているプログラム可能論理回路で動作している仮想マシンのデータ処理を、前記CPUと前記更新するプログラムをインストールしているプログラム可能論理回路とが共通して使用するメモリを介して前記CPUに代行させる、ことを特徴とする請求項1に記載の制御装置。
- 前記制御手段が、前記更新するプログラムをインストールしているプログラム可能論理回路が更新されたことに応じて、前記CPUに代行させたデータ処理を前記更新されたプログラム可能論理回路に行わせる、ことを特徴とする請求項1または2に記載の制御装置。
- 前記制御手段が、前記対応関係とプログラム更新の指示とに応じて、前記複数のサーバのうち更新するプログラムをインストールしているプログラム可能論理回路に対応するサーバを特定する、ことを特徴とする請求項1から3のいずれか一項に記載の制御装置。
- 記憶手段が、複数のサーバがそれぞれプログラム可能論理回路に対応しているかどうかの情報と、前記複数のサーバそれぞれで起動する仮想マシンと、前記プログラム可能論理回路にインストールされているプログラムと、の対応関係を記憶し、
制御手段が、前記対応関係に基づいて、前記複数のサーバのうち更新するプログラムをインストールしているプログラム可能論理回路に対応するサーバを特定し、前記更新するプログラムをインストールしているプログラム可能論理回路で動作している仮想マシンのデータ処理を前記特定したサーバのCPU(Central Processing Unit)に代行させる、
ことを特徴とする制御方法。 - 前記制御手段が、前記更新するプログラムをインストールしているプログラム可能論理回路で動作している仮想マシンのデータ処理を、前記CPUと前記更新するプログラムをインストールしているプログラム可能論理回路とが共通して使用するメモリを介して前記CPUに代行させる、ことを特徴とする請求項5に記載の制御方法。
- 前記制御手段が、前記更新するプログラムをインストールしているプログラム可能論理回路が更新されたことに応じて、前記CPUに代行させたデータ処理を前記更新されたプログラム可能論理回路に行わせる、ことを特徴とする請求項5または6に記載の制御方法。
- 前記制御手段が、前記対応関係とプログラム更新の指示とに応じて、前記複数のサーバのうち更新するプログラムをインストールしているプログラム可能論理回路に対応するサーバを特定する、ことを特徴とする請求項5から7のいずれか一項に記載の制御方法。
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