JP7244497B2 - 集積回路パッケージへのプログラマブルデバイスおよび処理システムの集積 - Google Patents
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Description
最近の中央処理装置(CPU)は、単一の半導体ダイ上に複数のマイクロプロセッサコア、グラフィックスエンジン、および他の固定機能を集積する複雑なシステムオンチップ(SoC)デバイスである。CPUは、周辺構成要素相互接続エクスプレス(Peripheral Component Interconnect Express)(PCIe)インターフェイスなどの拡張バスインターフェイスを含むことができる。典型的な構成では、CPUを有する集積回路(IC)パッケージは、プリント回路基板(PCB)に搭載される。固定されたまたは着脱可能な態様で、さまざまな周辺機器がCPU ICパッケージの外部のPCBに搭載される。周辺機器は、PCBおよびCPU ICパッケージのピンを通じてCPUのPCIeインターフェイスに結合される。そのような構成は、少なくともPCB上に搭載される複数個のICと最悪の場合は周辺機器を有する他のPCBを挿入可能な拡張ポートのための空間とを必要とする大きな設置面積を有する。
集積回路(IC)パッケージ中へのプログラマブルデバイスおよび処理システムの集積を説明する。ある例では、ICパッケージは、基板上に配設される処理システムおよびプログラマブルICを含み、処理システムは、基板の配線を通じてプログラマブルICに結合され、処理システムは、リング配線に結合される構成要素を含み、構成要素は、プロセッサおよびインターフェイスコントローラを含む。プログラマブルICは、配線を通じてインターフェイスコントローラに結合されるインターフェイス終点と、インターフェイス終点に結合されかつインターフェイス終点およびインターフェイスコントローラを通じての処理システムのリング配線との通信のために構成される少なくとも1つの周辺機器とを含む。
ある実施形態では、プログラマブルICは、プログラマブルファブリックに結合される埋込処理システムを含み得る。
ある実施形態では、プログラマブルICは、プログラマブルファブリックに結合される埋込処理システムを含み得る。
ある実施形態では、プログラマブルICは、プログラマブルファブリックに結合される埋込処理システムを含み得る。
ある実施形態では、プログラマブルICは、プログラマブルファブリックに結合される埋込処理システムを含み得る。
以上に記載の特徴を詳細に理解できるように、そのいくつかを添付の図面に示す例示的実現例を参照することによって、以上に簡単に要約した説明のより特定的な説明を有し得る。しかしながら、添付の図面は、典型的な例示的実現例のみを示すもので、したがって図面をその範囲の限定と考えてはならないことに留意すべきである。
理解を容易にするため、可能な場合、図に共通の同一の要素を示すのに同一の参照番号を用いる。有用な場合には、1つの例の要素を他の例に組入れ得ることが企図される。
図1は、例に従う集積回路(IC)パッケージ102を描くブロック図である。ICパッケージ102は、処理システム104およびプログラマブルIC106を含む。処理システム104は半導体ダイ上に実現され、1つ以上の中央処理装置(CPU)および周辺機器インターフェイスコントローラ(たとえば、周辺構成要素相互接続エクスプレス(PCIe)インターフェイスコントローラなど)を含む他の固定機能を含む。処理システム104の例示的な実現例を、図2を参照して以下に説明する。プログラマブルIC106は別の半導体ダイ上に実現され、フィールドプログラマブルゲートアレイ(FPGA)、コンプレックスプログラマブル論理デバイス(CPLD)、FPGA/CPLD機能性を有するシステムオンチップ(SoC)、または他の種類のプログラマブルデバイスであることができる。処理システム104およびプログラマブルIC106は、インターポーザ、パッケージ基板などの基板118に電気的かつ機械的に搭載される。基板118はICパッケージ102中に配設され、これは蓋またはその上に半導体ダイを封入する何らかの他の形態の封入体を含むことができる。
Claims (6)
- 集積回路(IC)パッケージであって、
基板上に配設される処理システムおよびプログラマブルICを備え、前記処理システムは、前記基板の配線を通じて前記プログラマブルICに結合され、さらに
前記処理システムおよび前記プログラマブルICのための外部インターフェイスを設けるように構成されるパッケージインターフェイスを備え、
前記処理システムはリング配線に結合される構成要素を含み、前記構成要素はプロセッサおよびインターフェイスコントローラを含み、
前記プログラマブルICは、
前記配線を通じて前記インターフェイスコントローラに結合されるインターフェイス終点と、
前記インターフェイス終点に結合されかつ前記インターフェイス終点および前記インターフェイスコントローラを通じての前記処理システムの前記リング配線との通信のために構成される少なくとも1つの周辺機器とを含み、
前記少なくとも1つの周辺機器は、パッケージインターフェイスに結合されるインターフェイスを含み、
前記プログラマブルICは、前記リング配線を通じて直接にアクセス可能ではない少なくとも1つの専用メモリと、前記少なくとも1つの周辺機器を通じ、前記リング配線を通じてアクセス可能な少なくとも1つのメモリとをさらに含む、集積回路(IC)パッケージ。 - 前記プログラマブルICはプログラマブルファブリックを含む、請求項1に記載のICパッケージ。
- 前記プログラマブルICは、前記プログラマブルファブリックに結合される埋込処理システムを含む、請求項2に記載のICパッケージ。
- 前記少なくとも1つの周辺機器は前記プログラマブルファブリック中にプログラミングされる、請求項2に記載のICパッケージ。
- 前記インターフェイスコントローラおよび前記インターフェイス終点は、各々、少なくとも1つのストリーミングインターフェイスを用いた通信のために構成される1つ以上のポートを含む、請求項1に記載のICパッケージ。
- 前記処理システムおよび前記プログラマブルICに結合される1つ以上の他のICをさらに備える、請求項1に記載のICパッケージ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2023036854A JP2023078246A (ja) | 2017-09-28 | 2023-03-09 | 集積回路パッケージへのプログラマブルデバイスおよび処理システムの集積 |
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US15/719,288 US10573598B2 (en) | 2017-09-28 | 2017-09-28 | Integration of a programmable device and a processing system in an integrated circuit package |
US15/719,288 | 2017-09-28 | ||
PCT/US2018/052413 WO2019067352A1 (en) | 2017-09-28 | 2018-09-24 | INTEGRATION OF A PROGRAMMABLE DEVICE AND A PROCESSING SYSTEM IN AN INTEGRATED CIRCUIT BOX |
Related Child Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2023036854A Division JP2023078246A (ja) | 2017-09-28 | 2023-03-09 | 集積回路パッケージへのプログラマブルデバイスおよび処理システムの集積 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2020535659A JP2020535659A (ja) | 2020-12-03 |
JP7244497B2 true JP7244497B2 (ja) | 2023-03-22 |
Family
ID=63858108
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2020517780A Active JP7244497B2 (ja) | 2017-09-28 | 2018-09-24 | 集積回路パッケージへのプログラマブルデバイスおよび処理システムの集積 |
JP2023036854A Pending JP2023078246A (ja) | 2017-09-28 | 2023-03-09 | 集積回路パッケージへのプログラマブルデバイスおよび処理システムの集積 |
Family Applications After (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2023036854A Pending JP2023078246A (ja) | 2017-09-28 | 2023-03-09 | 集積回路パッケージへのプログラマブルデバイスおよび処理システムの集積 |
Country Status (6)
Country | Link |
---|---|
US (2) | US10573598B2 (ja) |
EP (2) | EP3688604B1 (ja) |
JP (2) | JP7244497B2 (ja) |
KR (1) | KR20200062244A (ja) |
CN (2) | CN118295958A (ja) |
WO (1) | WO2019067352A1 (ja) |
Families Citing this family (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US11320995B2 (en) * | 2018-10-31 | 2022-05-03 | Western Digital Technologies, Inc. | Transferring computational operations to controllers of data storage devices |
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US11580057B2 (en) | 2019-10-28 | 2023-02-14 | Xilinx, Inc. | Subsystem for configuration, security, and management of an adaptive system |
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- 2017-09-28 US US15/719,288 patent/US10573598B2/en active Active
-
2018
- 2018-09-24 CN CN202410368756.5A patent/CN118295958A/zh active Pending
- 2018-09-24 EP EP18786532.4A patent/EP3688604B1/en active Active
- 2018-09-24 CN CN201880063416.4A patent/CN111183419B/zh active Active
- 2018-09-24 KR KR1020207011292A patent/KR20200062244A/ko not_active Application Discontinuation
- 2018-09-24 WO PCT/US2018/052413 patent/WO2019067352A1/en active Search and Examination
- 2018-09-24 JP JP2020517780A patent/JP7244497B2/ja active Active
- 2018-09-24 EP EP23191968.9A patent/EP4254214A3/en active Pending
-
2020
- 2020-01-27 US US16/773,501 patent/US11024583B2/en active Active
-
2023
- 2023-03-09 JP JP2023036854A patent/JP2023078246A/ja active Pending
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Also Published As
Publication number | Publication date |
---|---|
EP3688604A1 (en) | 2020-08-05 |
US10573598B2 (en) | 2020-02-25 |
US20190096813A1 (en) | 2019-03-28 |
CN111183419B (zh) | 2024-04-16 |
KR20200062244A (ko) | 2020-06-03 |
EP4254214A2 (en) | 2023-10-04 |
US11024583B2 (en) | 2021-06-01 |
CN118295958A (zh) | 2024-07-05 |
CN111183419A (zh) | 2020-05-19 |
WO2019067352A1 (en) | 2019-04-04 |
EP4254214A3 (en) | 2023-12-13 |
JP2020535659A (ja) | 2020-12-03 |
EP3688604B1 (en) | 2023-08-23 |
JP2023078246A (ja) | 2023-06-06 |
US20200161247A1 (en) | 2020-05-21 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A521 | Request for written amendment filed |
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