JP7206425B2 - セルラ電気通信ネットワークにおけるフロントホール物理レイヤ分割 - Google Patents
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Description
・ダウンリンクについては、逆高速フーリエ変換(iFFT)の最大ビット幅と、電力増幅器およびデジタルアナログ変換器の両方の精度;
・アップリンクについては、FFTの最大ビット幅、アナログデジタル変換器および受信機感度の両方の精度。
1.候補ビット幅を使用するときのフロントホールリンク40の予想容量要件と、その高容量構成の下で動作するときのフロントホールリンクの容量との比較;
2.候補ビット幅を使用するときの予想エラーレートと、(証明および/または較正データから知られる)サービスについてのエラーレートしきい値との比較。
PRBl tは、時間tにおいてレイヤlでスケジュールされた物理リソースブロック(PRB)の数であり、
Qは、PRB当たりのビット数であり、
Ltは、時間tにおける同時スケジュールされたUEの数である。
IQサンプルのビット幅を増加させる効果は、DU20が許容可能なエラーレートを維持しながらその現在のMCSを維持することができるように、EVM性能を改善することである。したがって、UE30は、許容可能なエラーレートを維持しながら、劣化したRF環境においてサービスを消費し続けることができる。したがって、本発明のこの実施形態は、自律運転サービスなど、セルラ電気通信ネットワークを通して動作する高信頼性サービスに特に適している。この実施形態はまた、典型的にはユーザデータよりも信頼性が高いはずである制御データ通信に特に適している。
1.候補ビット幅を使用するときのフロントホールリンク40の予想容量要件と、その低容量構成を使用するときのフロントホールリンクの容量との比較;
2.前記候補ビット幅を使用するときの予想エラーレートとサービスについてのエラーレートしきい値との比較。
以下に、本願出願の当初の特許請求の範囲に記載された発明を付記する。
[1] セルラ電気通信ネットワーク中の基地局を動作する方法であって、前記基地局は、中央基地局ユニットおよび分散基地局ユニットを有し、前記中央基地局ユニットおよび前記分散基地局ユニットは、フロントホールリンクを通して通信し、前記セルラ電気通信ネットワークは、前記基地局を介してサービスを消費するユーザ機器(UE)をさらに含み、前記中央基地局ユニットと前記UEとの間の通信は、構成可能なエラー軽減技術を利用し、前記方法は、
第1のビット幅で前記フロントホールリンクを通してサンプルを通信するステップと、
前記サービスの待ち時間測定値またはその導関数がしきい値を満たすと決定し、それに応答して、
第2のビット幅を使用するように前記サンプルを再構成し、ここにおいて、前記第1のビット幅は前記第2のビット幅とは異なり、
前記エラー軽減技術を再構成するステップと、
前記第2のビット幅で前記フロントホールリンクを通してサンプルを通信するステップと、
前記再構成されたエラー軽減技術を使用して、前記中央基地局ユニットと前記UEとの間で通信するステップとを含む、方法。
[2] 前記サービスの前記待ち時間測定値またはその導関数が前記しきい値よりも大きいと決定すると、前記第2のビット幅は、前記第1のビット幅よりもサンプル当たり多くのビットを有する、[1]に記載の方法。
[3] 前記サービスの前記待ち時間測定値またはその導関数が前記しきい値未満であると決定すると、前記第2のビット幅は、前記第1のビット幅よりもサンプル当たり少ないビットを有する、[1]に記載の方法。
[4] 前記エラー軽減技術を再構成するステップは、前記エラー軽減技術がアクティブである第1の状態と、前記エラー軽減技術が非アクティブである第2の状態との間で切り替えることを含む、[1]から[3]のうちのいずれか一項に記載の方法。
[5] 前記サンプルは、同相および直交(IQ)サンプルである、[1]から[4]のうちのいずれか一項に記載の方法。
[6] 命令を含むコンピュータプログラム製品であって、
前記プログラムがコンピュータによって実行されるとき、前記コンピュータに、[1]から[5]のうちのいずれか一項に記載の方法を実行させる、コンピュータプログラム製品。
[7] [6]の前記コンピュータプログラムを記憶した、コンピュータ読取可能データキャリア。
[8] セルラ電気通信ネットワークのための中央基地局ユニットであって、前記セルラ電気通信ネットワークは、前記中央基地局ユニットを介してサービスを消費するユーザ機器(UE)を含み、前記中央基地局ユニットと前記UEとの間の通信は、構成可能なエラー軽減技術を利用し、前記基地局ユニットは、
前記エラー軽減技術を使用して、第1のビット幅で分散基地局ユニットと、および前記UEと、フロントホールリンクを通してサンプルを通信するように構成されたトランシーバと、
前記サービスの待ち時間測定値またはその導関数がしきい値を満たすと決定し、それに応答して、
第2のビット幅を使用するように前記サンプルを再構成し、ここにおいて、前記第1のビット幅は前記第2のビット幅とは異なり、
前記エラー軽減技術を再構成するように構成されたプロセッサとを備え、
再構成に続いて、前記トランシーバは、前記第2のビット幅で前記フロントホールリンクを通してサンプルを通信し、前記再構成されたエラー軽減技術を使用して、前記UEと通信するように構成される、基地局ユニット。
[9] 前記サービスの前記待ち時間測定値又はその導関数が前記しきい値よりも大きいと決定すると、前記第2のビット幅は、前記第1のビット幅よりもサンプル当たりより多くのビットを有する、[8]に記載の基地局ユニット。
[10] 前記サービスの前記待ち時間測定値又はその導関数が前記しきい値未満であると決定すると、前記第2のビット幅は、前記第1のビット幅よりもサンプル当たりより少ないビットを有する、[8]に記載の基地局ユニット。
[11] 前記プロセッサは、前記エラー軽減技術がアクティブである第1の状態と前記エラー軽減技術が非アクティブである第2の状態との間で切り替えることによって、前記エラー軽減技術を再構成するように構成される、[8]から[10]のいずれか一項に記載の方法。
[12] 前記サンプルは同相および直交(IQ)サンプルである、[8]から[11]のいずれか一項に記載の方法。
Claims (8)
- セルラ電気通信ネットワーク中の基地局を動作する方法であって、前記基地局は、中央基地局ユニットおよび分散基地局ユニットを有し、前記中央基地局ユニットおよび前記分散基地局ユニットは、フロントホールリンクを通して通信し、前記セルラ電気通信ネットワークは、前記基地局を介してサービスを消費するユーザ機器(UE)をさらに含み、前記中央基地局ユニットと前記UEとの間の通信は、構成可能なエラー軽減技術を利用し、前記方法は、
第1のビット幅で前記フロントホールリンクを通してサンプルを通信するステップと、
前記サービスの待ち時間測定値またはその導関数がしきい値を満たすと決定し、それに応答して、
第2のビット幅を使用するように前記サンプルを再構成し、ここにおいて、前記サービスの前記待ち時間測定値またはその導関数が前記しきい値よりも大きいと決定される場合、前記第2のビット幅は、前記第1のビット幅よりもサンプル当たり多くのビットを有し、前記サービスの前記待ち時間測定値またはその導関数が前記しきい値未満であると決定される場合、前記第2のビット幅は、前記第1のビット幅よりもサンプル当たり少ないビットを有し、
前記エラー軽減技術を再構成するステップと、
前記第2のビット幅で前記フロントホールリンクを通してサンプルを通信するステップと、
前記再構成されたエラー軽減技術を使用して、前記中央基地局ユニットと前記UEとの間で通信するステップとを含む、方法。 - 前記エラー軽減技術を再構成するステップは、前記エラー軽減技術がアクティブである第1の状態と、前記エラー軽減技術が非アクティブである第2の状態との間で切り替えることを含む、請求項1に記載の方法。
- 前記サンプルは、同相および直交(IQ)サンプルである、請求項1から2のうちのいずれか一項に記載の方法。
- コンピュータプログラムであって、
前記コンピュータプログラムがコンピュータによって実行されるとき、前記コンピュータに、請求項1から3のうちのいずれか一項に記載の方法を実行させる、コンピュータプログラム。 - 請求項4の前記コンピュータプログラムを記憶した、コンピュータ読取可能データキャリア。
- セルラ電気通信ネットワークのための中央基地局ユニットであって、前記セルラ電気通信ネットワークは、前記中央基地局ユニットを介してサービスを消費するユーザ機器(UE)を含み、前記中央基地局ユニットと前記UEとの間の通信は、構成可能なエラー軽減技術を利用し、前記中央基地局ユニットは、
前記エラー軽減技術を使用して、第1のビット幅で分散基地局ユニットと、および前記UEと、フロントホールリンクを通してサンプルを通信するように構成されたトランシーバと、
前記サービスの待ち時間測定値またはその導関数がしきい値を満たすと決定し、それに応答して、
第2のビット幅を使用するように前記サンプルを再構成し、ここにおいて、前記サービスの前記待ち時間測定値又はその導関数が前記しきい値よりも大きいと決定される場合、前記第2のビット幅は、前記第1のビット幅よりもサンプル当たりより多くのビットを有し、前記サービスの前記待ち時間測定値又はその導関数が前記しきい値未満であると決定される場合、前記第2のビット幅は、前記第1のビット幅よりもサンプル当たりより少ないビットを有し、
前記エラー軽減技術を再構成するように構成されたプロセッサとを備え、
再構成に続いて、前記トランシーバは、前記第2のビット幅で前記フロントホールリンクを通してサンプルを通信し、前記再構成されたエラー軽減技術を使用して、前記UEと通信するように構成される、中央基地局ユニット。 - 前記プロセッサは、前記エラー軽減技術がアクティブである第1の状態と前記エラー軽減技術が非アクティブである第2の状態との間で切り替えることによって、前記エラー軽減技術を再構成するように構成される、請求項6に記載の中央基地局ユニット。
- 前記サンプルは同相および直交(IQ)サンプルである、請求項6から7のいずれか一項に記載の中央基地局ユニット。
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