JP7112262B2 - Semiconductor optical device and optical transmission module - Google Patents

Semiconductor optical device and optical transmission module Download PDF

Info

Publication number
JP7112262B2
JP7112262B2 JP2018119555A JP2018119555A JP7112262B2 JP 7112262 B2 JP7112262 B2 JP 7112262B2 JP 2018119555 A JP2018119555 A JP 2018119555A JP 2018119555 A JP2018119555 A JP 2018119555A JP 7112262 B2 JP7112262 B2 JP 7112262B2
Authority
JP
Japan
Prior art keywords
layer
mesa structure
optical device
semiconductor optical
buried
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2018119555A
Other languages
Japanese (ja)
Other versions
JP2020004754A (en
Inventor
秀明 浅倉
厚 中村
俊也 山内
義博 中井
Original Assignee
日本ルメンタム株式会社
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 日本ルメンタム株式会社 filed Critical 日本ルメンタム株式会社
Priority to JP2018119555A priority Critical patent/JP7112262B2/en
Publication of JP2020004754A publication Critical patent/JP2020004754A/en
Application granted granted Critical
Publication of JP7112262B2 publication Critical patent/JP7112262B2/en
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Description

本発明は、半導体光素子及びその製造方法並びに光送信モジュールに関する。 The present invention relates to a semiconductor optical device, its manufacturing method, and an optical transmission module.

半導体光素子の一つである半導体レーザは、光通信、情報処理、光源など、様々な用途で利用されており、低コスト、低消費電力、小型、高光出力、高信頼性が求められている。一般的に、半導体光素子は、pn接合を構成する半導体結晶と、電極を構成する金属を有する。 Semiconductor lasers, which are one of semiconductor optical devices, are used in various applications such as optical communication, information processing, and light sources, and are required to be low cost, low power consumption, small size, high optical output, and high reliability. . Generally, a semiconductor optical device has a semiconductor crystal forming a pn junction and a metal forming an electrode.

半導体光素子のなかでも埋め込みヘテロ構造(BH:Buried-Heterostructure)は、pn接合を構成する半導体結晶をメサ構造にし、該メサ構造の側部を半絶縁性半導体の埋め込み層で埋め込んでいる。そのため電極はメサ構造の上面(コンタクト層の上部の露出した面)と埋め込み層の上面にわたって配置される。 Among semiconductor optical devices, a buried-heterostructure (BH) has a semiconductor crystal forming a pn junction in a mesa structure, and the sides of the mesa structure are buried in a semi-insulating semiconductor buried layer. Therefore, the electrodes are arranged over the upper surface of the mesa structure (the upper exposed surface of the contact layer) and the upper surface of the buried layer.

半導体光素子の電極を構成する金属は、電子ビーム蒸着等の高温プロセスによって半導体結晶層上に成膜されることが一般的である。成膜された金属が高温から室温へ降温すると、半導体と金属の熱膨張係数の差によって半導体結晶に応力が発生する。このような応力は半導体光素子の性能に悪影響を及ぼすことが知られている。そのため、これまでこのような応力を緩和するための様々な提案がなされてきた。 A metal forming an electrode of a semiconductor optical device is generally deposited on a semiconductor crystal layer by a high-temperature process such as electron beam evaporation. When the temperature of the deposited metal is lowered from high temperature to room temperature, stress is generated in the semiconductor crystal due to the difference in thermal expansion coefficient between the semiconductor and the metal. Such stress is known to adversely affect the performance of semiconductor optical devices. Therefore, various proposals have been made so far for alleviating such stress.

特許文献1では、二重チャネル平面埋め込みヘテロ構造(DC-PBH:Double-Channel Planar Buried Heterostructure)型半導体レーザにおいて、電極を構成するPtによる半導体結晶に生じる応力と信頼性の関係が報告されている。例えば特許文献1では、TiPtAuオーミック電極を、メサ構造の両外部近傍でメサ部に沿って切断することが提案されている。 Patent Document 1 reports the relationship between the stress generated in the semiconductor crystal by Pt constituting the electrode and the reliability in a double-channel planar buried heterostructure (DC-PBH) type semiconductor laser. . For example, Patent Literature 1 proposes cutting TiPtAu ohmic electrodes along the mesa portion near both outsides of the mesa structure.

特許文献2では、リッジ型半導体レーザにおける、金属による半導体結晶の応力とレーザ活性層又は光吸収層の特性ばらつきの関係が報告されている。例えば特許文献2では、メサ構造上の電極に応力低減用スリットを加えることが提案されている。 Patent Document 2 reports the relationship between the stress of a semiconductor crystal caused by a metal and the characteristic variation of a laser active layer or a light absorption layer in a ridge type semiconductor laser. For example, Patent Literature 2 proposes adding stress-reducing slits to the electrodes on the mesa structure.

特許文献3では、リッジ型半導体レーザにおいて電極によるリッジ直下の活性層の応力を緩和することが提案されている。例えば特許文献3では、リッジ上部のコンタクト層の側壁部分とコンタクト直下の半導体リッジ構造の側壁部分に空洞を設ける構造が提案されている。 Japanese Laid-Open Patent Publication No. 2002-100002 proposes to relax the stress of the active layer directly under the ridge by the electrode in the ridge type semiconductor laser. For example, Patent Document 3 proposes a structure in which cavities are provided in the sidewall portion of the contact layer above the ridge and the sidewall portion of the semiconductor ridge structure immediately below the contact.

特許文献4では、窒化物半導体レーザのリッジ型構造において、電極による窒化物半導体層、およびリッジの応力と信頼性の関係が報告されている。例えば特許文献4では、リッジ基底部において、半導体層上の保護膜と、保護膜上の電極の間に空隙を設ける構造が提案されている。 In Patent Document 4, in the ridge type structure of a nitride semiconductor laser, the relationship between the reliability and the stress of the nitride semiconductor layer formed by the electrode and the ridge is reported. For example, Patent Document 4 proposes a structure in which a gap is provided between a protective film on a semiconductor layer and an electrode on the protective film in a ridge base portion.

特開昭64-28884号公報JP-A-64-28884 特開2012-256712号公報JP 2012-256712 A 特開2012-94564号公報JP 2012-94564 A 特開2012-59890号公報JP 2012-59890 A

前述したBH構造では、メサ構造の上面と埋め込み層の上面は概ね同一面となることが一般的であるが、BH構造の製造プロセスの中には、埋め込み層からメサ構造の上部を突出させるプロセスがある。そのようにメサ構造の一部が埋め込み層から突出する半導体光素子では、突出したメサ構造の一部の側面にも電極が形成される。そのためメサ構造は上面に加えて側面からも電極の応力を感じることになる。結果として、上部が突出したメサ構造は、上部が突出していないメサ構造よりも電極からより大きな影響を受ける。そのためメサ構造の上部が突出したBH構造型半導体レーザにおいては、応力緩和は特に重要であることを我々は見出した。 In the BH structure described above, the upper surface of the mesa structure and the upper surface of the buried layer are generally flush with each other. There is In such a semiconductor optical device in which a portion of the mesa structure protrudes from the buried layer, electrodes are also formed on the side surfaces of a portion of the protruding mesa structure. Therefore, in the mesa structure, the electrode stress is felt not only from the top surface but also from the side surface. As a result, the top-protruding mesa structure is more affected by the electrode than the non-top-protruding mesa structure. Therefore, we have found that stress relaxation is particularly important in a BH semiconductor laser in which the upper portion of the mesa structure protrudes.

しかし特許文献1で開示されている応力緩和は、コンタクト層が埋め込み層から露出していないBH構造の応力を緩和している。また特許文献2乃至4で開示されている応力緩和は、リッジ型半導体レーザの応力緩和であってBH構造型半導体レーザの応力緩和ではない。そのため特許文献1乃至4に開示された応力緩和では、BH構造型半導体レーザの応力緩和を十分に実現し得ない恐れがある。 However, the stress relaxation disclosed in Patent Document 1 relaxes the stress of the BH structure in which the contact layer is not exposed from the buried layer. The stress relaxation disclosed in Patent Documents 2 to 4 is stress relaxation for a ridge type semiconductor laser, not for a BH structure type semiconductor laser. Therefore, there is a possibility that the stress relaxation methods disclosed in Patent Documents 1 to 4 may not achieve sufficient stress relaxation for the BH structure semiconductor laser.

上記の理解に基づき本願発明者等は、特許文献1乃至4に開示された応力緩和について検討した。その結果本願発明者等は、特許文献1乃至4に開示された応力緩和では、コンタクト層が埋め込み層から一部又は全部が露出しているBH構造半導体レーザのSMSR(Side Mode Suppression Ratio)特性に及ぼす悪影響が十分に緩和されないことを発見した。 Based on the above understanding, the inventors of the present application examined the stress relaxation disclosed in Patent Documents 1 to 4. As a result, the inventors of the present application have found that the stress relaxation disclosed in Patent Documents 1 to 4 does not affect the SMSR (Side Mode Suppression Ratio) characteristics of a BH structure semiconductor laser in which the contact layer is partially or entirely exposed from the buried layer. It has been found that the adverse effects exerted are not sufficiently mitigated.

よって本願発明は、メサ構造上部が埋め込み層から突出するBH構造型半導体レーザにおいて、埋め込み層から突出するメサ構造上部の側面が電極層から受ける応力を低減することを目的とする。 SUMMARY OF THE INVENTION Accordingly, it is an object of the present invention to reduce stress applied from an electrode layer to the side surfaces of the mesa structure upper portion protruding from the buried layer in a BH structure semiconductor laser in which the upper portion of the mesa structure protrudes from the buried layer.

(1)本願の半導体光素子は、第一導電型を有する基板と、前記基板上に設けられる活性層、該活性層上に設けられて前記第一導電型とは異なる第二導電型を有するクラッド層、及び前記クラッド層上に設けられる第二導電型を有するコンタクト層を含むメサ構造と、前記基板上に設けられ、かつ、前記メサ構造を埋め込む埋め込み層と、前記コンタクト層上と前記埋め込み層上に設けられる少なくとも2つの層を含む電極層、を有する。当該半導体光素子では、前記メサ構造の上部は前記埋め込み層から露出し、前記メサ構造上と前記埋め込み層上に堆積される前記電極層のうちの一の層及び/又は該一の層上に堆積される他の層は、前記メサ構造の上部の側壁で分離する。 (1) A semiconductor optical device of the present application comprises a substrate having a first conductivity type, an active layer provided on the substrate, and a second conductivity type provided on the active layer different from the first conductivity type. a mesa structure including a cladding layer and a contact layer having a second conductivity type provided on the cladding layer; a burying layer provided on the substrate and burying the mesa structure; an electrode layer comprising at least two layers provided on the layer. In the semiconductor optical device, the upper portion of the mesa structure is exposed from the buried layer, and one of the electrode layers deposited on the mesa structure and the buried layer and/or on the one layer Another layer to be deposited separates the upper sidewalls of the mesa structure.

(2)(1)の半導体光素子において、前記他の層の厚さが、前記メサ構造の上部が前記埋め込み層から露出している部分の厚さより厚く、前記他の層は前記コンタクト層上から前記埋め込み層上において、連続的に繋がっており、前記一の層は、前記メサ構造の上部の側壁で分離する。 (2) In the semiconductor optical device of (1), the thickness of the other layer is thicker than the thickness of the portion where the upper part of the mesa structure is exposed from the buried layer, and the other layer is on the contact layer. on the buried layer, and the one layer is separated by the upper sidewall of the mesa structure.

(3)(1)の半導体光素子において、前記一の層の厚さが、前記メサ構造の上部が前記埋め込み層から露出している部分の厚さより厚く、前記一の層は前記コンタクト層上から前記埋め込み層上において、連続的に繋がっており、前記他の層は、前記メサ構造の上部の側壁で分離する。 (3) In the semiconductor optical device of (1), the thickness of the one layer is thicker than the thickness of the portion where the upper part of the mesa structure is exposed from the buried layer, and the one layer is on the contact layer. on the buried layer, and the other layers are separated by upper sidewalls of the mesa structure.

(4)(1)の半導体光素子において、前記メサ構造の内、前記埋め込み層から露出している領域は、前記コンタクト層の一部である。 (4) In the semiconductor optical device of (1), the region of the mesa structure exposed from the buried layer is part of the contact layer.

(5)(1)の半導体光素子において、前記一の層と前記他の層の厚さの合計は、前記メサ構造の上部が前記埋め込み層から露出している厚さより薄い。 (5) In the semiconductor optical device of (1), the total thickness of the one layer and the other layer is thinner than the thickness of the upper portion of the mesa structure exposed from the buried layer.

(6)(1)乃至(4)のいずれかの半導体光素子において、前記一の層と前記他の層の厚さの合計は、前記メサ構造の上部が前記埋め込み層から露出している厚さより厚い。 (6) In the semiconductor optical device according to any one of (1) to (4), the total thickness of the one layer and the other layer is the thickness at which the upper portion of the mesa structure is exposed from the buried layer. thicker than

(7)(1)乃至(3)のいずれかの半導体光素子において、前記メサ構造の内、前記埋め込み層から露出している領域は、前記コンタクト層の全部である。 (7) In the semiconductor optical device according to any one of (1) to (3), the region of the mesa structure exposed from the buried layer is the entire contact layer.

(8)(1)乃至(7)のいずれかの半導体光素子において、前記電極層のうちの一の層はTiであり、前記電極層のうちの他の層はPtである。 (8) In the semiconductor optical device according to any one of (1) to (7), one of the electrode layers is Ti and the other electrode layer is Pt.

(9)本願の光送信モジュールは、(1)乃至(8)のいずれかの半導体光素子を備える。 (9) An optical transmission module of the present application includes the semiconductor optical device according to any one of (1) to (8).

(10)本願の光送受信モジュールは、(1)乃至(8)のいずれかの半導体光素子を備える。 (10) An optical transceiver module of the present application comprises the semiconductor optical device according to any one of (1) to (8).

本発明は、メサ構造上部が埋め込み層から突出するBH構造型半導体レーザにおいて、埋め込み層から突出するメサ構造上部の側面が電極層から受ける応力を低減させる。 According to the present invention, in a BH structure semiconductor laser in which the upper portion of the mesa structure protrudes from the buried layer, the side surface of the upper portion of the mesa structure protruding from the buried layer receives stress from the electrode layer.

本発明の実施形態による光送信モジュールを備える光送受信モジュールを示す。1 shows an optical transceiver module comprising an optical transmitter module according to an embodiment of the invention; 本発明の実施形態による半導体光素子を搭載した光送信モジュールを示す。1 shows an optical transmission module equipped with a semiconductor optical device according to an embodiment of the present invention; 本発明の実施形態による半導体光素子の上面図を示す。1 shows a top view of a semiconductor optical device according to an embodiment of the present invention; FIG. 本発明の実施形態による半導体光素子の断面図を示している。1 shows a cross-sectional view of a semiconductor optical device according to an embodiment of the present invention; FIG. 本発明の実施形態による半導体光素子のメサ構造の拡大断面図を示している。1 shows an enlarged cross-sectional view of a mesa structure of a semiconductor optical device according to an embodiment of the present invention; FIG. 本発明の実施形態による半導体光素子のメサ構造の拡大断面図を示している。1 shows an enlarged cross-sectional view of a mesa structure of a semiconductor optical device according to an embodiment of the present invention; FIG. 本発明の実施形態による半導体光素子のメサ構造の拡大断面図を示している。1 shows an enlarged cross-sectional view of a mesa structure of a semiconductor optical device according to an embodiment of the present invention; FIG. 本発明の実施形態による半導体光素子のメサ構造の拡大断面図を示している。1 shows an enlarged cross-sectional view of a mesa structure of a semiconductor optical device according to an embodiment of the present invention; FIG. 本発明の実施形態による半導体光素子のメサ構造の拡大断面図を示している。1 shows an enlarged cross-sectional view of a mesa structure of a semiconductor optical device according to an embodiment of the present invention; FIG. 本発明の実施形態による半導体光素子の製造方法を表している。1 illustrates a method of manufacturing a semiconductor optical device according to an embodiment of the present invention; 本発明の実施形態による半導体光素子の製造方法を表している。1 illustrates a method of manufacturing a semiconductor optical device according to an embodiment of the present invention; 本発明の実施形態による半導体光素子の製造方法を表している。1 illustrates a method of manufacturing a semiconductor optical device according to an embodiment of the present invention; 本発明の実施形態による半導体光素子の製造方法を表している。1 illustrates a method of manufacturing a semiconductor optical device according to an embodiment of the present invention;

[第1実施形態]
図1は、本願実施形態による光送信モジュールを備える光送受信モジュールを示す。光送受信モジュール100は、筺体101と、筺体101中に設けられる、エッジ・コネクタ102を備えるプリント基板103と、光送信モジュール106(TOSA:Transmitter Optical Sub Assembly)と、光受信モジュール107(ROSA:Receiver Optical Sub Assembly)と、筺体101に取り付けられる光ファイバコネクタ108a,108bを有する。プリント基板103は該プリント基板103上に集積回路104を有する。
[First embodiment]
FIG. 1 shows an optical transceiver module comprising an optical transmitter module according to an embodiment of the present application. The optical transceiver module 100 includes a housing 101, a printed circuit board 103 provided in the housing 101 and provided with an edge connector 102, an optical transmitter module 106 (TOSA: Transmitter Optical Sub Assembly), and an optical receiver module 107 (ROSA: Receiver Optical Sub Assembly) and optical fiber connectors 108 a and 108 b attached to the housing 101 . A printed circuit board 103 has an integrated circuit 104 on it.

プリント基板103は、光送信モジュール106及び光受信モジュール107とはフレキシブル基板105によってそれぞれ接続される。光ファイバコネクタ108a,108bは、光送信モジュール106及び光受信モジュール107にそれぞれ光学的に位置合わせされている。 The printed circuit board 103 is connected to the optical transmission module 106 and the optical reception module 107 by the flexible circuit board 105 respectively. The fiber optic connectors 108a, 108b are optically aligned with the optical transmitter module 106 and the optical receiver module 107, respectively.

集積回路104は信号再生機能や増幅機能を有する。光送信モジュール106は電気信号を光信号に変換する機能を有する。光受信モジュール107は光信号を電気信号に変換する機能を有する。 The integrated circuit 104 has a signal reproduction function and an amplification function. The optical transmission module 106 has the function of converting electrical signals into optical signals. The optical receiver module 107 has a function of converting an optical signal into an electrical signal.

エッジ・コネクタ102は、光受信モジュール107からの電気信号をホスト装置(不図示)へ出力し、かつ、ホスト装置(不図示)からの電気信号を光送信モジュール106へ出力する。光ファイバコネクタ108a,108bは光送受信モジュール100の入出力手段として機能する。すなわち、入力光は、光ファイバコネクタ108bに接続される光ファイバ(不図示)を介して光受信モジュール107へ入力され、かつ、出力光は、光ファイバコネクタ108aに接続される光ファイバ(不図示)を介して光送信モジュール106から出力される。 The edge connector 102 outputs electrical signals from the optical receiver module 107 to a host device (not shown) and outputs electrical signals from the host device (not shown) to the optical transmitter module 106 . The optical fiber connectors 108 a and 108 b function as input/output means of the optical transceiver module 100 . That is, the input light is input to the optical receiving module 107 via an optical fiber (not shown) connected to the optical fiber connector 108b, and the output light is an optical fiber (not shown) connected to the optical fiber connector 108a. ) from the optical transmission module 106 .

図2は本願実施形態による光送信モジュールを示す。光送信モジュール106は、チップキャリア109と、該チップキャリア109上に搭載された半導体光素子110と、凸レンズ111を有する。 FIG. 2 shows an optical transmitter module according to an embodiment of the present application. The optical transmission module 106 has a chip carrier 109 , a semiconductor optical device 110 mounted on the chip carrier 109 , and a convex lens 111 .

半導体光素子110は光を放出する。凸レンズ111は半導体光素子110から放出された光を平行光又は集束光に変換する。 The semiconductor optical device 110 emits light. The convex lens 111 converts the light emitted from the semiconductor optical device 110 into parallel light or converging light.

図3は本願実施形態による半導体光素子の上面図を示す。図示されている半導体光素子110は電界吸収型光変調器集積分布帰還型レーザ(EA-DFB:Electro-Absorption modulator - Distributed Feedback laser)である。半導体光素子110は、レーザ部112と、導波路部113と、変調器部114と、メサ構造(メサストライプ)115を有する。 FIG. 3 shows a top view of a semiconductor optical device according to an embodiment of the present application. The illustrated semiconductor optical device 110 is an electro-absorption modulator-distributed feedback laser (EA-DFB). The semiconductor optical device 110 has a laser section 112 , a waveguide section 113 , a modulator section 114 and a mesa structure (mesa stripe) 115 .

レーザ部112の上部には電極116が設けられている。電極116は少なくとも2層の金属層を含んでよい。レーザ部112はDFBレーザ素子であることが好ましいが、他の形式のレーザ素子であってもよい。変調器部114の上部には電極116と電極パッド117が設けられている。変調器部114はEA光変調器であることが好ましいが、他の形式の光変調器であってもよい。 An electrode 116 is provided above the laser section 112 . Electrode 116 may include at least two metal layers. Laser portion 112 is preferably a DFB laser element, but may be other types of laser elements. An electrode 116 and an electrode pad 117 are provided above the modulator section 114 . Modulator section 114 is preferably an EA optical modulator, but may be other types of optical modulators.

図4は、本発明の実施形態による半導体光素子110の線A-A’に沿った断面図を示している。図示された半導体光素子110は半絶縁性半導体で埋め込まれたBH構造型半導体レーザである。なお図4に示された断面図は図3の断面A-A‘での断面に限定されるものではなく、レーザ部112のどの断面も図4に示された構造を有する。 FIG. 4 shows a cross-sectional view along line A-A' of semiconductor optical device 110 according to an embodiment of the present invention. The illustrated semiconductor optical device 110 is a BH structure type semiconductor laser embedded with a semi-insulating semiconductor. The cross-sectional view shown in FIG. 4 is not limited to the cross-section taken along the line AA' in FIG. 3, and any cross-section of the laser section 112 has the structure shown in FIG.

半導体光素子110は、第一導電型を有する基板118と、基板118の表面に設けられるメサ構造115と、メサ構造115を埋め込む埋め込み層122と、埋め込み層122の一部の上に設けられるパッシベーション膜123と、メサ構造115、埋め込み層122、及びパッシベーション膜123を覆うTi層124と、Ti層124上に設けられるPt層125と、Pt層125上に設けられるAu層126と、基板118の裏面に形成される第一導電型を有する電極127を有する。 The semiconductor optical device 110 includes a substrate 118 having a first conductivity type, a mesa structure 115 provided on the surface of the substrate 118, an embedding layer 122 embedding the mesa structure 115, and a passivation layer provided on part of the embedding layer 122. The film 123, the Ti layer 124 covering the mesa structure 115, the buried layer 122, and the passivation film 123, the Pt layer 125 provided on the Ti layer 124, the Au layer 126 provided on the Pt layer 125, and the substrate 118. It has an electrode 127 having a first conductivity type formed on the back surface.

メサ構造115は、活性層119と、活性層119上に設けられて第一導電型とは異なる第二導電型を有するクラッド層120と、クラッド層120上に設けられて第二導電型を有するコンタクト層121を有する。Ti層124と、Pt層125と、Au層126は、第二導電型を有する電極層116を構成する。メサ構造115は、本実施形態では、図4の鉛直方向にストライプ状の共振器構造を有する。本説明では省略したが、メサ構造115にはSCH層、回折格子層等の他の層が含まれていても良い。ただしメサ構造115の最上層はコンタクト層である。また本実施形態では、基板118はn型InP基板、活性層119はInGaAsPを含む多重量子井戸、クラッド層120はp型のInP層、コンタクト層121はp型のInGaAs層とした。さらにメサ構造115共振器構造はλ/4シフト回折格子構造とした。 The mesa structure 115 includes an active layer 119, a clad layer 120 provided on the active layer 119 and having a second conductivity type different from the first conductivity type, and a clad layer 120 provided on the clad layer 120 and having the second conductivity type. It has a contact layer 121 . The Ti layer 124, the Pt layer 125, and the Au layer 126 constitute the electrode layer 116 having the second conductivity type. The mesa structure 115 has a striped resonator structure in the vertical direction in FIG. 4 in this embodiment. Although omitted in this description, the mesa structure 115 may include other layers such as an SCH layer and a diffraction grating layer. However, the top layer of the mesa structure 115 is the contact layer. In this embodiment, the substrate 118 is an n-type InP substrate, the active layer 119 is a multiple quantum well containing InGaAsP, the cladding layer 120 is a p-type InP layer, and the contact layer 121 is a p-type InGaAs layer. Furthermore, the resonator structure of the mesa structure 115 is a λ/4 shift diffraction grating structure.

半導体光素子110はInGaAsP系材料で構成されるが他の材料系で構成されてもよい。埋め込み層122は半絶縁性半導体で構成される。ここではFeが添加されたInP層とした。コンタクト層121の上面ではTi層124、Pt層125、及びAu層126からなる電極層116はオーミック電極を構成するため、低抵抗の電気的接続が十分に保たれる。本実施形態では、第一導電型がn型で第二導電型はp型だが、実施形態によっては、第一導電型がp型で第二導電型はn型であってもよい。 The semiconductor optical device 110 is composed of an InGaAsP-based material, but may be composed of other materials. Buried layer 122 is composed of a semi-insulating semiconductor. Here, an InP layer to which Fe is added is used. Since the electrode layer 116 composed of the Ti layer 124, the Pt layer 125, and the Au layer 126 constitutes an ohmic electrode on the upper surface of the contact layer 121, low-resistance electrical connection is sufficiently maintained. In this embodiment, the first conductivity type is n-type and the second conductivity type is p-type, but depending on the embodiment, the first conductivity type may be p-type and the second conductivity type may be n-type.

半導体光素子の通電及び放熱並びに後工程(ワイヤボンディング、はんだ付け)を考慮すると、Auを電極として用いることが好ましい。しかし電極層中のAuはメサ構造中の半導体層中へ拡散することで、半導体光素子の信頼性及び特性を劣化させる恐れがある。そのようなAuの半導体層への拡散を防止するため、Pt電極層がバリア層としてAu電極層の下に設けられる。コンタクト層121とAu層126は直接接触せず、Auの半導体結晶への拡散はPt層125のバリアメタル効果により抑制される。しかしPtの半導体への接着強度は弱いため、接着層及びオーミック電極を形成するため、Ti層124がPt層125と埋め込み層122及びメサ構造115上部との間に設けられる。 Considering the conduction and heat dissipation of the semiconductor optical device and post-processes (wire bonding and soldering), it is preferable to use Au as the electrode. However, Au in the electrode layer diffuses into the semiconductor layer in the mesa structure, possibly degrading the reliability and characteristics of the semiconductor optical device. In order to prevent such diffusion of Au into the semiconductor layer, a Pt electrode layer is provided below the Au electrode layer as a barrier layer. The contact layer 121 and the Au layer 126 are not in direct contact, and diffusion of Au into the semiconductor crystal is suppressed by the barrier metal effect of the Pt layer 125 . However, since the adhesion strength of Pt to semiconductors is weak, a Ti layer 124 is provided between the Pt layer 125 and the buried layer 122 and the top of the mesa structure 115 to form an adhesion layer and an ohmic electrode.

前述したように、Auは通電及び放熱のためにメサ構造以外の領域に広がっていることが必要である。そのためたとえAu電極層がメサ構造へ及ぼす応力は大きいとしても、Au層が半導体層へ及ぼす応力は不可避である。しかしPt層とTi層は電極本来の機能である通電以外の目的を主として設けられている。そのためPt層とTi層はメサ構造に応力を及ぼさないことが好ましい。 As described above, Au needs to spread over areas other than the mesa structure for conduction and heat dissipation. Therefore, even if the stress exerted by the Au electrode layer on the mesa structure is large, the stress exerted by the Au layer on the semiconductor layer is inevitable. However, the Pt layer and the Ti layer are mainly provided for a purpose other than the original function of the electrode, which is to conduct electricity. Therefore, it is preferable that the Pt layer and the Ti layer do not exert stress on the mesa structure.

上記観点から鋭意検討した結果、本願発明者等は、Pt層とTi層がメサ構造へ及ぼす応力を緩和するため、メサ構造の側面に接するPt電極層及び/又はTi電極層と上面に接するPt電極層及び/又はTi電極層の繋がりを弱くすることに想到した。具体的には本願発明者等は、Pt電極層及び/又はTi電極層がメサ構造上部と側部で分離する半導体光素子を提案した。Pt層及び/又はTi層は、メサ構造の上部のみに形成されることが好ましいが、実際にはメサ構造の側部にもある程度形成される。 As a result of intensive studies from the above point of view, the inventors of the present application have found a Pt electrode layer in contact with the side surface of the mesa structure and/or a Pt electrode layer in contact with the upper surface of the mesa structure in order to relax the stress exerted on the mesa structure by the Pt layer and the Ti layer. The idea was to weaken the connection between the electrode layer and/or the Ti electrode layer. Specifically, the inventors of the present application have proposed a semiconductor optical device in which the Pt electrode layer and/or the Ti electrode layer are separated at the upper portion and the side portion of the mesa structure. The Pt layer and/or the Ti layer are preferably formed only on the top of the mesa structure, but in practice they are also formed on the sides of the mesa structure to some extent.

前述した半導体光素子の電極層は、メサ構造の側部で分離しているためメサ構造の上部であるコンタクト層側部への電極層による応力は緩和され、メサ構造全体の応力緩和が実現され、その結果本願実施形態による半導体光素子のSMSR歩留りを3%改善させることを本願発明者等は発見した。 Since the electrode layer of the semiconductor optical device described above is separated at the side of the mesa structure, the stress of the electrode layer on the side of the contact layer, which is the upper part of the mesa structure, is relieved, and the stress of the entire mesa structure is relieved. As a result, the inventors of the present application have found that the SMSR yield of the semiconductor optical device according to the present embodiment is improved by 3%.

図5は、本願実施形態による半導体光素子のメサ構造の図4のBでの拡大断面図を示している。本実施形態では、コンタクト層121の全部が埋め込み層122から露出している。すなわち本実施形態では、埋め込み層122から露出するメサ構造115の上部はコンタクト層121である。本実施形態では、Ti層124及びPt層125の両者がコンタクト層121の側部において分離されて不連続となっている。また、それぞれのコンタクト層121上部に形成された領域の厚さと、埋め込み層122上部に形成された領域の厚さとは略等しい。なお実施形態によっては、コンタクト層121より下に位置する層(例えばクラッド層120)が埋め込み層122から露出してもよい。本実施形態では、Ti層124の厚さがコンタクト層121の埋め込み層122から露出した部分の厚さ(以下、Hと呼称)より薄く(Ti層<H)、また、Pt層125の厚さも露出した部分の厚さより薄い(Pt厚<H)。さらに、Ti層124とPt層125の厚さの合計は、Hよりも大きい。そのため、Pt層125の上に配置されるAu層126が露出部(半導体層であるコンタクト層121)の側部に接することがなく、Au拡散の懸念はない。なお、本実施形態ではコンタクト層121の埋め込み層122から露出した部分の厚さは200nmで、Ti層124の厚さは100nmで、Pt層125は150nmで、かつ、Au層126は1000nmである。 FIG. 5 shows an enlarged cross-sectional view of the mesa structure of the semiconductor optical device according to the embodiment of the present application at B in FIG. In this embodiment, the entire contact layer 121 is exposed from the buried layer 122 . That is, in this embodiment, the upper portion of the mesa structure 115 exposed from the buried layer 122 is the contact layer 121 . In this embodiment, both the Ti layer 124 and the Pt layer 125 are separated and discontinuous at the sides of the contact layer 121 . Also, the thickness of the region formed on each contact layer 121 and the thickness of the region formed on the buried layer 122 are substantially equal. Depending on the embodiment, a layer (for example, the cladding layer 120) located below the contact layer 121 may be exposed from the buried layer 122. FIG. In this embodiment, the thickness of the Ti layer 124 is thinner than the thickness (hereinafter referred to as H) of the portion of the contact layer 121 exposed from the embedded layer 122 (Ti layer<H), and the thickness of the Pt layer 125 is also Thinner than the thickness of the exposed part (Pt thickness<H). Furthermore, the total thickness of the Ti layer 124 and the Pt layer 125 is greater than H. Therefore, the Au layer 126 arranged on the Pt layer 125 does not come into contact with the side of the exposed portion (the contact layer 121 which is a semiconductor layer), so there is no fear of Au diffusion. In this embodiment, the thickness of the portion of the contact layer 121 exposed from the buried layer 122 is 200 nm, the thickness of the Ti layer 124 is 100 nm, the thickness of the Pt layer 125 is 150 nm, and the thickness of the Au layer 126 is 1000 nm. .

図5に示されたメサ構造においては、Ti層124は、コンタクト層121の側部において分離されて不連続となっている。そのため、連続している場合と比較して、本実施形態による半導体光素子では、メサ構造115へのTi層124が及ぼす応力は緩和される。さらに、Pt層125も同様に不連続となっており、メサ構造115へのPt層125が及ぼす応力は緩和される。 In the mesa structure shown in FIG. 5, the Ti layer 124 is separated and discontinuous at the sides of the contact layer 121 . Therefore, in the semiconductor optical device according to this embodiment, the stress exerted by the Ti layer 124 on the mesa structure 115 is alleviated compared to the case where the mesa structure 115 is continuous. Furthermore, the Pt layer 125 is similarly discontinuous, and the stress exerted by the Pt layer 125 on the mesa structure 115 is relieved.

[第2実施形態]
図6は、本願実施形態による半導体光素子のメサ構造の拡大断面図を示している。本実施形態では、Pt層125がメサ構造115の側壁で連続していることを除き、第1実施形態と同様である。本実施形態では、Pt層厚は250nmとした。Ti層124はメサ構造115の側壁で分離しているので、Ti層124がコンタクト層121へ及ぼす応力は緩和される。よって本実施形態でも同様の効果が得られる。
[Second embodiment]
FIG. 6 shows an enlarged cross-sectional view of the mesa structure of the semiconductor optical device according to the embodiment of the present application. This embodiment is similar to the first embodiment except that the Pt layer 125 is continuous on the sidewalls of the mesa structure 115 . In this embodiment, the Pt layer thickness is set to 250 nm. Since the Ti layer 124 is separated by the sidewalls of the mesa structure 115, the stress exerted by the Ti layer 124 on the contact layer 121 is relieved. Therefore, the same effect can be obtained in this embodiment as well.

[第3実施形態]
図7は、本願実施形態による半導体光素子のメサ構造の拡大断面図を示している。本実施形態では、Ti層124がメサ構造115の側壁で連続していることを除き、第1実施形態と同様である。本実施形態では、Ti層厚は250nmとした。Pt層125がメサ構造115の側壁で分離しているので、コンタクト層121へ及ぼされる応力は緩和される。よって本実施形態でも同様の効果が得られる。
[Third embodiment]
FIG. 7 shows an enlarged cross-sectional view of the mesa structure of the semiconductor optical device according to the embodiment of the present application. This embodiment is similar to the first embodiment except that the Ti layer 124 is continuous on the sidewalls of the mesa structure 115 . In this embodiment, the Ti layer thickness is set to 250 nm. Since the Pt layer 125 separates the sidewalls of the mesa structure 115, the stress exerted on the contact layer 121 is relieved. Therefore, the same effect can be obtained in this embodiment as well.

[第4実施形態]
図8は、本願実施形態による半導体光素子のメサ構造の拡大断面図を示している。本実施形態では、コンタクト層121の一部が埋め込み層122から露出していること、Pt層の厚さが異なる点を除き、第1実施形態と同様である。また本実施形態では、露出している部分の厚さHは150nmであり、Pt層厚は100nmとした。本実施形態においても、コンタクト層121の一部しか露出していないとしても、Ti層124とPt層125がメサ構造115の側壁で分離しているので、コンタクト層121の露出した部分へ及ぼされる応力は緩和される。よって本実施形態でも同様の効果が得られる。逆に、メサ構造のうち、クラッド層120の一部まで露出していたとしても、Ti層124及び/又はPt層125が不連続であれば、本実施形態と同様の効果が得られる。
[Fourth embodiment]
FIG. 8 shows an enlarged cross-sectional view of the mesa structure of the semiconductor optical device according to the embodiment of the present application. This embodiment is the same as the first embodiment except that a part of the contact layer 121 is exposed from the buried layer 122 and the thickness of the Pt layer is different. In this embodiment, the thickness H of the exposed portion is 150 nm, and the Pt layer thickness is 100 nm. Also in this embodiment, even if only a portion of the contact layer 121 is exposed, the Ti layer 124 and the Pt layer 125 are separated by the sidewalls of the mesa structure 115, so that the exposed portion of the contact layer 121 is affected. Stress is relieved. Therefore, the same effect can be obtained in this embodiment as well. Conversely, even if part of the clad layer 120 is exposed in the mesa structure, if the Ti layer 124 and/or the Pt layer 125 are discontinuous, the same effects as in this embodiment can be obtained.

[第5実施形態]
図9は、本願実施形態による半導体光素子のメサ構造の拡大断面図を示している。本実施形態では、Ti層124とPt層125の厚さが異なることを除いて第1実施形態と同様である。ここではTi層厚は50nm、Pt層厚は100nmとした。なお、コンタクト層121の埋め込み層122から露出した部分の厚さHは200nmである。本実施形態では、Ti層124とPt層125がメサ構造115の側壁で分離しているので、コンタクト層121の露出した部分へ及ぼされる応力は緩和される。ただし、Ti層124とPt層125の合計の厚さはHより薄いために、メサ構造の側壁にはAu層126が接している。Au層126が半導体層(コンタクト層121)に接している場合は、Auが半導体内部に拡散する恐れがあるが、その領域が小さい場合は信頼性などへの影響は小さい。そのため、本構造においても本願発明の効果は得られる。
[Fifth embodiment]
FIG. 9 shows an enlarged cross-sectional view of the mesa structure of the semiconductor optical device according to the embodiment of the present application. This embodiment is the same as the first embodiment except that the Ti layer 124 and the Pt layer 125 have different thicknesses. Here, the Ti layer thickness is 50 nm and the Pt layer thickness is 100 nm. The thickness H of the portion of the contact layer 121 exposed from the buried layer 122 is 200 nm. In this embodiment, since the Ti layer 124 and the Pt layer 125 are separated by the sidewalls of the mesa structure 115, the stress applied to the exposed portion of the contact layer 121 is relieved. However, since the total thickness of the Ti layer 124 and the Pt layer 125 is thinner than H, the Au layer 126 is in contact with the side wall of the mesa structure. When the Au layer 126 is in contact with the semiconductor layer (contact layer 121), Au may diffuse into the semiconductor. Therefore, the effects of the present invention can be obtained in this structure as well.

なお、本実施形態1乃至3と実施形態4,5は各々適宜組み合わせても良い。本願発明は、メサ構造の一部が埋め込み層より露出している状態において、Ti層及び/又はPt層が不連続でメサ上部から埋め込み層上部に配置されていることに特徴がある。 The first to third embodiments and the fourth and fifth embodiments may be combined as appropriate. The present invention is characterized in that the Ti layer and/or the Pt layer are discontinuously arranged from the top of the mesa to the top of the buried layer in a state where a part of the mesa structure is exposed from the buried layer.

[本願実施形態による半導体光素子の製造方法]
本願実施形態による半導体光素子の製造方法が図10,11,12,13示されている。最初に図10に示されているように、複数の層を含む発光に適した活性層119が基板118上に堆積され、活性層119上にクラッド層120が堆積され、p型InPクラッド層120上にコンタクト層121が堆積される。基板118はたとえばn型InP基板であってよい。活性層119はたとえば多重量子井戸であってよい。活性層119はまた、レーザの発振状態を制御する回折格子層を有してよい。コンタクト層121はたとえばp型InGaAsであってよい。
[Method for manufacturing a semiconductor optical device according to the embodiment of the present application]
10, 11, 12 and 13 show a method of manufacturing a semiconductor optical device according to the present embodiment. First, as shown in FIG. 10, an active layer 119 suitable for light emission comprising multiple layers is deposited on a substrate 118, a cladding layer 120 is deposited on the active layer 119, and a p-type InP cladding layer 120 is deposited. A contact layer 121 is deposited thereon. Substrate 118 may be, for example, an n-type InP substrate. Active layer 119 may be, for example, multiple quantum wells. Active layer 119 may also include a grating layer that controls the oscillation state of the laser. Contact layer 121 may be, for example, p-type InGaAs.

次にエッチング処理によりメサ構造115が形成され、続いて埋め込み層122を選択的に堆積することによってBH構造が形成される。たとえば埋め込み層122は半絶縁性InPであってよい。メサ構造115の幅は単一モード発振条件を満たすように決定されることが好ましい。メサ構造115の幅はたとえば約2マイクロメートル以下であってよい。埋め込み層122の結晶成長時には、メサ上部にはメサ幅より少し太い幅のマスクが配置されているために、図11に示されているように、埋め込み層122はメサ上部において少し平坦な領域があり、その後結晶面に沿って斜め上に延び、また平坦部が続く形状となる。続いて、埋め込み層122の上面にパッシベーション膜123を成膜した後、メサ構造115の幅より大きな幅でパッシベーション膜123をエッチングし、メサ構造115との電気的接続のための構造が作成される(図11)。 An etching process then forms the mesa structure 115 followed by selective deposition of the buried layer 122 to form the BH structure. For example, buried layer 122 may be semi-insulating InP. The width of the mesa structure 115 is preferably determined to satisfy single mode oscillation conditions. The width of mesa structure 115 may be, for example, about 2 microns or less. During the crystal growth of the buried layer 122, since a mask having a width slightly larger than the mesa width is arranged over the mesa, the buried layer 122 has a slightly flat region above the mesa as shown in FIG. After that, it extends obliquely upward along the crystal plane, and a flat part continues. Subsequently, after forming a passivation film 123 on the upper surface of the buried layer 122, the passivation film 123 is etched with a width larger than the width of the mesa structure 115 to create a structure for electrical connection with the mesa structure 115. (Fig. 11).

その後図12に示されているように、コンタクト層121の側部が埋め込み層122から露出するようにエッチングが行なわれる。コンタクト層121は埋め込み層122から全体又は一部が露出する。 Thereafter, as shown in FIG. 12, etching is performed so that the sides of contact layer 121 are exposed from buried layer 122 . The contact layer 121 is exposed entirely or partially from the buried layer 122 .

次に図13に示されているように、Ti層124、Pt層125、及びAu層126がこの順に堆積される。結果としてp型電極が形成される。最後に基板118の裏面にn型電極127が形成される。 Next, as shown in FIG. 13, a Ti layer 124, a Pt layer 125 and an Au layer 126 are deposited in this order. A p-type electrode is formed as a result. Finally, an n-type electrode 127 is formed on the back surface of the substrate 118 .

以上の構造により、本発明はコンタクト層上面にTi、Pt、及びAuからなるオーミック電極による抵抗値の小さい電気的接続を有し、Ti層124及び/又はPt層125がコンタクト層側部において分離していることで、Ti層124及び/又はPt層125によるコンタクト層側部への応力が緩和される。これにより、メサ構造115に及ぼされる応力が低減される。結果として、応力に起因する屈折率変化及び回折格子ピッチの変化が低減されること等で、SMSR歩留り向上が実現される。 With the above structure, the present invention has an electrical connection with a small resistance value by an ohmic electrode made of Ti, Pt, and Au on the upper surface of the contact layer, and the Ti layer 124 and/or the Pt layer 125 are separated on the side of the contact layer. As a result, the stress exerted by the Ti layer 124 and/or the Pt layer 125 on the sides of the contact layer is relaxed. This reduces the stress exerted on the mesa structure 115 . As a result, stress-induced refractive index changes and diffraction grating pitch changes are reduced, thereby improving the SMSR yield.

本実施形態は、InGaAsP系EA-DFBレーザについて述べたが、BH構造を有するその他材料を用いた半導体レーザ、および半導体レーザ集積素子にも同様の効果が期待できる。さらに、この半導体光素子110を用いた光送信モジュール106、光送受信モジュール100においても同様の効果が得られることは言うまでもない。 Although the InGaAsP-based EA-DFB laser has been described in this embodiment, similar effects can be expected for semiconductor lasers using other materials having a BH structure and semiconductor laser integrated devices. Furthermore, it goes without saying that the same effect can be obtained in the optical transmission module 106 and the optical transmission/reception module 100 using this semiconductor optical device 110. FIG.

100 光送受信モジュール、101 筺体、102 エッジ・コネクタ、103 プリント基板、104 集積回路、105 フレキシブル基板、106 光送信モジュール、107 光受信モジュール、108a,b 光ファイバコネクタ、109 チップキャリア、110 半導体光素子、111 凸レンズ、112 レーザ部、113 導波路部、114 変調器部、115 メサ構造、116 電極、117 電極パッド、118 基板、119 活性層、120 クラッド層、121 コンタクト層、122 埋め込み層、123 パッシベーション膜、124 Ti層、125 Pt層、126 Au層、127 電極。 100 optical transceiver module 101 housing 102 edge connector 103 printed board 104 integrated circuit 105 flexible substrate 106 optical transmitter module 107 optical receiver module 108a, b optical fiber connector 109 chip carrier 110 semiconductor optical device , 111 convex lens, 112 laser section, 113 waveguide section, 114 modulator section, 115 mesa structure, 116 electrode, 117 electrode pad, 118 substrate, 119 active layer, 120 clad layer, 121 contact layer, 122 embedded layer, 123 passivation Membrane, 124 Ti layer, 125 Pt layer, 126 Au layer, 127 electrode.

Claims (12)

第一導電型を有する基板と、
前記基板上に設けられる活性層、該活性層上に設けられて前記第一導電型とは異なる第二導電型を有するクラッド層、及び前記クラッド層上に設けられる第二導電型を有するコンタクト層を含むメサ構造と、
前記基板上に設けられ、かつ、前記メサ構造の上部が露出するように前記メサ構造を埋め込む埋め込み層と、
前記メサ構造の前記上部上と前記埋め込み層上に設けられる電極層、
を有し、前記電極層は、前記メサ構造の前記上部に接触する接着層、導電層、及び前記接着層及び前記導電層の間にあるバリア層を含み、
前記接着層は、前記メサ構造の前記上部との接着強度において、前記電極層の他のどの層よりも強く、
前記接着層、前記導電層、及び前記バリア層が、前記コンタクト層上でオーミック電極を構成し、
前記電極層は、前記接着層及び前記バリア層のうちの一の層と、前記接着層及び前記バリア層の他の層を含み、
前記メサ構造上及び前記埋め込み層上に設けられた前記電極層の、前記一の層及び前記他の層の少なくとも一方は、前記メサ構造の前記上部にある部分と前記埋め込み層にある部分に分離されている、
ことを特徴とする半導体光素子。
a substrate having a first conductivity type;
an active layer provided on the substrate, a clad layer provided on the active layer and having a second conductivity type different from the first conductivity type, and a contact layer provided on the clad layer and having a second conductivity type a mesa structure comprising
a burying layer provided on the substrate and burying the mesa structure so that an upper portion of the mesa structure is exposed ;
an electrode layer provided on the upper portion of the mesa structure and on the buried layer;
wherein the electrode layer comprises an adhesion layer contacting the upper portion of the mesa structure, a conductive layer, and a barrier layer between the adhesion layer and the conductive layer;
the adhesion layer has a higher adhesion strength to the upper portion of the mesa structure than any other layer of the electrode layer;
the adhesive layer, the conductive layer, and the barrier layer form an ohmic electrode on the contact layer;
the electrode layer includes one layer of the adhesion layer and the barrier layer and the other layer of the adhesion layer and the barrier layer;
At least one of the one layer and the other layer of the electrode layer provided on the mesa structure and on the buried layer is separated into a portion on the top of the mesa structure and a portion on the buried layer. has been
A semiconductor optical device characterized by:
請求項1に記載の半導体光素子であって、
前記他の層の厚さが、前記メサ構造の前記上部が前記埋め込み層から露出している部分の厚さより厚く、
前記他の層は前記コンタクト層上から前記埋め込み層上において、連続的に繋がっており、
前記一の層は、前記メサ構造の前記上部の側壁で分離する、
ことを特徴とする半導体光素子。
The semiconductor optical device according to claim 1,
the thickness of the other layer is thicker than the thickness of the portion where the upper portion of the mesa structure is exposed from the buried layer;
the other layer is continuously connected from the contact layer to the embedded layer;
the one layer is separated by a sidewall of the upper portion of the mesa structure;
A semiconductor optical device characterized by:
請求項1に記載の半導体光素子であって、
前記一の層の厚さが、前記メサ構造の前記上部が前記埋め込み層から露出している部分の厚さより厚く、
前記一の層は前記コンタクト層上から前記埋め込み層上において、連続的に繋がっており、
前記他の層は、前記メサ構造の前記上部の側壁で分離する、
ことを特徴とする半導体光素子。
The semiconductor optical device according to claim 1,
the thickness of the one layer is thicker than the thickness of the portion where the upper portion of the mesa structure is exposed from the buried layer;
the one layer is continuously connected from the contact layer to the embedded layer;
the other layer is separated by a sidewall of the upper portion of the mesa structure;
A semiconductor optical device characterized by:
請求項1に記載の半導体光素子であって、
前記メサ構造の内、前記埋め込み層から露出している領域は、前記コンタクト層の一部である、
ことを特徴とする半導体光素子。
The semiconductor optical device according to claim 1,
A region of the mesa structure exposed from the buried layer is part of the contact layer,
A semiconductor optical device characterized by:
請求項1に記載の半導体光素子であって、
前記一の層と前記他の層の厚さの合計は、前記メサ構造の前記上部が前記埋め込み層から露出している厚さより薄い、
ことを特徴とする半導体光素子。
The semiconductor optical device according to claim 1,
the sum of the thicknesses of the one layer and the other layer is less than the thickness at which the upper portion of the mesa structure is exposed from the buried layer;
A semiconductor optical device characterized by:
請求項1乃至4のいずれか一項に記載の半導体光素子であって、
前記一の層と前記他の層の厚さの合計は、前記メサ構造の前記上部が前記埋め込み層から露出している厚さより厚い、
ことを特徴とする半導体光素子。
The semiconductor optical device according to any one of claims 1 to 4,
the sum of the thicknesses of the one layer and the other layer is greater than the thickness of the upper portion of the mesa structure exposed from the buried layer;
A semiconductor optical device characterized by:
請求項1乃至3のいずれか一項に記載の半導体光素子であって、
前記メサ構造の内、前記埋め込み層から露出している領域は、前記コンタクト層の全部である、
ことを特徴とする半導体光素子。
The semiconductor optical device according to any one of claims 1 to 3,
A region of the mesa structure exposed from the buried layer is the entire contact layer,
A semiconductor optical device characterized by:
請求項1乃至7のいずれか一項に記載の半導体光素子であって、
前記接着層はTiであり、
前記バリア層はPtである、
ことを特徴とする半導体光素子。
The semiconductor optical device according to any one of claims 1 to 7,
the adhesion layer is Ti,
the barrier layer is Pt;
A semiconductor optical device characterized by:
請求項1乃至8のいずれか一項に記載の半導体光素子を備える光送信モジュール。 An optical transmission module comprising the semiconductor optical device according to claim 1 . 請求項1乃至8のいずれか一項に記載の半導体光素子を備える光送受信モジュール。 An optical transceiver module comprising the semiconductor optical device according to claim 1 . 第一導電型を有する基板と、a substrate having a first conductivity type;
前記基板上に設けられる活性層、該活性層上に設けられて前記第一導電型とは異なる第二導電型を有するクラッド層、及び前記クラッド層上に設けられる第二導電型を有するコンタクト層を含むメサ構造と、an active layer provided on the substrate, a clad layer provided on the active layer and having a second conductivity type different from the first conductivity type, and a contact layer provided on the clad layer and having a second conductivity type a mesa structure comprising
前記基板上に設けられ、かつ、前記メサ構造を埋め込む埋め込み層と、an embedding layer provided on the substrate and embedding the mesa structure;
前記コンタクト層上と前記埋め込み層上に設けられる少なくとも2つの層を含む電極層、an electrode layer comprising at least two layers provided on said contact layer and said buried layer;
を有し、has
前記メサ構造の上部は前記埋め込み層から露出し、an upper portion of the mesa structure is exposed from the buried layer;
前記メサ構造上と前記埋め込み層上に堆積される前記電極層のうちの一の層及び/又は該一の層上に堆積される他の層は、前記メサ構造の前記上部の側壁で分離し、One of the electrode layers deposited on the mesa structure and the buried layer and/or another layer deposited on the one layer are separated by sidewalls of the upper portion of the mesa structure. ,
前記一の層の厚さが、前記メサ構造の前記上部が前記埋め込み層から露出している部分の厚さより厚く、the thickness of the one layer is thicker than the thickness of the portion where the upper portion of the mesa structure is exposed from the buried layer;
前記一の層は前記コンタクト層上から前記埋め込み層上において、連続的に繋がっており、the one layer is continuously connected from the contact layer to the embedded layer;
前記他の層は、前記メサ構造の前記上部の側壁で分離する、the other layer is separated by a sidewall of the upper portion of the mesa structure;
ことを特徴とする半導体光素子。A semiconductor optical device characterized by:
第一導電型を有する基板と、a substrate having a first conductivity type;
前記基板上に設けられる活性層、該活性層上に設けられて前記第一導電型とは異なる第二導電型を有するクラッド層、及び前記クラッド層上に設けられる第二導電型を有するコンタクト層を含むメサ構造と、an active layer provided on the substrate, a clad layer provided on the active layer and having a second conductivity type different from the first conductivity type, and a contact layer provided on the clad layer and having a second conductivity type a mesa structure comprising
前記基板上に設けられ、かつ、前記メサ構造を埋め込む埋め込み層と、an embedding layer provided on the substrate and embedding the mesa structure;
前記コンタクト層上と前記埋め込み層上に設けられる少なくとも2つの層を含む電極層、an electrode layer comprising at least two layers provided on said contact layer and said buried layer;
を有し、has
前記メサ構造の上部は前記埋め込み層から露出し、an upper portion of the mesa structure is exposed from the buried layer;
前記メサ構造上と前記埋め込み層上に堆積される前記電極層のうちの一の層及び/又は該一の層上に堆積される他の層は、前記メサ構造の前記上部の側壁で分離し、One of the electrode layers deposited on the mesa structure and the buried layer and/or another layer deposited on the one layer are separated by sidewalls of the upper portion of the mesa structure. ,
前記電極層のうちの一の層はTiであり、one of the electrode layers is Ti;
前記電極層のうちの他の層はPtである、the other of the electrode layers is Pt;
ことを特徴とする半導体光素子。A semiconductor optical device characterized by:
JP2018119555A 2018-06-25 2018-06-25 Semiconductor optical device and optical transmission module Active JP7112262B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2018119555A JP7112262B2 (en) 2018-06-25 2018-06-25 Semiconductor optical device and optical transmission module

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2018119555A JP7112262B2 (en) 2018-06-25 2018-06-25 Semiconductor optical device and optical transmission module

Publications (2)

Publication Number Publication Date
JP2020004754A JP2020004754A (en) 2020-01-09
JP7112262B2 true JP7112262B2 (en) 2022-08-03

Family

ID=69100365

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2018119555A Active JP7112262B2 (en) 2018-06-25 2018-06-25 Semiconductor optical device and optical transmission module

Country Status (1)

Country Link
JP (1) JP7112262B2 (en)

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2008277492A (en) 2007-04-27 2008-11-13 Matsushita Electric Ind Co Ltd Semiconductor light-emitting device and method of manufacturing the same
JP2012019053A (en) 2010-07-07 2012-01-26 Opnext Japan Inc Semiconductor optical element, optical transmission module, optical transmission and reception module, and optical transmission apparatus
JP2012059890A (en) 2010-09-08 2012-03-22 Nichia Chem Ind Ltd Nitride semiconductor laser element and method of manufacturing the same

Family Cites Families (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3192687B2 (en) * 1991-07-24 2001-07-30 株式会社東芝 Semiconductor laser device and method of manufacturing the same

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2008277492A (en) 2007-04-27 2008-11-13 Matsushita Electric Ind Co Ltd Semiconductor light-emitting device and method of manufacturing the same
JP2012019053A (en) 2010-07-07 2012-01-26 Opnext Japan Inc Semiconductor optical element, optical transmission module, optical transmission and reception module, and optical transmission apparatus
JP2012059890A (en) 2010-09-08 2012-03-22 Nichia Chem Ind Ltd Nitride semiconductor laser element and method of manufacturing the same

Also Published As

Publication number Publication date
JP2020004754A (en) 2020-01-09

Similar Documents

Publication Publication Date Title
JP5387671B2 (en) Semiconductor laser and integrated device
US7593445B2 (en) Semiconductor optical device and optical transmission module
JP5451332B2 (en) Optical semiconductor device
US7463663B2 (en) Semiconductor laser diode and integrated semiconductor optical waveguide device
JP6717733B2 (en) Semiconductor optical integrated circuit
JP2005051039A (en) Waveguide type photodetector
US7567601B1 (en) Semiconductor laser having low stress passivation layer
JP2827411B2 (en) Optical semiconductor device and method of manufacturing the same
WO2020245935A1 (en) Optical device
JP7112262B2 (en) Semiconductor optical device and optical transmission module
JP4411938B2 (en) Modulator integrated semiconductor laser, optical modulation system, and optical modulation method
JP2020021865A (en) Semiconductor optical element and optical transceiver module
JP2005072273A (en) Waveguide type light-receiving element
US7573925B1 (en) Semiconductor laser having a doped active layer
JP7134350B2 (en) Semiconductor optical integrated device and method for manufacturing semiconductor optical integrated device
US10680409B2 (en) Laser device
JP2004311556A (en) Semiconductor laser, optical module using the same, and functionally integrated laser
JPS6136987A (en) Distribution feedback type semiconductor laser provided with light detector
JPH10275960A (en) Optical semiconductor element
JP2605911B2 (en) Optical modulator and photodetector
JP2005216954A (en) Semiconductor light element
US20220206226A1 (en) Semiconductor optical device and method for manufacturing the same
JP7147979B2 (en) optical device
WO2023276106A1 (en) Semiconductor optical device
JP6479293B1 (en) Optical transmission device

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20210602

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20220322

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20220405

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20220602

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20220705

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20220722

R150 Certificate of patent or registration of utility model

Ref document number: 7112262

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150